JP3036619B2 - Soi基板の製造方法およびsoi基板 - Google Patents
Soi基板の製造方法およびsoi基板Info
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Description
に絶縁層を形成するSOI基板の製造方法およびSOI
基板に関する。
路を作り込むよりも、絶縁材料上に設けられた薄い単結
晶シリコン層に各種の素子を形成するほうが、素子特性
や素子間分離の点で有利である。このような見地から、
単結晶シリコン基板にSiO2の絶縁膜を介して素子形
成のためのシリコン単結晶層を設けたSOI基板が用い
られている。
がある。SIMOX基板は、単結晶シリコン基板に高濃
度の酸素イオン(16O+ )を注入して前記基板内の所定
の深さに高濃度酸素イオン注入層を形成し、これを11
00〜1300℃の温度で数時間アニールすることによ
って前記高濃度酸素イオン注入層を埋め込み酸化膜すな
わちSiO2 の絶縁膜に変化させる。SIMOX基板
は、貼り合わせ基板のように表面のシリコン単結晶層を
研磨加工せずに均一な厚さの活性領域層とすることがで
きる。
酸素イオンを注入し、アニール処理によって前記基板に
埋め込み酸化膜を形成する場合、次のような問題点があ
る。 (1)高品質のSIMOX基板は、表面のシリコン単結
晶層の転位密度が低く、埋め込み酸化膜の電気絶縁性に
優れている。しかし、埋め込み酸化膜の膜厚が80〜9
0nmと薄いため、図9に示すように酸素イオン注入時
に単結晶シリコン基板1の表面にパーティクル10が付
着すると、このパーティクル10がマスク作用をして高
濃度酸素イオン注入層3に注入不能部分ができる。前記
高濃度酸素イオン注入層はアニール処理により埋め込み
酸化膜5となるが、酸素イオン注入不能部分はピンホー
ル9となって電気絶縁性が低下する。なお、2は表面の
シリコン単結晶層、6はアニール酸化膜である。
シリコン単結晶層における転位密度との相関を示す
(J.Mater.Res.,Vol.8,No.3,
Mar1993 pp.523−534参照)。酸素イ
オン注入量を1.0×1018/cm2 〜2.0×1018
/cm2 に増加させて埋め込み酸化膜の膜厚を大きくし
た基板では、表面のシリコン単結晶層における結晶欠陥
すなわち転位密度が増大する。特に1.5×1018/c
m2 以上では、転位密度が急激に高くなる。
で酸素イオン注入量を0.5×10 18/cm2 〜0.9
×1018/cm2 に増加させた基板は、図11に示すよ
うに埋め込み酸化膜の破壊電界の強さが0〜1MV/c
mと小さく、電気絶縁性が低い。
基板では、表面のシリコン単結晶層と埋め込み酸化膜と
の界面(以下埋め込み酸化膜界面と略称する)の凹凸が
大きく(平方根平均ラフネスRmsが約2nm以上)、デ
バイスの特性にばらつきが出やすい。このようなSIM
OX基板は、長時間を費やして十分にアニール処理を施
すことにより埋め込み酸化膜が平坦化されるが、その実
施はコスト的に不可能である。
れたもので、SIMOX基板において表面のシリコン単
結晶層における結晶欠陥の増大を避けるために、酸素イ
オン注入量を増加せずに埋め込み酸化膜の厚膜化ができ
るSOI基板の製造方法を提供することを目的とする。
また、第2には、埋め込み酸化膜におけるピンホール密
度を低減することができるSOI基板の製造方法を提供
することを目的としている。更に、第3の目的は、埋め
込み酸化膜界面の平坦度を向上させることができるよう
なSOI基板の製造方法を提供することにある。また、
表面シリコン層への結晶欠陥がなく酸素イオン注入量に
より決定される埋め込み酸化膜の理論的膜厚より厚膜化
し、ピンホール発生率が極めて少なく、埋め込み酸化膜
界面の平坦度を向上させた構造のSOI基板を提供する
ことを目的としている。
入後にアニール処理を行うことにより予め埋め込み酸化
膜を形成したSIMOX基板を対象として、この基板を
高温酸化処理することにより、埋め込み酸化膜が膜成長
する現象を見い出したことによって実現されたものであ
る。SIMOX基板での表面活性シリコン層の厚さが3
20nm、埋め込み酸化膜の厚さが89nmを対象と
し、この基板を1350℃、不活性ガスアルゴン(A
r)中に流量比(以下同じ)で70%O2の酸素雰囲気
中におき、4時間の酸化処理を行ったところ、埋め込み
酸化膜は118nmに増膜する現象が見られた。そこ
で、温度条件を変え各酸化温度に対し、表面酸化膜厚が
約400nmと一定(表面のシリコン層の酸化される量
は180nmで一定)になるように時間を変化して埋め
込み酸化膜の増加量を求めたところ、図3に示すよう
に、酸化温度が上昇するにしたがって、埋め込み酸化膜
の膜厚が増加することが確認された(酸化時間77分〜
405分)。増膜作用は1150℃以上で確認された。
このことから、高温になるほど、内部の埋め込み酸化膜
が厚く酸化され、表面の酸化膜厚が同一でも内部の酸化
膜増加率が高いことが理解できる。同様に、図4は酸化
時間を4時間に固定し、O2濃度を70%に固定した場
合である。これによれば、酸化時間を一定時間に統一し
た場合の膜厚増加の温度依存性が理解でき、実用的な範
囲では1150℃以下は検出レベル以下となってしまう
ことが解る。なお、これらの図において、横軸の酸化温
度は絶対温度の逆数の104 倍の数値で表されている。
なお、各図の上部に摂氏の温度を併記している。これら
の図で明らかなように、酸化温度の上昇に伴って埋め込
み酸化膜増加量も増大する。酸化温度が1150℃以下
では埋め込み酸化膜増加量も僅かであり、あるいは酸化
時間を実用的な長さたとえば4時間とすると、その増加
量は検出レベル以下で、厚膜化の効果がないが、酸化温
度が1350℃に上昇すると埋め込み酸化膜増加量は約
30nmとなる。従来技術によるSIMOX基板の埋め
込み酸化膜厚が80〜90nmであるのに対し、本発明
を適用して1350℃で酸化処理し、表面酸化膜厚を約
400nmとした場合は埋め込み酸化膜厚が100〜1
10nmに増加することが確認できる。したがって、増
膜効果を得るためには少なくとも1150℃以上の温度
条件を必要とし、これはアニール処理温度に匹敵してい
る。また、上限温度はシリコンの融点が1415℃であ
るため、これより低い温度条件とする必要がある。
的には高い濃度が増膜作用に寄与すると考えられること
から、アニール処理後に1350℃の温度条件で4時間
の酸化処理による異なる酸素分圧による埋め込み酸化膜
の増膜量を実験的に求めたところ、図5に示すような特
性線図が得られた。これによれば、約1%O2の濃度以
上のときに増膜効果が得られることが理解でき、0.5
%濃度では増膜分は非常に少なく、また、界面の凹凸と
の差異が判別できないので、1%酸素濃度以上で増膜効
果が得られるものと考えられる。これは、雰囲気中の酸
素が、少なくとも表面シリコン層や基板シリコン層から
内部に拡散され、埋め込み酸化膜の界面部へSiO2が
滞留積層されるには、基本的に温度条件を主因子として
調整することができるので、シリコン層への拡散に最低
限の濃度としては上記1%O2の濃度以上を要するもの
と考えられる。もちろん所定の高温下で酸素濃度を因子
として増膜作用を行わせることができることは図5から
理解できる。
デバイス条件に応じて、より薄膜化することが要求され
る場合があり、この場合にはいわゆる犠牲酸化処理によ
り調整できる。この犠牲酸化処理としては熱酸化によっ
て表面に酸化膜を形成し、表面シリコン層から酸化膜を
公知の手法により除去することで、酸化膜厚さの分だけ
表面シリコン層を薄膜化できる。犠牲酸化によって埋め
込み酸化膜への影響を回避するため、酸化温度はアニー
ル温度より低い温度条件に設定すればよく、したがって
1100℃以下で酸化処理を行えばよい。この犠牲酸化
処理は埋め込み酸化膜の増膜工程より前で行ってもよ
く、あるいは増膜処理の後工程で行うこともできる。
法は、まず、単結晶シリコン基板に酸素イオンを打ち込
み注入した後、不活性ガス雰囲気中で高温でアニール処
理を行うことにより埋め込み酸化膜を形成し、表面層に
基板と絶縁分離された単結晶シリコン層を形成するSO
I基板の製造方法において、前記埋め込み酸化膜の膜厚
が酸素イオン注入量により計算される理論的膜厚になる
アニール処理を行った後、前記基板に高温酸素雰囲気中
で酸化処理を施すことにより前記アニール処理後の埋め
込み酸化膜を厚膜化するように構成することによって上
記目的を達成するようにした。
は上述したように1150℃以上、単結晶シリコン基板
の融点温度未満の範囲内に保つようにすればよく、前記
高温酸化処理は、アニール時の酸素濃度より高い濃度の
酸素ガス雰囲気中で行うようにすればよい。更に、前記
高温雰囲気中における酸化処理後基板表面の酸化膜除去
を実施し、引き続いて、1100℃以下の温度で犠牲酸
化を行った後、犠牲酸化膜を除去することにより表面シ
リコン層の薄膜化をなし、あるいはアニール処理後に1
100℃以下の温度で犠牲酸化を行った後、犠牲酸化膜
を除去し、引き続いて高温雰囲気中における酸化処理を
施すことにより表面シリコン層の薄膜化をなすようにす
ることができる。犠牲酸化は表面のシリコン層のみを酸
化することが望ましいが、SOI基板を1150℃以上
の高温で酸化すると、埋め込み酸化膜も増膜してしまう
ので、膜厚のコントロールが困難になるため、高温酸化
条件温度より低く設定する必要がある。そこで、犠牲酸
化の場合には埋め込み酸化膜への影響を与えない温度で
ある1100℃が上限温度となる。
度のガス雰囲気中で行うことにより絶縁埋め込み酸化膜
の増膜作用を確実に実現できる。
打ち込み注入した後、不活性ガス雰囲気中で高温アニー
ル処理を行うことにより埋め込み酸化膜を形成し、表面
層に基板と絶縁分離された単結晶シリコン層を形成する
SOI基板の製造方法において、前記埋め込み酸化膜の
膜厚が酸素イオン注入量により計算される理論的膜厚に
なるアニール処理を行った後、酸化温度に対する埋め込
み酸化膜厚の増膜特性線図を予め求めておき、この特性
線図により必要膜厚となる温度条件の高温雰囲気中で前
記基板を酸化処理することによって埋め込み酸化膜を厚
膜化することにより、表面シリコン層の結晶欠陥を発生
させることなく絶縁耐圧を高めることができる。
み注入した後、不活性ガス雰囲気中で高温アニール処理
を行うことにより埋め込み酸化膜を形成し、表面層に基
板と絶縁分離された単結晶シリコン層を形成するSOI
基板の製造方法において、前記埋め込み酸化膜の膜厚が
酸素イオン注入量により計算される理論的膜厚になるア
ニール処理を行った後、酸化温度に対する埋め込み酸化
膜厚の増膜特性線図を予め求めておき、この特性線図に
より埋め込み酸化膜に発生したピンホールを閉塞するに
必要な増膜量に対応する温度条件を求め、当該温度条件
の高温雰囲気中で前記基板を酸化処理することによって
埋め込み酸化膜を厚膜化することにより、パーティクル
付着によりイオン注入がなされない埋め込み絶縁層の欠
損部分の補修作用を行わせ、これによって絶縁耐圧強度
を向上させることができる。ピンホールの直径や個数は
酸素イオンの注入条件によって変化するため、実際のピ
ンホールを直接把握することは困難であるが、設定され
たイオン注入条件から発生するピンホールの数や大きさ
を統計的手法等によって求めておき、特に分布の高いピ
ンホール径を低減するように埋め込み酸化膜の増膜量を
決定すればよい。例えば、ピンホール径が50nmであ
る場合には増膜量はその2分の1の25nmとなるの
で、これを基準に設定すればよい。
打ち込み注入した後、不活性ガス雰囲気中で高温でアニ
ール処理を行うことにより埋め込み酸化膜を形成し、表
面層に基板と絶縁分離された単結晶シリコン層を形成す
るSOI基板の製造方法において、前記埋め込み酸化膜
の膜厚が酸素イオン注入量により計算される理論的膜厚
になるアニール処理を行った後、酸化温度に対する埋め
込み酸化膜厚の増膜特性線図を予め求めておき、この特
性線図により埋め込み酸化膜の界面平坦化に必要な増膜
量に対応する温度条件を求め、当該温度条件の高温雰囲
気中で前記基板を酸化処理することによって埋め込み酸
化膜を厚膜化することによって、イオン注入による凹凸
界面性状を改善し、作成されるデバイスの電気的特性を
均質化することができる。平坦度の改善効果に対して、
増膜量に対する平方根平均ラフネスRmsの関係を求める
と、図6に示すような特性図が得られる。デバイスによ
って要求される平坦度となるよう増膜量を上記特性図か
ら求めて高温酸化条件を設定すればよい。
を打ち込み注入した後、不活性ガス雰囲気中で高温でア
ニール処理を行うことにより埋め込み酸化膜を形成し、
表面層に基板と絶縁分離された単結晶シリコン層を形成
するSOI基板の製造方法において、前記酸素イオンを
打込み注入した基板を炉に入れて昇温させつつ表面ピッ
ト発生防止用の低酸素濃度で埋め込み酸化膜の膜厚が酸
素イオン注入量により計算される理論的膜厚になるアニ
ール処理を行い、酸素濃度を増量した高温高濃度酸素雰
囲気中で前記埋め込み酸化膜が形成された基板を酸化処
理することによって埋め込み酸化膜を厚膜化するように
構成した。酸素イオン注入されたシリコン基板は結晶欠
陥が入らないように、例えば800〜850℃で炉内を
不活性ガスで充満した熱処理炉内に導入し、その後、1
100〜1300℃程度まで昇温させて結晶安定化を図
る。アニール処理に際して表面にピットが発生すること
を防止するため、ガス雰囲気は0.5%濃度の酸素を含
ませている。このような低濃度酸素雰囲気中でのアニー
ル処理のための昇温過程が終了した状態ではガス雰囲気
温度はアニール温度かそれ以上の高温度に達しているた
め、ガス雰囲気中に例えば70%程度の酸素分圧となる
ように酸素濃度を調整しつつ、この温度を一定に保持し
て高温酸化を行うのである。これにより基板内の埋め込
み酸化膜は酸素イオン注入量によって決められる理論的
膜厚の界面で酸化膜が成長し、埋め込み酸化膜が理論値
より厚く形成されるのである。
シリコン基板に酸素イオンを注入し、アニールによって
前記基板内に埋め込み酸化膜を形成した後、高温酸化処
理を施したSIMOX基板であって、前記埋め込み酸化
膜の膜厚が90nmを超え、表面のシリコン単結晶層の
転位密度が100個/cm2 以下、埋め込み酸化膜のピ
ンホール密度が20個/cm2 以下で、かつ埋め込み酸
化膜界面の平方根平均ラフネスRmsが1nm以下とした
構成となっている。
ニール処理のみ行っていたSIMOX基板に、1150
℃以上、シリコン融点温度未満の高温雰囲気内で行う酸
化処理を追加したので、酸素イオン打込み注入に続く前
記アニール処理によって形成された理論的膜厚となって
いる埋め込み酸化膜の上に、更に酸化膜が形成され、埋
め込み酸化膜を厚膜化することができる。前記厚膜化
は、高温酸化時の酸素濃度を1%を超える値とすること
により達成可能となる。また、酸素イオン注入時に表面
のシリコン単結晶層にパーティクルが付着して埋め込み
酸化膜にピンホールが発生した場合や埋め込み酸化膜の
モホロジー(平坦度)が悪い場合も、前記高温酸化処理
によって形成された酸化膜がピンホールを補修し、ある
いはモホロジーを改善することができる。更に、高温酸
化処理の前後いずれかにおいて犠牲酸化処理を行うこと
としたので、表面のシリコン単結晶層を所望の厚さまで
薄膜化することが可能となる。
ール処理によって埋め込み酸化膜が形成された基板をア
ニールとは独立した工程で行うことができるが、アニー
ル処理を昇温過程で終了させ、昇温後に連続して高温酸
化することで連続した製造工程で埋め込み酸化膜の増膜
を図ることができる。すなわち、昇温中のみ低濃度(例
えば0.5%以下)の酸素を含むガス雰囲気中でアニー
ル処理を行い、昇温後にその温度を一定に保持して酸素
濃度を高濃度に変えて酸化処理を行えば、連続した製造
工程にすることができる。
られるSIMOX基板は、従来技術による低転位密度の
SIMOX基板に比べて埋め込み酸化膜厚が厚く、埋め
込み酸化膜中のピンホール密度が低い。また、埋め込み
酸化膜界面の平坦度も改善されている。
の実施例について、図面を参照して説明する。図1は、
SOI基板製造工程の流れを基板の模式的な部分断面に
よって示す説明図である。第1工程は酸素イオン注入
で、イオン注入装置を用いて単結晶シリコン基板1に酸
素イオン16O+ を所定の深さに注入する。この場合、さ
きに述べた表面のシリコン単結晶層2における転位密度
の増大や埋め込み酸化膜の破壊電界の強さの低下を回避
するため、酸素イオン注入量を0.5×1018/cm2
未満とする。3は高濃度酸素イオン注入層である。
いて単結晶シリコン基板1の表面にSiO2 のアニール
保護膜4を形成する。ただし、前記アニール保護膜を形
成せずに第3工程に進んでもよい。
分圧のArガス雰囲気で850℃に保持された炉内に基
板を入れ1350℃の温度に昇温して行う。このアニー
ル処理により結晶の安定化が行われ、高濃度酸素イオン
注入層は埋め込み酸化膜5に変化する。6はアニール酸
化膜である。ここまでは従来技術と同一の工程である。
板1を1150℃以上、融点温度未満の温度範囲で数時
間加熱する。このときのO2 ガス濃度は1%を超え、1
00%までの範囲内に保つものとする。図1ではこの酸
化処理によって実現する3種類の改良状況をそれぞれ示
している。図1の左側の工程は埋め込み酸化膜厚膜化で
あり、前記アニール工程で形成された埋め込み酸化膜5
の上に埋め込み酸化膜増加分7が形成される。8は前記
高温酸化によって増加した表面酸化膜である。中央の工
程はピンホール低減であり、酸素イオン注入時に単結晶
シリコン基板1の表面にパーティクルが付着した場合
に、さきに述べたマスク作用によって発生する埋め込み
酸化膜のピンホール9が補修される。右側の工程は埋め
込み酸化膜界面平坦化であり、埋め込み酸化膜5上面の
凹凸は埋め込み酸化膜増加分7によって平坦化される。
なお、第3の工程の実施で形成されたアニール膜6を除
去した後に第4の工程を実施してもよい。第5工程は犠
牲酸化で、表面のシリコン単結晶層2を薄膜化する目的
で行う酸化処理である。この犠牲酸化は、8の表面酸化
膜除去後に実施してもよい。犠牲酸化工程はアニール工
程と高温酸化工程の間に入れてもよい。また、この犠牲
酸化工程は6のアニール酸化膜除去後に実施してもよ
い。
理を昇温させながら行い、昇温後に引続いて高温酸化を
行うようにすることができる。すなわち、アニール処理
をなす第3工程を予め基板を炉内に入れておき、アニー
ルガスが充満している炉の温度を昇温させる過程でアニ
ールするようにし、炉内温度が1200℃以上の例えば
1350℃に達した状態で炉内温度を一定に保持させ
る。そして、昇温後に炉内に酸素を供給増量し、内部酸
素分圧が70%程度の高濃度になるように調整すること
により、第4工程の高温酸化処理を行うのである。この
処理過程の各例を図2(1)〜(3)に示す。図2
(1)の例は、初期の炉内温度は800〜850℃と
し、炉内にアニールガスを充填して昇温させ、埋め込み
酸化膜5を形成する。このアニール処理の後、独立して
高温酸化処理を行うようにしたものである。高温酸化は
炉内雰囲気を例えば70%酸素濃度となるよう酸素分圧
を増大させた雰囲気にて充満させた後、1350℃まで
昇温させ、昇温後は温度を1350℃に保持して、高温
酸化を行うこととしたものである。図2(2)は(1)
の工程を連続した工程によって実現するようにしてお
り、高温アニールを一定時間行った後に、引続いて炉内
の酸素分圧を増大し、高温酸化を行うようにしている。
また、図2(3)の例は、アニール処理を炉内温度の昇
温過程で実施するようにし、昇温後は高温酸化処理とな
るように調整したものである。尚、図2においてアニー
ル温度と酸化温度を同一とせず、例えば酸化温度を13
00℃としてもよい。
述べる。 (1)酸素イオン注入:単結晶シリコン基板に、加速エ
ネルギー180keVでドーズ量0.4×1018/c
m2の酸素イオンを注入し、所定の深さに高濃度酸素イ
オン注入層を形成した。 (2)アニール:アニール温度を1350℃とし、Ar
に0.5%の濃度のO2を添加した雰囲気ガス中で4時
間実施して埋め込み酸化膜を形成させた。雰囲気ガスに
0.5%のO2を添加することにより、基板表面におけ
るピットの発生を防止している。 (3)高温酸化:酸化温度を1350℃とし、4時間実
施して埋め込み酸化膜を厚膜化した。O2濃度は1%を
超え、100%までの範囲内であればよいが、本実験例
ではアルゴンガス中に流量比で30%及び70%の酸素
濃度とした。O2濃度1%ではO2量が少ないため、埋
め込み酸化膜厚の増大が見られなかった。 (4)犠牲酸化:表面のシリコン単結晶層を薄膜化する
ため1100℃の熱酸化による犠牲酸化処理を施した。
その後に表面酸化膜を除去し、デバイス基板を得たもの
である。
したSIMOX基板の埋め込み酸化膜について、膜厚、
ピンホール密度および埋め込み酸化膜界面の平坦度を検
査したところ、下記の通りであった。
図4に酸化温度と埋め込み酸化膜増加量との関係を示
す。尚、膜厚は分光エリプソメーターにて測定した。図
3は、表面のシリコン単結晶層を約180nm酸化した
場合、図4は酸化時間を4時間に固定し、O2 濃度を7
0%とした場合である。これらの図で明らかなように、
酸化温度の上昇に伴って埋め込み酸化膜増加量も増大す
る。酸化温度が1100℃以下では埋め込み酸化膜増加
量も僅かであり、あるいは酸化時間を実用的な長さたと
えば4時間とすると、その増加量は検出レベル以下で、
厚膜化の効果がないが、酸化温度が1350℃に上昇す
ると埋め込み酸化膜増加量は約30nmとなる。従来技
術によるシリコン基板の埋め込み酸化膜厚が80〜90
nmであるのに対し、本発明を適用して1350℃で酸
化処理し、表面酸化膜厚を約400nmとした場合は埋
め込み酸化膜厚が100〜110nmに増加した。
に、従来技術では約53個/cm2 であったが、本発明
を適用して30%O2 ガスで1350℃、4時間の酸化
処理を行った場合は約18個/cm2 に低減した。な
お、1100℃での酸化処理では埋め込み酸化膜厚の増
加が見られないため、ピンホール密度の低減はなかっ
た。
込み酸化膜界面の平坦度は、希フッ酸でSIMOX基板
表面の酸化膜を除去し、次に水酸化カリウム溶液を用い
て表面のシリコン単結晶層を除去した上、埋め込み酸化
膜表面の凹凸を原子間力顕微鏡で観察することによって
求めた。図8(a)は酸素イオン注入後、Ar+0.5
%O2 の雰囲気中で1350℃、4時間のアニール処理
を行った比較例として従来技術によるSIMOX基板に
ついて観察した埋め込み酸化膜界面の模式的部分断面図
である。この埋め込み酸化膜界面のマイクロラフネス
(Rms)は1.881nm、凹凸の頂部と谷部との高さ
の差(P−V)は12.373nmであった。図8
(b)は比較例として酸素イオン注入後、Ar+0.5
%O2 の雰囲気中で1350℃、4時間のアニール処理
を行い、更に0.5%O2 ガスで1350℃、4時間の
酸化処理を行ったSIMOX基板の観察結果で、酸化処
理時の酸素濃度が低いため埋め込み酸化膜界面のマイク
ロラフネス(Rms)は1.658nm、凹凸の頂部と谷
部との高さの差(P−V)は8.760nmであり、改
善効果が認められなかった。これに対し、本発明を適用
して酸素イオン注入後、Ar+0.5%O2 の雰囲気中
で1350℃、4時間のアニール処理を行い、更に30
%O2 ガスで1350℃、4時間の酸化処理を行った場
合、埋め込み酸化膜界面の平坦度は図8(c)に示すよ
うにマイクロラフネス(Rms)が0.854nm、凹凸
の頂部と谷部との高さの差(P−V)は5.122nm
に改善された。
0.4×1018/cm2 とし、ピンホール密度が従来の
1/3程度に低減され、かつ埋め込み酸化膜が厚くなっ
たので、絶縁耐圧は約40Vから約64Vに向上した。
来は単結晶シリコン基板に酸素イオンを注入後、アニー
ル処理のみ行って酸素イオン注入量によって定まる理論
膜厚となるような埋め込み酸化膜を形成したSIMOX
基板に、1150℃以上でシリコン融点温度未満の高温
雰囲気内で行う酸化処理を追加することにより、前記ア
ニール処理によって形成された理論的埋め込み酸化膜厚
の上に更に酸化膜が増膜形成され、埋め込み酸化膜の厚
膜化が可能となる。また、酸素イオン注入時に基板表面
にパーティクルが付着して埋め込み酸化膜にピンホール
が発生した場合や、埋め込み酸化膜界面の凹凸が著しい
場合も、前記高温酸化処理の追加によりピンホールを補
修し、あるいは界面の凹凸を平坦化することができる。
このように高温酸化処理工程を追加して得られるSIM
OX基板は、従来技術によるSIMOX基板に比べて埋
め込み酸化膜の厚膜化、埋め込み酸化膜中のピンホール
低減および埋め込み酸化膜界面の平坦度向上を実現させ
た高品質のSOI基板となり、各種の素子形成を容易に
行うことができる。
る。
実施例のアニールおよび高温酸化工程と温度変化の関係
を示す説明図である。
層を約180nm酸化した場合の酸化温度と埋め込み酸
化膜増加量との相関を示す図である。
定し、O2 濃度を70%とした場合の酸化温度と埋め込
み酸化膜増加量との相関を示す図である。
み酸化膜増加量との相関を示す図である。
ある。
いて、本発明による方法と従来技術による方法との比較
結果を示す図である。
界面の模式的部分断面図で、酸素イオン注入後に、
(a)はアニール処理のみ施した従来のSIMOX基
板、(b)は濃度0.5%のO2 ガスで酸化処理を行っ
たSIMOX基板、(c)は濃度30%のO2 ガスで酸
化処理を行ったSIMOX基板を示す。
る。
における転位密度との相関を示す図である。
縁性との相関を示す図である。
Claims (11)
- 【請求項1】 単結晶シリコン基板に酸素イオンを打ち
込み注入した後、不活性ガス雰囲気中で高温熱処理する
アニール処理を行うことにより埋め込み酸化膜を形成
し、表面層に基板と絶縁分離された単結晶シリコン層を
形成するSOI基板の製造方法において、 前記埋め込み酸化膜の膜厚が酸素イオン注入量により計
算される理論的膜厚になるアニール処理を行った後、前
記基板に高温酸素雰囲気中で酸化処理を施すことにより
前記アニール処理後の埋め込み酸化膜を厚膜化すること
を特徴とするSOI基板の製造方法。 - 【請求項2】 前記高温酸化処理温度は1150℃以
上、単結晶シリコン基板の融点温度未満の範囲内に保つ
ことを特徴とする請求項1に記載のSOI基板の製造方
法。 - 【請求項3】 前記高温酸化処理は、アニール時の酸素
濃度より高い濃度の酸素ガス雰囲気中で行うことを特徴
とする請求項1に記載のSOI基板の製造方法。 - 【請求項4】 前記高温雰囲気中における酸化処理後に
基板表面の酸化膜除去を実施し、引き続いて、1100
℃以下の温度で犠牲酸化を行った後、犠牲酸化膜を除去
することにより表面シリコン層の薄膜化をなすことを特
徴とする請求項1に記載のSOI基板の製造方法。 - 【請求項5】 アニール処理後に1100℃以下の温度
で犠牲酸化を行った後、犠牲酸化膜を除去することによ
り表面シリコン層の薄膜化を行い、引き続いて高温雰囲
気中における酸化処理を施すことを特徴とする請求項1
に記載のSOI基板の製造方法。 - 【請求項6】 前記高温酸化処理は、1%を超える酸素
濃度のガス雰囲気中で行うことを特徴とする請求項3に
記載のSOI基板の製造方法。 - 【請求項7】 単結晶シリコン基板に酸素イオンを打ち
込み注入した後、不活性ガス雰囲気中で高温でアニール
処理を行うことにより埋め込み酸化膜を形成し、表面層
に基板と絶縁分離された単結晶シリコン層を形成するS
OI基板の製造方法において、 前記埋め込み酸化膜の膜厚が酸素イオン注入量により計
算される理論的膜厚になるアニール処理を行った後、酸
化温度に対する埋め込み酸化膜厚の増膜特性線図を予め
求めておき、この特性線図により必要膜厚となる温度条
件の高温雰囲気中で前記基板を酸化処理することによっ
て埋め込み酸化膜を厚膜化することを特徴とするSOI
基板の製造方法。 - 【請求項8】 単結晶シリコン基板に酸素イオンを打ち
込み注入した後、不活性ガス雰囲気中で高温でアニール
処理を行うことにより埋め込み酸化膜を形成し、表面層
に基板と絶縁分離された単結晶シリコン層を形成するS
OI基板の製造方法において、 前記埋め込み酸化膜の膜厚が酸素イオン注入量により計
算される理論的膜厚になるアニール処理を行った後、酸
化温度に対する埋め込み酸化膜厚の増膜特性線図を予め
求めておき、この特性線図により埋め込み酸化膜に発生
したピンホールを閉塞するに必要な増膜量に対応する温
度条件を求め、当該温度条件の高温雰囲気中で前記基板
を酸化処理することによって埋め込み酸化膜を厚膜化す
ることを特徴とするSOI基板の製造方法。 - 【請求項9】 単結晶シリコン基板に酸素イオンを打ち
込み注入した後、不活性ガス雰囲気中で高温でアニール
処理を行うことにより埋め込み酸化膜を形成し、表面層
に基板と絶縁分離された単結晶シリコン層を形成するS
OI基板の製造方法において、 前記埋め込み酸化膜の膜厚が酸素イオン注入量により計
算される理論的膜厚になるアニール処理を行った後、酸
化温度に対する埋め込み酸化膜厚の増膜特性線図を予め
求めておき、この特性線図により埋め込み酸化膜の界面
平坦化に必要な増膜量に対応する温度条件を求め、当該
温度条件の高温雰囲気中で前記基板を酸化処理すること
によって埋め込み酸化膜を厚膜化することを特徴とする
SOI基板の製造方法。 - 【請求項10】 単結晶シリコン基板に酸素イオンを打
ち込み注入した後、不活性ガス雰囲気中で高温熱処理す
るアニール処理を行うことにより埋め込み酸化膜を形成
し、表面層に基板と絶縁分離された単結晶シリコン層を
形成するSOI基板の製造方法において、 前記酸素イオンを打込み注入した基板を炉に入れて昇温
させつつ埋め込み酸化膜の膜厚が酸素イオン注入量によ
り計算される理論的膜厚になるアニール処理を行い、ア
ニール温度以上に昇温した後酸素濃度を増量した高温高
濃度酸素雰囲気中で前記埋め込み酸化膜が形成された基
板を酸化処理することによって埋め込み酸化膜を厚膜化
することを特徴とするSOI基板の製造方法。 - 【請求項11】 単結晶シリコン基板に酸素イオンを注
入し、アニールによって前記基板内に埋め込み酸化膜を
形成した後、高温酸化処理を施したSIMOX基板であ
って、前記埋め込み酸化膜の膜厚が90nmを超え、表
面のシリコン単結晶層の転位密度が100個/cm2 以
下、埋め込み酸化膜のピンホール密度が20個/cm2
以下で、かつ埋め込み酸化膜界面の平方根平均ラフネス
が1nm以下であることを特徴とするSOI基板。
Priority Applications (9)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6076538A JP3036619B2 (ja) | 1994-03-23 | 1994-03-23 | Soi基板の製造方法およびsoi基板 |
| US08/403,518 US5658809A (en) | 1994-03-23 | 1995-03-13 | SOI substrate and method of producing the same |
| EP95103998A EP0675534B1 (en) | 1994-03-23 | 1995-03-17 | SOI substrate and method of producing the same |
| DE69515189T DE69515189T2 (de) | 1994-03-23 | 1995-03-17 | SOI-Substrat und Verfahren zur Herstellung |
| KR1019950005872A KR0145824B1 (ko) | 1994-03-23 | 1995-03-20 | Soi 기판 및, 그 기판의 제조방법 |
| CZ95726A CZ281798B6 (cs) | 1994-03-23 | 1995-03-22 | Substrát SOI a způsob jeho výroby |
| FI951340A FI951340A7 (fi) | 1994-03-23 | 1995-03-22 | SOI-substraatti ja menetelmä sen valmistamiseksi |
| TW084106175A TW401609B (en) | 1994-03-23 | 1995-06-16 | SOI substrate and method of producing the same |
| US08/915,301 US5918136A (en) | 1994-03-23 | 1997-08-19 | SOI substrate and method of producing the same |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6076538A JP3036619B2 (ja) | 1994-03-23 | 1994-03-23 | Soi基板の製造方法およびsoi基板 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH07263538A JPH07263538A (ja) | 1995-10-13 |
| JP3036619B2 true JP3036619B2 (ja) | 2000-04-24 |
Family
ID=13608053
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6076538A Expired - Lifetime JP3036619B2 (ja) | 1994-03-23 | 1994-03-23 | Soi基板の製造方法およびsoi基板 |
Country Status (8)
| Country | Link |
|---|---|
| US (2) | US5658809A (ja) |
| EP (1) | EP0675534B1 (ja) |
| JP (1) | JP3036619B2 (ja) |
| KR (1) | KR0145824B1 (ja) |
| CZ (1) | CZ281798B6 (ja) |
| DE (1) | DE69515189T2 (ja) |
| FI (1) | FI951340A7 (ja) |
| TW (1) | TW401609B (ja) |
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- 1995-03-17 DE DE69515189T patent/DE69515189T2/de not_active Expired - Lifetime
- 1995-03-17 EP EP95103998A patent/EP0675534B1/en not_active Expired - Lifetime
- 1995-03-20 KR KR1019950005872A patent/KR0145824B1/ko not_active Expired - Fee Related
- 1995-03-22 FI FI951340A patent/FI951340A7/fi unknown
- 1995-03-22 CZ CZ95726A patent/CZ281798B6/cs not_active IP Right Cessation
- 1995-06-16 TW TW084106175A patent/TW401609B/zh not_active IP Right Cessation
-
1997
- 1997-08-19 US US08/915,301 patent/US5918136A/en not_active Expired - Lifetime
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7524744B2 (en) | 2003-02-19 | 2009-04-28 | Shin-Etsu Handotai Co., Ltd. | Method of producing SOI wafer and SOI wafer |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH07263538A (ja) | 1995-10-13 |
| DE69515189T2 (de) | 2000-11-23 |
| TW401609B (en) | 2000-08-11 |
| EP0675534A3 (en) | 1996-11-13 |
| US5658809A (en) | 1997-08-19 |
| FI951340A0 (fi) | 1995-03-22 |
| EP0675534B1 (en) | 2000-03-01 |
| KR950027901A (ko) | 1995-10-18 |
| KR0145824B1 (ko) | 1998-11-02 |
| CZ72695A3 (en) | 1995-11-15 |
| FI951340A7 (fi) | 1995-09-24 |
| CZ281798B6 (cs) | 1997-02-12 |
| DE69515189D1 (de) | 2000-04-06 |
| US5918136A (en) | 1999-06-29 |
| EP0675534A2 (en) | 1995-10-04 |
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| FPAY | Renewal fee payment (event date is renewal date of database) |
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| R350 | Written notification of registration of transfer |
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