DE2558925A1 - Verfahren zur herstellung einer halbleitervorrichtung in der technik der integrierten injektionslogik - Google Patents
Verfahren zur herstellung einer halbleitervorrichtung in der technik der integrierten injektionslogikInfo
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Description
Kawasaki-shi, Japan
hergestellte I L-Schaltung enthält einen lateralen PNP-Transisfcor, mit einem Emitter, einer Basis und einem Kollektor, die von der zweiten p-leitenden Zone, der n-leitenden Halbleitesschicht bzw. der ersten p-leitenden Zone gebildet sind, sowie einen vertikalen NPN-Transistor mit einem Emitter, einer Basis und einem Kollektor, die von der η-leitenden Halbleiter schicht, der ersten p-leitenden Zone bzw. der η-leitenden Zone gebildet sind.
I L-Halbleitervorrichtung ist daher angestrebt worden und in den japanischen Patentanmeldungen Nr. 14856/74 und Nr.1 909/75 sind bereits verbesserte I L-HaIbDe itervor-
vorrichtung erleichtert wird.
I L-Halbleitervorrichtung enthält einen lateralen Transistor und ,einen vertikalen Transistor. Die Basiszone des lateralen Transistors hat eine gleichmässige Weite in ihrer gesamten Tiefe, und sie ist äußerst schmal; an der Übergangsfläche zwischen den Emitter- und Basiszonen entsteht ein passender Störstoffkonzentrationsgradient, so daß es möglich ist, ein elektrisches Beschleunigungsfeld zum Injizieren von Ladungsträgern aus der Emitterzone anzulegen. Da die Kollektorzone den gesamten Umfang der Emitterzone umgibt, ist es auch möglich, den Injektionswirkungsgrad und den Transportwirkungsgrad der Ladungsträger beträchtlich zu erhöhen. Als Folge davon hat der Lateraltransistor einen hohen Stromversorgungsfaktor und ein ausgezeichnetes Hochfrequenzverhalten. Hinslfchtlich des vertikalen Transistors ist es möglich, die Störstoffkonzentration der Emitterzone höher als die der Basiszone zu machen und die Dichte der Rekombinationszentren in der Basiszone herabzusetzen. Somit hat auch der vertikale Transistor einen hohen Strom-
Claims (6)
- PatentansprücheirjVerfahren zur Herstellung einer Halbleitervorrichtung in der Technik der integrierten Injektionslogik, dadurch gekennzeichnet, daß auf einem Halbleitersubstrat eines Leitungstyps eine Halbleiterschicht des entgegengesetzten Leitungstyps gebildet wird, daß auf die Halbleiterschicht des entgegengesetzten Leitungstyps ein Isolierfilm aufgebracht wird, daß durch den Isolierfilm eine erste Öffnung gebildet wird, daß dieHalbleiterschicht des entgegengesetzten Leitungstyps durch die erste Öffnung mit einem Störstoff des einen Leitungstyps dotiert wird, damit eine erste Zone ,des einen Leitungstyps gebildet wird, die das Halbleitersubstrat des einen Leitungstyps erreicht, daß durch den Isolierfilm eine zweite Öffnung gebildet wird, daß die erste Zone des einen Leitungstyps und die Halbleiterschicht des entgegengesetzten Leitungstyps durch die dusten bzw. die zweiten Öffnungen mit einem Störstoff des entgegengesetzten Leitungstyps dotiert werden, damit in der ersten Zone des einen Leitungstyps und in der Halbleiterschicht des entgegengesetzten Leitungstyps erste bzw. zweite Bereiche des entgegengesetzten Leitungstyps gebildet werden, d*ß durch den Isolierfilm eine dritte Öffnung gebildet wird und daß die Halbleiterschicht des entgegengesetzten Leitungstyps durch die dritte Öffnung mit einem Störstoff des einen Leitungstyps dotiert wird, damit in der Halbleiterschicht des entgegengesetzten Leitungstyps eine zweite Zone des einen Leitungstyps entsteht.609828/0694
- 2. Verfahren nach Anspruch 1, dadurch gekennzeichnet, daß die erste Zone des einen Leitungstyps dadurch gebildet wird, daß ein einen Störstoff des einen Leitungstyps enthaltender Siliziumoxidfilm auf den durch die erste Öffnung freiliegenden Oberflächenabschnitten der Halbleiterschicht des entgegengesetzten Leitungstyps und auf dem Isolierfilm gebildet wird und daß die so gebildete Halbleiteranordnung einereine hohe Temperatur aufweisenden nichtoxidierenden Atmosphäre für eine vorfeestimmte Zeitdauer ausgesetzt wird.
- 3. Verfahren zur Herstellung einer Halbleitervorrichtung in der Technik der integrierten Injektionslogik, dadurch gekenn zeichnet, daß auf einem Halbleitersubstrat des einen Leitungstyps eine Halbleiterschicht des entgegengeeetzten Leitungstyps gebildet wird, daß auf derHalbleiterschicht des entgegengesetzten Leitungstyps ein Isolierfilm gebildet wird, daß durch den Isolierfilm erste und zweite Öffnungen gebildet werden, daß die Halbleiterschicht des entgegengesetzten Leitungstyps durch die erste Öffnung mit einem Störstoff des einen Leitungstyps dotiert wird, damit eine erste Zone des einen Leitungstyps entsteht, die das Halbleitersubstrat erreicht, daß die erste Zone des ersten Leitungstyps und die Halbleiterschicht des entgegengesetzten Leitungstyps durch die ersten lund zweiten Öffnungen mit einem Störstoff dotiert werden, damit in der ersten Zone des einen Leitungstyps und in der Halbleiterschicht des entgegengesetzten Leitungstyps erste bzw. zweite Bereiche des entgegengesetzten Leitungstyps gebildet werden, daß durch den Isolierfilm eine dritte Öffnung gebildet wird und daß die Halbleiterschicht des entgegengesetzten Leitungstyps durch die dritte Öffnung mit einem Störstoff des einen Leitungstyps dotiert wird, damit eine zweite Zone des einen Leitungstyps gebildet wird.609828/0694
- 4. Verfahren nach Anspruch 3, dadurch gekennzeichnet, daß die erste Zone des einen Leitungstyps dadurch gebildet wird, daß auf durch die ersten und zweiten Öffnungen freiliegenden Abschnitten der Halbleiterschicht des entgegengesetzten Leitungstyps und auf dem Isolierfilm ein Siliziumnitridfilm aufgebracht wird, daß auf den Siliziumnitridfilm ein einen Störstoff des einen Leitungstyps enthaltender erster Siliziumoxidfilm gebildet wird, daß mittels einer Ätzlösung zur erneuten Freilegung der ersten Öffnung der Siliziumoxidfilm und der Siliziumnitridfilm mit Ausnahme des Abschnitts des Siliziumnitridfilms und des Abschnitts des Siliziumoxidfilms an der zweiten Öffnung entfernt werden, wobei die übrigen Abschnitte des Siliziumoxidfilms mit Hilfe der Ätzlösung entfernt werden, daß ein einen Störstoff des einen Leitungstyps enthaltender zweiter Siliziumoxidfilm auf den beim Entfernen des Siliziumoxidfilms freigelegten Oberflächenabschnitt des Siliziumnitridfilms, auf den beim Wiederfreilegen der ersten Öffnung freigelegten Oberflächenabschnitt der Halbleiterschicht des entgegengesetzten Leitungstyps und auf den Isolierfilm aufgebracht wird, daß durch die erste Öffnung der in dem zweiten Siliziumoxidfilm enthaltene Störstoff des einen Leitungstyps in die Siliziumschicht des entgegengesetzten Leitungstyps eindiffundiert wird, indem die so erhaltene Anordnung mit einer eine hohe Temperatur aufweisenden nichtoxidierenden Atmosphäre behandelt wird, und daß zur erneuten Freilegung der ersten und zweiten Öffnungen Abschnitte des zweiten Siliziumoxidfilms und des Siliziumnitridfilms mit Hilfe einer Ätzlösung entfernt werden.
- 5. Verfahren zur Herstellung einer Halbleitervorrichtung in der Technik der integrierten Injektionslogik, dadurch gekennzeichnet, daß auf einem HalbleiteBsubstrat des einen Leitungstyps eine Halbleiterschicht des entgegengesetzten Leitungstyps gebildet wird, daß auf der Halbleiterschicht des entgegengesetzten609828/0694·Leitungstyps ein Isolierfilm gebildet wird, daß durch den Isolierfilm erste, zweite und dritte Öffnungen erzeugt werden, daß die Halbleiterschicht des entgegengesetzten Leitungstyps durch die erste Öffnung zur Bildung einer ersten Zone des einen Leitungstyps mit einem Störstoff des einen Leitungstyps dotiert wird, daß die Halbleiterschicht des entgegengesetzten Leitungstyps durch die ersten und zweiten öffnungen zur Bildung erster bzw. zweiter Bereiche des entgegengesetzten Leitungstyps in der ersten Zone des einen Leitungstyps und in der Halbleiterschicht des entgegengesetzten Leitungstyps mit einem Störstoff des entgegengesetzten Leitungstyps dotiert wird und daß die Halbleiterschicht des entgegengesetzten Leitungstyps durch die dritte Öffnung zur Bildung einer zweiten Zone des einen Leitungstyps mit einem Störstoff des einen Leitungstyps dotiert wird.
- 6. Verfahren nach Anspruch 5, dadurch gekennzeichnet, daß die Bildung der ersten Zone des einen Leitungstyps dadurch erfolgt, daß auf den von den ersten, zweiten und dritten Öffnungen freigelegten Oberflächenabschnitten der Halbleiterschicht des entgegengesetzten Leitungstyps und auf dem Isolierfilm ein Siliziumnitridfilm gebildet wird, daß auf dem Siliziumnitridfilm ein einen Störstoff des einen Leitungstyps enthaltender Siliziumoxidfilm gebildet wird, daß mittels eines Photoätzverfahrens Abschnitte des Siliziumoxidfilms mit Ausnahme der bei den zweiten und dritten Öffnungen liegenden Abschnitte entfernt werden, daß die Abschnitte des Siliziumnitridfilms mit Hilfe einer Ätzlösung entfernt werden, indem der verbleibende Abschnitt des Siliziumoxidfilms, der bei dem Photoätzverfahren nicht entfernt worden ist, als Maske verwendet wird, damit die erste Öffnung wieder freigelegt wird, daß die Abschnitte des Siliziumoxidfilms auf dem verbleibenden Abschnitt des Siliziumnitridfilmä zur Freilegung des Abschnitts des Siliziumnitridfilms entfernt werden, daß auf den freigelegten609828/0694- 2b -Abschnitt des Siliziumoxidfilms, auf den erneut durch die erste Öffnung freigelegten Oberflächenabschnitt der Halbleiterschicht des entgegengesetzten Leitungstyps und auf den Isolierfilm ein zweiter Siliziumoxidfilm aufgebracht wird, daß der in dem zweiten Siliziumoxidfilm enthaltene Störstoff des einen Leitungstyps in die Halbleiterschicht des entgegengesetzten Leitungstyps diffundiert wird, indem die auf diese Weise erhaltene Anordnung mit einer eine hohe Temperatur aufweisenden nichtoxidierenden Atmosphäre behandelt wird, daß zur Bildung der ersten und zweiten Bereiche des entgegengesetzten Leitungstyps Abschnitte des zweiten Siliziumoxidfilms mit Ausnahme derjenigen Abschnitte, die bei der dritten Öffnung liegen, entfernt werden, damit die erste Öffnung wieder freigelegt wird, daß Abschnitte des Siliziumnitridfilms mit einer Ätzlösung unter Verwendung des verbleibenden Abschnitts des Siliziumoxidfilms als Maske entfernt werden, damit die~zweite Öffnung wieder freigelegt wird, und daß der Störstoff des entgegengesetzten Leitungstyps in die erste Zone des einen Leitungstyps und in die Halbleiterschicht des entgegengesetzten Leitungstyps durch die freigelegten ersten und zweiten Öffnungen diffundiert wird.Verfahren zur Herstellung einer Halbleitervorrichtung in der Technik der integrierten Injektionslogik, dadurch gekennzeichnet, daß auf einem Halbleitersubstrat des einen Leitungstyps eine Halbleiterschicht des entgegengesetzten Leitungstyps gebildet wird, daß auf der Halbleiterschicht des entgegengesetzten Leitungstyps ein Isolierfilm gebildet wird, daß durch den Isolierfilm eine erste Öffnung mit einem vorbestimmten Muster gebildet wird, daß ein einen Störstoff des einen Leitungstyps enthaltender Siliziumoxidfilm gebildet wird, der den durch die erste Öffnung freigelegten Oberflächenabschnitt der Halbleiterschicht des entgegengesetztenLeitungstyps und mehrere, durch Unterteilen des Isoli%rfilms mittels der öffnung erzeugte Abschnitte des Isolierfilms bedeckt, daß der Störstoff des einen Leitungstyps in die Halbleiterschicht diffundiert wird, indem die auf diese Weise erhaltene Anordnung in einer eine hohe Temperatur aufweisenden nichtoxidierenden Atmosphäre behandelt wird, damit eine erste Zone des einen Leitungstyps erzeugt wird, die ein dem vorbestimmten Muster entsprechendes Muster hat und das Halbleitersubstrat des einen Leitungstyps erreicht, daß durch den Siliziumoxidfilm auf dem ersten Bereich der ersten Zone des einen Leitungstyps eine der ersten Zone des einen Leitungstyps entsprechende zweite Öffnung gebildet wird, daß durch entsprechende Abschnitte des Isolierfilm und durch den Siliziumoxidfilm auf entsprechenden Abschnitten des Isolierfilms eine dritte öffnung gebildet wird, daß in die erste Zone des einen Leitungstyps und in die Halbleiterschicht des entgegengesetzten Leitungstyps durch die zweiten und dritten öffnungen ein Störstoff des entgegengesetzten Leitungstyps diffundiert wird, damit erste und zweite Bereiche des entgegengesetzten Leitungstyps entstehen, daß durch Jeweilige Abschnitte des Isolierfilms und durch den Siliziumoxidfilm eine vierte Öffnung gebildet wird, und daß durch die vierte Öffnung ein Störstoff des einen Leitungstyps in die Halbleiterschicht diffundiert wird.60982 870694L e e r s e i t e
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Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE3136731A1 (de) * | 1981-09-16 | 1983-03-31 | Licentia Patent-Verwaltungs-Gmbh, 6000 Frankfurt | Verfahren zum herstellen einer halbleiteranordnung |
Families Citing this family (9)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5317081A (en) * | 1976-07-30 | 1978-02-16 | Sharp Corp | Production of i2l device |
| DE2652103C2 (de) * | 1976-11-16 | 1982-10-28 | Ibm Deutschland Gmbh, 7000 Stuttgart | Integrierte Halbleiteranordnung für ein logisches Schaltungskonzept und Verfahren zu ihrer Herstellung |
| US4180827A (en) * | 1977-08-31 | 1979-12-25 | International Business Machines Corporation | NPN/PNP Fabrication process with improved alignment |
| CA1116309A (en) * | 1977-11-30 | 1982-01-12 | David L. Bergeron | Structure and process for optimizing the characteristics of i.sup.2l devices |
| US4168999A (en) * | 1978-12-26 | 1979-09-25 | Fairchild Camera And Instrument Corporation | Method for forming oxide isolated integrated injection logic semiconductor structures having minimal encroachment utilizing special masking techniques |
| US4317690A (en) * | 1980-06-18 | 1982-03-02 | Signetics Corporation | Self-aligned double polysilicon MOS fabrication |
| US4446611A (en) * | 1980-06-26 | 1984-05-08 | International Business Machines Corporation | Method of making a saturation-limited bipolar transistor device |
| US5759902A (en) * | 1986-09-26 | 1998-06-02 | Analog Devices, Incorporated | Method of making an integrated circuit with complementary junction-isolated bipolar transistors |
| CN102299070A (zh) * | 2010-06-22 | 2011-12-28 | 无锡华润上华半导体有限公司 | 横向pnp晶体管的制造方法 |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US3328214A (en) * | 1963-04-22 | 1967-06-27 | Siliconix Inc | Process for manufacturing horizontal transistor structure |
| US3489622A (en) * | 1967-05-18 | 1970-01-13 | Ibm | Method of making high frequency transistors |
| US3560278A (en) * | 1968-11-29 | 1971-02-02 | Motorola Inc | Alignment process for fabricating semiconductor devices |
Family Cites Families (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US3472710A (en) * | 1967-04-20 | 1969-10-14 | Teledyne Inc | Method of forming a field effect transistor |
| FR2051714A1 (en) * | 1969-07-12 | 1971-04-09 | Tokyo Shibaura Electric Co | High frequency transistors |
| DE2262297C2 (de) * | 1972-12-20 | 1985-11-28 | Ibm Deutschland Gmbh, 7000 Stuttgart | Monolithisch integrierbare, logisch verknüpfbare Halbleiterschaltungsanordnung mit I↑2↑L-Aufbau |
| US3919005A (en) * | 1973-05-07 | 1975-11-11 | Fairchild Camera Instr Co | Method for fabricating double-diffused, lateral transistor |
| US3873989A (en) * | 1973-05-07 | 1975-03-25 | Fairchild Camera Instr Co | Double-diffused, lateral transistor structure |
| GB1507299A (en) * | 1974-03-26 | 1978-04-12 | Signetics Corp | Integrated semiconductor devices |
| US3982266A (en) * | 1974-12-09 | 1976-09-21 | Texas Instruments Incorporated | Integrated injection logic having high inverse current gain |
-
1975
- 1975-12-24 US US05/644,294 patent/US4058419A/en not_active Expired - Lifetime
- 1975-12-29 DE DE2558925A patent/DE2558925C2/de not_active Expired
- 1975-12-29 DE DE2560576A patent/DE2560576C2/de not_active Expired
- 1975-12-29 GB GB53012/75A patent/GB1528027A/en not_active Expired
- 1975-12-29 FR FR7539998A patent/FR2334204A1/fr active Granted
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US3328214A (en) * | 1963-04-22 | 1967-06-27 | Siliconix Inc | Process for manufacturing horizontal transistor structure |
| US3489622A (en) * | 1967-05-18 | 1970-01-13 | Ibm | Method of making high frequency transistors |
| US3560278A (en) * | 1968-11-29 | 1971-02-02 | Motorola Inc | Alignment process for fabricating semiconductor devices |
Non-Patent Citations (3)
| Title |
|---|
| In Betracht gezogene ältere Anmeldung: DE-OS 25 12 737 * |
| US-Z:"Electronics", Bd. 47, H. 20, 3. Okt. 1974, S. 111-118 * |
| US-Z:"Electronics", Bd. 47, H. 20, 30. Okt. 1974, S. 111-118 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE3136731A1 (de) * | 1981-09-16 | 1983-03-31 | Licentia Patent-Verwaltungs-Gmbh, 6000 Frankfurt | Verfahren zum herstellen einer halbleiteranordnung |
Also Published As
| Publication number | Publication date |
|---|---|
| GB1528027A (en) | 1978-10-11 |
| DE2560576C2 (de) | 1985-10-31 |
| US4058419A (en) | 1977-11-15 |
| FR2334204B1 (de) | 1978-05-26 |
| DE2558925C2 (de) | 1985-10-31 |
| FR2334204A1 (fr) | 1977-07-01 |
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