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DE2029775A1 - Steuerverteiler fur die Steuerung mehrerer Schaltelemente einer peripheren Einheit - Google Patents

Steuerverteiler fur die Steuerung mehrerer Schaltelemente einer peripheren Einheit

Info

Publication number
DE2029775A1
DE2029775A1 DE19702029775 DE2029775A DE2029775A1 DE 2029775 A1 DE2029775 A1 DE 2029775A1 DE 19702029775 DE19702029775 DE 19702029775 DE 2029775 A DE2029775 A DE 2029775A DE 2029775 A1 DE2029775 A1 DE 2029775A1
Authority
DE
Germany
Prior art keywords
control
switching
switching elements
control distributor
distributor according
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
DE19702029775
Other languages
English (en)
Other versions
DE2029775C3 (de
DE2029775B2 (de
Inventor
Jean Marie La Celle St Cloud Liot Jean Bernard Michel Bailly Trelut (Frankreich)
Original Assignee
International Standard Electric Corp , New York, NY (V St A )
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by International Standard Electric Corp , New York, NY (V St A ) filed Critical International Standard Electric Corp , New York, NY (V St A )
Publication of DE2029775A1 publication Critical patent/DE2029775A1/de
Publication of DE2029775B2 publication Critical patent/DE2029775B2/de
Application granted granted Critical
Publication of DE2029775C3 publication Critical patent/DE2029775C3/de
Expired legal-status Critical Current

Links

Classifications

    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04Q—SELECTING
    • H04Q3/00—Selecting arrangements
    • H04Q3/42—Circuit arrangements for indirect selecting controlled by common circuits, e.g. register controller, marker
    • H04Q3/54—Circuit arrangements for indirect selecting controlled by common circuits, e.g. register controller, marker in which the logic circuitry controlling the exchange is centralised
    • H04Q3/545—Circuit arrangements for indirect selecting controlled by common circuits, e.g. register controller, marker in which the logic circuitry controlling the exchange is centralised using a stored programme

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Electronic Switches (AREA)
  • Testing Electric Properties And Detecting Electric Faults (AREA)
  • Logic Circuits (AREA)
  • Use Of Switch Circuits For Exchanges And Methods Of Control Of Multiplex Exchanges (AREA)
  • Exchange Systems With Centralized Control (AREA)

Description

009887/1817
E - Nr. 9151
Reg. Nr.
Case: J.M.Trelut et al 5-1
Titel· Electric Control Distributor
Steuerverteiles· für die Steuerung mehrerer Schaltelemente einer peripheren Einheit.
Verzeiehrais der verwendeten Bezeichnungen
Bezugs- Ursprungssprache Stf& F. Ubersef zu ng :ü/D
zeichen !.Übersetzung E0
1 distributor Verteiler
2 junctor circuit Verbindungssatz
3 computer Rechner
4 busbar Leitungsbündel
5 memory Speicher
6 junctor circuit decoder Verbinder-Decodi erer
7 relay decoders Relaisdeoodierer
8 relay comparators Relaisvergleicher
9 OR-gate ODER-Schaltung
10 time base circuit Zeltgeber
11 circuit Prüfschaltung
12 fault circuit Fehlerschaltung
13 transfer circuit Sendeschaltung
14, 15 decoders Decodierer
J relay Relais
jl bis j8 contacts Kontakte
16 Instruction decoder Befehlsdeoodlerer
17, 18 voltage switching circuits Spannungssohalter
N1 bis N8 relays Relais
η* bis mo cells Zellen
19 wire Ader
20 resistance Widerstand
nl bis n8 contacts Kontakt
21 comparison ®ir@uit Vergleichsschaltung
22 amplifier Verstärker
23 comparison decodes» V©rgl®iohsdeeodi©r®r
24,24a,24b am-g&tm UND-Schaltungen
25 validation deeoier Anzeigedeoodlerer
26 registering oteouit
00-9887/181 		Regletriereoliftltung
f
E - Nr. 9151
Reg. Nr,
Case :
202977S
Titel:
Verzeichnis der 009 verwendeten Bezeichnungen 887/181 « ·
Bezugs Ursprungssprache D/E Ausgang
zeichen Ausgänge
27 decoder Eingang
28 AND-gates Adern
29 circuit Ausgang
50 gates Ader
31 OR-gate Leitung
32 link Leitungsbündel
35 output Ader
34 Kippstufe
35 output, input UND-Schaltung
F wire UND-Schaltung
36, 37 flip-flop memories Transistoren
xl,x2,x3 , flip-flop
yl,y2,y3 „
D input
38 multiplages
39,39a,39b links Übersetzung E/D
40,40a,40b
41 output Decodierer
42,43 outputs UND-Schaltungen
44 input Schaltung
45 wires Torschaltungen
46 output ODER-Schaltung
L wire Leitungsbündel
47 line Ausgang
T link
48 wire Anschluss
49,50,51 flip-flop Ader
. ■ ■
52,53,54 AND-gate bistabile Kippstufen
55 AND-gate Kippstufen
56,58 transistors
Eingang
Vielfachzeichen
BAD ORiGiNAL
Nr. 9151
Verzeichnis der verwendeten Bezeichnungen
5ezugs- Urspnjngsspraehe 009887/ 1 ί < Übersetzung -
zesehen
57, 59 resistances Π7 Widerstände
-Tr» gate UND-Schaltung
inverter Inverter
<o protection resistance Schutzwiderstand
63 transistor Transistor
64 point Punkt
zener diode Zenerdiode
67, 68 transistors Transistoren
69 zener diode Zenerdiode
VO resistance Widerstand
;l AND-gate UND-Schaltung
=72 resistance Widerstand
73 exclusive OR-gate EXCLUSIV-ODER-Schaltung
74 OR-gate ODER-Schaltung
75 AND-gate UND-Schaltung
76,77 AND-gates UND-Schaltungen
78 inverter Inverter

Claims (1)

  1. J.M.Trelut 5-1
    Patentansprüche
    Iy Steuerverteiler für die Steuerung mehrerer Schaltelemente einer peripheren Einheit durch einen Rechner, insbesondere der Relais eines Verbindungssatzes einer rechnergesteuerten Fernmeldevermittlungsanlage, dadurch gekennzeichnet, daß im Steuerverteiler ein Zwischenspeicher {5) angeordnet ist, der für jedes zu steuernde Schaltelement (Nl bis N8) ein
    binäres Element (ml bis m.8) aufweist und der für jedes Bit einer für alle Schaltelemente gemeinsamen Steuerinformation ein zusätzliches binäres Element (t, r).aufweist, und daß den zu steuernden Schaltelementen individuell Befehlsdecodierer (7) und Vergleicher (8) zugeordnet sind, die jeweils aus der gemeinsamen Steuerinformation und dem Zustand des individuellen binären Elementes (z.B. binäres Element ml) den erwünschten Steuervorgang ermitteln (7) bzw. aus der gemeinsamen Steuerinformation (t, r) dem Zustand des individuellen binären Elementes (z.B. ml) und dem tatsächlichem '·-;_. :=a des zn
    steuernden Schaltelementes (z.B. Nl) eine A1 "-/eichung vom Soll-Zustand ermitteln (8).
    2. Steuer verteiler nach Anspruch 1, dadurch gekennzeichnet,
    daß der Speicher (5) für den Fall mehrerer peripherer
    Einheiten weitere binäre Elemente (xl bis y3) aufweist, die jeweils die zu steuernde Einheit kennzeichnen.
    Vl/Sd
    003387/1317
    BAD ORIGINAL
    J. M. Trelut 5-1
    3a Steuerverteiler nach Anspruch 1 oder Z, dadurch gekennzeichnet, daß die stisätzlichen binären Elemente (t, r) für die Steuerinformation neben den Anweisungen a) Einschalten eines oder mehrerer Schaltelemente., b) Ausschalten eines oder mehrerer Schaltelemente und c) Herstellen einer bestimmten Kombination von Schaltzuständen auch eine Steuerinformation für die bloße Rückmeldung der Schaltzustände aller Schaltelemente (Nl bis N8) • aufnehmen.
    4„ Steuerverteiler nach Anspruch 2, dadurch gekennzeichnet, daß die weiteren binären Elemente (xl bis y3) zur Bestimmung der Koordinaten eines Punktes einer Matrix dienen, an dem ein Relais zum. Durchschalten der Verbindung vom Steuerverteiler zu einer bestimmten peripheren Einheit angeordnet ist.
    5. Steuerverteiler nach Anspruch 1, dadurch gekennzeichnet, daß der Speicher (5) eine Zelle (p) für die Aufnahme eines Quersummenprüfbit umfaßt.
    6. Steuerverteiler nach Anspruch I5 dadurch gekennzeichnet, daß in den Befehlsdecodierern (7) die Spannungsquellen für die Betätigung der Schaltelemente (Nl bis N8) in den peripheren Einheiten angeordnet sind*,
    1/1111
    JYM. Trelut 5-1
    7. Steuerverteiler nach Anspruch 3, dadurch gekennzeichnet, daß ein interner Zeitgeber (10) angeordnet ist, der mindestens zwei sich ausschließende Zeitintervalle (t2,t3) definiert, und daß im einen Zeitintervall (Steuerzeit t2) nur die Befehlsdecodierer (7) und im anderen Zeitintervall (Vergleichszeit t3) nur die Vergleicher (8) betätigt werden,
    8, Steuerverteiler nach Anspruch 5, dadurch gekennzeichnet, daß eine Fehler schaltung (12) angeordnet ist, die beim Auftreten eines Quersummenfehlers in den vom Rechner (3) übertragenen Anweisungen oder beim Auftreten einer Abweichung zwischen dem IST-Zustand und dem SOLL-Zustand ein entsprechendes Zeichen (F) zum Rechner überträgt.
DE19702029775 1969-06-20 1970-06-16 Steuerverteiler für die Steuerung mehrerer Schaltelemente einer peripheren Einheit Expired DE2029775C3 (de)

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
FR6920698A FR2055839A5 (de) 1969-06-20 1969-06-20

Publications (3)

Publication Number Publication Date
DE2029775A1 true DE2029775A1 (de) 1971-02-11
DE2029775B2 DE2029775B2 (de) 1973-09-27
DE2029775C3 DE2029775C3 (de) 1981-09-24

Family

ID=9036093

Family Applications (1)

Application Number Title Priority Date Filing Date
DE19702029775 Expired DE2029775C3 (de) 1969-06-20 1970-06-16 Steuerverteiler für die Steuerung mehrerer Schaltelemente einer peripheren Einheit

Country Status (6)

Country Link
AU (1) AU1657870A (de)
CH (1) CH537682A (de)
DE (1) DE2029775C3 (de)
ES (1) ES380990A1 (de)
FR (1) FR2055839A5 (de)
GB (1) GB1275210A (de)

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Non-Patent Citations (1)

* Cited by examiner, † Cited by third party
Title
DIN 44 300, März 1972, S. 2 *

Also Published As

Publication number Publication date
FR2055839A5 (de) 1971-05-14
DE2029775C3 (de) 1981-09-24
ES380990A1 (es) 1972-10-16
DE2029775B2 (de) 1973-09-27
CH537682A (fr) 1973-05-31
AU1657870A (en) 1971-12-29
GB1275210A (en) 1972-05-24

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