DE102004053801A1 - Dynamische Rekonfiguration von PCI-Expresslinks - Google Patents
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Abstract
Ein Verfahren und Schaltkreise zum dynamischen Rekonfigurieren der Links eines PCI-Expressbusses. Ein Computer-System ist anfänglich mit PCI-Expressbus-Links zu verschiedenen Endpunkten konfiguriert worden unter Verwendung der Skalierungsmerkmale des PCI-Express-Standards. Während des Betriebes des Computer-Systems wird der Status der Endpunkte erfasst und unbenutzte Links (oder unbenutzte Teile eines Links) werden an andere Endpunkte umgeroutet.
Description
- Technisches Gebiet der Erfindung
- Diese Erfindung bezieht sich auf Computersysteme und insbesondere auf Busverbindungen für Computersysteme.
- Hintergrund der Erfindung
- Die Komponenten eines Computers einschließlich seines Prozessors, des Chipsatzes, seines Cache, seines Speichers, seiner Erweiterungskarten und seiner Speichergeräte, kommunizieren miteinander über einen oder mehrere "Busse". Ein "Bus" ist in allgemeinen Computerfachbegriffen ein Kanal, über den Informationen zwischen zwei oder mehreren Geräten fließen. Ein Bus hat normalerweise Zugangspunkte oder Stellen, an denen ein Gerät an den Bus angeschlossen werden kann. Sobald Geräte an den Bus angeschlossen sind, können sie auf dem Bus Informationen an andere Geräte senden und von anderen Geräten empfangen.
- Heutige Personal Computer tendieren dazu, mindestens vier Busse zu haben. Jeder Bus ist gewissermaßen weiter von dem Prozessor entfernt; jeder ist mit der Ebene über ihm verbunden.
- Der Prozessor-Bus ist der Bus höchster Ebene und er wird von dem Chipsatz benutzt, um Informationen an den und von dem Prozessor zu senden. Der Cache-Bus (manchmal als der Rückwandbus bezeichnet) wird benutzt, um auf den System-Cache zuzugreifen. Der Speicher-Bus verbindet das Speichersubsystem mit dem Chipsatz und dem Prozessor. In vielen Systemen sind die Prozessor- und Speicher-Busse dieselben und sie werden gemeinsam als der Frontseiten- bzw. Frontside-Bus oder Systembus bezeichnet.
- Der lokale E/A-(Eingabe/Ausgabe, Input/output)-Bus verbindet Peripheriegeräte mit dem Speicher, dem Chipsatz und dem Prozessor. Videokarten, Plattenspeichergeräte und Netzwerkschnittstellenkarten benutzen im Allgemeinen diesen Bus. Die beiden am meisten gebräuchlichen lokalen E/A-Busse sind der lokale VESA-Bus (VLB) und der Periphäre-Komponenten-Verbindungs-(Peripheral-Component-Interconnect, (PCI))-Bus. Ebenso kann ein Industrie-Standard-Architektur-(Industry-Standard-Architecture, ISA)-E/A-Bus für langsamere Peripheriegeräte benutzt werden, wie z.B. für Mäuse, Modems und Sound- und Netzwerkgeräte niedriger Geschwindigkeit.
- Die aktuelle Generation des PCI-Busses ist als der PCI-Expressbus bekannt. Dieser Bus ist ein serieller Bus großer Bandbreite, welcher die Softwarekompatibilität mit bestehenden PCI-Geräten unterstützt.
- Zusammenfassung der Erfindung
- Ein Aspekt der Erfindung ist ein Verfahren, zum Rekonfigurieren von Links eines PCI-Expressbusses. Der Status der Busendpunkte wird erfasst, z.B. ob die Endpunkte bestückt sind und wie viel Bandbreite die Endpunkte benötigen. Basierend auf dieser Erfassung kann der ganze oder ein Teil eines Links, der unbenutzte Bandbreite aufweist, an einen anderen Endpunkt umgeschaltet (oder "geswitcht") werden.
- Zum Beispiel können alle Leitungen eines Links, die an einen unbestückten Endpunkt geroutet sind, an einen bestückten Endpunkt umgeroutet werden. Als anderes Beispiel können eine oder mehrere Leitungen eines Links, der an einen Endpunkt geroutet ist, welcher weniger Bandbreite benötigt als durch den Link bereitgestellt wird, an einen Endpunkt umgeschaltet werden, der mehr Bandbreite benötigt.
- Ein Vorteil der Erfindung ist, dass sie hilft, die Bandbreitenbeschränkungen des PCI-Expressbusses zu überwinden. Dynamische Rekonfiguration von PCI- Express-Leitungen erlaubt es, dass ungenutzte Bandbreite zu anderen Geräten auf dem Bus umgeschaltet wird.
- Kurze Beschreibung der Zeichnungen
- Ein kompletteres Verständnis der gegenwärtigen Ausführungsformen und die Vorteile daraus kann durch Bezugnahme auf die folgende Beschreibung in Verbindung mit den begleitenden Zeichnungen erlangt werden, worin gleiche Bezugszeichen gleiche Merkmale bezeichnen und worin:
-
1 verschiedene interne Elemente eines Informationsverarbeitungssystems gemäß der Erfindung illustriert; -
2 einen Teil des Systems von1 illustriert und ein erstes Beispiel zum Rekonfigurieren eines Links illustriert; -
3 ein zweites Beispiel zum Rekonfigurieren eines Links illustriert; -
4 ein drittes Beispiel zum Rekonfigurieren eines Links illustriert. - Detaillierte Beschreibung der Erfindung
-
1 illustriert verschiedene interne Elemente eines Informationsverarbeitungssystems100 gemäß der Erfindung. Wie unten erläutert, hat System100 einen PCI-Expressbus17 , ebenso zusätzliche Schaltkreise19 , die einen oder mehrere Links17b des Busses dynamisch rekonfigurieren. Der PCI-Expressbus17 wird auf konventionelle Art und Weise zum Verbinden peripherer Komponenten benutzt, aber er ist erweitert, so dass der Status eines Endpunkts17c erfasst werden kann und die Bandbreite für den Endpunkt umgeroutet werden kann, wenn sie nicht für den Endpunkt benötigt wird. - In der Ausführungsform von
1 ist das System100 üblicherweise ein Personal-Computer-System, aber es könnte auch eine andere Art von Informationsver arbeitungssystem sein, wie z.B. ein Server, eine Workstation oder ein eingebettetest System. - Für die Zwecke dieser Offenbarung kann ein Informationsverarbeitungssystem jedes betriebsfähige Instrumentarium oder eine Ansammlung von Instrumentarien einschließen, die in der Lage sind jede Art von Information, Intelligenz oder Daten für Unternehmens-, Wissenschafts-, Kontroll- oder andere Zwecke, zu berechnen, zu klassifizieren, zu verarbeiten, zu übertragen, zu empfangen, abzurufen, zu erzeugen, zu schalten, zu speichern, anzuzeigen, darzustellen, aufzuspüren, aufzunehmen, zu reproduzieren, zu bearbeiten, oder zu verwenden. Ein Informationsverarbeitungssystem kann z.B. ein Personal Computer, ein Netzwerkspeichergerät oder jedes andere geeignete Gerät sein und es kann in Größe, Form, Leistungsfähigkeit, Funktionalität und Preis variieren. Das Informationsverarbeitungssystem kann Wahlfrei-Zugriffs-Speicher (Random Access Memory, "RAM"), eine oder mehrere Verarbeitungsressourcen, wie z.B. eine Zentralverarbeitungseinheit ("CPU"), Hard- oder Software-Kontrolllogik, ROM, und oder andere Arten von nichtflüchtigen Speichern beinhalten. Zusätzliche Komponenten des Informationsverarbeitungssystems können ein oder mehrere Plattenlaufwerke, einen oder mehrere Netzwerkkanäle zur Kommunikation mit externen Geräten beinhalten, sowie verschiedene Eingabe und Ausgabe ("E/A")-Geräte, wie z.B. eine Tastatur, eine Maus und eine Videoanzeige. Das Informationsverarbeitungssystem kann ebenfalls einen oder mehrere Busse beinhalten, welche in der Lage sind, Nachrichten zwischen den verschiedenen Hardwarekomponenten zu übertragen.
- Die CPU
10 kann ein beliebiges Zentralverarbeitungsgerät sein. Ein Beispiel einer typischen CPU10 ist eine aus der Pentium-Familie von Prozessoren, die von der Intel Corporation verfügbar ist. Für die Zwecke der Erfindung ist die CPU10 zumindest programmiert, um ein Betriebssystem auszuführen, das eine BIOS (Basic Input/Output System) Programmierung hat. - Die Host-Bridge
11 (oft als North-Bridge bezeichnet) ist ein Chip (oder ein Teil eines Chipsatzes), der die CPU10 mit den Endpunkten12 , dem Speicher13 und dem PCI-Expressbus17 verbindet. Die Arten von Endpunkten12 , welche mit der Host-Bridge11 verbunden sind, hängen von der Anwendung ab. Wenn das System100 beispielsweise ein Desktop-Computer ist, sind die Endpunkte12 üblicherweise ein Graphikadapter, HDD (über einen seriellen ATA-Link) und lokale E/A (über einen USB-Link). Für einen Server sind die Endpunkte12 üblicherweise GbE-(Gigabit-Ethernet)- und IBE-Geräte und zusätzliche Bridge-Geräte. - Die Kommunikation zwischen der CPU
10 und der Host-Bridge11 findet mittels eines Frontseitenbusses14 statt. - PCI-Expressbus
17 umfasst eine Switch-Struktur17a und Links17b , mittels derer eine Anzahl von PCI-Endpunkten45 angeschlossen werden kann. Die Switch-Struktur17a stellt die Ausgangslast von der Host-Bridge11 an die Links17b bereit und sorgt für die Link-Skalierung. - "Link-Skalierung" bedeutet, dass die verfügbare Bandbreite des PCI-Expressbus
17 zugeteilt wird, so dass eine vorherbestimmte Anzahl von Links17b , von denen jeder eine Grösse gemäß des PCI-Express-Architekturstandards hat, physikalisch an die Endpunkte18 geroutet wird. Jeder Link17b umfasst eine oder mehrere Leitungen. Ein Link, der eine einzige Leitung hat (bezeichnet als eine x1-Breite habend), hat zwei Niederspannungs-Differentialpaare; er ist eine Dual-Simplex-Serial-Verbindung zwischen zwei Geräten. Die Datenübertragung zwischen den beiden Geräten findet simultan in beiden Richtungen statt. Ein skalierbarer Durchsatz wird durch breitere Linkbreiten erreicht (x1, x2, x4, x8, x16, x32). Die Links werden symmetrisch skaliert, mit derselben Anzahl von Leitungen in jeder Richtung. - Die PCI-Endpunkte
18 können Peripheriegeräte oder Chips sein, die mittels Kartenschlitzen oder anderen Verbindungsmechanismen physikalisch verbunden sind. - Die speziellen Endpunkte
45 , die mit dem PCI-Expressbus17 verbunden sind, hängen von der Art der Anwendung des Systems100 ab. Beispiele für typische PCI-Endpunkte18 für ein Desktop-Computersystem sind mobile Dockingadapter, Ethernetadapter und andere Add-In-Geräte. Die Endpunkte45 für eine Serverplattform könnten Gigabit-Ethernet-Verbindungen sein und zusätzliche Switchingfähigkeit für E/A- und Cluster-Zusammenschaltungen. Die Endpunkte18 für eine Kommunikationsplattform könnten Leitungskarten sein. - In einem herkömmlichen PCI-Expressbus
17 ist die Switching-Struktur17a ein logisches Element, das als eine separate Komponente oder als Teil einer Komponente implementiert ist, die die Host-Bridge11 enthält. Wie unten erläutert, arbeitet der PCI-Expressbus17 in der vorliegenden Erfindung in Verbindung mit zusätzlichen Switching- und Kontrollschaltkreisen19 . Diese Schaltkreise19 erfassen den Status der Endpunkte45 und sind fähig, die Links von einem Endpunkt zu einem anderen umzuschalten. -
2 ist eine Teilansicht des Systems100 und illustriert die dynamische Rekonfiguration von PCI-Expresslinks17b in Übereinstimmung mit der Erfindung. Jeder Link17b ist illustriert als zwei Paare von Signalen – ein Sendepaar und ein Empfangspaar. Sendepaare sind als T-Signale und Empfangspaare als R-Signale kenntlich gemacht. - Die Einschübe
23 und24 sind zum Verbinden mit Endpunkten45 in Kartenart bestimmt. Obwohl nur zwei Einschübe gezeigt sind, ist jede Anzahl von Einschubkonfigurationen möglich, abhängig von der gewünschten Skalierung (x1, x4, etc.) des Links. Die Einschübe23 und24 repräsentieren physikalische Orte, üblicherweise innerhalb des Computergehäuses des Systems100 , wo Karten für verschiedene E/A-Geräte installiert werden können. In anderen Ausführungsformen könnte das System100 eine oder mehrere Chipverbindungen zusätzlich oder anstelle der Einschubverbindungen haben. Der Begriff "Endpunkt Verbindung" kann allgemein gültig verwendet werden, um sich gemeinsam auf die Verbindung für Chips, Karten oder jede andere Art von Endpunkten zu beziehen. - In dem Beispiel von
1 ist Einschub23 mit einer x4-Linkbreite (Link A) konfiguriert. Einschub24 ist mit einer x4-Linkbreite (Link B) konfiguriert. - Die Rekonfiguration wird durch Verwendung der Switche
25 und26 und eines Link-Konfigurationskontrollers27 erreicht. Es versteht sich, dass2 ein Beispiel ist und viele verschiedene Variationen der Switching- und Kontroll-Schaltkreise möglich sind mit verschiedener Anzahl von Links, Einschüben und Switchen und verschiedenen Linkbreiten. - Der Link-Konfigurationskontroller
27 erfasst, ob die Einschübe23 und24 bestückt (in Benutzung) sind. Da der PCI-Bus40 erlaubt, dass Einschübe "hotplugged" (in Betrieb gesteckt) oder "hot-swapped" (in Betrieb getauscht) werden, ist diese Erfassung dynamisch in dem Sinn, dass wann auch immer ein Gerät in einem Slot23 oder24 installiert oder deinstalliert wird, der Kontroller27 dieses Ereignis unverzüglich erfasst. - Link-Konfigurationskontroller
27 kann als ein programmierbares Logikgerät implementiert sein und ein unabhängiger Logikschaltkreis sein oder in einer anderen Systemlogik integriert sein. Beispielsweise kann der Link-Konfigurationskontroller in der Host-Bridge20 integriert sein. - Wenn der Status eines Einschubs (bestückt oder unbestückt) sich verändert, liefert der Kontroller
27 ein Signal an die Switche25 und26 . Die Switche25 und26 können als Hochgeschwindigkeits-Switching-Geräte implementiert sein. Ähnlich wie Kontroller27 , könnten die Switche25 und26 mit anderen Schaltkreisen integriert sein, wie z.B. mit Kontroller27 oder mit der Host-Bridge20 . - In dem Beispiel von
2 hat Link B einen Switch25 an seinen Sendeleitungen und einen Switch26 an seinen Empfangsleitungen. Die Switche25 und26 sind beide betriebsfähig, den Link B entweder zu Einschub23 oder Einschub24 umzuschalten. Wenn Link B zu Einschub23 umgeschaltet ist, empfängt Einschub23 einen x8-Link. Wenn Link B zu Einschub24 umgeschaltet ist, empfängt Einschub24 einen x4-Link. Es wird angenommen, dass entsprechende physikalische Verbindungen zwischen den Switchen25 und26 und Einschub23 gemacht worden sind, so dass das Umschalten zwischen den alternativen Pfaden möglich ist. - In dem Beispiel ist Einschub
23 bestückt und Einschub24 ist unbestückt. Dieser Status ist durch den Kontroller27 erfasst worden, der die Switche25 und26 eingestellt hat, um den ganzen Link B zu Einschub23 umzuschalten. -
3 illustriert ein anderes Beispiel des Betriebs der Erfindung. In diesem Beispiel sind beide Einschübe33 und34 bestückt. Das System ist mit drei x4-Links konfiguriert worden. Link A ist ein x4-Link und ist zu Einschub33 geroutet. Link B ist ebenfalls ein x4-Link und ist zu Einschub B geroutet. Link C ist ein x4-Link und ist zu den Switchen35 und36 geroutet, was ihn zu einem "switchable" (umschaltbaren) Link macht. - Kontroller
27 hat erfasst, dass beide Einschübe33 und34 bestückt sind, aber er hat ebenso erfasst, dass Einschub33 einen x8-Link erfordert und dass Einschub34 nur einen x4-Link benötigt. Als Antwort hat Kontroller27 ein Kontrollsignal an die Switche35 und36 geliefert, so dass Link C zu Einschub33 geroutet ist, was ihn zu einem x8-Einschub macht. Für dieses Beispiel wird angenommen, dass die Karten, mit denen die Einschübe33 und34 bestückt sind, irgendein Mittel besitzen, um den Kontroller27 (direkt oder über das Betriebssystem des Systems100 ) über ihre Bandbreitenerfordernisse zu informieren. -
4 illustriert ein drittes Beispiel, wo Switche verwendet werden, um einen Link zu einem Endpunkt zu rekonfigurieren, so dass nur ein Teil des Links umge routet wird. In dem Beispiel von4 sind die existierenden Konfigurationen von Einschub43 und Einschub44 ein x4- bzw. ein x8-Link. Jedoch ist ein x8-Endpunkt im Einschub43 und ein x4-Endpunkt im Einschub44 untergebracht. Kontroller27 hat den Status und die Bandbreitenerfordernisse der beiden Einschübe erfasst und hat die Switche45 und46 so betätigt, dass ein Teil des Links B zu dem Einschub43 umgeroutet wird. In einer Variation dieses Beispiels könnte der Einschub44 unbestückt sein und Link B umgeschaltet, so dass er in einen x4-Pfad zu Einschub43 und einen x4-Pfad zu irgendeinem anderen Endpunkt geteilt ist. - Die oben beschriebenen Beispiele erreichen die "Rekonfiguration" in dem Sinne, dass sie existierende Links umrouten, d.h. Links, die schon physikalisch zu verschiedenen Endpunkten an dem Bus geroutet worden sind. Ohne die Erfindung würde der PCI-Expressbus in Übereinstimmung mit egal welcher Link-Konfiguration arbeiten, die bei der Initialisierung des Systems
100 eingerichtet war. Darüber hinaus sind das Verfahren und die Schaltkreise der oben beschriebenen Beispiele "dynamisch" in dem Sinne, dass die Statuserfassung und das Umschalten stattfinden, während das System100 eingeschaltet wird (während des Inbetriebsetzens) und während das Betriebssystem läuft. Daher ist die Statuserfassung die Erfassung des Echtzeit-(aktuellen)-Status eines Endpunkts. Die Erfassung und das Umschalten der vorliegenden Erfindung arbeitet auf Links, die im Vorhinein skaliert wurden in Übereinstimmung mit der Skalierungsfähigkeit eines PCI-Expressbusses. Es ist eine dynamische Rekonfiguration verglichen mit der statischen Konfiguration, die aus der Skalierung resultiert. - In dem obigen Beispiel erfasst Kontroller
27 den Status der Einschübe und liefert ein Kontrollsignal an die Konfigurationsswitche. In anderen Ausführungsformen kann eine oder beide dieser Funktionen von dem Betriebssystem des Systems100 ausgeführt werden, wie z.B. von seinem BIOS. Das heißt, das BIOS könnte programmiert werden, um den Status der Einschübe an seinem PCI-Expressbus40 zu erfassen und/oder die Leitungen in Antwort auf den Status umzuschalten. Daher kann in verschiedenen Ausführungsformen der vorliegenden Erfindung die Erfassungs- und Umschaltfunktion (Switchingfunktion) hardware- oder softwaregesteuert sein. - Die Rekonfiguration könnte nützlich sein ohne die "dynamischen" Erfassungsaspekte der Erfindung. In anderen Worten, es kann Situationen geben, in denen es wünschenswert ist, existierende PCI-Expressbus-Links manuell umzurouten. Beispielsweise kann eine Karte, welche einen x8-Link benötigt, physikalisch in einen Einschub innerhalb eines Gehäuses passen, der einen x4-Link hat. Die x8-Karte könnte mit einer x4-Karte umgeschaltet und ihre Links umgeroutet sein.
Claims (23)
- Ein Verfahren zum Rekonfigurieren von Links eines PCI-Expressbusses eines Informationsverarbeitungssystems, wobei die Links zu Endpunkten auf dem Bus geroutet werden, mit den folgenden Schritten: Erfassen des Status von einem oder mehreren der Endpunkten; und Umschalten des gesamten oder eines Teils eines Links von einem Endpunkt zu einem anderen Endpunkt basierend auf dem Ergebnis des Erfassungsschrittes.
- Das Verfahren gemäß Anspruch 1, wobei der Erfassungsschritt ausgeführt wird durch Erfassung, ob ein Endpunkt bestückt ist.
- Das Verfahren gemäß Anspruch 2, wobei der Umschaltungsschritt ausgeführt wird durch Umschalten eines Links von einem unbestückten Endpunkt zu einem oder mehreren bestückten Endpunkten.
- Das Verfahren gemäß Anspruch 1, wobei der Erfassungsschritt ausgeführt wird durch Erfassung der Bandbreitenerfordernisse von Geräten, die an bestückten Endpunkten installiert sind.
- Das Verfahren gemäß Anspruch 1, wobei der Umschaltungsschritt ausgeführt wird mit Switchen, die extern zu der PCI-Expressbus-Switchingstruktur sind.
- Das Verfahren gemäß Anspruch 1, wobei das Informationsverarbeitungssystem ein Betriebssystem hat und der Erfassungsschritt ausgeführt wird durch Benutzung von Schaltkreisen, die extern zu dem Betriebssystem sind.
- Das Verfahren gemäß Anspruch 1, wobei das Informationsverarbeitungssystem ein Betriebssystem hat und der Erfassungsschritt durch Benutzung des Betriebssystems ausgeführt wird.
- Das Verfahren gemäß Anspruch 1, wobei der Umschaltungsschritt ausgeführt wird durch Umschalten an mehr als einen anderen Endpunkt.
- Das Verfahren gemäß Anspruch 1, wobei das Informationsverarbeitungssystem während der Erfassungs- und Umschaltungsschritte in Betrieb ist.
- Schaltkreise zum Rekonfigurieren von Links eines PCI-Expressbusses eines Informationsverarbeitungssystems, wobei die Links zu den Endpunkten des Busses geroutet werden, umfassend: einen Kontroller zur Erfassung des Status von einem oder mehreren der Endpunkte; und Switche, die mindestens einem der Links zugeordnet sind, und die betriebsfähig sind, den ganzen oder einen Teil des Links von einem Endpunkt zu einem anderen Endpunkt umzuschalten, als Antwort auf ein Signal von dem Kontroller, und während das Informationsverarbeitungssystem in Betrieb ist.
- Die Schaltkreise gemäß Anspruch 10, wobei der Kontroller erfasst, ob ein Endpunkt bestückt ist.
- Die Schaltkreise gemäß Anspruch 11, wobei die Switche betriebsfähig sind, einen Link von einem unbestückten Endpunkt zu einem oder mehreren bestückten Endpunkten umzuschalten.
- Die Schaltkreise gemäß Anspruch 10, wobei der Kontroller die Bandbreitenerfordernisse von Geräten erfasst, die an bestückten Endpunkten installiert sind.
- Die Schaltkreise gemäß Anspruch 10, wobei die Switche extern zu der PCI-Expressbus-Switchingstruktur sind.
- Die Schaltkreise gemäß Anspruch 10, wobei das Informationsverarbeitungssystem eine Host-Bridge hat und wobei der Kontroller in die Host-Bridge integriert ist.
- Die Schaltkreise gemäß Anspruch 10, wobei das Signal von dem Kontroller an die Switche gerichtet ist.
- Die Schaltkreise gemäß Anspruch 10, wobei das Signal von dem Kontroller durch das Betriebssystem des Informationsverarbeitungssystems führt.
- Ein Informationsverarbeitungssystem,umfassend: eine Zentralverarbeitungseinheit; Speicher zum Speichern von ausführbaren Programmen durch die Zentralverarbeitungseinheit; einen PCI-Expressbus zum Verbinden von Eingabe/Ausgabe-Endpunkten an das System, und aufweisend eine Switchingstruktur und Links von der Host-Bridge zu den Endpunkten; eine Host-Bridge zum Verbinden der CPU, des Speichers und des Busses; und Link-Rekonfigurationsschaltkreise zum Rekonfigurieren von Links des PCI-Expressbusses und aufweisend einen Kontroller zur Erfassung des Status von einem oder mehreren der Endpunkte und Switche, zugeordnet zu mindestens einem der Links und betriebsbereit, um den gesamten oder einen Teil des Links von einem Endpunkt zu einem anderen Endpunkt umzuschalten, als Antwort auf ein Signal von dem Kontroller, während das Informationsverarbeitungssystem in Betrieb ist.
- Das System gemäß Anspruch 18, wobei der Kontroller erfasst, ob ein Endpunkt bestückt ist.
- Das System gemäß Anspruch 19, wobei die Switche betriebsfähig sind, einen Link von einem unbestückten Endpunkt zu einem oder mehreren bestückten Endpunkten umzuschalten.
- Das System gemäß Anspruch 18, wobei der Kontroller die Bandbreitenerfordernisse von Geräten erfasst, die an bestückten Endpunkten installiert sind.
- Das System gemäß Anspruch 18, wobei die Switche extern sind zu der PCI-Expressbus-Switchingstruktur.
- Das System gemäß Anspruch 18, wobei der Kontroller in die Host-Bridge integriert ist.
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Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE102007019047A1 (de) * | 2007-04-23 | 2008-11-13 | Abb Ag | Kommunikationsanordnung |
Families Citing this family (121)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7480831B2 (en) * | 2003-01-23 | 2009-01-20 | Dell Products L.P. | Method and apparatus for recovering from a failed I/O controller in an information handling system |
| TWI242134B (en) * | 2004-02-12 | 2005-10-21 | Via Tech Inc | Data extraction method and system |
| US7246190B2 (en) * | 2004-04-21 | 2007-07-17 | Hewlett-Packard Development Company, L.P. | Method and apparatus for bringing bus lanes in a computer system using a jumper board |
| US20050270298A1 (en) * | 2004-05-14 | 2005-12-08 | Mercury Computer Systems, Inc. | Daughter card approach to employing multiple graphics cards within a system |
| US20050270988A1 (en) * | 2004-06-04 | 2005-12-08 | Dehaemer Eric | Mechanism of dynamic upstream port selection in a PCI express switch |
| US7370224B1 (en) * | 2005-02-17 | 2008-05-06 | Alcatel Usa Sourcing, Inc | System and method for enabling redundancy in PCI-Express architecture |
| TWI258670B (en) * | 2004-10-19 | 2006-07-21 | Elitegroup Computer Systems Co Ltd | Main board with a slot-sharing circuit for PCI express x16 and x1 slot to be connected to |
| TWI274255B (en) * | 2004-11-08 | 2007-02-21 | Asustek Comp Inc | Motherboard |
| US7174411B1 (en) * | 2004-12-02 | 2007-02-06 | Pericom Semiconductor Corp. | Dynamic allocation of PCI express lanes using a differential mux to an additional lane to a host |
| JP4558519B2 (ja) * | 2005-01-18 | 2010-10-06 | 富士通株式会社 | 情報処理装置およびシステムバス制御方法 |
| US20060168377A1 (en) * | 2005-01-21 | 2006-07-27 | Dell Products L.P. | Reallocation of PCI express links using hot plug event |
| US20060168391A1 (en) * | 2005-01-26 | 2006-07-27 | Phison Electronics Corp. | [flash memory storage device with pci express] |
| JP4398386B2 (ja) * | 2005-01-28 | 2010-01-13 | 富士通株式会社 | 複数の処理ノードをシリアルバスにより相互接続する装置 |
| US8021193B1 (en) | 2005-04-25 | 2011-09-20 | Nvidia Corporation | Controlled impedance display adapter |
| US9606795B1 (en) * | 2005-05-05 | 2017-03-28 | Alcatel-Lucent Usa Inc. | Providing intelligent components access to an external interface |
| US7793029B1 (en) * | 2005-05-17 | 2010-09-07 | Nvidia Corporation | Translation device apparatus for configuring printed circuit board connectors |
| US7539801B2 (en) * | 2005-05-27 | 2009-05-26 | Ati Technologies Ulc | Computing device with flexibly configurable expansion slots, and method of operation |
| US20060282599A1 (en) * | 2005-06-10 | 2006-12-14 | Yung-Cheng Chiu | SLI adaptor card and method for mounting the same to motherboard |
| US20060294279A1 (en) * | 2005-06-28 | 2006-12-28 | Mckee Kenneth G | Mechanism for peripheral component interconnect express (PCIe) connector multiplexing |
| US7480790B2 (en) * | 2005-07-29 | 2009-01-20 | Hewlett-Packard Development Company, L.P. | Sleep state resume |
| US20070038794A1 (en) * | 2005-08-10 | 2007-02-15 | Purcell Brian T | Method and system for allocating a bus |
| US7539809B2 (en) * | 2005-08-19 | 2009-05-26 | Dell Products L.P. | System and method for dynamic adjustment of an information handling systems graphics bus |
| TWI269975B (en) * | 2005-08-25 | 2007-01-01 | Inventec Corp | Method and device for automatically adjusting bus width |
| US7536489B2 (en) | 2005-08-30 | 2009-05-19 | Ricoh Company Limited | Information processing system for determining payload size based on packet-to-payload size ratio |
| JP4777723B2 (ja) * | 2005-08-30 | 2011-09-21 | 株式会社リコー | 情報処理システム、プログラムおよびデータ転送方法 |
| CN100414526C (zh) * | 2005-08-31 | 2008-08-27 | 英业达股份有限公司 | 自动调整总线宽度的方法及装置 |
| US20070067535A1 (en) * | 2005-09-20 | 2007-03-22 | Ta-Wei Liu | Motherboard capable of selectively supporting dual graphic engine |
| US8189603B2 (en) | 2005-10-04 | 2012-05-29 | Mammen Thomas | PCI express to PCI express based low latency interconnect scheme for clustering systems |
| US7447824B2 (en) * | 2005-10-26 | 2008-11-04 | Hewlett-Packard Development Company, L.P. | Dynamic lane management system and method |
| US7660926B2 (en) * | 2005-11-16 | 2010-02-09 | Sun Microsystems, Inc. | Apparatus and method for a core for implementing a communications port |
| CN100382064C (zh) * | 2005-12-19 | 2008-04-16 | 威盛电子股份有限公司 | 状态协调方法 |
| CN100435125C (zh) * | 2005-12-20 | 2008-11-19 | 英业达股份有限公司 | 总线宽度自动调整系统 |
| CN100424668C (zh) * | 2005-12-20 | 2008-10-08 | 英业达股份有限公司 | Pci-e总线自动配置系统 |
| US7496742B2 (en) * | 2006-02-07 | 2009-02-24 | Dell Products L.P. | Method and system of supporting multi-plugging in X8 and X16 PCI express slots |
| US20070233926A1 (en) * | 2006-03-10 | 2007-10-04 | Inventec Corporation | Bus width automatic adjusting method and system |
| JP4877482B2 (ja) * | 2006-04-11 | 2012-02-15 | 日本電気株式会社 | PCIExpressリンク、マルチホストコンピュータシステム、およびPCIExpressリンクの再構成方法 |
| US7562174B2 (en) * | 2006-06-15 | 2009-07-14 | Nvidia Corporation | Motherboard having hard-wired private bus between graphics cards |
| US7412554B2 (en) * | 2006-06-15 | 2008-08-12 | Nvidia Corporation | Bus interface controller for cost-effective high performance graphics system with two or more graphics processing units |
| US7500041B2 (en) * | 2006-06-15 | 2009-03-03 | Nvidia Corporation | Graphics processing unit for cost effective high performance graphics system with two or more graphics processing units |
| US7536490B2 (en) * | 2006-07-20 | 2009-05-19 | Via Technologies, Inc. | Method for link bandwidth management |
| CN100561455C (zh) * | 2006-09-01 | 2009-11-18 | 鸿富锦精密工业(深圳)有限公司 | 高速差分信号传输硬件架构 |
| US7716503B2 (en) * | 2006-12-14 | 2010-05-11 | Inventec Corporation | Extension card incorporating power management device |
| US7529860B2 (en) * | 2006-12-19 | 2009-05-05 | International Business Machines Corporation | System and method for configuring an endpoint based on specified valid combinations of functions |
| US7793089B2 (en) * | 2007-01-31 | 2010-09-07 | Hewlett-Packard Development Company, L.P. | Configurable backplane connectivity for an electrical device |
| US7660925B2 (en) * | 2007-04-17 | 2010-02-09 | International Business Machines Corporation | Balancing PCI-express bandwidth |
| US7702840B1 (en) * | 2007-05-14 | 2010-04-20 | Xilinx, Inc. | Interface device lane configuration |
| US7930462B2 (en) * | 2007-06-01 | 2011-04-19 | Apple Inc. | Interface controller that has flexible configurability and low cost |
| US20090006708A1 (en) * | 2007-06-29 | 2009-01-01 | Henry Lee Teck Lim | Proportional control of pci express platforms |
| US7603500B2 (en) * | 2007-08-10 | 2009-10-13 | Dell Products L.P. | System and method for allowing coexistence of multiple PCI managers in a PCI express system |
| TW200910103A (en) * | 2007-08-29 | 2009-03-01 | Inventec Corp | Method for dynamically allocating link width of riser card |
| US20090063894A1 (en) * | 2007-08-29 | 2009-03-05 | Billau Ronald L | Autonomic PCI Express Hardware Detection and Failover Mechanism |
| US7934032B1 (en) * | 2007-09-28 | 2011-04-26 | Emc Corporation | Interface for establishing operability between a processor module and input/output (I/O) modules |
| US7653773B2 (en) * | 2007-10-03 | 2010-01-26 | International Business Machines Corporation | Dynamically balancing bus bandwidth |
| US7711886B2 (en) * | 2007-12-13 | 2010-05-04 | International Business Machines Corporation | Dynamically allocating communication lanes for a plurality of input/output (‘I/O’) adapter sockets in a point-to-point, serial I/O expansion subsystem of a computing system |
| US7809872B2 (en) * | 2007-12-14 | 2010-10-05 | Infineon Technologies Ag | Master and slave device for communicating on a communication link with limited resource |
| US7809869B2 (en) * | 2007-12-20 | 2010-10-05 | International Business Machines Corporation | Throttling a point-to-point, serial input/output expansion subsystem within a computing system |
| US8175085B2 (en) * | 2008-03-25 | 2012-05-08 | Fusion-Io, Inc. | Bus scaling device |
| TWI363969B (en) * | 2008-04-30 | 2012-05-11 | Asustek Comp Inc | A computer system with data accessing bridge circuit |
| CN102112969A (zh) * | 2008-06-01 | 2011-06-29 | 惠普开发有限公司 | Pci express链路中的队列共享和重配置 |
| CN101636040B (zh) * | 2008-07-21 | 2011-12-14 | 鸿富锦精密工业(深圳)有限公司 | 印刷电路板 |
| CN102197404A (zh) * | 2008-10-24 | 2011-09-21 | 松下电器产业株式会社 | 卡主机lsi和具有该卡主机lsi的设置机器 |
| JP5272704B2 (ja) * | 2008-12-17 | 2013-08-28 | 富士ゼロックス株式会社 | 情報伝送システム、情報送信装置及び情報受信装置 |
| US8296469B2 (en) * | 2008-12-31 | 2012-10-23 | Intel Corporation | Scalable method and apparatus for link with reconfigurable ports |
| TWI385533B (zh) * | 2009-05-11 | 2013-02-11 | Via Tech Inc | 電腦系統、資料交換裝置以及資料交換方法 |
| US8687639B2 (en) | 2009-06-04 | 2014-04-01 | Nvidia Corporation | Method and system for ordering posted packets and non-posted packets transfer |
| US7996596B2 (en) * | 2009-07-17 | 2011-08-09 | Dell Products, Lp | Multiple minicard interface system and method thereof |
| US8140730B2 (en) * | 2009-08-12 | 2012-03-20 | International Business Machines Corporation | System reconfiguration of expansion cards |
| US8532098B2 (en) * | 2009-11-30 | 2013-09-10 | Nvidia Corporation | System and method for virtual channel communication |
| US9176909B2 (en) * | 2009-12-11 | 2015-11-03 | Nvidia Corporation | Aggregating unoccupied PCI-e links to provide greater bandwidth |
| US9183166B2 (en) * | 2009-12-14 | 2015-11-10 | Rambus Inc. | Expandable asymmetric-channel memory system |
| CN102193583B (zh) * | 2010-03-04 | 2014-03-26 | 鸿富锦精密工业(深圳)有限公司 | 便携式计算机 |
| US9331869B2 (en) | 2010-03-04 | 2016-05-03 | Nvidia Corporation | Input/output request packet handling techniques by a device specific kernel mode driver |
| US8429325B1 (en) * | 2010-08-06 | 2013-04-23 | Integrated Device Technology Inc. | PCI express switch and method for multi-port non-transparent switching |
| TWI528161B (zh) * | 2010-09-30 | 2016-04-01 | 瑞昱半導體股份有限公司 | 資料傳輸系統以及資料傳輸方法 |
| US8706944B2 (en) | 2010-12-22 | 2014-04-22 | Intel Corporation | Dual bus standard switching bus controller |
| US20120260015A1 (en) * | 2011-04-07 | 2012-10-11 | Raphael Gay | Pci express port bifurcation systems and methods |
| CN102810085A (zh) * | 2011-06-03 | 2012-12-05 | 鸿富锦精密工业(深圳)有限公司 | Pci-e扩展系统及方法 |
| WO2012106934A1 (zh) * | 2011-07-27 | 2012-08-16 | 华为技术有限公司 | Pci快速通道设备、链路能量管理方法及系统 |
| CN102931546A (zh) * | 2011-08-10 | 2013-02-13 | 鸿富锦精密工业(深圳)有限公司 | 连接器组合 |
| CN102957009A (zh) * | 2011-08-17 | 2013-03-06 | 鸿富锦精密工业(深圳)有限公司 | 连接器组合 |
| US8756360B1 (en) * | 2011-09-26 | 2014-06-17 | Agilent Technologies, Inc. | PCI-E compatible chassis having multi-host capability |
| TWI461921B (zh) * | 2011-12-02 | 2014-11-21 | Asustek Comp Inc | 電子裝置及其雷電連接器之模式切換方法 |
| US9330031B2 (en) | 2011-12-09 | 2016-05-03 | Nvidia Corporation | System and method for calibration of serial links using a serial-to-parallel loopback |
| WO2013115798A1 (en) * | 2012-01-31 | 2013-08-08 | Hewlett-Packard Development Company, L.P. | Flexible port configuration based on interface coupling |
| WO2013126547A1 (en) * | 2012-02-21 | 2013-08-29 | Zih Corp. | Electrically configurable option board interface |
| US9122810B2 (en) * | 2012-05-18 | 2015-09-01 | Dell Products, Lp | System and method for providing input/output functionality to a processing node |
| TW201349166A (zh) * | 2012-05-28 | 2013-12-01 | Hon Hai Prec Ind Co Ltd | 匯流排帶寬調整方法及系統 |
| US9152595B2 (en) * | 2012-10-18 | 2015-10-06 | Qualcomm Incorporated | Processor-based system hybrid ring bus interconnects, and related devices, processor-based systems, and methods |
| TWI456407B (zh) * | 2012-10-18 | 2014-10-11 | Inventec Corp | 用於快捷外設互聯標準插槽的檢測系統及其方法 |
| JP2014137614A (ja) * | 2013-01-15 | 2014-07-28 | Fujitsu Ltd | 情報処理装置、デバイス装置及びプログラム |
| US9436630B2 (en) | 2013-06-11 | 2016-09-06 | Western Digital Technologies, Inc. | Using dual phys to support multiple PCIe link widths |
| US9626319B2 (en) * | 2013-08-23 | 2017-04-18 | Lenovo Enterprise Solutions (Singapore) Pte. Ltd. | Allocating lanes in a peripheral component interconnect express (‘PCIe’) bus |
| CN104461988A (zh) * | 2013-09-23 | 2015-03-25 | 鸿富锦精密电子(天津)有限公司 | 接口切换系统及功能卡 |
| US9984015B2 (en) * | 2014-02-28 | 2018-05-29 | Hewlett-Packard Development Company, L.P. | Computing system control |
| CN104317763A (zh) * | 2014-10-29 | 2015-01-28 | 华为数字技术(苏州)有限公司 | 一种串行信号合并装置、系统及方法 |
| WO2016122480A1 (en) | 2015-01-28 | 2016-08-04 | Hewlett-Packard Development Company, L.P. | Bidirectional lane routing |
| EP3251018A4 (de) * | 2015-01-28 | 2018-10-03 | Hewlett-Packard Development Company, L.P. | Umleitung von fahrspurressourcen |
| US10585673B2 (en) | 2015-02-10 | 2020-03-10 | Hewlett Packard Enterprise Development Lp | Chipset reconfiguration based on device detection |
| CN104657317B (zh) * | 2015-03-06 | 2017-12-26 | 北京百度网讯科技有限公司 | 服务器 |
| CN107408090B (zh) | 2015-03-27 | 2021-03-26 | 英特尔公司 | 输入/输出控制器访问通道的动态配置 |
| US10049076B2 (en) | 2015-04-02 | 2018-08-14 | Western Digital Technologies, Inc. | Methods and systems for implementing high speed serial interface bus having inhomogeneous lane bundles and encodings |
| US10158525B2 (en) | 2015-08-12 | 2018-12-18 | Nxp Usa, Inc. | System and method for radio base station device hot switching and hot swapping |
| US10212754B2 (en) | 2015-08-12 | 2019-02-19 | Nxp Usa, Inc. | System and method for radio base station device hot reconnection (hot plugging) |
| CN106290943B (zh) * | 2015-10-14 | 2018-07-27 | 北京信息科技大学 | 一种流式细胞仪总线控制装置和方法 |
| KR102611987B1 (ko) | 2015-11-23 | 2023-12-08 | 삼성전자주식회사 | 패브릭 네트워크를 이용한 파워 관리 방법 및 이를 적용하는 패브릭 네트워크 시스템 |
| CN105512058A (zh) * | 2015-11-27 | 2016-04-20 | 浪潮(北京)电子信息产业有限公司 | 一种高端存储pcie交换机及其管理模块 |
| US10102074B2 (en) | 2015-12-01 | 2018-10-16 | International Business Machines Corporation | Switching allocation of computer bus lanes |
| US10296484B2 (en) | 2015-12-01 | 2019-05-21 | International Business Machines Corporation | Dynamic re-allocation of computer bus lanes |
| US10122386B2 (en) | 2015-12-15 | 2018-11-06 | Nxp Usa, Inc. | System and method for on-the-fly modification of the properties on an active antenna carrier in radio base station communication operation |
| US9979600B2 (en) | 2015-12-15 | 2018-05-22 | Nxp Usa, Inc. | System and method for automatic load adaptive antenna carrier bandwidth dynamic reconfiguration in radio base station system |
| US10178641B2 (en) | 2016-01-04 | 2019-01-08 | Nxp Usa, Inc. | System and method for automatic delay compensation in a radio base station system |
| KR20170102717A (ko) * | 2016-03-02 | 2017-09-12 | 한국전자통신연구원 | 패브릭 연결망 기반의 마이크로 서버 |
| US10387346B2 (en) * | 2016-05-06 | 2019-08-20 | Quanta Computer Inc. | Dynamic PCIE switch reconfiguration mechanism |
| US10331605B2 (en) * | 2016-08-30 | 2019-06-25 | International Business Machines Corporation | Dynamic re-allocation of signal lanes |
| TWI596484B (zh) * | 2016-12-22 | 2017-08-21 | 財團法人工業技術研究院 | 應用快速周邊組件互聯介面的環狀網路系統及其設定方法 |
| CN109828942A (zh) * | 2017-11-23 | 2019-05-31 | 凌华科技股份有限公司 | 智能化PCIe插槽通道分配方法 |
| TW202005485A (zh) * | 2018-06-01 | 2020-01-16 | 緯穎科技服務股份有限公司 | 擴充快捷外設互聯標準兼容性的電路 |
| US10387349B1 (en) | 2018-08-22 | 2019-08-20 | International Busniess Machines Corporation | Dynamically bypassing a peripheral component interconnect switch |
| US20230048504A1 (en) * | 2020-02-18 | 2023-02-16 | Hewlett-Packard Development Company, L.P. | Dynamic allocation of shared bus lanes |
| KR102833253B1 (ko) * | 2020-08-11 | 2025-07-10 | 삼성전자주식회사 | 메모리 컨트롤러, 메모리 컨트롤러의 동작 방법 및 스토리지 장치 |
| US11599484B2 (en) * | 2020-12-01 | 2023-03-07 | Micron Technology, Inc. | Semiconductor device having plural signal buses for multiple purposes |
Family Cites Families (11)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6535929B1 (en) * | 1996-07-02 | 2003-03-18 | Sun Microsystems, Inc. | Universal communication mechanism for applications running in a multitasking environment |
| US6256700B1 (en) * | 1999-03-30 | 2001-07-03 | Dell Usa, L.P. | Bus/port switching system and method for a computer |
| US6535939B1 (en) * | 1999-11-09 | 2003-03-18 | International Business Machines Corporation | Dynamically configurable memory bus and scalability ports via hardware monitored bus utilizations |
| US6826645B2 (en) * | 2000-12-13 | 2004-11-30 | Intel Corporation | Apparatus and a method to provide higher bandwidth or processing power on a bus |
| US6665742B2 (en) * | 2001-01-31 | 2003-12-16 | Advanced Micro Devices, Inc. | System for reconfiguring a first device and/or a second device to use a maximum compatible communication parameters based on transmitting a communication to the first and second devices of a point-to-point link |
| JP3787498B2 (ja) * | 2001-02-13 | 2006-06-21 | キヤノン株式会社 | 撮像装置及び撮像システム |
| EP1253519B1 (de) * | 2001-04-23 | 2009-03-04 | Hewlett-Packard Company | Rechner, Verfahren zur Verbindung von Geräten mit Bussteuereinrichtungen, Verfahren zur Bandbreitenzuordnung einer Mehrzahl von Datenbussteuereinrichtungen und Vorrichtung dafür |
| US6918001B2 (en) * | 2002-01-02 | 2005-07-12 | Intel Corporation | Point-to-point busing and arrangement |
| US7802049B2 (en) * | 2002-10-30 | 2010-09-21 | Intel Corporation | Links having flexible lane allocation |
| US20040233856A1 (en) * | 2003-05-20 | 2004-11-25 | Lanus Mark S. | Method of configuring a computer network having an N/2 slot switch module |
| US7383365B2 (en) * | 2003-07-16 | 2008-06-03 | Dell Products L.P. | Method and system for PCI express audiovisual output |
-
2003
- 2003-11-06 US US10/702,832 patent/US7099969B2/en not_active Expired - Lifetime
-
2004
- 2004-10-26 KR KR1020040085758A patent/KR20050044247A/ko not_active Ceased
- 2004-10-26 TW TW093132374A patent/TWI328168B/zh not_active IP Right Cessation
- 2004-10-26 SG SG200406877A patent/SG112061A1/en unknown
- 2004-10-26 JP JP2004311154A patent/JP2005141739A/ja active Pending
- 2004-11-04 GB GB0424436A patent/GB2407890B/en not_active Expired - Lifetime
- 2004-11-05 FR FR0411796A patent/FR2862147B1/fr not_active Expired - Lifetime
- 2004-11-08 CN CN2008100984109A patent/CN101303681B/zh not_active Expired - Lifetime
- 2004-11-08 DE DE102004053801.8A patent/DE102004053801B4/de not_active Expired - Lifetime
- 2004-11-08 CN CNB2004100907157A patent/CN100444145C/zh not_active Expired - Lifetime
-
2006
- 2006-08-29 US US11/468,222 patent/US7293125B2/en not_active Expired - Lifetime
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE102007019047A1 (de) * | 2007-04-23 | 2008-11-13 | Abb Ag | Kommunikationsanordnung |
| DE102007019047B4 (de) * | 2007-04-23 | 2015-06-18 | Abb Ag | Kommunikationsanordnung |
Also Published As
| Publication number | Publication date |
|---|---|
| US7099969B2 (en) | 2006-08-29 |
| FR2862147A1 (fr) | 2005-05-13 |
| US7293125B2 (en) | 2007-11-06 |
| TW200519613A (en) | 2005-06-16 |
| GB0424436D0 (en) | 2004-12-08 |
| US20050102454A1 (en) | 2005-05-12 |
| TWI328168B (en) | 2010-08-01 |
| CN101303681A (zh) | 2008-11-12 |
| CN101303681B (zh) | 2012-06-27 |
| FR2862147B1 (fr) | 2007-04-06 |
| GB2407890A (en) | 2005-05-11 |
| CN100444145C (zh) | 2008-12-17 |
| JP2005141739A (ja) | 2005-06-02 |
| US20070073959A1 (en) | 2007-03-29 |
| DE102004053801B4 (de) | 2015-07-30 |
| KR20050044247A (ko) | 2005-05-12 |
| GB2407890B (en) | 2006-07-12 |
| CN1624674A (zh) | 2005-06-08 |
| SG112061A1 (en) | 2005-06-29 |
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