TWI694571B - 字元線結構及其製造方法 - Google Patents
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Abstract
一種字元線結構，包括：基底、堆疊結構以及金屬矽化物結構。堆疊結構配置在基底上。金屬矽化物結構配置在堆疊結構上。金屬矽化物結構包括第一金屬元素、第二金屬元素以及矽元素。第一金屬元素與第二金屬元素不同，且第一金屬元素的濃度與第二金屬元素的濃度自金屬矽化物結構的頂面往基底的方向逐漸減少。
Description
本發明是有關於一種記憶元件及其製造方法，且特別是有關於一種字元線結構及其製造方法。
金屬矽化物層具有高熔點、穩定性及低電阻值等優點，目前已廣泛應用於積體電路上。在逐漸微小化的積體電路技術中，線寬、接觸面積及接面深度等逐漸縮小，為了能有效地提高元件的工作品質，降低電阻並減少電阻及電容所造成的信號傳遞延遲，因而常利用金屬矽化物層來有效地降低接面電阻值。
然而，隨著記憶體技術的進步，記憶體的關鍵尺寸（例如字元線間距）亦隨之縮小。由於字元線間距縮小，在矽化製程（silicidation process）中容易產生字元線頸縮（necking）而引起字元線彎曲（bending）問題，其可能導致漏電流，進而影響記憶體的效能。
本發明提供一種字元線結構及其製造方法，其可避免字元線頸縮所引起的字元線彎曲問題，並改善原有字元線阻抗的穩定性與耐久度，進而提升記憶體的效能。
本發明提供一種字元線結構，包括：基底、堆疊結構以及金屬矽化物結構。堆疊結構配置在基底上。金屬矽化物結構配置在堆疊結構上。金屬矽化物結構包括第一金屬元素、第二金屬元素以及矽元素。第一金屬元素與第二金屬元素不同，且第一金屬元素的濃度與第二金屬元素的濃度自金屬矽化物結構的頂面往基底的方向逐漸減少。
在本發明的一實施例中，上述的第一金屬元素包括鈦、鎳或其組合，而第二金屬元素包括鈷。
在本發明的一實施例中，上述的第一金屬元素的濃度小於第二金屬元素的濃度，且第二金屬元素的濃度小於矽元素的濃度。
在本發明的一實施例中，上述的金屬矽化物結構包括第一部分與位於第一部分上的第二部分，且第一金屬元素於第二部分中的平均濃度大約是於第一部分中的5至7倍。
在本發明的一實施例中，上述的第二部分中的第二金屬元素的平均濃度與第一部分中的第二金屬元素的平均濃度的比為1至2。
在本發明的一實施例中，上述的第一金屬元素具有第一濃度梯度，第二金屬元素具有第二濃度梯度，且第一濃度梯度大於第二濃度梯度。
在本發明的一實施例中，上述的堆疊結構包括：電荷儲存層、導體層以及閘間介電層。導體層配置在電荷儲存層上。閘間介電層配置在電荷儲存層與導體層之間。
在本發明的一實施例中，上述的字元線結構，更包括穿隧介電層配置在基底與堆疊結構之間。
本發明提供一種在本發明的一實施例中，上述的字元線結構的製造方法，其步驟如下。在基底上形成堆疊結構。進行沉積製程，依序形成第一金屬層與第二金屬層，以覆蓋堆疊結構的頂部，其中第一金屬層與第二金屬層具有不同金屬。進行熱處理製程，以將堆疊結構的頂部轉變為金屬矽化物結構。
在本發明的一實施例中，上述的第一金屬層包括鈦層、鎳層或其組合，而第二金屬層包括鈷層。
在本發明的一實施例中，上述的第一金屬層的厚度小於第二金屬層的厚度。
在本發明的一實施例中，上述的進行熱處理製程包括以下步驟。進行第一熱處理步驟，使得第一金屬層、第二金屬層與堆疊結構的頂部進行反應。進行選擇性移除步驟，以移除未反應的第一金屬層與未反應的第二金屬層。進行第二熱處理步驟，且第二熱處理步驟的溫度大於第一熱處理步驟的溫度。
在本發明的一實施例中，上述的沉積製程與第一熱處理步驟是同時進行的。
在本發明的一實施例中，上述的第一熱處理步驟是在沉積製程之後進行的。
在本發明的一實施例中，上述的製造方法，更包括在第二金屬層上形成頂蓋層，其中頂蓋層包括金屬氮化物層。
在本發明的一實施例中，上述的金屬矽化物結構包括第一金屬元素、第二金屬元素以及矽元素。第一金屬元素與第二金屬元素不同。第一金屬元素的濃度與第二金屬元素的濃度自金屬矽化物結構的頂面往基底的方向逐漸減少。
在本發明的一實施例中，上述的第一金屬元素的濃度小於第二金屬元素的濃度，且第二金屬元素的濃度小於矽元素的濃度。
在本發明的一實施例中，上述的金屬矽化物結構包括第一部分與位於第一部分上的第二部分，且第一金屬元素於第二部分中的平均濃度大約是第一部分中的5至7倍。
在本發明的一實施例中，上述的第二部分中的第二金屬元素的平均濃度與第一部分中的第二金屬元素的平均濃度的比為1至2。
在本發明的一實施例中，上述的第一金屬元素具有第一濃度梯度，第二金屬元素具有第二濃度梯度，且第一濃度梯度大於第二濃度梯度。
基於上述，在本實施例中，依序形成第一金屬層與第二金屬層以覆蓋堆疊結構的頂部，並進行熱處理製程，以將堆疊結構的頂部轉變為金屬矽化物結構。由於第一金屬層與第二金屬層具有不同材料，其可保持金屬矽化物結構的形狀，而不易產生頸縮或彎曲。在此情況下，本實施例可降低字元線阻抗，進而提升記憶體的效能。
為讓本發明的上述特徵和優點能更明顯易懂，下文特舉實施例，並配合所附圖式作詳細說明如下。
參照本實施例之圖式以更全面地闡述本發明。然而，本發明亦可以各種不同的形式體現，而不應限於本文中所述之實施例。圖式中的層與區域的厚度會為了清楚起見而放大。相同或相似之標號表示相同或相似之元件，以下段落將不再一一贅述。
圖1A至圖1E是依照本發明一實施例的一種字元線結構的製造流程的剖面示意圖。以下實施例中所述的字元線結構可應用在記憶元件（例如快閃記憶體）中，但本發明不以此為限。
請參照圖1A，本發明實施例提供一種字元線結構10（如圖1D所示）的製造方法，其步驟如下。首先，提供基底100。在一些實施例中，基底100例如為半導體基底、半導體化合物基底或是絕緣層上有半導體基底（Semiconductor Over Insulator, SOI）。半導體例如是IVA族的原子，例如矽或鍺。半導體化合物例如是IVA族的原子所形成之半導體化合物，例如是碳化矽或是矽化鍺，或是IIIA族原子與VA族原子所形成之半導體化合物，例如是砷化鎵。
接著，於基底100上形成穿隧介電層102。如圖1A所示，穿隧介電層102全面地覆蓋基底100的表面。在一些實施例中，穿隧介電層102可以由單一材料層構成。單一材料層例如是低介電常數材料或是高介電常數材料。低介電常數材料為介電常數低於4的介電材料，例如是氧化矽或氮氧化矽。高介電常數材料為介電常數高於4的介電材料，例如是HfAlO、HfO
2、Al
2O
3或Si
3N
4。在替代實施例中，穿隧介電層102也可以是雙層結構或是多層結構。
然後，於穿隧介電層102上形成多個堆疊結構104，使得穿隧介電層102位於基底100與堆疊結構104之間。具體來說，堆疊結構104由下而上依序包括電荷儲存層106、閘間介電層108以及導體層110。在一些實施例中，電荷儲存層106的材料包括導體材料，其可例如是摻雜多晶矽、未摻雜多晶矽或其組合。在本實施例中，電荷儲存層106可以是浮置閘極。閘間介電層108的材料包括介電材料，其可例如是氧化矽、氮化矽、氮氧化矽或其組合。閘間介電層108可以是單層結構或多層結構。在本實施例中，閘間介電層108可例如是由氧化物/氮化物/氧化物（Oxide/Nitride/Oxide，ONO）所構成的複合層。導體層110的材料包括導體材料，其可例如是摻雜多晶矽、未摻雜多晶矽或其組合。在本實施例中，導體層110可以是控制閘極。
在一些實施例中，堆疊結構104以等距離方式彼此間隔，如圖1A所示。但本發明不以此為限，在其他實施例中，堆疊結構104亦可以非等距離方式彼此間隔。在替代實施例中，堆疊結構104的寬度或底面積可彼此相同或不同。
在形成堆疊結構104之後，形成襯層112，以共形地覆蓋堆疊結構104。在一些實施例中，襯層112的材料包括介電材料，其可例如是氧化矽、氮化矽、氮氧化矽或其組合。接著，形成介電層113以填入堆疊結構104之間的溝渠或空間中。在一些實施例中，介電層113的材料包括介電材料，其可例如是氧化矽、氮化矽、氮氧化矽或其組合。在替代實施例中，襯層112與介電層113包括不同材料。舉例來說，襯層112可以是氧化矽層，而介電層113可以是氮化矽層。另一方面，在形成介電層113之後，可選擇性地進行平坦化製程，以使介電層113的頂面與襯層112的頂面共平面，如圖1A所示。
請參照圖1A與圖1B，依序移除部分介電層113與部分襯層112，以使堆疊結構104的頂部111外露於介電層113a與襯層112a。堆疊結構104的頂部111與底部109的比例可依需求來調整，本發明不以此為限。在一些實施例中，襯層112a的頂面至少高於閘間介電層108的頂面。
請參照圖1B與圖1C，在暴露出堆疊結構104的頂部111之後，完全移除介電層113a。接著，進行沉積製程，依序形成第一金屬層114、第二金屬層116以及頂蓋層118。在此情況下，第一金屬層114、第二金屬層116以及頂蓋層118至少共形地覆蓋堆疊結構104的頂部111的頂面與側壁。在替代實施例中，如圖1C所示，第一金屬層114、第二金屬層116以及頂蓋層118延伸覆蓋襯層112a的表面。在一些實施例中，第一金屬層114包括鈦層、鎳層或其組合，其厚度可介於0.5 nm至3 nm之間。第二金屬層116包括鈷層，其厚度可介於5 nm至8 nm之間。在本實施例中，第一金屬層114與第二金屬層116具有不同金屬，且第一金屬層114的厚度小於第二金屬層116的厚度。頂蓋層118包括金屬氮化物層，例如是氮化鈦（TiN），其厚度可介於5 nm至10 nm之間。
請參照圖1C與圖1D，進行熱處理製程（或稱為矽化製程），以將堆疊結構104的頂部111轉變為金屬矽化物結構121。以下，將堆疊結構104的底部109稱為堆疊結構104，而金屬矽化物結構121位於堆疊結構104上。具體來說，上述的熱處理製程包括以下步驟。進行第一熱處理步驟，使得第一金屬層114、第二金屬層116與堆疊結構104的頂部111進行反應，以形成第一金屬矽化物。在此情況下，上述的第一金屬矽化物可例如是介穩定（metastable）的相結構。在一些實施例中，所述第一熱處理步驟可以是快速熱處理製程（Rapid Thermal Process，RTP），其溫度可介於450°C至500°C之間，而其處理時間可介於30秒至180秒之間。
在形成第一金屬矽化物之後，進行選擇性移除步驟，以移除未反應的第一金屬層114、未反應的第二金屬層116以及頂蓋層118。在一些實施例中，上述的選擇性移除步驟例如是進行RCA清洗製程。RCA清洗製程包括使用水（H
2O）/過氧化氫（H
2O
2）/氨水（NH
4OH）的混合液（亦即，標準清洗液SC1）、使用水（H
2O）/過氧化氫（H
2O
2）/鹽酸（HCl）之混合液（亦即，標準清洗液SC2）或使用上述SC1與SC2的組合。
在移除未反應的第一金屬層114、未反應的第二金屬層116以及頂蓋層118之後，進行第二熱處理步驟，以將第一金屬矽化物轉變成電阻值較低的第二金屬矽化物，亦即圖1D所繪示的金屬矽化物結構121。在此情況下，上述的第二金屬矽化物可例如是穩定的相結構。也就是說，第二金屬矽化物的相結構比第一金屬矽化物的相結構更為穩定。在一些實施例中，所述第二熱處理步驟可以是另一快速熱處理製程，其溫度可介於700°C至900°C之間，而其處理時間可介於10秒至90秒之間。在替代實施例中，第二熱處理步驟的溫度大於第一熱處理步驟的溫度。
另外，雖然第一熱處理步驟是在沉積製程之後進行的，但本發明不以此為限。在其他實施例中，沉積製程與第一熱處理步驟亦可以是同時進行的。也就是說，可在同一腔室中同時進行沉積與加熱。換言之，沉積製程與第一熱處理步驟可以原位（in-situ）的方式來進行。
如圖1D所示，在矽化製程期間，頂部111與第一金屬層114、第二金屬層116進行反應會損耗部分頂部111。因此，反應後的金屬矽化物結構121的體積可能小於反應前的頂部111的體積。上述金屬矽化物的縮小現象（shrinkage phenomenon）使得金屬矽化物結構121的側壁比堆疊結構104的側壁更為內縮。
值得注意的是，本實施例藉由不同金屬材料所構成的第一金屬層114與第二金屬層116來與頂部111進行矽化製程，其可解決金屬矽化物結構121頸縮或變形的問題，以降低字元線阻抗，進而提升記憶體的效能。以下，以第一金屬層114為鈦層，而第二金屬層116為鈷層為例來說明。在一些實施例中，鈦層114中的鈦元素的移動速率小於鈷層116中的鈷元素的移動速率。在此情況下，大部分的鈷元素擴散至頂部111中，而大部分的鈦元素則停留在頂部111的表面。因此，這些鈦元素可維持金屬矽化物結構121的形狀，而不易頸縮並產生彎曲現象。相較於以單一鈷層來進行矽化製程，本實施例將鈦層插入鈷層與矽層之間來進行矽化製程，其所形成的金屬矽化物結構121的輪廓較為筆直且較不彎曲，且亦能改善字元線阻抗的穩定性與耐久度。在另一實施例中，在矽化製程中，鈷原子比鈦原子或鎳原子消耗更多的矽原子。因此，相較於以單一鈷層來進行矽化製程，本實施例將鈦層或鎳層插入鈷層與矽層之間來進行矽化製程，所形成的金屬矽化物結構121不易產生縮小現象，因此，可維持金屬矽化物結構121的形狀而不易變形。
請參照圖1D與圖2，金屬矽化物結構121配置在堆疊結構104上。金屬矽化物結構121包括第一金屬元素131、第二金屬元素132以及矽元素133。在一實施例中，第一金屬元素131包括鈦、鎳或其組合，而第二金屬元素132包括鈷。在另一實施例中，第一金屬元素131與第二金屬元素132不同。如圖2所示，沿著金屬矽化物結構121的頂面121t往基底100的方向（亦即線A-A’）來看，第一金屬元素131的濃度與第二金屬元素132的濃度逐漸減少。第一金屬元素131的濃度小於第二金屬元素132的濃度，且第二金屬元素132的濃度小於矽元素133的濃度。
在其他實施例中，第一金屬元素131具有第一濃度梯度，而第二金屬元素132具有第二濃度梯度。於此，所謂的「濃度梯度」是指濃度差異、濃度曲線的斜率，或者是最大濃度與最小濃度的比。如圖2所示，第一金屬元素131的第一濃度梯度大於第二金屬元素132的第二濃度梯度。也就是說，大部分的第一金屬元素131（例如Ti）位於或集中於金屬矽化物結構121的頂面121t；而大部分的第二金屬元素132（例如Co）則是擴散或均勻分散至金屬矽化物結構121中。
具體來說，金屬矽化物結構121包括第一部分121a與位於第一部分121a上的第二部分121b，如圖1D所示。在一些實施例中，第一部分121a的中間寬度W1可小於或等於第二部分121b的中間寬度W2，但本發明不以此為限。如圖2所示，沿著金屬矽化物結構121的頂面121t往基底100的方向（亦即線A-A’）來看，在一實施例中，第二部分121b中的第一金屬元素131的平均濃度與第一部分121a中的第一金屬元素131的平均濃度的比（R1）為5至7。也就是說，第一金屬元素131於第二部分121b中的平均濃度大約是第一部分121a中的5至7倍。在另一實施例中，第二部分121b中的第二金屬元素132的平均濃度與第一部分121a中的第二金屬元素132的平均濃度的比（R2）為1至2。在替代實施例中，上述的比（R1）大於比（R2）。換言之，第一金屬元素131較為集中在第二部分121b；而第二金屬元素132則是均勻分布在第一部分121a與第二部分121b中。
請參照圖1D與圖1E，在形成金屬矽化物結構121之後，字元線結構10便已完成。在形成字元線結構10之後，可形成介電層120以覆蓋金屬矽化物結構121。在一些實施例中，介電層120的材料包括氧化矽、磷矽玻璃（PSG）、硼磷矽玻璃（BPSG）或其組合。由於金屬矽化物結構121之間的間距較小，因此，介電層120填入金屬矽化物結構121之間的空間時會形成空氣間隙122。如圖1E所示，空氣間隙122位於堆疊結構104之間，且自堆疊結構104的下部延伸至金屬矽化物結構121的上部。在一些實施例中，由於空氣間隙122的介電常數趨近於1，因此空氣間隙122可降低金屬矽化物結構121之間的電容值並降低RC延遲。如圖1E所示，空氣間隙122的頂面122t可等於或高於金屬矽化物結構121的頂面121t。在另一實施例中，空氣間隙122可接觸或不接觸穿隧介電層102的頂面。在替代實施例中，空氣間隙122包括單一個空氣間隙或兩個以上的空氣間隙。
綜上所述，在本實施例中，依序形成第一金屬層與第二金屬層以覆蓋堆疊結構的頂部，並進行熱處理製程，以將堆疊結構的頂部轉變為金屬矽化物結構。由於第一金屬層與第二金屬層具有不同材料，其可保持金屬矽化物結構的形狀，而不易產生頸縮或彎曲。在此情況下，本實施例可降低字元線阻抗，進而提升記憶體的效能。
雖然本發明已以實施例揭露如上，然其並非用以限定本發明，任何所屬技術領域中具有通常知識者，在不脫離本發明的精神和範圍內，當可作些許的更動與潤飾，故本發明的保護範圍當視後附的申請專利範圍所界定者為準。
10:字元線結構
100:基底
102:穿隧介電層
104:堆疊結構
106:電荷儲存層
108:閘間介電層
109:堆疊結構的底部
110:導體層
111:堆疊結構的頂部
112:襯層
113、120:介電層
114:第一金屬層
116:第二金屬層
118:頂蓋層
121:金屬矽化物結構
121a:第一部分
121b:第二部分
121t:金屬矽化物結構的頂面
122:空氣間隙
122t:空氣間隙的頂面
131:第一金屬元素
132:第二金屬元素
133:矽元素
W1、W2:中間寬度
圖1A至圖1E是依照本發明一實施例的一種字元線結構的製造流程的剖面示意圖。
圖2是沿著圖1D的線A-A’的數量強度（濃度）與距離的關係圖。
10:字元線結構
100:基底
102:穿隧介電層
104:堆疊結構
106:電荷儲存層
108:閘間介電層
110:導體層
112a:襯層
120:介電層
121:金屬矽化物結構
121t:金屬矽化物結構的頂面
122:空氣間隙
122t:空氣間隙的頂面
Claims (20)
- 一種字元線結構，包括： 堆疊結構，配置在基底上；以及 金屬矽化物結構，配置在所述堆疊結構上，其中所述金屬矽化物結構包括第一金屬元素、第二金屬元素以及矽元素，所述第一金屬元素與所述第二金屬元素不同，且所述第一金屬元素的濃度與所述第二金屬元素的濃度自所述金屬矽化物結構的頂面往所述基底的方向逐漸減少。
- 如申請專利範圍第1項所述的字元線結構，其中所述第一金屬元素包括鈦、鎳或其組合，而所述第二金屬元素包括鈷。
- 如申請專利範圍第2項所述的字元線結構，其中所述第一金屬元素的所述濃度小於所述第二金屬元素的所述濃度，且所述第二金屬元素的所述濃度小於所述矽元素的濃度。
- 如申請專利範圍第2項所述的字元線結構，其中所述金屬矽化物結構包括第一部分與位於所述第一部分上的第二部分，且所述第二部分中的所述第一金屬元素的平均濃度與所述第一部分中的所述第一金屬元素的平均濃度的比為5至7。
- 如申請專利範圍第4項所述的字元線結構，其中所述第二部分中的所述第二金屬元素的平均濃度與所述第一部分中的所述第二金屬元素的平均濃度的比為1至2。
- 如申請專利範圍第2項所述的字元線結構，其中所述第一金屬元素具有第一濃度梯度，所述第二金屬元素具有第二濃度梯度，且所述第一濃度梯度大於所述第二濃度梯度。
- 如申請專利範圍第1項所述的字元線結構，其中所述堆疊結構包括： 電荷儲存層； 導體層，配置在所述電荷儲存層上；以及 閘間介電層，配置在所述電荷儲存層與所述導體層之間。
- 如申請專利範圍第1項所述的字元線結構，更包括穿隧介電層配置在所述基底與所述堆疊結構之間。
- 一種字元線結構的製造方法，包括： 在基底上形成堆疊結構； 進行沉積製程，依序形成第一金屬層與第二金屬層，以覆蓋所述堆疊結構的頂部，其中所述第一金屬層與所述第二金屬層具有不同金屬；以及 進行熱處理製程，以將所述堆疊結構的所述頂部轉變為金屬矽化物結構。
- 如申請專利範圍第9項所述的字元線結構的製造方法，其中所述第一金屬層包括鈦層、鎳層或其組合，而所述第二金屬層包括鈷層。
- 如申請專利範圍第9項所述的字元線結構的製造方法，其中所述第一金屬層的厚度小於所述第二金屬層的厚度。
- 如申請專利範圍第9項所述的字元線結構的製造方法，其中所述進行所述熱處理製程包括： 進行第一熱處理步驟，使得所述第一金屬層、所述第二金屬層與所述堆疊結構的所述頂部進行反應； 進行選擇性移除步驟，以移除未反應的第一金屬層與未反應的第二金屬層；以及 進行第二熱處理步驟，其中所述第二熱處理步驟的溫度大於所述第一熱處理步驟的溫度。
- 如申請專利範圍第12項所述的字元線結構的製造方法，其中所述沉積製程與所述第一熱處理步驟是同時進行的。
- 如申請專利範圍第12項所述的字元線結構的製造方法，其中所述第一熱處理步驟是在所述沉積製程之後進行的。
- 如申請專利範圍第9項所述的字元線結構的製造方法，更包括在所述第二金屬層上形成頂蓋層，其中所述頂蓋層包括金屬氮化物層。
- 如申請專利範圍第9項所述的字元線結構的製造方法，其中所述金屬矽化物結構包括第一金屬元素、第二金屬元素以及矽元素，所述第一金屬元素與所述第二金屬元素不同，且所述第一金屬元素的濃度與所述第二金屬元素的濃度自所述金屬矽化物結構的頂面往所述基底的方向逐漸減少。
- 如申請專利範圍第16項所述的字元線結構的製造方法，其中所述第一金屬元素的所述濃度小於所述第二金屬元素的所述濃度，且所述第二金屬元素的所述濃度小於所述矽元素的濃度。
- 如申請專利範圍第16項所述的字元線結構的製造方法，其中所述金屬矽化物結構包括第一部分與位於所述第一部分上的第二部分，且所述第二部分中的所述第一金屬元素的平均濃度與所述第一部分中的所述第一金屬元素的平均濃度的比為5至7。
- 如申請專利範圍第18項所述的字元線結構的製造方法，其中所述第二部分中的所述第二金屬元素的平均濃度與所述第一部分中的所述第二金屬元素的平均濃度的比為1至2。
- 如申請專利範圍第16項所述的字元線結構的製造方法，其中所述第一金屬元素具有第一濃度梯度，所述第二金屬元素具有第二濃度梯度，且所述第一濃度梯度大於所述第二濃度梯度。
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2019
- 2019-02-27 TW TW108106913A patent/TWI694571B/zh active
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