JP2006019368A - インターポーザ及びその製造方法並びに半導体装置 - Google Patents

Abstract

【課題】 所要のファンアウト構造を実現可能にすると共に、コストの低減化を図ることができる「インターポーザ」を提供すること。
【解決手段】 搭載する半導体チップ１と実装用基板との間に介在されるインターポーザ１０は、半導体からなるインターポーザ部１１と、その外周に一体的に設けられたインターポーザ部１２とを有している。各インターポーザ部１１，１２の両面には、それぞれ絶縁層１３ａ，１３ｂを介して配線パターン１４ａ，１４ｂ，１５ａ，１５ｂが形成され、各配線パターンは、各インターポーザ部の所要の位置にそれぞれ形成されたスルーホールを介して電気的に接続されている。外側のインターポーザ部１２は、絶縁体（樹脂）又は金属体により構成されている。さらに、インターポーザ１０の一方の面に外部接続端子１６が接合されている。
【選択図】 図１

Description

本発明は、半導体装置用のインターポーザに係り、特に、搭載する半導体チップとマザーボード等のプリント配線板（実装用基板）との間で所要のファンアウト構造を実現するのに適応されたインターポーザ及びその製造方法並びに半導体装置に関する。

かかるインターポーザは、半導体チップを搭載する役割を果たすことから、機能的には配線基板と同じであり、「パッケージ」とも呼ばれている。

典型的なインターポーザは、半導体チップ（代表的にはシリコン（Ｓｉ）チップ）を搭載し、チップを搭載した状態でプリント配線板に実装されて、半導体装置を構成する。インターポーザを構成する材料としては様々なものが使用されているが、その一例として、シリコン（Ｓｉ）を使用したものがある。これは、搭載する半導体チップの構成材料であるＳｉと同じ材料を使用する（つまり、両者の熱膨張係数（ＣＴＥ）をほぼ同じにする）ことで、両者間に熱収縮の差に起因する反りや捻れ等の不都合が生じないようにするためである。

このように構成材料としてＳｉを使用したインターポーザでは、搭載するＳｉチップとのＣＴＥがマッチングしているというメリットがある。この場合、Ｓｉインターポーザの大きさは、ＣＴＥのマッチングの面からはチップサイズとほぼ同じであれば十分である。しかし、チップが搭載される側と反対側の面に設けられる外部接続端子のピッチは当該チップの端子のピッチより大きいため、チップサイズと比べてインターポーザのサイズは大きくなり、特に端子数の多いチップを搭載する場合には、より一層大きくなる。つまり、インターポーザは、搭載するＳｉチップの端子とプリント配線板接続用端子（外部接続端子）とを整合する（つまり、再配線を行う）ためのものであるため、その構造上、外部接続端子のエリアがチップ搭載エリアの周囲に拡張された形態、いわゆる「ファンアウト構造」を呈する。

また、このようなＳｉインターポーザの製造にあたり、従来のプロセスでは、Ｓｉウエハの状態で一連の加工（スルーホールの形成、スルーホール内及びウエハ表面への絶縁層の形成、絶縁層上へのシード層等の形成、めっきによるスルーホール内への導体の充填、両面へのめっき層の形成及び表裏の導通、両面への配線パターンの形成、保護膜の形成など）を行った後、各インターポーザ単位にダイシング（個片化）し、さらに必要に応じて外部接続端子を接合していた。つまり、配線パターンの形成は、Ｓｉウエハの状態で行われていた。

上記の従来技術に関連する技術としては、例えば、特許文献１に記載されるように、半導体装置用インターポーザにおいて、搭載する半導体チップの直下で配線パターン間にキャパシタを設けるようにしたものがある。
特開２００１−３２６３０５号公報

上述したように従来のインターポーザでは、外部接続端子の占有エリアがチップの搭載エリアの周囲に拡張された「ファンアウト構造」となっているため、インターポーザをシリコン（Ｓｉ）のみで製作しようとすると、搭載するＳｉチップとのＣＴＥのマッチングの面からは本来必要でないエリア、すなわち、チップ搭載エリアの周囲に拡張されたエリアにまでＳｉを使用しなければならず、その結果、コストアップを招くといった課題があった。

また、インターポーザの製造にあたり、従来のプロセスでは、最終的に個片化されるまではＳｉウエハの状態で加工を行っていたため、Ｓｉウエハの両面に所要の形状に配線パターンを形成することが技術的に困難であるといった課題もあった。

本発明は、かかる従来技術における課題に鑑み創作されたもので、所要のファンアウト構造を実現可能にすると共に、コストの低減化を図ることができるインターポーザを提供することを目的とする。

さらに本発明は、インターポーザの両面に所要の配線パターンを容易に形成することができるインターポーザの製造方法、及び、当該インターポーザを用いて構成された半導体装置を提供することを目的とする。

上述した従来技術の課題を解決するため、本発明の一形態によれば、搭載する半導体チップと実装用基板との間に介在されるインターポーザであって、半導体からなる第１のインターポーザ部と、該第１のインターポーザ部の面方向においてその外周に該第１のインターポーザ部と一体的に設けられた絶縁体からなる第２のインターポーザ部とを有し、前記第１及び第２のインターポーザ部の表面と裏面にそれぞれ絶縁層を介して形成された配線パターンが、該第１及び第２のインターポーザ部の所要の位置にそれぞれ形成されたスルーホールを介して電気的に接続されていることを特徴とするインターポーザが提供される。

この形態に係るインターポーザの構成によれば、第１のインターポーザ部は、搭載する半導体チップとの間で熱膨張係数（ＣＴＥ）のマッチングを行うのに必要な半導体からなっており、この第１のインターポーザ部の外周のエリア（つまり、搭載する半導体チップとのＣＴＥのマッチングの面からは本来必要でないエリア）に設けられた第２のインターポーザ部は、絶縁体からなっている。従って、従来のように不必要なエリアに半導体（代表的にはＳｉ）を使用する必要がなくなり、半導体の使用量を必要最小限に抑えることができるので、コストの低減化を図ることができる。また、第２のインターポーザ部の存在により、所要のファンアウト構造を実現することができる。

また、上記の形態に係るインターポーザにおいて、前記絶縁体からなる第２のインターポーザ部に代えて、金属からなる第２のインターポーザ部を設けるようにしてもよい。

この場合には、本インターポーザを半導体装置として構成したときに内部で発生する熱を、この金属体（第２のインターポーザ部）を介して外部に放散させることができる。つまり、一種のヒートスプレッダとして機能する。

また、本発明の他の形態によれば、上記の形態に係るインターポーザを製造する方法が提供される。その一形態に係る製造方法は、半導体ウエハの所要の位置に第１のスルーホールを形成する工程と、前記第１のスルーホールの内壁を含めて全面に第１の絶縁層を形成した後、該第１のスルーホールの内部を含めて両面にそれぞれ所要の形状に第１の配線パターンを形成する工程と、該第１の配線パターンが形成された半導体ウエハを第１のインターポーザ部の形状にダイシングする工程と、一方の面に第２の絶縁層が形成された支持体の該第２の絶縁層上に、前記ダイシングされた各第１のインターポーザ部をそれぞれ所定の間隔をおいて配置する工程と、前記各第１のインターポーザ部間の隙間を充填して絶縁体層を形成し、さらに、該絶縁体層及び各第１のインターポーザ部上に第３の絶縁層を形成する工程と、前記支持体を除去した後、前記絶縁体層の所要の位置に、前記第３の絶縁層から前記第２の絶縁層まで貫通して第２のスルーホールを形成すると共に、前記第１の配線パターンの所要の箇所に画定されたパッド部に達するビアホールを形成する工程と、前記第２のスルーホールを介して前記絶縁体層の両面を電気的に接続し、かつ、前記ビアホールを充填して前記第１の配線パターンのパッド部に電気的に接続されるように所要の形状に第２の配線パターンを形成する工程と、前記各第１のインターポーザ部及び前記絶縁体層の両面に、前記第２の配線パターンの所要の箇所に画定されたパッド部が露出するようにそれぞれ保護膜を形成し、さらに、第１のインターポーザ部を含み、かつ、規定の第２のインターポーザ部のエリアが画定されるように、前記絶縁体層の該当する部分を切断して分離する工程とを含むことを特徴とする。

この形態に係るインターポーザの製造方法によれば、上記の形態に係るインターポーザにより得られた効果に加えて、さらに、半導体ウエハから第１のインターポーザ部をダイシング（切断分離）し、支持体上で再レイアウト後、加工を行うようにしているので、従来のようにＳｉウエハの状態で加工を行う場合とは違い、インターポーザの両面に所要の配線パターンを容易に形成することができる。

また、本発明の更に他の形態によれば、上記の形態に係るインターポーザ上に、半導体チップが前記配線パターンに電気的に接続されて搭載されていることを特徴とする半導体装置が提供される。さらに、この半導体装置を、所要個数、相互に電気的に接続して積層するようにしてもよい。

図１は本発明の一実施形態に係るインターポーザの構成を断面図の形態で模式的に示したものである。図示の例では、本発明に関連する部分を明示するためにインターポーザの構成を簡略化して示しており、詳細な構成（構造）についてはプロセスに関連させて後で説明する。

本実施形態に係るインターポーザ１０は、図中破線で示すようにシリコン（Ｓｉ）チップ１を搭載し、後述するようにＳｉチップ１を搭載した状態で実装用基板に実装されて、半導体装置を構成する。インターポーザ１０は、その基本構造として、搭載するＳｉチップ１との間で熱膨張係数（ＣＴＥ）のマッチングを行うのに必要なＳｉからなる部分（以下、「Ｓｉインターポーザ部」という。）１１と、所要のファンアウト構造を実現するためにチップ搭載エリアの周囲（Ｓｉインターポーザ部１１の面方向においてその外周）に拡張された部分（以下、「拡張インターポーザ部」という。）１２とを有している。Ｓｉインターポーザ部１１と拡張インターポーザ部１２は一体的に設けられており、Ｓｉインターポーザ部１１は、平面的に見て、搭載するＳｉチップ１の大きさとほぼ同じ大きさを有している。また、拡張インターポーザ部１２は絶縁体からなり、コスト面（コストを低減できる点）と加工面（加工し易い点）を考慮して、本実施形態ではエポキシ樹脂を使用している。

また、Ｓｉインターポーザ部１１の両面（表面と裏面）には、それぞれ絶縁層１３ａ，１３ｂを介在させて、それぞれ所要の形状に配線パターン（例えば、銅（Ｃｕ）のめっき層）１４ａ，１４ｂが形成されており、各配線パターン１４ａ，１４ｂは、Ｓｉインターポーザ部１１の所要の位置に形成されたスルーホールを介して電気的に接続されている。同様に、拡張インターポーザ部１２の両面（表面と裏面）にも、それぞれ所要の形状に配線パターン１５ａ，１５ｂが形成されており、各配線パターン１５ａ，１５ｂは、拡張インターポーザ部１２の所要の位置に形成されたスルーホールを介して電気的に接続されている。各インターポーザ部１１，１２にそれぞれ形成されたスルーホールは、導体（例えば、Ｃｕ）で充填されており、あるいは、その内壁上に導体が形成されている。また、図１には明示していないが、Ｓｉインターポーザ部１１の配線パターン１４ａ，１４ｂと、拡張インターポーザ部１２の配線パターン１５ａ，１５ｂとは、所要の箇所において相互に接続されている。

各配線パターン１４ａ，１４ｂ，１５ａ，１５ｂは、それぞれ所要の箇所にパッド部を含むように形成されている。本実施形態に係る構成では、Ｓｉチップ１が搭載される側の配線パターン１４ａ，１５ａは、搭載するＳｉチップ１の電極端子２（例えば、はんだバンプ、金（Ａｕ）スタッドバンプ等）の位置に対応する箇所にパッド部が画定されるように形成され、これと反対側の配線パターン１４ｂ，１５ｂは、実装用基板に実装する際に用いられる外部接続端子１６（例えば、はんだバンプ）の接合位置に対応する箇所にパッド部が画定されるように形成されている。図示の例では、インターポーザ部１１（１２）の両面に１層ずつ配線パターン１４ａ，１４ｂ（１５ａ，１５ｂ）が形成された構造を示しているが、必要に応じて、ビルドアップ法等により更なる多層配線化を行ってもよいことはもちろんである。

また、図１には明示していないが、各インターポーザ部１１，１２の両面には、各配線パターン１４ａ，１４ｂ，１５ａ，１５ｂのパッド部を露出させて全面を覆うようにして保護膜（例えば、ソルダレジスト層）が形成されており、さらに、各保護膜から露出している配線パターン（パッド部）上に、ニッケル（Ｎｉ）／金（Ａｕ）のめっき層が被着されている。なお、図示の例では外部接続端子１６を設けているが、これは必ずしも設ける必要はない。要は、必要なときに外部接続端子を接合できるようにパッド部（Ｎｉ／Ａｕめっき層）が保護膜から露出していれば十分である。

本実施形態に係るインターポーザ１０は、基本的には、搭載するＳｉチップ１との間でＣＴＥのマッチングを行うのに必要な大きさのＳｉインターポーザ部１１と、所要のファンアウト構造を実現するために必要な拡張インターポーザ部１２とが一体的に設けられ、さらに、保護膜から露出しているパッド部もしくはパッド部上に接合された外部接続端子を介して、後述するように必要に応じて多層的に積み重ねることができるようにしたことを特徴としている。

本実施形態では、Ｓｉチップ１との間でＣＴＥのマッチングを行うための構成部材としてＳｉからなるインターポーザ部１１を設けているが、Ｓｉチップ１と同等のＣＴＥを有している材料であれば、Ｓｉに限定されないことはもちろんである。例えば、ガラスセラミックス等の低温焼成セラミックスを好適に使用することができる。

図２は、上述した実施形態に係るインターポーザ１０を用いて構成された半導体装置の一構成例を模式的に示したものである。

図示の半導体装置５０は、Ｓｉチップ１を搭載したインターポーザ１０が、マザーボード等のプリント配線板（実装用基板）５１に実装されて構成されている。インターポーザ１０にＳｉチップ１を搭載する際には、例えば、上側のソルダレジスト層（保護膜）から露出している配線パターンのパッド部に、Ｓｉチップ１のパッド上に接合されたはんだバンプ等の電極端子２が電気的に接続されるように当該チップをフリップチップ接続し、さらに当該ソルダレジスト層との間にアンダーフィル樹脂（例えば、エポキシ樹脂）を充填し、熱硬化させて接着する。この場合、フリップチップ接続とアンダーフィル樹脂の充填を同時に行うことも可能である。また、インターポーザ１０をプリント配線板５１に実装する際には、同様にして下側のソルダレジスト層（保護膜）から露出している配線パターンのパッド部に、外部接続端子として供されるはんだボールをリフローにより接合し（はんだバンプ１６）、このはんだバンプ１６を介してプリント配線板５１上の対応するパッド又はランド５２に接続する。

図３は、上述した実施形態に係るインターポーザ１０を用いて構成された半導体装置の他の構成例を模式的に示したものである。図示の半導体装置５０ａは、Ｓｉチップ１を搭載した状態でインターポーザ１０を複数個（図示の例では、２個）、相互に電気的に接続して多層的に積み重ねた構造を有している。この場合、各インターポーザ１０間の電気的な接続は、下側のインターポーザ１０のパッド部（上側）と上側のインターポーザ１０のパッド部（下側）に接合された外部接続端子１６とを介して行われる。なお、図３の例では、図２に示したプリント配線板（実装用基板）５１の図示を省略している。

また、特に図示はしないが、マルチチップモジュールへの対応を考慮して、本実施形態に係るインターポーザ１０を平面状に複数個配列した形態で半導体装置を構成することも可能である。

次に、本実施形態に係るインターポーザ１０を製造する方法について、その製造工程の一例を示す図４〜図６を参照しながら説明する。図４〜図６に示す断面構成では、図示の簡単化のため、Ｓｉインターポーザ部１１（一部分）とこれに隣接する拡張インターポーザ部１２（一部分）のみが示されている。

先ず最初の工程では（図４（ａ）参照）、例えば１２インチサイズのＳｉウエハを用意し、所定の厚さ（５０〜３００μｍ程度）に薄化した後、このＳｉウエハ２０の所要の位置に、反応性イオンエッチング（ＲＩＥ）やスパッタエッチング等のドライエッチング法により、スルーホールＴＨ１を形成する。

次の工程では（図４（ｂ）参照）、スルーホールＴＨ１の内壁を含めて全面に、例えばＣＶＤ法や熱酸化法等により、ＳｉＯ₂ の絶縁層（シリコン酸化膜）２１を形成する。

次の工程では（図４（ｃ）参照）、絶縁層２１の全面に、例えば無電解めっき、スパッタリング、蒸着等により、銅（Ｃｕ）のシード層２２を形成する。

次の工程では（図４（ｄ）参照）、スルーホールＴＨ１に導体を充填し、この導体に接続されるようにして両面に所要の形状に配線パターン２３を形成する。例えば、シード層２２を給電層として電解ＣｕめっきによりスルーホールＴＨ１を充填し、あるいは、Ｃｕ等の金属を含有する導電性ペーストをスクリーン印刷法、インクジェット法等によりスルーホールＴＨ１に充填する。さらに、この充填された導体上に、サブトラクティブ法、セミアディティブ法、インクジェット法等により、所要の形状にＣｕの配線パターン２３を形成する。セミアディティブ法もしくはインクジェット法を用いた場合には、スルーホールＴＨ１への導体（Ｃｕ）の充填と同時に配線パターン２３を形成することができ、工程の簡素化に寄与する。

ここで形成される配線パターン２３は、図１に示した配線パターン１４ａ，１４ｂに相当する。図示の例では、Ｓｉウエハ２０の両面（絶縁層２１上）にそれぞれ１層ずつ、計２層の配線パターン２３を形成しているが、形成する配線パターンの層数は２層に限定されないことはもちろんであり、必要に応じて、ビルドアップ法等により適宜配線の多層化を行ってもよい。

次の工程では（図５（ａ）参照）、両面にそれぞれ配線パターン２３が形成されたＳｉウエハ２０を、例えばダイサー等により、平面的に見たＳｉインターポーザ部１１の形状（本実施形態では、搭載するＳｉチップ１の形状）に切断して、各インターポーザ単位に個片化する。

次の工程では（図５（ｂ）参照）、一方の面にエポキシ樹脂やポリイミド樹脂等からなる絶縁膜２５が形成された支持体２４を用意し、この支持体２４の絶縁膜２５上に、前の工程で個片化された各Ｓｉインターポーザ部１１（インターポーザ１０の一部分）をそれぞれ所定の間隔をおいて配置する。支持体２４は、金属体で構成されていてもよいし、あるいはテープ材のような形態でもよい。後者の場合、そのテープ材の絶縁膜２５が形成される側の面に離型剤が塗布されていることが望ましい。これは、後の段階で支持体２４を剥離除去する際の便宜上の理由からである。

次の工程では（図５（ｃ）参照）、各Ｓｉインターポーザ部１１間の隙間に樹脂を充填して樹脂層２６を形成し、さらに各Ｓｉインターポーザ部１１及び樹脂層２６上に、ＣＶＤ法、ラミネート法等により絶縁膜２７を形成する。樹脂層２６は、例えば、粘度の低い熱硬化性のエポキシ樹脂を各Ｓｉインターポーザ部１１間の隙間に溶かし込み、そのまま上から熱プレスすることによって形成され得る。

ここで形成される樹脂層２６は、その一部が図１に示した拡張インターポーザ部１２を構成し、また、各Ｓｉインターポーザ部１１及び樹脂層２６を挟んでその両面に形成される絶縁膜２７及び２５は、それぞれ図１に示した絶縁層１３ａ及び１３ｂに相当する。

次の工程では（図５（ｄ）参照）、支持体２４（図５（ｃ）参照）を、ウエットエッチング（金属の場合）や剥離（テープ材の場合）等により、除去する。

次の工程では（図６（ａ）参照）、樹脂層２６（絶縁膜２５，２７を含む）の所要の位置に、例えばＵＶ−ＹＡＧレーザ、ＣＯ₂ レーザ、エキシマレーザ等により、スルーホールＴＨ２を形成する。さらに、Ｓｉインターポーザ部１１の配線パターン２３の所要の箇所（パッド部）に、例えばレーザにより、当該パッド部に達するようにビアホールＶＨを形成する。

次の工程では（図６（ｂ）参照）、スルーホールＴＨ２内を含めて絶縁膜２５，２７の全面に、無電解めっき、スパッタリング等によりシード層（Ｃｕ）を形成し、このシード層を給電層として電解ＣｕめっきによりスルーホールＴＨ２を充填（あるいは、Ｃｕ等の金属を含有する導電性ペーストをスクリーン印刷法、インクジェット法等によりスルーホールＴＨ２に充填）した後、サブトラクティブ法、セミアディティブ法、インクジェット法等により、スルーホールＴＨ２に充填された導体とビアホールＶＨから露出している配線パターン２３のパッド部とを接続するように、所要の形状にＣｕの配線パターン２８を形成する。

ここで形成される配線パターン２８は、図１に示した配線パターン１５ａ，１５ｂに相当する。

最後の工程では（図６（ｃ）参照）、両面の配線パターン２８の所要の箇所にそれぞれ画定されたパッド部が露出するように全面を覆ってソルダレジスト層２９を形成し、さらに、各ソルダレジスト層２９から露出している各々のパッド部（Ｃｕ）に、それぞれＮｉ／Ａｕめっきを施す（Ｎｉ／Ａｕめっき層３０の形成）。これは、後の段階ではんだ接合を行ったときに当該パッド部との接着性を向上させるためである。さらに、Ｓｉインターポーザ部１１を含み、かつ、規定の拡張インターポーザ部１２（図１参照）のエリアが画定されるように、樹脂層２６（絶縁膜２５，２７を含む）の該当する部分を切断して分離する。

以上の工程により、本実施形態に係るインターポーザ１０が作製されたことになる。なお、最後の工程においてＮｉ／Ａｕめっき層３０を形成した後、必要に応じて、ソルダレジスト層２９から露出しているパッド部（Ｎｉ／Ａｕめっき層３０）に、外部接続端子１６（図１参照）として用いるはんだバンプを形成してもよい。

以上説明したように、本実施形態に係るインターポーザ１０（図１）及びその製造方法によれば、Ｓｉインターポーザ部１１は、搭載するＳｉチップ１の大きさとほぼ同じ大きさを有しているので、Ｓｉチップ１との間で熱膨張係数（ＣＴＥ）のマッチングを行うことができ、一方、このＳｉインターポーザ部１１の外周のエリア（つまり、搭載するＳｉチップ１とのＣＴＥのマッチングの面からは本来必要でないエリア）に設けられた拡張インターポーザ部１２は、絶縁体（エポキシ樹脂）からなっている。従って、従来のように不必要なエリアにＳｉを使用する必要がなくなり、Ｓｉの使用量を必要最小限に抑えることができるので、コストの低減化を図ることができる。また、拡張インターポーザ部１２の存在により、所要のファンアウト構造を実現することができる。

また、これに関連して、Ｓｉチップ１とＳｉインターポーザ部１１の間でＣＴＥのマッチングによる応力緩和を行えることにより、拡張インターポーザ部１２を構成する材料の選択の自由度を高めることができる。

また、本実施形態に係る製造方法（図４〜図６）によれば、Ｓｉウエハ２０からＳｉインターポーザ部１１を切断分離し、支持体２４上で再レイアウト後、加工を行うようにしているので、従来のようにＳｉウエハの状態で加工を行う場合とは違い、インターポーザ１０の両面に所要の配線パターンを容易に形成することができる。

また、必要に応じて、ソルダレジスト層（保護膜）２９から露出している配線パターンのパッド部に外部接続端子１６を接合することができるので、図３に例示したように複数個のインターポーザ１０（Ｓｉチップ１を搭載した状態）を多層的に積み重ねることが可能となる。

また、図４（ａ）の工程においてスルーホールＴＨ１の形成に先立ちＳｉウエハを薄化した際に、反りや捻れ等のストレスが仮に発生していたとしても、その後の段階で行うダイシングにより（図５（ａ））当該ストレスを除去できるため、薄いＳｉでの加工が容易となり、インターポーザ１０の薄型化に寄与することができる。

さらに、スルーホールの形成を樹脂エリア（拡張インターポーザ部１２のエリア）のみに留めた場合には、そのスルーホールの加工及び導通処理に基板プロセスを使用できるため、工程を簡略化することができ、コストの低減化と共に手番の短縮が可能となる。

上述した実施形態（図１）では、Ｓｉインターポーザ部１１の外周に設けられる拡張インターポーザ部１２を絶縁体（エポキシ樹脂）で構成した場合を例にとって説明したが、拡張インターポーザ部１２を構成する材料がこれに限定されないことはもちろんであり、例えば、絶縁体に代えて金属体で構成することも可能である。

以下、拡張インターポーザ部を金属体で構成した場合の実施形態を説明する。なお、この実施形態に係るインターポーザの構成については、その外形上、図１に示したインターポーザ１０の構成と同じであるので、ここではその説明は省略する。

この形態に係るインターポーザ（拡張インターポーザ部が金属体からなる場合）の構成によれば、上述した実施形態で得られた利点に加えて、さらに、拡張インターポーザ部を金属体で構成しているので、半導体装置として構成したときに内部で発生する熱を外部に放散させることができるという利点が得られる。

以下、金属体からなる拡張インターポーザ部を備えたインターポーザを製造する方法について、その製造工程の一例を示す図７〜図９を参照しながら説明する。

先ず、上述した実施形態に係る製造工程のうち、図４（ａ）〜図５（ａ）の工程を経た後、次の工程では（図７（ａ）参照）、所定の厚さ（５０〜３００μｍ程度）を有するアルミニウム（Ａｌ）や銅（Ｃｕ）等の金属板４０に対し、ウエットエッチング、機械的ドリルによる穴明け加工、ＵＶ−ＹＡＧレーザ、ＣＯ₂ レーザ、エキシマレーザ等によるレーザー加工等により、所要の位置にスルーホールＴＨ３を形成する。この際、Ｓｉインターポーザ部１１を収容するための開口部を同時に形成するようにしてもよい。

次の工程では（図７（ｂ）参照）、スルーホールＴＨ３の内壁を含めて全面に、例えば電着法により、エポキシ樹脂、ポリイミド樹脂等からなる絶縁層４１を形成する。

次の工程では（図７（ｃ）参照）、絶縁層４１の全面に、例えば無電解めっき、スパッタリング、蒸着等により、銅（Ｃｕ）のシード層４２を形成する。

次の工程では（図７（ｄ）参照）、スルーホールＴＨ３に導体を充填し、この導体に接続されるようにして両面に所要の形状に配線パターン４３を形成する。例えば、シード層４２を給電層として電解ＣｕめっきによりスルーホールＴＨ３を充填し、あるいは、Ｃｕ等の金属を含有する導電性ペーストをスクリーン印刷法、インクジェット法等によりスルーホールＴＨ３に充填する。さらに、この充填された導体上に、サブトラクティブ法、セミアディティブ法、インクジェット法等により、所要の形状にＣｕの配線パターン４３を形成する。セミアディティブ法もしくはインクジェット法を用いた場合には、スルーホールＴＨ３への導体（Ｃｕ）の充填と同時に配線パターン４３を形成することができる（工程の簡素化）。

ここで形成される配線パターン４３は、図１に示した配線パターン１５ａ，１５ｂに相当する。図示の例では、金属板４０の両面（絶縁層４１上）にそれぞれ１層ずつ、計２層の配線パターン４３を形成しているが、形成する配線パターンの層数は２層に限定されないことはもちろんであり、必要に応じて、ビルドアップ法等により適宜配線の多層化を行ってもよい。

次の工程では（図８（ａ）参照）、両面にそれぞれ配線パターン４３が形成された金属板４０を、例えばダイサー等により、所要の拡張インターポーザ部１２ａ（インターポーザの一部分）の形状、すなわち、図示のようにＳｉインターポーザ部１１を収容する開口部が形成された「枠状」の形状に切断して、各インターポーザ単位に個片化する。なお、Ｓｉインターポーザ部１１を収容するための開口部については、この工程ではダイサー等による切断により形成しているが、例えば、ダイサー等による切断の前、あるいは後に、プレス等による打ち抜き加工で形成するようにしてもよい。

次の工程では（図８（ｂ）参照）、一方の面にエポキシ樹脂やポリイミド樹脂等からなる絶縁膜４５が形成された支持体４４を用意し、この支持体４４の絶縁膜４５上に、既に個片化されている各Ｓｉインターポーザ部１１と、前の工程で個片化された各拡張インターポーザ部１２ａとを配置する。この際、Ｓｉインターポーザ部１１が、拡張インターポーザ部１２ａに形成した開口部内に収容されるような形態で配置する。支持体４４は、金属体で構成されていてもよいし、あるいは、テープ材のような形態（絶縁膜４５が形成される側の面に離型剤が塗布されているもの）でもよい。

次の工程では（図８（ｃ）参照）、Ｓｉインターポーザ部１１と拡張インターポーザ部１２ａの間、隣接する拡張インターポーザ部１２ａの間を含めて全面に、ＣＶＤ法、ラミネート法等により絶縁膜４６を形成する。あるいは、熱硬化性の樹脂を塗布し、これを硬化させて絶縁膜４６を形成するようにしてもよい。

ここで形成される絶縁膜４６、及び前の工程で形成された絶縁膜４５は、それぞれ図１に示した絶縁層１３ａ及び１３ｂに相当する。

次の工程では（図８（ｄ）参照）、支持体４４（図８（ｃ）参照）を、ウエットエッチング（金属の場合）や剥離（テープ材の場合）等により、除去する。

次の工程では（図９（ａ）参照）、Ｓｉインターポーザ部１１及び拡張インターポーザ部１２ａの各配線パターン２３，４３の所要の箇所（パッド部）に、例えばＵＶ−ＹＡＧレーザ、ＣＯ₂ レーザ、エキシマレーザ等により、それぞれ当該パッド部に達するようにビアホールＶＨ１，ＶＨ２を形成する。

次の工程では（図９（ｂ）参照）、サブトラクティブ法、セミアディティブ法、導電性ペーストを用いたスクリーン印刷法等により、Ｓｉインターポーザ部１１に形成されたビアホールＶＨ１から露出している配線パターン２３のパッド部と、拡張インターポーザ部１２ａに形成されたビアホールＶＨ２から露出している配線パターン４３のパッド部とを接続するように、所要の形状にＣｕの配線パターン４７を形成する。

ここで形成される配線パターン４７は、図１に示した配線パターン１５ａ，１５ｂに相当する。

最後の工程では（図９（ｃ）参照）、両面の配線パターン４７の所要の箇所にそれぞれ画定されたパッド部が露出するように全面を覆ってソルダレジスト層２９を形成し、さらに、各ソルダレジスト層２９から露出している各々のパッド部（Ｃｕ）に、それぞれＮｉ／Ａｕめっきを施す（Ｎｉ／Ａｕめっき層３０の形成）。さらに、Ｓｉインターポーザ部１１とその外周に配置された拡張インターポーザ部１２ａを含むように、当該拡張インターポーザ部１２ａの外周の絶縁膜部分を切断して分離する。

以上の工程により、本実施形態に係るインターポーザ１０ａが作製されたことになる。上述した実施形態の場合と同様に、最後の工程においてＮｉ／Ａｕめっき層３０を形成した後、必要に応じて、ソルダレジスト層２９から露出しているパッド部（Ｎｉ／Ａｕめっき層３０）に、はんだバンプ（図１の外部接続端子１６）を形成してもよい。

次に、拡張インターポーザ部を金属体で構成した場合の他の実施形態に係るインターポーザの製造方法について、図１０及び図１１を参照しながら説明する。

先ず、図４（ａ）〜図５（ａ）の工程を経た後、次の工程では（図１０（ａ）参照）、所定の厚さ（５０〜３００μｍ程度）を有するアルミニウム（Ａｌ）や銅（Ｃｕ）等の金属板４０の所要の位置に、ウエットエッチング、機械的ドリルによる穴明け加工、ＣＯ₂ レーザ、エキシマレーザ等によるレーザー加工等により、スルーホールＴＨ４を形成し、さらに、ダイサー等により、所要の拡張インターポーザ部１２ｂの形状、すなわち、図示のようにＳｉインターポーザ部１１を収容する開口部が形成された「枠状」の形状に切断して、各インターポーザ単位に個片化する。

次の工程では（図１０（ｂ）参照）、図８（ｂ）の工程で行った処理と同様にして、一方の面にエポキシ樹脂やポリイミド樹脂等からなる絶縁膜４５が形成された支持体４４を用意し、この支持体４４の絶縁膜４５上に、既に個片化されている各Ｓｉインターポーザ部１１と、前の工程で個片化された各拡張インターポーザ部１２ｂとを配置する。このとき、Ｓｉインターポーザ部１１が、拡張インターポーザ部１２ｂに形成した開口部内に収容されるような形態で配置する。支持体４４は、金属体、あるいは、テープ材のような形態（絶縁膜４５が形成される側の面に離型剤が塗布されているもの）でもよい。

次の工程では（図１０（ｃ）参照）、Ｓｉインターポーザ部１１と拡張インターポーザ部１２ｂの間、隣接する拡張インターポーザ部１２ｂの間を含めて全面に、ＣＶＤ法、ラミネート法等により絶縁膜４６を形成する。このとき、金属板４０に形成したスルーホールＴＨ４の内部にも絶縁膜が形成（充填）される。なお、熱硬化性の樹脂を塗布し、これを硬化させて絶縁膜４６を形成するようにしてもよい。ここで形成される絶縁膜４６、及び前の工程で形成された絶縁膜４５は、それぞれ図１に示した絶縁層１３ａ及び１３ｂに相当する。

次の工程では（図１０（ｄ）参照）、支持体４４（図１０（ｃ）参照）を、ウエットエッチング（金属の場合）や剥離（テープ材の場合）等により、除去する。

次の工程では（図１１（ａ）参照）、拡張インターポーザ部１２ｂの所定の位置（絶縁膜で充填されたスルーホールＴＨ４の位置）に、例えばＵＶ−ＹＡＧレーザ、ＣＯ₂ レーザ、エキシマレーザ等により、スルーホールＴＨ５を形成し、さらに、Ｓｉインターポーザ部１１の配線パターン２３の所要の箇所（パッド部）に、例えばレーザにより、当該パッド部に達するようにビアホールＶＨ３を形成する。

次の工程では（図１１（ｂ）参照）、スルーホールＴＨ５内を含めて全面に、無電解めっき、スパッタリング等によりシード層（Ｃｕ）を形成し、このシード層を給電層として電解ＣｕめっきによりスルーホールＴＨ５を充填し、あるいは、Ｃｕ等の金属を含有する導電性ペーストをスクリーン印刷法、インクジェット法等によりスルーホールＴＨ５に充填する（導体４８）。

次の工程では（図１１（ｃ）参照）、サブトラクティブ法、セミアディティブ法、インクジェット法等により、スルーホールＴＨ５に充填された導体４８とビアホールＶＨ３から露出している配線パターン２３のパッド部とを接続するように、所要の形状にＣｕの配線パターン４７を形成する。

ここで形成される配線パターン４７は、図１に示した配線パターン１５ａ，１５ｂに相当する。

最後の工程では（図１１（ｄ）参照）、両面の配線パターン４７の所要の箇所にそれぞれ画定されたパッド部が露出するように全面を覆ってソルダレジスト層２９を形成し、さらに、各ソルダレジスト層２９から露出している各々のパッド部（Ｃｕ）に、Ｎｉ／Ａｕめっきを施す（Ｎｉ／Ａｕめっき層３０の形成）。さらに、Ｓｉインターポーザ部１１とその外周に配置された拡張インターポーザ部１２ｂを含むように、当該拡張インターポーザ部１２ｂの外周の絶縁膜部分を切断して分離する。

以上の工程により、本実施形態に係るインターポーザ１０ｂが作製されたことになる。同様にして、最後の工程においてＮｉ／Ａｕめっき層３０を形成した後、必要に応じて、ソルダレジスト層２９から露出しているパッド部（Ｎｉ／Ａｕめっき層３０）に、はんだバンプ（図１の外部接続端子１６）を形成してもよい。

本発明の一実施形態に係るインターポーザ（拡張インターポーザ部が絶縁体からなる場合）の構成を模式的に示す断面図である。 図１のインターポーザを用いて構成された半導体装置の一構成例を模式的に示す断面図である。 図１のインターポーザを用いて構成された半導体装置の他の構成例を模式的に示す断面図である。 図１のインターポーザの製造工程の一例を示す断面図（一部は平面図）である。 図４の製造工程に続く製造工程を示す断面図（一部は平面図）である。 図５の製造工程に続く製造工程を示す断面図である。 本発明の他の実施形態に係るインターポーザ（拡張インターポーザ部が金属体からなる場合）の製造工程の一例を示す断面図（一部は平面図）である。 図７の製造工程に続く製造工程を示す断面図（一部は平面図）である。 図８の製造工程に続く製造工程を示す断面図である。 本発明の他の実施形態に係るインターポーザ（拡張インターポーザ部が金属体からなる場合）の製造工程の他の例を示す断面図（一部は平面図）である。 図１０の製造工程に続く製造工程を示す断面図である。

符号の説明

１…シリコン（Ｓｉ）チップ（半導体チップ）、
２…（チップの）電極端子、
１０，１０ａ，１０ｂ…インターポーザ、
１１…Ｓｉインターポーザ部（第１のインターポーザ部）、
１２，１２ａ，１２ｂ…拡張インターポーザ部（第２のインターポーザ部）、
１３ａ，１３ｂ…絶縁層、
１４ａ，１４ｂ，１５ａ，１５ｂ…配線パターン、
１６…はんだバンプ（外部接続端子）、
２０…シリコン（Ｓｉ）ウエハ、
２３，２８…配線パターン、
２４…支持体、
２５，２７…絶縁膜、
２６…樹脂層（絶縁体層）、
２９…ソルダレジスト層（保護膜）、
３０…Ｎｉ／Ａｕめっき層、
４０…金属板、
４３，４７…配線パターン、
４４…支持体、
４５，４６…絶縁膜、
４８…導体、
５０，５０ａ…半導体装置、
５１…プリント配線板（実装用基板）、
ＴＨ１，ＴＨ２，ＴＨ３，ＴＨ４，ＴＨ５…スルーホール、
ＶＨ，ＶＨ１，ＶＨ２，ＶＨ３…ビアホール。

Claims (13)

1. 搭載する半導体チップと実装用基板との間に介在されるインターポーザであって、
   半導体からなる第１のインターポーザ部と、該第１のインターポーザ部の面方向においてその外周に該第１のインターポーザ部と一体的に設けられた絶縁体からなる第２のインターポーザ部とを有し、
   前記第１及び第２のインターポーザ部の表面と裏面にそれぞれ絶縁層を介して形成された配線パターンが、該第１及び第２のインターポーザ部の所要の位置にそれぞれ形成されたスルーホールを介して電気的に接続されていることを特徴とするインターポーザ。
2. 前記第１及び第２のインターポーザ部の表面と裏面が、それぞれ前記配線パターンの所要の箇所に画定された複数のパッド部を露出させて、それぞれ保護膜により被覆されていることを特徴とする請求項１に記載のインターポーザ。
3. 前記保護膜から露出している前記複数のパッド部のうち、所要の数のパッド部に外部接続端子が接合されていることを特徴とする請求項２に記載のインターポーザ。
4. 前記第１のインターポーザ部が、搭載する半導体チップと同等の熱膨張係数を有する半導体からなることを特徴とする請求項１に記載のインターポーザ。
5. 前記半導体からなる第１のインターポーザ部に代えて、搭載する半導体チップと同等の熱膨張係数を有する低温焼成セラミックスからなる第１のインターポーザ部が設けられていることを特徴とする請求項１に記載のインターポーザ。
6. 前記第２のインターポーザ部が、樹脂により形成されていることを特徴とする請求項１に記載のインターポーザ。
7. 前記絶縁体からなる第２のインターポーザ部に代えて、金属からなる第２のインターポーザ部が設けられていることを特徴とする請求項１に記載のインターポーザ。
8. 前記第１のインターポーザ部は、平面的に見て、搭載する半導体チップの大きさとほぼ同じ大きさを有していることを特徴とする請求項１に記載のインターポーザ。
9. 半導体ウエハの所要の位置に第１のスルーホールを形成する工程と、
   前記第１のスルーホールの内壁を含めて全面に第１の絶縁層を形成した後、該第１のスルーホールの内部を含めて両面にそれぞれ所要の形状に第１の配線パターンを形成する工程と、
   該第１の配線パターンが形成された半導体ウエハを第１のインターポーザ部の形状にダイシングする工程と、
   一方の面に第２の絶縁層が形成された支持体の該第２の絶縁層上に、前記ダイシングされた各第１のインターポーザ部をそれぞれ所定の間隔をおいて配置する工程と、
   前記各第１のインターポーザ部間の隙間を充填して絶縁体層を形成し、さらに、該絶縁体層及び各第１のインターポーザ部上に第３の絶縁層を形成する工程と、
   前記支持体を除去した後、前記絶縁体層の所要の位置に、前記第３の絶縁層から前記第２の絶縁層まで貫通して第２のスルーホールを形成すると共に、前記第１の配線パターンの所要の箇所に画定されたパッド部に達するビアホールを形成する工程と、
   前記第２のスルーホールを介して前記絶縁体層の両面を電気的に接続し、かつ、前記ビアホールを充填して前記第１の配線パターンのパッド部に電気的に接続されるように所要の形状に第２の配線パターンを形成する工程と、
   前記各第１のインターポーザ部及び前記絶縁体層の両面に、前記第２の配線パターンの所要の箇所に画定されたパッド部が露出するようにそれぞれ保護膜を形成し、さらに、第１のインターポーザ部を含み、かつ、規定の第２のインターポーザ部のエリアが画定されるように、前記絶縁体層の該当する部分を切断して分離する工程とを含むことを特徴とするインターポーザの製造方法。
10. 半導体ウエハの所要の位置に第１のスルーホールを形成する工程と、
    前記第１のスルーホールの内壁を含めて全面に第１の絶縁層を形成した後、該第１のスルーホールの内部を含めて両面にそれぞれ所要の形状に第１の配線パターンを形成する工程と、
    該第１の配線パターンが形成された半導体ウエハを第１のインターポーザ部の形状にダイシングする工程と、
    金属板の所要の位置に第２のスルーホールを形成する工程と、
    前記第２のスルーホールの内壁を含めて全面に第２の絶縁層を形成した後、該第２のスルーホールの内部を含めて両面にそれぞれ所要の形状に第２の配線パターンを形成する工程と、
    該第２の配線パターンが形成された金属板を第２のインターポーザ部の形状にダイシングする工程と、
    一方の面に第３の絶縁層が形成された支持体の該第３の絶縁層上に、前記ダイシングされた第１のインターポーザ部が前記第２のインターポーザ部の内側に収容されるような形態で配置する工程と、
    前記第１及び第２のインターポーザ部の間、隣接する第２のインターポーザ部の間を含めて各インターポーザ部上に第４の絶縁層を形成する工程と、
    前記支持体を除去した後、前記第１及び第２の配線パターンのそれぞれ所要の箇所に画定されたパッド部にそれぞれ達する第１及び第２のビアホールを形成する工程と、
    該第１及び第２のビアホールからそれぞれ露出している各パッド部を電気的に接続するように所要の形状に第３の配線パターンを形成する工程と、
    該第３の配線パターンの所要の箇所に画定されたパッド部が露出するように全面を覆って保護膜を形成し、さらに、前記第１のインターポーザ部とその外周に配置された前記第２のインターポーザ部を含むように、当該第２のインターポーザ部の外周の絶縁体部分を切断して分離する工程とを含むことを特徴とするインターポーザの製造方法。
11. 半導体ウエハの所要の位置に第１のスルーホールを形成する工程と、
    前記第１のスルーホールの内壁を含めて全面に第１の絶縁層を形成した後、該第１のスルーホールの内部を含めて両面にそれぞれ所要の形状に第１の配線パターンを形成する工程と、
    該第１の配線パターンが形成された半導体ウエハを第１のインターポーザ部の形状にダイシングする工程と、
    金属板の所要の位置に第２のスルーホールを形成し、さらに、該金属板を第２のインターポーザ部の形状にダイシングする工程と、
    一方の面に第２の絶縁層が形成された支持体の該第２の絶縁層上に、前記ダイシングされた第１のインターポーザ部が前記第２のインターポーザ部の内側に収容されるような形態で配置する工程と、
    前記第１及び第２のインターポーザ部の間、隣接する第２のインターポーザ部の間を含めて各インターポーザ部上に第３の絶縁層を形成する工程と、
    前記支持体を除去した後、前記第２のインターポーザ部の所要の位置に、前記第３の絶縁層から第２の絶縁層まで貫通して第３のスルーホールを形成すると共に、前記第１の配線パターンの所要の箇所に画定されたパッド部に達するビアホールを形成する工程と、
    前記第３のスルーホールを導体で充填し、さらに、該導体と前記ビアホールから露出しているパッド部を電気的に接続するように所要の形状に第２の配線パターンを形成する工程と、
    該第２の配線パターンの所要の箇所に画定されたパッド部が露出するように全面を覆って保護膜を形成し、さらに、前記第１のインターポーザ部とその外周に配置された前記第２のインターポーザ部を含むように、当該第２のインターポーザ部の外周の絶縁体部分を切断して分離する工程とを含むことを特徴とするインターポーザの製造方法。
12. 請求項１から８のいずれか一項に記載のインターポーザ上に、半導体チップが前記配線パターンに電気的に接続されて搭載されていることを特徴とする半導体装置。
13. 請求項１２に記載の半導体装置が、所要個数、相互に電気的に接続されて積層されていることを特徴とする半導体装置。

Images