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CN106057108A - 显示装置 - Google Patents

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CN106057108A
CN106057108A CN201610554145.5A CN201610554145A CN106057108A CN 106057108 A CN106057108 A CN 106057108A CN 201610554145 A CN201610554145 A CN 201610554145A CN 106057108 A CN106057108 A CN 106057108A
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CN
China
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voltage
display device
transistor switch
driving
terminal
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CN201610554145.5A
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English (en)
Inventor
李忠隆
柳福源
李仁傑
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AUO Corp
Original Assignee
AU Optronics Corp
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Publication date
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    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
    • G09G3/006—Electronic inspection or testing of displays and display drivers, e.g. of LED or LCD displays

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  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • General Physics & Mathematics (AREA)
  • Theoretical Computer Science (AREA)
  • Control Of Indicators Other Than Cathode Ray Tubes (AREA)

Abstract

本发明公开了一种显示装置，具有驱动电路、多条驱动线、多个晶体管开关与读取线。每条驱动线具有第一端与第二端，且每条驱动线的第一端连接于驱动电路。每个晶体管开关具有第一端、第二端与控制端。每个晶体管开关的第一端电性连接于第一电压端，而每个晶体管开关的控制端电性连接于对应的一条驱动线的第二端。读取线电性连接于每个晶体管开关的第二端。

Description

显示装置
技术领域
本发明关于一种显示装置，特别关于一种具有导线断线检测能力的显示装置。
背景技术
显示装置是由源极驱动电路与栅极驱动电路透过源极驱动线(数据线)与栅极驱动线(扫描线)来更新每个像素的亮度，藉以更新画面。然而栅极驱动线与源极驱动线由于制程的关系，往往容易发生断线的问题。并且在制作、运送与使用等任何时间都可能在栅极驱动线或源极驱动线产生有断线的问题。因此，如何在显示装置出厂后仍然能简单、快速地检测其中是否有断线问题是一个待解决的问题。
发明内容
鉴于以上问题，本发明提出一种显示装置，得以在显示装置出厂后仍能简单地检测其中的各驱动线是否有断线。
依据本发明一实施例的显示装置，具有驱动电路、多条驱动线、多个晶体管开关与读取线。每条驱动线具有第一端与第二端，且每条驱动线的第一端连接于驱动电路。每个晶体管开关具有第一端、第二端与控制端。每个晶体管开关的第一端电性连接于第一电压端，而每个晶体管开关的控制端电性连接于对应的一条驱动线的第二端。读取线电性连接于每个晶体管开关的第二端。
综上所述，本发明藉由加入受控于栅极驱动线或源极驱动线的晶体管开关，并藉由对应的电压端所提供的信号，栅极驱动电路或源极驱动电路得以判断是否有任何驱动线有断线的问题。
以上的关于本公开内容的说明及以下的实施方式的说明用以示范与解释本发明的精神与原理，并且提供本发明的专利申请范围更进一步的解释。
附图说明
图1为依据本发明一实施例的显示装置电路架构示意图。
图2A为依据本发明一实施例的正常的显示装置的信号时序图。
图2B为依据本发明一实施例的异常的显示装置的信号时序图。
图3为依据本发明另一实施例的显示装置电路架构示意图。
图4A为依据本发明一实施例的正常的显示装置的信号时序图。
图4B为依据本发明一实施例的异常的显示装置的信号时序图。
图4C为依据本发明一实施例的正常的显示装置的信号时序图。
图4D为依据本发明一实施例的异常的显示装置的信号时序图。
图5为依据本发明另一实施例的显示装置电路架构示意图。
图6A为依据本发明一实施例的正常的显示装置的信号时序图。
图6B为依据本发明一实施例的异常的显示装置的信号时序图。
图7为依据本发明另一实施例的显示装置电路架构示意图。
图8为依据本发明再一实施例的显示装置电路架构示意图。
其中，附图标记：
1000 显示装置
1100 栅极驱动电路
1110 电压重置电路
1200 源极驱动电路
S1～SN 栅极驱动线
D1～DM 源极驱动线
TS1～TSN 晶体管开关
TD1～TDM 晶体管开关
READ 读取线
V1、V11～V1M 第一电压端
PF 画面时间区间
P1～PN、PB 时间区间
VREAD、VS1～VSN、VD1、VD2 信号
具体实施方式
以下在实施方式中详细叙述本发明的详细特征以及优点，其内容足以使任何本领域的技术人员了解本发明的技术内容并据以实施，且根据本说明书所公开的内容、权利要求保护范围及附图，任何本领域的技术人员可轻易地理解本发明相关的目的及优点。以下的实施例进一步详细说明本发明的观点，但非以任何观点限制本发明的范畴。
本发明所公开的显示装置中所使用的薄膜晶体管电路架构乃所属技术领域的技术人员得以依据本发明下列实施例自由设计。以下本发明均以N型薄膜晶体管(N-typethin-film transistor,N-type TFT)为例。请参照图1，其为依据本发明一实施例的显示装置电路架构示意图。如图1所示，依据本发明一实施例的显示装置1000具有栅极驱动电路1100、源极驱动电路1200、多条栅极驱动线(扫描线)S1～SN、多条源极驱动线(数据线)D1～DM、多个晶体管开关TS1～TSN与读取线READ。每条栅极驱动线具有第一端与第二端，以图1为例，栅极驱动线的第一端为左端(以图1而言，X轴座标较小的一端)，而栅极驱动线的第二端为右端(以图1而言，X轴座标较大的一端)。每条栅极驱动线的第一端连接于栅极驱动电路1100。每个晶体管开关具有第一端、第二端与控制端。每个晶体管开关的第一端电性连接于第一电压端V1，而每个晶体管开关的控制端电性连接于对应的一条栅极驱动线的第二端。读取线READ电性连接于每个晶体管开关的第二端。于本实施例中，虽然读取线READ电性连接至栅极驱动电路1100。然而于其他实施方式中，读取线READ或是被外接至一个信号输出端以便于使用者或检测者进行量测，或是电性连接至源极驱动电路1200，本发明并不加以限制。此外，虽然本发明中的栅极驱动电路1100与源极驱动电路1200分别于显示装置1000的左侧与下侧，然而所属技术领域的技术人员当能依据本发明的精神自行配置驱动电路、驱动线与对应晶体管开关的位置及连接关系，本发明并不加以限制。
因此，请参照图2A，其为依据本发明一实施例的正常的显示装置的信号时序图。如图2A所示，其中信号VS1至信号VSN由栅极驱动电路1100送到栅极驱动线S1～SN的电压，信号V1即为第一电压端V1的电压，信号VREAD则为读取线READ所读取到的电压。于第一时间区间P1至第N时间区间PN，栅极驱动电路1100分别对栅极驱动线S1至栅极驱动线SN提供高准位的脉冲(pulse)，并且于每个时间区间中，第一电压端V1也提供一个高准位脉冲。其中栅极驱动线的脉冲即为垂直同步信号(vertical synchronization signal,V-sync)，而第一电压端V1所提供的脉冲的宽度，举例而言，小于各栅极扫描线上的脉冲(垂直同步信号)的宽度。从而在各个时间区间中，信号VREAD的电压应该如图2A所示，实质同步于第一电压端V1所提供的脉冲。
相对的，请参照图2B其为依据本发明一实施例的异常的显示装置的信号时序图。图2B所对应的状态是在栅极驱动线S2上有断线，因此于第二时间区间P2中，晶体管开关TS2不会导通，从而信号VREAD与第一电压端V1的信号不同步，从而使用者、栅极驱动电路1100或是源极驱动电路1200得以藉由比较第一电压端V1的信号与信号VREAD而判断是否有栅极驱动线断线以及哪一条栅极驱动线断线。更具体来说，于一实施例中，第一电压端V1电性连接于栅极驱动电路1100，并且第一电压端V1所提供的脉冲实质上是由栅极驱动电路1100所产生。因此，栅极驱动电路1100依据其所产生给第一电压端V1的脉冲与从读取线READ所检测到的信号VREAD，得以直接判断两者是否对应。
于本发明另一实施例中，请参照图3，其为依据本发明另一实施例的显示装置电路架构示意图。相较于图1的显示装置，图3的实施例中，栅极驱动电路1100更具有一个电压读取电路1110，用以读取输入到读取线的讯号V1。从第一时间区间P1开始直到最后一个时间区间PN为止，第一电压端V1均维持高电压(例如为电源电压VDD)。则请参照图4A，其为依据本发明一实施例的正常的显示装置的信号时序图。于图4A中可以看到，只要有任意一条扫描线的电压为高电压，则信号VREAD就会是高电压。若是其中扫描线S2有断线，则请参照图4B，其为依据本发明一实施例的异常的显示装置的信号时序图。由于扫描线S2有断线，因此在第二时间区间P2中，即使栅极驱动电路1100对扫描线S2送出高电压，但是晶体管开关TD2的栅极电压并不会变成高电压，而是维持低电压。从而在第二时间区间P2中，晶体管开关TD2未导通，因此信号VREAD在第二时间区间P2中维持低电压。从而使用者、栅极驱动电路1100或是源极驱动电路1200得以藉由比较第一电压端V1的信号与信号VREAD而判断是否有栅极驱动线断线以及哪一条栅极驱动线断线。
然而，第一电压端V1所提供的电压不必然要是直流电压。请参照图4C，其为依据本发明一实施例的正常的显示装置的信号时序图。相较于图4A的实施例，第一电压端V1所提供的电压实质上可以具有任意波形，而图4C的实施例中，第一电压端V1所提供的电压为齿状波(sawtooth wave)。因此在每当有任意一条扫描线上的电压为高电压时，信号VREAD的波形会对应于第一电压端V1所提供的波形。设若扫描线S2有断线，则请参照图4D其为依据本发明一实施例的异常的显示装置的信号时序图。由于扫描线S2有断线，因此在第二时间区间P2中，即使栅极驱动电路1100对扫描线S2送出高电压，但是晶体管开关TD2的栅极电压并不会变成高电压，而是维持低电压。从而在第二时间区间P2中，晶体管开关TD2未导通，因此信号VREAD在第二时间区间P2中维持低电压。从而使用者、栅极驱动电路1100或是源极驱动电路1200得以藉由比较第一电压端V1的信号与信号VREAD而判断是否有栅极驱动线断线以及哪一条栅极驱动线断线。
于本发明另一实施例中，请参照图5，其为依据本发明另一实施例的显示装置电路架构示意图。如图5所示，依据本发明一实施例的显示装置1000具有栅极驱动电路1100、源极驱动电路1200、多条栅极驱动线(扫描线)S1～SN、多条源极驱动线(数据线)D1～DM、多个晶体管开关TD1～TDM与读取线READ。每条源极驱动线具有第一端与第二端，以图5为例，源极驱动线的第一端为下端(以图5而言，Y轴座标较小的一端)，而源极驱动线的第二端为上端(以图5而言，Y轴座标较大的一端)。每条源极驱动线的第一端连接于源极驱动电路1100。每个晶体管开关具有第一端、第二端与控制端。每个晶体管开关的第一端电性连接于第一电压端V1，而每个晶体管开关的控制端电性连接于对应的一条源极驱动线的第二端。读取线READ电性连接于每个晶体管开关的第二端。于本实施例中，虽然读取线READ电性连接至源极驱动电路1200。然而于其他实施方式中，读取线READ或是被外接至一个信号输出端以便于使用者或检测者进行量测，或是电性连接至栅极驱动电路1100，本发明并不加以限制。
因此，请参照图6A，其为依据本发明一实施例的正常的显示装置的信号时序图。如图6A所示，其中信号VS1至信号VSN由栅极驱动电路1100送到栅极驱动线S1～SN的电压，信号VD1与信号VD2由源极驱动电路1200分别送到源极驱动线D1与D2的电压，信号V1即为第一电压端V1的电压，信号VREAD则为读取线READ所读取到的电压。一个画面时间区间PF包含第一时间区间P1至第N时间区间PN(也就是更新时间区间)以及空白时间区间PB，于第一时间区间P1至第N时间区间PN，栅极驱动电路1100分别对栅极驱动线S1至栅极驱动线SN提供高准位的脉冲(pulse)，而在空白时间区间PB中，源极驱动电路1200对源极驱动线D1至源极驱动线DM其中部份的源极驱动线依序提供高准位的脉冲。
举例来说，在空白时间区间PB中，源极驱动电路1200先对源极驱动线D1提供脉冲，接着对源极驱动线D2提供脉冲，并且同时第一电压端V1也提供脉冲。于一实施例中，第一电压端提供的脉冲的宽度小于源极驱动电路1200对各源极驱动线提供的脉冲的宽度，然不以此为限。根据此实施例，在各个时间区间中，信号VREAD的电压如图6A所示，实质同步于第一电压端V1所提供的脉冲。每一个画面时间区间PF的空白时间区间PB例如被区分为四个检测时间区间，而源极驱动电路1200于一个空白时间区间PB的四个检测时间区间分别对源极驱动线织中的四条依序提供电压。所提供的电压(驱动电压)需要能使晶体管开关导通。
相对的，请参照图6B其为依据本发明一实施例的异常的显示装置的信号时序图。图6B所对应的状态是在源极驱动线D2上有断线，因此于某一个空白时间区间PB中，信号VREAD与第一电压端V1的信号不同步，从而使用者、栅极驱动电路1100或是源极驱动电路1200得以藉由比较第一电压端V1的信号与信号VREAD而判断是否有栅极驱动线断线以及哪一条栅极驱动线断线。
请参照图7，其为依据本发明另一实施例的显示装置电路架构示意图。如图7所示，依据本发明另一实施例的显示装置1000具有栅极驱动电路1100、源极驱动电路1200、多条栅极驱动线(扫描线)S1～SN、多条源极驱动线(数据线)D1～DM、多个晶体管开关TD1～TDM与读取线READ。每条源极驱动线具有第一端与第二端，以图7为例，源极驱动线的第一端为下端(以图7而言Y轴座标较小的一端)，而源极驱动线的第二端为上端(以图7而言Y轴座标较大的一端)。每条源极驱动线的第一端连接于源极驱动电路1200。每个晶体管开关具有第一端、第二端与控制端。每个晶体管开关的第一端电性连接于第一电压端V1，而每个晶体管开关的控制端电性连接于对应的一条源极驱动线的第二端。读取线READ电性连接于每个晶体管开关的第二端。更具体来说，于图7的实施例中，晶体管开关TD1的第一端连接于第一电压端V1，晶体管开关TD2的第一端连接于晶体管开关TD1的第二端，每个晶体管开关串接，晶体管开关TDM的第一端连接于晶体管开关TDM-1的第二端而晶体管开关TDM的第二端连接至读取线READ。因此于本实施例中，第一电压端V1于空白时间区间PB中提供一个脉冲，而源极驱动电路1200于空白时间区间PB中同时对每条源极驱动线D1至DM提供高电压，从而使晶体管开关TD1至晶体管开关TDM能同时导通。因此，使用者、栅极驱动电路1100或源极驱动电路1200得以藉由检测空白时间区间PB中信号VREAD是否与第一电压端V1所提供的脉冲对应，而判断是否有任何一条源极驱动线有断线的异常问题。
于另一实施例中，请参照图8，其为依据本发明再一实施例的显示装置电路架构示意图。如图8所示，依据本发明一实施例的显示装置1000具有栅极驱动电路1100、源极驱动电路1200、多条栅极驱动线(扫描线)S1～SN、多条源极驱动线(数据线)D1～DM、多个晶体管开关TD1～TDM与读取线READ。每条源极驱动线具有第一端与第二端，以图8为例，源极驱动线的第一端为下端(以图8而言Y轴座标较小的一端)，而源极驱动线的第二端为上端(以图8而言Y轴座标较大的一端)。每条源极驱动线的第一端连接于源极驱动电路1200。每个晶体管开关具有第一端、第二端与控制端。晶体管开关TD1的第一端电性连接于第一电压端V11，晶体管开关TD2的第一端电性连接于第一电压端V12，晶体管开关TDM的第一端电性连接于第一电压端V1M，而每个晶体管开关的控制端电性连接于对应的一条源极驱动线的第二端。读取线READ电性连接于每个晶体管开关的第二端。更具体来说，于图6的实施例中，晶体管开关TD2的第一端连接于晶体管开关TD1的第二端，每个晶体管开关串接，晶体管开关TDM的第一端连接于晶体管开关TDM-1的第二端而晶体管开关TDM的第二端连接至读取线READ。因此于本实施例中，第一电压端V11至第一电压端V1M于空白时间区间PB中分别循序提供一个脉冲，而源极驱动电路1200于空白时间区间PB中同时对每条源极驱动线D1至DM提供高电压，从而使晶体管开关TD1至晶体管开关TDM能同时导通。因此，使用者、栅极驱动电路1100或源极驱动电路1200得以藉由检测空白时间区间PB中信号VREAD是否与第一电压端V11至第一电压端V1M所提供的脉冲对应，而判断是否有任何一条源极驱动线有断线的异常问题。具体来说，设若晶体管开关TD2的控制端所连接的源极驱动线D2有断线问题，则第一电压端V11与第一电压端V12所提供的脉冲无法被传送至读取线READ，因此经由信号VREAD，这样的断线问题得以被检查出来。
综上所述，本发明藉由加入受控于栅极驱动线或源极驱动线的晶体管开关，并藉由对应的电压端所提供的信号，栅极驱动电路或源极驱动电路得以判断是否有任何驱动线有断线的问题。
虽然本发明以前述的实施例公开如上，但其并非用以限定本发明。在不脱离本发明的精神和范围内，所为的更动与修改，均属本发明的专利保护范围。关于本发明所界定的保护范围请参考所附的权利要求书。

Claims (10)

1.一种显示装置，其特征在于，包含：
一驱动电路；
N条驱动线，每一该驱动线具有一第一端与一第二端，且每一该驱动线的该第一端连接于该驱动电路，N为大于2的整数；
N个晶体管开关，其中第i个晶体管开关包含：
一第一端，该第i个晶体管的该第一端电性连接于一第一电压端，i为小于等于N的正整数；
一第二端；以及
一控制端，电性连接于该N条驱动线中第i条驱动线的该第二端；以及
一读取线，电性连接于每一该晶体管开关的该第二端。
2.如权利要求1所述的显示装置，其特征在于，该驱动电路为一源极驱动电路，且该显示装置的一画面周期区分为一更新时间区间与一空白时间区间，该源极驱动电路于该空白时间区间中对该N条驱动线其中至少之一提供至少一驱动电压。
3.如权利要求2所述的显示装置，其特征在于，该源极驱动电路于该空白时间区间中对该N条驱动线中的M条驱动线提供该驱动电压，M为小于N且大于等于1的整数。
4.如权利要求3所述的显示装置，其特征在于，该空白时间区间被区分为M个检测时间区间，该源极驱动电路于第k个检测时间区间中提供给该M条驱动线中的第k条驱动线该驱动电压，k为小于等于M的正整数。
5.如权利要求2所述的显示装置，其特征在于，该第i个晶体管开关分别连接于该第(i-1)个晶体管开关与该第(i+1)个晶体管开关，该第i个晶体管开关透过该第(i+1)个晶体管开关而电性连接至该读取线，且该第i个晶体管开关透过该第(i-1)个晶体管开关电性连接至该第一电压端。
6.如权利要求5所述的显示装置，其特征在于，该源极驱动电路于该空白时间区间中同时对每一该驱动线提供该驱动电压。
7.如权利要求1所述的显示装置，其特征在于，该驱动电路为一栅极驱动电路用以对该些驱动线提供一驱动电压。
8.如权利要求1所述的显示装置，其特征在于，该读取线直接连接于每一该晶体管开关的该第二端。
9.如权利要求2至7中任一所述的显示装置，其特征在于，该第一电压端提供一测试信号，且该驱动电压的电压位准高于该测试信号的电压位准。
10.如权利要求1至8中任一所述的显示装置，其特征在于，该第一电压端所提供的电压为一直流电压或一交流电压。
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