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WO2000041033A1 - Substrate of lcd device and method of manufacture thereof - Google Patents

Substrate of lcd device and method of manufacture thereof Download PDF

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WO2000041033A1
WO2000041033A1 PCT/JP1999/007328 JP9907328W WO0041033A1 WO 2000041033 A1 WO2000041033 A1 WO 2000041033A1 JP 9907328 W JP9907328 W JP 9907328W WO 0041033 A1 WO0041033 A1 WO 0041033A1
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WO
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substrate
bus line
film
liquid crystal
insulating film
Prior art date
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Application number
PCT/JP1999/007328
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English (en)
French (fr)
Inventor
Atuyuki Hoshino
Tadashi Hasegawa
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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Publication date
Application filed by Fujitsu Ltd filed Critical Fujitsu Ltd
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    • G02F2201/123Constructional arrangements not provided for in groups G02F1/00 - G02F7/00 electrode pixel

Definitions

  • FIG. 6 shows a cross-sectional view of a terminal portion for connection to the outside of a conventional active matrix liquid crystal display device.
  • a gate insulating film 101 is formed on a surface of a glass substrate 100.
  • the gate insulating film 101 functions as a gate insulating film of a thin film transistor (TFT) of each pixel.
  • TFT thin film transistor
  • a drain bus line 102 is formed on the gate insulating film 101.
  • the drain bus line 102 is connected to the drain electrode of TFT.
  • An insulating film 103 is formed on the gate insulating film 101 so as to cover the drain bus line 102.
  • An external terminal 104 is formed on a region near the outer periphery of the insulating film 103. External terminals 104 are insulating films
  • Opposing substrate such that it faces glass substrate 100 with a certain interval
  • the area on the outer peripheral side of the substrate on the top surface of the substrate 04 is disposed outside the bonding portion with the adhesive 115 and is exposed.
  • Glass substrate 100 and counter substrate 1 The liquid crystal material 118 is filled between 110 and 110.
  • the edge of the opposing substrate 110 is almost equal to the corresponding edge of the glass substrate 100 when viewed from the normal direction of the substrate. Arrange them so that they overlap. After the opposing substrate 110 is fixed to the glass substrate 100, a portion 110a near the edge of the opposing substrate 110 is cut off.
  • the external terminal 104 can be connected to an external drive circuit by cutting off the portion 110a near the ⁇ of the counter substrate 110.
  • An object of the present invention is to provide a substrate for a liquid crystal display device in which external terminals are hardly damaged when a portion near the edge of the substrate facing the substrate on which the external terminals are formed is cut off, and a method of manufacturing the same. It is.
  • a first substrate in which an image display area is defined in a main surface, and a terminal area is defined in a part of an outside thereof, and the image in a main surface of the first substrate.
  • a plurality of first bus lines arranged on a display area; a first insulating film arranged on a main surface of the first substrate so as to cover the first bus lines;
  • a first contact hole is provided on the terminal region of the first substrate corresponding to each of the first bus lines and penetrates the first insulating film and reaches the upper surface of the first bus line.
  • an external terminal electrically connected to the corresponding first bus line, and not covering at least a region near an outer peripheral end of the first substrate on an upper surface of the external terminal.
  • a substrate for a liquid crystal display device having a protective film made of an insulating material covering a part of the surface.
  • the external terminal Since a part of the external terminal is covered with the protective film, damage to the external terminal can be suppressed in the processing and processing in the next and subsequent steps. In addition, since the outer peripheral area of the external terminal is not covered with the protective film, the external terminal can be connected to an external circuit in this area.
  • a step of preparing a first substrate wherein an image display region is defined in a main surface of the first substrate, and a terminal region is defined in a portion outside the main surface.
  • a first bus line is provided on the terminal area of the first substrate corresponding to each of the first bus lines, and penetrates the first insulating film to reach an upper surface of the first bus line.
  • An external terminal electrically connected to the corresponding first bus line via a contact hole, and covering at least a region near an outer peripheral end of the first substrate on an upper surface of the external terminal; So as not to cover a part of the upper surface of the external terminal.
  • a plurality of second bus lines formed so as to intersect the first bus line on the image display area; and a first bus line and a second bus on the image display area.
  • a pixel electrode arranged corresponding to each of the intersections with the lines, and connecting each of the pixel electrodes to one of the corresponding first and second bus lines, and the other bus line
  • FIG. 1 is a plan view of a liquid crystal display device according to a first embodiment of the present invention.
  • FIG. 2A and FIG. 2B are diagrams of a liquid crystal display device for explaining the effect of a projection pattern. It is sectional drawing.
  • FIG. 3 is a sectional view of the liquid crystal display device according to the first embodiment.
  • 4A to 4F are cross-sectional views of a substrate for explaining a method of manufacturing the TFT substrate of the liquid crystal display device according to the first embodiment.
  • 5A and 5B are cross-sectional views of a substrate for describing a method of manufacturing a TFT substrate of a liquid crystal display according to the second embodiment.
  • FIG. 6 is a sectional view of an external terminal portion of a conventional liquid crystal display device.
  • BEST MODE FOR CARRYING OUT THE INVENTION FIG. 1 shows a plan view of a home port pick type liquid crystal display device according to a first embodiment.
  • An image display area 2 is defined in the plane of the glass substrate 1, and a terminal area 3 is defined in a part outside the image display area 2.
  • a plurality of gate bus lines 5 extend in the row direction (lateral direction) in the figure. Between two gate bus runs 5 adjacent to each other, a capacitance bus line 6 extending in the row direction is arranged.
  • the gate insulating film covers the gate bus line 5 and the capacitance bus line 6. On this gate insulating film, a plurality extending in the column direction (vertical direction) Data bus lines 7 are arranged.
  • a thin film transistor (TFT) 10 is provided at the intersection of the gate bus line 5 and the data bus line 7.
  • the drain electrode of TFT 10 is connected to the corresponding data bus line 7.
  • Gate bus line 5 forces Also serves as the gate electrode of the corresponding TFT 10.
  • the data bus line 7 and the TFT 10 are covered with an interlayer insulating film.
  • the pixel electrode 12 is arranged in a region surrounded by two gate bus lines 5 and two data bus lines 7. The pixel electrode 12 is connected to the source region of the corresponding TFT 10.
  • An auxiliary capacitance branch line 14 branched from the capacitance bus line 6 extends along the edge of the pixel electrode 12.
  • the capacitance bus line 6 and the auxiliary capacitance branch line 14 form an auxiliary capacitance with the pixel electrode 12.
  • the potential of the capacitance bus line 6 is fixed.
  • the potential of the pixel electrode 12 fluctuates due to capacitive coupling caused by stray capacitance.
  • the potential fluctuation of the pixel electrode 12 can be reduced.
  • a first projection pattern 16 and a second projection pattern 18 are formed on the glass substrate 1 on which the TFT is formed and the opposing surface of the opposing substrate, respectively, along a zigzag pattern extending in the column direction. ing.
  • the first projection pattern 16 is hatched to distinguish the first projection pattern 16 from the second projection pattern 18.
  • the first projection patterns 16 are arranged at regular intervals in the row direction, and the bending points are located on the gate bus line 5 and the capacitance bus line 6.
  • the second projection pattern 18 has substantially the same pattern as the first projection pattern 16, and is arranged substantially at the center of two adjacent first projection patterns 16.
  • data terminals 20 are arranged corresponding to the respective data bus lines 7, and in the left terminal area 3, a gate bus line is provided.
  • Gate terminals 21 are arranged corresponding to each of the gates 5.
  • Each data terminal 20 is connected to a corresponding data bus line 7 via a contact hole 24.
  • Each gate terminal 21 is connected to a corresponding gate bus line 5 via a contact hole 25.
  • the gate bus line 5 and the data bus line 7 are connected to an external drive circuit via a gate terminal 21 and a data terminal 20 respectively.
  • the protection film 26 is arranged so as to cross the substantially center of the data terminal 20 in the row direction.
  • the protective film 26 does not cover the area near the outer peripheral end of the glass substrate 1 on the upper surface of the data terminal 20.
  • first and second projection patterns 16 and 18 will be described with reference to FIGS. 2A and 2B.
  • FIG. 2A is a cross-sectional view of the liquid crystal display device in a state where no voltage is applied.
  • a first projection pattern 16 is formed on the facing surface of the glass substrate 1, and a second projection pattern 18 is formed on the facing surface of the facing substrate 36.
  • a vertical alignment film 28 is formed so as to cover the protruding patterns 16 and 18.
  • a liquid crystal material 29 containing liquid crystal molecules 30 is sandwiched between the glass substrate 1 on which TFT is formed and the counter substrate 36.
  • the liquid crystal molecules 30 have negative dielectric anisotropy.
  • Polarizing plates 31 and 32 are arranged outside the glass substrate 1 and the opposing substrate 36 in crossed Nicols, respectively.
  • the liquid crystal molecules 30 When no voltage is applied, the liquid crystal molecules 30 are oriented perpendicular to the substrate surface.
  • the liquid crystal molecules 30a on the slopes of the first and second projection patterns 16 and 18 try to align vertically to the slopes. Therefore, the liquid crystal molecules 30a on the slopes of the first and second projection patterns 16 and 18 are oriented obliquely with respect to the substrate surface.
  • the liquid crystal molecules 30 are vertically aligned in a wide area within the pixel, a good black display state can be obtained.
  • FIG. 2B is a cross-sectional view in a state where a voltage is applied so that the liquid crystal molecules 30 are inclined, that is, in a halftone display state.
  • the liquid crystal molecules 30a that are tilted in advance tilt more greatly in the tilt direction.
  • the surrounding liquid crystal molecules 30 are also tilted in the same direction under the influence of the tilt of the liquid crystal molecules 30a. Therefore, the liquid crystal molecules 30 between the first projection pattern 16 and the second projection pattern 18 are arranged such that the major axis (director) is along a straight line from the lower left to the upper right in the figure.
  • the liquid crystal molecules 30 on the left side of the first projection pattern 16 and the liquid crystal molecules 30 on the right side of the second projection pattern 18 have their major axes straight from the lower right to the upper left in the figure. Arrange along the line.
  • the first and second projection patterns 16 and 18 define the boundaries of the domain.
  • two types of domains can be formed.
  • the first and second protrusion patterns 16 and 18 are bent, so that a total of four types of domains are formed.
  • FIG. 3 shows a cross-sectional view of the liquid crystal display device of FIG.
  • the drawings on the right and left sides of the broken portion in the center of FIG. 3 correspond to the cross-sectional views taken along dashed-dotted line A-A and dashed-dotted line BB in FIG.
  • the TFT substrate 35 and the counter substrate 36 are arranged in parallel with a gap therebetween.
  • Gate bus lines 5 are formed on the opposite surface of the glass substrate 1.
  • the gate bus line 5 has a two-layer structure of an Al film having a thickness of 10 nm and a Ti film having a thickness of 5 nm.
  • a gate insulating film 40 is formed on the glass substrate 1 so as to cover the gate bus line 5.
  • the gate insulating film 40 is a SiN film having a thickness of 400 nm.
  • An active region 41 is formed on the surface of the gate insulating film 40 so as to straddle the gate bus line 5.
  • the active region 41 is a non-doped amorphous Si film having a thickness of 30 nm.
  • a channel protective film 42 is formed on a region above the gate bus line 5 on the surface of the active region 41. I have.
  • the channel protective film 42 is a SiN film having a thickness of 140 nm.
  • the channel protective film 42 is patterned so as to cover the channel region of the TFT 10 in FIG.
  • a source electrode 44 and a drain electrode 46 are formed on regions on both sides of the channel protective film 42 on the upper surface of the active region 41, respectively.
  • the source electrode 44 and the drain electrode 46 are both a 30 nm thick n + type amorphous Si film, a 20 nm thick Ti film, a 75 nm thick A1 film, and a thick film. It has a laminated structure in which 80 nm Ti films are laminated in this order.
  • the TFT bus 10 is constituted by the gate bus line 5, the gate insulating film 40, the active region 41, the source electrode 44, and the drain electrode 46. In terminal region 3, the end of data bus line 7 is arranged on gate insulating film 40.
  • the data bus line 7 has the same laminated structure as the drain electrode 46 formed in the image display area 2.
  • the amorphous Si film formed simultaneously with the active region 41 remains below the bus line 7.
  • An insulating film 48 is formed on the gate insulating film 40 so as to cover the TFT 10 and the data bus line 7.
  • the insulating film 48 is a SiN film having a thickness of 330 nm.
  • the pixel electrode 12 is formed on the insulating film 48.
  • the pixel electrode 12 is a 70 nm thick tin oxide (ITO) film, and is connected to the source electrode 44 via a contact hole 50 penetrating the insulating film 48.
  • ITO tin oxide
  • a first projection pattern 16 is formed on the pixel electrode 12 and the insulating film 48.
  • the first projection pattern 16 is formed of a photoresist.
  • the uppermost layer in the image display area 2 is covered with an alignment film 28.
  • the data terminal 20 is formed on the insulating film 48.
  • the data terminal 20 is formed and patterned at the same time as the pixel electrode 12.
  • the data terminal 20 is connected to the data bus line 7 via a contact hole 24 penetrating the insulating film 48.
  • a part of the upper surface of the data terminal 20 is covered with a protective film 26.
  • Data terminal 2 0 A part of the upper surface of the glass substrate 1 on the outer peripheral side is exposed.
  • a light-shielding film 52 made of Cr or the like is formed on a predetermined region on the opposite surface of the glass substrate 27.
  • a common electrode 54 made of ITO is formed on the opposite surface of the glass substrate 27 so as to cover the light shielding film 52.
  • the alignment film 28 covers the surface of the common electrode 54 in the image display area 2. In the terminal region 3, the common electrode 54 is exposed.
  • the opposing substrate 36 is fixed to the TFT substrate 35 with an adhesive 56 at the periphery thereof.
  • the gap between the TFT substrate 35 and the counter substrate 36 is sealed with an adhesive 56.
  • a liquid crystal material 29 is filled in a gap between the TFT substrate 35 and the counter substrate 36.
  • the liquid crystal material 29 has a negative dielectric anisotropy.
  • the adhesive 56 is fixed to the TFT substrate 35 in a region inside the protective film 26.
  • the adhesive 56 may be arranged so as to contact the protective film 26.
  • the edge of the opposing substrate 36 is arranged so as to substantially overlap the corresponding edge of the TFT substrate 35 when viewed from the normal direction of the substrate. After the fixing, the peripheral portion 36a of the counter substrate 36 is cut off.
  • Steps up to the state shown in FIG. 4A will be described.
  • An A1 film having a thickness of 10 O nm and a Ti film having a thickness of 5 O nm are formed in this order. These films can be formed by sputtering.
  • two layers, an A1 film and a Ti film are patterned to leave a gate bus line 5.
  • Etching of A 1 film and T i layer is performed by reactive ion etching (RIE) using mixed gas of BC 1 3 and C 1 2.
  • RIE reactive ion etching
  • a gate insulating film 40 made of SiN and having a thickness of 400 nm is formed on the glass substrate 1 so as to cover the gate bus line 5.
  • a 30-nm thick non-amorphous Si film 41 a is formed on the gate insulating film 40.
  • the gate insulating film 40 and the amorphous Si film 41a are formed by, for example, plasma-excited chemical vapor deposition (PE-CVD).
  • a SiN film having a thickness of 140 nm is formed by PE-C VD.
  • This SiN film is patterned using photolithography technology, and the channel protective film 42 is left.
  • an edge of the resist pattern parallel to the row direction in FIG. 1 can be defined.
  • the edge parallel to the column direction in FIG. 1 is defined by exposure using a normal photomask.
  • Etching of the SiN film can be performed by wet etching using a buffered hydrofluoric acid-based etchant, or by RIE using a fluorine-based gas.
  • n + -type amorphous Si film having a thickness of 30 nm is formed on the entire surface of the substrate by PE-CVD so as to cover the channel protective film.
  • a Ti film having a thickness of 2 O nm, an Al film having a thickness of 75 nm, and a Ti film having a thickness of 80 nm are sequentially formed by sputtering.
  • the process from the top Ti film to the non-doped amorphous Si film 41a is performed. Etching of these films is performed by RIE using a mixed gas of BC 1 3 and C 1 2.
  • the upper part of the gate bus line 5 In the region, the channel protective film 42 functions as an etching stop layer.
  • An active region 41 made of a non-doped amorphous Si remains on the gate insulating film 40 so as to straddle the gate bus line 5.
  • the source electrode 44 and the drain electrode 46 remain on the upper surface of the active region 41 and on the regions on both sides of the protective film 42, respectively.
  • the data bus line 7 remains on the terminal area.
  • An insulating film 48 made of SiN and having a thickness of 330 nm is formed on the entire surface of the substrate by PE-CVD.
  • a contact hole 50 exposing a part of the upper surface of the source electrode 44 is formed in the insulating film 48.
  • a contact hole 24 exposing a part of the upper surface near the end of the data bus line 7 is formed.
  • An ITO film with a thickness of 70 nm is formed on the entire surface of the substrate.
  • the ITO film is formed by, for example, DC magnetron sputtering. This ITO film is patterned to leave the pixel electrode 12 and the data terminal 20.
  • the ITO film is etched by wet etching using an oxalic acid etchant. Steps up to the state shown in FIG. 4F will be described.
  • a resist film is formed on the entire surface of the substrate, and the resist film is patterned. As a result, the first projection pattern 16 is left on the image display area, and the protective film 26 is left on the terminal area. Next, an alignment film 28 is formed on the image display area.
  • the formation of the protective film 26 is performed simultaneously with the formation of the first projection pattern 16. Therefore, the protective film 26 can be formed without increasing the number of steps.
  • an identification mark such as a product type, a product number, or a lot number.
  • characters, bar codes, mosaic two-dimensional bar codes, and the like can be formed in an area other than the image display area.
  • the gate bus line 5 is formed of an A 1 Nd alloy containing 2 mol% of Nd.
  • the wiring resistance can be reduced as compared with the case where the stacked structure of A 1 and T i is used in the first embodiment.
  • the source electrode 44, the drain electrode 46, and the data bus line 7 were connected to an n + type amorphous silicon film having a thickness of 3 O nm and a Ti having a thickness of 2 O nm. It has a three-layer structure of a film and an Al film having a thickness of 30 O nm.
  • the A1 film can be made thicker than in the case of the four-layer structure of the n + type amorphous silicon film, the Ti film, the A1 film, and the Ti film as in the first embodiment. For this reason, the wiring resistance of the data bus line 7 can be reduced. Note that when the thick A1 film is etched by RIE, resist scorch may occur. In such a case, it is preferable to wet-etch the A1 film.
  • an insulating film 48 made of SiN and having a thickness of 330 nm is formed on the entire surface of the substrate.
  • An ITO film is formed on the insulating film 48, and the ITO film is patterned to leave the pixel electrode 12 and the external connection portion 20a of the data terminal.
  • contact hole 50 exposing a part of the upper surface of source electrode 44 and contact hole 24 exposing a part of the upper surface of data bus line 7 are formed in insulating film 48.
  • a Ti film with a thickness of 2 O nm is formed on the entire surface of the substrate, and a photoresist film is formed thereon.
  • the photoresist film is patterned to leave resist patterns 60, 61, and 62.
  • the resist pattern 60 has a pattern that matches the first projection pattern 16 in FIG. In FIG. 1, one first projection pattern 16 passes over a plurality of pixel electrodes 12.
  • a resist is formed in a region between two adjacent pixel electrodes 12. Divide pattern 60.
  • the resist pattern 61 continuously covers from the region above the contact hole 50 to the end of the pixel electrode 12.
  • the resist pattern 62 continuously covers the region from above the contact hole 24 to the region above the external connection portion 20a.
  • the Ti film thereunder is etched.
  • the first projection pattern 16 is formed by the resist pattern 60 and the Ti film 65 remaining thereunder.
  • the pixel electrode 12 is electrically connected to the source electrode 44 by the Ti film 66 remaining under the resist pattern 61.
  • the external connection portion 20a is electrically connected to the data bus line 7 by the Ti film 67 left under the resist pattern 62.
  • the data terminal 20 is constituted by the internal connection part 20 b made of the Ti film 67 and the external connection part 20 a.
  • the image display area is covered with an alignment film 28.
  • the first projection pattern 16 in the second embodiment has a conductive Ti film 65 in a lower layer portion. However, since the first projection pattern 16 is divided between the pixel electrodes 12 adjacent to each other, a short circuit between the pixel electrodes 12 does not occur.
  • the pixel electrode 12 composed of ITO is not in direct contact with the uppermost A1 film of the source electrode 44, but is connected via the Ti film 66. Therefore, good electrical connection between the two can be ensured.
  • the resist pattern 62 covering the internal connection portion 20b of the data terminal 20 performs the same function as the protective film 26 of the first embodiment shown in FIG. For this reason, the data terminal 20 is maintained when the peripheral portion of the opposing substrate is cut off. Therefore, the occurrence of conduction failure of the terminal 20 can be suppressed.
  • the resist pattern 62 it is also possible to use the resist pattern 62 to form an identification mark such as a product type, a product number, or a lot number.

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Description

明細書 液晶表示装置用基板及びその製造方法 技術分野 本発明は、 液晶表示装置用基板及びその製造方法であって、 基板の 縁近傍に外部回路との接続用端子が設けられた液晶表示装置用基板 及びその製造方法に関する。 背景技術 図 6は、 従来のァクティブマトリクス型液晶表示装置の、 外部との 接続用端子部分の断面図を示す。 ガラス基板 1 0 0の表面上に、 ゲー ト絶縁膜 1 0 1が形成されている。 ゲ一ト絶縁膜 1 0 1は、 各画素の 薄膜トランジスタ (T F T ) のゲート絶縁膜として機能する。 ゲート 絶縁膜 1 0 1の上に、 ドレインバスライン 1 0 2が形成されている。 ドレインバスライン 1 0 2は、 T F Tのドレイン電極に接続されてい る。
ドレインバスライン 1 0 2を覆うように、ゲ一ト絶縁膜 1 0 1の上 に絶縁膜 1 0 3が形成されている。 絶縁膜 1 0 3の、 外周近傍の領域 上に、 外部端子 1 0 4が形成されている。 外部端子 1 0 4は、 絶緣膜
1 0 3に設けられたコンタクトホール 1 0 5を経由してドレインバ スライン 1 0 2に接続されている。
ガラス基板 1 0 0に、 ある間隔を隔てて対向するように、 対向基板
1 1 0が配置されている。対向基板 1 1 0は、その縁の近傍において、 接着剤 1 1 5によりガラス基板 1 0 0に固着されている。外部端子 1
0 4の上面のうち基板の外周側の領域は接着剤 1 1 5による接着箇 所よりも外側に配置され、 露出する。 ガラス基板 1 0 0と対向基板 1 1 0との間に、 液晶材料 1 1 8が充填されている。
対向基板 1 1 0をガラス基板 1 0 0に対向させて固着させる際に は、 基板法線方向から見たとき、 対向基板 1 1 0の縁が、 ガラス基板 1 0 0の対応する縁にほぼ重なるように配置する。対向基板 1 1 0が ガラス基板 1 0 0に固着した後に、対向基板 1 1 0の縁の近傍の部分 1 1 0 aを切り落とす。対向基板 1 1 0の緣近傍部分 1 1 0 aを切り 落とすことにより、外部端子 1 0 4を外部の駆動回路に接続すること が可能になる。
対向基板 1 1 0の縁の近傍の部分 1 1 0 aを切り落とす時に、外部 端子 1 0 4が損傷を受け、 断線する場合がある。 また、 対向基板 1 1 0の対向面上には、 共通電極が形成されている。 切り落とし時に発生 する導電性のゴミにより、外部端子 1 0 4と共通電極とが短絡する場 合も起こり得る。 発明の開示 本発明の目的は、外部端子が形成された基板に対向する基板の縁の 近傍部分を切り落とす時に、外部端子が損傷を受けにくい液晶表示装 置用基板及びその製造方法を提供することである。
本発明の一観点によると、 主表面内に画像表示領域が画定され、 そ の外側の一部に端子領域が画定された第 1の基板と、前記第 1の基板 の主表面内の前記画像表示領域上に配置された複数本の第 1のバス ラインと、 前記第 1のバスラインを覆うように、 前記第 1の基板の主 表面上に配置された第 1の絶緣膜と、前記第 1のバスラインの各々に 対応して前記第 1の基板の端子領域上に設けられ、前記第 1の絶縁膜 を貫通して前記第 1のバスラインの上面まで達する第 1のコンタク 卜ホールを経由し、対応する前記第 1のバスラインに電気的に接続さ れた外部端子と、前記外部端子の上面のうち少なくとも前記第 1の基 板の外周側の端部近傍の領域を被覆しないように、前記外部端子の上 面の一部を被覆する絶縁材料からなる保護膜とを有する液晶表示装 置用基板が提供される。
外部端子の一部が保護膜で覆われているため、次工程以降の処理及 び加工において、 外部端子の受ける損傷を抑制することができる。 ま た、 外部端子の外周側の領域は保護膜で覆われていないため、 この部 分において、 外部端子と外部の回路とを接続することができる。
本発明の他の観点によると、 第 1の基板を準備する工程であって、 該第 1の基板の主表面内に画像表示領域が画定され、その外側の一部 に端子領域が画定されており、該画像表示領域上に配置された複数本 の第 1のバスラインと、 該第 1のバスラインを覆うように、 前記第 1 の基板の主表面上に配置された第 1の絶縁膜と、前記第 1のバスライ ンの各々に対応して前記第 1の基板の端子領域上に設けられ、前記第 1の絶縁膜を貫通して前記第 1のバスラインの上面まで達する第 1 のコンタクトホールを経由し、対応する前記第 1のバスラインに電気 的に接続された外部端子と、前記外部端子の上面のうち少なくとも前 記第 1の基板の外周側の端部近傍の領域を被覆しないように、前記外 部端子の上面の一部を被覆する絶緣材料からなる保護膜と、前記画像 表示領域上に、前記第 1のバスラインと交差するように形成された複 数の第 2のバスラインと、 前記画像表示領域上に、 前記第 1のバスラ インと第 2のバスラインとの交差箇所の各々に対応して配置された 画素電極と、 前記画素電極の各々を、 対応する第 1及び第 2のバスラ ィンのうち一方のバスラインに接続し、他方のバスラインに印加され る信号によって導通状態を制御されるスィツチング素子とが形成さ れた前記第 1の基板を準備する工程と、表面上に共通電極が形成され た第 2の基板を準備する工程と、前記第 1の基板の主表面に前記第 2 の基板の共通電極が形成された面がある間隔を隔てて対向するよう に、 前記第 1の基板と第 2の基板とを配置し、 前記保護膜の上面のう ち、少なくとも前記第 1の基板の外周側の一部の領域を封止部材が被 覆しないように、前記第 1の基板と第 2の基板とを該封止部材で固着 させる工程と、前記第 2の基板の縁近傍の部分を切り落とす工程であ つて、 切り落とされた後の第 2の基板の新たな縁が、 前記第 1の基板 の法線方向から見たとき、前記保護膜の内部を通過するように切り落 とす工程とを有する液晶表示装置の製造方法が提供される。
外部端子の一部が保護膜で覆われているため、第 2の基板の縁近傍 の部分を切り落とす際に、 外部端子が損傷を受けにくくなる。 これに より、 外部端子の導通不良の発生を抑制することができる。 図面の簡単な説明 図 1は、本発明の第 1の実施例による液晶表示装置の平面図である < 図 2 A及び図 2 Bは、 突起パターンの効果を説明するための、 液晶 表示装置の断面図である。
図 3は、 第 1の実施例による液晶表示装置の断面図である。
図 4 A〜図 4 Fは、第 1の実施例による液晶表示装置の T F T基板 の製造方法を説明するための基板の断面図である。
図 5 A及び図 5 Bは、第 2の実施例による液晶表示装置の T F T基 板の製造方法を説明するための基板の断面図である。
図 6は、 従来の液晶表示装置の外部端子部分の断面図である。 発明を実施するための最良の形態 図 1は、第 1の実施例によるホメオト口ピック型液晶表示装置の平 面図を示す。 ガラス基板 1の面内に、 画像表示領域 2が画定され、 そ の外側の一部に端子領域 3が画定されている。複数のゲートバスライ ン 5が図の行方向 (横方向) に延在する。 相互に隣り合う 2本のゲー トバスラン 5の間に、行方向に延在する容量バスライン 6が配置され ている。ゲ一トバスライン 5と容量バスライン 6をゲ一ト絶緣膜が覆 う。 このゲート絶縁膜の上に、 図の列方向 (縦方向) に延在する複数 のデータバスライン 7が配置されている。
ゲートバスライン 5とデータバスライン 7との交差箇所に対応し て、 薄膜トランジスタ (T F T ) 1 0が設けられている。 T F T 1 0 のドレイン電極は、 対応するデータバスライン 7に接続されている。 ゲートバスライン 5力 対応する T F T 1 0のゲート電極を兼ねる。 データバスライン 7と T F T 1 0とを層間絶縁膜が覆う。 2本のゲ 一トバスライン 5と 2本のデータバスライン 7とに囲まれた領域内 に、 画素電極 1 2が配置されている。 画素電極 1 2は、 対応する T F T 1 0のソース領域に接続されている。
容量バスライン 6から分岐した補助容量支線 1 4が、画素電極 1 2 の縁に沿って延在している。容量バスライン 6及び補助容量支線 1 4 は、 画素電極 1 2との間で補助容量を形成する。 容量バスライン 6の 電位は固定されている。
データバスライン 7の電位が変動すると、浮遊容量に起因する容量 結合により画素電極 1 2の電位が変動する。 図 1の構成では、 画素電 極 1 2が補助容量を介して容量バスライン 6に接続されているため、 画素電極 1 2の電位変動を低減することができる。
T F Tが形成されたガラス基板 1及び対向基板の対向面上に、それ ぞれ列方向に延在するジグザグパターンに沿って第 1の突起パター ン 1 6及び第 2の突起パターン 1 8が形成されている。 図 1では、 第 1の突起パターン 1 6と第 2の突起パターン 1 8とを区別するため に、 第 1の突起パターン 1 6にハッチを付している。 第 1の突起パ夕 ーン 1 6は行方向に等間隔で配列し、 その折れ曲がり点は、 ゲートバ スライン 5及び容量バスライン 6の上に位置する。第 2の突起パター ン 1 8は、 第 1の突起パターン 1 6とほぼ同様のパターンを有し、 相 互に隣り合う 2本の第 1の突起パターン 1 6のほぼ中央に配置され ている。
図 1の下方の端子領域 3内に、データバスライン 7の各々に対応し てデータ端子 2 0が配置され、 左方の端子領域 3内に、 ゲートバスラ イン 5の各々に対応してゲート端子 2 1が配置されている。各データ 端子 2 0は、 コンタクトホール 2 4を経由して対応するデータバスラ イン 7に接続されている。 各ゲート端子 2 1は、 コンタクトホール 2 5を経由して対応するゲ一トバスライン 5に接続されている。ゲート バスライン 5及びデータバスライン 7は、それぞれゲート端子 2 1及 びデ一夕端子 2 0を介して外部の駆動回路に接続される。
データ端子 2 0のほぼ中央を行方向に横切るように、保護膜 2 6が 配置されている。 保護膜 2 6は、 データ端子 2 0の上面のうち、 ガラ ス基板 1の外周側の端部近傍の領域を被覆しない。
図 2 A及び図 2 Bを参照して、第 1及び第 2の突起パターン 1 6及 び 1 8の機能について説明する。
図 2 Aは、 電圧無印加状態における液晶表示装置の断面図を示す。 ガラス基板 1の対向面上に、 第 1の突起パターン 1 6が形成され、 対 向基板 3 6の対向面上に第 2の突起パターン 1 8が形成されている。 T F Tが形成されたガラス基板 1及び対向基板 3 6の対向面上に、突 起パターン 1 6及び 1 8を覆うように、垂直配向膜 2 8が形成されて いる。 T F Tが形成されたガラス基板 1と対向基板 3 6との間に、 液 晶分子 3 0を含む液晶材料 2 9が挟持されている。 液晶分子 3 0は、 負の誘電率異方性を有する。ガラス基板 1及び対向基板 3 6の外側に、 それぞれ偏光板 3 1及び 3 2がクロスニコル配置されている。
電圧無印加時には、液晶分子 3 0は基板表面に対して垂直に配向す る。第 1及び第 2の突起パターン 1 6及び 1 8の斜面上の液晶分子 3 0 aは、 その斜面に対して垂直に配向しょうとする。 このため、 第 1 及び第 2の突起パターン 1 6及び 1 8の斜面上の液晶分子 3 0 aは、 基板表面に対して斜めに配向する。 しかし、 画素内の広い領域で液晶 分子 3 0が垂直に配向するため、 良好な黒表示状態が得られる。
図 2 Bは、 液晶分子 3 0が斜めになる程度の電圧を印加した状態、 すなわち中間調表示状態における断面図を示す。図 2 Aに示すように、 予め傾斜している液晶分子 3 0 aは、その傾斜方向により大きく傾く。 その周囲の液晶分子 3 0も、液晶分子 3 0 aの傾斜に影響を受けて同 一方向に傾斜する。 このため、 第 1の突起パターン 1 6と第 2の突起 パターン 1 8との間の液晶分子 3 0は、 その長軸 (ディレクタ) が図 の左下から右上に向かう直線に沿うように配列する。第 1の突起パ夕 —ン 1 6よりも左側の液晶分子 3 0及び第 2の突起パターン 1 8よ りも右側の液晶分子 3 0は、その長軸が図の右下から左上に向かう直 線に沿うように配列する。
このように、 1画素内に、液晶分子の傾斜方向の揃ったドメインが、 複数個画定される。 第 1及び第 2の突起パターン 1 6及び 1 8が、 ド メインの境界を画定する。第 1及び第 2の突起パターン 1 6及び 1 8 を、 基板面内に関して相互に平行に配置することにより、 2種類のド メインを形成することができる。 図 1では、 第 1及び第 2の突起パ夕 ーン 1 6及び 1 8が折れ曲がつているため、合計 4種類のドメインが 形成される。 1画素内に複数のドメインが形成されることにより、 中 間調表示状態における視角特性を改善することができる。
図 3は、 図 1の液晶表示装置の断面図を示す。 図 3の中央の破断部 よりも右側及び左側の図は、それぞれ図 1の一点鎖線 A— A及び一点 鎖線 B— Bにおける断面図に相当する。 T F T基板 3 5と対向基板 3 6とが、 相互にある間隙を隔てて平行に配置されている。
まず、 T F T基板 3 5の構成について説明する。 ガラス基板 1の対 向面上に、 ゲートバスライン 5が形成されている。 ゲートバスライン 5は、厚さ 1 0 O n mの A 1膜と厚さ 5 O n mの T i膜との 2層構造 を有する。 ゲートバスライン 5を覆うように、 ガラス基板 1の上にゲ ―ト絶緣膜 4 0が形成されている。 ゲ一ト絶縁膜 4 0は、 厚さ 4 0 0 n mの S i N膜である。
ゲート絶緣膜 4 0の表面上に、ゲ一卜バスライン 5を跨ぐように活 性領域 4 1が形成されている。 活性領域 4 1は、 厚さ 3 0 n mのノン ドープアモルファス S i膜である。 活性領域 4 1の表面のうち、 ゲー トバスライン 5の上方の領域上にチャネル保護膜 4 2が形成されて いる。 チャネル保護膜 4 2は、 厚さ 1 4 0 nmの S i N膜である。 チ ャネル保護膜 4 2は、図 1において T F T 1 0のチャネル領域を覆う ようにパターニングされている。
活性領域 4 1の上面のうち、チャネル保護膜 4 2の両側の領域上に、 それぞれソース電極 44及びドレイン電極 4 6が形成されている。 ソ ース電極 44及びドレイン電極 4 6は、 共に厚さ 3 0 nmの n+型ァ モルファス S i膜、 厚さ 2 0 nmの T i膜、 厚さ 7 5 nmの A 1膜、 及び厚さ 8 0 nmの T i膜がこの順番に積層された積層構造を有す る。 ゲートバスライン 5、 ゲ一ト絶緣膜 4 0、 活性領域 4 1、 ソース 電極 44、 及びドレイン電極 46により T F T 1 0が構成される。 端子領域 3においては、ゲ一ト絶縁膜 4 0の上にデータバスライン 7の端部が配置されている。 データバスライン 7は、 画像表示領域 2 内に形成されたドレイン電極 4 6と同一の積層構造を有する。 なお、 デ一夕バスライン 7の下に、活性領域 4 1と同時に形成されるァモル ファス S i膜が残る。 T F T 1 0、 及びデータバスライン 7を覆うよ うに、 ゲート絶縁膜 4 0の上に絶縁膜 4 8が形成されている。 絶縁膜 4 8は、 厚さ 3 3 0 nmの S i N膜である。
絶縁膜 4 8の上に、 画素電極 1 2が形成されている。 画素電極 1 2 は、 厚さ 7 0 nmのィンジゥム錫ォキサイ ド ( I TO) 膜であり、 絶 縁膜 48を貫通するコンタクトホール 5 0を経由してソース電極 4 4に接続されている。
画素電極 1 2及び絶縁膜 4 8の上に、第 1の突起パターン 1 6が形 成されている。 第 1の突起パターン 1 6は、 フォトレジストにより形 成される。 画像表示領域 2内の最上層を配向膜 2 8が覆っている。 端子領域 3においては、絶縁膜 4 8の上にデ一夕端子 2 0が形成さ れている。 データ端子 2 0は、 画素電極 1 2と同時に成膜されパター ニングされる。 データ端子 2 0は、 絶縁膜 4 8を貫通するコンタクト ホール 2 4を経由してデータバスライン 7に接続されている。データ 端子 2 0の上面の一部を、 保護膜 2 6が覆っている。 デ一夕端子 2 0 の上面のうち、 ガラス基板 1の外周側の一部の領域は露出している。 次に、 対向基板 3 6の構成について説明する。 ガラス基板 2 7の対 向面の所定の領域上に C r等からなる遮光膜 5 2が形成されている。 遮光膜 5 2を覆うように、 ガラス基板 2 7の対向面上に I T Oからな る共通電極 5 4が形成されている。画像表示領域 2内の共通電極 5 4 の表面を、 配向膜 2 8が覆う。 端子領域 3においては、 共通電極 5 4 が露出している。
対向基板 3 6は、その周辺部において接着剤 5 6により T F T基板 3 5に固着されている。 T F T基板 3 5と対向基板 3 6との間の間隙 が、 接着剤 5 6により封止されている。 T F T基板 3 5と対向基板 3 6との間の間隙内に、 液晶材料 2 9が充填されている。 液晶材料 2 9 は、 負の誘電率異方性を有する。 接着剤 5 6は、 保護膜 2 6よりも内 側の領域において T F T基板 3 5に固着される。 なお、 接着剤 5 6が 保護膜 2 6に接触するような配置としてもよい。
次に、 T F T基板 3 5と対向基板 3 6との貼り合わせ方法について 説明する。 対向基板 3 6を T F T基板 3 5に固着させる際には、 基板 法線方向から見たとき、対向基板 3 6の縁が T F T基板 3 5の対応す る縁にほぼ重なるように配置する。 固着後、 対向基板 3 6の周辺部分 3 6 aを切り落とす。
基板法線方向から見たとき、周辺部分 3 6 aを切り落とした後の対 向基板 3 6の緣は、 保護膜 2 6の内部を通過する。 このため、 対向基 板 3 6をスクライブする際に、 T F T基板 3 5側のデータ端子 2 0に キズ等が発生することを抑制できる。 これにより、 データ端子 2 0の 導通不良の発生を抑制し、 歩留りの向上を図ることが可能になる。 ま た、共通電極 5 4の切り屑等に起因するデータ端子 2 0同士の短絡を 防止することができる。
次に、 図 4 A〜図 4 Fを参照して、 図 3に示す T F T基板 3 5の作 製方法を説明する。
図 4 Aに示す状態までの工程を説明する。ガラス基板 1の表面上に、 厚さ 1 0 O nmの A 1膜と厚さ 5 O nmの T i膜とを順番に形成す る。 これらの膜の形成は、 スパッタリングにより行うことができる。 フォ トリソグラフィ技術を用い、 A 1膜と T i膜との 2層をパター二 ングし、ゲートバスライン 5を残す。 A 1膜と T i膜のエッチングは、 B C 13と C 1 2との混合ガスを用いた反応性イオンエッチング (R I E) により行う。
図 4 Bに示す状態までの工程を説明する。ゲートバスライン 5を覆 うように、 ガラス基板 1の上に S i Nからなる厚さ 40 0 nmのゲー ト絶緣膜 40を形成する。ゲ一ト絶縁膜 40の上に厚さ 3 0 nmのノ ンド一プアモルファス S i膜 4 1 aを形成する。ゲート絶緣膜 40及 びアモルファス S i膜 4 1 aの形成は、例えばプラズマ励起型化学気 相成長 (P E— CVD) により行う。
アモルファス S i膜 4 1 aの上に、 厚さ 1 40 nmの S i N膜を、 P E— C VDにより形成する。 この S i N膜をフォ トリソグラフィ技 術を用いてパターニングし、 チャネル保護膜 42を残す。 ゲートバス ライン 5をフォ トマスクとして用い、 ガラス基板 1の背面から露光す ることにより、 レジストパターンの、 図 1の行方向に平行な縁を画定 することができる。 図 1の列方向に平行な縁は、 通常のフォ トマスク を用いて露光することにより画定する。 S i N膜のエッチングは、 緩 衝弗酸系のエッチヤントを用いたゥエツ トエッチング、 またはフッ素 系ガスを用いた R I Eにより行うことができる。
図 4 Cに示す状態までの工程を説明する。チャネル保護膜 42を覆 うように、 基板の全面上に P E— CVDにより、 厚さ 30 nmの n + 型アモルファス S i膜を形成する。 この n+型アモルファス S i膜の 上に、 スパッタリングにより厚さ 2 O nmの T i膜、 厚さ 7 5 nmの A 1膜、 及び厚さ 8 0 nmの T i膜を順番に形成する。 この最上層の T i膜からノンドープアモルファス S i膜 4 1 aまでをパ夕一ニン グする。 これらの膜のエッチングは、 B C 1 3と C 1 2との混合ガス を用いた R I Eにより行う。 このとき、 ゲ一トバスライン 5の上方の 領域においては、チャネル保護膜 4 2がエッチング停止層として機能 する。
ゲート絶縁膜 4 0の上に、 ゲートバスライン 5を跨ぐように、 ノン ド一プアモルファス S iからなる活性領域 4 1が残る。 また、 活性領 域 4 1の上面の、 保護膜 4 2の両側の領域上に、 それぞれソース電極 4 4及びドレイン電極 4 6が残る。 端子領域上には、 データバスライ ン 7が残る。
図 4 Dに示す状態までの工程を説明する。 基板の全面上に、 P E— C V Dにより S i Nからなる厚さ 3 3 0 n mの絶縁膜 4 8を形成す る。 絶緣膜 4 8に、 ソース電極 4 4の上面の一部を露出させるコン夕 クトホール 5 0を形成する。 同時に、 データバスライン 7の端部近傍 の上面の一部を露出させるコンタクトホール 2 4を形成する。
図 4 Eに示す状態までの工程を説明する。 基板の全面上に、 厚さ 7 0 n mの I T O膜を形成する。 I T O膜の形成は、 例えば D Cマグネ トロンスパッタリングにより行う。 この I T O膜をパターニングし、 画素電極 1 2及びデータ端子 2 0を残す。 I T O膜のエッチングは、 しゅう酸系のエツチャントを用いたウエットエッチングにより行う。 図 4 Fに示す状態までの工程を説明する。基板の全面上にレジスト 膜を形成し、 このレジスト膜をパターニングする。 これにより、 画像 表示領域上に第 1の突起パターン 1 6を残し、端子領域上に保護膜 2 6を残す。 次に、 画像表示領域上に配向膜 2 8を形成する。
上記第 1の実施例による方法では、 図 4 Fに示す工程において、 保 護膜 2 6の形成を、 第 1の突起パターン 1 6の形成と同時に行う。 こ のため、工程数の増加を伴うことなく保護膜 2 6を形成することがで きる。
また、 保護膜 2 6を用いて、 製品種別、 製品番号、 もしくはロット 番号等の識別標識を形成することも可能である。 例えば、 画像表示領 域以外の領域に、 文字、 バーコード、 モザイク状の 2次元バーコ一ド 等を形成することができる。 次に、 第 2の実施例による液晶表示装置の製造方法について、 第 1 の実施例による製造方法との相違点に着目して説明する。
図 4 Aに示す工程において、 ゲ一卜バスライン 5を N dを 2モル% 含有する A 1 N d合金で形成する。第 1の実施例で用いた A 1 と T i との積層構造とする場合に比べて、配線抵抗を低減することができる。 図 4 Cに示す工程においで、 ソース電極 4 4、 ドレイン電極 4 6 、 及びデ一夕バスライン 7を、 厚さ 3 O n mの n +型アモルファスシリ コン膜、 厚さ 2 O n mの T i膜、 及び厚さ 3 0 O n mの A 1膜の 3層 構造とする。第 1の実施例のように、 n +型アモルファスシリコン膜、 T i膜、 A 1膜、 T i膜の 4層構造とする場合に比べて、 A 1膜を厚 くすることができる。 このため、 データバスライン 7の配線抵抗を低 減することができる。 なお、 R I Eにより厚い A 1膜をエッチングす ると、 レジスト焦げ等が発生する場合がある。 このような場合には、 A 1膜をウエッ トエッチングすることが好ましい。
第 2の実施例では、 ソース電極 4 4の最上層が A 1膜であるため、 I T O膜と良好な電気的接続を得ることができない。 このため、 以下 の工程は、 第 1の実施例の場合と異なる。
図 5 Aに示すように、基板の全面上に S i Nからなる厚さ 3 3 0 η mの絶緣膜 4 8を形成する。 なお、 後にテ一パ形状のコンタク トホ一 ルを形成するために、上層部分のエッチング速度が下層部分のエッチ ング速度よりも速くなるような条件で成膜することが好ましい。
絶縁膜 4 8の上に I T O膜を形成し、 この I T〇膜をパターニング して、 画素電極 1 2及びデータ端子の外部接続部 2 0 aを残す。
図 5 Bに示すように、 絶緣膜 4 8に、 ソース電極 4 4の上面の一部 を露出させるコンタク トホール 5 0、 及びデ一夕バスライン 7の上面 の一部を露出させるコンタク トホール 2 4を形成する。基板の全面上 に、 厚さ 2 O n mの T i膜を形成し、 その上にフォ トレジスト膜を形 成する。フォ トレジスト膜をパターニングし、 レジストパターン 6 0 、 6 1、 及び 6 2を残す。 レジストパターン 6 0は、図 1の第 1の突起パターン 1 6に整合し たパターンを有する。 図 1では、 1本の第 1の突起パターン 1 6が複 数の画素電極 1 2の上を通過している。 しかし、 第 2の実施例の場合 には、相互に隣り合う画素電極 1 2同士がレジストパターン 6 0を経 由して接続されないように、隣接する 2つの画素電極 1 2の間の領域 においてレジストパターン 6 0を分断させる。
レジストパターン 6 1は、 コンタク トホール 5 0の上方の領域から 画素電極 1 2の端部までを連続的に覆う。 レジストパターン 6 2は、 コンタクトホール 2 4の上方の領域から外部接続部 2 0 aの上方の —部の領域までを連続的に覆う。
これらのレジストパターン 6 0 、 6 1、 及び 6 2をマスクとして、 その下の T i膜をエッチングする。 レジストパターン 6 0と、 その下 に残った T i膜 6 5により第 1の突起パターン 1 6が形成される。 レ ジストパターン 6 1の下に残った T i膜 6 6により、画素電極 1 2が ソース電極 4 4に電気的に接続される。 レジス卜パターン 6 2の下に 残った T i膜 6 7により、外部接続部 2 0 aがデータバスライン 7に 電気的に接続される。 T i膜 6 7からなる内部接続部 2 0 bと、 外部 接続部 2 0 aとにより、 データ端子 2 0が構成される。 画像表示領域 上を配向膜 2 8で覆う。
第 2の実施例における第 1の突起パターン 1 6は、その下層部分に 導電性の T i膜 6 5を有する。 しかし、 相互に隣接する画素電極 1 2 の間で第 1の突起パターン 1 6が分断されているため、画素電極 1 2 同士の短絡が生ずることはない。
第 2の実施例では、 I T Oからなる画素電極 1 2がソース電極 4 4 の最上層の A 1膜に直接接触せず、 T i膜 6 6を介して接続される。 このため、 両者間の良好な電気的接続を確保することができる。
また、データ端子 2 0の内部接続部 2 0 bを覆うレジストパターン 6 2が、図 3に示す第 1の実施例の保護膜 2 6と同様の機能を果たす。 このため、対向基板の周辺部分を切り落とす際にデータ端子 2 0が保 護され、 デ一夕端子 2 0の導通不良の発生を抑制することができる。 また、第 1の実施例の場合と同様に、レジストパターン 6 2を用いて、 製品種別、 製品番号、 もしくはロッ ト番号等の識別標識を形成するこ とも可能である。
以上実施例に沿って本発明を説明したが、本発明はこれらに制限さ れるものではない。 例えば、 種々の変更、 改良、 組み合わせ等が可能 なことは当業者に自明であろう。

Claims

請求の範囲
1 . 主表面内に画像表示領域が画定され、 その外側の一部に端子領 域が画定された第 1の基板と、
前記第 1の基板の主表面内の前記画像表示領域上に配置された複 数本の第 1のバスラインと、
前記第 1のバスラインを覆うように、前記第 1の基板の主表面上に 配置された第 1の絶緣膜と、
前記第 1のバスラインの各々に対応して前記第 1の基板の端子領 域上に設けられ、前記第 1の絶緣膜を貫通して前記第 1のバスライン の上面まで達する第 1のコンタクトホールを経由し、対応する前記第 1のバスラインに電気的に接続された外部端子と、
前記外部端子の上面のうち少なくとも前記第 1の基板の外周側の 端部近傍の領域を被覆しないように、前記外部端子の上面の一部を被 覆する絶縁材料からなる保護膜と
を有する液晶表示装置用基板。
2 . さらに、
前記画像表示領域上に、前記第 1のバスラインと交差するように形 成された複数の第 2のバスラインと、
前記画像表示領域上に、前記第 1のバスラインと第 2のバスライン との交差箇所の各々に対応して配置された画素電極と、
前記画素電極の各々を、対応する第 1及び第 2のバスラインのうち 一方のバスラインに接続し、他方のバスラインに印加される信号によ つて導通状態を制御されるスィツチング素子と
を有する請求項 1に記載の液晶表示装置用基板。
3 . 前記スイッチング素子が、 前記第 1の絶縁膜で覆われており、 前記画素電極が、 前記第 1の絶縁膜上に配置され、 該第 1の絶縁膜 に形成された第 2のコンタクトホールを経由して前記スィツチング 素子に接続されており、
前記外部端子と前記画素電極とが同一材料で形成されている請求 項 2に記載の液晶表示装置用基板。
4 . さらに、 前記画素電極の上に配置され、 前記保護膜と同一材料 で形成された土手状の突起パターンを有する請求項 2に記載の液晶 表示装置用基板。
5 . さらに、 前記画素電極の上に配置され、 前記保護膜と同一材料 で形成された土手状の突起パターンを有する請求項 3に記載の液晶 表示装置用基板。
6 . 前記スイッチング素子が、 前記第 1の絶縁膜で覆われており、 さらに、
前記画素電極の各々と、 対応する前記スイッチング素子とを、 前記 第 1の絶縁膜に設けられた第 2のコンタクトホールを経由して電気 的に接続する画素接.続配線と、
前記画素接続配線の上面を覆う被覆膜と
を有し、
前記外部端子が、 前記端子領域上に配置された外部接続部と、 該外 部接続部を前記第 1のバスラインに電気的に接続する内部接続部と を含み、
前記保護膜が前記内部接続部の上面を被覆している請求項 2に記 載の液晶表示装置用基板。
7 . 前記画素接続配線と前記内部接続部とが同一材料で形成され、 前記画素電極と前記外部接続部とが同一材料で形成され、
前記保護膜と前記被覆膜とが同一材料で形成されている請求項 6 に記載の液晶表示装置用基板。
8 . さらに、 前記画素電極の上に配置され、 前記画素接続配線と同 一材料で形成された下層と、前記被覆膜と同一材料で形成された上層 との積層構造とされた土手状の突起パターンを有する請求項 6に記 載の液晶表示装置用基板。
9 . さらに、 前記画素電極の上に配置され、 前記画素接続配線と同 一材料で形成された下層と、前記被覆膜と同一材料で形成された上層 との積層構造とされた土手状の突起パターンを有する請求項 7に記 載の液晶表示装置用基板。
1 0 . 主表面内に画像表示領域が画定され、 その外側の一部に端子領 域が画定された第 1の基板と、
前記第 1の基板の主表面内の前記画像表示領域上に配置された複 数本の第 1のバスラインと、
前記第 1のバスラインを覆うように、前記第 1の基板の主表面上に 配置された第 1の絶縁膜と、
前記第 1のバスラインの各々に対応して前記第 1の基板の端子領 域上に設けられ、前記第 1の絶縁膜を貫通して前記第 1のバスライン の上面まで達する第 1のコンタクトホールを経由し、対応する前記第 1のバスラインに電気的に接続された外部端子と、
前記外部端子の上面のうち少なくとも前記第 1の基板の外周側の 端部近傍の領域を被覆しないように、前記外部端子の上面の一部を被 覆する絶縁材料からなる保護膜と、
前記第 1の基板の主表面に対向し、該主表面からある間隔を隔てて 配置され、前記第 1の基板に対向する面上に共通電極が形成された第 2の基板であって、 該第 2の基板をその法線方向から見たとき、 該第 2の基板の縁の一部が前記保護膜内を通過するように配置されてい る第 2の基板と、
前記第 2の基板を、その周辺部において前記第 1の基板に固着させ、 該第 1の基板と第 2の基板との間の間隙をその外周において封止す る封止部材と、
前記第 1の基板と第 2の基板との間の間隙内に充填された液晶材 料と
を有する液晶表示装置。
1 1 . 第 1の基板を準備する工程であって、 該第 1の基板の主表面 内に画像表示領域が画定され、その外側の一部に端子領域が画定され ており、該画像表示領域上に配置された複数本の第 1のバスラインと、 該第 1のバスラインを覆うように、前記第 1の基板の主表面上に配置 された第 1の絶緣膜と、前記第 1のバスラインの各々に対応して前記 第 1の基板の端子領域上に設けられ、前記第 1の絶縁膜を貫通して前 記第 1のバスラインの上面まで達する第 1のコンタクトホールを経 由し、対応する前記第 1のバスラインに電気的に接続された外部端子 と、前記外部端子の上面のうち少なくとも前記第 1の基板の外周側の 端部近傍の領域を被覆しないように、前記外部端子の上面の一部を被 覆する絶縁材料からなる保護膜と、 前記画像表示領域上に、 前記第 1 のバスラインと交差するように形成された複数の第 2のバスライン と、 前記画像表示領域上に、 前記第 1のバスラインと第 2のバスライ ンとの交差箇所の各々に対応して配置された画素電極と、前記画素電 極の各々を、対応する第 1及び第 2のバスラインのうち一方のバスラ ィンに接続し、他方のバスラインに印加される信号によって導通状態 を制御されるスィツチング素子とが形成された前記第 1の基板を準 備する工程と、
表面上に共通電極が形成された第 2の基板を準備する工程と、 前記第 1の基板の主表面に前記第 2の基板の共通電極が形成され た面がある間隔を隔てて対向するように、前記第 1の基板と第 2の基 板とを配置し、 前記保護膜の上面のうち、 少なくとも前記第 1の基板 の外周側の一部の領域を封止部材が被覆しないように、前記第 1の基 板と第 2の基板とを該封止部材で固着させる工程と、
前記第 2の基板の緣近傍の部分を切り落とす工程であって、切り落 とされた後の第 2の基板の新たな緣が、前記第 1の基板の法線方向か ら見たとき、 前記保護膜の内部を通過するように切り落とす工程と を有する液晶表示装置の製造方法。
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