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TWI871815B - 控制顯示面板的方法及其控制電路 - Google Patents

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TWI871815B
TWI871815B TW112141277A TW112141277A TWI871815B TW I871815 B TWI871815 B TW I871815B TW 112141277 A TW112141277 A TW 112141277A TW 112141277 A TW112141277 A TW 112141277A TW I871815 B TWI871815 B TW I871815B
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Abstract

一種用於一控制電路之方法，用來控制一顯示面板，該方法包含有下列步驟：判斷在一預定時間內是否接收到一輸入視訊資料；當判斷在該預定時間內接收到一輸入視訊資料時，輸出一輸出視訊資料及具有一第一頻率的一時脈訊號至該顯示面板；以及當判斷在該預定時間內未接收到任何輸入視訊資料時，停止輸出該輸出視訊資料，而輸出具有一第二頻率的該時脈訊號至該顯示面板。其中，該第二頻率高於該第一頻率。

Description

控制顯示面板的方法及其控制電路
本發明係指一種控制顯示面板的方法及其相關的控制電路，尤指一種透過顯示埠(Display Port，DP)介面或嵌入式顯示埠(embedded DP，eDP)介面接收輸入視訊資料，以控制發光二極體(Light-Emitting Diode，LED)面板的方法，以及其相關的控制電路。
不同於主流的行動產業處理器介面(Mobile Industry Processor Interface，MIPI)，在嵌入式顯示埠(embedded Display Port，eDP)介面或顯示埠(Display Port，DP)介面(下文簡稱為eDP/DP介面)的協定中不存在垂直同步訊號(vertical synchronization signal)。因此，在前一幀的資料完全傳送之後，視訊提供單元可在任意時間點開始傳送下一幀的資料至顯示驅動電路，因此，基於視訊資料的接收，顯示驅動電路應在任何時間點和視訊提供單元同步。
在習知液晶顯示(Liquid Crystal Display，LCD)面板上，由於背光係持續開啟，因此，當透過eDP/DP介面到達的視訊資料為不規則的情形下，顯示驅動電路可對應地延遲視訊資料，接著在一預定的時間點上透過視訊資料來刷新面板，使得視訊資料能夠良好同步，並且不受到eDP/DP介面上的不規則傳輸影響。
對於有機發光二極體(Organic Light-Emitting Diode，OLED)面板而言，發光係利用畫素中的有機發光二極體產生而不是背光模組，其中，有機發光二極體的發光受控於發光脈衝訊號，且亮度係根據發光脈衝訊號的責任週期來決定。然而，當採用eDP/DP介面來傳輸視訊資料時，顯示驅動電路應配備有足夠的列緩衝器或幀緩衝器(如靜態隨機存取記憶體(Static Random Access Memory，SRAM))來暫存視訊資料，以在視訊資料刷新面板時維持準確的發光責任週期。
因此，當有機發光二極體面板採用eDP/DP介面來進行視訊資料傳輸時，其需要設置足夠的列緩衝器或幀緩衝器，以滿足上述控制需求，所需的列/幀緩衝器往往佔據大量面積，因而造成電路成本的增加。
因此，本發明之主要目的即在於提出一種控制發光二極體(Light-Emitting Diode，LED)面板的方法，以解決上述問題。
本發明之一實施例揭露一種用於一控制電路之方法，用來控制一顯示面板。該方法包含有下列步驟：判斷在一預定時間內是否接收到一輸入視訊資料；當判斷在該預定時間內接收到一輸入視訊資料時，輸出一輸出視訊資料及具有一第一頻率的一時脈訊號至該顯示面板；以及當判斷在該預定時間內未接收到任何輸入視訊資料時，停止輸出該輸出視訊資料，而輸出具有一第二頻率的該時脈訊號至該顯示面板。其中，該第二頻率高於該第一頻率。
本發明之另一實施例揭露一種控制電路，用來控制一顯示面板。該控制電路包含有一偵測電路、一資料輸出驅動器及一發光控制電路。該偵測電路用來判斷在一預定時間內是否接收到一輸入視訊資料。該資料輸出驅動器耦接於該偵測電路，用來在該偵測電路判斷在該預定時間內接收到一輸入視訊資料時輸出一輸出視訊資料至該顯示面板，並且在該偵測電路判斷在該預定時間內未接收到任何輸入視訊資料時停止輸出該輸出視訊資料。該發光控制電路耦接於該偵測電路，用來在該偵測電路判斷在該預定時間內接收到一輸入視訊資料時輸出具有一第一頻率的一時脈訊號至該顯示面板，並且在該偵測電路判斷在該預定時間內未接收到任何輸入視訊資料時輸出具有一第二頻率的該時脈訊號至該顯示面板。其中，該第二頻率高於該第一頻率。
本發明之另一實施例揭露一種用於一控制電路之方法，用來控制一顯示面板。該方法包含有下列步驟：接收一第一幀視訊資料；輸出該第一幀視訊資料與具有一第一責任週期的一發光脈衝訊號至該顯示面板；當該第一幀視訊資料完全接收之後，判斷在一預定時間內是否接收到一第二幀視訊資料；以及當判斷在該預定時間內未接收到該第二幀視訊資料時，輸出具有該第一責任週期的該發光脈衝訊號至該顯示面板而不輸出任何視訊資料。
本發明之另一實施例揭露一種控制電路，用來控制一顯示面板。該控制電路包含有一偵測電路、一資料輸出驅動器及一發光控制電路。該偵測電路用來接收一第一幀視訊資料，並且在該第一幀視訊資料完全接收之後，判斷在一預定時間內是否接收到一第二幀視訊資料。該資料輸出驅動器耦接於該偵測電路，用來輸出該第一幀視訊資料至該顯示面板。該發光控制電路耦接於該偵測電路，用來輸出具有一第一責任週期的一發光脈衝訊號至該顯示面板。其 中，當該偵測電路判斷在該預定時間內未接收到該第二幀視訊資料時，該發光控制電路另用來輸出具有該第一責任週期的該發光脈衝訊號，且該資料輸出驅動器不輸出任何視訊資料。
BS:空白起始訊號
BE:空白結束訊號
20:顯示系統
200:主機
202:顯示驅動電路
204:顯示面板
212:偵測電路
214:發光控制電路
216:資料輸出驅動器
218:閘極控制電路
220:時序控制器
230:列緩衝器
F1,F2,F3,F4:幀
Vsync:垂直同步訊號
Hsync:水平同步訊號
GOA:閘極控制訊號
MUX1~MUX3:多工控制訊號
VOUT:輸出視訊資料
EM_CLK:發光控制時脈
EM_STV:發光脈衝訊號
60:流程
600~608:步驟
第1圖為eDP/DP介面的典型封包格式之示意圖。
第2圖為本發明實施例一顯示系統之示意圖。
第3A及3B圖為顯示驅動電路的操作之時序圖。
第4A及4B圖為本發明實施例顯示驅動電路的操作之時序圖。
第5A及5B圖為本發明實施例顯示驅動電路在正常掃描模式及快速掃描模式下的詳細實施方式之波形圖。
第6圖為本發明實施例一流程之流程圖。
第7A及7B圖為本發明實施例顯示驅動電路的操作之時序圖。
第1圖為嵌入式顯示埠(embedded Display Port，eDB)介面或顯示埠(Display Port，DP)介面(eDP/DP介面)的典型封包格式之示意圖。如第1圖所示，eDP/DP封包的時序係利用空白起始(Blanking Start，BS)訊號及空白結束(Blanking End，BE)訊號來定義。每一空白起始訊號用來指示一列時間，而部分較前面的列時間為空白列，其可以空著不用或用來發送指令，這些列時間可定義為廊(porch)。在廊期間內僅傳送空白起始訊號和部分指令，但不傳送空白結束訊號。視訊資料則是在廊期間結束之後傳送。在資料傳輸期間內，每一列時間係由一空白起始訊號起始，隨後是一空白結束訊號，接著再傳送一列視 訊資料。當一幀視訊資料傳送完畢之後，代表整段傳輸期間結束。
在行動產業處理器介面(Mobile Industry Processor Interface，MIPI)中，時序係藉由垂直同步訊號(vertical synchronization signal)及水平同步訊號(horizontal synchronization signal)的傳送來定義，因此顯示驅動電路容易得知每一幀資料的起始和結束。相較之下，在eDP/DP封包中，時序僅利用空白起始訊號和空白結束訊號來定義，且顯示驅動電路可能不知道廊何時結束且視訊資料何時開始傳送。因此，當顯示驅動電路被設定用來驅動發光二極體(Light-Emitting Diode，LED)面板(如有機發光二極體(Organic LED，OLED)面板)的情況下，若幀率是可變的，eDP/DP封包內的廊期間長度亦為可變。因此，顯示驅動電路需要在視訊資料不規則到達的情形下良好地處理資料傳輸和發光控制。
第2圖為本發明實施例一顯示系統20之示意圖。顯示系統20包含有一主機200、一顯示驅動電路202及一顯示面板204。主機200可作為一視訊提供單元，用來產生視訊/影像內容並輸出視訊資料至顯示驅動電路202。主機200可以是一系統晶片(System on Chip，SoC)或任何其它類型的主處理電路，其設置有作業系統(如安卓(Android))用以安裝各種應用程式，但不限於此。顯示面板204可以是一有機發光二極體面板、迷你發光二極體(mini-LED)面板、微型發光二極體(micro-LED)面板，諸如此類，其係利用畫素內所包含的發光元件來進行發光。
顯示驅動電路202包含有一偵測電路212、一發光控制電路214、一資料輸出驅動器216、一閘極控制電路218、一時序控制器220、及一或多個列緩衝 器230。偵測電路212用來偵測並判斷在一預定時間內是否接收到任何視訊資料。在一實施例中，偵測電路212可包含一接收器或透過一接收器來實現，此接收器可以是eDP/DP接收器，用來接收來自於主機200並透過eDP/DP介面傳送的輸入視訊資料。發光控制電路214用來輸出發光控制訊號，如發光脈衝訊號及發光控制時脈，這些發光控制訊號可傳送至顯示面板204上的閘極驅動陣列(Gate-on-Array，GOA)電路(未繪示)，用以實現發光控制。閘極控制電路218用來輸出閘極控制訊號，如閘極脈衝訊號及閘極控制時脈，這些閘極控制訊號亦可傳送至閘極驅動陣列電路。資料輸出驅動器216亦稱為源極驅動器，可用來輸出視訊資料電壓至顯示面板204上的目標畫素。時序控制器220用來根據輸入視訊資料的接收，控制發光/閘極控制訊號及資料電壓的輸出時序。列緩衝器230可在視訊資料被輸出之前，用來儲存所接收的視訊資料。顯示驅動電路202可實現於晶片中的積體電路(Integrated Circuit，IC)，亦稱為顯示驅動積體電路(Display Driver IC，DDIC)。
第3A及3B圖為顯示驅動電路202的操作之時序圖，其繪示輸入視訊資料、一垂直同步訊號Vsync、及視訊資料的輸出時序。顯示驅動電路202可從主機200接收視訊資料的一系列幀(F1、F2、F3…等)，並輸出視訊資料以刷新顯示面板204。所接收的視訊資料幀需遵循eDP/DP介面的封包格式，如第1圖所示的eDP/DP封包。
垂直同步訊號Vsync包含有複數個脈衝，其中每一脈衝指示一輸出幀期間的起始，輸出幀期間係用來輸出一幀視訊資料的期間。需注意的是，eDP/DP介面未攜帶同步訊號，而此處的垂直同步訊號Vsync為顯示驅動電路202根據輸入視訊資料產生的內部訊號。在一實施例中，時序控制器220被設定用來產生垂 直同步訊號Vsync，用來定義內部時序，以控制發光/閘極控制訊號及資料電壓在適合的時間輸出。輸出幀期間係由一垂直後廊(Vertical Back Porch，VBP)、一資料輸出期間、及一垂直前廊(Vertical Front Porch，VFP)所組成，其中，顯示驅動電路202係在資料輸出期間內輸出視訊資料，以對顯示面板204進行刷新。
幀F1內存在100條沒有視訊資料傳送的空白列，其後是一幀視訊資料。顯示驅動電路202可偵測這些空白列中是否攜帶任何指令。接著，當顯示驅動電路202偵測到一空白起始訊號及其相對應的空白結束訊號時，可得知視訊資料即將到達，並開始接收視訊資料。此時，時序控制器220可產生垂直同步訊號Vsync之一脈衝，用以指示一幀期間的起始。發光控制電路214、資料輸出驅動器216及閘極控制電路218的操作需遵循垂直同步訊號Vsync所定義的區間時序。需注意的是，顯示驅動電路202需花費一段處理時間來產生垂直同步訊號Vsync並配置垂直後廊。因此，在垂直同步訊號Vsync之前接收的部分視訊資料可先存入列緩衝器230。接下來，顯示驅動電路202可在資料輸出期間起始的時間點，開始對顯示面板204進行刷新。
在此例中，假設每一幀包含有2000列的視訊資料。在資料輸出期間內，顯示驅動電路202可根據先進先出(first-in-first-out)的原則，從列緩衝器230輸出視訊資料，並將新接收的視訊資料寫入列緩衝器230。
當幀F1的2000列視訊資料完全接收之後，顯示驅動電路202可開始接收第二幀F2，其包含有90條空白列以及2000條資料列。此時，輸出幀期間在幀F1的視訊資料輸出完畢之後進入垂直前廊。然而，直到顯示驅動電路202接收到 指示視訊資料到達的空白結束訊號之前，顯示驅動電路202皆無法知道第二幀F2內空白列的總數。而發光控制應根據當前的視訊幀。更明確來說，用來輸出F1的幀資料之輸出幀期間可被決定為等於2100個列時間，其為幀F1內的100條空白列與2000條資料列的總和。假設發光責任週期為20%，則用於幀F1的輸出幀期間之發光脈衝寬度等於420個列時間，如第3A圖所示。
由於第二幀F2內存在90條空白列，其數量少於第一幀F1的100條空白列。因此，在開始接收幀F2的視訊資料之後，用於第二幀F2的輸出幀期間(如垂直同步訊號Vsync的脈衝所指示)需要延遲10個列時間，以因應減少的空白列數量。在此情況下，相較於前一幀(即F1)於列緩衝器230暫存的列資料數量而言，存在多10列資料存入列緩衝器230。
同樣地，用於幀F2的輸出幀期間長度係根據幀F2的空白列與資料列的總和來決定，其等於2090個列時間。為了維持亮度恆定，發光責任週期仍為20%，而此輸出幀期間的發光脈衝寬度將等於418個列時間。
接著，顯示驅動電路202開始接收第三幀F3，其包含有110條空白列，其數量多於第二幀F2的90條空白列。因此，在開始接收幀F3的視訊資料之後，用於第三幀F3的輸出幀期間(如垂直同步訊號Vsync的脈衝所指示)係以對應於幀F3的視訊資料到達之較小的延遲起始。在此情況下，存在較少的列資料被存入列緩衝器230(相較於前一幀(即F2)於列緩衝器230暫存的列資料數量而言少了20列資料)。
同樣地，用於幀F3的輸出幀期間長度係根據幀F3的空白列與資料列 的總和來決定，其等於2110個列時間。為了維持亮度恆定，發光責任週期仍為20%，而此輸出幀期間的發光脈衝寬度將等於422個列時間。
基於上述控制方法，在可變幀率之下，顯示驅動電路202可處理顯示面板204的刷新並良好控制發光責任週期恆定，其需在輸入視訊資料傳送至顯示面板204之前，先利用部分列緩衝器230來進行暫存。然而，由於幀率的不固定，下一幀視訊資料的到達時間通常難以預測。若延遲時間的變化超出一容許值，使得視訊資料無法及時到達以順利產生輸出視訊資料，則顯示驅動電路202無法將新的視訊資料存入列緩衝器230，因而需要透過舊的視訊資料或其它可利用的資料來刷新顯示面板204，導致顯示畫面異常。為解決此問題，習知的方式採用能夠儲存更多列資料之較大的列緩衝器或甚至幀緩衝器，但較大的記憶體空間往往伴隨著較大的面積和較高的成本。從另一個角度來看，設置的列/幀緩衝器之記憶體空間是有限的，除非所分配的記憶體空間到達極大容量，否則變化幅度極大的到達時間仍難以利用列/幀緩衝器良好地進行處理。
本發明提出了一種無須使用大量記憶體空間的新式控制方法，其可在輸入視訊的到達時間具有大幅度變化的情況下，能夠良好控制發光責任週期以降低所顯示畫面上產生的副作用。在一實施例中，當前一幀的視訊資料完全接收之後，顯示驅動電路202的偵測電路212可判斷一預定時間內是否接收到下一幀視訊資料。若下一幀視訊資料係在該預定時間點上或之前被接收，即此幀資料的延遲時間可透過現有的列緩衝器230來進行處理，代表第3A及3B圖中的時序方案是可行的。反之，若下一幀視訊資料無法在預定時間被接收，表示此視訊資料之延遲時間過大，使得顯示驅動電路202無法及時輸出新接收到的視訊資料來刷新顯示面板204。
第4A及4B圖為本發明實施例顯示驅動電路202的操作之時序圖。類似於第3A及3B圖，第4A及4B圖同樣繪示依據eDP/DP資料格式配置的一系列輸入幀、垂直同步訊號Vsync、及視訊資料的輸出時序。在此例中，幀F1內的空白列數量為100，且顯示驅動電路202所包含的列緩衝器230之儲存容量允許最多例如130條空白列的接收。接著，幀F1內的視訊資料順利被接收，隨後在相對應的輸出幀期間進行輸出。當幀F1的最後一列視訊資料被接收之後，偵測電路212可計算列時間，直到接收到下一幀輸入視訊資料(即F2)為止。更明確來說，偵測電路212可計算列時間以在對應於130條空白列的一預定時間點判斷是否接收到輸入視訊資料。
在此例中，一空白起始訊號係在每一個列時間的開始傳送，因此偵測電路212可計算接收到最後一列視訊資料之後的空白起始訊號之數量。
在一實施例中，若顯示驅動電路202正常運作，根據先進先出的原理，輸入視訊資料及時寫入列緩衝器230，且輸出視訊資料從列緩衝器230輸出，顯示驅動電路202可視為操作在一正常掃描模式。在正常掃描模式下，垂直同步訊號Vsync可用來定義用以輸出一幀視訊資料的一輸出幀期間。若偵測電路212判斷當計算出的列時間超過一臨界值(如130)之後但未接收到任何輸入視訊資料時，顯示驅動電路202可進入一快速掃描模式。在快速掃描模式下，資料輸出驅動器216可停止輸出視訊資料，即停止刷新顯示面板204。對應地，閘極控制電路218可停止輸出閘極控制訊號至顯示面板204。
在快速掃描模式之下，為了維持亮度恆定，發光控制電路214仍可輸 出和先前的正常掃描模式具有相同責任週期的發光脈衝訊號。雖然資料輸出驅動器216停止輸出視訊資料，但資料電壓仍可保留在相對應畫素的儲存電容一段幀期間，僅存在容許範圍的漏電。因此，延遲刷新對畫面顯示所造成的影響可達到最小。
舉例來說，如第4A及4B圖所示，在幀F1的視訊資料完全接收之後，當偵測電路212判斷計算出的空白列數量超過一臨界值而未接收到任何視訊資料的情況下，顯示驅動電路202可在用於幀F1的輸出幀期間結束之後進入快速掃描模式。在快速掃描模式下，時序控制器220所產生的垂直同步訊號Vsync之每一脈衝可定義一快速掃描期間，快速掃描期間的長度短於輸出幀期間的長度。 快速掃描期間的長度可預先決定，其適合的數值可根據顯示面板204的操作速度來決定。舉例來說，可決定快速掃描期間的長度等於輸出幀期間長度的1/10、1/25或1/100。基於快速掃描期間，發光控制時脈可具有(相較於正常掃描模式下)較高頻率，且發光脈衝訊號的責任週期相同於其在正常掃描模式下的最後一個輸出幀期間的責任週期。
若持續接收到空白列的情況下，顯示驅動電路202處於快速掃描模式，直到得知下一幀視訊資料到達為止。在此例中，當顯示驅動電路202接收到用來指示幀F2的視訊資料到達的一空白結束訊號之後，即可準備進入正常掃描模式並重新開始刷新顯示面板204。更明確來說，當偵測電路212偵測到新的視訊資料到達時，顯示驅動電路202完成最後一個快速掃描期間，或者另分配額外的快速掃描期間以確保列緩衝器230儲存足夠的視訊資料，接著再進入正常掃描模式。在正常掃描模式下，垂直同步訊號Vsync重新開始遵循對應於輸入視訊資料的幀期間。發光脈衝訊號可維持相同的責任週期，且發光控制時脈以(相較 於快速掃描期間而言)較低的頻率輸出。顯示驅動電路202利用新接收的視訊資料重新開始刷新顯示面板204，並同時輸出相對應的閘極控制訊號。
第5A及5B圖為本發明實施例顯示驅動電路202在正常掃描模式及快速掃描模式下的詳細實施方式之波形圖。第5A及5B圖繪示一垂直同步訊號Vsync、一水平同步訊號Hsync、閘極控制訊號GOA、多工控制訊號MUX1~MUX3、輸出視訊資料VOUT、一發光控制時脈EM_CLK、及一發光脈衝訊號EM_STV之波形。垂直同步訊號Vsync及水平同步訊號Hsync用來定義正常掃描模式及快速掃描模式的時序。在正常掃描模式下，垂直同步訊號Vsync及水平同步訊號Hsync遵循輸入幀資料，分別用來定義一輸出幀期間及一列時間。在快速掃描模式下，垂直同步訊號Vsync可定義一快速掃描期間，快速掃描期間短於輸出幀期間，且水平同步訊號Hsync的期間長度亦等比例地縮短。在此情況下，垂直同步訊號Vsync之脈衝所定義的每一期間皆具有固定數量的水平同步訊號Hsync脈衝。由顯示驅動電路202輸出至顯示面板204的訊號將遵循垂直同步訊號Vsync及水平同步訊號Hsync所定義的時序。
在正常掃描模式下，顯示驅動電路202可正常刷新顯示面板204。詳細來說，閘極控制訊號GOA的輸出被啟用，一幀輸出視訊資料VOUT(分別用於紅色(R)、綠色(G)、藍色(B))一列一列輸出，且透過多工控制訊號MUX1~MUX3依序開啟顯示面板204上相對應的多工器，使得輸出視訊資料VOUT依序傳送至目標資料列。多工控制訊號MUX1~MUX3僅是用以說明多工器控制的一種示例性實施方式，事實上，顯示面板204上可能存在6個、8個或任意數量的多工器，用以耦接至面板上的數百或數千條資料列。發光控制時脈EM_CLK係依據水平同步訊號Hsync所定義的時序觸發(toggle)。需注意的是，發光控制時脈 EM_CLK可透過任意且適合的頻率輸出，其實施方式不限於第5A及5B圖所示的情況。發光脈衝訊號EM_STV具有一預定的責任週期，用以決定整體亮度。在此例中，所定義的責任週期為點亮比例等於4/N，其中，發光脈衝訊號EM_STV具有一脈衝，此脈衝的寬度等於4個列時間(在此幀的N個列時間當中)。
如第5B圖所示，在輸出幀期間的廊之後是快速掃描期間，此時顯示驅動電路202進入快速掃描模式。在快速掃描模式下，水平同步訊號Hsync的每一脈衝定義一縮短的列時間。為了維持亮度恆定，發光脈衝訊號EM_STV同樣具有一脈衝，此脈衝的寬度等於4條縮短的列時間，以實現相同的點亮比例4/N，相當於相同的責任週期。
第6圖為本發明實施例一流程60之流程圖。流程60可實現於用來控制發光二極體面板之顯示驅動電路，如第2圖中的顯示驅動電路202。如第6圖所示，流程60包含有下列步驟：步驟600：顯示驅動電路202接收一幀視訊資料，並且在正常掃描模式下輸出該幀視訊資料。
步驟602：偵測電路212判斷下一幀視訊資料是否及時被接收。若是，則執行步驟600；若否，則執行步驟604。
步驟604：在最後一個輸出幀期間結束後，顯示驅動電路202進入快速掃描模式。
步驟606：在快速掃描模式下，發光控制電路214輸出具有相同責任週期的發光脈衝訊號，並輸出具有較高頻率的發光控制時脈，且資料輸出驅動器216及閘極控制電路218停止輸出。
步驟608：偵測電路212判斷下一幀視訊資料是否到達。若是，則執 行步驟600；若否，則執行步驟606。
關於流程60之詳細操作及變化方式可參考前述段落的說明，在此不贅述。
值得注意的是，本發明之目的在於提出一種可透過eDP/DP介面接收輸入視訊資料，以控制發光二極體面板的新式方法。本領域具通常知識者當可據以進行修飾或變化，而不限於此。舉例來說，在上述實施例中，主機200係在空白間隙(blanking interval)持續輸出空白起始訊號，空白起始訊號可作為顯示驅動電路202用以計算列時間的參考。而在另一實施例中，空白間隙中不傳送空白起始訊號，而顯示驅動電路202應自行判斷下一幀資料的到達。
第7A及7B圖為本發明實施例顯示驅動電路202的操作之時序圖。在第7A及7B圖之時序圖中，位於幀F1及F2之間的空白間隙內未接收到空白起始訊號，因此，顯示驅動電路202無法藉由計算空白起始訊號的數量來判斷列時間。然而，根據顯示驅動電路202接收到的前一幀F1視訊資料及其相關的空白結束/空白起始訊號，列時間長度是已知的資訊，使得顯示驅動電路202可透過一內部時脈(如時序控制器220所產生的水平同步訊號)來計算列時間。若計算出的列時間數量超過一臨界值(其超出了基於列緩衝器230的儲存容量之容許值範圍)，顯示驅動電路202仍可進入快速掃描模式。
綜上所述，本發明提出了一種可透過eDP/DP介面接收輸入視訊資料，以控制發光二極體面板的方法，以及其相關的控制電路(如顯示驅動電路)。當輸入視訊資料正常接收時，顯示驅動電路可操作在一正常掃描模式，其中， 輸入視訊資料依序寫入列緩衝器，接著輸出視訊資料從列緩衝器輸出至顯示面板。在可變幀率之下，每一幀視訊資料的到達時間具有不同延遲。若下一幀資料未能在一預定時間內接收，顯示驅動電路可進入一快速掃描模式，其中發光控制時脈具有(相較於正常掃描模式下)較高的頻率，且發光脈衝訊號維持相同的責任週期，使亮度恆定。在一實施例中，快速掃描模式下的垂直及水平同步訊號可透過(相較於正常掃描模式下)較高的頻率觸發，以控制發光控制訊號的輸出時序。同時，視訊資料及其相關的閘極控制訊號停止輸出，因此可利用儲存於畫素中的資料電壓來保持畫面顯示。因此，顯示驅動電路僅需要少量的列緩衝器，即可在可變幀率的應用中，在不影響畫面品質的情況下良好控制發光二極體面板的發光及亮度。
以上所述僅為本發明之較佳實施例，凡依本發明申請專利範圍所做之均等變化與修飾，皆應屬本發明之涵蓋範圍。
60:流程
600~608:步驟

Claims (36)

  1. 一種用於一控制電路之方法，用來控制一顯示面板，該方法包含有：判斷在一預定時間內是否接收到一輸入視訊資料；當判斷在該預定時間內接收到一輸入視訊資料時，輸出一輸出視訊資料及具有一第一頻率的一時脈訊號至該顯示面板；以及當判斷在該預定時間內未接收到任何輸入視訊資料時，停止輸出該輸出視訊資料，而輸出具有一第二頻率的該時脈訊號至該顯示面板；其中，該第二頻率高於該第一頻率。
  2. 如請求項1所述之方法，另包含有：在用來輸出一幀視訊資料之一輸出幀期間內輸出具有一第一責任週期的一發光脈衝訊號至該顯示面板；以及當判斷在該預定時間內未接收到任何輸入視訊資料時，在該輸出幀期間之後的一時間區間內輸出具有一第二責任週期的該發光脈衝訊號至該顯示面板；其中，該第二責任週期實質上等於該第一責任週期。
  3. 如請求項1所述之方法，另包含有：當判斷在該預定時間內接收到一輸入視訊資料時，輸出一閘極控制訊號至該顯示面板；以及當判斷在該預定時間內未接收到任何輸入視訊資料時，停止輸出該閘極控制訊號至該顯示面板。
  4. 如請求項1所述之方法，其中判斷在該預定時間內是否接收到一輸入視訊資料之步驟包含有：計算接收到一最後輸入視訊資料之後的一列時間，以判斷在該預定時間內是否接收到一輸入視訊資料。
  5. 如請求項4所述之方法，其中計算接收到該最後輸入視訊資料之後的該列時間之步驟包含有：計算接收到該最後輸入視訊資料之後接收的空白起始訊號之數量。
  6. 如請求項4所述之方法，其中計算接收到該最後輸入視訊資料之後的該列時間，以判斷在該預定時間內是否接收到一輸入視訊資料之步驟包含有：當計算出的該列時間超過一臨界值之後但未接收到任何輸入視訊資料時，判斷在該預定時間內未接收到任何輸入視訊資料，該臨界值係根據一列緩衝器決定。
  7. 如請求項1所述之方法，其中當判斷在該預定時間內接收到一輸入視訊資料時，該控制電路處於一正常掃描模式，而當判斷在該預定時間內未接收到任何輸入視訊資料時，該控制電路處於一快速掃描模式，且該方法另包含有：當該控制電路處於該正常掃描模式時，根據該輸入視訊資料產生一垂直同步訊號以定義一輸出幀期間；以及當該控制電路處於該快速掃描模式時，產生該垂直同步訊號以定義一快速掃描期間； 其中，該快速掃描期間的長度短於該輸出幀期間的長度。
  8. 如請求項1所述之方法，其中該控制電路處於一快速掃描模式，且該方法另包含有：在接收到一空白結束訊號之後，進入一正常掃描模式並重新開始輸出該輸出視訊資料，該空白結束訊號指示該輸入視訊資料的到達。
  9. 如請求項1所述之方法，另包含有：透過一顯示埠(Display Port，DP)介面或一嵌入式顯示埠(embedded DP，eDP)介面接收該輸入視訊資料。
  10. 一種控制電路，用來控制一顯示面板，該控制電路包含有：一偵測電路，用來判斷在一預定時間內是否接收到一輸入視訊資料；一資料輸出驅動器，耦接於該偵測電路，用來在該偵測電路判斷在該預定時間內接收到一輸入視訊資料時輸出一輸出視訊資料至該顯示面板，並且在該偵測電路判斷在該預定時間內未接收到任何輸入視訊資料時停止輸出該輸出視訊資料；以及一發光控制電路，耦接於該偵測電路，用來在該偵測電路判斷在該預定時間內接收到一輸入視訊資料時輸出具有一第一頻率的一時脈訊號至該顯示面板，並且在該偵測電路判斷在該預定時間內未接收到任何輸入視訊資料時輸出具有一第二頻率的該時脈訊號至該顯示面板；其中，該第二頻率高於該第一頻率。
  11. 如請求項10所述之控制電路，其中該發光控制電路另用來： 在用來輸出一幀視訊資料之一輸出幀期間內輸出具有一第一責任週期的一發光脈衝訊號至該顯示面板；以及當該偵測電路判斷在該預定時間內未接收到任何輸入視訊資料時，在該輸出幀期間之後的一時間區間內輸出具有一第二責任週期的該發光脈衝訊號至該顯示面板；其中，該第二責任週期實質上等於該第一責任週期。
  12. 如請求項10所述之控制電路，另包含有一閘極控制電路，該閘極控制電路用來：當該偵測電路判斷在該預定時間內接收到一輸入視訊資料時，輸出一閘極控制訊號至該顯示面板；以及當該偵測電路判斷在該預定時間內未接收到任何輸入視訊資料時，停止輸出該閘極控制訊號至該顯示面板。
  13. 如請求項10所述之控制電路，其中該偵測電路另用來計算接收到一最後輸入視訊資料之後的一列時間，以判斷在該預定時間內是否接收到一輸入視訊資料。
  14. 如請求項13所述之控制電路，其中該偵測電路另用來計算接收到該最後輸入視訊資料之後接收的空白起始訊號之數量，以計算該列時間。
  15. 如請求項13所述之控制電路，另包含有一列緩衝器，其中當計算出的該列時間超過一臨界值之後但未接收到任何輸入視訊資料時，該偵測電路另判斷在該預定時間內未接收到任何輸入視訊資料，該臨界值係根據該列 緩衝器決定。
  16. 如請求項10所述之控制電路，其中當該偵測電路判斷在該預定時間內接收到一輸入視訊資料時，該控制電路處於一正常掃描模式，而當該偵測電路判斷在該預定時間內未接收到任何輸入視訊資料時，該控制電路處於一快速掃描模式，且該控制電路另包含有：一時序控制器，用來：當該控制電路處於該正常掃描模式時，根據該輸入視訊資料產生一垂直同步訊號以定義一輸出幀期間；以及當該控制電路處於該快速掃描模式時，產生該垂直同步訊號以定義一快速掃描期間；其中，該快速掃描期間的長度短於該輸出幀期間的長度。
  17. 如請求項10所述之控制電路，其中該控制電路處於一快速掃描模式，且在該控制電路接收到一空白結束訊號之後，該控制電路進入一正常掃描模式且該資料輸出驅動器重新開始輸出該輸出視訊資料，該空白結束訊號指示該輸入視訊資料的到達。
  18. 如請求項10所述之控制電路，另用來透過一顯示埠(Display Port，DP)介面或一嵌入式顯示埠(embedded DP，eDP)介面接收該輸入視訊資料。
  19. 一種用於一控制電路之方法，用來控制一顯示面板，該方法包含有： 接收一第一幀視訊資料；輸出該第一幀視訊資料與具有一第一責任週期的一發光脈衝訊號至該顯示面板；當該第一幀視訊資料完全接收之後，判斷在一預定時間內是否接收到一第二幀視訊資料；以及當判斷在該預定時間內未接收到該第二幀視訊資料時，輸出具有該第一責任週期的該發光脈衝訊號至該顯示面板而不輸出任何視訊資料。
  20. 如請求項19所述之方法，另包含有：針對該第一幀視訊資料輸出具有一第一頻率的一發光控制時脈至該顯示面板；以及當判斷在該預定時間內未接收到該第二幀視訊資料時，輸出具有一第二頻率的該發光控制時脈至該顯示面板；其中，該第二頻率高於該第一頻率。
  21. 如請求項19所述之方法，另包含有：當判斷在該預定時間內接收到該第二幀視訊資料時，輸出一閘極控制訊號至該顯示面板；以及當判斷在該預定時間內未接收到該第二幀視訊資料時，停止輸出該閘極控制訊號至該顯示面板。
  22. 如請求項19所述之方法，其中判斷在該預定時間內是否接收到該第二幀視訊資料之步驟包含有：計算接收到該第一幀視訊資料之後的一列時間，以判斷在該預定時間內是否 接收到該第二幀視訊資料。
  23. 如請求項22所述之方法，其中計算接收到該第一幀視訊資料之後的該列時間之步驟包含有：計算接收到該第一幀視訊資料之後接收的空白起始訊號之數量。
  24. 如請求項22所述之方法，其中計算接收到該第一幀視訊資料之後的該列時間，以判斷在該預定時間內是否接收到該第二幀視訊資料之步驟包含有：當計算出的該列時間超過一臨界值之後但未接收到任何視訊資料時，判斷在該預定時間內未接收到該第二幀視訊資料，該臨界值係根據一列緩衝器決定。
  25. 如請求項19所述之方法，其中當判斷在該預定時間內接收到該第二幀視訊資料時，該控制電路處於一正常掃描模式，而當判斷在該預定時間內未接收到該第二幀視訊資料時，該控制電路處於一快速掃描模式，且該方法另包含有：當該控制電路處於該正常掃描模式時，根據該第二幀視訊資料產生一垂直同步訊號以定義一輸出幀期間；以及當該控制電路處於該快速掃描模式時，產生該垂直同步訊號以定義一快速掃描期間；其中，該快速掃描期間的長度短於該輸出幀期間的長度。
  26. 如請求項19所述之方法，其中該控制電路處於一快速掃描模式， 且該方法另包含有：在接收到一空白結束訊號之後，進入一正常掃描模式並重新開始輸出一輸出視訊資料，該空白結束訊號指示一第三幀視訊資料的到達。
  27. 如請求項19所述之方法，另包含有：透過一顯示埠(Display Port，DP)介面或一嵌入式顯示埠(embedded DP，eDP)介面接收該第一幀視訊資料。
  28. 一種控制電路，用來控制一顯示面板，該控制電路包含有：一偵測電路，用來接收一第一幀視訊資料，並且在該第一幀視訊資料完全接收之後，判斷在一預定時間內是否接收到一第二幀視訊資料；一資料輸出驅動器，耦接於該偵測電路，用來輸出該第一幀視訊資料至該顯示面板；以及一發光控制電路，耦接於該偵測電路，用來輸出具有一第一責任週期的一發光脈衝訊號至該顯示面板；其中，當該偵測電路判斷在該預定時間內未接收到該第二幀視訊資料時，該發光控制電路另用來輸出具有該第一責任週期的該發光脈衝訊號，且該資料輸出驅動器不輸出任何視訊資料。
  29. 如請求項28所述之控制電路，其中該發光控制電路另用來：針對該第一幀視訊資料輸出具有一第一頻率的一發光控制時脈至該顯示面板；以及當該偵測電路判斷在該預定時間內未接收到該第二幀視訊資料時，輸出具有一第二頻率的該發光控制時脈至該顯示面板； 其中，該第二頻率高於該第一頻率。
  30. 如請求項28所述之控制電路，另包含有一閘極控制電路，該閘極控制電路用來：當該偵測電路判斷在該預定時間內接收到該第二幀視訊資料時，輸出一閘極控制訊號至該顯示面板；以及當該偵測電路判斷在該預定時間內未接收到該第二幀視訊資料時，停止輸出該閘極控制訊號至該顯示面板。
  31. 如請求項28所述之控制電路，其中該偵測電路另用來計算接收到該第一幀視訊資料之後的一列時間，以判斷在該預定時間內是否接收到該第二幀視訊資料。
  32. 如請求項31所述之控制電路，其中該偵測電路另用來計算接收到該第一幀視訊資料之後接收的空白起始訊號之數量，以計算該列時間。
  33. 如請求項31所述之控制電路，另包含有一列緩衝器，其中當計算出的該列時間超過一臨界值之後但未接收到任何視訊資料時，該偵測電路另判斷在該預定時間內未接收到該第二幀視訊資料，該臨界值係根據該列緩衝器決定。
  34. 如請求項28所述之控制電路，其中當該偵測電路判斷在該預定時間內接收到該第二幀視訊資料時，該控制電路處於一正常掃描模式，而當該偵測電路判斷在該預定時間內未接收到該第二幀視訊資料時，該控制電路處 於一快速掃描模式，且該控制電路另包含有：一時序控制器，用來：當該控制電路處於該正常掃描模式時，根據該第二幀視訊資料產生一垂直同步訊號以定義一輸出幀期間；以及當該控制電路處於該快速掃描模式時，產生該垂直同步訊號以定義一快速掃描期間；其中，該快速掃描期間的長度短於該輸出幀期間的長度。
  35. 如請求項28所述之控制電路，其中該控制電路處於一快速掃描模式，且在該控制電路接收到一空白結束訊號之後，該控制電路進入一正常掃描模式且該資料輸出驅動器重新開始輸出一輸出視訊資料，該空白結束訊號指示一第三幀視訊資料的到達。
  36. 如請求項28所述之控制電路，另用來透過一顯示埠(Display Porf，DP)介面或一嵌入式顯示埠(embedded DP，eDP)介面接收該第一幀視訊資料。
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