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TWI851276B - 顯示裝置及其驅動方法 - Google Patents

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TWI851276B
TWI851276B TW112121728A TW112121728A TWI851276B TW I851276 B TWI851276 B TW I851276B TW 112121728 A TW112121728 A TW 112121728A TW 112121728 A TW112121728 A TW 112121728A TW I851276 B TWI851276 B TW I851276B
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林城興
李明賢
吳佳恩
張書瀚
戴俊翔
莊銘宏
董哲維
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友達光電股份有限公司
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Abstract

一種顯示裝置及其驅動方法被提出。在顯示裝置中，顯示面板具有交錯排列的多個第一畫素列以及多個第二畫素列。在第一時間區間中，第一閘極驅動器以第一驅動方式依序地驅動第一畫素列。在第二時間區間中，第二閘極驅動器以第一驅動方式依序地驅動第二畫素列。在第三時間區間中，第三閘極驅動器以第二驅動方式依序地驅動第一畫素列。在第四時間區間中，第四閘極驅動器以第二驅動方式依序地驅動第二畫素列。第一驅動方式以及第二驅動方式的其中之一為脈衝振幅調變的驅動方式，其中之另一為脈波寬度調變的驅動方式。

Description

顯示裝置及其驅動方法
本發明是有關於一種驅動技術，且特別是有關於一種顯示裝置及其驅動方法。
在一般的顯示裝置中，畫素電路通常會具備以脈衝寬度調變(Pulse Width Modulation，PWM)控制方式之PWM區塊以及/或以脈衝振幅調變(Pulse Amplitude Modulation，PAM)控制方式之PAM區塊，並透過PWM區塊以及/或PAM區塊來驅動畫素電路，藉以調整發光元件的發光亮度。
然而，在習知的驅動技術中，顯示裝置的設計較容易受到充電率不足而影響顯示品質。
有鑑於此，如何提升畫素電路的充電效率，藉以改善顯示畫面的顯示品質，將是本領域相關技術人員重要的課題。
本發明提供一種顯示裝置及其驅動方法，能夠有效地提 升畫素電路的充電效率以改善顯示畫面的顯示品質。
本發明的顯示裝置包括顯示面板、第一閘極驅動器、第二閘極驅動器、第三閘極驅動器以及第四閘極驅動器。顯示面板具有多個第一畫素列以及多個第二畫素列，多個第一畫素列分別與多個第二畫素列交錯排列。在第一時間區間中，第一閘極驅動器以第一驅動方式依序地驅動多個第一畫素列。在第一時間區間之後的第二時間區間中，第二閘極驅動器以第一驅動方式依序地驅動多個第二畫素列。在第二時間區間之後的第三時間區間中，第三閘極驅動器以第二驅動方式依序地驅動多個第一畫素列。在第三時間區間之後的第四時間區間中，第四閘極驅動器以第二驅動方式依序地驅動多個第二畫素列。其中第一驅動方式以及第二驅動方式的其中之一為脈衝振幅調變(Pulse Amplitude Modulation，PAM)的驅動方式，其中之另一為脈波寬度調變(Pulse-width modulation，PWM)的驅動方式。
本發明的顯示裝置的驅動方法，包括：提供具有多個第一畫素列以及多個第二畫素列的顯示面板，其中多個第一畫素列分別與多個第二畫素列交錯排列；在第一時間區間中，提供第一閘極驅動器以第一驅動方式依序地驅動多個第一畫素列；在第一時間區間之後的第二時間區間中，提供第二閘極驅動器以第一驅動方式依序地驅動多個第二畫素列；在第二時間區間之後的第三時間區間中，提供第三閘極驅動器以第二驅動方式依序地驅動多個第一畫素列；以及在第三時間區間之後的第四時間區間中，提 供第四閘極驅動器以第二驅動方式依序地驅動多個第二畫素列，其中第一驅動方式以及第二驅動方式的其中之一為脈衝振幅調變(Pulse Amplitude Modulation，PAM)的驅動方式，其中之另一為脈波寬度調變(Pulse-width modulation，PWM)的驅動方式。
基於上述，本發明的顯示裝置及其驅動方法可以在第一與第二時間區間中，透過第一與第二閘極驅動器以第一驅動方式來依序地驅動第一與第二畫素列的畫素。並且，在第三與第四時間區間中，顯示裝置可以透過第三與第四閘極驅動器以第二驅動方式來依序地驅動第一與第二畫素列的畫素。如此一來，本發明的顯示裝置能夠有效地增加畫素電路的充電時間，藉以提升畫素電路的充電效率，以改善顯示畫面的顯示品質。
在本案說明書全文(包括申請專利範圍)中所使用的「耦接(或連接)」一詞可指任何直接或間接的連接手段。舉例而言，若文中描述第一裝置耦接(或連接)於第二裝置，則應該被解釋成該第一裝置可以直接連接於該第二裝置，或者該第一裝置可以透過其他裝置或某種連接手段而間接地連接至該第二裝置。另外，凡可能之處，在圖式及實施方式中使用相同標號的元件/構件/步驟代表相同或類似部分。不同實施例中使用相同標號或使用相同用語的元件/構件/步驟可以相互參照相關說明。
圖1是依照本發明一實施例的顯示裝置的示意圖。請參照圖1，顯示裝置100包括顯示面板110、第一閘極驅動器121_1、121_2、第二閘極驅動器122_1、122_2、第三閘極驅動器123_1、123_2、第四閘極驅動器124_1、124_2、發光電路125_1、125_2以及源極驅動器130。
在本實施例中，顯示面板110包括多個畫素(或畫素電路)P11~PN1、P12~PN2、P13~PN3以及P14~PN4。這些畫素P11~PN1、P12~PN2、P13~PN3及P14~PN4可被配置於資料線與閘極線的交錯處，並透過相對應的閘極線與資料線來控制畫素電路操作。
這些畫素P11~PN1、P12~PN2、P13~PN3以及P14~ PN4可以被排列成多個畫素列PC1~PC4。舉例來說，畫素P11~PN1可以被排列成畫素列PC1；畫素P12~PN2可以被排列成畫素列PC2；畫素P13~PN3可以被排列成畫素列PC3；畫素P14~PN4可以被排列成畫素列PC4。其中，這些畫素列PC1~PC4可以彼此交錯排列。
需注意到的是，在本實施例中，畫素列PC1、PC3可以是顯示面板110的奇數列的畫素列(亦即，第一畫素列)，而畫素列PC2、PC4可以是顯示面板110的偶數列的畫素列(亦即，第二畫素列)。在本發明實施例中，本領域通常知識者可以依據顯示裝置100的設計需求，來決定顯示面板110的畫素的數量，本發明並不限於上述所舉例的數量。其中，上述的N為正整數。
特別一提的是，針對顯示面板110的畫素(或畫素電路)P11~PN1、P12~PN2、P13~PN3以及P14~PN4的說明內容，請同時參照圖1以及圖2，圖2是依照本發明圖1實施例的畫素電路的示意圖。其中，顯示面板110的畫素(或畫素電路)P11~PN1、P12~PN2、P13~PN3以及P14~PN4中的任一個畫素(或畫素電路)可以由圖2所示的畫素電路200來實施。
在本實施例中，畫素電路200可以包括PAM區塊210以及PWM區塊220。其中，PAM區塊210可以包括用於實現PAM控制方式的相關電子電路，而PWM區塊220可以包括用於實現PWM控制方式的相關電子電路。
具體而言，畫素電路200可以透過PAM區塊210來接 收來自第一閘極驅動器121_1、121_2以及/或第二閘極驅動器122_1、122_2所產生的PAM控制信號SPAM[n]，以及接收來自源極驅動器130所產生的資料電壓DATA[n]。
藉此，第一閘極驅動器121_1、121_2以及/或第二閘極驅動器122_1、122_2能夠透過被致能的PAM控制信號SPAM[n]而啟動畫素電路200的PAM區塊210的操作動作，以對畫素電路200進行PAM驅動。在此同時，源極驅動器130可以對應地將資料電壓DATA[n]寫入至畫素電路200中。
在另一方面，畫素電路200可以透過PWM區塊220來接收來自第三閘極驅動器123_1、123_2以及/或第四閘極驅動器124_1、124_2所產生的PWM控制信號SPWM[n]，以及接收來自源極驅動器130所產生的資料電壓DATA[n]。
藉此，第三閘極驅動器123_1、123_2以及/或第四閘極驅動器124_1、124_2能夠透過被致能的PWM控制信號SPWM[n]而啟動畫素電路200的PWM區塊220的操作動作，以對畫素電路200進行PWM驅動。在此同時，源極驅動器130可以對應地將資料電壓DATA[n]寫入至畫素電路200中。
此外，在本實施例中，畫素電路200可以接收來自發光電路125_1、125_2所產生的發光控制信號EM[n]。藉此，畫素電路200可以依據被致能的發光控制信號EM[n]而點亮發光元件。
值得一提的是，本實施例並不限制畫素電路200的實施 方式。舉例來說，在一些實施例中，畫素電路200可以包括由本領域具有通常知識者所熟知具備PAM區塊(或應用PAM驅動之相關電路)以及PWM區塊(或應用PWM驅動之相關電路)的畫素電路。
請返回參照圖1的內容，在本實施例中，第一閘極驅動器121_1、第二閘極驅動器122_1、第三閘極驅動器123_1、第四閘極驅動器124_1以及發光電路125_1可以被配置於顯示面板110的第一側(如顯示面板110的左側)，而第一閘極驅動器121_2、第二閘極驅動器122_2、第三閘極驅動器123_2、第四閘極驅動器124_2以及發光電路125_2可以被配置於顯示面板110的相對於第一側的第二側(如顯示面板110的右側)，但本發明並不限於此。
在本實施例中，第一閘極驅動器121_1、121_2可以耦接至顯示面板110的奇數列的多個畫素(亦即，第一畫素列PC1中的多個畫素P11~PN1以及第一畫素列PC3中的多個畫素P13~PN3)。第一閘極驅動器121_1、121_2可以依據起始信號(Start pulse signal)以產生PAM控制信號SPAM[1]、SPAM[3]至對應的第一畫素列PC1中的多個畫素P11~PN1以及第一畫素列PC3中的多個畫素P13~PN3。
在此情況下，第一閘極驅動器121_1、121_2可以透過PAM控制信號SPAM[1]以及/或PAM控制信號SPAM[3]且以PAM的驅動方式來驅動第一畫素列PC1以及/或第一畫素列PC3中對 應的畫素(或畫素電路)。
在另一方面，第二閘極驅動器122_1、122_2可以耦接至顯示面板110的偶數列的多個畫素(亦即，第二畫素列PC2中的多個畫素P12~PN2以及第二畫素列PC4中的多個畫素P14~PN4)。第二閘極驅動器122_1、122_2可以依據起始信號以產生PAM控制信號SPAM[2]、SPAM[4]至對應的第二畫素列PC2中的多個畫素P12~PN2以及第二畫素列PC4中的多個畫素P14~PN4。
在此情況下，第二閘極驅動器122_1、122_2可以透過PAM控制信號SPAM[2]以及/或PAM控制信號SPAM[4]且以PAM的驅動方式來驅動第二畫素列PC2以及/或第二畫素列PC4中對應的畫素(或畫素電路)。
在另一方面，第三閘極驅動器123_1、123_2可以耦接至顯示面板110的奇數列的多個畫素(亦即，第一畫素列PC1中的多個畫素P11~PN1以及第一畫素列PC3中的多個畫素P13~PN3)。第三閘極驅動器123_1、123_2可以依據起始信號以產生PWM控制信號SPWM[1]、SPWM[3]至對應的第一畫素列PC1中的多個畫素P11~PN1以及第一畫素列PC3中的多個畫素P13~PN3。
在此情況下，第三閘極驅動器123_1、123_2可以透過PWM控制信號SPWM[1]以及/或PWM控制信號SPWM[3]且以PWM的驅動方式來驅動第一畫素列PC1以及/或第一畫素列PC3 中對應的畫素(或畫素電路)。
在另一方面，第四閘極驅動器124_1、124_2可以耦接至顯示面板110的偶數列的多個畫素(亦即，第二畫素列PC2中的多個畫素P12~PN2以及第二畫素列PC4中的多個畫素P14~PN4)。第四閘極驅動器124_1、124_2可以依據起始信號以產生PWM控制信號SPWM[2]、SPWM[4]至對應的第二畫素列PC2中的多個畫素P12~PN2以及第二畫素列PC4中的多個畫素P14~PN4。
在此情況下，第四閘極驅動器124_1、124_2可以透過PWM控制信號SPWM[2]以及/或PWM控制信號SPWM[4]且以PWM的驅動方式來驅動第二畫素列PC2以及/或第二畫素列PC4中對應的畫素(或畫素電路)。
關於本實施例的第一閘極驅動器121_1(或121_2)、第二閘極驅動器122_1(或122_2)、第三閘極驅動器123_1(或123_2)以及第四閘極驅動器124_1(或124_2)的實施細節，請同時參照圖1以及圖3A至圖3D，圖3A至圖3D分別是依照本發明圖1實施例的第一閘極驅動器至第四閘極驅動器的示意圖。
在此，請同時參照圖1以及圖3A，本實施例的第一閘極驅動器121_1(或121_2)可以由圖3A所示的閘極驅動器300來實施。
在本實施例中，閘極驅動器300可以包括多個移位暫存電路(例如，移位暫存電路SR11、SR31、SR51、SR71、SR91 以及SR111等)。這些移位暫存電路SR11、SR31、SR51、SR71、SR91以及SR111可以彼此相互串聯耦接。閘極驅動器300的第一級的移位暫存電路SR11可以接收起始信號STV1。閘極驅動器300的移位暫存電路SR11、SR31、SR51、SR71、SR91以及SR111可以依據起始信號STV1以分別產生依序致能(例如是低電壓準位)的多個PAM控制信號(例如，PAM控制信號SPAM[1]、SPAM[3]、SPAM[5]、SPAM[7]、SPAM[9]以及SPAM[11]等)。
在此，請同時參照圖1以及圖3B，本實施例的第二閘極驅動器122_1(或122_2)可以由圖3B所示的閘極驅動器310來實施。
在本實施例中，閘極驅動器310可以包括多個移位暫存電路(例如，移位暫存電路SR21、SR41、SR61、SR81以及SR101等)。這些移位暫存電路SR21、SR41、SR61、SR81以及SR101可以彼此相互串聯耦接。閘極驅動器310的第一級的移位暫存電路SR21可以接收起始信號STV2。閘極驅動器310的移位暫存電路SR21、SR41、SR61、SR81以及SR101可以依據起始信號STV1以分別產生依序致能(例如是低電壓準位)的多個PAM控制信號(例如，PAM控制信號SPAM[2]、SPAM[4]、SPAM[6]、SPAM[8]以及SPAM[10]等)。
在此，請同時參照圖1以及圖3C，本實施例的第三閘極驅動器123_1(或123_2)可以由圖3C所示的閘極驅動器320 來實施。
在本實施例中，閘極驅動器320可以包括多個移位暫存電路(例如，移位暫存電路SR12、SR32、SR52、SR72、SR92以及SR112等)。這些移位暫存電路SR12、SR32、SR52、SR72、SR92以及SR112可以彼此相互串聯耦接。閘極驅動器320的第一級的移位暫存電路SR12可以接收起始信號STV3。閘極驅動器320的移位暫存電路SR12、SR32、SR52、SR72、SR92以及SR112可以依據起始信號STV3以分別產生依序致能(例如是低電壓準位)的多個PWM控制信號(例如，PWM控制信號SPWM[1]、SPWM[3]、SPWM[5]、SPWM[7]、SPWM[9]以及SPWM[11]等)。
在此，請同時參照圖1以及圖3D，本實施例的第四閘極驅動器124_1(或124_2)可以由圖3D所示的閘極驅動器330來實施。
在本實施例中，閘極驅動器330可以包括多個移位暫存電路(例如，移位暫存電路SR22、SR42、SR62、SR82以及SR102等)。這些移位暫存電路SR22、SR42、SR62、SR82以及SR102可以彼此相互串聯耦接。閘極驅動器330的第一級的移位暫存電路SR22可以接收起始信號STV4。閘極驅動器330的移位暫存電路SR22、SR42、SR62、SR82以及SR102可以依據起始信號STV4以分別產生依序致能(例如是低電壓準位)的多個PWM控制信號(例如，PWM控制信號SPWM[2]、SPWM[4]、 SPWM[6]、SPWM[8]以及SPWM[10]等)。
需注意到的是，本實施例並不限制閘極驅動器300~330的實施方式。舉例來說，在一些實施例中，閘極驅動器300~330中的各個移位暫存電路可以包括由本領域具有通常知識者所熟知的移位暫存器或移位暫存電路，各元件中的相關操作動作在此則不多贅述。
請返回參照圖1的內容，在本實施例中，發光電路125_1、125_2可以耦接至顯示面板110的第一畫素列PC1、PC3以及第二畫素列PC2、PC4中的多個畫素。發光電路125_1、125_2可以產生多個發光控制信號EM[1]~EM[4]至對應的第一畫素列PC1、PC3以及第二畫素列PC2、PC4，藉以點亮對應的畫素。
在另一方面，在本實施例中，源極驅動器130耦接至顯示面板110。源極驅動器130可以根據第一閘極驅動器、第二閘極驅動器、第三閘極驅動器以及第四閘極驅動器的驅動方式而對應地產生資料電壓至多個第一畫素列以及/或第二畫素列中。
圖4是依照本發明圖1實施例的顯示裝置的時序圖。請參照圖4，在本實施例中，顯示裝置100的一個畫素期間TFR可以區分為第一時間區間T1、第二時間區間T2、第三時間區間T3以及第四時間區間T4。顯示裝置100可以依序操作於第一時間區間T1、第二時間區間T2、第三時間區間T3以及第四時間區間T4，且第一時間區間T1、第二時間區間T2、第三時間區間T3 以及第四時間區間T4彼此不相互重疊。
關於顯示裝置100的實施細節，請同時參照圖1、圖2以及圖4。具體而言，在第一時間區間T1中，第一閘極驅動器121_1、121_2可以產生依序致能(例如，低電壓準位)的PAM控制信號SPAM[1]、SPAM[3]至顯示面板110的奇數列的多個畫素(亦即，第一畫素列PC1中的多個畫素P11~PN1以及第一畫素列PC3中的多個畫素P13~PN3)的PAM區塊。
在此情況下，第一閘極驅動器121_1、121_2可以以PAM驅動方式來依序地驅動這些第一畫素列PC1、PC3(亦即，顯示面板110的奇數列的畫素列)。並且，源極驅動器130可以依序地將對應的資料電壓DATA[n](例如是在第一閘極驅動器121_1、121_2以PAM驅動方式驅動第一畫素列PC1、PC3下的PAM資料電壓VPAM1、VPAM3)寫入至這些第一畫素列PC1、PC3的畫素中。
接著，在第一時間區間T1之後的第二時間區間T2中，第二閘極驅動器122_1、122_2可以產生依序致能(例如，低電壓準位)的PAM控制信號SPAM[2]、SPAM[4]至顯示面板110的偶數列的多個畫素(亦即，第二畫素列PC2中的多個畫素P12~PN2以及第二畫素列PC4中的多個畫素P14~PN4)的PAM區塊。
在此情況下，第二閘極驅動器122_1、122_2可以以PAM驅動方式來依序地驅動這些第二畫素列PC2、PC4(亦即， 顯示面板110的偶數列的畫素列)。並且，源極驅動器130可以依序地將對應的資料電壓DATA[n](例如是在第二閘極驅動器122_1、122_2以PAM驅動方式驅動第二畫素列PC2、PC4下的PAM資料電壓VPAM2、VPAM4)寫入至這些第二畫素列PC2、PC4的畫素中。
在完成第一閘極驅動器121_1、121_2以及第二閘極驅動器122_1、122_2以PAM驅動方式來依序地驅動第一畫素列PC1、PC3以及第二畫素列PC2、PC4的操作動作之後，在第三時間區間T3中，第三閘極驅動器123_1、123_2可以產生依序致能(例如，低電壓準位)的PWM控制信號SPWM[1]、SPWM[3]至顯示面板110的奇數列的多個畫素(亦即，第一畫素列PC1中的多個畫素P11~PN1以及第一畫素列PC3中的多個畫素P13~PN3)的PWM區塊。
在此情況下，第三閘極驅動器123_1、123_2可以以PWM驅動方式來依序地驅動這些第一畫素列PC1、PC3(亦即，顯示面板110的奇數列的畫素列)。並且，源極驅動器130可以依序地將對應的資料電壓DATA[n](例如是在第三閘極驅動器123_1、123_2以PWM驅動方式驅動第一畫素列PC1、PC3下的PWM資料電壓VPWM1、VPWM3)寫入至這些第一畫素列PC1、PC3的畫素中。
接著，在第三時間區間T3之後的第四時間區間T4中，第四閘極驅動器124_1、124_2可以產生依序致能(例如，低電 壓準位)的PWM控制信號SPWM[2]、SPWM[4]至顯示面板110的偶數列的多個畫素(亦即，第二畫素列PC2中的多個畫素P12~PN2以及第二畫素列PC4中的多個畫素P14~PN4)的PWM區塊。
在此情況下，第四閘極驅動器124_1、124_2可以以PWM驅動方式來依序地驅動這些第二畫素列PC2、PC4(亦即，顯示面板110的偶數列的畫素列)。並且，源極驅動器130可以依序地將對應的資料電壓DATA[n](例如是在第四閘極驅動器124_1、124_2以PWM驅動方式驅動第二畫素列PC2、PC4下的PWM資料電壓VPWM2、VPWM4)寫入至這些第二畫素列PC2、PC4的畫素中。
依據上述的說明內容可以得知，在一些設計需求下(在一些實施例中)，顯示裝置100可以先透過第一閘極驅動器121_1、121_2以PAM驅動方式來依序地驅動顯示面板110的多個奇數列的畫素列(亦即，第一畫素列)。接著，顯示裝置100可以再透過第二閘極驅動器122_1、122_2以PAM驅動方式來依序地驅動顯示面板110的多個偶數列的畫素列(亦即，第二畫素列)。
在第一與第二閘極驅動器皆完成以PAM驅動方式來驅動第一畫素列以及第二畫素列的操作動作之後，顯示裝置100可以接著透過第三閘極驅動器123_1、123_2以PWM驅動方式來依序地驅動顯示面板110的多個奇數列的畫素列(亦即，第一畫素 列)。
接著，顯示裝置100可以再透過第四閘極驅動器124_1、124_2以PWM驅動方式來依序地驅動顯示面板110的多個偶數列的畫素列(亦即，第二畫素列)，以完成畫素P11~PN1、P12~PN2、P13~PN3、P14~PN4的資料寫入動作。藉此，本實施的顯示裝置100能夠有效地增加畫素電路的充電時間，藉以提升畫素電路的充電效率，以改善顯示畫面的顯示品質。
而在另一些設計需求下(在另一些實施例中)，當顯示裝置100操作於第一時間區間T1時，顯示裝置100亦可先透過第三閘極驅動器123_1、123_2以PWM驅動方式來依序地驅動顯示面板110的多個奇數列的畫素列(亦即，第一畫素列)。接著，顯示裝置100可以再透過第四閘極驅動器124_1、124_2以PWM驅動方式來依序地驅動顯示面板110的多個偶數列的畫素列(亦即，第二畫素列)。
並且，在第三與第四閘極驅動器皆完成以PWM驅動方式來驅動第一畫素列以及第二畫素列的操作動作之後，顯示裝置100可以接著透過第一閘極驅動器121_1、121_2以PAM驅動方式來依序地驅動顯示面板110的多個奇數列的畫素列(亦即，第一畫素列)。
接著，顯示裝置100可以再透過第二閘極驅動器122_1、122_2以PAM驅動方式來依序地驅動顯示面板110的多 個偶數列的畫素列(亦即，第二畫素列)，以完成畫素P11~PN1、P12~PN2、P13~PN3、P14~PN4的資料寫入動作。
圖5A至圖5C分別是依照本發明圖1實施例的顯示裝置的三種操作情境的示意圖。在此接續圖4實施例的說明內容，請同時參照圖1、圖4以及圖5A至圖5C，在本實施例中，顯示裝置100的一個畫素期間TFR可以更包括垂直消隱(Vertical Blanking)時間區間BLK。
具體而言，在圖5A的實施例中，顯示裝置100可以在垂直消隱時間區間BLK之後，才開始依序地透過第一閘極驅動器121_1、121_2以及第二閘極驅動器122_1、122_2以PAM驅動方式來驅動顯示面板110的多個奇數列的畫素列(亦即，第一畫素列)以及多個偶數列的畫素列(亦即，第二畫素列)。
也就是說，在圖5A的實施例中(相同或相似於圖4實施例)，第一閘極驅動器121_1、121_2以及第二閘極驅動器122_1、122_2可以在垂直消隱時間區間BLK中停止對畫素列執行PAM驅動方式。
在另一方面，在圖5B的實施例中，當顯示裝置100操作於垂直消隱時間區間BLK時，顯示裝置100即可開始依序地透過第一閘極驅動器121_1、121_2以及第二閘極驅動器122_1、122_2以PAM驅動方式來驅動顯示面板110的多個奇數列的畫素列(亦即，第一畫素列)以及多個偶數列的畫素列(亦即，第二畫素列)。
也就是說，在圖5B的實施例中，第一閘極驅動器121_1、121_2以及第二閘極驅動器122_1、122_2可以在垂直消隱時間區間BLK中維持對畫素列執行PAM驅動方式。
在另一方面，在圖5C的實施例中，當顯示裝置100操作於垂直消隱時間區間BLK時，第一閘極驅動器121_1、121_2以及第二閘極驅動器122_1、122_2中的多個移位暫存電路可產生同時致能的PAM控制信號，以將為固定常數的PAM控制信號提供至對應的畫素列中。
而在顯示裝置100完成垂直消隱時間區間BLK的操作動作之後，顯示裝置100可以再接續透過第三閘極驅動器123_1、123_2以及第四閘極驅動器124_1、124_2以PWM驅動方式來依序地驅動顯示面板110的多個奇數列的畫素列(亦即，第一畫素列)以及多個偶數列的畫素列(亦即，第二畫素列)。
圖6是依照本發明一實施例的顯示裝置的驅動方法的流程圖。請同時參照圖1以及圖6，在步驟S610中，顯示裝置提供具有多個第一畫素列以及多個第二畫素列的顯示面板，其中多個第一畫素列分別與多個第二畫素列交錯排列。在步驟S620中，在第一時間區間中，顯示裝置提供第一閘極驅動器以第一驅動方式依序地驅動多個第一畫素列。
在步驟S630中，在第一時間區間之後的第二時間區間中，顯示裝置提供第二閘極驅動器以第一驅動方式依序地驅動多個第二畫素列。在步驟S640中，在第二時間區間之後的第三時 間區間中，顯示裝置提供第三閘極驅動器以第二驅動方式依序地驅動多個第一畫素列。在步驟S650中，在第三時間區間之後的第四時間區間中，顯示裝置提供第四閘極驅動器以第二驅動方式依序地驅動多個第二畫素列。
關於各步驟的實施細節在前述的實施例及實施方式都有詳盡的說明，以下恕不多贅述。
綜上所述，本發明的顯示裝置及其驅動方法可以在第一與第二時間區間中，透過第一與第二閘極驅動器以第一驅動方式來依序地驅動第一與第二畫素列的畫素。並且，在第三與第四時間區間中，顯示裝置可以透過第三與第四閘極驅動器以第二驅動方式來依序地驅動第一與第二畫素列的畫素。如此一來，本發明的顯示裝置能夠有效地增加畫素電路的充電時間，藉以提升畫素電路的充電效率，以改善顯示畫面的顯示品質。
100:顯示裝置
110:顯示面板
121_1、121_2:第一閘極驅動器
122_1、122_2:第二閘極驅動器
123_1、123_2:第三閘極驅動器
124_1、124_2:第四閘極驅動器
125_1、125_2:發光電路
130:源極驅動器
200:畫素電路
210:PAM區塊
220:PWM區塊
300、310、320、330:閘極驅動器
BLK:垂直消隱時間區間
DATA[1]~DATA[n]:資料電壓
EM[1]~EM[4]、EM[n]:發光控制信號
P11~PN1、P12~PN2、P13~PN3、P14~PN4:畫素
PC1~PC4:畫素列
STV1~STV4:起始信號
SPAM[1]~SPAM[11]、SPAM[n]:PAM控制信號
SPWM[1]~SPWM[11]、SPWM[n]:PWM控制信號
SR11~SR112:移位暫存電路
S610~S650:步驟
TFR:畫素期間
T1:第一時間區間
T2:第二時間區間
T3:第三時間區間
T4:第四時間區間
VPAM1~VPAM4:PAM資料電壓
VPWM1~VPWM4:PWM資料電壓
圖1是依照本發明一實施例的顯示裝置的示意圖。
圖2是依照本發明圖1實施例的畫素電路的示意圖。
圖3A至圖3D分別是依照本發明圖1實施例的第一閘極驅動器至第四閘極驅動器的示意圖。
圖4是依照本發明圖1實施例的顯示裝置的時序圖。
圖5A至圖5C分別是依照本發明圖1實施例的顯示裝置的三種操作情境的示意圖。
圖6是依照本發明一實施例的顯示裝置的驅動方法的流程 圖。
100:顯示裝置
110:顯示面板
121_1、121_2:第一閘極驅動器
122_1、122_2:第二閘極驅動器
123_1、123_2:第三閘極驅動器
124_1、124_2:第四閘極驅動器
125_1、125_2:發光電路
130:源極驅動器
DATA[1]~DATA[n]:資料電壓
EM[1]~EM[4]:發光控制信號
P11~PN1、P12~PN2、P13~PN3、P14~PN4:畫素
PC1~PC4:畫素列
SPAM[1]~SPAM[4]:PAM控制信號
SPWM[1]~SPWM[4]:PWM控制信號

Claims (10)

  1. 一種顯示裝置，包括：一顯示面板，具有多個第一畫素列以及多個第二畫素列，該些第一畫素列分別與該些第二畫素列交錯排列；一第一閘極驅動器，在一第一時間區間中，以一第一驅動方式依序地驅動該些第一畫素列；一第二閘極驅動器，在該第一時間區間之後的一第二時間區間中，以該第一驅動方式依序地驅動該些第二畫素列；一第三閘極驅動器，在該第二時間區間之後的一第三時間區間中，以一第二驅動方式依序地驅動該些第一畫素列；以及一第四閘極驅動器，在該第三時間區間之後的一第四時間區間中，以該第二驅動方式依序地驅動該些第二畫素列，其中該第一驅動方式以及該第二驅動方式的其中之一為脈衝振幅調變(Pulse Amplitude Modulation，PAM)的驅動方式，其中之另一為脈波寬度調變(Pulse-width modulation，PWM)的驅動方式。
  2. 如請求項1所述的顯示裝置，其中於一垂直消隱時間區間中，該第一閘極驅動器以及該第二閘極驅動器維持執行該第一驅動方式。
  3. 如請求項1所述的顯示裝置，其中於一垂直消隱時間區間中，該第一閘極驅動器以及該第二閘極驅動器停止執行該第一驅動方式。
  4. 如請求項1所述的顯示裝置，其中該顯示裝置更包括：一源極驅動器，耦接至該顯示面板，用以依據該第一驅動方式或該第二驅動方式的類型以提供多個資料電壓至該些第一畫素列中的多個畫素或該些第二畫素列中的多個畫素。
  5. 如請求項1所述的顯示裝置，其中該些第一畫素列為該顯示面板的奇數列的畫素列，而該些第二畫素列為該顯示面板的偶數列的畫素列。
  6. 一種顯示裝置的驅動方法，包括：提供具有多個第一畫素列以及多個第二畫素列的一顯示面板，其中該些第一畫素列分別與該些第二畫素列交錯排列；在一第一時間區間中，提供一第一閘極驅動器以一第一驅動方式依序地驅動該些第一畫素列；在該第一時間區間之後的一第二時間區間中，提供一第二閘極驅動器以該第一驅動方式依序地驅動該些第二畫素列；在該第二時間區間之後的一第三時間區間中，提供一第三閘極驅動器以一第二驅動方式依序地驅動該些第一畫素列；以及在該第三時間區間之後的一第四時間區間中，提供一第四閘極驅動器以該第二驅動方式依序地驅動該些第二畫素列，其中該第一驅動方式以及該第二驅動方式的其中之一為脈衝振幅調變(Pulse Amplitude Modulation，PAM)的驅動方式，其中 之另一為脈波寬度調變(Pulse-width modulation，PWM)的驅動方式。
  7. 如請求項6所述的驅動方法，更包括：於一垂直消隱時間區間中，使該第一閘極驅動器以及該第二閘極驅動器維持執行該第一驅動方式。
  8. 如請求項6所述的驅動方法，更包括：於一垂直消隱時間區間中，使該第一閘極驅動器以及該第二閘極驅動器停止執行該第一驅動方式。
  9. 如請求項6所述的驅動方法，更包括：提供一源極驅動器依據該第一驅動方式或該第二驅動方式的類型以提供多個資料電壓至該些第一畫素列中的多個畫素或該些第二畫素列中的多個畫素。
  10. 如請求項6所述的驅動方法，其中該些第一畫素列為該顯示面板的奇數列的畫素列，而該些第二畫素列為該顯示面板的偶數列的畫素列。
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