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TWI763235B - 顯示面板 - Google Patents

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TWI763235B
TWI763235B TW110100426A TW110100426A TWI763235B TW I763235 B TWI763235 B TW I763235B TW 110100426 A TW110100426 A TW 110100426A TW 110100426 A TW110100426 A TW 110100426A TW I763235 B TWI763235 B TW I763235B
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Taiwan
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transistor
voltage
gate driving
pull
control
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TW110100426A
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董哲維
林煒力
周晉賢
葉彥緯
Original Assignee
友達光電股份有限公司
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Abstract

一種顯示面板被提出。顯示面板包括多條掃描線以及閘極驅動電路。多條掃描線沿著第一方向設置於顯示面板上，分別提供多個閘極驅動信號。閘極驅動電路沿著與第一方向交錯的第二方向設置於顯示面板的第一側邊。閘極驅動電路包括多個偏壓產生器以及多個信號輸出電路。信號輸出電路區分為多個群組，偏壓產生器分別對應這些群組。偏壓產生器產生多個第一偏壓電壓，群組分別依據第一偏壓電壓以產生閘極驅動信號。

Description

顯示面板
本發明是有關於一種顯示面板，且特別是有關於一種窄邊框設計(Zero Border Display,ZBD)的顯示面板。
窄邊框設計是指為了節省顯示面板的邊框大小，而將傳統放置於顯示面板兩側的閘極驅動電路(Gate driver-on-array，GOA)移至顯示面板的天側，再利用多條閘極信號線將閘極驅動信號輸出至每一列掃描線，以驅動對應的畫素進行顯示。如此一來，可以使顯示面板的邊框小於1公厘。
然而，由於閘極驅動電路移至顯示面板的天側後，會造成天側的邊框面積大幅增加，且需要額外設置大量的閘極信號線，而加大了閘極驅動電路的輸出端上的電阻電容負載以及交互電容的大小，進而造成閘極驅動電路的充放電能力大幅衰減。
有鑑於此，本發明提供一種顯示面板，可以降低顯示面板的邊框面積，同時改善閘極驅動電路的充放電能力。
本發明的顯示面板包括多條掃描線以及閘極驅動電路。多條掃描線沿著第一方向設置於顯示面板上，分別提供多個閘極驅動信號。閘極驅動電路沿著與第一方向交錯的第二方向設置於顯示面板的第一側邊。閘極驅動電路包括多個偏壓產生器以及多個信號輸出電路。信號輸出電路區分為多個群組，偏壓產生器分別對應這些群組。偏壓產生器產生多個第一偏壓電壓，群組分別依據第一偏壓電壓以產生閘極驅動信號。
基於上述，本發明提出的顯示面板，將閘極驅動電路沿著與掃描線設置方向交錯的另一方向設置於顯示面板的側邊，並透過多個偏壓產生器以及對應的多個信號輸出電路，來產生多個閘極驅動信號至掃描線。如此一來，可以大幅減少顯示面板的邊框面積，同時改善閘極驅動電路的充放電能力。
為讓本發明的上述特徵和優點能更明顯易懂，下文特舉實施例，並配合所附圖式作詳細說明如下。
110、410:閘極驅動電路
111_1、111_2、211:偏壓產生器
112_1~112_P、312:信號輸出電路
213、214:上拉電路
215、215_1、215_2、216:下拉電路
217:輸出級電路
318_1~318_x、319_1~319_x:緩衝器
320_1~320_x:電壓產生器
400、700:顯示面板
420、430、521~524、524_1、524_2、720:輔助電路
721~724:導電路徑
725_1、725_x:畫素
750:顯示區域
A:線寬
B:線距
C1、C2_1~C2_x、C3:電容
CK1、CK1_1~CK1_8、CK2、CK2_1~CK2_x、CK3_1、CK3_2:時脈信號
DIR1、DIR2:方向
Gn、VB_1、VB_2:第一偏壓電壓
Gn-4:前級偏壓電壓
Gn+4:後級偏壓電壓
GL、GLa~GLd:掃描線
GL1~GLX、GL_1~GL_P:閘極驅動信號
GLX-5、GLX-3~GLX-1:前級閘極驅動信號
GLX+5:後級閘極驅動信號
GP_1、GP_2:群組
Pn、Qn:控制電壓
SCL:閘極信號線
SID1~SID3:側邊
ST:起始信號
T1~T29、T9_1~T9_x、T10_1~T10_x、T11_1~T11_x、T12_1~T12_x、T30_1~T30_4:電晶體
VGHD、VSSQ、VSSG:電壓
圖1繪示本發明一實施例的閘極驅動電路的示意圖。
圖2繪示本發明一實施例的偏壓產生器的示意圖。
圖3A至圖3C繪示本發明不同實施例的信號輸出電路的示意圖。
圖4繪示本發明一實施例的顯示面板的示意圖。
圖5A至圖5D繪示本發明不同實施例的輔助電路的示意圖。
圖6繪示本發明一實施例的時脈信號的時序圖。
圖7繪示本發明一實施例的顯示面板的部分架構的示意圖。
在本案說明書全文(包括申請專利範圍)中所使用的「耦接(或連接)」一詞可指任何直接或間接的連接手段。舉例而言，若文中描述第一裝置耦接(或連接)於第二裝置，則應該被解釋成該第一裝置可以直接連接於該第二裝置，或者該第一裝置可以透過其他裝置或某種連接手段而間接地連接至該第二裝置。本案說明書全文(包括申請專利範圍)中提及的「第一」、「第二」等用語是用以命名元件(element)的名稱，或區別不同實施例或範圍，而並非用來限制元件數量的上限或下限，亦非用來限制元件的次序。
請參照圖1。圖1繪示本發明一實施例的閘極驅動電路的示意圖。閘極驅動電路110適用於顯示面板。在圖1中，閘極驅動電路110由多個偏壓產生器以及多個信號輸出電路相互串聯耦接來建構。例如在本實施例中，閘極驅動電路110包括偏壓產生器111_1、111_2以及信號輸出電路112_1~112_P。其中，信號輸出電路112_1~112_R與112_R+1~112_P(P>R)可以分別組成群組GP_1與GP_2。偏壓產生器111_1與111_2可以分別對應群組GP_1與GP_2，並分別產生第一偏壓電壓VB_1、VB_2給對應的群組 GP1、GP2。信號輸出電路112_1~112_P可以分別依據接收到的第一偏壓電壓VB_1或VB_2來產生閘極驅動信號GL_1~GL_P。
在本實施例中，偏壓產生器111_1、111_2可以使用移位暫存器(Shift Register)來實施，信號輸出電路112_1~112_P可以使用上拉電路(pull-up circuit)與下拉電路(pull-down circuit)的組合，以調整偏壓產生器111_1或111_2產生的第一偏壓電壓VB_1或VB_2。依照設計需求，群組GP_1中的信號輸出電路112_1~112_R可以相同，群組GP_2中的信號輸出電路112_R+1~112_P可以相同，不同群組GP_1、GP_2中的信號輸出電路112_1~112_P可以不相同(例如群組GP_1中的信號輸出電路112_1與群組GP_2中的信號輸出電路112_R+1)。關於偏壓產生器111_1、111_2以及信號輸出電路112_1~112_P的實施細節，可以參照後述的多個實施例。在其他實施例中，閘極驅動電路110可以包含其他數量的偏壓產生器以及信號輸出電路，本發明不在此設限。
值得一提的是，本發明的顯示面板，透過將閘極驅動電路以多個偏壓產生器以及對應的多個信號輸出電路來設置，並產生多個閘極驅動信號至掃描線。如此一來，可以大幅減少顯示面板的邊框面積，同時改善閘極驅動電路的充放電能力。
關於圖1示例中偏壓產生器111_1、111_2的實施方式，請參照圖2。圖2繪示本發明一實施例的偏壓產生器的示意圖。在圖2中，偏壓產生器211包含第一上拉電路213、第二上拉電路 214、第一下拉電路215、第二下拉電路216以及輸出級電路217。偏壓產生器211用以產生第一偏壓電壓Gn。在一實施例中，偏壓產生器211還可以提供第二控制電壓Pn以作為第二偏壓電壓。偏壓產生器211可以將第一偏壓電壓Gn及/或第二控制電壓Pn輸出至對應群組中的多個信號輸出電路。
在本實施例中，第一上拉電路213接收第一電壓VGHD以及前級偏壓電壓(例如在本實施例中是前四級偏壓電壓Gn-4，但本發明不以為限)，並用以拉升第一控制電壓Qn。第二上拉電路214接收第一時脈信號CK1，並用以拉升第二控制電壓Pn。第一下拉電路215接收起始信號ST、第二控制電壓Pn及/或後級偏壓電壓(例如在本實施例中是後四級偏壓電壓Gn+4，但本發明不以為限)，並用以拉低第一控制電壓Qn。第二下拉電路216接收起始信號ST及/或第一控制電壓Qn，並用以拉低第二控制電壓Pn。輸出級電路217接收第一控制電壓Qn以及第二控制電壓Pn，並用以產生第一偏壓電壓Gn。
在細節上，第一上拉電路213由電晶體T1所構成。電晶體T1的第一端接收第一電壓VGHD，電晶體T1的控制端(閘極)接收前級偏壓電壓Gn-4，使電晶體T1可以基於第一電壓VGHD以依據前級偏壓電壓Gn-4來拉升電晶體T1的第二端上的第一控制電壓Qn。第二上拉電路214由電容C1所構成。電容C1的第一端接收時脈信號CK1，使電容C1可以依據時脈信號CK1來拉升電容C2的第二端上的第二控制電壓Pn。
第一下拉電路215包括電晶體T2、T5、T6。電晶體T2、T5、T6的第一端共同接收第一控制電壓Qn，電晶體T2、T5、T6的第二端共同接收第二電壓VSSQ，電晶體T2、T5、T6的控制端(閘極)分別接收起始信號ST、第二控制電壓Pn以及後級偏壓電壓Gn+4。使電晶體T2、T5、T6可以依據起始信號ST、第二控制電壓Pn及後級偏壓電壓Gn+4來拉低第一控制電壓Qn。
第二下拉電路216包括電晶體T3、T4。電晶體T3、T4的第一端共同接收第二控制電壓Pn，電晶體T3、T4的第二端共同接收第二電壓VSSQ，電晶體T3、T4的控制端(閘極)分別接收起始信號ST以及第一控制電壓Qn。使電晶體T3、T4可以依據起始信號ST以及第一控制電壓Qn來拉低第二控制電壓Pn。
輸出級電路217可以為緩衝器。例如在本實施例中，輸出級電路217包括電晶體T7、T8。電晶體T7的第一端接收第一時脈信號CK1，電晶體T7的控制端(閘極)接收第一控制電壓Qn。電晶體T8的第一端耦接至電晶體T7的第二端，電晶體T8的第二端接收第三電壓VSSG，電晶體T8的控制端(閘極)接收第二控制電壓Pn。使電晶體T7、T8可以依據第一控制電壓Qn以及第二控制電壓Pn來在電晶體T7的第二端上產生第一偏壓電壓Gn。
關於圖1示例中信號輸出電路112_1~112_P的實施方式，請參照圖3A至圖3C。圖3A至圖3C繪示本發明不同實施例的信號輸出電路的示意圖。圖3A至圖3C中的信號輸出電路312均用以接收多個第二時脈信號CK2_1~CK2_x，以依據前述的偏壓 產生器(例如圖2所示的偏壓產生器211)產生的第一偏壓電壓Gn及/或作為第二偏壓電壓的第二控制電壓Pn，來產生對應的閘極驅動信號GL1~GLx。
在圖3A中，信號輸出電路312包含緩衝器318_1~318_x。緩衝器318_1~318_x分別為電晶體T9_1~T9_x與T10_1~T10_x的組合。以緩衝器318_1為例，電晶體T9_1的第一端接收第二時脈信號CK2_1。電晶體T10_1的第一端耦接至電晶體T9_1的第二端。電晶體T9_1的控制端以及電晶體T10_1的第二端共同接收第一偏壓電壓Gn。電晶體T10_1的控制端接收第二控制電壓Pn。使緩衝器318_1可以依據第一偏壓電壓Gn以及第二控制電壓Pn來在電晶體T9_1的第二端上產生對應的閘極驅動信號GL1。其餘緩衝器318_2~318_x中的元件耦接方式可以依此類推，本發明不再贅述。
在圖3B中，信號輸出電路312包含緩衝器319_1~319_x。緩衝器319_1~319_x分別為電晶體T9_1~T9_x與T10_1~T10_x的組合。以緩衝器319_1為例，電晶體T9_1的第一端接收第二時脈信號CK2_1。電晶體T10_1可以耦接為二極體組態，所構成的二極體的陽極耦接至電晶體T9_1的第二端，所構成的二極體的陰極與電晶體T9_1的控制端共同接收第一偏壓電壓Gn。使緩衝器319_1可以僅依據第一偏壓電壓Gn來在電晶體T9_1的第二端上產生對應的閘極驅動信號GL1。緩衝器319_1並可以透過電晶體T10_1以依據閘極驅動信號GL1及第一偏壓電壓Gn來維持閘極驅 動信號GL1的電壓值。其餘緩衝器319_2~319_x中的元件耦接方式可以依此類推，本發明不再贅述。
在圖3C中，信號輸出電路312包括多級電壓產生器320_1~320_x。電壓產生器320_1~320_x分別包括電晶體T9_1~T9_x、T10_1~T10_x、T11_1~T11_x、T12_1~T12_x以及電容C2_1~C2_x。以電壓產生器320_1為例，電晶體T9_1的第一端接收第二時脈信號CK2_1。電晶體T10_1的第一端耦接至電晶體T9_1的第二端，電晶體T9_1的控制端與電晶體T10_1的第二端共同接收第一偏壓電壓Gn。電晶體T11_1與T12_1的第一端共同耦接至電晶體T10_1的控制端，電晶體T11_1與T12_1的第二端共同接收第三電壓VSSG。電晶體T11_1與電晶體T12_1的控制端分別接收第一偏壓電壓Gn與起始信號ST。電容C2_1耦接在電晶體T9_1的第一端以及電晶體T10_1的控制端之間。使電壓產生器320_1可以依據第一偏壓電壓Gn來在電晶體T9_1的第二端上產生對應的閘極驅動信號GL1。其餘電壓產生器320_2~320_x中的元件耦接方式可以依此類推，本發明不再贅述。
請參照圖4。圖4繪示本發明一實施例的顯示面板的示意圖。在圖4中，顯示面板400包括實線繪示的閘極驅動電路410、第一輔助電路420、多條掃描線GL、多條閘極信號線SCL以及虛線繪示的第二輔助電路430。在其他實施例中，第一輔助電路420與第二輔助電路430可以擇其中之一設置，或均進行設置。第一輔助電路420與第二輔助電路430的元件組成可以相同或不相同。
在本實施例中，多條掃描線GL沿著第一方向DIR1設置於顯示面板400上。閘極驅動電路410沿著與第一方向DIR1交錯的第二方向DIR2設置於顯示面板400的第一側邊SID1(例如顯示面板400的天側)。第一輔助電路420及/或第二輔助電路430沿著第一方向DIR1分別設置於顯示面板400的第二側邊SID2(例如顯示面板400的天側之外的三個側邊)及/或相對於第二側邊SID2的第三側邊SID3，並分別耦接至多條掃描線GL。在本實施例中，第一方向DIR1與第二方向DIR2垂直，但本發明不以為限。其中，閘極驅動電路410可以依據前述多個實施例的偏壓產生器以及信號輸出電路來組成，並透過多條閘極信號線SCL耦接至多條掃描線GL。閘極驅動電路410可以產生多個閘極驅動信號給掃描線GL，以透過掃描線GL來驅動顯示面板400上對應的畫素進行顯示。第一輔助電路420及/或第二輔助電路430可以透過掃描線GL來補償閘極驅動電路410產生的多個閘極驅動信號。
在此請特別注意，在本實施例中，本發明可以透過將閘極驅動電路410設置在顯示面板400的天側，並將第一輔助電路420及/或第三輔助電路430設置在靠近天側的兩側。如此一來，可以大幅減少顯示面板400天側的邊框面積，以達到窄邊框的要求，還可以改善閘極驅動電路410的充放電能力。舉例而言，假設顯示面板400的尺寸為65吋，並使用一條資料線一條閘極線(one data line and one gate line，1D1G)的驅動方式，則在解析度為4K2K(即3840*2160畫素)時，本發明顯示面板400的天側 邊框面積可以減少約61%，在解析度為8K4K(即7680*4320畫素)時，本發明顯示面板400的天側邊框面積可以減少約81%。
關於圖4示例中第一輔助電路420及/或第二輔助電路430的實施方式，請參照圖5A至圖5D。圖5A至圖5D繪示本發明不同實施例的輔助電路的示意圖。在此請特別注意，依照設計需求，第一輔助電路420及/或第二輔助電路430可以分別包含圖5A至圖5D中的輔助電路521~524中的一個或多個或任何組合，以補償由閘極驅動電路410產生的閘極驅動信號，本發明不在此設限。
在圖5A與圖5B中，輔助電路521、522用以提供閘極驅動信號GLX對掃描線進行充電前的預充電路徑，使閘極驅動信號GLX上拉至高電位(在圖5A示例中為第一電壓VGHD，在圖5B示例中為第二時脈信號CK2，但本發明不以為限)的速度可以被提升。換言之，輔助電路521、522可以是上拉電路，並且可以依照設計需求，選擇要基於電壓還是時脈信號來拉升閘極驅動信號GLX，而不會同時受到電壓與時脈信號設定的限制。
在細節上，在圖5A中，輔助電路521由電晶體T13所構成。電晶體T13的第一端接收第一電壓VGHD，電晶體T13的第二端接收閘極驅動信號GLX，電晶體T13的控制端接收前級閘極驅動信號(例如在本實施例中為前五級閘極驅動信號GLX-5，但本發明不以為限)。使輔助電路521可以基於第一電壓VGHD以依據前級閘極驅動信號GLX-5來拉升閘極驅動信號GLX。在圖5B中，輔 助電路522包括電晶體T13、T14以及電容C3。電晶體T13的第一端接收第二時脈信號CK2，電晶體T13的第二端接收閘極驅動信號GLX。電晶體T14可以耦接為二級體組態，所構成的二極體的陽極接收前級閘極驅動信號(例如在本實施例中為前五級閘極驅動信號GLX-5，但本發明不以為限)，所構成的二極體的陰極耦接至電晶體T13的控制端。電容C3可以耦接在電晶體T13的控制端與第二端之間。使輔助電路522可以基於第二時脈信號CK2以依據前級閘極驅動信號GLX-5來拉升閘極驅動信號GLX。
在圖5C中，輔助電路523用以提供在閘極驅動信號GLX對掃描線進行放電時的額外放電路徑，使閘極驅動信號GLX下拉至低電位(在本實施例中為第三電壓VSSG，但本發明不以為限)的速度可以被提升。在本實施例中，輔助電路523由電晶體T15所構成，電晶體T15的第一端接收閘極驅動信號GLX，電晶體T15的第二端接收第三電壓VSSG，電晶體T15的控制端接收後級閘極驅動信號(例如在本實施例中為後五級閘極驅動信號GLX+5，但本發明不以為限)。換言之，輔助電路523可以是下拉電路，並且可以基於第三電壓VSSG以依據後級閘極驅動信號GLX+5來拉低閘極驅動信號GLX。
在圖5D中，輔助電路524用以提供在閘極驅動信號GLX對掃描線進行放電時的穩壓路徑，以避免受串擾影響產生突波(fluctuation)，使閘極驅動信號GLX下拉至低電位(在本實施例中為第三電壓VSSG，但本發明不以為限)的速度可以被提升。在 本實施例中，輔助電路524由多級電壓控制器524_1、524_2所構成。電壓控制器524_1、524_2分別包括電晶體T16~T22以及T23~T29。以電壓控制器524_1為例，電晶體T16的第一端接收閘極驅動信號GLX。電晶體T17的第二端耦接至電晶體T16的控制端。電晶體T18與T20的第一端共同耦接至電晶體T17的第二端。電晶體T19與T22的第一端共同耦接至電晶體T17的控制端。電晶體T21可以耦接為二極體組態，所構成的二極體的陽極與電晶體T17的第一端共同接收第三時脈信號CK3_1，所構成的二極體的陰極耦接至電晶體T17的控制端。電晶體T18與T19的控制端共同接收閘極驅動信號GLX。電晶體T20與T22的控制端共同接收前級閘極驅動信號(例如在本實施例中為前二級閘極驅動信號GLX-2，但本發明不以為限)。電晶體T16、T18~T20與T22的第二端共同接收第三電壓VSSG。使電壓控制器524_1可以基於第三電壓VSSG以依據前級閘極驅動信號GLX-2以及閘極驅動信號GLX來補償閘極驅動信號GLX。電壓控制器542_2中的元件耦接方式可以依此類推，本發明不再贅述。
在此請特別注意，本發明可以依據設計需求，使用上述圖5A至圖5D的實施例中不同的輔助電路521~524的組合來組成如圖4所示的第一輔助電路420及/或第二輔助電路430。其中，輔助電路521與522可以依據前級閘極驅動信號GLX-5來提供掃描線上預充電的輔助功能，使閘極驅動信號GLX上拉至高電位的速度可以被提升。輔助電路523可以依據後級閘極驅動信號GLX+5 來提供掃描線上快速放電的輔助功能，使閘極驅動信號GLX下拉至低電位的速度可以被提升。輔助電路524可以依據前級閘極驅動信號GLX-2、閘極驅動信號GLX以及第三時脈信號CK3_1、CK3_2來對閘極驅動信號GLX進行穩壓，使閘極驅動信號GLX下拉至低電位的速度可以被提升。如此一來，第一輔助電路420及/或第二輔助電路430可以依據設計需求來對閘極驅動信號GLX進行補償，進而改善閘極驅動電路的充放電能力。
請同時參照圖1與圖6，圖6繪示本發明一實施例的時脈信號的時序圖。閘極驅動電路110可以透過時序控制的方式來依序驅動偏壓產生器111_1、111_2與對應的信號輸出電路112_1~112_P，以控制閘極驅動信號GL_1~GL_P對掃描線的充放電時間。例如圖6中的第一時脈信號CK1_1~CK1_8可以用來依序驅動八個偏壓產生器，第二時脈信號CK2_1~CK2_8可以用來依序驅動八個信號輸出電路。以圖1中的閘極驅動電路110為例，偏壓產生器111_1、111_2可以分別接收第一時脈信號CK1_1與CK1_2以依序被驅動。偏壓產生器111_1對應的群組GP_1中的信號輸出電路112_1~112_8(在此示例中R=8)可以分別接收第二時脈信號CK2_1~CK2_8以依序被驅動。因此，當第一時脈信號CK1_1被拉升即偏壓產生器111_1被驅動後，可以再依據第二時脈信號CK2_1~CK2_8以依序驅動信號輸出電路112_1~112_8。在本實施例中，第一時脈信號CK1_1~CK1_8的兩兩間具有一預設的相位差，且第一時脈信號CK1_1被拉高後，第二時脈信號 CK2_1~CK2_8可依序被拉高，但上述時脈信號的數量只是用來說明的範例，並不用以限制本發明。
請參照圖7，圖7繪示本發明一實施例的顯示面板的部分架構的示意圖。在圖7中，顯示面板700包括第一輔助電路720以及顯示區域750。顯示區域750至少包括由畫素725_1、725_x組成的畫素陣列以及掃描線GLa~GLd。其中掃描線GLa~GLd分別提供閘極驅動信號GLX-3~GLX。畫素725_1、725_x可以分別依據掃描線GLa、GLd上提供的閘極驅動信號GLX-3、GLX來驅動具有不同波長的(例如紅、綠、藍(RGB))像素以進行顯示。第一輔助電路720設置於顯示區域750的側邊，第一輔助電路720至少包括一條電源軌線、電晶體T30_1~T30_4以及導電路徑721~724。在本實施例中，電源軌線用以傳輸第一電壓VGHD，在其他實施例中，電源軌線也可以用來傳輸時脈信號或其他電壓。
在本實施例中，電晶體T30_1~T30_4的第一端共同耦接至電源軌線以接收第一電壓VGHD，電晶體T30_1~T30_4的第二端分別耦接至掃描線GLa~GLd以對閘極驅動信號GLX-3~GLX進行補償。電晶體T30_1~T30_4的控制端(閘極)可以接收前級或後級閘極驅動信號。舉例而言，電晶體T30_4的控制端可以依據導電路徑721至724接收閘極驅動信號GLX-3以作為前級閘極驅動信號，以基於第一電壓VGHD和前級閘極驅動信號GLX-3來拉升閘極驅動信號GLX。因此，可以依照設計需求，設計第一輔助電路720的電路結構，使其可以基於其他電壓或時脈信號，以依據前N級 或後N級閘極驅動信號來補償閘極驅動信號GLX(N>0)。例如在本實施例中，線寬A的寬度可以為8微米(μm)，線距B的寬度可以為10微米，若顯示面板的單邊邊框被限制為900微米，則電晶體T30_1~T30_4至多可以接收到前50級或後50級閘極驅動信號(N=50)。
在上述多個實施例中，電晶體T1~T29、T30_1~T30_4可例如是薄膜電晶體(Thin Film Transistor,TFT)。第一電壓VGHD可以為直流的閘極高電位，第二電壓VSSQ以及第三電壓VSSG可以為接地電位。
綜上所述，本發明提出的顯示面板，將閘極驅動電路沿著與掃描線設置方向交錯的另一方向設置於顯示面板的側邊，並透過多個偏壓產生器以及對應多個信號輸出電路，來產生多個閘極驅動信號至掃描線。如此一來，可以大幅減少顯示面板的邊框面積，同時改善閘極驅動電路的充放電能力。
雖然本發明已以實施例揭露如上，然其並非用以限定本發明，任何所屬技術領域中具有通常知識者，在不脫離本發明的精神和範圍內，當可作些許的更動與潤飾，故本發明的保護範圍當視後附的申請專利範圍所界定者為準。
110:閘極驅動電路
111_1、111_2:偏壓產生器
112_1~112_P:信號輸出電路
GL_1~GL_P:閘極驅動信號
GP_1、GP_2:群組
VB_1、VB_2:第一偏壓電壓

Claims (12)

  1. 一種顯示面板，包括：多條掃描線，沿著一第一方向設置於該顯示面板上，分別提供多個閘極驅動信號；以及一閘極驅動電路，沿著與該第一方向交錯的一第二方向設置於該顯示面板的一第一側邊，該閘極驅動電路包括多個偏壓產生器以及多個信號輸出電路，該些信號輸出電路區分為多個群組，該些偏壓產生器分別對應該些群組，該些偏壓產生器產生多個第一偏壓電壓，該些群組分別依據該些第一偏壓電壓以產生該些閘極驅動信號。
  2. 如請求項1所述的顯示面板，其中各該偏壓產生器包括：一第一上拉電路，基於一第一電壓以依據一前級偏壓電壓來拉升一第一控制電壓；一第二上拉電路，依據一第一時脈信號以拉升一第二控制電壓；一第一下拉電路，依據一起始信號、該第二控制電壓及/或一後級偏壓電壓以拉低該第一控制電壓；一第二下拉電路，依據該起始信號及/或該第一控制電壓以拉低該第二控制電壓；以及 一輸出級電路，依據該第一控制電壓以及該第二控制電壓以產生對應群組的各該第一偏壓電壓。
  3. 如請求項2所述的顯示面板，其中該第一上拉電路為一上拉電晶體，其第一端接收該第一電壓，該上拉電晶體的控制端接收該前級偏壓電壓，用以拉升該上拉電晶體的第二端上的該第一控制電壓；該第二上拉電路為一上拉電容，其第一端接收該第一時脈信號，用以拉升該上拉電容的第二端上的該第二控制電壓；該第一下拉電路包括多個第一下拉電晶體，該些第一下拉電晶體的第一端接收該第一控制電壓，該些第一下拉電晶體的第二端接收一第二電壓，該些第一下拉電晶體的控制端分別接收該起始信號、該第二控制電壓及該後級偏壓電壓，以拉低該第一控制電壓；該第二下拉電路包括多個第二下拉電晶體，該些第二下拉電晶體的第一端接收該第二控制電壓，該些第二下拉電晶體的第二端接收該第二電壓，該些第二下拉電晶體的控制端分別接收該起始信號及該第一控制電壓，以拉低該第二控制電壓；以及該輸出級電路為一緩衝器，該緩衝器接收該第一時脈信號以及一第三電壓，以依據該第一控制電壓以及該第二控制電壓來產生對應群組的各該第一偏壓電壓。
  4. 如請求項2所述的顯示面板，其中各該偏壓產生器更提供該第二控制電壓以作為一第二偏壓電壓，其中相同群組中的各該信號輸出電路包括：多個緩衝器，分別接收多個第二時脈信號，該些緩衝器依據該第一偏壓電壓以及該第二偏壓電壓以分別產生對應的該些閘極驅動信號。
  5. 如請求項2所述的顯示面板，其中相同群組中的各該信號輸出電路包括：多個緩衝器，分別接收多個第二時脈信號，該些緩衝器僅依據該第一偏壓電壓以分別產生對應的該些閘極驅動信號，並依據該些閘極驅動信號以及該第一偏壓電壓來維持該些閘極驅動信號的電壓值。
  6. 如請求項2所述的顯示面板，其中相同群組中的各該信號輸出電路包括：多級電壓產生器，分別產生對應的該些閘極驅動信號，其中各該電壓產生器包括：一第一電晶體，其第一端接收一第二時脈信號，該第一電晶體的控制端接收該第一偏壓電壓；一第二電晶體，其第一端耦接至該第一電晶體的第二端，該第二電晶體的第二端接收該第一偏壓電壓； 一第三電晶體以及一第四電晶體，該第三電晶體與該第四電晶體的第一端均耦接至該第二電晶體的控制端，該第三電晶體與該第四電晶體的第二端均接收一第三電壓，該第三電晶體的控制端接收該第一偏壓電壓，該第四電晶體的控制端接收該起始信號；以及一電容，耦接在該第一電晶體的第一端以及該第二電晶體的控制端間。
  7. 如請求項1所述的顯示面板，還包括：一第一輔助電路，沿著該第一方向設置於該面板的一第二側邊，該第一輔助電路耦接至該些掃描線，用以補償該些信號輸出電路產生的該些閘極驅動信號。
  8. 如請求項7所述的顯示面板，其中該第一輔助電路包括：多個第一電晶體，基於一第一電壓或一第二時脈信號以依據多個前級閘極驅動信號來拉升該些閘極驅動信號。
  9. 如請求項8所述的顯示面板，其中該第一輔助電路更包括：多個第二電晶體，分別耦接為多個二極體，該些二極體分別具有多個陰極分別耦接至該些第一電晶體的控制端，以及該些二極體的多個陽極分別接收該些前級閘極驅動信號；以及 多個電容，分別耦接在該些第一電晶體的控制端以及第二端間。
  10. 如請求項7所述的顯示面板，其中該第一輔助電路包括：多個第一電晶體，基於一第三電壓以依據多個後級閘極驅動信號來拉低該些閘極驅動信號。
  11. 如請求項7所述的顯示面板，其中該第一輔助電路包括：多級電壓控制器，基於多個第三時脈信號以依據一前級閘極驅動信號來補償該些閘極驅動信號，其中各該電壓控制器包括：一第一電晶體，其第一端接收對應的各該閘極驅動信號；一第二電晶體，其第二端耦接至該第一電晶體的控制端；一第三電晶體以及一第四電晶體，該第三電晶體與該第四電晶體的第一端均耦接至該第二電晶體的第二端；一第五電晶體以及一第六電晶體，該第五電晶體與該第六電晶體的第一端均耦接至該第二電晶體的控制端；一第七電晶體，耦接為二極體組態，具有陰極耦接至該第二電晶體的控制端，以及具有陽極與第二電晶體的第一端共同接收對應的各該第三時脈信號， 其中，該第三電晶體與該第五電晶體的控制端均接收對應的各該閘極驅動信號，該第四電晶體與該第六電晶體的控制端均接收該前級閘極驅動信號，該第一電晶體、第三電晶體、第四電晶體、第五電晶體以及第六電晶體的第二端均接收一第三電壓。
  12. 如請求項7所述的顯示面板，還包括：多個第二輔助電路，沿著該第一方向設置於該面板相對於該第二側邊的一第三側邊，該些第二輔助電路耦接至該些掃描線，用以補償該些信號輸出電路產生的該些閘極驅動信號。
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