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TWI717983B - 適合窄邊框應用的顯示面板與相關的掃描驅動電路 - Google Patents

適合窄邊框應用的顯示面板與相關的掃描驅動電路 Download PDF

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TWI717983B
TWI717983B TW109102501A TW109102501A TWI717983B TW I717983 B TWI717983 B TW I717983B TW 109102501 A TW109102501 A TW 109102501A TW 109102501 A TW109102501 A TW 109102501A TW I717983 B TWI717983 B TW I717983B
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董哲維
林煒力
林禹佐
張家銘
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友達光電股份有限公司
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Abstract

一種掃描驅動電路包含多級移位暫存單元與多個閘極控制電路。多級移位暫存單元設置於顯示面板的周邊區，且用於接收多個第一時脈訊號。多個閘極控制電路設置於顯示面板的主動區，且用於接收多個第二時脈訊號。主動區包含耦接於顯示面板的多個閘極線的多個畫素電路。每級移位暫存單元用於將多個第一時脈訊號中對應的一者作為控制訊號提供至多個閘極控制電路中對應的N者。多個閘極控制電路中對應的N者用於依據控制訊號將多個第二時脈訊號中對應的M者分別作為M個閘極訊號，並將M個閘極訊號分別提供至多個閘極線中對應的M者，且M和N為正整數。

Description

適合窄邊框應用的顯示面板與相關的掃描驅動電路
本揭示文件有關一種顯示面板，尤指一種適合窄邊框應用的顯示面板與相關的掃描驅動電路。
窄邊框設計常被應用於個人電腦的螢幕或家用電視中，以在玩遊戲或觀賞電影時營造視覺沉浸感。另外，高頻寬通訊技術的蓬勃發展促使了高畫質影音串流的普及化。因此，高解析度(例如，4K)與窄邊框已成為消費者選購顯示器的基本要求。相較於傳統的顯示器，高畫質顯示器具有更高的像素密度(Pixel Per Inch，簡稱PPI)，因而需要使用具有更多階級的掃描驅動電路。然而，階級數多的掃描驅動電路將不利於縮減顯示器的邊框厚度。
本揭示文件提供一種掃描驅動電路，其包含多級移位暫存單元與多個閘極控制電路。多級移位暫存單元設置於顯示面板的周邊區，且用於接收多個第一時脈訊號。多個閘極控制電路設置於顯示面板的主動區，且用於接收多個第二時脈訊號。主動區包含多個畫素電路，且多個畫素電路耦接於顯示面板的多個閘極線。每級移位暫存單元耦接於多個閘極控制電路中對應的多者，且用於將多個第一時脈訊號中對應的一者作為控制訊號提供至多個閘極控制電路中對應的N者。多個閘極控制電路中對應的N者耦接於多個閘極線中對應的M者，並用於依據控制訊號將多個第二時脈訊號中對應的M者分別作為M個閘極訊號，且將M個閘極訊號分別提供至多個閘極線中對應的M者，M和N為正整數。
本揭示文件另提供一種顯示面板，其包含設置於主動區的多個畫素電路、多個控制線、多個閘極線與掃描驅動電路。多個控制線與多個閘極線自周邊區延伸至主動區。掃描驅動電路包含多級移位暫存單元與多個閘極控制電路。多級移位暫存單元設置於周邊區，且用於接收多個第一時脈訊號。多個閘極控制電路設置於主動區，且用於接收多個第二時脈訊號。每級移位暫存單元透過多個控制線中對應的M者耦接於多個閘極控制電路中對應的N者，並用於將多個第一時脈訊號中對應的一者作為控制訊號，且用於透過多個控制線中對應的M者將控制訊號提供至多個閘極控制電路中對應的N者。多個閘極控制電路中對應的N者耦接於多個閘極線中對應的M者，並用於依據控制訊號將多個第二時脈訊號中對應的M者分別作為M個閘極訊號，且將M個閘極訊號分別提供至多個閘極線中對應的M者，M和N為正整數。
上述的掃描驅動電路與顯示面板有助於縮減顯示器邊框寬度。
以下將配合相關圖式來說明本揭示文件的實施例。在圖式中，相同的標號表示相同或類似的元件或方法流程。
第1圖為依據本揭示文件一實施例的顯示面板100簡化後的功能方塊圖。顯示面板100包含掃描驅動電路110、多個畫素電路120、多個閘極線GL、多個資料線SL、多個控制線EL、多個第一時脈線CLa與多個第二時脈線CLb，其中多個第一時脈線CLa用於對應地傳遞多個第一時脈訊號CK1~CK4，而多個第二時脈線CLb用於對應地傳遞多個第二時脈訊號HC1~HC8。多個畫素電路120設置於顯示面板100的主動區AA內，且對應地設置於多個閘極線GL與多個資料線SL的交叉處。顯示面板100會提供資料訊號至多個資料線SL以指定每個畫素電路120的灰階值(亮度)，且每個畫素電路120會依據一對應的閘極線GL上的訊號決定接收資料訊號的時間點。換言之，主動區AA是指多個畫素電路120排列成矩陣以顯示畫面的區域。
掃描驅動電路110包含多級移位暫存單元1121~112n與多個閘極控制電路114。移位暫存單元1121~112n設置於顯示面板100的周邊區PA，其中周邊區PA圍繞主動區AA。多個閘極控制電路114設置於主動區AA，且每個閘極控制電路114設置於對應的一第二時脈線CLb與對應的一控制線EL的交叉處。為方便說明，本揭示文件將使用移位暫存單元112指稱移位暫存單元1121~112n中的不特定任意一者。
每級移位暫存單元112用於自第一時脈線CLa接收第一時脈訊號CK1~CK4中的對應一者，並耦接於對應的四個控制線EL，且透過每一個控制線EL耦接於一個對應的閘極控制電路114，但本實施例不以此為限。每個閘極控制電路114用於自第二時脈線CLb接收第二時脈訊號HC1~HC8中的對應一者，且透過閘極線GL耦接於對應的一列畫素電路120。互相耦接的移位暫存單元112與閘極控制電路114共同用於驅動對應的多列畫素電路120。
在一些實施例中，每級移位暫存單元112可基於實際需求耦接於不特定數量的控制線EL，且透過每一個控制線EL耦接於不特定數量的閘極控制電路114。例如，移位暫存單元112可以耦接於八個控制線EL，且可以透過每一個控制線EL耦接於兩個或兩個以上的閘極控制電路114以提升驅動能力。耦接於同一級移位暫存單元112且耦接於同一個控制線EL的任兩個個閘極控制電路114，會接收第二時脈訊號HC1~HC8中的同一者。另一方面，耦接於同一級移位暫存單元112但位於不同個閘極線GL上的任兩個閘極控制電路114，會接收第二時脈訊號HC1~HC8中的相異兩者。
雖然第1圖中相鄰的兩個第二時脈線CLb之間僅設置有一行畫素電路120，但於實作上，相鄰的兩個第二時脈線CLb之間可以設置有多行畫素電路120，以在主動區AA中平均設置閘極控制電路114。
第2圖為依據本揭示文件一實施例的顯示面板100的局部放大示意圖。如第2圖所示，每個閘極控制電路114包含第一電晶體T1與第二電晶體T2，其中第一電晶體T1與第二電晶體T2皆包含第一端、第二端與控制端。第一電晶體T1的第一端用於接收第二時脈訊號HC1~HC8中對應的一者。第一電晶體T1的第二端耦接於一對應的閘極線GL，且用於提供多個閘極訊號GP1~GP4中對應的一者。第一電晶體T1的控制端透過一對應的控制線EL耦接於一對應的移位暫存單元112。在本實施例中，畫素電路120包含三個分別用於提供紅色、綠色與藍色光線的子畫素，但本揭示文件不以此為限。實作上，畫素電路120中子畫素的數量以及顏色可以依據實際需求來設計。
值得注意的是，第2圖的多個閘極控制電路114是耦接於同一個移位暫存單元112，且用於透過控制線EL自該同一個移位暫存單元112接收相同的控制訊號CT。
第3圖為依據本揭示文件一實施例的控制訊號CT與閘極訊號GP1~GP4的波形示意圖。請同時參照第2圖與第3圖，當控制訊號CT具有邏輯高準位(logic high level)時，第一電晶體T1會導通以將第二時脈訊號HC1~HC8中對應的一者作為閘極訊號GP1~GP4中對應的一者輸出至閘極線GL，且第二電晶體T2也會隨之導通。第二時脈訊號HC1~HC8會如後述的第6圖所示般依序提供脈波。因此，閘極訊號GP1~GP4會依序切換至邏輯高準位，再依序切換至邏輯低準位(logic low level)，以依序驅動第2圖中的多列畫素電路120。
在本實施例中，為使第二時脈訊號HC1~HC8的波形能完整通過第一電晶體T1，控制訊號CT的最高電壓(或振幅)被設置為高於第二時脈訊號HC1~HC8每一者的最高電壓(或振幅)。另外，控制訊號CT的脈波寬度大於第二時脈訊號HC1~HC8(或者閘極訊號GP1~GP4)每一者的脈波寬度。
當控制訊號CT具有邏輯低準位時，第一電晶體T1與第二電晶體T2會處於關斷狀態。此時，若第一電晶體T1因為第二時脈訊號HC1~HC8的振盪而意外導通，第二電晶體T2會形成二極體耦接形式(diode-connected)之電晶體而將閘極線GL穩定於接近控制訊號CT的邏輯低準位。
第4圖為依據本揭示文件另一實施例的顯示面板100的局部放大示意圖。第4圖的閘極控制電路114相似於第2圖的閘極控制電路114，差異在於，第4圖的閘極控制電路114的第二電晶體T2的控制端，是耦接於第一電晶體T1的第一端。
第5圖為依據本揭示文件一實施例的移位暫存單元500的電路示意圖。第1圖的移位暫存單元1121~112n的每一者可以由移位暫存單元500來實現，且移位暫存單元500包含輸出節點NO[i]、驅動節點NQ、穩壓節點NP、第三電晶體T3、第四電晶體T4、電壓輸入電路510與穩壓電路520。輸出節點NO[i]用於提供控制訊號CT，並耦接於對應的多個控制線EL，且透過每個控制線EL耦接於對應的一或多個閘極控制電路114。例如，輸出節點NO[i]可以耦接第2圖中的所有控制線EL。
第三電晶體T3與第四電晶體T4皆包含第一端、第二端與控制端。第三電晶體T3的第一端用於接收多個第一時脈訊號CK1~CK4中對應的一者(例如，第一時脈訊號CK1)。第三電晶體T3的第二端耦接於輸出節點NO[i]。第三電晶體T3的控制端耦接於驅動節點NQ。亦即，第三電晶體T3用於將第一時脈訊號CK1~CK4中對應的一者提供至輸出節點NO[i]以作為控制訊號CT。第四電晶體T4的第一端耦接於驅動節點NQ。第四電晶體T4的第二端用於接收第一參考電壓VSSQ。第四電晶體T4的控制端耦接於後二級之移位暫存單元112的輸出節點NO[i+2]。
電壓輸入電路510用於依據前二級之移位暫存單元112的輸出節點NO[i-2]的電壓與起始訊號ST，將驅動節點NQ與穩壓節點NP設置為第一參考電壓VSSQ，或將驅動節點NQ設置為第二參考電壓VGHD。詳細而言，電壓輸入電路510包含第五電晶體T5、第六電晶體T6與第七電晶體T7，其中第五電晶體T5、第六電晶體T6與第七電晶體T7皆包含第一端、第二端與控制端。第五電晶體T5的第一端用於接收第二參考電壓VGHD。第五電晶體T5的第二端耦接於驅動節點NQ。第五電晶體T5的控制端耦接於前二級之移位暫存單元112的輸出節點NO[i-2]。第六電晶體T6的第一端耦接於驅動節點NQ。第六電晶體T6的第二端用於接收第一參考電壓VSSQ。第六電晶體T6的控制端用於接收起始訊號ST。第七電晶體T7的第一端耦接於穩壓節點NP。第七電晶體T7的第二端用於接收第一參考電壓VSSQ。第七電晶體T7的控制端用於接收起始訊號ST。
在本實施例中，起始訊號ST可以在每個圖框(frame)開始時提供脈波以導通第六電晶體T6與第七電晶體T7，進而重置驅動節點NQ與穩壓節點NP的電壓。
穩壓電路520用於依據第一時脈訊號CK1~CK4中對應的一者(例如，第一時脈訊號CK1)與穩壓節點NP的電壓穩定驅動節點NQ與輸出節點NO[i]的電壓。詳細而言，穩壓電路520包含第八電晶體T8、第九電晶體T9、第十電晶體T10與電容元件Cs，其中第八電晶體T8、第九電晶體T9與第十電晶體T10皆包含第一端、第二端與控制端。第八電晶體T8的第一端耦接於輸出節點NO[i]。第八電晶體T8的第二端用於接收第三參考電壓VSSG。第八電晶體T8的控制端耦接於穩壓節點NP。第九電晶體T9的第一端耦接於穩壓節點NP。第九電晶體T9的第二端用於接收第一參考電壓VSSQ。第九電晶體T9的控制端用於接收起始訊號ST。第十電晶體T10的第一端耦接於驅動節點NQ。第十電晶體T10的第二端用於接收第一參考電壓VSSQ。第十電晶體T10的控制端耦接於穩壓節點NP。電容元件Cs包含第一端和第二端，其中電容元件Cs的第一端用於接收第一時脈訊號CK1~CK4中對應的一者(例如，第一時脈訊號CK1)，電容元件Cs的第二端則耦接於穩壓節點NP。在一些實施例中，電容元件Cs的第一端接收到的時脈訊號，會與第三電晶體T3的第一端接收到的時脈訊號同相位，但電容元件Cs的第一端與第三電晶體T3的第一端無需用於接收相同的時脈訊號，而可以用於接收不同的時脈訊號。
第6圖為依據本揭示文件一實施例的第一時脈訊號CK1~CK4與第二時脈訊號HC1~HC8的波形示意圖。請同時參考第1圖與第6圖，當移位暫存單元112接收到的第一時脈訊號CK1~CK4中的對應一者具有邏輯高準位時，移位暫存單元112會輸出具有邏輯高準位的控制訊號CT。另一方面，當移位暫存單元112接收到的第一時脈訊號CK1~CK4中的對應一者具有邏輯低準位時，移位暫存單元112會輸出具有邏輯低準位的控制訊號CT。
例如，第1圖的移位暫存單元1121會在第一時脈訊號CK1具有邏輯高準位時輸出具有邏輯高準位的控制訊號CT。此時，耦接於移位暫存單元1121的閘極控制電路114會利用第二時脈訊號HC3~HC6分別做為閘極訊號GP1~GP4，以依序驅動對應的多列畫素電路120。
又例如，第1圖的移位暫存單元1122會在第一時脈訊號CK2具有邏輯高準位時輸出具有邏輯高準位的控制訊號CT。此時，耦接於移位暫存單元1122的閘極控制電路114會利用第二時脈訊號HC7~HC8和HC1~HC2分別做為閘極訊號GP1~GP4，以依序驅動對應的多列畫素電路120，其餘依此類推。
如前所述，為確保第二時脈訊號HC1~HC8的波形能完整傳遞至閘極線GL，第一時脈訊號CK1~CK4每一者的最高電壓(或振幅)會高於第二時脈訊號HC1~HC8每一者的最高電壓(或振幅)。
另外，第一時脈訊號CK1~CK4每一者的脈波寬度會大於第二時脈訊號HC1~HC8每一者的脈波寬度。
此外，若每級移位暫存單元112耦接於M個控制線EL，則於第一時脈訊號CK1~CK4每一者的一脈波期間，第二時脈訊號HC1~HC8提供的脈波數量會大於或等於M。例如，由於第1圖每級移位暫存單元112耦接於4個控制線EL，所以於第一時脈訊號CK1~CK4每一者的脈波期間，第二時脈訊號HC1~HC8提供的脈波數量等於8。藉由將第一時脈訊號CK1~CK4設計為具有較大的脈波寬度，可以避免第一時脈訊號CK1~CK4的上升邊緣與下降邊緣影響閘極控制電路114的輸出波形。
在上述多個實施例中，移位暫存單元112與閘極控制電路114的電晶體可以使用任何合適種類的N型電晶體來實現，例如薄膜電晶體(Thin-Film Transistor，簡稱TFT)、金氧半場效電晶體和雙極性接面電晶體等等。
在一些實施例中，移位暫存單元112與閘極控制電路114的電晶體也可以使用任何合適種類的P型電晶體來實現。此時，第一時脈訊號CK1~CK4與第二時脈訊號HC1~HC8可以具有與第6圖所示相反的波形。
綜上所述，有別於傳統的移位暫存單元僅能驅動一列畫素電路，本揭示文件的每級移位暫存單元112可以同時驅動多列畫素電路120。因此，顯示面板100僅需少量的移位暫存單元112，進而有助於縮減顯示器邊框寬度。
另外，本揭示文件的閘極控制電路114設置於閘極線GL的位置可以自由調整，以使閘極控制電路114平均分布於主動區AA內。因此，顯示面板100中於閘極線GL上傳遞的訊號具有低傳輸延遲。
在說明書及申請專利範圍中使用了某些詞彙來指稱特定的元件。然而，所屬技術領域中具有通常知識者應可理解，同樣的元件可能會用不同的名詞來稱呼。說明書及申請專利範圍並不以名稱的差異做為區分元件的方式，而是以元件在功能上的差異來做為區分的基準。在說明書及申請專利範圍所提及的「包含」為開放式的用語，故應解釋成「包含但不限定於」。另外，「耦接」在此包含任何直接及間接的連接手段。因此，若文中描述第一元件耦接於第二元件，則代表第一元件可通過電性連接或無線傳輸、光學傳輸等信號連接方式而直接地連接於第二元件，或者通過其他元件或連接手段間接地電性或信號連接至該第二元件。
另外，除非說明書中特別指明，否則任何單數格的用語都同時包含複數格的涵義。
以上僅為本揭示文件的較佳實施例，凡依本揭示文件請求項所做的均等變化與修飾，皆應屬本揭示文件的涵蓋範圍。
100:顯示面板
110:掃描驅動電路
112,1121~112n,500:移位暫存單元
114:閘極控制電路
120:畫素電路
CK1~CK4:第一時脈訊號
HC1~HC8:第二時脈訊號
CLa:第一時脈線
CLb:第二時脈線
EL:控制線
GL:閘極線
SL:資料線
PA:周邊區
AA:主動區
T1:第一電晶體
T2:第二電晶體
T3:第三電晶體
T4:第四電晶體
T5:第五電晶體
T6:第六電晶體
T7:第七電晶體
T8:第八電晶體 T9:第九電晶體 T10:第十電晶體 510:電壓輸入電路 520:穩壓電路 CT:控制訊號 GP1~GP4:閘極訊號 NO[i],NO[i-2],NO[i+2]:輸出節點 NQ:驅動節點 NP:穩壓節點 VSSQ:第一參考電壓 VGHD:第二參考電壓 VSSG:第三參考電壓 ST:起始訊號
第1圖為依據本揭示文件一實施例的顯示面板簡化後的功能方塊圖。 第2圖為依據本揭示文件一實施例的顯示面板的局部放大示意圖。 第3圖為依據本揭示文件一實施例的控制訊號與閘極訊號的波形示意圖。 第4圖為依據本揭示文件另一實施例的顯示面板的局部放大示意圖。 第5圖為依據本揭示文件一實施例的移位暫存單元的電路示意圖。 第6圖為依據本揭示文件一實施例的第一時脈訊號與第二時脈訊號的波形示意圖。
100:顯示面板
110:掃描驅動電路
1121~112n:移位暫存單元
114:閘極控制電路
120:畫素電路
CK1~CK4:第一時脈訊號
HC1~HC8:第二時脈訊號
CLa:第一時脈線
CLb:第二時脈線
EL:控制線
GL:閘極線
SL:資料線
PA:周邊區
AA:主動區

Claims (20)

  1. 一種掃描驅動電路，包含：多級移位暫存單元，設置於一顯示面板的一周邊區，且用於接收多個第一時脈訊號；以及多個閘極控制電路，設置於該顯示面板的一主動區，且用於接收多個第二時脈訊號，其中該主動區包含多個畫素電路，且該多個畫素電路耦接於該顯示面板的多個閘極線；其中每級移位暫存單元耦接於該多個閘極控制電路中對應的N者，且用於將該多個第一時脈訊號中對應的一者作為一控制訊號提供至該多個閘極控制電路中該對應的N者，該多個閘極控制電路中該對應的N者耦接於該多個閘極線中對應的M者，並用於依據該控制訊號將該多個第二時脈訊號中對應的M者分別作為M個閘極訊號，且將該M個閘極訊號分別提供至該多個閘極線中該對應的M者，M和N為正整數。
  2. 如請求項1所述之掃描驅動電路，其中，該多個閘極控制電路中該對應的N者的每一者包含：一第一電晶體，包含一第一端、一第二端和一控制端，其中該第一電晶體的該第一端用於接收該多個第二時脈訊號中對應的一者，該第一電晶體的該第二端耦接於該多個閘極線中該對應的M者的其中之一，該第一電晶體的該控 制端耦接於該移位暫存單元且用於接收該控制訊號；以及一第二電晶體，包含一第一端、一第二端和一控制端，其中該第二電晶體的該第一端與該第二電晶體的該控制端耦接於該第一電晶體的該第二端，該第二電晶體的該第二端耦接於該第一電晶體的該控制端。
  3. 如請求項1所述之掃描驅動電路，其中，該多個閘極控制電路中該對應的N者的每一者包含：一第一電晶體，包含一第一端、一第二端和一控制端，其中該第一電晶體的該第一端用於接收該多個第二時脈訊號中對應的一者，該第一電晶體的該第二端耦接於該多個閘極線中該對應的M者的其中之一，該第一電晶體的該控制端耦接於該移位暫存單元且用於接收該控制訊號；以及一第二電晶體，包含一第一端、一第二端和一控制端，其中該第二電晶體的該第一端耦接於該第一電晶體的該第二端，該第二電晶體的該第二端耦接於該第一電晶體的該控制端，該第二電晶體的該控制端耦接於該第一電晶體的該第一端。
  4. 如請求項1所述之掃描驅動電路，其中，該多個第一時脈訊號中該對應的一者的振幅大於該多個第二時脈訊號中該對應的M者的振幅。
  5. 如請求項1所述之掃描驅動電路，其中，該 多個第一時脈訊號中該對應的一者的一第一脈波寬度大於該多個第二時脈訊號中該對應的M者的一第二脈波寬度。
  6. 如請求項5所述之掃描驅動電路，其中，於該多個第一時脈訊號中該對應的一者的一脈波期間，該多個第二時脈訊號提供的脈波數量大於或等於M。
  7. 如請求項1所述之掃描驅動電路，其中，該多個閘極控制電路中該對應的N者中的二者皆耦接於該多個閘極線中該對應的M者的其中之一，且皆用於接收該多個第二時脈訊號中該對應的M者的其中之一。
  8. 如請求項1所述之掃描驅動電路，其中，每級移位暫存單元包含：一輸出節點，耦接於該多個閘極控制電路中該對應的N者，且用於提供該控制訊號；一驅動節點；一穩壓節點；一第三電晶體，包含一第一端、一第二端和一控制端，其中該第三電晶體的該第一端用於接收該多個第一時脈訊號中該對應的一者，該第三電晶體的該第二端耦接於該輸出節點，且該第三電晶體的該控制端耦接於該驅動節點；一第四電晶體，包含一第一端、一第二端和一控制端，其中該第四電晶體的該第一端耦接於該驅動節點，該第四 電晶體的該第二端用於接收一第一參考電壓，且該第四電晶體的該控制端耦接於一後二級之移位暫存單元的該輸出節點；一電壓輸入電路，用於依據一前二級之移位暫存單元的該輸出節點的電壓與一起始訊號將該驅動節點與該穩壓節點設置為該第一參考電壓，或將該驅動節點設置為一第二參考電壓；以及一穩壓電路，用於依據該多個第一時脈訊號中該對應的一者與該穩壓節點的電壓穩定該驅動節點與該輸出節點的電壓。
  9. 如請求項8所述之掃描驅動電路，其中，該電壓輸入電路包含：一第五電晶體，包含一第一端、一第二端和一控制端，其中該第五電晶體的該第一端用於接收該第二參考電壓，該第五電晶體的該第二端耦接於該驅動節點，該第五電晶體的該控制端耦接於該前二級之移位暫存單元的該輸出節點；一第六電晶體，包含一第一端、一第二端和一控制端，其中該第六電晶體的該第一端耦接於該驅動節點，該第六電晶體的該第二端用於接收該第一參考電壓，該第六電晶體的該控制端用於接收該起始訊號；以及一第七電晶體，包含一第一端、一第二端和一控制端，其中該第七電晶體的該第一端耦接於該穩壓節點，該第七 電晶體的該第二端用於接收該第一參考電壓，該第七電晶體的該控制端用於接收該起始訊號。
  10. 如請求項8所述之掃描驅動電路，其中，該穩壓電路包含：一第八電晶體，包含一第一端、一第二端和一控制端，其中該第八電晶體的該第一端耦接於該輸出節點，該第八電晶體的該第二端用於接收一第三參考電壓，該第八電晶體的該控制端耦接於該穩壓節點；一第九電晶體，包含一第一端、一第二端和一控制端，其中該第九電晶體的該第一端耦接於該穩壓節點，該第九電晶體的該第二端用於接收該第一參考電壓，該第九電晶體的該控制端用於接收該起始訊號；一第十電晶體，包含一第一端、一第二端和一控制端，該第十電晶體的該第一端耦接於該驅動節點，該第十電晶體的該第二端用於接收該第一參考電壓，該第十電晶體的該控制端耦接於該穩壓節點；以及一電容元件，包含一第一端和一第二端，其中該電容元件的該第一端用於接收該多個第一時脈訊號中該對應的一者或該多個第一時脈訊號中對應的另一者，該電容元件的該第二端耦接於該穩壓節點，且該多個第一時脈訊號中該對應的一者與該多個第一時脈訊號中該對應的另一者具有相同相位。
  11. 一種顯示面板，包含：多個畫素電路，設置於一主動區；多個控制線；多個閘極線，其中該多個控制線與該多個閘極線自一周邊區延伸至該主動區；以及一掃描驅動電路，包含：多級移位暫存單元，設置於該周邊區，且用於接收多個第一時脈訊號；以及多個閘極控制電路，設置於該主動區，且用於接收多個第二時脈訊號；其中每級移位暫存單元透過該多個控制線中對應的M者耦接於該多個閘極控制電路中對應的N者，並用於將該多個第一時脈訊號中對應的一者作為一控制訊號，且用於透過該多個控制線中該對應的M者將該控制訊號提供至該多個閘極控制電路中該對應的N者，該多個閘極控制電路中該對應的N者耦接於該多個閘極線中對應的M者，並用於依據該控制訊號將該多個第二時脈訊號中對應的M者分別作為M個閘極訊號，且將該M個閘極訊號分別提供至該多個閘極線中該對應的M者，M和N為正整數。
  12. 如請求項11所述之顯示面板，其中，該多個閘極控制電路中該對應的N者的每一者包含：一第一電晶體，包含一第一端、一第二端和一控制端， 其中該第一電晶體的該第一端用於接收該多個第二時脈訊號中對應的一者，該第一電晶體的該第二端耦接於該多個閘極線中該對應的M者的其中之一，該第一電晶體的該控制端透過該多個控制線中該對應的M者的其中之一耦接於該移位暫存單元且用於接收該控制訊號；以及一第二電晶體，包含一第一端、一第二端和一控制端，其中該第二電晶體的該第一端與該第二電晶體的該控制端耦接於該第一電晶體的該第二端，該第二電晶體的該第二端耦接於該第一電晶體的該控制端。
  13. 如請求項11所述之顯示面板，其中，該多個閘極控制電路中該對應的N者的每一者包含：一第一電晶體，包含一第一端、一第二端和一控制端，其中該第一電晶體的該第一端用於接收該多個第二時脈訊號中對應的一者，該第一電晶體的該第二端耦接於該多個閘極線中該對應的M者的其中之一，該第一電晶體的該控制端透過該多個控制線中該對應的M者的其中之一耦接於該移位暫存單元且用於接收該控制訊號；以及一第二電晶體，包含一第一端、一第二端和一控制端，其中該第二電晶體的該第一端耦接於該第一電晶體的該第二端，該第二電晶體的該第二端耦接於該第一電晶體的該控制端，該第二電晶體的該控制端耦接於該第一電晶體的該第一端。
  14. 如請求項11所述之顯示面板，其中，該多個第一時脈訊號中該對應的一者的振幅大於該多個第二時脈訊號中該對應的M者的振幅。
  15. 如請求項11所述之顯示面板，其中，該多個第一時脈訊號中該對應的一者的一第一脈波寬度大於該多個第二時脈訊號中該對應的M者的一第二脈波寬度。
  16. 如請求項15所述之顯示面板，其中，於該多個第一時脈訊號中該對應的一者的一脈波期間，該多個第二時脈訊號提供的脈波數量大於或等於M。
  17. 如請求項11所述之顯示面板，其中，該多個閘極控制電路中該對應的N者中的至少二者皆耦接於該多個閘極線中該對應的M者的其中之一，且皆用於接收該多個第二時脈訊號中該對應的M者的其中之一。
  18. 如請求項11所述之顯示面板，其中，每級移位暫存單元包含：一輸出節點，耦接於該多個控制線中該對應的M者，且用於提供該控制訊號；一驅動節點；一穩壓節點；一第三電晶體，包含一第一端、一第二端和一控制端， 其中該第三電晶體的該第一端用於接收該多個第一時脈訊號中該對應的一者，該第三電晶體的該第二端耦接於該輸出節點，且該第三電晶體的該控制端耦接於該驅動節點；一第四電晶體，包含一第一端、一第二端和一控制端，其中該第四電晶體的該第一端耦接於該驅動節點，該第四電晶體的該第二端用於接收一第一參考電壓，且該第四電晶體的該控制端耦接於一後二級之移位暫存單元的該輸出節點；一電壓輸入電路，用於依據一前二級之移位暫存單元的該輸出節點的電壓與一起始訊號將該驅動節點與該穩壓節點設置為該第一參考電壓，或將該驅動節點設置為一第二參考電壓；以及一穩壓電路，用於依據該多個第一時脈訊號中該對應的一者與該穩壓節點的電壓穩定該驅動節點與該輸出節點的電壓。
  19. 如請求項18所述之顯示面板，其中，該電壓輸入電路包含：一第五電晶體，包含一第一端、一第二端和一控制端，其中該第五電晶體的該第一端用於接收該第二參考電壓，該第五電晶體的該第二端耦接於該驅動節點，該第五電晶體的該控制端耦接於該前二級之移位暫存單元的該輸出節點；一第六電晶體，包含一第一端、一第二端和一控制端， 其中該第六電晶體的該第一端耦接於該驅動節點，該第六電晶體的該第二端用於接收該第一參考電壓，該第六電晶體的該控制端用於接收該起始訊號；以及一第七電晶體，包含一第一端、一第二端和一控制端，其中該第七電晶體的該第一端耦接於該穩壓節點，該第七電晶體的該第二端用於接收該第一參考電壓，該第七電晶體的該控制端用於接收該起始訊號。
  20. 如請求項18所述之顯示面板，其中，該穩壓電路包含：一第八電晶體，包含一第一端、一第二端和一控制端，其中該第八電晶體的該第一端耦接於該輸出節點，該第八電晶體的該第二端用於接收一第三參考電壓，該第八電晶體的該控制端耦接於該穩壓節點；一第九電晶體，包含一第一端、一第二端和一控制端，其中該第九電晶體的該第一端耦接於該穩壓節點，該第九電晶體的該第二端用於接收該第一參考電壓，該第九電晶體的該控制端用於接收該起始訊號；一第十電晶體，包含一第一端、一第二端和一控制端，該第十電晶體的該第一端耦接於該驅動節點，該第十電晶體的該第二端用於接收該第一參考電壓，該第十電晶體的該控制端耦接於該穩壓節點；以及一電容元件，包含一第一端和一第二端，其中該電容元件的該第一端用於接收該多個第一時脈訊號中該對應的 一者或該多個第一時脈訊號中對應的另一者，該電容元件的該第二端耦接於該穩壓節點，且該多個第一時脈訊號中該對應的一者與該多個第一時脈訊號中該對應的另一者具有相同相位。
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