TWI413971B - 驅動晶片之建立時間及保持時間調整電路 - Google Patents
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Description
本發明涉及一種驅動晶片的調整電路，特別涉及一種液晶監視器內驅動晶片的建立時間和保持時間的調整電路。
液晶監視器中驅動晶片(Source IC)在接收資料之前具有一段建立時間(setup time)，它的定義為低擺幅差分訊號(RSDS，Reduced swing differential signal)開始傳送到驅動晶片起到第一個低擺幅差分訊號開始的時間，這段時間為低擺幅差分訊號從零到有即低擺幅差分訊號由零升高到高電位所需要的準備時間。當低擺幅差分訊號準備好之後，即在第一個低擺幅差分訊號開始時，驅動晶片開始抓取低擺幅差分訊號，保持時間(hold time)即是為了能夠讓驅動晶片抓取到正確的低擺幅差分訊號。
由於習知所使用的液晶監視器的刷新頻率基本上皆為60HZ或者75HZ，故將建立時間和保持時間設定為一固定值即可。然，隨著對液晶監視器的品質要求的不斷增加，需要透過增加監視器的刷新頻率來彌補液晶監視器的動態模糊(Motion blur)等不足，如此則需要將建立時間和保持時間縮短。且，當用戶自定義刷新頻率時，無法做到建立時間和保持時間自動更新。
鑒於以上內容，有必要提供一種能根據液晶監視器的刷新頻率自動調整驅動晶片的建立時間和保持時間的電路。
一種驅動晶片的建立時間和保持時間調整電路，包括：一控制器，用於接收一刷新頻率訊號；一記憶體，用於存儲複數不同刷新頻率訊號及其所對應的最佳建立時間和保持時間；一偵測器，用於對輸入控制器的刷新頻率訊號進行偵測，以得到刷新頻率訊號的時鐘頻率，該控制器還用於將得到的時鐘頻率與記憶體中刷新頻率及其最佳建立時間和保持時間進行比對，以得到該刷新頻率所對應的最佳建立時間和保持時間，並根據該最佳建立時間和保持時間產生對應的控制訊號；以及一控制電路，用於接收控制器輸出的控制訊號，並產生對應的偏斜值，該驅動晶片根據偏斜值完成對建立時間及保持時間的設定。
一種驅動晶片的建立時間和保持時間調整電路，包括：一時序控制器，用於接收一刷新頻率訊號；一記憶體，用於存儲複數不同刷新頻率訊號及其所對應的最佳建立時間和保持時間；以及一偵測器，用於對輸入時序控制器的刷新頻率訊號進
行偵測，以得到刷新頻率訊號的時鐘頻率，並將得到的時鐘頻率輸出給該時序控制器；其中，該時序控制器還用於將得到的時鐘頻率與記憶體中刷新頻率及其最佳建立時間和保持時間進行比對，以得到該刷新頻率所對應的最佳建立時間和保持時間，並根據該最佳建立時間和保持時間產生對應的時序控制訊號以輸出給驅動晶片。
一種驅動晶片的建立時間和保持時間調整電路，包括：一時序控制器，用於接收一刷新頻率訊號；一記憶體，用於存儲複數驅動晶片在複數不同刷新頻率訊號下所對應的最佳建立時間和保持時間；以及一偵測器，用於對輸入時序控制器的刷新頻率訊號進行偵測，以得到刷新頻率訊號的時鐘頻率，並將得到的時鐘頻率輸出給該時序控制器；其中，該時序控制器還用於將得到的時鐘頻率與記憶體中每一驅動晶片在不同刷新頻率訊號下所對應的最佳建立時間和保持時間進行比對，以得到該驅動晶片在該刷新頻率下所對應的最佳建立時間和保持時間，並根據該最佳建立時間和保持時間產生對應的時序控制訊號以輸出給對應的驅動晶片。
前述驅動晶片的建立時間和保持時間調整電路透過控制器或時序控制器偵測液晶監視器的刷新頻率，並將其與存儲於記憶體內部的最佳建立時間和保持時間進行比對，然後據此輸出對應的控制訊號或者直接輸出時序訊號至驅
動晶片，從而可使得驅動晶片根據不同的刷新頻率具有不同的最佳建立時間和保持時間。
請參閱圖1，本發明驅動晶片的建立時間和保持時間調整電路用於根據液晶監視器的刷新頻率自動調整驅動晶片的建立時間和保持時間，其第一較佳實施方式包括一控制器10、一記憶體12、一偵測器15以及一控制電路16。
該控制器10與記憶體12、偵測器15以及控制電路16均相連，還用於接收液晶監視器的刷新頻率訊號。
該記憶體12中存儲有複數不同刷新頻率及其所對應的最佳建立時間和保持時間。用戶可事先將複數不同刷新頻率下驅動晶片所對應的最佳建立時間和保持時間透過測量的方法得出，並將其存儲於該記憶體12中。本實施方式中，該記憶體12為一電可讀寫可編程唯讀記憶體(EEPROM)。
該偵測器15用於對輸入控制器10的刷新頻率進行偵測，以得知此時所輸入的訊號的時鐘頻率，並將偵測得到的時鐘頻率傳送至控制器10，該時鐘頻率即為液晶監視器的刷新頻率。該控制器10將得到的時鐘頻率與存儲在記憶體12中的刷新頻率及其最佳建立時間和保持時間進行比對，以得到該刷新頻率所對應的最佳建立時間和保持時間，並根據該最佳建立時間和保持時間產生對應的控制訊
號。
該控制電路16包括四個場效應電晶體Q1-Q4以及四個電阻R1-R4，該場效應電晶體Q1-Q4的閘極對應與該控制器10的四個輸出端相連。該場效應電晶體Q1的汲極與數位電源DVDD相連，源極依次透過電阻R1及R2與場效應電晶體Q2的汲極相連，該場效應電晶體Q2的源極接地。該場效應電晶體Q3的汲極與數位電源DVDD相連，源極依次透過電阻R3與R4與場效應電晶體Q4的汲極相連，該場效應電晶體Q4的源極接地。本實施方式中，電阻R1-R4的阻值均為1K歐姆。其中，電阻R1和R2之間的電平值即為第一偏斜(Skew)值，電阻R3和R4之間的電平值即為第二偏斜值。該第一偏斜值及第二偏斜值均用於輸出給驅動晶片，該驅動晶片可根據接收的第一及第二偏斜值設定對應的建立時間及保持時間。其中，第一及第二偏斜值與建立時間及保持時間的對應關係如下表：
上表中T代表一個完整的低擺幅差分訊號週期(RSDS clock cycle)。當場效應電晶體Q1及Q3均不導通、場效應電晶體Q2及Q4導通時，該第一及第二偏斜值均為0，此時驅動晶片的建立時間為T/16-T/2、保持時間為T/16；當場效應電晶體Q1不導通、場效應電晶體Q2導通、場效應電晶體Q3導通、場效應電晶體Q4不導通時，該第一偏斜值為0、第二偏斜值為1，此時驅動晶片的建立時間為2T/16-T/2、保持時間為2T/16；當場效應電晶體Q1及Q4導通、場效應電晶體Q2及Q3均不導通時，該第一偏斜值為1、第二偏斜值為0，此時驅動晶片的建立時間為3T/16-T/2、保持時間為3T/16。其他情形依此類推。
第一較佳實施方式中，透過控制器10輸出對應的控制訊號控制四個場效應電晶體Q1-Q4的導通與截止，以得到對應的第一偏斜值及第二偏斜值，從而可實現對驅動晶片的最佳建立時間和保持時間的選擇。比如，當偵測器15偵測到輸入的訊號的時鐘頻率為60HZ時，該控制器10從記憶體12中得知此刷新頻率下最佳建立時間與保持時間分別為4T/16-T/2、4T/16，則該控制器10產生對應的控制訊
號(1，1，0，0)，並輸出該控制訊號至控制電路16，使得場效應電晶體Q1及Q3導通、場效應電晶體Q2及Q4不導通，從而使得第一及第二偏斜值均為“1”，此時，該驅動晶片接收到第一及第二偏斜值均為“1”，則其建立時間將被設定為4T/16-T/2，保持時間為4T/16。
請參閱圖2，本發明驅動晶片的建立時間和保持時間調整電路的第二較佳實施方式包括一時序控制器20、一記憶體22以及一偵測器25。
該時序控制器20與記憶體22、偵測器25以及一驅動晶片26均相連，還用於接收液晶監視器的刷新頻率訊號。
該記憶體22中存儲有複數不同刷新頻率及其所對應的最佳建立時間和保持時間。用戶可事先將複數不同頻率下驅動晶片的最佳建立時間和保持時間透過測量的方法得出，並將其存儲於該記憶體22中。本實施方式中，該記憶體22為一電可讀寫可編程唯讀記憶體。
該偵測器25用於對輸入時序控制器20的刷新頻率進行偵測，以得知此時所輸入的訊號的時鐘頻率，並將偵測得到的時鐘頻率傳送至時序控制器20，該時鐘頻率即為液晶監視器的刷新頻率。該時序控制器20將得到的時鐘頻率與存儲在記憶體22中的刷新頻率及其所對應的最佳建立時間和保持時間進行比對，以得到該刷新頻率所對應的最佳建立時間和保持時間，並根據得到的最佳建立時間和保
持時間輸出對應的時序訊號至驅動晶片26，即可實現最佳的建立時間和保持時間。
第二較佳實施方式中，該時序控制器20根據得到的最佳建立時間和保持時間直接輸出時序訊號給驅動晶片26，從而可實現對最佳建立時間和保持時間的選擇。
請參閱圖3，本發明驅動晶片的建立時間和保持時間調整電路的第三較佳實施方式包括一時序控制器30、一記憶體32以及一偵測器35。
該時序控制器30與記憶體32、偵測器35以及複數驅動晶片36均相連，還用於接收液晶監視器的刷新頻率訊號。
該記憶體32中存儲有每一驅動晶片36在複數不同刷新頻率下所對應的最佳建立時間和保持時間。用戶可事先將每一驅動晶片36在複數不同頻率下所對應的最佳建立時間和保持時間透過測量的方法得出，並將其存儲於該記憶體32中。本實施方式中，該記憶體32為一電可讀寫可編程唯讀記憶體。
該偵測器35用於對輸入時序控制器30的刷新頻率進行偵測，以得知此時所輸入的訊號的時鐘頻率，並將偵測得到的時鐘頻率傳送至時序控制器30，該時鐘頻率即為液晶監視器的刷新頻率。該時序控制器30將得到的時鐘頻率與存儲在記憶體32中的每一驅動晶片36的刷新頻率及其
對應的最佳建立時間和保持時間進行比對，以得到該刷新頻率下每一驅動晶片36所對應的最佳建立時間和保持時間，並根據得到的最佳建立時間和保持時間輸出對應的時序訊號至對應的驅動晶片36，即可實現每一驅動晶片36均擁有最佳的建立時間和保持時間。
第三較佳實施方式中，該時序控制器30根據得到的每一驅動晶片36的最佳建立時間和保持時間直接輸出對應的時序訊號給不同的驅動晶片36，從而可實現對最佳建立時間和保持時間的選擇。
前述驅動晶片的建立時間和保持時間調整電路透過控制器或時序控制器偵測液晶監視器的刷新頻率，並將其與存儲於記憶體內部的最佳建立時間和保持時間進行比對，然後據此輸出對應的控制訊號或者直接輸出時序訊號至驅動晶片，從而可使得驅動晶片根據不同的刷新頻率具有不同的最佳建立時間和保持時間。
綜上所述，本發明符合發明專利要件，爰依法提出專利申請。惟，以上所述者僅為本發明之較佳實施例，舉凡熟悉本案技藝之人士，在爰依本發明精神所作之等效修飾或變化，皆應涵蓋於以下之申請專利範圍內。
10‧‧‧控制器
12、22、32‧‧‧記憶體
15、25、35‧‧‧偵測器
16‧‧‧控制電路
DVDD‧‧‧數位電源
Q1-Q4‧‧‧場效應電晶體
R1-R4‧‧‧電阻
20、30‧‧‧時序控制器
26、36‧‧‧驅動晶片
圖1是本發明驅動晶片的建立時間和保持時間調整電路的第一較佳實施方式的示意圖。
圖2是本發明驅動晶片的建立時間和保持時間調整電路的第二較佳實施方式的示意圖。
圖3是本發明驅動晶片的建立時間和保持時間調整電路的第三較佳實施方式的示意圖。
10‧‧‧控制器
12‧‧‧記憶體
15‧‧‧偵測器
16‧‧‧控制電路
DVDD‧‧‧數位電源
Q1-Q4‧‧‧場效應電晶體
R1-R4‧‧‧電阻
Claims (1)
- 一種驅動晶片的建立時間和保持時間調整電路，包括：一控制器，用於接收一刷新頻率訊號；一記憶體，用於存儲複數不同刷新頻率訊號及其所對應的最佳建立時間和保持時間；一偵測器，用於對輸入控制器的刷新頻率訊號進行偵測，以得到刷新頻率訊號的時鐘頻率，該控制器還用於將得到的時鐘頻率與記憶體中刷新頻率及其最佳建立時間和保持時間進行比對，以得到該刷新頻率所對應的最佳建立時間和保持時間，並根據該最佳建立時間和保持時間產生對應的控制訊號；以及一控制電路，用於接收控制器輸出的控制訊號，並產生對應的偏斜值，該驅動晶片根據偏斜值完成對建立時間及保持時間的設定，其中該控制電路包括第一至第四場效應電晶體以及第一至第四電阻，該第一至第四場效應電晶體的閘極與該控制器的四個輸出端對應相連，該第一場效應電晶體的汲極與一數位電源相連，源極依次透過第一及第二電阻與第二場效應電晶體的汲極相連，該第二場效應電晶體的源極接地，該第三場效應電晶體的汲極與數位電源相連，源極依次透過第三及第四電阻與第四場效應電晶體的汲極相連，該第四場效應電晶體的源極接地。
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