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TWI465891B - 供電延遲電路 - Google Patents

供電延遲電路 Download PDF

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TWI465891B
TWI465891B TW100116443A TW100116443A TWI465891B TW I465891 B TWI465891 B TW I465891B TW 100116443 A TW100116443 A TW 100116443A TW 100116443 A TW100116443 A TW 100116443A TW I465891 B TWI465891 B TW I465891B
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delay circuit
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delay
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guo-yi Chen
Wen-Sen Hu
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Hon Hai Prec Ind Co Ltd
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Description

供電延遲電路
本發明涉及一種電路技術，特別涉及一種供電延遲電路。
傳統的供電電路都是同時向多個負載提供電能，而在負載上電的瞬間將產生較大的瞬間衝擊電流，這樣一方面使供電電路中的瞬間電流較大，容易造成供電電路的燒毀；另外一方面將引起提供電能給供電電路的供電電網的瞬間電壓波動，可能對供電電網造成損壞。
有鑑於此，有必要提供一種能使多個負載分時啟動的供電延遲電路。
一種供電延遲電路，其用於對多個負載供電；所述供電延遲電路包括一第一供電電路、一第二供電電路及一第三供電電路，所述每個供電電路均與一觸發端相連接；各供電電路均包括一開關單元，所述開關單元包括一第一端、一第二端及一用於控制第一端和第二端的通斷的控制端，所述第一端與一電源相連接，所述第二端與一負載相連接，所述控制端與所述觸發端相連接；第二供電電路與第三供電電路均還包括一延時電路，所述延時電路連接於所述觸發端與所述開關單元的第一端之間；該第三供電電路中的延時電路的延時時間大於第二供電電路中的延時電路的延時時 間。
與先前技術相比，本發明提供的供電延遲電路通過在第二供電電路和第三供電電路中分別設置延時時間不相同的延時電路，使得分別與第一、第二、第三供電電路相連接的負載分時啟動，有效降低了多個負載因同時啟動所產生的瞬間大電流對整個供電電路的影響。
100‧‧‧供電延遲電路
200‧‧‧負載
10‧‧‧控制晶片
11‧‧‧觸發端
20‧‧‧第一供電電路
21‧‧‧開關單元
211‧‧‧第一端
212‧‧‧第二端
213‧‧‧控制端
30‧‧‧第二供電電路
31‧‧‧延時電路
U1‧‧‧延時晶片
SENSE‧‧‧基準端
CT‧‧‧偵測端
MR‧‧‧輸入端
RESET‧‧‧輸出端
VDD‧‧‧電源端
GND‧‧‧接地端
R1‧‧‧第一電阻
C1‧‧‧第一電容
C2‧‧‧第二電容
R2‧‧‧第二電阻
R3‧‧‧第三電阻
C3‧‧‧第三電容
40‧‧‧第三供電電路
Vcc‧‧‧電源
P3V3‧‧‧電壓源
圖1為本發明實施方式提供的供電延遲電路的功能模組圖。
圖2為圖1中的供電延遲電路的延時電路的電路圖。
下面將結合附圖與實施例對本技術方案作進一步詳細說明。
如圖1所示，為本發明實施方式提供的一種供電延遲電路100，其用於對多個負載200供電。所述供電延遲電路100包括一控制晶片10、一第一供電電路20、一第二供電電路30及一第三供電電路40。
所述控制晶片10為一單片機，其包括多個觸發端11。該控制晶片10內設有控制程式，其可以根據程式指令同時從所述多個觸發端11輸出觸發信號，也可分時從所述多個觸發端11輸出觸發信號。本實施方式中，所述觸發信號為高電平信號，例如，+5V。
所述第一供電電路20包括一開關單元21，所述開關單元21包括一第一端211、一第二端212及一用於控制第一端211和第二端212的通斷的控制端213。所述第一端211與一電源Vcc相連接，所述第二端212與一負載200相連接，所述控制端213與所述觸發端11相 連接。本實施方式中，所述開關單元21為一NPN型三極管，所述第一端211為集電極，所述第二端212為發射極，所述控制端213為基極。
如圖2所示，所述第二供電電路30與第三供電電路40均還包括一延時電路31，所述延時電路31連接於所述觸發端11與所述開關單元21的第一端211之間。所述延時電路31包括一延時晶片U1、一第一電阻R1、一第一電容C1、一第二電容C2、一第二電阻R2、一第三電阻R3及一第三電容C3。所述延時晶片U1包括一基準端SENSE、一偵測端CT、一輸入端MR、一輸出端RESET、一電源端VDD及一接地端GND。所述輸入端MR與觸發端11相連接，所述輸出端RESET與所述開關單元21的控制端213相連接，所述電源端VDD與一電壓源P3V3相連接，所述接地端GND接地。所述第一電阻R1的一端與所述電壓源P3V3相連接，另一端與所述基準端SENSE相連接。所述第一電容C1的一端與所述基準端SENSE相連接，另一端接地。所述第二電容C2的一端與所述偵測端CT相連接，另一端接地。所述第二電阻R2連接在所述輸入端MR和電源端VDD之間。所述第三電阻R3連接在所述輸出端RESET與電源端VDD之間。所述第三電容C3的一端與所述電源端VDD相連接，另一端接地。
所述延時電路31通過改變所述第二電容C2的參數以變化該延時電路31的延時時間。當所述輸入端MR接收到所述觸發信號時，與所述偵測端CT相連接的第二電容C2開始進行充電，當所述偵測端CT的電壓高於基準端SENSE的電壓時，所述輸入端MR與輸出端RESET相導通。
所述第三供電電路40中的延時電路31的延時時間大於第二供電電 路30中的延時電路31的延時時間，即所述第三供電電路40中的第二電容C2的電容量大於所述第二供電電路30中的第二電容C2的電容量。
可以理解，所述供電延遲電路100還包括第四、第五等多個供電電路，且每個供電電路中的延時電路31的延時時間均不相同，從而實現多個負載200的分時啟動。
在使用過程中，所述控制晶片10同時通過所述觸發端11向所述第一、第二、第三供電電路20、30、40發出觸發信號。所述第一供電電路20中的開關單元21的控制端213接收到所述觸發信號後，所述第一端211和第二端212相導通，所述電源Vcc向連接在所述第二端212的負載200提供電能。同時，所述第二供電電路30中的延時晶片U1的輸入端MR接收到所述觸發信號，所述第二電容C2開始進行充電。當所述偵測端CT的電壓高於基準端SENSE的電壓時，所述輸入端MR與輸出端RESET相導通，所述觸發信號延時輸入到第二供電電路30中的開關單元21的控制端213，並相對於第一供電電路20延時向與第二供電電路30相連接的負載200提供電能。同理，由於所述第三供電電路40的延時時間大於所述第二供電電路30的延時時間，使得第三供電電路40相對於第二供電電路30延時向與第三供電電路40相連接的負載200提供電能。
本發明提供的供電延遲電路通過在第二供電電路和第三供電電路中分別設置延時時間不相同的延時電路，使得分別與第一、第二、第三供電電路相連接的負載分時啟動，有效降低了負載在同時啟動時產生的瞬間電流對電路的影響。
綜上所述，本發明確已符合發明專利之要件，遂依法提出專利申 請。惟，以上所述者僅為本發明之較佳實施方式，自不能以此限制本案之申請專利範圍。舉凡熟悉本案技藝之人士援依本發明之精神所作之等效修飾或變化，皆應涵蓋於以下申請專利範圍內。
100‧‧‧供電延遲電路
200‧‧‧負載
10‧‧‧控制晶片
11‧‧‧觸發端
20‧‧‧第一供電電路
21‧‧‧開關單元
211‧‧‧第一端
212‧‧‧第二端
213‧‧‧控制端
30‧‧‧第二供電電路
31‧‧‧延時電路
40‧‧‧第三供電電路
Vcc‧‧‧電源

Claims (5)

  1. 一種供電延遲電路，其用於對多個負載供電；所述供電延遲電路包括一第一供電電路、一第二供電電路及一第三供電電路，所述每個供電電路均與一觸發端相連接；各供電電路均包括一開關單元，所述開關單元包括一第一端、一第二端及一用於控制第一端和第二端的通斷的控制端，所述第一端與一電源相連接，所述第二端與一負載相連接，所述控制端與所述觸發端相連接；第二供電電路與第三供電電路均還包括一延時電路，所述延時電路連接於所述觸發端與所述開關單元的第一端之間；該第三供電電路中的延時電路的延時時間大於第二供電電路中的延時電路的延時時間；所述延時電路包括一延時晶片、一第一電阻、一第一電容及一第二電容，所述延時晶片包括一基準端、一偵測端、一輸入端及一輸出端，所述第一電阻的一端與一電壓源相連接，另一端與基準端相連接，所述第一電容的一端與基準端相連接，另一端接地，所述第二電容的一端與偵測端相連接，另一端接地，所述輸入端與觸發端相連接，所述輸出端與所述開關單元的控制端相連接，當所述偵測端的電壓高於基準端的電壓時，所述輸入端與輸出端相導通。
  2. 如申請專利範圍第1項所述的供電延遲電路，其中：所述延時電路還包括一第二電阻、一第三電阻及一第三電容；所述延時晶片還包括一電源端及一接地端，所述電源端與所述電壓源相連接，所述接地端接地；所述第二電阻連接在所述輸入端和電源端之間；所述第三電阻連接在所述輸出端與電源端之間；所述第三電容的一端與所述電源端相連接，另一端接地。
  3. 如申請專利範圍第2項所述的供電延遲電路，其中：所述延時電路通過改 變所述第二電容的參數以改變該延時電路的延時時間。
  4. 如申請專利範圍第1項所述的供電延遲電路，其中：所述開關單元為一NPN型三極管，所述第一端為集電極，所述第二端為發射極，所述控制端為基極。
  5. 如申請專利範圍第1項所述的供電延遲電路，其中：所述供電延遲電路還包括一控制晶片，所述控制晶片包括多個所述觸發端，並同時向多個所述觸發端發出觸發信號。
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