TWI395315B - 在超高壓元件的高壓路徑上提供esd保護的結構 - Google Patents
在超高壓元件的高壓路徑上提供esd保護的結構 Download PDFInfo
- Publication number
- TWI395315B TWI395315B TW099113056A TW99113056A TWI395315B TW I395315 B TWI395315 B TW I395315B TW 099113056 A TW099113056 A TW 099113056A TW 99113056 A TW99113056 A TW 99113056A TW I395315 B TWI395315 B TW I395315B
- Authority
- TW
- Taiwan
- Prior art keywords
- metal layer
- high voltage
- type well
- contact
- horizontal section
- Prior art date
Links
Classifications
-
- H10W20/493—
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D30/00—Field-effect transistors [FET]
- H10D30/60—Insulated-gate field-effect transistors [IGFET]
- H10D30/601—Insulated-gate field-effect transistors [IGFET] having lightly-doped drain or source extensions, e.g. LDD IGFETs or DDD IGFETs
- H10D30/603—Insulated-gate field-effect transistors [IGFET] having lightly-doped drain or source extensions, e.g. LDD IGFETs or DDD IGFETs having asymmetry in the channel direction, e.g. lateral high-voltage MISFETs having drain offset region or extended drain IGFETs [EDMOS]
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D64/00—Electrodes of devices having potential barriers
- H10D64/20—Electrodes characterised by their shapes, relative sizes or dispositions
- H10D64/23—Electrodes carrying the current to be rectified, amplified, oscillated or switched, e.g. sources, drains, anodes or cathodes
- H10D64/251—Source or drain electrodes for field-effect devices
- H10D64/257—Source or drain electrodes for field-effect devices for lateral devices wherein the source or drain electrodes are characterised by top-view geometrical layouts, e.g. interdigitated, semi-circular, annular or L-shaped electrodes
-
- H10W42/80—
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D62/00—Semiconductor bodies, or regions thereof, of devices having potential barriers
- H10D62/10—Shapes, relative sizes or dispositions of the regions of the semiconductor bodies; Shapes of the semiconductor bodies
- H10D62/13—Semiconductor regions connected to electrodes carrying current to be rectified, amplified or switched, e.g. source or drain regions
- H10D62/149—Source or drain regions of field-effect devices
- H10D62/151—Source or drain regions of field-effect devices of IGFETs
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D89/00—Aspects of integrated devices not covered by groups H10D84/00 - H10D88/00
- H10D89/60—Integrated devices comprising arrangements for electrical or thermal protection, e.g. protection circuits against electrostatic discharge [ESD]
- H10D89/601—Integrated devices comprising arrangements for electrical or thermal protection, e.g. protection circuits against electrostatic discharge [ESD] for devices having insulated gate electrodes, e.g. for IGFETs or IGBTs
- H10D89/911—Integrated devices comprising arrangements for electrical or thermal protection, e.g. protection circuits against electrostatic discharge [ESD] for devices having insulated gate electrodes, e.g. for IGFETs or IGBTs using passive elements as protective elements
Landscapes
- Semiconductor Integrated Circuits (AREA)
- Design And Manufacture Of Integrated Circuits (AREA)
Description
本發明係有關一種超高壓元件(ultra-high voltage device),特別是關於一種為超高壓元件提供靜電放電(Electro-Static Discharge;ESD)保護的結構。
在本文中,超高壓係指500V以上的電壓。圖1係習知的超高壓元件的垂直剖面圖,在P型基板10上形成P型磊晶層12,其上形成P型井14與高壓N型井16,高壓N型井16上成長氧化物28,從其未覆蓋的開口摻雜而形成接觸區18,其經接點柱20、第一金屬層22、導孔26及第二金屬層24等結構而連接到高壓端HV,此即超高壓元件之高壓路徑。高壓N型井16使超高壓元件具有較高的崩潰電壓,以便提供高壓操作。
超高壓元件通常具有非常巨大的尺寸,而ESD保護結構會增加電路佈局的尺寸,因此不適合再施作於超高壓元件上。即使超高壓元件的尺寸已經非常巨大,但是仍然不能達到最小的ESD要求,其問題在於超高壓元件的不均勻。由於ESD是一種大電流的現象,超高壓元件不均勻處將導致電流的聚集使電流無法均勻分散。參考圖2,其中的上圖係圖1的超高壓元件的布局圖,下圖係該布局中的部份區域30的局部放大,在水平剖面上,連接柱20具有長條形狀的結構。圖2中的接觸區末端32為超高壓元件常見的不均勻處,當有ESD般的大電流通過時將造成電流的聚集,同時產生相當大的熱導致局部高溫而使超高壓元件熔毀。只要超高壓元件的高壓路徑有任一區段熔毀,該超高壓元件便失去承受高壓的能力而無法繼續使用。
目前尚未有為超高壓元件的高壓路徑提供ESD保護的技術,只能依賴超高壓元件的自身保護結構。
本發明的目的之一,在於提出一種為超高壓元件提供ESD保護的結構。
根據本發明,一種超高壓元件的高壓路徑建立於從高壓N型井經第一金屬層至第二金屬層,在該高壓N型井及第一金屬層之間有連接柱,其在水平剖面上具有分散式的結構以提高該超高壓元件的均勻度,使該高壓路徑上的電流均勻地散佈,因而避免電流分佈不均勻所導致的局部熱聚集的情況發生,降低該超高壓元件的損毀率。
較佳者,更包含多個熔絲裝置彼此獨立地連接該第一金屬層,該熔絲裝置含有多晶矽熔絲在承載的電流過大時熔毀。
圖3係本發明之第一實施例,其垂直剖面圖與圖1相同,但是連接柱20在水平剖面上具有分散式的結構,接觸區18在水平剖面上隨形於連接柱20,因而呈現點狀分布的多個隔離島區域。此分散式的結構可以提高超高壓元件的均勻度,使高壓路徑上的電流均勻地散佈,當有ESD般的大電流通過時,因而避免電流分佈不均勻所導致的局部熱聚集的情況發生,降低超高壓元件的損毀率。在此實施例中,要形成分開的接觸區18及分散式的連接柱20,只要改變其定義的圖案即可,因此不會增加製程的步驟,也不會增加電路的尺寸。
圖4及圖5係本發明之第二實施例的垂直剖面圖與局部布局圖,除了連接柱20在水平剖面上具有分散式的結構,更增加多個熔絲裝置40於高壓路徑上。每一熔絲裝置40包含多晶矽熔絲42,其兩端分別經接點柱44及46連接第一金屬層22的第一部份48及第二部份50。第一部份48及第二部份50都是第一金屬層22的一部份,但是彼此隔離。因為第二金屬層24經多個導孔26與第一金屬層22的每一第二部份50連接,所以全部的熔絲裝置40係並聯在接觸區18及第二金屬層24之間。由於接點柱20、44、46、第一金屬層22及第二金屬層24皆是金屬材質,因此適當長度的多晶矽熔絲42在遭受過大電流時會先行毀損。當流經某一區段的多晶矽熔絲42的電流到達其飽和電流時,多晶矽熔絲42會變成一具有高阻抗的電阻,迫使電流流往其他未達飽和電流的多晶矽熔絲42,雖然電壓可能持續增加但是電流不會再增加,因此電流便均勻的分佈在所有的熔絲裝置多晶矽熔絲42上。即使某一區段的多晶矽熔絲42上的電流超過其飽和電流時,則電流會先將該區段的多晶矽熔絲42熔毀而形成斷路,因此電流就不會流向接觸區18,避免接觸區18燒毀形成短路,而其餘具有完好的多晶矽熔絲42的區段仍能使超高壓元件正常動作。多晶矽熔絲42係由多晶矽層提供,接點柱44及46係在製作接點柱20時一併形成,因此本實施例不會增加製程的步驟。熔絲裝置40係配置在氧化物28的上方,因此不會擴大電路布局。
圖6係結合前述兩實施例的第三實施例,除了圖5的結構,接觸區18也跟隨著連接柱20個別地獨立分開,因而呈現點狀分布的多個隔離島區域。
如以上各實施例所示,本發明在不改變超高壓元件的尺寸、電流電壓特性及製程的情況下,將其ESD性能改善到可接受的程度。
以上對於本發明之較佳實施例所作的敘述係為闡明之目的,而無意限定本發明精確地為所揭露的形式,基於以上的教導或從本發明的實施例學習而作修改或變化是可能的,實施例係為解說本發明的原理以及讓熟習該項技術者以各種實施例利用本發明在實際應用上而選擇及敘述,本發明的技術思想由以下的申請專利範圍及其均等來決定。
10...P型基板
12...P型磊晶層
14...P型井
16...高壓N型井
18...接觸區
20...接點柱
22...第一金屬層
24...第二金屬層
26...導孔
28...氧化物
30...超高壓元件的局部區域
32...接觸區末端
40...熔絲裝置
42...多晶矽熔絲
44...接點柱
46...接點柱
48...第一金屬層的第一部份
50...第一金屬層的第二部份
圖1係習知的超高壓元件的垂直剖面圖;
圖2係習知的超高壓元件的水平面布局圖;
圖3係本發明之第一實施例的水平面布局圖;
圖4係本發明之第二實施例的垂直剖面圖;
圖5係本發明之第二實施例的水平面布局圖;以及
圖6係本發明之第三實施例的水平面布局圖。
16...高壓N型井
18...接觸區
20...接點柱
26...導孔
28...氧化物
Claims (3)
- 一種在超高壓元件的高壓路徑上提供ESD保護的結構,該高壓路徑係建立於從高壓N型井經第一金屬層至第二金屬層,該提供ESD保護的結構包含:連接柱連接於該高壓N型井及第一金屬層之間,在水平剖面上具有分散式的結構;以及接觸區在該高壓N型井上,供該連接柱電性接觸,且在該水平剖面上隨形於該連接柱而呈現點狀分布的多個隔離島區域。
- 一種在超高壓元件的高壓路徑上提供ESD保護的結構,該高壓路徑係建立於從高壓N型井經第一金屬層至第二金屬層,該提供ESD保護的結構包含:連續的接觸區在該高壓N型井上;第一連接柱在水平剖面上具有分散式的結構電性接觸該接觸區且連接該第一金屬層;以及多個熔絲裝置彼此獨立地連接該第一金屬層;其中,每一該熔絲裝置包含:由該第一金屬層提供的彼此隔離的第一部份及第二部份,該第一部份連接該第一連接柱,該第二部份經導孔連接該第二金屬層;第二及第三接點柱分別連接該第一金屬層的第一及第二部份;以及多晶矽熔絲連接該第二及第三接點柱。
- 一種在超高壓元件的高壓路徑上提供ESD保護的結構,該高壓路徑係建立於從高壓N型井經第一金屬層至第二金屬層,該提供ESD保護的結構包含:第一連接柱連接於該高壓N型井及第一金屬層之間,在水平剖面上具有分散式的結構;以及接觸區在該高壓N型井上,供該第一連接柱電性接觸,且在該水平剖面上隨形於該第一連接柱而呈現點狀分布的多個隔離島區域;以及多個熔絲裝置彼此獨立地連接該第一金屬層;其中,每一該熔絲裝置包含:由該第一金屬層提供的彼此隔離的第一部份及第二部份,該第一部份連接該第一連接柱,該第二部份經導孔連接該第二金屬層;第二及第三接點柱分別連接該第一金屬層的第一及第二部份;以及多晶矽熔絲連接該第二及第三接點柱。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| TW099113056A TWI395315B (zh) | 2010-04-26 | 2010-04-26 | 在超高壓元件的高壓路徑上提供esd保護的結構 |
| US13/091,264 US8357993B2 (en) | 2010-04-26 | 2011-04-21 | Structure in a high voltage path of an ultra-high voltage device for providing ESD protection |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| TW099113056A TWI395315B (zh) | 2010-04-26 | 2010-04-26 | 在超高壓元件的高壓路徑上提供esd保護的結構 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| TW201138051A TW201138051A (en) | 2011-11-01 |
| TWI395315B true TWI395315B (zh) | 2013-05-01 |
Family
ID=44815091
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| TW099113056A TWI395315B (zh) | 2010-04-26 | 2010-04-26 | 在超高壓元件的高壓路徑上提供esd保護的結構 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US8357993B2 (zh) |
| TW (1) | TWI395315B (zh) |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8987073B2 (en) | 2012-07-11 | 2015-03-24 | International Business Machines Corporation | Self-protected metal-oxide-semiconductor field-effect transistor |
| TWI521659B (zh) | 2013-05-02 | 2016-02-11 | 乾坤科技股份有限公司 | 電流導通元件 |
| US9768283B1 (en) * | 2016-03-21 | 2017-09-19 | Vanguard International Semiconductor Corporation | High-voltage semiconductor structure |
| CN107611121B (zh) * | 2016-07-11 | 2020-12-29 | 联华电子股份有限公司 | 用于静电放电保护的半导体结构 |
Citations (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| TW200601540A (en) * | 2004-06-18 | 2006-01-01 | United Microelectronics Corp | Electrostatic discharge (ESD) protection MOS device and ESD circuitry thereof |
| TW200601543A (en) * | 2004-06-25 | 2006-01-01 | Novatek Microelectronics Corp | High voltage device for electrostatic discharge protective circuit and high voltage device |
| TW200703430A (en) * | 2005-07-04 | 2007-01-16 | United Microelectronics Corp | High voltage device structure |
| TW201010082A (en) * | 2008-07-09 | 2010-03-01 | Taiwan Semiconductor Mfg | Semiconductor structure |
| US7683426B2 (en) * | 2006-05-31 | 2010-03-23 | Advanced Analogic Technologies, Inc. | High-voltage lateral DMOS device with diode clamp |
Family Cites Families (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7923811B1 (en) * | 2008-03-06 | 2011-04-12 | Xilinx, Inc. | Electronic fuse cell with enhanced thermal gradient |
| US8049307B2 (en) * | 2009-01-23 | 2011-11-01 | Vanguard International Semiconductor Corporation | Insulated gate bipolar transistor (IGBT) electrostatic discharge (ESD) protection devices |
-
2010
- 2010-04-26 TW TW099113056A patent/TWI395315B/zh not_active IP Right Cessation
-
2011
- 2011-04-21 US US13/091,264 patent/US8357993B2/en active Active
Patent Citations (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| TW200601540A (en) * | 2004-06-18 | 2006-01-01 | United Microelectronics Corp | Electrostatic discharge (ESD) protection MOS device and ESD circuitry thereof |
| TW200601543A (en) * | 2004-06-25 | 2006-01-01 | Novatek Microelectronics Corp | High voltage device for electrostatic discharge protective circuit and high voltage device |
| TW200703430A (en) * | 2005-07-04 | 2007-01-16 | United Microelectronics Corp | High voltage device structure |
| US7683426B2 (en) * | 2006-05-31 | 2010-03-23 | Advanced Analogic Technologies, Inc. | High-voltage lateral DMOS device with diode clamp |
| TW201010082A (en) * | 2008-07-09 | 2010-03-01 | Taiwan Semiconductor Mfg | Semiconductor structure |
Also Published As
| Publication number | Publication date |
|---|---|
| TW201138051A (en) | 2011-11-01 |
| US20110260287A1 (en) | 2011-10-27 |
| US8357993B2 (en) | 2013-01-22 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| KR101761922B1 (ko) | 반도체 장치 | |
| US8629513B2 (en) | HV interconnection solution using floating conductors | |
| US12002706B2 (en) | Structure and method for enhancing robustness of ESD device | |
| TWI395315B (zh) | 在超高壓元件的高壓路徑上提供esd保護的結構 | |
| US8482102B2 (en) | Semiconductor device | |
| CN103794599B (zh) | 半导体装置 | |
| US9299817B2 (en) | Bipolar junction transistor and method of manufacturing the same | |
| JP2007335441A (ja) | 静電破壊保護装置 | |
| CN102244070B (zh) | 在超高压组件的高压路径上提供esd保护的结构 | |
| US9035386B2 (en) | Semiconductor structure and method for manufacturing the same | |
| JP6033054B2 (ja) | 半導体装置 | |
| US8648425B2 (en) | Resistors formed based on metal-oxide-semiconductor structures | |
| US9601481B2 (en) | Semiconductor device | |
| US20130153959A1 (en) | Semiconductor device | |
| US20140054656A1 (en) | Semiconductor structure and method for manufacturing the same | |
| JP6099985B2 (ja) | 半導体装置 | |
| JP4504664B2 (ja) | 静電気放電保護素子及び静電気放電保護回路 | |
| US9786653B1 (en) | Self-balanced diode device | |
| TWI643309B (zh) | 圖案化有靜電放電保護之電晶體及其製法 | |
| TWI728090B (zh) | 半導體結構 | |
| US9059283B1 (en) | Semiconductor structure | |
| KR102844860B1 (ko) | 정전기 방전 보호 회로 | |
| JPH04320067A (ja) | サージ防護デバイスにおけるブレーク・オーバ電流または保持電流に関する設計仕様値からの誤差低減方法 | |
| TWI489615B (zh) | 半導體結構及其製造方法與操作方法 | |
| JP5371164B2 (ja) | 双方向型二端子サイリスタ |
Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| MM4A | Annulment or lapse of patent due to non-payment of fees |