KR20180005607A - 루테늄 배선 및 그 제조 방법 - Google Patents
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Abstract
Description
도 2는 본 발명의 제1 실시 형태에 따른 Ru 배선의 제조 방법을 개략적으로 도시하는 공정 단면도이다.
도 3은 TiN막 및 TiON막(O: 46at% 및 O: 55at%)의 막 두께와 막응력의 관계를 도시하는 도면이다.
도 4는 TiON막의 성막 방법의 시퀀스의 일례를 나타내는 타이밍 차트이다.
도 5는 TiON막의 성막 방법의 시퀀스의 일례를 나타내는 흐름도이다.
도 6은 도 4, 도 5의 시퀀스로 TiON막을 성막했을 때의 성막 상태를 도시하는 모식도이다.
도 7은 제1 실시 형태에 따른 Ru 배선의 제조 방법을 실시하기 위해서 사용되는 성막 시스템의 일례를 개략적으로 나타내는 수평 단면도이다.
도 8은 도 7의 성막 시스템에 탑재된 TiON막 성막 장치의 일례를 개략적으로 도시하는 단면도이다.
도 9는 도 7의 성막 시스템에 탑재된 Ru막 성막 장치의 일례를 개략적으로 도시하는 단면도이다.
도 10은 본 발명의 제2 실시 형태에 관한 Ru 배선의 제조 방법을 개략적으로 나타내는 흐름도이다.
도 11은 본 발명의 제2 실시 형태에 관한 Ru 배선의 제조 방법을 개략적으로 도시하는 공정 단면도이다.
도 12는 제2 실시 형태에서 평탄화에 사용하는 Ar 플라즈마 처리 장치로서의 Ar 이온 스퍼터링 장치의 일례를 나타내는 단면도이다.
도 13은 제2 실시 형태에 관한 Ru 배선의 제조 방법을 일괄해서 실시할 수 있는 성막 시스템의 일례를 개략적으로 나타내는 수평 단면도이다.
도 14는 층간 절연막에 트렌치가 형성된 웨이퍼에 대하여, TaN막으로 이루어지는 하지막을 형성한 후, Ru막을 성막하고, 트렌치를 매립한 상태를 나타내는 SEM 사진이다.
도 15는 도 14의 상태의 웨이퍼에 Ar 이온 스퍼터링을 행하여, 웨이퍼 표면의 Ru막 및 TaN막을 제거한 상태를 나타내는 SEM 사진이다.
도 16은 다양한 폭의 트렌치에, 하지막으로서 TaN막을 성막하고, 그 후, Ru막을 성막해서 트렌치를 매립한 후, Ar 이온 스퍼터링에 의한 평탄화를 행해서 Ru 배선을 형성했을 때의 트렌치 폭과 배선 저항과의 관계를 도시하는 도면이다.
도 17은 다양한 폭의 트렌치에, 하지막으로서 TaN막을 성막하고, 그 후, Ru막을 성막해서 트렌치를 매립한 후, Ar 이온 스퍼터링에 의한 평탄화를 행해서 Ru 배선을 형성했을 때의 인가 전압과 누설 전류와의 관계를 도시하는 도면이다.
11; TiON막 성막 장치 12; 냉각 장치
13; Ru막 성막 장치 14; 로드 로크 실
201; 기체 202; 층간 절연막
203; 트렌치 204; 비아 홀
205; TiON막 206; Ru막
207, 212; Ru 배선 211; 하지막
301; 단위 TiN막 400; Ar 이온 스퍼터 장치
W; 반도체 웨이퍼
Claims (26)
- 기판 표면의 미리 정해진 막에 형성된 오목부에, 하지막으로서 형성된 TiON막과, 상기 TiON막 상에 상기 오목부를 매립하도록 형성된 루테늄 막을 포함하는 루테늄 배선.
- 제1항에 있어서,
상기 미리 정해진 막은 층간 절연막이며, 상기 층간 절연막에 상기 오목부로서 트렌치 및 비아 홀이 형성되어 있는, 루테늄 배선. - 제1항에 있어서,
상기 TiON막은 ALD에 의해 형성된 막이며, 상기 루테늄 막은 CVD에 의해 형성된 막인, 루테늄 배선. - 제1항 내지 제3항 중 어느 한 항에 있어서,
상기 TiON막은, 산소량이 50at% 이상인, 루테늄 배선. - 표면에 오목부가 형성된 미리 정해진 막을 포함하는 기판에 대하여, 상기 오목부를 매립해서 루테늄 배선을 제조하는 루테늄 배선의 제조 방법으로서,
적어도 상기 오목부의 표면에, 하지막으로서 TiON막을 형성하는 공정과,
상기 TiON막 상에 상기 오목부를 매립하도록 루테늄 막을 형성하는 공정
을 포함하는 루테늄 배선의 제조 방법. - 제5항에 있어서,
상기 미리 정해진 막은 층간 절연막이며, 상기 층간 절연막에 상기 오목부로서 트렌치 및 비아 홀이 형성되어 있는, 루테늄 배선의 제조 방법. - 제5항에 있어서,
상기 루테늄 막을 형성해서 상기 오목부를 매립한 후, 상기 기판의 표면의 상기 루테늄 막 및 상기 TiON막을 제거해서 상기 기판의 표면을 평탄화하는 공정을 더 포함하는, 루테늄 배선의 제조 방법. - 제7항에 있어서,
상기 평탄화하는 공정은, 상기 기판의 표면의 상기 루테늄 막 및 상기 TiON막을 CMP에 의해 연마함으로써 행하여지는, 루테늄 배선의 제조 방법. - 제7항에 있어서,
상기 평탄화하는 공정은, 상기 기판의 표면의 상기 루테늄 막 및 상기 TiON막을, 아르곤 플라즈마 처리를 포함하는 처리에 의해 제거함으로써 행하여지는, 루테늄 배선의 제조 방법. - 제9항에 있어서,
상기 평탄화하는 공정은, 상기 기판의 표면의 상기 루테늄 막 및 상기 TiON막을, 아르곤 플라즈마 처리에 의해 제거한 후, CMP에 의해 연마함으로써 행하여지는, 루테늄 배선의 제조 방법. - 제9항 또는 제10항에 있어서,
상기 아르곤 플라즈마 처리는, 아르곤 이온 스퍼터 처리인, 루테늄 배선의 제조 방법. - 제7항 내지 제10항 중 어느 한 항에 있어서,
상기 루테늄 막을 형성한 후, 상기 평탄화 전에, 어닐 처리를 실시하는 공정을 더 포함하는, 루테늄 배선의 제조 방법. - 제5항 내지 제10항 중 어느 한 항에 있어서,
상기 TiON막의 산소량을 조정함으로써, 상기 TiON막에 작용하는 응력을 제어하는, 루테늄 배선의 제조 방법. - 제5항 내지 제10항 중 어느 한 항에 있어서,
상기 TiON막의 산소량을 50at% 이상으로 하는, 루테늄 배선의 제조 방법. - 제5항 내지 제10항 중 어느 한 항에 있어서,
상기 TiON막은, 처리 용기 내에 기판을 배치하고, 상기 처리 용기 내를 감압 상태로 유지하고, 미리 정해진 처리 온도에서, 상기 처리 용기 내에 Ti 함유 가스를 공급하는 스텝과, 상기 처리 용기 내에 질화 가스를 공급하는 스텝을 교대로 X회 반복해서 단위 TiN막을 성막한 후, 상기 처리 용기 내에 산화제를 공급해서 상기 단위 TiN막을 산화하는 일련의 처리를 1 사이클로 하고, 이 사이클을 원하는 막 두께가 되도록 복수 사이클 반복함으로써 형성하고, X의 횟수에 의해 상기 TiON막 내의 산소량을 조정하는, 루테늄 배선의 제조 방법. - 제15항에 있어서,
상기 TiON막을 형성할 때 사용하는, 상기 Ti 함유 가스가 TiCl4 가스이며, 상기 질화 가스가 NH3 가스인, 루테늄 배선의 제조 방법. - 제15항에 있어서,
상기 TiON막을 형성할 때의 상기 산화제로서, O2 가스, O3 가스, H2O, NO2로 이루어지는 군에서 선택되는 산소 함유 가스, 또는, 상기 산소 함유 가스를 플라즈마화한 것을 사용하는, 루테늄 배선의 제조 방법. - 제15항에 있어서,
상기 TiON막을 형성할 때의 상기 처리 온도가 300 내지 500℃의 범위인, 루테늄 배선의 제조 방법. - 표면에 오목부가 형성된 미리 정해진 막을 포함하는 기판에 대하여, 상기 오목부를 매립해서 루테늄 배선을 제조하는 루테늄 배선의 제조 방법으로서,
적어도 상기 오목부의 표면에, 하지막을 형성하는 공정과,
상기 하지막 상에 상기 오목부를 매립하도록 루테늄 막을 형성하는 공정과,
상기 루테늄 막을 형성해서 상기 오목부를 매립한 후, 상기 기판의 표면의 상기 루테늄 막 및 상기 하지막을, 아르곤 플라즈마 처리를 포함하는 처리에 의해 제거해서 상기 기판의 표면을 평탄화하는 공정
을 포함하는 루테늄 배선의 제조 방법. - 제19항에 있어서,
상기 평탄화하는 공정은, 상기 기판의 표면의 상기 루테늄 막 및 상기 하지막을 상기 아르곤 플라즈마 처리에 의해 제거한 후, CMP에 의해 연마함으로써 행하여지는, 루테늄 배선의 제조 방법. - 제19항에 있어서,
상기 아르곤 플라즈마 처리는, 아르곤 이온 스퍼터 처리인, 루테늄 배선의 제조 방법. - 제19항에 있어서,
상기 루테늄 막을 형성한 후, 상기 평탄화하는 공정 전에, 어닐 처리를 실시하는 공정을 더 포함하는, 루테늄 배선의 제조 방법. - 제19항 내지 제22항 중 어느 한 항에 있어서,
상기 하지막은, TiN막, Ta막, TaN막, TaAlN막 및 TiON막 중 어느 하나인, 루테늄 배선의 제조 방법. - 제5항 내지 제10항 및 제19항 내지 제22항 중 어느 한 항에 있어서,
상기 루테늄 막은, CVD에 의해 형성하는, 루테늄 배선의 제조 방법. - 제24항에 있어서,
상기 루테늄 막을 CVD에 의해 형성할 때, 성막 원료로서 루테늄 카르보닐을 사용하는, 루테늄 배선의 제조 방법. - 제25항에 있어서,
상기 루테늄 막을 형성할 때의 처리 온도가 130 내지 250℃의 범위인, 루테늄 배선의 제조 방법.
Applications Claiming Priority (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JPJP-P-2016-134043 | 2016-07-06 | ||
| JP2016134043 | 2016-07-06 | ||
| JP2016216142A JP6785130B2 (ja) | 2016-07-06 | 2016-11-04 | ルテニウム配線およびその製造方法 |
| JPJP-P-2016-216142 | 2016-11-04 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| KR20180005607A true KR20180005607A (ko) | 2018-01-16 |
| KR102096143B1 KR102096143B1 (ko) | 2020-04-01 |
Family
ID=61019733
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| KR1020170083687A Active KR102096143B1 (ko) | 2016-07-06 | 2017-06-30 | 루테늄 배선 및 그 제조 방법 |
Country Status (3)
| Country | Link |
|---|---|
| JP (1) | JP6785130B2 (ko) |
| KR (1) | KR102096143B1 (ko) |
| TW (1) | TWI742098B (ko) |
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Also Published As
| Publication number | Publication date |
|---|---|
| JP2018014477A (ja) | 2018-01-25 |
| KR102096143B1 (ko) | 2020-04-01 |
| TW201816162A (zh) | 2018-05-01 |
| TWI742098B (zh) | 2021-10-11 |
| JP6785130B2 (ja) | 2020-11-18 |
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| A201 | Request for examination | ||
| PA0109 | Patent application |
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|
| PA0201 | Request for examination |
St.27 status event code: A-1-2-D10-D11-exm-PA0201 |
|
| PG1501 | Laying open of application |
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|
| D13-X000 | Search requested |
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|
| D14-X000 | Search report completed |
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|
| E902 | Notification of reason for refusal | ||
| PE0902 | Notice of grounds for rejection |
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|
| E13-X000 | Pre-grant limitation requested |
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|
| P11-X000 | Amendment of application requested |
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|
| P13-X000 | Application amended |
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|
| E902 | Notification of reason for refusal | ||
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| GRNT | Written decision to grant | ||
| PR0701 | Registration of establishment |
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|
| PR1002 | Payment of registration fee |
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|
| PG1601 | Publication of registration |
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|
| PR1001 | Payment of annual fee |
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|
| PR1001 | Payment of annual fee |
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|
| PR1001 | Payment of annual fee |
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|
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