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JP3006585B2 - 半導体装置 - Google Patents

半導体装置

Info

Publication number
JP3006585B2
JP3006585B2 JP10151064A JP15106498A JP3006585B2 JP 3006585 B2 JP3006585 B2 JP 3006585B2 JP 10151064 A JP10151064 A JP 10151064A JP 15106498 A JP15106498 A JP 15106498A JP 3006585 B2 JP3006585 B2 JP 3006585B2
Authority
JP
Japan
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external lead
terminal
out terminal
soldered
external
Prior art date
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Application number
JP10151064A
Other languages
English (en)
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JPH11345926A (ja
Inventor
孝敏 小林
沖田  宗一
力宏 丸山
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fuji Electric Co Ltd
Original Assignee
Fuji Electric Co Ltd
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Filing date
Publication date
Application filed by Fuji Electric Co Ltd filed Critical Fuji Electric Co Ltd
Priority to JP10151064A priority Critical patent/JP3006585B2/ja
Priority to US09/301,716 priority patent/US6262474B1/en
Priority to GB9911965A priority patent/GB2338108B/en
Publication of JPH11345926A publication Critical patent/JPH11345926A/ja
Application granted granted Critical
Publication of JP3006585B2 publication Critical patent/JP3006585B2/ja
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    • H10W90/811
    • H10W90/00
    • H10W72/884
    • H10W90/734
    • H10W90/754

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  • Lead Frames For Integrated Circuits (AREA)

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明はケース内に半導体チ
ップを収納した半導体装置に関し、特に外部導出端子に
より、半導体チップを外部と電気的に接続可能とした半
導体装置に関する。
【0002】
【従来の技術】従来、半導体チップをケース内に収納し
た半導体装置は、外部導出端子を介して外部と電気的に
接続可能となっている。
【0003】図9は従来の半導体装置の構成例を示す断
面図である。半導体装置90は、例えばIGBT(Insu
lated Gate Bipolar Transistor)の半導体チップ94
を用いており、金属ベース91、枠体92、カバー93
によりケースが構成され、この中に半導体チップ94が
収納されている。金属ベース91上には、アルミナ、窒
化アルミなどのセラミックス製の基板95が取り付けら
れており、この基板95上に形成された銅などのパター
ン95a上に、半導体チップ94が搭載されている。ま
た、基板95上には、端子接続用のパターン95b,9
5cなども形成されている。これらパターン95b,9
5cは、ボンディングワイヤ95d,95eによってそ
れぞれ半導体ップ94の電極と接続されている。
【0004】また、各パターン95b,95cには、外
部導出端子96,97の各はんだ付け部96a,97a
がはんだ付けされている。外部導出端子96の他方の端
部96bは、カバー93に固定されており、一部が外部
に露出している。一方、外部導出端子97の他方の端部
97bは、枠体92の側面に接触するように設けられ、
一部がカバー93あるいは枠体92の外部に露出してい
る。もちろん、外部導出端子96の他方の端部96bを
枠体92に固定してもよく、また、端部97bを枠体9
2の側面に接触させなくてもよい。
【0005】このような半導体チップ94や外部導出端
子96,97は、シリコーンゲル98を充填して封止さ
れた状態で、枠体92内に収納されている。また、外部
導出端子96,97は、薄板状に形成された導電部材で
あり、低抵抗、低インダクタンスを維持できる範囲内で
できるだけ長く形成され、かつ面方向に折り曲げ形成さ
れている。これにより、外部導出端子96,97は、外
部から加わる図面上下方向の応力や、温度変化による外
部導出端子96,97自身の膨張、収縮などによる図面
上下方向の応力に対して、緩和能力を有している。
【0006】
【発明が解決しようとする課題】ところで、図9のよう
な半導体装置90は、基板95またははんだ付け部など
でクラックの発生などを防止するため、予めコンピュー
タを用いたシミュレーションによる構造解析を行い、こ
れに基づいて端子形状や配置が決定されている。ところ
が、シミュレーション後に実際にモジュールを組み立て
てヒートサイクル試験を行ってみると、外部導出端子9
6のはんだ付け部96aとパターン95bとの間のはん
だ部分にクラックが生じることがあった。
【0007】この原因としては、シミュレーションによ
る構造解析が上下左右の2軸方向だけであり、また応力
緩和対策が図面上下方向のみにしか施されていなかった
ことが考えられる。
【0008】本発明はこのような点に鑑みてなされたも
のであり、低抵抗、低インダクタンスを維持しつつ、外
部導出端子のはんだ付け部分のクラック発生を防止する
ことのできる半導体装置を提供することを目的とする。
【0009】
【課題を解決するための手段】本発明では上記課題を解
決するために、ケース内の半導体チップを外部導出端子
により外部と接続可能とした半導体装置において、前記
外部導出端子の基板へのはんだ付け部分と前記ケースへ
の固定部との間に、互いに直交する3軸方向に対して応
力を緩和する応力緩和手段を有し、所定範囲の温度変化
を与えたときに、前記はんだ付け部分と前記固定部との
間のたわみ量と、前記はんだ付け部分の変位量との比
が、0.4以上であることを特徴とする半導体装置が提
供される。
【0010】このような半導体装置では、応力緩和手段
によって、互いに直交する3軸方向に対して外部導出端
子の応力が緩和される。このため、低抵抗、低インダク
タンスを維持しつつ、外部導出端子のはんだ付け部分の
クラック発生を防止することができる。
【0011】
【発明の実施の形態】以下、本発明の実施の形態を図面
を参照して説明する。図2は本形態の半導体装置のチッ
プ搭載後の構成を示す平面図である。また、図3は図2
のA1−A1線に沿う断面図である。さらに、図4は図
2のA2−A2線に沿う断面図である。ただし、図2で
は、ケース内部のみを示してある。また、図3、図4で
は、カバー13以外を断面としている。
【0012】半導体装置10は、例えばIGBTモジュ
ールであり、金属ベース11、枠体12、カバー13に
よりケース全体が形成されている。金属ベース11上に
は、一対のセラミック基板14,15が取り付けられて
いる。各セラミック基板14,15上には、それぞれゲ
ート用回路パターン141,151、コレクタ用回路パ
ターン142,152、およびエミッタ用回路パターン
143,153が形成されている。
【0013】コレクタ用回路パターン142,152上
には、それぞれ4個のIGBTチップ16〜19、20
〜23が搭載されている。各IGBTチップは、裏面が
コレクタ電極であって、コレクタ用回路パターン14
2,152にはんだ付けされている。また、各IGBT
チップの表面には、エミッタ電極およびゲート電極が配
置されている。この他、コレクタ用回路パターン14
2,152上には、フライホイールダイオードチップも
搭載されている。
【0014】ゲート用回路パターン141,151上に
は、それぞれゲート端子用の端子搭載部24,25が形
成されている。同様に、コレクタ用回路パターン14
2,152上には、それぞれコレクタ端子用の端子搭載
部26,27,28,29が形成されている。さらに、
エミッタ用回路パターン143,153上には、それぞ
れエミッタ端子用の端子搭載部30,31,32,33
が形成されている。また、エミッタ用回路パターン14
3上には、補助エミッタ端子用の端子搭載部34が形成
されている。
【0015】ゲート用回路パターン141は、図示され
ていないボンディングワイヤによって、各IGBTチッ
プ16〜19のゲート電極と結線されている。同様に、
ゲート用回路パターン151は、図示されていないボン
ディングワイヤによって、IGBTチップ20〜23の
ゲート電極と結線されている。このようなゲート用回路
パターン141,151間には、共通のゲート端子とし
て、外部導出端子35がはんだ付けされている。外部導
出端子35は、図2に示すように、全体がアーム状に形
成されており、両端の接続部351,352が、それぞ
れ端子搭載部24,25にはんだ付けされている。ま
た、外部導出端子35には、外部端子部350が形成さ
れている。外部端子部350は、上半分がほぼ直角に折
り曲げられ、図4に示すように、ケースの一部をなすカ
バー13の上面から露出するように固定されている。
【0016】コレクタ用回路パターン142,152間
には、共通のコレクタ端子として、外部導出端子36が
取り付けられている。外部導出端子36は、4本の接続
部361,362,363,364と、外部端子部36
0とを有している。接続部361,362,363,3
64は、それぞれコレクタ用回路パターン142,15
2上の端子搭載部26,27,28,29にはんだ付け
されている。一方、外部端子部360は、上半分がほぼ
直角に折り曲げられ、図3に示すように、カバー13の
上面から露出するように固定されている。なお、外部導
出端子36の具体的な形状については後述する。
【0017】エミッタ用回路パターン143は、図示さ
れていないボンディングワイヤによって、各IGBTチ
ップ16〜19のエミッタ電極と結線されている。同様
に、エミッタ用回路パターン153は、図示されていな
いボンディングワイヤによって、IGBTチップ20〜
23のゲート電極と結線されている。このようなエミッ
タ用回路パターン143,153間には、共通のエミッ
タ端子として、外部導出端子37が取り付けられてい
る。
【0018】外部導出端子37は、4本の接続部37
1,372,373,374と、外部端子部370とを
有している。接続部371,372,373,374
は、それぞれエミッタ用回路パターン143,153上
の端子搭載部30,31,32,33にはんだ付けされ
ている。一方、外部端子部370は、上半分がほぼ直角
に折り曲げられ、図3および図4に示すように、カバー
13の上面から露出するように固定されている。
【0019】また、エミッタ用回路パターン143の端
子搭載部34には、補助エミッタ端子として、外部導出
端子38がはんだ付けされている。外部導出端子38の
外部端子部380は、上半分がほぼ直角に折り曲げら
れ、図3および図4に示すように、カバー13の上面か
ら露出するように固定されている。
【0020】このような半導体チップや外部導出端子
は、シリコーンゲル39を充填して封止された状態で、
枠体12内に収納されている。次に、外部導出端子の具
体的な形状について説明する。
【0021】図1は本形態の外部導出端子36の具体的
な形状を示す斜視図である。外部導出端子36は、1枚
の金属板を打ち抜き、折り曲げ形成されたものであり、
その平板部365をZ−X平面に平行に置いたとき、外
部端子部360がY軸方向に平行となるように形成され
ている。平板部365は、枠体12から張り出した梁状
の支持体(図示せず)によって枠体12に固定されてい
る。外部端子部360の中間部分には、2個の切り欠き
360a,360bが互いに対向するように形成されて
いる。外部端子部360は、この切り欠き360a,3
60b部分でほぼ直角に折り曲げられ、図3で示したよ
うにカバー13に係止される。
【0022】一方、各接続部361,362,363,
364は、その板厚に比して十分な長さを持ち、平板部
365とほぼ平行に平板部365からZ軸方向に突き出
し、途中から下方に向くように折り曲げ形成されてい
る。また、各接続部361,362,363,364に
は、応力緩和手段としての切り欠き部361a,362
a,363a,364aが複数個ずつ形成されている。
切り欠き部361a,362a,363a,364a
は、例えばX軸方向に沿うとともに、切り欠きの向きが
隣どうし互いに逆となるように形成されている。その大
きさや数は、各接続部361,362,363,364
の抵抗やインダクタンスを考慮して決められている。
【0023】このような構成の外部導出端子36は、切
り欠き部361a,362a,363a,364aの働
きによって、接続部361,362,363,364が
弾性力を持ち、Y軸方向(上下方向)だけでなく、X
軸、Z軸方向への応力を緩和する能力を有している。
た、各接続部361,362,363,364の先端の
はんだ付け部分361b,362b,363b,364
の幅に比べ、各接続部361,362,363,364
の板幅は十分小さい。これによって、各接続部361,
362,363,364を長くすることなく応力緩和が
できる。
【0024】なお、外部導出端子37についても、部分
的に寸法や形状が異なる以外は、外部導出端子36とほ
ぼ同じ構成となっている。また、他の外部導出端子3
5,38についても、各接続部には切り欠き部361a
などと同様の切り欠き部が形成されている。
【0025】次に、各外部導出端子35,36,37の
実際の特性について説明する。まず、外部導出端子3
5,36,37をセラミック基板14,15上にはんだ
付けし、半導体装置10に25℃〜125℃の温度変化
を与え、そのときの各接続部361,362,363,
364などのはんだ付け部分の変位(mm)量と、1k
gの加重をかけたときのたわみ量(mm/kg)を検出
した。ここで、たわみ量とは、各接続部のはんだ付け部
分と、ケース側との固着部分との間のたわみ量を意味す
る。また、固着部分とは、外部導出端子35,36,3
7が枠体12に直接、あるいは支持体に固定されていれ
ばその固定部分が固着部分であり、同じくカバー13に
固定されていればその固定部分が固着部分である。な
お、通常、ヒートサイクル試験での温度条件は、−40
℃〜125℃であるが、実際には変形しない状態が常温
であると仮定して、計算上は25℃〜125℃を温度変
化範囲とした。
【0026】また、応力緩和手段を持たない従来型の外
部導出端子についても同様の試験を行った。図5は従来
の外部導出端子の構成例を示す斜視図である。外部導出
端子40は、その外部端子部41および平板部42につ
いては、例えば外部導出端子36とほぼ同じ寸法に形成
されている。また、接続部43,44,45,46に
は、切り欠きなどの応力緩和手段は設けられていない。
【0027】図6は図5のような従来型の外部導出端子
と本形態の外部導出端子におけるたわみ量と変位量の比
を示す図である。図において、横軸はX軸またはZ軸方
向へのたわみ量と変位量の比であり、縦軸はY軸方向へ
のたわみ量と変位量の比である。また、点P1,P2,
P3は、それぞれゲート(G)用の外部導出端子35、
コレクタ(C)用の外部導出端子36、エミッタ(E)
用の外部導出端子37の各たわみ量と変位量の比を示す
点である。一方、点P11,P12,P13は、それぞ
れ従来型のゲート(G)用の外部導出端子、コレクタ
(C)用の外部導出端子、エミッタ(E)用の外部導出
端子の各たわみ量と変位量の比を示す点である。
【0028】図からも分かるように、従来型に比べて本
形態の各外部導出端子35,36,37は、変位量に対
するたわみ量が多く、応力に対して緩和能力が高い。次
に、従来型、本形態ともに様々な外部導出端子につい
て、はんだ付け部分のクラックの発生状態について調べ
た。
【0029】図7は外部導出端子の各たわみ量と変位量
の比とはんだ付け部分のクラックの発生の関係を示す図
である。図において、白抜きの点はクラックが発生しな
かったもの、黒点はクラックが発生したものである。こ
の結果、図から分かるように、たわみ量/変位量が3軸
のいずれかの方向で0.4以下のときにはクラックが発
生している。前述の図6のデータで示したように、従来
の構成ではたわみ量/変位量が0.4以下にしかでき
ず、クラックが発生してしまう。一方、本形態の構成で
は、切り欠き部361aなどの数や大きさを調節するこ
とにより、0.4よりも十分に大きな値に設計すること
ができる。よって、はんだ付け部分のクラックの発生を
容易に防止することができる。
【0030】ただし、たわみ量/変位量を大きくしよう
として切り欠き部361aなどを必要以上に増やしたり
大きくすると、抵抗とインダクタンスが高くなってしま
ったり、サイズの大型化により枠体12内に収納できな
くなるおそれがある。したがって、たわみ量/変位量が
0.4より多少大きくなる程度に収めることが好まし
い。
【0031】図8は外部導出端子の他の構成例を示す斜
視図である。外部導出端子50は、図1の外部導出端子
36と同様に、外部端子部51および平板部52を有し
ている。平板部52には、4本の接続部53,54,5
5,56が形成されている。各接続部53,54,5
5,56間には、切り欠き部57,58などが形成さ
れ、各接続部が複数の屈折部を有するように形成されて
いる。これにより、Y軸方向のみならず、Z軸方向およ
びX軸方向へも応力緩和がなされている。
【0032】
【発明の効果】以上説明したように本発明では、互いに
直交する3軸方向に対して応力を緩和する応力緩和手段
を設け、所定の温度変化に対して、はんだ付け部分と固
定部のたわみ量と、はんだ付け部分の変位量との比を
0.4以上にしたので、はんだ付け部への応力を低減で
き、クラックを確実に防止できる。
【図面の簡単な説明】
【図1】本形態の外部導出端子の具体的な形状を示す斜
視図である。
【図2】本形態の半導体装置のチップ搭載後の構成を示
す平面図である。
【図3】図2のA1−A1線に沿う断面図である。
【図4】図2のA2−A2線に沿う断面図である。
【図5】従来の外部送出端子の構成例を示す斜視図であ
る。
【図6】従来型の外部導出端子と本形態の外部導出端子
におけるたわみ量と変位量の比を示す図である。
【図7】外部導出端子の各たわみ量と変位量の比とはん
だ付け部分のクラックの発生の関係を示す図である。
【図8】外部導出端子の他の構成例を示す斜視図であ
る。
【図9】従来の半導体装置の構成例を示す断面図であ
る。
【符号の説明】
10 半導体装置 11 金属ベース 12 枠体 13 カバー 14,15 セラミック基板 16〜23 IGBTチップ 35 (ゲート端子用の)外部導出端子 36 (コレクタ端子用の)外部導出端子 37 (エミッタ端子用の)外部導出端子 360 外部端子部 361,362,363,364 接続部 361a,362a,363a,364a 切り欠き部
フロントページの続き (56)参考文献 特開 平6−268128(JP,A) 特開 昭63−318147(JP,A) 特開 平4−32256(JP,A) 特開 平4−162554(JP,A) 実開 平5−15444(JP,U) (58)調査した分野(Int.Cl.7,DB名) H01L 23/48

Claims (1)

    (57)【特許請求の範囲】
  1. 【請求項1】 ケース内の半導体チップを外部導出端子
    により外部と接続可能とした半導体装置において、 前記外部導出端子の基板へのはんだ付け部分と前記ケー
    スへの固定部との間に、互いに直交する3軸方向に対し
    て応力を緩和する応力緩和手段を有し、所定範囲の温度
    変化を与えたときに、前記はんだ付け部分と前記固定部
    との間のたわみ量と、前記はんだ付け部分の変位量との
    比が、0.4以上であることを特徴とする半導体装置。
JP10151064A 1998-06-01 1998-06-01 半導体装置 Expired - Lifetime JP3006585B2 (ja)

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GB9911965A GB2338108B (en) 1998-06-01 1999-05-21 Semiconductor device

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