JP2018170377A - 樹脂封止型半導体装置およびその製造方法 - Google Patents
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Abstract
Description
まず、第一面と前記第一面の反対側の第二面を有する樹脂封止体と、
前記樹脂封止体に埋め込まれた半導体チップと、
前記半導体チップの素子面上に設けられ、前記樹脂封止体に埋め込まれた外部端子と、
を備える樹脂封止型半導体装置であって、
前記外部端子上に設けられた積層膜は、前記第一面に露出し、
前記半導体チップの素子面の反対側の裏面は、前記第二面と同一面を成し、
前記半導体チップの裏面には、前記第二面よりも突出する金属層が設けられていることを特徴とする樹脂封止型半導体装置とした。
前記樹脂封止体に埋め込まれた半導体チップと、
前記半導体チップの素子面上に設けられ、前記樹脂封止体に埋め込まれた外部端子と、
を備える樹脂封止型半導体装置の製造方法であって、
第一主面と前記第一主面と反対側の第二主面とを有する基板を準備する工程と、
前記第一主面に導電層を形成する工程と、
前記半導体チップ上に設けられたバンプ電極と前記導電層を接合して前記外部端子を形成する工程と、
前記外部端子と前記半導体チップを樹脂で被覆して前記第一主面上に樹脂封止体を形成する工程と、
前記樹脂封止体が前記第一主面と接する面と反対側の面から、前記樹脂封止体および前記半導体チップを研削して、前記半導体チップの素子面と反対側の面を露出させる工程と、
前記半導体チップの露出面に金属層を形成する工程と、
前記外部端子と前記樹脂封止体の前記第一面を露出させる工程と、
隣接する前記半導体チップの間を切断して、樹脂封止型半導体装置に個片化する工程と、
を備えることを特徴とする樹脂封止型半導体装置の製造方法とした。
図1は、本発明の第1の実施形態に係る樹脂封止型半導体装置の平面図で、図1(1)は、外部端子の露出面(表面)から見た図であり、図1(2)は、外部端子の露出面と反対側の面(裏面)から透視した図である。
半導体チップ1の表面には複数のパッド電極(図示せず)上に形成されたバンプ電極2が設けられ、バンプ電極2上には半田(図示せず)を介して導電層3がフリップチップ接続されている。そして、半導体チップ1とバンプ電極2と導電層3からなる外部端子9は、樹脂封止体6によって封緘されている。樹脂封止体6は上面と下面を有し、上面側から導電層3、バンプ電極2、半導体チップ1の順に埋め込まれ、半導体チップ1は樹脂封止体6の下面(裏面)側に露出する構成となっている。導電層3がバンプ電極2と接する面と反対側に位置する導電層3の表面と樹脂封止体6の上面は同一面を成し、さらに、導電層3の表面には積層膜5が設けられ、該同一面から幾分突出するように形成されている。ここで、外部端子9は半導体チップ1の素子の外縁よりも内側に配置されているが、これは樹脂封止体6内において、半導体チップ1が外部端子9のアンカーになり、外部端子9が樹脂封止体6から容易に抜けないようにするためである。このように外部端子9の端子強度が確保されることで、樹脂封止型半導体装置100と実装基板との接続信頼性を確保することができる。
半導体チップ1を2つのパワーMOSFETからなる構成とし、半導体チップ1の厚さが50μm厚になるように設定してある。半導体チップ1の素子面側の各々の端子の上に50μm厚の銅の柱状バンプ電極2が形成され、半田(図示せず)を介して50μm厚の銅の柱状バンプ電極2と50μm厚の銅の柱状導電層3がフリップチップ接続されている。半導体チップ1、柱状バンプ電極2、柱状導電層3および半田が、導電層3の表面および反対側の半導体チップ1の裏面を除いて、エポキシタイプの樹脂封止体6で封緘される。樹脂封止体6から露出した半導体チップ1の素子面と反対側の面である半導体チップ1の裏面には、30μm厚さの銅の金属層4を設け、電気的に接続されている。この金属層4は2つのパワーMOSFETのドレイン側の共通電極として機能し、オン抵抗を下げるために30μm以上という厚膜に形成されるのが好ましい。そして、樹脂封止体6の下面から露出する金属層4の表面は積層膜5によって覆われている。積層膜5は半導体チップ1装置の裏面だけでなく、表面の外部端子9の表面にも形成されるが、この積層膜5は金属層4側および外部端子9側からニッケル/パラジウム/金の順に被着される構成である。積層膜5はニッケル/パラジウム/金に代えて、クロム/ニッケル/金、チタン/ニッケル/銅、チタン/ニッケル/金、チタン/ニッケル/銀という順に被着した積層構造でも構わない。
本発明の第1の実施形態に係る樹脂封止型半導体装置100との違いは、樹脂封止型半導体装置100の裏面全面に金属層4および積層膜5を設け、樹脂封止体6の外縁と金属層4の外縁を同一とし、平面視的に樹脂封止体6と金属層4を同じ大きさとした点である。第1の実施形態の場合は金属層4を所定の形状にパターニングする必要があったが、このような構成とすることでパターニングの必要がなくなり、工程を削減できるという効果がある。また、ここでは、外部端子9は半導体チップ1の外縁よりも内側に配置するようにされていることに加え、金属層4が半導体チップ1の外縁よりも張り出して樹脂封止体6の裏面と接触する構成となっている。このため、樹脂封止体6内において、半導体チップ1が外部端子9のアンカーになるだけでなく、金属層4もアンカーとなり、外部端子9が、樹脂封止体6から容易に抜けないようになる。外部端子3の端子強度が確保されることで、樹脂封止型半導体装置100と実装基板との接続信頼性を確保することができる。
本発明の第1の実施形態に係る樹脂封止型半導体装置100との違いは、積層膜5側面の外縁が樹脂封止体6に埋め込まれ、積層膜5の表面と樹脂封止体6の上面とが一つの平面を形成し、該平面に積層膜5が露出している点である。積層膜5が樹脂封止体6に埋め込まれながらも表面のみが露出する構成とすることで、第1の実施形態に係る樹脂封止型半導体装置100のような積層膜5が樹脂封止体6よりも突出するものに比べ、実装基板に実装したときに接合面積を幾分小さくできるという効果がある。また、樹脂封止体6の下面から露出する金属層4の表面は積層膜5によって覆われていない点も異なる。金属層4を覆う積層膜5は金属層4の保護膜としての役目を有するが、この樹脂封止型半導体装置100を実装基板へ実装する際に金属層4裏面が封止されれば何ら問題はない。
本発明の第2の実施形態に係る樹脂封止型半導体装置100との違いは、積層膜5側面の外縁が樹脂封止体6に埋め込まれ、積層膜5表面と樹脂封止体6上面とが一つの平面を形成し、該平面に積層膜5が露出している点である。積層膜5が樹脂封止体6に埋め込まれながらも表面のみが露出する構成とすることで、第1の実施形態に係る樹脂封止型半導体装置100のような積層膜5が樹脂封止体6よりも突出するものに比べ、実装基板に実装したときに接合面積を幾分小さくできるという効果がある。また、樹脂封止体6の下面よりも突出する金属層4の表面は積層膜5によって覆われていない点も異なる。金属層4を覆う積層膜5は金属層4の保護膜としての役目を有するが、この樹脂封止型半導体装置100を実装基板へ実装する際に金属層4の裏面が封止されれば何ら問題はない。
本発明の第1の実施形態に係る樹脂封止型半導体装置100との違いは、バンプ電極2と導電層3とを異径とした点である。図2においては、バンプ電極2と導電層3と積層膜5とを同一径で平面視的に重畳するように図示しているが、本構造ではバンプ電極2の外径を導電層3の外径よりも小さくしている。第1の実施形態の場合は、外部端子9は半導体チップ1の外周よりも内側に配置するようにされていることで樹脂封止体6内において、半導体チップ1が外部端子9のアンカーになり、図の上方向に外部端子9が樹脂封止体6から容易に抜けないようになっているが、本実施形態の場合は、バンプ電極2と導電層3とが平面視的に部分的に重畳し、かつバンプ電極2の断面積(外径)を導電層3の断面積(外径)よりも小さくしているため、図の下方向にも半導体チップ1が樹脂封止体6から容易に抜けないようになっている。このため、半導体チップ1のバンプ電極2や導電層3と樹脂封止体6との密着が強固なものとなり、樹脂封止体6によって十分にサポートされるので、樹脂封止型半導体装置100の反りが抑制され、ハンドリング性が向上するとともに、表面の平坦性が維持されるため、複数の外部端子9上の積層膜5の高さ均一性(コプラナリティ)が改善され、実装基板への実装品質を高めることができる。
図7(1)に示すとおり、まず、基板7を準備する。基板7は、長さ250mm、幅80mm、厚さ250μmの鉄系の鋼板とした。他の基板材料として銅をベースにした合金素材、または、ニッケルをベースにした合金素材、さらには、絶縁体であるセラミクスあるいは繊維強化プラスチック(FRP)の板を利用しても良い。図7(2)に示すとおり、基板7の一方の主面に、電解または無電解メッキ法で厚さ50μmの銅の柱状導電層3を形成する。導電層3の材質は、はんだ、金、銀、銅、アルミ、パラジウム、ニッケルの単層材料、もしくはこれらの金属を積層した多層材料や合金からなる。
図4および図5に示す樹脂封止型半導体装置100では、外部端子9上の積層膜5が樹脂封止体6に埋め込まれ、積層膜5の表面だけが露出して樹脂封止体6の表面と同一面を形成しているが、これを製造するためには図7(2)に示す工程に代えて、図10に示すような工程とすれば良い。基板7の一方の主面に、電解または無電解メッキ法で積層膜5と柱状導電層3とを連続して形成することで図4および図5に示すような外部端子9上の積層膜5が樹脂封止体6に埋め込まれた樹脂封止型半導体装置とすることができる。このようにすることで図9(1)に示す工程を削除することができる。本発明の第4の実施形態に係る樹脂封止型半導体装置の製造方法についても同様である。
2 バンプ電極
3 導電層
4 金属層
5 積層膜
6 樹脂封止体
7 基板
8 ダイシングエリア
9 外部端子
20 ソースバンプ電極
21 ゲートバンプ電極
22 ドレインバンプ電極
24 金属層
25 半導体チップ
100 樹脂封止型半導体装置
200 半導体装置
Claims (15)
- 第一面と前記第一面の反対側の第二面を有する樹脂封止体と、
前記樹脂封止体に埋め込まれた半導体チップと、
前記半導体チップの素子面上に設けられ、前記樹脂封止体に埋め込まれた外部端子と、
を備える樹脂封止型半導体装置であって、
前記外部端子上に設けられた積層膜は、前記第一面に露出し、
前記半導体チップの素子面の反対側の裏面は、前記第二面と同一面を成し、
前記半導体チップの裏面には、前記第二面よりも突出する金属層が設けられていることを特徴とする樹脂封止型半導体装置。 - 平面視的に前記金属層の外縁が前記半導体チップの外縁と同一であって、前記金属層を前記半導体チップと同じ大きさとすることを特徴とする請求項1に記載の樹脂封止型半導体装置。
- 平面視的に前記金属層の外縁が前記樹脂封止体の外縁と同一であって、前記金属層を前記樹脂封止体と同じ大きさとすることを特徴とする請求項1に記載の樹脂封止型半導体装置。
- 前記積層膜の表面が前記第一面と同一面を成すことを特徴とする請求項1乃至請求項3のいずれか1項に記載の樹脂封止型半導体装置。
- 前記外部端子の表面が前記第一面と同一面を成し、前記積層膜が前記第一面よりも突出していることを特徴とする請求項1乃至請求項3のいずれか1項に記載の樹脂封止型半導体装置。
- 前記外部端子は、バンプ電極および前記バンプ電極上に設けられた導電層を備えることを特徴とする請求項1乃至請求項5のいずれか1項に記載の樹脂封止型半導体装置。
- 平面視的に前記バンプ電極の断面積が前記導電層の断面積よりも小さいことを特徴とする請求項6に記載の樹脂封止型半導体装置。
- 第一面と前記第一面の反対側の第二面を有する樹脂封止体と、
前記樹脂封止体に埋め込まれた半導体チップと、
前記半導体チップの素子面上に設けられ、前記樹脂封止体に埋め込まれた外部端子と、
を備える樹脂封止型半導体装置の製造方法であって、
第一主面と前記第一主面と反対側の第二主面とを有する基板を準備する工程と、
前記第一主面に導電層を形成する工程と、
前記半導体チップ上に設けられたバンプ電極と前記導電層を接合して前記外部端子を形成する工程と、
前記外部端子と前記半導体チップを樹脂で被覆して前記第一主面上に樹脂封止体を形成する工程と、
前記樹脂封止体が前記第一主面と接する面と反対側の面から、前記樹脂封止体および前記半導体チップを研削して、前記半導体チップの素子面と反対側の面を露出させる工程と、
前記半導体チップの露出面に金属層を形成する工程と、
前記外部端子と前記樹脂封止体の前記第一面を露出させる工程と、
隣接する前記半導体チップの間を切断して、樹脂封止型半導体装置に個片化する工程と、
を備えることを特徴とする樹脂封止型半導体装置の製造方法。 - 前記金属層を形成する工程において、
平面視的に前記金属層の外縁を前記半導体チップの外縁と同一にして、前記金属層を前記半導体チップと同じ大きさとすることを特徴とする請求項8に記載の樹脂封止型半導体装置の製造方法。 - 前記金属層を形成する工程において、
平面視的に前記金属層の外縁を前記樹脂封止体の外縁と同一にして、前記金属層を前記樹脂封止体と同じ大きさとすることを特徴とする請求項8に記載の樹脂封止型半導体装置の製造方法。 - 前記半導体チップの素子面と反対側の面を露出させる工程において、前記樹脂封止体および前記半導体チップを研削した後に化学機械研磨(CMP)処理することを特徴とする請求項8乃至請求項10のいずれか1項に記載の樹脂封止型半導体装置の製造方法。
- 前記隣接する半導体チップの間を切断して、樹脂封止型半導体装置に個片化する工程が、ダイシング法またはブレーキング法であることを特徴とする請求項8乃至請求項11のいずれか1項に記載の樹脂封止型半導体装置の製造方法。
- 前記外部端子と前記樹脂封止体の前記第一面を露出させる工程が、前記基板全てを除去する工程であることを特徴とする請求項8乃至請求項12のいずれか1項に記載の樹脂封止型半導体装置の製造方法。
- 前記外部端子と前記樹脂封止体の前記第一面を露出させる工程が、前記基板を部分的に除去する工程であることを特徴とする請求項8乃至請求項12のいずれか1項に記載の樹脂封止型半導体装置の製造方法。
- 前記外部端子と前記樹脂封止体の前記第一面を露出させる工程が、前記基板の外周部分以外を開口する工程であることを特徴とする請求項14に記載の樹脂封止型半導体装置の製造方法。
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Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2021027091A (ja) * | 2019-08-01 | 2021-02-22 | リンテック株式会社 | 半導体素子の製造方法 |
Families Citing this family (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN109671635B (zh) * | 2018-12-26 | 2023-12-29 | 合肥矽迈微电子科技有限公司 | 芯片封装方法及封装体 |
| WO2021124806A1 (ja) * | 2019-12-20 | 2021-06-24 | 株式会社村田製作所 | 電子部品モジュール、および、電子部品モジュールの製造方法 |
| CN111653528A (zh) * | 2020-07-22 | 2020-09-11 | 江苏长晶科技有限公司 | 芯片封装结构、方法和半导体器件 |
| US12477829B2 (en) * | 2020-09-16 | 2025-11-18 | Rohm Co., Ltd. | Method for manufacturing semiconductor device and semiconductor device |
| US12198998B2 (en) * | 2021-12-09 | 2025-01-14 | Nxp B.V. | Dielectric sidewall protection and sealing for semiconductor devices in a in wafer level packaging process |
Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2005026631A (ja) * | 2003-07-04 | 2005-01-27 | Sony Corp | 半導体装置及びその製造方法 |
| JP2010098000A (ja) * | 2008-10-14 | 2010-04-30 | Fuji Electric Systems Co Ltd | 半導体装置の製造方法及び半導体装置 |
| JP2016001759A (ja) * | 2015-09-16 | 2016-01-07 | 凸版印刷株式会社 | 半導体装置 |
| JP2017005073A (ja) * | 2015-06-09 | 2017-01-05 | 富士通株式会社 | 電子装置の製造方法 |
Family Cites Families (18)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP3230348B2 (ja) * | 1993-09-06 | 2001-11-19 | ソニー株式会社 | 樹脂封止型半導体装置及びその製造方法 |
| JP3277996B2 (ja) * | 1999-06-07 | 2002-04-22 | 日本電気株式会社 | 回路装置、その製造方法 |
| JP2002368218A (ja) | 2001-06-08 | 2002-12-20 | Sanyo Electric Co Ltd | 絶縁ゲート型半導体装置 |
| JP3868777B2 (ja) * | 2001-09-11 | 2007-01-17 | 株式会社東芝 | 半導体装置 |
| US8541876B2 (en) * | 2005-09-30 | 2013-09-24 | Intel Corporation | Microelectronic package having direct contact heat spreader and method of manufacturing same |
| CN101071799A (zh) * | 2006-05-11 | 2007-11-14 | 松下电器产业株式会社 | 树脂封装型半导体器件的制造方法及其所用的布线基板 |
| JP2008084959A (ja) * | 2006-09-26 | 2008-04-10 | Shinko Electric Ind Co Ltd | 半導体装置及びその製造方法 |
| CN100573862C (zh) * | 2008-01-25 | 2009-12-23 | 苏州固锝电子股份有限公司 | 一种新型封装结构的半导体器件 |
| US8435837B2 (en) * | 2009-12-15 | 2013-05-07 | Silicon Storage Technology, Inc. | Panel based lead frame packaging method and device |
| US20120126396A1 (en) * | 2010-11-19 | 2012-05-24 | Broadcom Corporation | Die down device with thermal connector |
| JP5728423B2 (ja) * | 2012-03-08 | 2015-06-03 | 株式会社東芝 | 半導体装置の製造方法、半導体集積装置及びその製造方法 |
| JP6030970B2 (ja) * | 2013-02-12 | 2016-11-24 | エスアイアイ・セミコンダクタ株式会社 | 樹脂封止型半導体装置およびその製造方法 |
| JP6044936B2 (ja) * | 2013-04-24 | 2016-12-14 | Shマテリアル株式会社 | 半導体素子搭載用基板の製造方法 |
| KR101640076B1 (ko) * | 2014-11-05 | 2016-07-15 | 앰코 테크놀로지 코리아 주식회사 | 웨이퍼 레벨의 칩 적층형 패키지 및 이의 제조 방법 |
| TWI535346B (zh) * | 2014-12-10 | 2016-05-21 | 上海兆芯集成電路有限公司 | 線路基板和封裝結構 |
| KR20170007612A (ko) * | 2015-07-09 | 2017-01-19 | 삼성전자주식회사 | 반도체 패키지 |
| CN204792766U (zh) * | 2015-07-21 | 2015-11-18 | 宁波芯健半导体有限公司 | 一种mosfet芯片封装结构 |
| JP6770331B2 (ja) * | 2016-05-02 | 2020-10-14 | ローム株式会社 | 電子部品およびその製造方法 |
-
2017
- 2017-03-29 JP JP2017065909A patent/JP6851239B2/ja active Active
-
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Patent Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2005026631A (ja) * | 2003-07-04 | 2005-01-27 | Sony Corp | 半導体装置及びその製造方法 |
| JP2010098000A (ja) * | 2008-10-14 | 2010-04-30 | Fuji Electric Systems Co Ltd | 半導体装置の製造方法及び半導体装置 |
| JP2017005073A (ja) * | 2015-06-09 | 2017-01-05 | 富士通株式会社 | 電子装置の製造方法 |
| JP2016001759A (ja) * | 2015-09-16 | 2016-01-07 | 凸版印刷株式会社 | 半導体装置 |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2021027091A (ja) * | 2019-08-01 | 2021-02-22 | リンテック株式会社 | 半導体素子の製造方法 |
| JP7319134B2 (ja) | 2019-08-01 | 2023-08-01 | リンテック株式会社 | 半導体素子の製造方法 |
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