JP2018006742A - 半導体デバイス製造における酸化スズ被膜スペーサ - Google Patents
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Abstract
Description
本明細書に開示される実装形態の別の態様は、本明細書で述べる方法を達成するために構成された装置およびシステムである。適切な装置は、プロセス操作を達成するためのハードウェアと、開示される実装形態に従ってプロセス操作を制御するための命令を有するシステム制御部とを含む。いくつかの実施形態では、SnO層を堆積するための堆積装置が提供される。いくつかの実施形態では、この堆積装置はALD装置(例えばPEALD装置)である。他の実施形態では、CVD装置、または酸化スズターゲットを含むスパッタリング装置でもよい。この装置は、プロセスチャンバと、堆積中に基板を所定位置に保持するための支持体と、プロセスガスをプロセスチャンバに流入するための入口とを含み、プロセスチャンバ内でプラズマを生成するためのシステムも含んでいてよい。さらに、この装置は、本明細書で提供される方法に従ってSnO層を堆積するためのプログラム命令を有する制御部を含む。
本明細書で述べた装置およびプロセスは、例えば、半導体デバイス、ディスプレイ、LED、太陽光発電パネルなどの作製または製造のためのリソグラフィパターン形成ツールまたはプロセスと共に使用されてもよい。必須ではないが、典型的には、そのような装置およびプロセスは、共通の製造施設で一緒に使用または実施される。被膜のリソグラフィパターン形成は、典型的には、以下のステップのいくつかまたは全てを含み、各ステップが、いくつかの可能なツールによって実現可能にされる:(1)スピンオンまたはスプレーオンツールを使用してワークピース(すなわち基板)にフォトレジストを塗布するステップ;(2)ホットプレートまたは炉またはUV硬化ツールを使用してフォトレジストを硬化するステップ;(3)ウェハステッパなどのツールを用いて可視光またはUV光またはX線光でフォトレジストを露光するステップ;(4)ウェットベンチなどのツールを使用して、レジストを現像し、レジストを選択的に除去し、それによりレジストをパターン形成するステップ;(5)ドライエッチングまたはプラズマエッチングツールを使用することによって、下にある被膜またはワークピースにレジストパターンを転写するステップ;および(6)RFまたはマイクロ波プラズマレジストストリッパなどのツールを使用してレジストを除去するステップ。
本明細書で述べた装置およびプロセスは、例えば、半導体デバイス、ディスプレイ、LED、太陽光発電パネルなどの作製または製造のためのリソグラフィパターン形成ツールまたはプロセスと共に使用されてもよい。必須ではないが、典型的には、そのような装置およびプロセスは、共通の製造施設で一緒に使用または実施される。被膜のリソグラフィパターン形成は、典型的には、以下のステップのいくつかまたは全てを含み、各ステップが、いくつかの可能なツールによって実現可能にされる:(1)スピンオンまたはスプレーオンツールを使用してワークピース(すなわち基板)にフォトレジストを塗布するステップ;(2)ホットプレートまたは炉またはUV硬化ツールを使用してフォトレジストを硬化するステップ;(3)ウェハステッパなどのツールを用いて可視光またはUV光またはX線光でフォトレジストを露光するステップ;(4)ウェットベンチなどのツールを使用して、レジストを現像し、レジストを選択的に除去し、それによりレジストをパターン形成するステップ;(5)ドライエッチングまたはプラズマエッチングツールを使用することによって、下にある被膜またはワークピースにレジストパターンを転写するステップ;および(6)RFまたはマイクロ波プラズマレジストストリッパなどのツールを使用してレジストを除去するステップ。
本発明は、たとえば、以下のような態様で実現することもできる。
適用例1:
半導体基板を処理する方法であって、
(a)第1の材料を含む露出層と、前記第1の材料とは異なる第2の材料を含む少なくとも1つの突出フィーチャとを有する半導体基板を提供するステップと、
(b)前記少なくとも1つの突出フィーチャの側壁を含め、前記第1の材料と前記第2の材料との両方の上にSnO層を堆積するステップとを含み、
前記第1の材料および前記第2の材料が、第1のエッチング化学反応に関して、SnOのエッチングレートに対する前記第1の材料のエッチングレートの比が1よりも大きく、第2のエッチング化学反応に関して、SnOのエッチングレートに対する前記第2の材料のエッチングレートの比が1よりも大きくなるように選択される
方法。
適用例2:
適用例1の方法であって、前記SnO層がコンフォーマルに堆積される方法。
適用例3:
適用例1の方法であって、前記SnO層が原子層堆積(ALD)によって堆積される方法。
適用例4:
適用例1の方法であって、前記SnO層が約5〜30nmの厚さに堆積される方法。
適用例5:
適用例1の方法であって、前記SnO層が約10〜20nmの厚さに堆積される方法。
適用例6:
適用例1の方法であって、前記第1の材料が、酸化ケイ素および窒化ケイ素からなる群から選択される材料を含む方法。
適用例7:
適用例1の方法であって、前記第2の材料が、非晶質シリコンおよび炭素からなる群から選択される材料を含む方法。
適用例8:
適用例1の方法であって、前記第1の材料が酸化ケイ素を含み、前記第1のエッチング化学反応がプラズマ・フルオロカーボン・エッチングである方法。
適用例9:
適用例1の方法であって、前記第2の材料が非晶質シリコンを含み、前記第2のエッチング化学反応が酸化性の酸素含有化学反応を含む方法。
適用例10:
適用例9の方法であって、前記第2の化学反応がプラズマエッチングであり、前記プラズマが、HBrおよびO 2 を含むプロセスガス中で生成される方法。
適用例11:
適用例1の方法であって、
(c)前記SnO層を堆積した後、前記少なくとも1つの突出部の前記側壁を覆う前記SnO層を完全には除去することなく、前記半導体基板の水平面から前記SnO層を完全に除去するステップ
をさらに含む方法。
適用例12:
適用例11の方法であって、
(d)前記半導体基板の水平面から前記SnO層を除去した後、前記第2のエッチング化学反応を使用して、前記少なくとも1つの突出部の前記側壁を覆っていた前記SnO層を完全には除去することなく前記少なくとも1つの突出部を完全に除去し、それによりSnOスペーサを形成するステップ
をさらに含む方法。
適用例13:
適用例12の方法であって、
(e)前記SnOスペーサを形成した後、前記第1のエッチング化学反応を使用して、前記SnOスペーサを完全には除去することなく前記第1の材料の露出部分を除去し、それにより、前記第1の材料の層の下にあるハードマスク層の一部を露出するステップ
をさらに含む方法。
適用例14:
適用例13の方法であって、
ステップ(e)の後、前記SnO層の下にあった第1の材料の前記層を完全には除去することなく、前記SnO層と前記ハードマスク層の露出部分との両方を除去するステップ
をさらに含む方法。
適用例15:
適用例13の方法であって、ステップ(e)が、前記基板をプラズマ・フルオロカーボン・エッチングに曝すステップを含む方法。
適用例16:
適用例15の方法であって、ステップ(e)の後、水素含有ガスを含むプロセスガス中でプラズマを生成して、揮発性の水素化スズを生成することによって、エッチングチャンバを洗浄するステップをさらに含む方法。
適用例17:
適用例16の方法であって、前記水素含有ガスが、H 2 および/またはNH 3 である方法。
適用例18:
適用例1の方法であって、前記半導体基板が、前記第2の材料を含む複数の突出フィーチャを備え、最も近い突出フィーチャ間の距離が約10〜100nmである方法。
適用例19:
適用例1の方法であって、前記半導体基板が、前記第2の材料を含む複数の突出フィーチャを備え、最も近い突出フィーチャ間の距離が約40〜100nmである方法。
適用例20:
適用例1の方法であって、前記半導体基板が、前記第2の材料を含む複数の突出フィーチャを備え、最も近い突出フィーチャ間の距離が約10〜30nmである方法。
適用例21:
適用例1の方法であって、
フォトレジストを前記半導体基板に塗布するステップと、
前記フォトレジストを露光するステップと、
前記フォトレジストをパターン形成し、前記パターンを前記半導体基板に転写するステップと、
前記半導体基板から前記フォトレジストを選択的に除去するステップと
をさらに含む方法。
適用例22:
適用例1の方法であって、前記第1の材料が、窒化ケイ素および酸化ケイ素からなる群から選択される材料を含み、前記第2の材料が、非晶質シリコンおよび炭素からなる群から選択される材料を含む方法。
適用例23:
半製造された半導体デバイスであって、第1の材料の露出層と、前記第1の材料の前記層上にある複数のSnOスペーサとを備える半導体デバイス。
適用例24:
半導体基板上にSnO層を堆積するための装置であって、
SnO堆積中に前記半導体基板を保持するために構成された基板ホルダを有するプロセスチャンバと、
反応物を導入するための入口と、
プログラム命令を含む制御部とを備え、前記プログラム命令が、
第1の材料の露出層と、第2の材料からなる複数の突出部とを有する半導体基板上にSnO層をコンフォーマルに堆積するためのものであり、前記第1の材料が、窒化ケイ素と酸化ケイ素からなる群から選択され、前記第2の材料が、非晶質シリコンおよび炭素からなる群から選択される
装置。
適用例25:
半導体基板を処理するためのシステムであって、
1つまたは複数の堆積プロセスチャンバと、
1つまたは複数のエッチングプロセスチャンバと、
プログラム命令を含むプロセス制御部とを備え、前記プログラム命令が、
(a)第1の材料を含む露出層と、前記第1の材料とは異なる第2の材料を含む少なくとも1つの突出フィーチャとを有する半導体基板を提供するため、および
(b)前記少なくとも1つの突出フィーチャの側壁を含め、前記第1の材料と前記第2の材料との両方の上にSnO層を堆積するためのものであり、
前記第1の材料および前記第2の材料が、第1のエッチング化学反応に関して、SnOのエッチングレートに対する前記第1の材料のエッチングレートの比が1よりも大きく、第2のエッチング化学反応に関して、SnOのエッチングレートに対する前記第2の材料のエッチングレートの比が1よりも大きくなるように選択される
システム。
適用例26:
適用例25のシステムであって、さらにステッパを備えるシステム。
適用例27:
コードを含む非一時的なコンピュータ可読媒体であって、前記コードが、
(a)第1の材料を含む露出層と、前記第1の材料とは異なる第2の材料を含む少なくとも1つの突出フィーチャとを有する半導体基板を提供するため、および
(b)前記少なくとも1つの突出フィーチャの側壁を含め、前記第1の材料と前記第2の材料との両方の上にSnO層を堆積するためのものであり、
前記第1の材料および前記第2の材料が、第1のエッチング化学反応に関して、SnOのエッチングレートに対する前記第1の材料のエッチングレートの比が1よりも大きく、第2のエッチング化学反応に関して、SnOのエッチングレートに対する前記第2の材料のエッチングレートの比が1よりも大きくなるように選択される
非一時的なコンピュータ可読媒体。
Claims (27)
- 半導体基板を処理する方法であって、
(a)第1の材料を含む露出層と、前記第1の材料とは異なる第2の材料を含む少なくとも1つの突出フィーチャとを有する半導体基板を提供するステップと、
(b)前記少なくとも1つの突出フィーチャの側壁を含め、前記第1の材料と前記第2の材料との両方の上にSnO層を堆積するステップとを含み、
前記第1の材料および前記第2の材料が、第1のエッチング化学反応に関して、SnOのエッチングレートに対する前記第1の材料のエッチングレートの比が1よりも大きく、第2のエッチング化学反応に関して、SnOのエッチングレートに対する前記第2の材料のエッチングレートの比が1よりも大きくなるように選択される
方法。 - 請求項1に記載の方法であって、前記SnO層がコンフォーマルに堆積される方法。
- 請求項1に記載の方法であって、前記SnO層が原子層堆積(ALD)によって堆積される方法。
- 請求項1に記載の方法であって、前記SnO層が約5〜30nmの厚さに堆積される方法。
- 請求項1に記載の方法であって、前記SnO層が約10〜20nmの厚さに堆積される方法。
- 請求項1に記載の方法であって、前記第1の材料が、酸化ケイ素および窒化ケイ素からなる群から選択される材料を含む方法。
- 請求項1に記載の方法であって、前記第2の材料が、非晶質シリコンおよび炭素からなる群から選択される材料を含む方法。
- 請求項1に記載の方法であって、前記第1の材料が酸化ケイ素を含み、前記第1のエッチング化学反応がプラズマ・フルオロカーボン・エッチングである方法。
- 請求項1に記載の方法であって、前記第2の材料が非晶質シリコンを含み、前記第2のエッチング化学反応が酸化性の酸素含有化学反応を含む方法。
- 請求項9に記載の方法であって、前記第2の化学反応がプラズマエッチングであり、前記プラズマが、HBrおよびO2を含むプロセスガス中で生成される方法。
- 請求項1に記載の方法であって、
(c)前記SnO層を堆積した後、前記少なくとも1つの突出部の前記側壁を覆う前記SnO層を完全には除去することなく、前記半導体基板の水平面から前記SnO層を完全に除去するステップ
をさらに含む方法。 - 請求項11に記載の方法であって、
(d)前記半導体基板の水平面から前記SnO層を除去した後、前記第2のエッチング化学反応を使用して、前記少なくとも1つの突出部の前記側壁を覆っていた前記SnO層を完全には除去することなく前記少なくとも1つの突出部を完全に除去し、それによりSnOスペーサを形成するステップ
をさらに含む方法。 - 請求項12に記載の方法であって、
(e)前記SnOスペーサを形成した後、前記第1のエッチング化学反応を使用して、前記SnOスペーサを完全には除去することなく前記第1の材料の露出部分を除去し、それにより、前記第1の材料の層の下にあるハードマスク層の一部を露出するステップ
をさらに含む方法。 - 請求項13に記載の方法であって、
ステップ(e)の後、前記SnO層の下にあった第1の材料の前記層を完全には除去することなく、前記SnO層と前記ハードマスク層の露出部分との両方を除去するステップ
をさらに含む方法。 - 請求項13に記載の方法であって、ステップ(e)が、前記基板をプラズマ・フルオロカーボン・エッチングに曝すステップを含む方法。
- 請求項15に記載の方法であって、ステップ(e)の後、水素含有ガスを含むプロセスガス中でプラズマを生成して、揮発性の水素化スズを生成することによって、エッチングチャンバを洗浄するステップをさらに含む方法。
- 請求項16に記載の方法であって、前記水素含有ガスが、H2および/またはNH3である方法。
- 請求項1に記載の方法であって、前記半導体基板が、前記第2の材料を含む複数の突出フィーチャを備え、最も近い突出フィーチャ間の距離が約10〜100nmである方法。
- 請求項1に記載の方法であって、前記半導体基板が、前記第2の材料を含む複数の突出フィーチャを備え、最も近い突出フィーチャ間の距離が約40〜100nmである方法。
- 請求項1に記載の方法であって、前記半導体基板が、前記第2の材料を含む複数の突出フィーチャを備え、最も近い突出フィーチャ間の距離が約10〜30nmである方法。
- 請求項1に記載の方法であって、
フォトレジストを前記半導体基板に塗布するステップと、
前記フォトレジストを露光するステップと、
前記フォトレジストをパターン形成し、前記パターンを前記半導体基板に転写するステップと、
前記半導体基板から前記フォトレジストを選択的に除去するステップと
をさらに含む方法。 - 請求項1に記載の方法であって、前記第1の材料が、窒化ケイ素および酸化ケイ素からなる群から選択される材料を含み、前記第2の材料が、非晶質シリコンおよび炭素からなる群から選択される材料を含む方法。
- 半製造された半導体デバイスであって、第1の材料の露出層と、前記第1の材料の前記層上にある複数のSnOスペーサとを備える半導体デバイス。
- 半導体基板上にSnO層を堆積するための装置であって、
SnO堆積中に前記半導体基板を保持するために構成された基板ホルダを有するプロセスチャンバと、
反応物を導入するための入口と、
プログラム命令を含む制御部とを備え、前記プログラム命令が、
第1の材料の露出層と、第2の材料からなる複数の突出部とを有する半導体基板上にSnO層をコンフォーマルに堆積するためのものであり、前記第1の材料が、窒化ケイ素と酸化ケイ素からなる群から選択され、前記第2の材料が、非晶質シリコンおよび炭素からなる群から選択される
装置。 - 半導体基板を処理するためのシステムであって、
1つまたは複数の堆積プロセスチャンバと、
1つまたは複数のエッチングプロセスチャンバと、
プログラム命令を含むプロセス制御部とを備え、前記プログラム命令が、
(a)第1の材料を含む露出層と、前記第1の材料とは異なる第2の材料を含む少なくとも1つの突出フィーチャとを有する半導体基板を提供するため、および
(b)前記少なくとも1つの突出フィーチャの側壁を含め、前記第1の材料と前記第2の材料との両方の上にSnO層を堆積するためのものであり、
前記第1の材料および前記第2の材料が、第1のエッチング化学反応に関して、SnOのエッチングレートに対する前記第1の材料のエッチングレートの比が1よりも大きく、第2のエッチング化学反応に関して、SnOのエッチングレートに対する前記第2の材料のエッチングレートの比が1よりも大きくなるように選択される
システム。 - 請求項25に記載のシステムであって、さらにステッパを備えるシステム。
- コードを含む非一時的なコンピュータ可読媒体であって、前記コードが、
(a)第1の材料を含む露出層と、前記第1の材料とは異なる第2の材料を含む少なくとも1つの突出フィーチャとを有する半導体基板を提供するため、および
(b)前記少なくとも1つの突出フィーチャの側壁を含め、前記第1の材料と前記第2の材料との両方の上にSnO層を堆積するためのものであり、
前記第1の材料および前記第2の材料が、第1のエッチング化学反応に関して、SnOのエッチングレートに対する前記第1の材料のエッチングレートの比が1よりも大きく、第2のエッチング化学反応に関して、SnOのエッチングレートに対する前記第2の材料のエッチングレートの比が1よりも大きくなるように選択される
非一時的なコンピュータ可読媒体。
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