JP2008108768A - 半導体装置の製造方法 - Google Patents
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- 239000004065 semiconductor Substances 0.000 title claims abstract description 69
- 238000004519 manufacturing process Methods 0.000 title claims abstract description 22
- 239000000758 substrate Substances 0.000 claims abstract description 73
- 229910052739 hydrogen Inorganic materials 0.000 claims abstract description 55
- 239000001257 hydrogen Substances 0.000 claims abstract description 55
- 239000011229 interlayer Substances 0.000 claims abstract description 47
- UFHFLCQGNIYNRP-UHFFFAOYSA-N Hydrogen Chemical compound [H][H] UFHFLCQGNIYNRP-UHFFFAOYSA-N 0.000 claims abstract description 46
- 238000000034 method Methods 0.000 claims abstract description 44
- 238000009792 diffusion process Methods 0.000 claims abstract description 30
- 239000010410 layer Substances 0.000 claims abstract description 21
- 238000002161 passivation Methods 0.000 claims abstract description 17
- 230000002265 prevention Effects 0.000 claims abstract description 14
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 claims description 44
- 229910052710 silicon Inorganic materials 0.000 claims description 44
- 239000010703 silicon Substances 0.000 claims description 44
- 238000005530 etching Methods 0.000 claims description 34
- 229910052751 metal Inorganic materials 0.000 claims description 13
- 239000002184 metal Substances 0.000 claims description 13
- 229910052581 Si3N4 Inorganic materials 0.000 claims description 11
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 claims description 11
- 239000012535 impurity Substances 0.000 claims description 9
- HBMJWWWQQXIZIP-UHFFFAOYSA-N silicon carbide Chemical compound [Si+]#[C-] HBMJWWWQQXIZIP-UHFFFAOYSA-N 0.000 claims description 5
- 229910010271 silicon carbide Inorganic materials 0.000 claims description 5
- 239000004020 conductor Substances 0.000 claims description 4
- ATJFFYVFTNAWJD-UHFFFAOYSA-N Tin Chemical compound [Sn] ATJFFYVFTNAWJD-UHFFFAOYSA-N 0.000 claims description 3
- 230000008569 process Effects 0.000 description 17
- 238000005245 sintering Methods 0.000 description 17
- WFKWXMTUELFFGS-UHFFFAOYSA-N tungsten Chemical compound [W] WFKWXMTUELFFGS-UHFFFAOYSA-N 0.000 description 15
- 229910052721 tungsten Inorganic materials 0.000 description 15
- 239000010937 tungsten Substances 0.000 description 15
- 230000004888 barrier function Effects 0.000 description 10
- 150000002431 hydrogen Chemical class 0.000 description 9
- 238000002955 isolation Methods 0.000 description 7
- 229910000838 Al alloy Inorganic materials 0.000 description 4
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 4
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 4
- 229920005591 polysilicon Polymers 0.000 description 4
- 229910052814 silicon oxide Inorganic materials 0.000 description 4
- 230000015572 biosynthetic process Effects 0.000 description 3
- 230000035699 permeability Effects 0.000 description 3
- 238000004544 sputter deposition Methods 0.000 description 3
- 238000007747 plating Methods 0.000 description 2
- 238000005498 polishing Methods 0.000 description 2
- 230000007547 defect Effects 0.000 description 1
- 238000001312 dry etching Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000002844 melting Methods 0.000 description 1
- 230000008018 melting Effects 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 230000003647 oxidation Effects 0.000 description 1
- 238000007254 oxidation reaction Methods 0.000 description 1
- 238000001039 wet etching Methods 0.000 description 1
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- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
- Insulated Gate Type Field-Effect Transistor (AREA)
Abstract
【課題】処理温度を高温にしなくてもトランジスタのゲート絶縁膜と半導体基板の界面に水素を十分に供給することができる半導体装置の製造方法を提供する。
【解決手段】本発明に係る半導体装置の製造方法は、半導体基板1の表面にトランジスタを形成する工程と、半導体基板1の表面上及びトランジスタ上に層間絶縁膜9,12及び配線層10,13を形成する工程と、最上層の配線層13上及び層間絶縁膜12上にパッシベーション膜14を形成する工程とを具備し、パッシベーション膜14を形成する工程の前に、半導体基板1の裏面には膜(例えば拡散防止膜8)が形成されており、パッシベーション膜14を形成する工程の後に、半導体基板1の裏面から前記膜を除去する工程と、半導体基板1の裏面から、トランジスタのゲート絶縁膜と半導体基板1の界面に水素を供給する工程とを具備する。
【選択図】図2
【解決手段】本発明に係る半導体装置の製造方法は、半導体基板1の表面にトランジスタを形成する工程と、半導体基板1の表面上及びトランジスタ上に層間絶縁膜9,12及び配線層10,13を形成する工程と、最上層の配線層13上及び層間絶縁膜12上にパッシベーション膜14を形成する工程とを具備し、パッシベーション膜14を形成する工程の前に、半導体基板1の裏面には膜(例えば拡散防止膜8)が形成されており、パッシベーション膜14を形成する工程の後に、半導体基板1の裏面から前記膜を除去する工程と、半導体基板1の裏面から、トランジスタのゲート絶縁膜と半導体基板1の界面に水素を供給する工程とを具備する。
【選択図】図2
Description
本発明は、トランジスタを有する半導体装置の製造方法に関する。特に本発明は、処理温度を高温にしなくてもトランジスタのゲート絶縁膜と半導体基板の界面に水素を十分に供給することができる半導体装置の製造方法に関する。
図5は、水素シンター処理が行われる従来の半導体装置の断面図である。水素シンター処理は、トランジスタのゲート絶縁膜とシリコン基板の界面に水素を供給し、欠陥(シリコンダングリングボンド)を低減する処理である。水素シンター処理は、半導体装置の表面側から行われるのが一般的である(例えば特許文献1参照)。
図5に示す半導体装置は、シリコン基板100の表面に、ゲート絶縁膜103を有するトランジスタが形成されている。トランジスタ及びシリコン基板100の上には1層目の層間絶縁膜109及び2層目の層間絶縁膜112が、この順に積層されている。1層目の層間絶縁膜109の表面には1層目のCu配線110が埋め込まれており、2層目の層間絶縁膜112には、タングステンプラグと2層目のCu配線113が埋め込まれている。層間絶縁膜112及びCu配線113はパッシベーション膜114で覆われている。パッシベーション膜114は、例えば窒化シリコン膜などの水素が透過しにくい膜を有している。
層間絶縁膜109,112には、Cu配線110,113を埋め込むための溝がエッチングにより形成されている。層間絶縁膜109,112それぞれの中には、溝形成の為のエッチング処理におけるエッチングストッパー膜109b,112bが設けられている。エッチングストッパー膜109b,112bには、窒化シリコン膜、炭化シリコン膜、炭窒化シリコン膜などの水素が透過しにくい膜が用いられる。
また、Cu配線110を埋め込む為の溝の底面には、Cu配線110とトランジスタ(例えばゲート電極104)を接続する為の接続溝が形成されており、Cu配線113を埋め込む為の溝の底面には、Cu配線110とCu配線113を接続する為の接続孔が形成されている。これらの接続孔はエッチングにより形成されている。層間絶縁膜109上には、接続孔形成の為のエッチング処理におけるエッチングストッパー膜111が形成されている。エッチングストッパー膜111には、窒化シリコン膜、炭化シリコン膜、炭窒化シリコン膜などの水素が透過しにくい膜が用いられる。
また、Cu配線110,113が埋め込まれる溝及び接続孔の側壁は、Cuの拡散を防止する為の拡散防止膜110a,113aで覆われている。拡散防止膜110a,113aには、Ti、TiN、Ta、TaN、MnSiOなどの水素が透過しにくい膜が用いられる。
また、Cu配線110,113は、層間絶縁膜109,112に形成された溝及び接続孔内、層間絶縁膜109,112にCu膜をスパッタリング法及びめっき法により形成した後、層間絶縁膜109,112上に位置するCu膜をCMPで研磨除去することにより形成される。Cu膜を形成する処理においてシリコン基板100の裏面にCuが付着すると、シリコン中のCuの拡散係数は高いため、ゲート絶縁膜103とシリコン基板100の界面にCuが供給され、トランジスタの特性が劣化する。これを防止する為に、層間絶縁膜109を形成する前に、シリコン基板100の裏面には拡散防止膜108が形成される。
上記したように、トランジスタの上にはエッチングストッパー膜、拡散防止膜、及びパッシベーション膜など、水素が透過しにくい膜が複数形成されている。このため、従来のように半導体基板の上からゲート絶縁膜と半導体基板の界面に十分な量の水素を供給するためには、処理温度を高温(例えば400℃)にする必要があった。処理温度が高温になると、半導体装置を構成する部品(例えば配線)に負荷が加わるため、処理温度は低温なのが好ましい。
本発明は上記のような事情を考慮してなされたものであり、その目的は、処理温度を高温にしなくてもトランジスタのゲート絶縁膜と半導体基板の界面に水素を十分に供給することができる半導体装置の製造方法を提供することにある。
上記課題を解決するため、本発明に係る半導体装置の製造方法は、半導体基板の表面に、ゲート絶縁膜を有するトランジスタを形成する工程と、
前記半導体基板の表面上及び前記トランジスタ上に層間絶縁膜及び配線層をそれぞれ少なくとも一層形成する工程と、
最上層の配線層及び層間絶縁膜それぞれ上にパッシベーション膜を形成する工程と、
を具備し、前記パッシベーション膜を形成する工程が終了した状態では前記半導体基板の裏面には膜が形成されており、
前記パッシベーション膜を形成する工程の後に、
前記半導体基板の裏面から前記膜を除去する工程と、
前記半導体基板の裏面から前記半導体基板内に水素を拡散させることにより、前記トランジスタのゲート絶縁膜と前記半導体基板の界面に水素を供給する工程とを具備する。
前記半導体基板の表面上及び前記トランジスタ上に層間絶縁膜及び配線層をそれぞれ少なくとも一層形成する工程と、
最上層の配線層及び層間絶縁膜それぞれ上にパッシベーション膜を形成する工程と、
を具備し、前記パッシベーション膜を形成する工程が終了した状態では前記半導体基板の裏面には膜が形成されており、
前記パッシベーション膜を形成する工程の後に、
前記半導体基板の裏面から前記膜を除去する工程と、
前記半導体基板の裏面から前記半導体基板内に水素を拡散させることにより、前記トランジスタのゲート絶縁膜と前記半導体基板の界面に水素を供給する工程とを具備する。
この半導体装置の製造方法によれば、前記水素を供給する工程において前記半導体基板の裏面には膜が存在しない為、処理温度を高温にしなくても前記半導体基板の裏面から前記界面に十分な量の水素を供給することができる。
前記トランジスタを形成する工程は、例えばゲート絶縁膜を形成する工程と、前記ゲート絶縁膜上にゲート電極を形成する工程と、前記ゲート電極上及びその周囲に絶縁膜を形成する工程と、前記絶縁膜をエッチバックすることにより前記ゲート電極の側壁を覆うサイドウォールを形成する工程とを具備する。この場合、前記絶縁膜を形成する工程において、前記半導体基板の裏面に前記膜が形成される。
前記層間絶縁膜及び配線層を形成する工程の前に、金属不純物が前記半導体基板を介して前記トランジスタに拡散することを防止するために、前記半導体基板の裏面に前記膜を形成する工程を具備してもよい。前記パッシベーション膜は、水素透過率が低い膜、例えば窒化シリコン膜を有する。
前記層間絶縁膜及び前記配線層は、それぞれ2層以上形成される場合、前記層間絶縁膜及び前記配線層を形成する工程は、例えば第1の前記層間絶縁膜を形成する工程と、前記第1の層間絶縁膜上にエッチングストッパー膜を形成する工程と、前記エッチングストッパー膜上に第2の前記層間絶縁膜を形成する工程と、前記第2の層間絶縁膜上に溝を形成し、かつ前記エッチングストッパー膜をストッパーとしたエッチングにより前記溝の底面に接続孔を形成する工程と、前記溝及び前記接続孔に導電体を埋め込むことにより配線を形成する工程とを具備する。この場合、前記エッチングストッパー膜は、水素透過率が低い膜、例えば窒化シリコン膜、炭化シリコン膜、炭窒化シリコン膜の少なくとも一つを含んでいてもよい。
前記溝の底面に接続孔を形成する工程と、前記溝及び前記接続孔に導電体を埋め込むことにより配線を形成する工程の間に、少なくとも前記溝の側壁に拡散防止膜を形成する工程を具備してもよい。前記拡散防止膜は、水素透過率が低い膜、例えばTi膜及びTiN膜、Ta膜及びTaN膜、若しくはMnSiO膜を含んでいてもよい。
前記半導体基板の裏面から前記トランジスタのゲート界面に水素を供給する工程は、例えばバッチ式の熱拡散炉を用いて行われる。バッチ式の熱拡散炉を用いると、前記半導体装置の表面からも、前記界面に水素を供給することができる。
前記半導体基板の裏面から前記トランジスタのゲート界面に水素を供給する工程は、例えばバッチ式の熱拡散炉を用いて行われる。バッチ式の熱拡散炉を用いると、前記半導体装置の表面からも、前記界面に水素を供給することができる。
以下、図面を参照して本発明の実施形態について説明する。図1及び図2の各図は、本発明の第1の実施形態に係る半導体装置の製造方法を説明する為の図である。本実施形態は、シリコン基板の表面に半導体装置を形成し、次いでシリコン基板の裏面に形成された膜を除去した後に、バッチ式の熱拡散炉を用いて水素シンター処理を行うことにより、シリコン基板の裏面及び表面から、トランジスタのゲート絶縁膜と半導体基板の界面に水素を供給する方法である。
まず、図1(A)の断面図に示すように、トレンチアイソレーション法を用いて、シリコン基板1の表面に素子分離膜2を埋め込み、トランジスタが形成される素子領域を他の領域から分離する。素子分離膜2はシリコン酸化膜により形成されている。なお、素子分離膜2はLOCOS酸化法により形成されても良い。次いで、シリコン基板1を熱酸化する。これにより、素子領域に位置するシリコン基板1にはゲート絶縁膜3が形成される。
次いで、ゲート絶縁膜3上にポリシリコン膜を形成し、このポリシリコン膜を選択的に除去する。これにより、ゲート絶縁膜3上にはゲート電極4が形成される。なお、ポリシリコン膜を形成する工程において、シリコン基板1の裏面にもポリシリコン膜(図示せず)が形成される。
次いで、素子分離膜2及びゲート電極4をマスクとして、シリコン基板1に不純物を導入する。これにより、シリコン基板1には低濃度不純物領域6が形成される。次いで、ゲート電極4上を含む全面上に絶縁膜(例えば酸化シリコン膜及び窒化シリコン膜の積層膜)を形成し、この絶縁膜をエッチバックする。これにより、ゲート電極4の側壁はサイドウォール5で覆われる。なお、サイドウォールとなる絶縁膜を形成する工程において、シリコン基板1の裏面にも絶縁膜が形成される。
次いで、素子分離膜2、ゲート電極4、及びサイドウォール5をマスクとしてシリコン基板1に不純物を導入する。これにより、シリコン基板1にはソース及びドレインとなる2つの不純物領域7が形成される。
このようにして、シリコン基板1の表面にはトランジスタが形成される。
このようにして、シリコン基板1の表面にはトランジスタが形成される。
次いで、図1(B)の断面図に示すように、シリコン基板1の裏面に拡散防止膜8を形成する。拡散防止膜8は、例えば酸化シリコン膜及び窒化シリコン膜をこの順に積層した膜であり、後述する配線形成工程においてシリコン基板1の裏面に付着したCu等の金属不純物がシリコン基板1中を拡散することを防止する為の膜である。
次いで、トランジスタ上を含む全面上に、層間絶縁膜9を構成する絶縁膜9aを形成する。次いで絶縁膜9a上にレジストパターン(図示せず)を形成し、このレジストパターンをマスクとして絶縁膜9aをエッチングする。これにより絶縁膜9aにはトランジスタ上(例えばゲート電極4上)に位置する接続孔が形成される。その後、レジストパターンを除去する。次いで、接続孔内及び絶縁膜9a上にバリアメタル膜を形成し、さらにバリアメタル膜上にタングステン膜を形成する。次いで、絶縁膜9a上に位置するバリアメタル膜及びタングステン膜をCMP法により研磨除去する。これにより、接続孔内にはバリアメタル膜15a及びタングステンプラグ15が埋め込まれる。
次いで、タングステンプラグ15上及び絶縁膜9a上にエッチングストッパー膜9bを形成し、さらにエッチングストッパー膜9b上に層間絶縁膜9を構成する絶縁膜9cを形成する。次いで絶縁膜9c上にレジストパターン(図示せず)を形成し、このレジストパターンをマスクとして絶縁膜9cをエッチングし、さらにエッチング条件を変えてエッチングストッパー膜9bをエッチングする。これにより、絶縁膜9cにはタングステンプラグ15上に位置する溝が形成される。この溝の底部ではタングステンプラグ15が露出している。その後、レジストパターンを除去する。
次いで、溝内及び絶縁膜9c上にバリアメタル膜10aを形成し、さらにバリアメタル膜10a上にCu膜をスパッタリング法とめっき法により形成する。次いで、絶縁膜9c上に位置するバリアメタル膜10a及びCu膜をCMP法により研磨除去する。これにより溝内には、バリアメタル膜10a及びCu配線10が埋め込まれる。
次いで、図1(C)の断面図に示すように、絶縁膜9c上及び配線10上に、エッチングストッパー膜11を形成する。エッチングストッパー膜11は、例えば窒化シリコン膜、炭化シリコン膜、又は炭窒化シリコン膜である。次いでエッチングストッパー膜11上に、第2層目の層間絶縁膜12を構成する絶縁膜12a、エッチングストッパー膜12b、及び絶縁膜12cをこの順に形成する。
次いで、絶縁膜12cに溝を形成し、さらにエッチングストッパー膜12b及び絶縁膜12aに接続孔を形成する。この溝及び接続孔の形成方法は、バリアメタル膜及びタングステンプラグ膜を形成する工程が省かれている点を除いて、層間絶縁膜9に溝及び接続孔を形成する方法と同様である。なお、接続孔を形成する工程において、エッチングストッパー膜11がエッチングストッパーとして機能する。次いで、層間絶縁膜12の溝及び接続孔に拡散防止膜13aを形成し、さらに第2層目の配線13を埋め込む。拡散防止膜13a及び配線13の形成方法は、拡散防止膜10a及び配線10の形成方法と略同様である。ただし、配線13及び拡散防止膜13aは、絶縁膜12aに形成された接続孔内にも埋め込まれる。
次いで、層間絶縁膜12及び配線13上にパッシベーション膜14を形成する。パッシベーション膜14は、例えば酸化シリコン膜及び窒化シリコン膜をこの順に積層した膜である。
次いで、シリコン基板1の裏面に形成された膜(拡散防止膜8を含む)を全て除去する。この除去には、例えばウェットエッチング又はドライエッチングが用いられる。
次いで、図2(A)の縦断面図に示すように、シリコン基板1をバッチ式の熱拡散炉50に挿入し、水素シンター処理を行う。熱拡散炉50の処理室51の中は水素雰囲気となっており、その周囲に配置されているヒータ53によって内部が加熱される。処理室51の底面には保熱ユニット54が位置している。保熱ユニット54上にはウェハボード52が配置されている。ウェハボード52は複数のシリコン基板1を、互いに離間して保持している。ウェハボード52に保持されている状態において、シリコン基板1の表面側は水素雰囲気に露出しており、かつ裏面はウェハボード52と接しているごく一部を除いて水素雰囲気に露出している。
図2(B)の断面図は、水素シンター処理における水素が拡散する様子を説明する為の半導体装置の断面図である。上記したように、水素シンター処理が行われている間、裏面は大部分が水素雰囲気に露出している。また、シリコン基板1の裏面に形成された膜は全て除去されている。また、シリコン中の水素の拡散係数は十分に大きい。このため、水素はシリコン基板1の裏面から拡散し、ゲート絶縁膜3とシリコン基板1の界面には十分な量の水素が供給される。なお、シリコン基板1の表面側も水素雰囲気に露出しているため、上記した界面には表面側からも水素が供給される。
図3は、本実施形態に示した方法により水素シンター処理を行った場合の、界面準位の処理温度依存性を示すグラフである。なお、比較の為、シリコン基板1の裏面の膜を除去しなかった場合の、界面準位の処理温度依存性も示している。縦軸は、水素シンター処理を行わなかった場合の界面準位を1とした相対的な値である。
シリコン基板1の裏面の膜を除去しなかった場合、界面準位を0.3以下にする為には処理温度を400℃以上にする必要がある。これに対して、本実施形態によれば、処理温度が350℃以下であっても界面準位が0.3以下になっている。本図から、本実施形態によれば、処理温度を従来と比較して低温にできることが分かる。
以上、本発明の第1の実施形態によれば、水素シンター処理を行う前に、シリコン基板1の裏面に形成された膜は全て除去されている。このため、水素はシリコン基板1の裏面から拡散し、水素シンター処理を高温で行わなくても、ゲート絶縁膜3とシリコン基板1の界面には十分な量の水素が供給される。
図4は、本発明の第2の実施形態に係る半導体装置の製造方法を説明する為の断面図である。本実施形態に係る半導体装置の製造方法は、層間絶縁膜9,12の中にエッチングストッパー膜を形成しない点、層間絶縁膜9に溝を形成しないで接続孔のみを形成する点、層間絶縁膜9に形成された接続孔にタングステンプラグ10bを埋め込んでトランジスタと配線10を電気的に接続する点、層間絶縁膜12に形成された接続孔にタングステンプラグ13bを埋め込んで配線10,13を相互に電気的に接続する点、配線10,13が層間絶縁膜9,12に埋め込まれておらずAl合金を用いて形成されている点、及び接続孔の側壁及びシリコン基板1の裏面に拡散防止膜が形成されない点が、第1の実施形態と異なる。以下、第1の実施形態と同様の構成については同一の符号を付して、説明を省略する。
本実施形態においてタングステンプラグ10b,13bは、接続孔中及び層間絶縁膜9,12上にタングステン膜を形成した後、層間絶縁膜9,12上に位置するタングステン膜をCMP法により研磨除去することにより形成される。配線10は、層間絶縁膜9及びタングステンプラグ10b上にAl合金膜をスパッタリング法により形成したのち、このAl合金膜を選択的に除去することにより形成される。配線13も、配線10と同様の方法により形成される。
本実施形態によっても第1の実施形態と同様の効果を得ることができる。また、配線10,13をCuと比較して融点が低いAl合金で形成しているため、本発明の優位性がさらに顕著になる。
尚、本発明は上述した実施形態に限定されるものではなく、本発明の主旨を逸脱しない範囲内で種々変更して実施することが可能である。例えば上記した各実施形態では配線層及び層間絶縁膜を各2層としたが、それぞれを3層以上にしてもよい。このような場合、半導体装置の表面側から水素がさらに拡散しにくくなる為、本発明の優位性がさらに顕著になる。また、上記した実施形態において水素シンター処理は、バッチ式の熱拡散を用いて行ったが、炉枚葉式の水素シンター処理装置を用いてもよい。
1,100…シリコン基板、2…素子分離膜、3,103…ゲート絶縁膜、4,104…ゲート電極、5…サイドウォール、6…低濃度不純物領域、7…不純物領域、8,10a,13a,110a,113a…拡散防止膜、9,12,109,112…層間絶縁膜、9a,9c,12a,12c…絶縁膜、9b,11,12b,109b,112b,111…エッチングストッパー膜、10,13…配線、10b,13b,15…タングステンプラグ、14,114…パッシベーション膜、15a…バリアメタル膜、50…熱拡散炉、51…処理室、52…ウェハボード、53…ヒータ、54…保熱ユニット、110,113…Cu配線
Claims (9)
- 半導体基板の表面に、ゲート絶縁膜を有するトランジスタを形成する工程と、
前記半導体基板の表面上及び前記トランジスタ上に層間絶縁膜及び配線層をそれぞれ少なくとも一層形成する工程と、
最上層の配線層及び層間絶縁膜それぞれ上にパッシベーション膜を形成する工程と、
を具備し、前記パッシベーション膜を形成する工程が終了した状態では前記半導体基板の裏面には膜が形成されており、
前記パッシベーション膜を形成する工程の後に、
前記半導体基板の裏面から前記膜を除去する工程と、
前記半導体基板の裏面から前記半導体基板内に水素を拡散させることにより、前記トランジスタのゲート絶縁膜と前記半導体基板の界面に水素を供給する工程と、
を具備する半導体装置の製造方法。 - 前記トランジスタを形成する工程は、
前記半導体基板の表面にゲート絶縁膜を形成する工程と、
前記ゲート絶縁膜上にゲート電極を形成する工程と、
前記ゲート電極上及びその周囲に絶縁膜を形成する工程と、
前記絶縁膜をエッチバックすることにより前記ゲート電極の側壁を覆うサイドウォールを形成する工程と、
を具備し、
前記絶縁膜を形成する工程において、前記半導体基板の裏面に前記膜が形成される請求項1に記載の半導体装置の製造方法。 - 前記層間絶縁膜及び配線層を形成する工程の前に、金属不純物が前記半導体基板を介して前記トランジスタに拡散することを防止するために、前記半導体基板の裏面に前記膜を形成する工程を具備する請求項1に記載の半導体装置の製造方法。
- 前記パッシベーション膜は窒化シリコン膜を有する請求項1〜3のいずれか一項に記載の半導体装置の製造方法。
- 前記層間絶縁膜及び前記配線層は、それぞれ2層以上形成され、
前記層間絶縁膜及び前記配線層を形成する工程は、
第1の前記層間絶縁膜を形成する工程と、
前記第1の層間絶縁膜上にエッチングストッパー膜を形成する工程と、
前記エッチングストッパー膜上に第2の前記層間絶縁膜を形成する工程と、
前記第2の層間絶縁膜上に溝を形成し、かつ前記エッチングストッパー膜をストッパーとしたエッチングにより前記溝の底面に接続孔を形成する工程と、
前記溝及び前記接続孔に導電体を埋め込むことにより配線を形成する工程と、
を具備する請求項1〜4のいずれか一項に記載の半導体装置の製造方法。 - 前記エッチングストッパー膜は、窒化シリコン膜、炭化シリコン膜、炭窒化シリコン膜の少なくとも一つを含む請求項5に記載の半導体装置の製造方法。
- 前記溝の底面に接続孔を形成する工程と、前記溝及び前記接続孔に導電体を埋め込むことにより配線を形成する工程の間に、少なくとも前記溝の側壁に拡散防止膜を形成する工程を具備する請求項5又は6に記載の半導体装置の製造方法。
- 前記拡散防止膜は、Ti膜及びTiN膜、Ta膜及びTaN膜、若しくはMnSiO膜を含む請求項7に記載の半導体装置の製造方法。
- 前記半導体基板の裏面から前記トランジスタのゲート界面に水素を供給する工程は、バッチ式の熱拡散炉を用いて行われる請求項1〜8のいずれか一項に記載の半導体装置の製造方法。
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| Application Number | Priority Date | Filing Date | Title |
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