JP2005166764A - Multilayer printed wiring board and method for producing multilayer printed wiring board - Google Patents
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Abstract
【課題】信頼性の高いブラインドビアを設けた多層プリント配線板、および信頼性の高いブラインドビアを容易に形成可能な多層プリント配線板の製造方法を提供することを課題とする。
【解決手段】コア部材10の第3層(L3)に、配線パターン14の導体厚Th1より厚い、導体厚Th2のビア受けランド12を形成し、上記ビア受けランド12を設けたコア部材10に、ドリル加工で、絶縁層18を介して上記ビア受けランド12と対向する面方向より、上記ビア受けランド12に接する深さまで所定径の孔を穿設し、その孔の内壁に所定のめっきを施してL1,L3間を回路接続するブラインドビア11を形成する。
【選択図】 図1It is an object of the present invention to provide a multilayer printed wiring board provided with a highly reliable blind via and a method for manufacturing a multilayer printed wiring board capable of easily forming a highly reliable blind via.
A via receiving land having a conductor thickness Th2 that is thicker than a conductor thickness Th1 of a wiring pattern 14 is formed in a third layer (L3) of the core member 10, and the core member 10 provided with the via receiving land 12 is provided. Then, by drilling, a hole with a predetermined diameter is drilled from the surface direction facing the via receiving land 12 through the insulating layer 18 to a depth in contact with the via receiving land 12, and predetermined plating is applied to the inner wall of the hole As a result, the blind via 11 for connecting the circuits between L1 and L3 is formed.
[Selection] Figure 1
Description
本発明は各種の電子回路に適用される多層プリント配線板および多層プリント配線板の製造方法に関する。 The present invention relates to a multilayer printed wiring board applied to various electronic circuits and a method for manufacturing the multilayer printed wiring board.
情報処理機器をはじめ各種の小型電子機器に於いては、絶縁層(プリプレグ)とコア(銅張積層板)とを交互に積層した多層プリント配線板が広く用いられる。この種、多層プリント配線板には、配線パターンに加え、上記積層された配線板を貫通するスルーホール、上記配線板を貫通しないブラインドビア(blind via hole)等が設けられる。 In various small electronic devices including information processing devices, multilayer printed wiring boards in which insulating layers (prepregs) and cores (copper-clad laminates) are alternately laminated are widely used. In this type of multilayer printed wiring board, in addition to the wiring pattern, a through hole that penetrates the laminated wiring board, a blind via hole that does not penetrate the wiring board, and the like are provided.
多層プリント配線板に於けるブラインドビアの成形技術として、従来では、絶縁層に、コア部材に向けて穴加工を施し、この穴の先端をコア部材に形成した内層ランドに当接させてブラインドビアを形成する際に、ブラインドビア内壁のめっき層と絶縁層との熱膨張係数の違いに起因する熱ストレスによるめっき層の亀裂を低減するため、ビア形成周部(穴形成周部)に導体層を設けてビア形成周部の絶縁層を薄くする技術が存在する。このように従来技術では、絶縁層よりコア部材に向けて穴加工を施して形成するブラインドビアに対して、絶縁層の膜厚を薄くすることで、ブラインドビア内壁のめっき層と絶縁層との熱膨張係数の違いに起因する熱ストレスによるめっき層の亀裂の低減を図っている。 As a technique for forming blind vias in multilayer printed wiring boards, conventionally, via holes are drilled in the insulating layer toward the core member, and the tip of each hole is brought into contact with an inner land formed in the core member to blind blind vias. In order to reduce cracks in the plating layer due to thermal stress due to the difference in thermal expansion coefficient between the plating layer on the inner wall of the blind via and the insulating layer, the conductor layer is formed on the via formation peripheral part (hole formation peripheral part). There is a technique for thinning the insulating layer in the periphery of the via formation. As described above, in the prior art, the thickness of the insulating layer is reduced with respect to the blind via formed by drilling the insulating layer toward the core member. The crack of the plating layer due to the thermal stress caused by the difference in thermal expansion coefficient is reduced.
しかしながら、従来では、ドリル加工でコア部材に所定径の孔を穿設し、その孔の穿設方向先端をコア部材に形成したランドに当接させてブラインドビアを形成するブラインドビアの加工技術に関して、歩留まりを改善する効果的な技術が存在しなかった。 However, conventionally, a blind via processing technique in which a hole having a predetermined diameter is formed in a core member by drilling, and a tip of the hole in the drilling direction is brought into contact with a land formed in the core member to form a blind via. There was no effective technique to improve the yield.
特に、近年、プリント配線板の信号パターンは、高密度配線をするため、益々細くなる傾向がある。細い信号パターン(配線パターン)を形成するには、配線パターンの厚さ(導体厚)を薄くすることがパターン形成並びに歩留まりの面から望ましい。通常、上記ブラインドビアの受けランドはパターンエッチング等により同層の配線パターンと同時に形成される。従って配線パターンの厚さを薄くすると上記ブラインドビアの受けランドもその導体厚が薄くなってしまう。上記ブラインドビア受けランドの導体厚が薄くなると、上記したようなドリル加工でコア部材に穿設し、その穿設方向先端をコア部材に形成したランドに当接させてブラインドビアを形成するブラインドビアの加工技術に於いて、ドリル加工の深さ制御が正常なブラインドビア形成に大きく影響し、歩留まりの問題が派生する。具体的にはコア部材に形成した穴が浅い場合は回路の未接続による不良を招き、上記穴が深い場合はその穿設方向先端にある他層との回路接続による不良を招くという歩留まりの問題が生じる。さらに、この際、絶縁層を表層とした積層構造が一般的であり、コアの厚さ方向の寸法精度に対して絶縁層の厚さ方向の寸法精度が劣ることから、上記した問題点がより顕著になる。
上述したように、従来では、ドリル加工でコア部材に穿設し、その穿設方向先端をコア部材に形成したランドに当接させてブラインドビアを形成するブラインドビアの加工技術に於いて、ドリル加工の深さ制御が正常なブラインドビア形成に大きく影響し、ブラインドビア加工の容易化並びに歩留まりの面で問題があった。 As described above, conventionally, in the blind via machining technique in which a drill is drilled in a core member and a blind via is formed by abutting a tip formed in the drilling direction on a land formed in the core member. Control of the processing depth has a great influence on the formation of normal blind vias, and there are problems in terms of ease of blind via processing and yield.
本発明は上記実情に鑑みなされたもので、信頼性の高いブラインドビアを設けた多層プリント配線板、および信頼性の高いブラインドビアを容易に形成可能な多層プリント配線板の製造方法を提供することを目的とする。 The present invention has been made in view of the above circumstances, and provides a multilayer printed wiring board provided with a highly reliable blind via and a method for manufacturing a multilayer printed wiring board capable of easily forming a highly reliable blind via. With the goal.
本発明は、ドリル加工でコア部材に穿設し、その穿設方向先端をコア部材に形成したランドに当接させてブラインドビアを形成する多層プリント配線板に於いて、コアと、前記コアに形成された配線パターンと、前記コアに前記配線パターンの面より突出する方向に肉厚に形成されたブラインドビアの受けランドと、前記コアに前記受けランドと対向する面より穿設され、その穿設方向先端が前記受けランドに当接して形成されたブラインドビアとを具備したことを特徴とする。 The present invention relates to a multilayer printed wiring board in which a drill is drilled in a core member and a blind via is formed by contacting a tip formed in the drilling direction with a land formed in the core member. The formed wiring pattern, the receiving land of the blind via formed in the core in a direction protruding from the surface of the wiring pattern, and the core are formed from the surface facing the receiving land, And a blind via formed at its front end in contact with the receiving land.
また本発明は、コア部にブラインドビアを受けるランドおよび配線パターンを形成し、前記コア部の前記ランド形成面と対向する面からドリル加工により所定径の孔を穿設し、前記穿設した孔の内壁とその孔に当接した前記ランド面とにめっきを施して前記コア部に絶縁層を介しブラインドビアを形成するプリント配線板の製造方法に於いて、前記ブラインドビアの穿設方向先端部に設けられる前記ブラインドビアを受けるランドの導体厚を同層の前記配線パターンより厚くしたことを特徴とする。 In the present invention, a land and a wiring pattern for receiving a blind via are formed in the core portion, a hole having a predetermined diameter is drilled from a surface of the core portion facing the land forming surface, and the drilled hole is formed. In the method of manufacturing a printed wiring board, in which a blind via is formed on the core portion through an insulating layer by plating the inner wall of the substrate and the land surface in contact with the hole, the tip end portion of the blind via in the drilling direction The land receiving the via via is provided with a conductor thickness larger than that of the wiring pattern in the same layer.
ドリル加工でコア部材に所定径の穿設し、その孔の穿設方向先端をコア部材に形成したランドに当接させてブラインドビアを形成した多層プリント配線板に於いて、信頼性の高いブラインドビアを設けた多層プリント配線板を歩留まり良く容易に実現できる。 A highly reliable blind in a multilayer printed wiring board in which a drill hole is drilled to a predetermined diameter in the core member, and a blind via is formed by contacting the tip of the hole in the drilling direction with a land formed in the core member. A multilayer printed wiring board provided with vias can be easily realized with a high yield.
以下図面を参照して本発明の実施形態を説明する。 Embodiments of the present invention will be described below with reference to the drawings.
本発明は、ドリル加工でコア部材に所定径の孔を穿設し、その孔の穿設方向先端をコア部材に形成したランドに当接させてブラインドビアを形成する際に、コア部材に形成した上記ランド(ブラインドビアの受けランド)を上記コア部材に形成した配線パターンの厚さより厚く形成することで、ドリル加工に要求される深さ方向の寸法精度の許容範囲を拡げることができるとともに、ブラインドビアとその受けランドとの間に十分な接合面積を確保でき、これによって歩留まりの良い状態で信頼性の高いブラインドビアを容易に形成できるようにしている。 In the present invention, a hole having a predetermined diameter is drilled in a core member by drilling, and a blind via is formed in the core member when a tip in the drilling direction is brought into contact with a land formed in the core member. By forming the land (the receiving land of the blind via) thicker than the thickness of the wiring pattern formed on the core member, it is possible to expand the allowable range of dimensional accuracy in the depth direction required for drilling, A sufficient bonding area can be ensured between the blind via and its receiving land, so that a highly reliable blind via can be easily formed in a high yield state.
図1に本発明の第1実施形態による多層プリント配線板1Aのブラインドビア構造を示している。この多層プリント配線板1Aは、絶縁層(プリプレグ)18と、コア部材(銅張積層板)10とを交互に温度および圧力をかけて積層したn層で構成している。このn層構成の多層プリント配線板1Aには、全層を貫通するスルーホール13と、所定の層までしか貫通しないブラインドビア11と、配線パターン14(内層配線パターン14−1,14−2,…)とを有して構成される。
FIG. 1 shows a blind via structure of a multilayer printed
図1に示す多層プリント配線板1Aは、第2層(L2)と第3層(L3)に設けられるコア部材10の第3層(L3)、および第n−1層(Ln−1)と第n−2層(Ln−2)に設けられるコア部材10の第n−2層(Ln−2)に、それぞれ上記ブラインドビア11,11の受けランド12,12を設けて、そのブラインドビア11,11により、第1層(表層)と第3層(L3)、および第n層(表層)と第n−2層(Ln−2)をそれぞれ回路接続した例を示している。
A multilayer printed
ここで上記各ブラインドビア11,11の受けランド(以下ビア受けランドと称す)12,12は、図示するように、それぞれ同層の内層配線パターン厚より肉厚に形成される。例えば第3層(L3)の配線パターン14−3の導体厚をTh1とすると、コア部材10の第3層(L3)には上記導体厚Th1より厚い、導体厚Th2のビア受けランド12が形成される。上記第n−2層(Ln−2)にも上記第3層(L3)と同様の導体厚(Th2)をもつビア受けランド12が形成される。
Here, the receiving lands (hereinafter referred to as via receiving lands) 12 and 12 of the
上記ビア受けランド12,12を設けたコア部材10,10に、ドリル加工で、絶縁層18,18を介して上記ビア受けランド12,12と対向する面方向より、上記ビア受けランド12,12に接する深さまで所定径の孔を穿設し、その孔の内壁に所定のめっきを施すことで、上記各層間(L1,L3間、およびLn,Ln−2間)を回路接続するブラインドビア11,11が形成される。この際のドリル加工工程とめっき工程を図4(a),(b)に例示している。
The
上記したように、ビア受けランド12,12の導体厚を配線パターン14の導体厚より厚くした(TH1<TH2)ことにより、上記ドリル加工に要求される深さ方向の寸法精度の許容範囲を拡げることができることから、常に歩留まりの良い状態で信頼性の高いブラインドビアを有した多層プリント配線板を製造できる。さらにビア受けランド12,12の導体厚を配線パターン14の導体厚より厚くしたことにより、ブラインドビア11,11に於けるビア受けランド12,12の接合面積が増し、電気的抵抗の少ない安定したブラインドビアの回路を構成できるとともに、ビア受けランドの導体厚を意識することなく配線パターンの導体厚を薄くすることができることから多層プリント配線板1Aの薄型化に寄与できる。さらに、この実施形態によるブラインドビア構造はコア部材に穿設した孔にブラインドビアが形成されることから、上述した従来技術のようなブラインドビア内壁のめっき層と絶縁層との熱膨張係数の違いに起因する熱ストレスによるめっき層の亀裂を招く虞のない信頼性の高いブラインドビアを構成できる。
As described above, by making the conductor thickness of the
上記した配線パターンの導体厚Th1より厚い、導体厚Th2のビア受けランド12を形成する際のビア受けランド12,12の加工例を図3に示している。尚、この図3に示す工程は、コア部材10となる銅張積層板30の両面に上記したような肉厚のビア受けランドを形成する例を示している。
FIG. 3 shows a processing example of the
この図3に示すビア受けランドの加工工程は、先ずコア部材10となる銅張積層板30の各面の銅泊31を各々面毎にエッチングして(図3(a)参照)、各面毎に、配線パターン31−1,31−1,…、31−2,31−2,…と、上記ビア受けランド12の基となるランド32−1、32−2とを同時に形成する(図3(b)参照)。その後、スキージ40により、上記ランド32−1、32−2の上にそれぞれ導電ペースト41−1、41−2を印刷し、硬化する(図3(c)から(e)参照)。このの工程により、ブラインドビア11,11を受けるビア受けランド12,12の部分だけ導体厚を厚くすることができる。
The via receiving land processing step shown in FIG. 3 is performed by first etching the
図2に本発明の第2実施形態による多層プリント配線板1Bのブラインドビア構造を示している。この多層プリント配線板1Bは、上述の第1実施形態とは異なり、コア部材20により表層を形成して、絶縁層28とコア部材20との交互の積層によりn層を構成している。このn層構成の多層プリント配線板1Bには、全層を貫通するスルーホール23と、上記表層を形成したコア部材20に設けたブラインドビア21と、配線パターン24(24−1,24−2,…)とを有して構成される。
FIG. 2 shows a blind via structure of the multilayer printed
図2に示す多層プリント配線板1Bは、表層となる第1層(L1)と第2層(L2)に設けられるコア部材20の第2層(L2)、および表層となる第n層(Ln)と第n−1層(Ln−1)に設けられるコア部材20の第n−1層(Ln−1)に、それぞれ上記ブラインドビア21,21の受けランド22,22を設けて、ブラインドビア21,21により、第1層(表層)と第2層(L2)、および第n層(表層)と第n−1層(Ln−1)をそれぞれ回路接続した例を示している。
A multilayer printed
この第2実施形態に於いても上記第1実施形態と同様に、上記各ブラインドビア21,21の受けランド22,22をそれぞれ同層の内層配線パターン厚より肉厚に形成している。これにより、ブラインドビア21,21を形成する際のドリル加工に要求される深さ方向の寸法精度の許容範囲を拡げることができ、常に歩留まりの良い状態で信頼性の高いブラインドビアを有した多層プリント配線板を製造できる。さらにビア受けランド22,22の導体厚を配線パターン24の導体厚より厚くしたことにより、ブラインドビア21,21に於けるビア受けランド22,22の接合面積が増し、電気的抵抗の少ない安定したブラインドビアの回路を構成できるとともに、ビア受けランドの導体厚を意識することなく配線パターンの導体厚を薄くすることができることから多層プリント配線板1Bを薄型化することができる。さらに、この実施形態によるブラインドビア構造はコア部材に穿設した孔によってブラインドビアを形成することから、上述した従来技術のようなブラインドビア内壁のめっき層と絶縁層との熱膨張係数の違いに起因する熱ストレスによるめっき層の亀裂を招く虞のない信頼性の高いブラインドビアを構成できる。
In the second embodiment, as in the first embodiment, the receiving lands 22 and 22 of the blind vias 21 and 21 are formed thicker than the inner wiring pattern thickness of the same layer. As a result, the tolerance range of the dimensional accuracy in the depth direction required for drilling when forming the blind vias 21 and 21 can be expanded, and a multilayer having a highly reliable blind via always in a good yield state. A printed wiring board can be manufactured. Furthermore, by making the conductor thickness of the via receiving lands 22 and 22 thicker than the conductor thickness of the wiring pattern 24, the junction area of the via receiving lands 22 and 22 in the blind vias 21 and 21 is increased, and the electrical resistance is stable and less. The circuit of the blind via can be configured, and the thickness of the wiring pattern conductor can be reduced without being aware of the conductor thickness of the via receiving land, so that the multilayer printed
1A,1B…多層プリント配線板、10,20…コア部材(銅張積層板)、11,21…ブラインドビア、12,22…ビア受けランド、13,23…スルーホール、14−1,14−2,24−1,24−2,24−3…配線パターン、18,28…絶縁層(プリプレグ)、TH1…配線パターンの導体厚、TH2…ビア受けランドの導体厚。 1A, 1B ... multilayer printed wiring board, 10, 20 ... core member (copper-clad laminate), 11, 21 ... blind via, 12, 22 ... via receiving land, 13, 23 ... through hole, 14-1, 14- 2, 24-1, 24-2, 24-3 ... wiring pattern, 18, 28 ... insulating layer (prepreg), TH1 ... conductor thickness of wiring pattern, TH2 ... conductor thickness of via receiving land.
Claims (6)
前記コアに形成された配線パターン、および当該配線パターンより肉厚のランドと、
前記コアに前記ランドと対向する面方向より穿設され、その穿設方向先端が前記ランドに当接して形成されたブラインドビアと
を具備したことを特徴とする多層プリント配線板。 The core,
A wiring pattern formed on the core, and a land thicker than the wiring pattern;
A multilayer printed wiring board, comprising: a blind via formed in the core in a surface direction opposite to the land, the tip of the drilling direction being in contact with the land.
前記ブラインドビアの穿設方向先端部に設けられる前記ブラインドビアを受けるランドの導体厚を同層の前記配線パターンより厚くしたことを特徴とする多層プリント配線板の製造方法。 A land and a wiring pattern for receiving blind vias are formed in the core portion, a hole having a predetermined diameter is drilled from a surface direction of the core portion facing the land forming surface, and an inner wall of the drilled hole and its inner wall In the method of manufacturing a printed wiring board in which the land surface in contact with the hole is plated and a blind via is formed in the core portion without an insulating layer or an insulating layer.
A method of manufacturing a multilayer printed wiring board, wherein a conductor thickness of a land that receives the blind via provided at a front end portion of the blind via is made thicker than the wiring pattern of the same layer.
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2003400905A JP2005166764A (en) | 2003-11-28 | 2003-11-28 | Multilayer printed wiring board and method for producing multilayer printed wiring board |
| TW093124206A TWI293015B (en) | 2003-11-28 | 2004-08-12 | Multilayered printed wiring board and method for manufacturing the multilayered printed wiring board |
| KR1020040068426A KR100654283B1 (en) | 2003-11-28 | 2004-08-30 | Multilayered printed wiring board and method for manufacturing the multilayered printed wiring board |
| CNB2004100683724A CN100428873C (en) | 2003-11-28 | 2004-08-31 | Multilayer printed wiring board and method for manufacturing the multilayer printed wiring board |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2003400905A JP2005166764A (en) | 2003-11-28 | 2003-11-28 | Multilayer printed wiring board and method for producing multilayer printed wiring board |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2005166764A true JP2005166764A (en) | 2005-06-23 |
Family
ID=34724989
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2003400905A Pending JP2005166764A (en) | 2003-11-28 | 2003-11-28 | Multilayer printed wiring board and method for producing multilayer printed wiring board |
Country Status (4)
| Country | Link |
|---|---|
| JP (1) | JP2005166764A (en) |
| KR (1) | KR100654283B1 (en) |
| CN (1) | CN100428873C (en) |
| TW (1) | TWI293015B (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7767914B2 (en) | 2007-11-27 | 2010-08-03 | Kabushiki Kaisha Toshiba | Multilayer printed wiring board, method for manufacturing buildup printed wiring board, and electronic apparatus |
Families Citing this family (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP4527045B2 (en) * | 2005-11-01 | 2010-08-18 | 日本メクトロン株式会社 | Method for manufacturing multilayer wiring board having cable portion |
| KR100745520B1 (en) * | 2006-01-20 | 2007-08-02 | 삼성전기주식회사 | Multilayer printed circuit board and its manufacturing method |
| JP5165265B2 (en) * | 2007-03-23 | 2013-03-21 | 日本メクトロン株式会社 | Manufacturing method of multilayer printed wiring board |
| CN101772279B (en) * | 2009-12-21 | 2013-03-06 | 艾默生网络能源有限公司 | Method for manufacturing PCB plate with blind holes |
| CN105246254B (en) * | 2015-10-14 | 2018-08-03 | 江门崇达电路技术有限公司 | A method of making PTH platforms on PCB |
| CN114205991B (en) * | 2020-09-18 | 2024-05-03 | 重庆方正高密电子有限公司 | PCB board |
Family Cites Families (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP3724468B2 (en) * | 1995-04-28 | 2005-12-07 | 日本ビクター株式会社 | Multilayer printed circuit board |
| JP3234757B2 (en) * | 1995-12-05 | 2001-12-04 | インターナショナル・ビジネス・マシーンズ・コーポレーション | Multilayer wiring board and method of manufacturing the same |
| JP2000031644A (en) * | 1998-07-14 | 2000-01-28 | Hitachi Aic Inc | Circuit board |
| KR100346400B1 (en) * | 1999-12-16 | 2002-08-01 | 엘지전자주식회사 | Multi-layer pcb and the manufacturing method the same |
| JP2003179351A (en) * | 2001-12-11 | 2003-06-27 | Cmk Corp | Build-up multilayer wiring board and method of manufacturing the same |
| JP2003283127A (en) * | 2002-03-22 | 2003-10-03 | Ibiden Co Ltd | Printed wiring board and manufacturing method therefor |
-
2003
- 2003-11-28 JP JP2003400905A patent/JP2005166764A/en active Pending
-
2004
- 2004-08-12 TW TW093124206A patent/TWI293015B/en active
- 2004-08-30 KR KR1020040068426A patent/KR100654283B1/en not_active Expired - Fee Related
- 2004-08-31 CN CNB2004100683724A patent/CN100428873C/en not_active Expired - Fee Related
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7767914B2 (en) | 2007-11-27 | 2010-08-03 | Kabushiki Kaisha Toshiba | Multilayer printed wiring board, method for manufacturing buildup printed wiring board, and electronic apparatus |
Also Published As
| Publication number | Publication date |
|---|---|
| KR20050052327A (en) | 2005-06-02 |
| TW200520659A (en) | 2005-06-16 |
| CN100428873C (en) | 2008-10-22 |
| CN1622740A (en) | 2005-06-01 |
| TWI293015B (en) | 2008-01-21 |
| KR100654283B1 (en) | 2006-12-08 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20060331 |
|
| A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20080402 |
|
| A131 | Notification of reasons for refusal |
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|
| A521 | Written amendment |
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|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20081111 |