JP2002076571A - 回路基板の製造方法 - Google Patents
回路基板の製造方法Info
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Abstract
の導体パターンを得ることができ、しかも回路導体の配
置密度を向上させることができる回路導体の製造方法を
提供する。 【解決手段】 回路基板の製造方法は、銅板1の一面
に、所定の回路パターンが形成されたマスクを載置し、
銅板の一面に回路パターンを形成するエッチングを行う
工程と(図1(b))、前記エッチング工程の後、銅板
1の回路パターン形成面側1bに基体2を形成し、前記
銅板1を基体2に固定、一体化する工程と(図1
(c))、前記基体1に固定された銅板1の回路パター
ン非形成面側1cをエッチングし、回路パターンを構成
する回路導体1eを分離し、所定の回路パターンを形成
する工程と(図1(d))を含む。
Description
厚肉の金属板を使用した大電流回路基板等の回路基板の
製造に好適な回路基板の製造方法に関する。
厚肉の導体が要求される場合には、例えば、特開平8−
181417に提案されているように、銅板から打ち抜
き加工により打ち抜かれた回路導体と絶縁基板とを積層
一体化させた回路基板がある。この特開平8−1814
17に提案されている技術を図5乃至図8に基づいて説
明する。図5に示すように、所定の回路パターンを形成
する回路導体101は、銅板100からの打ち抜き加工
により形成される。そして、前記回路導体101の位置
関係を一定にするため、各回路導体101が縁枠導体1
02あるいは隣合う回路導体101と細いブリッジ10
3により固定されている。
縁基板とを一体化させて回路基板とするため、熱硬化性
の成形樹脂中に回路導体101を埋め込み一体化する。
すなわち、図6に示すように、移動型110の内面に銅
板100をセットして型を閉じ、成形樹脂を固定型11
1に形成された樹脂注入孔111aより充填する。その
結果、成形樹脂は固定型111の溝111bを通って回
路導体101を乗り越え、キャビティ112(固定型1
11と移動型110の間に形成される空隙)全域に充填
される。即ち、回路導体101以外の空隙部112aに
も充填される。
体化させて回路基板120において、図7に示すよう
に、ブリッジ103の位置にドリルで貫通穴104を設
け、ブリッジ103を切断し、各回路導体101を電気
的に独立させる。そして、前記ブリッジ103を切断し
た後、脱脂や粗化の表面処理を施した後、図8に示す成
形金型を用いて両面回路基板が製作される。即ち、成形
金型の固定型114と移動型113の内面114a、1
13a間に、2枚の回路基板120を回路導体101が
対向するようにピン113b、114bで保持する。そ
うして、固定型113に設けられた樹脂注入孔114c
より成形樹脂を固定型114と移動型113の間に注
入、充填する。成形樹脂が冷却または硬化後に、回路基
板120を取り出し、不要となる縁枠導体102部分を
切除し、樹脂成形体の両面に回路導体101が埋め込ま
れた両面回路基板を得る。
うに従来の回路基板の製造方法においては、樹脂成形の
手段を用いて、回路となる回路導体を埋め込み一体化す
る方法を用いている。そのため、回路導体をブリッジに
よって固定しているものの、成形型への樹脂注入時の注
入圧力によって前記ブリッジが変形し、回路導体が位置
ずれを起こし、所定の導体パターンを得ることができな
いという技術的課題があった。
は、回路導体と絶縁基板とを一体化させてた後、ブリッ
ジを切断し、各回路導体を電気的に独立させている。そ
のため、図7に示すように回路導体101にはブリッジ
103の残存部103aが残る。この残存部103a間
の距離は、少なくともショートしない距離にしなけばな
らない。この残存部103aの間の距離は、回路導体1
03間の距離よりも短いため、必要以上に回路導体10
3間の距離をおかなければならず、その結果、回路導体
103の配置密度が低下するという技術的課題があっ
た。
になされたものであり、回路導体が位置ずれを起こすこ
となく、所定の導体パターンを得ることができ、しかも
回路導体の配置密度を向上させることができる回路導体
の製造方法を提供することを目的とするものである。
するためになされたものであり、本発明にかかる回路基
板の製造方法は、銅板の一面に、所定の回路パターンが
形成されたマスクを載置し、銅板の一面に回路パターン
を形成するエッチングを行う工程と、前記エッチング工
程の後、銅板の回路パターン形成面側に基体を形成し、
前記銅板を基体に固定、一体化する工程と、前記基体に
固定された銅板の回路パターン非形成面側をエッチング
し、回路パターンを構成する回路導体を分離し、所定の
回路パターンを形成する工程と、を含むことを特徴とし
ている。
形成するエッチングを行い、前記エッチング工程の後、
銅板の回路パターン形成面側に基体を形成し、前記銅板
を基体に固定、一体化し、エッチングにより回路パター
ンを構成する回路導体を分離している。したがって、基
体を形成する際、回路導体は分離されておらず銅板を構
成しているため、回路導体の位置ずれを防止することが
できる。また、従来のようなブリッジが設けられていな
いため、回路導体の配置密度を向上させることができ
る。
に基体を形成し、前記銅板を基体に固定、一体化する工
程において、回路パターン形成面に対向してプリプレグ
を配置し、ホットプレスにより加熱加圧して前記プリプ
レグにより基体を構成すると共に、前記銅板を基体に固
定、一体化することが望ましい。このように、プリプレ
グを用いることにより、容易に銅板を基体に固定、一体
化させることができる。
基体を形成し、前記銅板を基体に固定、一体化する工程
において、前記銅板を金型内に収容し、成形樹脂により
基体を構成すると共に、前記銅板を基体に固定、一体化
しても良い。
なされたものであり、本発明にかかる回路基板の製造方
法は、銅板の一面に、所定の回路パターンが形成された
マスクを載置し、銅板の一面に回路パターンを形成する
エッチングを行う工程と、回路パターン形成面に対向し
てプリプレグを配置すると共に、回路パターン形成面と
対向する面と反対のプリプレグの面に銅箔を配置し、ホ
ットプレスにより加熱加圧して、前記プリプレグにより
基体を構成すると共に、前記銅板、銅箔をを基体に固
定、一体化する工程と、前記基体に固定された銅板の回
路パターン非形成面側をエッチングし、回路パターンを
構成する回路導体を分離し、所定の回路パターンを形成
する工程と、前記銅箔エッチングし、所定の回路パター
ンを形成する工程と、を含むことを特徴としている。こ
れにより、少なくとも銅板から構成された回路パターン
と、銅箔から構成された回路パターンを備えた回路基板
を得ることができる。
なされたものであり、本発明にかかる回路基板の製造方
法は、銅板の一面に、所定の回路パターンが形成された
マスクを載置し、銅板の一面に回路パターンを形成する
エッチングを行う工程と、回路パターン形成面に対向し
てプリプレグを配置すると共に、回路パターン形成面と
対向する面と反対のプリプレグの面に銅箔を配置し、ホ
ットプレスにより加熱加圧して、前記プリプレグにより
基体を構成すると共に、前記銅板、銅箔をを基体に固
定、一体化する工程と、前記基体に固定された銅板の回
路パターン非形成面側をエッチングし、回路パターンを
構成する回路導体を分離し、所定の回路パターンを形成
する工程と、前記回路導体上にプリプレグを配置し、更
に銅箔を配置し、ホットプレスにより加熱加圧して、前
記回路導体、銅箔を基体に固定、一体化する工程と、前
記基体に穿孔すると共に、表面に銅層を形成するメッキ
工程と、前記銅層の一部をエッチングし、銅層によって
所定の回路パターンを形成する工程とを含むこと特徴と
している。これにより、少なくとも銅板から構成された
回路パターンと、銅箔から構成された回路パターンを備
え、両回路パターンを電気的に接続するスルーホールと
を備えた回路基板を得ることができる。
なされたものであり、本発明にかかる回路基板の製造方
法は、2つの銅板の一面に、所定の回路パターンが形成
されたマスクを載置し、夫々の銅板の一面に回路パター
ンを形成するエッチングを行う工程と、前記エッチング
の後、2つの銅板の回路パターン形成面によって、プリ
プレグを挟むように配置し、ホットプレスにより加熱加
圧してプリプレグにより基体を構成すると共に、前記2
つの銅板を前記基体に固定、一体化する工程と、前記基
体に固定された銅板の回路パターン非形成面側をエッチ
ングし、回路パターンを構成する回路導体を分離し、所
定の回路パターンを形成する工程と、を含むこと特徴と
している。これにより、少なくとも銅板から構成された
2つの回路パターンを備えた回路基板を得ることができ
る。
なされたものであり、本発明にかかる回路基板の製造方
法は、2つの銅板の一面に、所定の回路パターンが形成
されたマスクを載置し、夫々の銅板の一面に回路パター
ンを形成するエッチングを行う工程と、前記エッチング
の後、2つの銅板の回路パターン形成面によって、プリ
プレグを挟むように配置し、ホットプレスにより加熱加
圧してプリプレグにより基体を構成すると共に、前記2
つの銅板を前記基体に固定、一体化する工程と、前記基
体に穿孔すると共に、表面に銅層を形成するメッキ工程
と、前記銅層及び銅板の一部をエッチングし、回路パタ
ーンを構成する回路導体を分離し、所定の回路パターン
を形成する工程と、を含むこと特徴としている。これに
より、銅板から構成された2つの回路パターンと、この
2つの回路パターンを電気的に接続するスルーホールと
を備えた回路基板を得ることができる。
なされたものであり、本発明にかかる回路基板の製造方
法は、2つの銅板の一面に、所定の回路パターンが形成
されたマスクを載置し、夫々の銅板の一面に回路パター
ンを形成するエッチングを行う工程と、前記エッチング
の後、2つの銅板の回路パターン形成面に対向してプリ
プレグを配置し、ホットプレスにより加熱加圧して前記
プリプレグにより基体を構成すると共に、前記2つの銅
板を基体に固定、一体化する工程と、前記基体に固定さ
れた2つの銅板の回路パターン非形成面側をエッチング
し、回路パターンを構成する回路導体を分離し、所定の
回路パターンを形成する工程と、前記基体の上下面に形
成された所定の回路パターン上に、更にプリプレグを配
置すると共に銅箔を配置し、ホットプレスにより加熱加
圧して前記銅箔を前記基体に固定、一体化する工程と、
前記基体に穿孔すると共に、表面に銅層を形成するメッ
キ工程と、前記銅層の一部をエッチングし、銅層によっ
て所定の回路パターンを形成する工程とを含むこと特徴
としている。
路パターンと、銅箔から構成されたは2つの回路パター
ンと、前記回路パターンを電気的に接続するスルーホー
ルとを備えた回路基板を得ることができる。
実施形態を図1に基づいて説明する。図1(a)に示す
ように、まず、銅板1の所定の位置に基準穴1aをドリ
ル等の穿孔手段を用いて形成する。銅板1としては、1
50μm〜500μmのものが用いられる。150μm
以下の銅板1では、電流回路導体や電源回路導体として
好ましくなく、500μmを越える板厚の銅板1では、
後に述べるエッチングに長い時間がかかるため、好まし
くないためである。なお、以下の説明において、銅板1
の一方の面をA面、他方の面をB面という。
1のB面1bをエッチングする。このとき銅板1の基準
穴1aを所定のピンに挿入しこれを基準として、所定の
回路パターンが形成されたマスクをB面1bの上に載置
し、エッチングを行う。このときのエッチング量は銅板
1の板厚の半分程度が好ましい。図中、符号1dの部分
が、エッチングされた部分を示している。これにより、
銅板1のB面1bには、所定の回路パターン(回路導体
1e)が形成される(銅板1のA面1cにおいて回路導
体1eは接続されている)。
り、銅板1に基体2を製作する。即ち、図1(c)に示
すように、エッチングされた銅板1のB面1bを、プリ
プレグなどの接着層に対向するように配置する。次い
で、ホットプレス(図示せず)により加熱加圧して全体
を一体する。これにより、所定の回路パターン(回路導
体)が形成された銅板1は、プリプレグなどの接着層か
らなる基体2に固定、一体化される。その後、図1
(d)に示すように、銅板1のA面1cをエッチング
し、回路導体1eを分離し、所定の回路パターンを形成
する。
形成するエッチングを行い、前記エッチング工程の後、
銅板の回路パターン形成面側に基体を形成し、前記銅板
を基体に固定、一体化し、エッチングにより回路パター
ンを構成する回路導体を分離している。したがって、基
体を形成する際、回路導体は分離されておらず銅板を構
成しているため、回路導体の位置ずれを防止することが
できる。また、従来のようなブリッジが設けられていな
いため、回路導体の配置密度を向上させることができ
る。更に、回路導体の一部が基体に埋設されるため、基
体表面に回路導体が単に接着される場合に比べて、強固
に基体に固定することができる。
を図2に基づいて説明する。図2(a)に示すように、
まず、銅板1の所定の位置に基準穴1aをドリル等の穿
孔手段を用いて形成する。銅板1としては、前記した第
1の実施形態と同様に、150μm〜500μmのもの
が用いられる。そして、図2(b)に示すように、前記
銅板1のB面1bをエッチングする。このとき銅板1の
基準穴1aを所定のピンに挿入しこれを基準として、所
定の回路パターンが形成されたマスク(図示せず)をB
面1bの上に載置し、エッチングを行う。このときのエ
ッチング量は銅板1の板厚の半分程度が好ましい。これ
により、銅板1のB面1bには、所定の回路パターンが
形成される(銅板1のA面1cにおいて回路導体1eは
接続されている)。
体2を製作すると共に、基体2の銅板側の面と反対面に
銅箔3を形成する。即ち、図2(c)に示すように、エ
ッチングされた銅板1のB面1bを、プリプレグなどの
接着層に対向するように配置する。また、プリプレグな
どの接着層の銅板側の面と反対面に銅箔3を配置する。
次いで、ホットプレス(図示せず)により加熱加圧して
全体を一体化する。これにより、所定の回路パターンが
形成された銅板1は、プリプレグなどの接着層からなる
基体2に固定、一体化される。また、基体2の反対面に
は銅箔3が固定、一体化される。その後、図2(d)に
示すように、銅板1のA面1cをエッチングし、回路導
体1eを分離し、所定の回路パターンを形成する。
どの接着層を配置し、前記接着層の上に銅箔4を配置す
る。そして、ホットプレス(図示せず)により加熱加圧
して全体を一体化する。これにより、内部に所定の回路
パターンを構成する回路導体1eが形成されると共に、
基体2の上下面に銅箔3、4が設けられた回路基板が形
成される。
銅箔3、4に所定の回路パターンを形成する。この回路
パターンの形成は、従来から知られている方法を採用す
ることができる。まず、図2(f)に示すように、基体
2の所定の位置にドリル等の手段を用いて穿孔し、貫通
孔2aを形成する。その後、図2(g)に示すように、
基体2の両面及び貫通孔2a内面に銅メッキを施す(銅
メッキ層5を形成する)。更に、図2(h)に示すよう
に、所定の回路パターンが形成されたマスクを基体の両
面上に載置し、エッチングを行い、前記基体2の両面上
に所定の回路パターンを形成する。
するスルーホール6を備えた回路基板が形成される。な
お、スルーホール6によって内部に形成された回路パタ
ーンと基体2の表面上形成された回路パターンとを電気
的に接続してもよい。なお、この回路基板の内部に設け
られた回路導体は、その厚さが厚いため電源回路、大電
流回路等に適し、回路基板の上下面に設けられた回路導
体は、その厚さが薄いため、信号用回路等に適してい
る。
を図3に基づいて説明する。図3(a)に示すように、
まず、銅板10、銅板11を用意し、それぞれの銅板1
0、銅板11の所定の位置に基準穴10a、11aをド
リル等の穿孔手段を用いて形成する。銅板10、11と
しては、前記した第1の実施形態と同様に、150μm
〜500μmのものが用いられる。
10のB面10bをエッチングする。このとき銅板10
の基準穴10aを所定のピンに挿入しこれを基準とし
て、所定の回路パターンが形成されたマスク(図示せ
ず)をB面10bの上に載置し、エッチングを行う。こ
のときのエッチング量は銅板10の板厚の半分程度が好
ましい。同様に、前記銅板11のA面11cをエッチン
グする。このとき銅板11の基準穴11aを所定のピン
に挿入しこれを基準として、所定の回路パターンが形成
されたマスク(図示せず)をA面11cの上に載置し、
エッチングを行う。このときのエッチング量は銅板11
の板厚の半分程度が好ましい。これにより、銅板10の
B面10b及び銅板11のA面11cには、所定の回路
パターンが形成される(銅板10のA面10c側におい
て回路導体は接続され、銅板11のB面11b側におい
て回路導体は接続されている)。
リプレグなどの接着層2を挟んで対向させる。すなわ
ち、銅板10のB面10bと銅板11のA面11cとが
対向させる。その後、図3(c)に示すように、ホット
プレス(図示せず)により加熱加圧して全体を一体化す
る。
2の所定の位置を穿孔し、貫通孔12aを形成する。そ
の後、図3(e)に示すように、基体12の両面及び貫
通孔12aに銅メッキを施す(銅層15を形成する)。
更に、図2(f)に示すように、所定の回路パターンが
形成されたマスクを基体12の両面上に載置し、エッチ
ングを行い、前記基体2の両面上に所定の回路パターン
を形成する。これにより、基体の両面に形成された回路
パターンを電気的に接続するスルーホール16を備えた
回路基板が形成される。また、回路導体の一部が基体に
埋設されるため、基体表面に回路導体が単に接着される
場合に比べて、強固に基体に固定することができる。な
お、この回路基板の上下面に設けられた回路導体は、そ
の厚さが厚いため電源回路、大電流回路等に適してい
る。
を図4に基づいて説明する。図4(a)に示すように、
まず、銅板10、銅板11を用意し、それぞれの銅板1
0、銅板11の所定の位置に基準穴10a、11aをド
リル等の穿孔手段を用いて形成する。銅板10、11と
しては、前記した第1の実施形態と同様に、150μm
〜500μmのものが用いられる。
10のB面10bをエッチングする。このとき銅板10
の基準穴10aを所定のピンに挿入しこれを基準とし
て、所定の回路パターンが形成されたマスク(図示せ
ず)をB面10bの上に載置し、エッチングを行う。こ
のときのエッチング量は銅板10の板厚の半分程度が好
ましい。同様に、前記銅板11のA面11cをエッチン
グする。このとき銅板11の基準穴11aを所定のピン
に挿入しこれを基準として、所定の回路パターンが形成
されたマスク(図示せず)をA面11cの上に載置し、
エッチングを行う。このときのエッチング量は銅板11
の板厚の半分程度が好ましい。
板11のA面11cには、所定の回路パターンが形成さ
れる(銅板10のA面10c側において回路導体は接続
され、銅板11のB面11b側において回路導体は接続
されている)。
リプレグなどの接着層2を挟んで対向させる。すなわ
ち、銅板10のB面10bと銅板11のA面11cとが
対向させる。その後、図4(c)に示すように、ホット
プレス(図示せず)により加熱加圧して全体を一体化す
る。その後、図4(d)に示すように、銅板10のA面
10c、銅板11のB面11bをエッチングし、回路導
体10e、11eを分離し、所定の回路パターンを形成
する。
11のB面11b側にプリプレグなどの接着層を配置す
ると共に、更に銅箔13、14を配置する。そして、ホ
ットプレス(図示せず)により加熱加圧して全体を一体
する。これにより、内部に所定の回路パターンを構成す
る回路導体10e、11eが形成されると共に、基体の
上下面に銅箔13、14が設けられた回路基板が形成さ
れる。
13、14に所定の回路パターンを形成する。この回路
パターンの形成は、従来から知られている方法を採用す
ることができる。まず、図4(f)に示すように、基体
12の所定の位置を穿孔し、貫通孔12aを形成する。
その後、図4(g)に示すように、基体の両面及び貫通
孔に銅メッキを施す(銅メッキ層15を形成する)。更
に、図4(h)に示すように、所定の回路パターンが形
成されたマスクを基体12の両面上に載置し、エッチン
グを行い、前記基体12の両面上に所定の回路パターン
を形成する。
続するスルーホール16を備えた回路基板が形成され
る。この回路基板の内部に設けられた2層の回路導体1
0e、11eは、その厚さが厚いため電源回路、大電流
回路等に適し、回路基板の上下面に設けられた回路導体
は、その厚さが薄いため、信号用回路等に適している。
グされた銅板に基体を形成するために、あるいはエッチ
ングされた銅板同士を一体化するために、プリプレグな
どの接着層を配置し、ホットプレス(図示せず)により
加熱加圧して全体を一体化している。しかしながら、本
発明にかかる製造方法にあっては、特にプリプレグなど
の接着層を用いる場合に限定されるものではなく、エッ
チングされた銅板を金型内に収容し、エッチングされた
銅板と成形樹脂とを一体化しても良く、またハーフエッ
チングされた2つの銅板を金型内に収容し、成形樹脂と
を一体化しても良い。このとき、回路導体は、いわゆる
ハーフエッチング(板厚の半分程度のエッチング)で形
成されているため(従来のようにブリッジで連結されい
ないため)、金型内を流れる成形樹脂によって回路導体
が位置ずれを起こすこともなく、所定の回路パターンを
得ることができる。
黒化処理のほかに、脱脂や粗化、カップリング剤処理、
接着剤の塗布など、成形樹脂との接着性を向上させる手
段を施してもよい。更に、成形樹脂としては、ポリエチ
レンテレフタレート、ポリフェニレンサルファイド、ポ
リエーテルイミドなどの熱可塑性樹脂もしくはエポキ
シ、不飽和ポリエステル、ジアリルテレフタレートなど
の熱硬化性樹脂で、半田付けする温度での耐熱性がよい
樹脂が好ましい。
チング量として銅板の板厚さの半分程度が望ましいと説
明したが、特にこれに限定されるものではなく、必要に
応じて銅板のエッチング量を調整することができる。
の上下面に銅箔を形成することにより回路パターンを形
成したが、この回路パターンを設けることなく、プリプ
レグあるいは成形樹脂を介して銅板による回路パターン
を形成し、回路基板のより多層化を図っても良い。
導体の製造方法よれば、回路導体が位置ずれを起こすこ
となく、所定の回路パターンを得ることができ、回路導
体の配置密度を向上させることができる。
第1の実施形態を説明するための図である。
第2の実施形態を説明するための図である。
第3の実施形態を説明するための図である。
第4の実施形態を説明するための図である。
する図である。
示す工程を説明する図である。
作する工程を説明する図である。
Claims (8)
- 【請求項1】 銅板の一面に、所定の回路パターンが形
成されたマスクを載置し、銅板の一面に回路パターンを
形成するエッチングを行う工程と、 前記エッチング工程の後、銅板の回路パターン形成面側
に基体を形成し、前記銅板を基体に固定、一体化する工
程と、 前記基体に固定された銅板の回路パターン非形成面側を
エッチングし、回路パターンを構成する回路導体を分離
し、所定の回路パターンを形成する工程と、を含むこと
を特徴とする回路基板の製造方法。 - 【請求項2】 前記銅板の回路パターン形成面側に基体
を形成し、前記銅板を基体に固定、一体化する工程にお
いて、 回路パターン形成面に対向してプリプレグを配置し、ホ
ットプレスにより加熱加圧して前記プリプレグにより基
体を構成すると共に、前記銅板を基体に固定、一体化す
ることを特徴とする請求項1に記載された回路基板の製
造方法。 - 【請求項3】 前記銅板の回路パターン形成面側に基体
を形成し、前記銅板を基体に固定、一体化する工程にお
いて、 前記銅板を金型内に収容し、成形樹脂により基体を構成
すると共に、前記銅板を基体に固定、一体化することを
特徴とする請求項1に記載された回路基板の製造方法。 - 【請求項4】 銅板の一面に、所定の回路パターンが形
成されたマスクを載置し、銅板の一面に回路パターンを
形成するエッチングを行う工程と、 回路パターン形成面に対向してプリプレグを配置すると
共に、回路パターン形成面と対向する面と反対のプリプ
レグの面に銅箔を配置し、ホットプレスにより加熱加圧
して、前記プリプレグにより基体を構成すると共に、前
記銅板、銅箔をを基体に固定、一体化する工程と、 前記基体に固定された銅板の回路パターン非形成面側を
エッチングし、回路パターンを構成する回路導体を分離
し、所定の回路パターンを形成する工程と、 前記銅箔エッチングし、所定の回路パターンを形成する
工程と、を含むことを特徴とする回路基板の製造方法。 - 【請求項5】 銅板の一面に、所定の回路パターンが形
成されたマスクを載置し、銅板の一面に回路パターンを
形成するエッチングを行う工程と、 回路パターン形成面に対向してプリプレグを配置すると
共に、回路パターン形成面と対向する面と反対のプリプ
レグの面に銅箔を配置し、ホットプレスにより加熱加圧
して、前記プリプレグにより基体を構成すると共に、前
記銅板、銅箔をを基体に固定、一体化する工程と、 前記基体に固定された銅板の回路パターン非形成面側を
エッチングし、回路パターンを構成する回路導体を分離
し、所定の回路パターンを形成する工程と、 前記回路導体上にプリプレグを配置し、更に銅箔を配置
し、ホットプレスにより加熱加圧して、前記回路導体、
銅箔を基体に固定、一体化する工程と、 前記基体に穿孔すると共に、表面に銅層を形成するメッ
キ工程と、 前記銅層の一部をエッチングし、銅層によって所定の回
路パターンを形成する工程とを含むこと特徴とする回路
基板の製造方法。 - 【請求項6】 2つの銅板の一面に、所定の回路パター
ンが形成されたマスクを載置し、夫々の銅板の一面に回
路パターンを形成するエッチングを行う工程と、 前記エッチングの後、2つの銅板の回路パターン形成面
によって、プリプレグを挟むように配置し、ホットプレ
スにより加熱加圧してプリプレグにより基体を構成する
と共に、前記2つの銅板を前記基体に固定、一体化する
工程と、 前記基体に固定された銅板の回路パターン非形成面側を
エッチングし、回路パターンを構成する回路導体を分離
し、所定の回路パターンを形成する工程と、を含むこと
特徴とする回路基板の製造方法。 - 【請求項7】 2つの銅板の一面に、所定の回路パター
ンが形成されたマスクを載置し、夫々の銅板の一面に回
路パターンを形成するエッチングを行う工程と、 前記エッチングの後、2つの銅板の回路パターン形成面
によって、プリプレグを挟むように配置し、ホットプレ
スにより加熱加圧してプリプレグにより基体を構成する
と共に、前記2つの銅板を前記基体に固定、一体化する
工程と、 前記基体に穿孔すると共に、表面に銅層を形成するメッ
キ工程と、 前記銅層及び銅板の一部をエッチングし、回路パターン
を構成する回路導体を分離し、所定の回路パターンを形
成する工程と、を含むこと特徴とする回路基板の製造方
法。 - 【請求項8】 2つの銅板の一面に、所定の回路パター
ンが形成されたマスクを載置し、夫々の銅板の一面に回
路パターンを形成するエッチングを行う工程と、 前記エッチングの後、2つの銅板の回路パターン形成面
に対向してプリプレグを配置し、ホットプレスにより加
熱加圧して前記プリプレグにより基体を構成すると共
に、前記2つの銅板を基体に固定、一体化する工程と、 前記基体に固定された2つの銅板の回路パターン非形成
面側をエッチングし、回路パターンを構成する回路導体
を分離し、所定の回路パターンを形成する工程と、 前記基体の上下面に形成された所定の回路パターン上
に、更にプリプレグを配置すると共に銅箔を配置し、ホ
ットプレスにより加熱加圧して前記銅箔を前記基体に固
定、一体化する工程と、 前記基体に穿孔すると共に、表面に銅層を形成するメッ
キ工程と、 前記銅層の一部をエッチングし、銅層によって所定の回
路パターンを形成する工程とを含むこと特徴とする回路
基板の製造方法。
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| JP2007250698A (ja) * | 2006-03-14 | 2007-09-27 | Furukawa Electric Co Ltd:The | メタルコアプリント配線板の製造方法 |
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| JP2007053146A (ja) * | 2005-08-16 | 2007-03-01 | Nec Engineering Ltd | 封止型プリント基板及びその製造方法 |
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