DE1762770C - Arrangement for monitoring control devices for processing binary characters, especially in telephone exchanges - Google Patents
Arrangement for monitoring control devices for processing binary characters, especially in telephone exchangesInfo
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Uiebspausc /ur l.rliillunu einet VciknüptimnsbcJm- Man tL^^n Ϊ-: c- .iivr .mch mt <nÜL"h. die I Ί-,ι- «Ming heitiagcndc Signale fuhren. Hit. Lrtindiing K-- ν· aclr.inus.m. >u!iiung genial'· der 1 .rliinlunt; (Ι.ιΙμιι triili se.mn cmc I bcrwachumzsanordnimi: /lit I-.··; ge'icrul au^/u^c-laiicn oil', die I'; ulsiiMialc die Verstellung fehlerhafter Siiinal/iisiände in Bmarsiuiak- L.riiipHmnsbcdiniv.ni'j: iiachcinand-■ mil Wirkung ie· \cra; Kiicnden. insbesondere in ren'.'-pr.-iincrmiu- i ■..cu- liir cine iL* ein, einer. f iniiani^leiumecn des lungs.inlagcn enthaltenen StcuereinHchum-JX-n. Ki K-ireiier.dcn SicuceinricIViUn-j-icik in die ODI R-deiieii mil /u diesen Sicuercmnchlungcn iiihrcndcn HediniHirg andern, mdci.i Si^nallciumgcn. aul denen während Betriebspau^cn li::m ilei eiiicnilichcn W jeweils nonnalcrucis..· stilehe Siim.ilc auiirelen. die wagende Signal·./ an die ic^ /ι: einer durch ein am Ausgang lvw. auf einer /ν. i- υ iihiigcn ( ingangsicilimLicn se'ienergebnisleiluni; der helreiTenden Steuereinrieh e!:e^ \-T-eelien hri π lii 'jeuei tuii'J auiuelendes Sisinal aiiüc/oiütcii [-.ri'üllun^ eine!" nen Ansiieslalluni: del \ cikniipluiiüsKdiniiLiP.g dieser Sleiiereinriehtiir.u Lilien üinljeien /.c;iKd-ni nichts beitragen, suw ie uejebenen'ail- mil »'.»lehcn V'nrieil. von xorniierein. , 7« ischener"ebnisleituni;en. auf denen während l'-e- 15 seilen ilen ein/e!:ii.r, l-inuai lrii.bspau^eii norniaierweise jeweils cbenl'al's /u e^p.c. keilen und daivei ^v.gel\ F:rliilliiuu einer V'erknüpfunushediimuni; niehis bei- hccin eine eii;spieehei',.!e tra".eiule Signale auftreten, die Hingange einer ODfR- K'i/uführcn.Uiebspausc / ur l.rliillunu einet VciknüptimnsbcJm- Man tL ^^ n Ϊ-: c- .iivr .mch mt <nÜL "h. The I Ί-, ι-« Ming lead heitiagcndc signals. Hit. Lrtindiing K-- ν · aclr.inus.m.> u! iiung genial '· der 1 .rliinlunt; (Ι.ιΙμιι triili se.mn cmc I bcrwachumzsanordnimi: / lit I-. ··; ge'icrul au ^ / u ^ c-laiicn oil ', the I'; ulsiiMialc the adjustment of faulty Siiinal / iisiände in Bmarsiuiak- L.riiipHmnsbcdiniv.ni'j: iiachcinand- ■ mil effect ie · \ cra; Kiicnden. especially in ren '.'- pr.-iincrmiu- i ■ ..cu- liir cine iL * a, one. f iniiani ^ leiumecn des lungs.inlagcn contained StcuereinHchum-JX-n. Ki K-ireiier.dcn SicuceinricIViUn-j-icik in the ODI R-deiieii mil / u these security lungs. iiihrcndcn HediniHirg andern, mdci.i Si ^ nallciumgcn. To those during break in operations ^ cn li :: m ilei eiiicnilichcn W each nonnalcrucis .. · stilehe Siim.ilc auiirelen. The daring signal ·. / To the ic ^ / ι: one through a at the exit lvw. on a / ν. i- υ iihiigcn (ingangsicilimLicn se'ienresultleiluni; der helr EiTenden Steuereinrieh e!: e ^ \ -T-eelien hri π lii 'jeuei tuii'J auiuelendes Sisinal aiiüc / oiütcii [-.ri'üllun ^ ein! "nen Ansiieslalluni: del \ cikniipluiiüsKdiniiLiP.g üinljeuien.lihtiirhtiir .c; iKd-ni contribute nothing, suw ie uejebenen'ail-mil »'.» lehcn V'nrieil. from xorniierein. , 7 "ischener"ebnisleituni; en. On which during l'-e- 15 ropes ilen a / e!: Ii.r, l-inuai lrii.bspau ^ eii norniaierweise each cbenl'al's / ue ^ pc wedges and daivei ^ v.gel \ F: rliilliiuu a V'erknüpfunushediimuni; niehis examples hccin a eii; spieehei ',. e tra ".eiule signals occur, Hing In a ODfR- K'i / uführcn!.
Schailung für die /ur !:rfüilunu der jeweiligen Ver- Werden tlahe: in wci'c:.i Aus^esialtung der I.: knüpfungsbedingung beitragenden, auf den betreffen- 20 finJung im Anschluß an den Prüf\<irgang PrüKignale den Leitungen auftretenden Signale verbunden sjpd, als /ur Frfülluiig der ek itlichen Verkniipfungshe dii: mit Abgabe eines die Erfüllung der ODFR-Be- dingung beitragende Signale auch an alle in Frage dingung anzeigenden Ausgangssignals während einer kommenden Fingangsleitungen des betrellenden Betriebspause das Vorliegen eines fehlerhaften Si- Steuereinrichtungsteils gleichzeitig gc'iefert und dagnalzustandes anzeigt, nach Patent 1275 125; ge- 25 bei mit der Abgabe von die Nichterfüllung der eigentmäß der Erfindung ibt diese Uberwachungsanord- üchcn Verknüpfungsbedingung anzeigenden Ausnung dadurch gekennzeichnet, daß die ODER-Schal- gangssignalen an die Prüfeinrichtung fehlerhafte Situng durch Teile der zugehörigen Steuereinrieh- gnal/ustande angezeigt, so ergibt sich zugleich der tung mit nicht durch die ODER-Bedingung gege- Vorteil, auch Fehler feststellen zu können, denen zubener Verknüpfungsbedingung gebildet ist, indem 3° folge eine Erfüllung der jeweiligen Verknüpfungshederen Verknüpfungsbedingung von Zeit zu Zeit dingung des betreffenden Steuereinrichtungsteils durch wiederholt jeweils im Verlaufe von Betriebspausen die auf dessen Fingangsleitungen auftretenden Sinach Maßgabe von von einer Prüfeinrichtung ab- gnale nicht durch ein entsprechendes Ausgangssignal gegebenen Prüfsignalen in die ODER-Bedingung angezeigt wird: eine — wie in der Hauptpatentschrift geändert und dabei mit der Abgabe eines die Frfül- 35 angegeben 'ur Erzielung einer derart erhöhten lung der ODER-Bedingung anzeigenden Ausgangs- Betriebssicherheit vorzunehmende Verdoppelung des signals an die Prüfeinrichtung das Vorliegen eines betreffenden Steuereinrichtungsteils kann dabei entfehlerhaften Signalzustandes angezeigt wird. fallen.Schailung for the / ur!: Rfüilunu of the respective Verification: in wci'c: .i Aus ^ esialtung the I .: Linking condition contributing to the relevant finding after the test \ <irgang test signals The signals appearing on the lines are connected to each other, as an early stage in the connection dii: if a signal contributing to the fulfillment of the ODFR condition is given to everyone in question condition indicating output signal during an incoming input line of the person concerned Break in operation, the presence of a faulty Si control device part is simultaneously delivered and diagnostic status indicates, according to patent 1275,125; with the delivery of the non-fulfillment of the inherent According to the invention, this monitoring arrangement shows the linkage condition characterized in that the OR switching signals to the test device are faulty indicated by parts of the associated control signal / statuses, this also results in the The advantage of being able to detect errors is not the advantage of the OR condition Linkage condition is formed by 3 ° follow a fulfillment of the respective linkage hereditary Linking condition from time to time condition of the relevant control device part repeats the Sinach occurring on its input lines in the course of breaks in operation Provision of signals from a test device not through a corresponding output signal given test signals is displayed in the OR condition: one - as in the main patent specification changed and thereby indicated with the submission of a pre-35 'ur achievement of such an increased The output operational reliability to be displayed by the OR condition is doubled signals to the test device the presence of a relevant part of the control device can be defective Signal status is displayed. fall.
Die Erfindung bringt den Vorteil mit sich, als An Hand der Zeichnungen sei die Erfindung noch ODER-Schaltung zur Überwachung der Eingangs- 4° näher erläutert. Dabei läßt F i g. I noch einmal das signal- bzw. Zwischenergebnisleitungen einer Steuer- Prinzip einer Überwachungsanordnung gemäß dem einrichtung auf während einer Betriebspause auf- Hauptpatent erkennen; Fig. 2 zeigt dann ein Austretende und zu einer Erfüllung der jeweiligen Ver- führungsbeispiei für eine gemäß der Erfindung ausknüpfungsbedingung beitragende Signale die betref- gebildete Überwachungsanordnung, fend? Steuereinrichtung selbst bzw. Teile von ihr mit 45 Fig. 1 zeigt zunächst noch einmal in prinzipielle! nicht durch die ODER-Bedingung gegebener Ver- Form eine gemäß dem Hauptpatent ausgebildete knüpfungsbedingung mit ausnutzen zu können, so Überwachungsanordnung zur Feststellung fehlerhafter daß also ein zusätzlicher Aufwand einer ODER- Signalzustände in Binärsignale verarbeitenden Steuer-Schaltung nicht erforderlich ist. einrichtungen, wie sie insbesondere in Fcrnsprech-The invention has the advantage that the invention will be explained in more detail with reference to the drawings OR circuit for monitoring the input 4 °. Here, F i g. I once again recognize the signal or intermediate result lines of a control principle of a monitoring arrangement according to the device on during a break in operation. Main patent; 2 then shows an exit and the monitoring arrangement in question, fend? Control device itself or parts of it with 45 Fig. 1 initially shows again in principle! Not by the OR condition given form to be able to use a link condition formed according to the main patent with, so monitoring arrangement for the detection of faulty so that an additional effort of an OR signal states in binary signals processing control circuit is not necessary. facilities such as those used in telephone
Die Änderung der Verknüpfungsbedingung kann 50 Vermittlungsanlagen enthalten sein können. Eine solin weiterer Ausgestaltung der Erfindung dadurch ehe Steuereinrichtung ist in Fig. 1 mit Si bezeichnet: herbeigeführt werden, daß die Prüfsignale die An- sie möge einer bestimmten Verknüpfungsbedingung sprechschwelle des betreffenden Steuereinrichtungs- genügen, bei deren Erfüllung durch die auf den Einteils so verlagern, daß sie bei Auftreten eines zur Er- gangsleitungen der Steuereinrichtung Si, wie den Leifüllung der eigenttichen Verknüpfungsbedingung bei- 55 tungensi... sn, auftretenden Signale ein dies antragenden Signals auf mindestens einer Eingangslei- zeigendes Signal am Ausgang ν der Steuereinrichtung tung des betreffenden Steuereinrichtungsteils über- 5/ auftreten möge. Wie in Fig. 1 angedeutet ist, schritten wird. Wird beispielsweise die nicht durch kann die Steuereinrichtung St eine Mehrzahl von Verdie ODER-BedingOHg gegebene Verknüpfung über knüpfungsschaltungen umfassen, wobei dann die die Magnetfelder von Magnetkernen herbeigeführt, 60 Steuereinrichtung 5/ zusätzlich zu ihren Eingangsso kann dazu während der Betriebspausen eine signalleitungen 51... sn und der Ausgangsleitung ν Wicklung solcher Magnetkerne mit einem Magneti- auch noch entsprechende Zwischenergebnisleuungcn sierungsstrom beschickt werden, auf Grund dessen aufweisen kann, wie sie in Fig. 1 mit z\ —zm beder betreffende Magnetkern so weit vormagnetisiert zeichnet sind.The change in the link condition can contain 50 switching systems. A further embodiment of the invention in this way before the control device is denoted by Si in FIG. that when a signal occurs to the output lines of the control device Si, such as the fulfillment of the actual linkage condition si ... sn, it sends a signal requesting this to at least one input signal at the output ν of the control device of the relevant Control device part over- 5 / may occur. As indicated in Fig. 1, steps are taken. For example, by may include the control device St, a plurality of Verdie OR BedingOHg given link about knüpfungsschaltungen not, and then the induced magnetic fields of magnetic cores, 60 controller 5 / in addition to their Eingangsso can to a signal lines 5 1 during the operating pauses .. sn and the output line ν winding of such magnetic cores are charged with a magnetization sierungsstrom also corresponding Zwischenergebnisleuungcn, on the basis of which may have, as shown in Figure 1, with z \ -.. distinguished biased so far zm beder respective magnetic core.
wird, daß berefH ein auf einer Signalleitung auf- 65 Mit den während der Betriebspausen der Steuertretender, zu einer Erfüllung der eigentlichen Ver- einrichtung 5/ normalerweise jeweils solche Signale, knUpfungsbedingung beitragender Signalstrom die die zu einer durch ein am Ausgang ν bzw. auf einer Erfüllung der Ve. i;näpfimgsbedingung herbeiführt. Zwischenergcbnisleitung der Steuereinrichtung auf-is that berefH a on a signal line up 65 with the during the breaks in operation of the control kicking, means to a fulfillment of the actual encryption 5 / Usually each such signals knUpfungsbedingung contributing signal current machine or the ν to a by the output of a Fulfillment of the Ve. i; brings about the receiving condition. Intermediate result line of the control device on
tretendes Signal angezeigten Erfüllung einer Vcr- der eigentlichen Verknüpfungsbedingung der Verknüpfungsbedingung der Steuereinrichtung nichts bei- knüpfungsschaltung V beitragende Prüfsignale an die tragen, führenden Eingangssignallcitungcn bzw. mit jeweils in Frage kommenden Übrigen Zwischcncrgebsolchen Zwischcncrgcbnislcitungcn, auf denen wäb- nislcitungcn liefert. In F i g. 2 ist hierzu angedeutet, rend Bctriebspauscn normalerweise jeweils ebenfalls 5 daß dies mit Hilfe von Arbeitskontakten ρ 1 ... pm zu einer Erfüllung einer Verknüpfungsbedingung geschehen kann, mit deren Hilfe von den in Frage nichts beitragende Signale auftreten, sind die Ein- kommenden Transistoren TO 1 ... TOm die Speisegänge einer ODER-Schaltung für die zur Erfüllung spannungsvolle abgeschaltet werden kann. Die der jeweiligen Verknüpfungsbedingung beitragenden. Spcisespannungsabschaltung wird dabei in der Weise auf den betreuenden Leitungen auftretenden Signale io vorgenommen, daß die Spciscspannungsqucllc zuverbunden. Eine solche ODER-Schaltung ist in nächst nur bei dem ersten Transistor TOi der Tian-F i g. I mit [·' bezeichnet; sie ist mit ihren Eingängen sistoren TO 1 ... TOm angeschaltet bleibt und bei an die Zwischenergcbnislcitungcn zi...zm angc- den übrigen Transistoren ... TOm abgeschaltet wird, schlossen. Diese ODER-Schaltung F zeigt mit Ab- daß danach die Spciscspannungsqucllc nur bei dem gäbe eines die Erfüllung der ODER-Bedingung an- 15 nächsten Transistor angeschaltet bleibt und bei den zeigenden Ausgangssignals an ihrem Ausgang ü wäh- übrigen Transistoren abgeschaltet wird und so fort, rcnd einer Bctrichspausr das Vorliegen eines fehler- bis schließlich die Spciscspannungsqucllc nur bei dem haften Signal/ustandcs. nämlich das Auftreten eines letzten Transistor TOm der Transistoren TO 1 ... zur Erfüllung der VcrknüpfunRsbedingung Γ bcitra- TOm angeschaltet bleibt und bei den übrigen Trangenden Signals auf einer der Zwischencrgebnislcitun- ao sistoren TO 1 ... abgeschaltet wird. Bei fehlerfreiem gen r 1 ... r./ii während einer Betriebspause an. Betrieb der Steuereinrichtung trägt dann jeweils gc-Occurring signal indicated fulfillment of the actual linking condition of the linking condition of the control device linking circuit V contributing test signals to the leading input signal lines or with other possible interim results such intermediate lines on which information is provided. In Fig. 2 is thereto indicated rend Bctriebspauscn each also 5 that this ρ by means of working contacts 1 can be done pm to satisfaction of a join condition normally ..., with the aid of the not contributing signals occur in question are the input coming transistors TO 1 ... TOm the supply inputs of an OR circuit for which voltage can be switched off in order to fulfill the voltage. Those contributing to the respective linkage condition. Spciscspannungsqucllc is carried out in such a way on the supervising lines occurring signals that the Spciscspannungsqucllc connected. Such an OR circuit is initially only the Tian-F i g for the first transistor TOi. I denoted by [· '; it is with its inputs sistors TO 1 ... TOm remains switched on and is closed when the intermediate result is switched off zi ... zm the other transistors ... TOm. This OR circuit F shows with Ab- that afterwards the Spciscspannungsqucllc only if one of the fulfillment of the OR condition would remain switched on next transistor and with the showing output signal at its output ü the remaining transistors are switched off and so on, rcnd a break the presence of an error until finally the Spciscspannungsqucllc only with the persistent signal / state. namely, the occurrence of a last transistor TOm of the transistors TO 1 ... to fulfill the link condition Γ bcitra- TOm remains switched on and for the other branches the signal on one of the intermediate result transistors TO 1 ... is switched off. If gen r 1 ... r./ii is error-free during a break in operation. Operation of the control device then carries gc-
F i g. 2 zeigt nun ein Ausführungsbeispiel für eine radc eines der auf den Zwischcncrgcbnisleitungcn Überwachungsanordnung, bei der die gewünschte zi .. ■ zm auftretenden Signale nicht ?ur Erfüllung Sicherheit dagegen, daß sich fehlerhafte Signal/u- der Verknüpfungsbedingung UND dcrVerknüpfungsstäiulc der genannten Art schädlich auswirken kön- 25 schaltung V bei, indem nämlich jeweils auf dcrjcnincn. auch ohne Inanspruchnahme einer gesonderten gen Zwischcncrgcbnislcitung, die mit dem gerade ODER-Schaltung (/·" in Fig. 1) erzielt wird. Die leitend gehaltenen Transistor der Transistoren Steuereinrichtung ist hier wiederum mit St bczcich- TOi ...TOm verbunden ist, ein relativ hohes Tonet: sie möge, entsprechend den in F i μ. 1 dargc- ierüia! herrsch!, auf tlcn übrigen Zwischcncrgcbnisstelltcn Verhältnissen, unter anderem wiederum eine 30 leitungen dagegen ein niedriges Potential. Die Vcr-EingangsicitiMigen vl .. ..wt zusammenfassende, hier knüpfungsscha'.tung V wird dann an ihrem Ausdurch eine Dioden-Transistor-Schaltung gegebene gang ν kein die Erfüllung der eigentlichen Vcrknüp-ODER-Schallung. die über eine Zwischenergebnis- fungsbcdingung UND anzeigendes Signal abgeben, leitung r 1 zu einem Eingang einer mit weiteren Ein- Tritt im Verlaufe dieser Prüfung indessen der Fall gangen an weiteren Zwischenergebnislcitungen (:.m) 35 ein. daß alle Zwischcncrgcbnisleitungen z\...zm angeschlossenen, ebenfalls durch eine Dioden-Tran- ein zur Erfüllung der Verknüpfungsbedingung der sistor-Schaltung gegebenen UND-Schaltung V führt. Verknüpfungsschaltung V beitragendes Signal führen, enthalten. Wie in Fig. 2 angedeutet ist. sind die zu so gibt die Verknüpfungsschaltung V an ihrem Ausclen Zwischenergebnislcitungen ti . .. zm führenden gang ν ein entsprechendes Signal ab, daß jetzt der Transistoren TOi .. .TOm im Ruhezustand der 40 Prüfeinrichtung Γ das Vorliegen eines fehlerhaften Steuereinrichtung und damit auch während deren Signalzustandcs angezeigt wird, nämlich das Auf-Betriebspausen leitend, während der Transistor der treten eines zur Erfüllung der Verknüpfungsbcdin-UND-Schaltung V gesperrt ist. gung beitragenden Signals auf derjenigen Zwischcn-F i g. 2 now shows an exemplary embodiment for a radc of one of the monitoring arrangements on the Zwischencncrgcbnisleitungcn, in which the desired zi .. ■ zm occurring signals are not for the fulfillment of security against the fact that faulty signals / and the linkage condition AND the linkage of the type mentioned can have a harmful effect - 25 circuit V at, namely in each case to dcrjcnincn. without use of a separate gene Zwischcncrgcbnislcitung, achieved with the just-OR circuit (/ · "in Fig. 1). The transistor conductive the transistors held control device is here again with St bczcich- TOi TOm ... is connected to a Relatively high tone: according to the rule shown in Fig. 1, it should be on some of the other interim results, among other things again a 30 lines, on the other hand, a low potential 'Here link circuit V is then given at its output by a diode-transistor circuit the fulfillment of the actual link-OR circuit, which emit an intermediate result condition AND indicating signal, line r 1 to an input of a with a further entry in the course of this test, however, the case was received at further interim result lines (: .m) 35 that all interconnection lines z \ ... zm are connected ssenen, also through a diode tran- a given AND circuit V leads to the fulfillment of the linkage condition of the sistor circuit. Linking circuit V lead contributing signal included. As indicated in FIG. 2. if they are to then the logic circuit V gives intermediate result lines ti at its cut-out. .. zm leading output ν a corresponding signal that now the transistors TOi .. .TOm in the idle state of the 40 test device Γ the presence of a faulty control device and thus also during its signal statecs is indicated , namely the on-operational pauses conductive, while the transistor the occurrence of one to fulfill the linkage Bcdin-AND circuit V is blocked. contributing signal on that intermediate
Zur Überwachung der Steuereinrichtung St darauf, ergcbnislcitung. die mit demjenigen der Transistoren daß ihre während Bclriebspausen jeweils normaler- 45 TO 1 ... TOm verbunden ist, bei dem gerade die weise nicht zu einer Erfüllung der Vcrknüpfungsbc- Bctricbsspannungsquellc nicht abgeschaltet worden dingung UND der Verknüpfungsschaltung V bcitra- ist. Mit der beschriebenen Prüfung St ist also zugendc Signale führenden Zwischenergebnisleitungcn gleich eine gewisse Fehlerlokalisicrung verbunden, ti ...zm während etier Betriebspause keine zur die die Durchführung der gegebenenfalls im AnErfüllung der Verknüpfungsbedingung UND beitra- 50 Schluß an eine Fehlerfeststellung vorzunehmenden genden Signale führen, wird nun jeweils im Verläufe Maßnahmen zur Fehlerbeseitigung erleichtert, einer Betriebspause die Verknüpfungsbedingung der Der beschriebene Prüfvorgang kann noch dahin-VcrknOpfungsschaltung V in die ODER-Bedingung gehend ausgeweitet werden, daß in einem weiteren geändert, und zwar nach Maßgabe von Prüfsignalen. Prüfschritt durch gleichzeitiges Offnen aller Kontakte die von einer Prüfeinrichtung P abgegeben werden. 55 ρ I .. pm die Speisespanmmgsquelle gleichzeitig von der dabei mit der Abgabe eines die Erfüllung der allen Transistoren TO i ... TOm abgeschaltet wird ODER-Bedingung anzeigenden Ausgangssignais der und damit zur Erfüllung der eigentlichen Verknüp-Verknüpfungsschaltung V das Vorliegen eines fehler- fungsbedingung (UND) der Verknüpfungsschaltung V haften Signalzustandes angezeigt wird. Die Anschal- beitragende Prüfsignal an alle Zwbchenergebnisleitung der Prüfeinrichtung Γ an die Steuereinrichtung 60 tungenzl ...zm gleichzeitig geliefert werden. In .Vr kann durch Umlegen von in F i g. 2 mit α bezekh- diesem Falle müßte die Vernüungsschaltung V neten Kontakten in die dargestellte Lage herbeige- ein die Erfüllung der Verknüpfungsbedingung anzeiführt werden. Die Prüfeinrichtung P der Über- gendes Ausgangssignal abgeben; mit der Abgabe wachungsanordnung nach F i g. 2 ändert nun die Ver- eines die Nichterfüllung der Vcrknüpfungsbedingung knüpfungsbedingung der Verknüpfungsschaltung V 65 anzeigenden Ausgangsstgnals an die PrüfeinrichtungP nacheinander mit Wirkung jeweils für eine der einzel- wird dagegen das Vorliegen eines fehlerhaften Sincn Zwischenergebnisleitungen ζ 1 ... zm in die gnalzustandes angezeigt, nämlich daß sich auf einer ODER-Bedmgung. indcrrs sis jeweils tut Erfüllung der Eingangsleitungen der Verknüpfungsschaltung V In order to monitor the control device St it is necessary to provide results. the one of the transistors that their normal 45 TO 1 ... TOm is connected during pauses in operation, in which precisely the condition AND the logic circuit V bcitra- is not switched off to a fulfillment of the Vcrlinkungsbc- Bctricbsspannungsquellc. With the described test St , therefore, a certain error localization is connected to the intermediate result lines carrying signals , ti ... zm during a break in operation none of the signals to be carried out which may contribute to the fulfillment of the linkage condition AND contribute to an error detection, will lead now each facilitated curves measures for error correction, a break in operation, the connecting condition of the Test Procedure described can still go-VcrknOpfungsschaltung V OR condition to be expanded continuously in the that changed to another, and indeed in accordance with test signals. Test step by simultaneous opening of all contacts that are issued by a test device P. 55 ρ I .. pm the supply voltage source at the same time from the output signal of the output signal that indicates the fulfillment of all transistors TO i ... TOm is switched off with the output of an OR condition and thus the presence of an error to fulfill the actual logic logic circuit V condition (AND) of the logic circuit V sticking signal state is displayed. The test signal contributing to the connection can be delivered to all intermediate result lines of the test device Γ to the control device 60 tungenzl ... zm at the same time. In .Vr can by moving in F i g. 2 with α bezekh- in this case the vernier circuit V neten contacts would have to be brought into the position shown- the fulfillment of the linkage condition would have to be indicated. The test device P emits the transferring output signal; with the submission of the surveillance order according to Fig. 2 now changes the connection of an output signal to the test device P indicating the non-fulfillment of the connection condition connection condition of the connection circuit V 65, with each effect for one of the individual interim result lines ζ 1 ... zm is displayed in the signal state, namely that is based on an OR condition. indcrrs sis in each case does fulfillment of the input lines of the logic circuit V
ilerhaftcrwcise ein zur Erfüllung der Verknüpigsbcdingung nicht beitragendes Signal durchsetzt d die Verknüpfungsschaltung V die tatsächliche füllung der Verknüpfungsbedingung fehlerhaftcr- ;isc nicht anzeigt. Eine solche Ergänzung des Prüfrgangcs gestattet es, wie eingangs bereits erwähnt, f eire sonst unter Umständen erforderliche Ver-ilerhaftcrwcise a non-contributing to fulfill the Verknüpigsbcdingung signal passes through the switching circuit V d fehlerhaftcr- the actual filling of the link condition; isc does not display. Such an addition to the test procedure, as already mentioned at the beginning, allows for any other
doppclimg der Verknüpfungsschaltung V. wie sie in der Hauplpatcntschrift angegeben ist, zu verzichten. Es sei noch bemerkt, daß die Prüfeinrichtung /' neben der in F i g. 2 dargestellten Steuereinrichtung St auch noch andere Steuereinrichtungen in entsprechender Weise überprüfen kann, was hier jedoch nicht weiter erläutert zu werden braucht.doubleclimg of the logic circuit V. as it is specified in the main patent specification, to be omitted. It should also be noted that the test device / 'in addition to the in F i g. 2 control device St shown can also check other control devices in a corresponding manner, but this does not need to be explained further here.
Hierzu 1 Blatt Zeichnungen1 sheet of drawings
309633/209309633/209
Claims (4)
lerhat!er Signal/usiändc in HmiirMiiiiale veraibci1. ScluilumgMiiioulnung / ur F csisicHung I- ; '- »i'jnal / .Li-vaiidc * auuc / ciizl will.
lerhat ! he signal / usiändc in HmiirMiiiiale veraibci
noi nial.'rwci-.e suiche Sijnale aufircLc-::. Ji. .·.:Lcn. ouch! whom uahund Hcirich-spaiisc !. jewel's ι ·
noi nial.'rwci-.e suiche Sijnale aufircLc - ::. Ji. . · .:
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| DES102594A DE1275125B (en) | 1966-03-17 | 1966-03-17 | Arrangement for monitoring control devices for processing binary characters, in particular in telephone switching systems |
| DE19681762770 DE1762770C (en) | 1968-08-22 | Arrangement for monitoring control devices for processing binary characters, especially in telephone exchanges | |
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| DE19681762769 DE1762769C (en) | 1968-08-22 | Arrangement for monitoring control devices for processing binary characters, especially in telephone exchanges |
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