DE1514742A1 - Halbleiteranordnung - Google Patents
HalbleiteranordnungInfo
- Publication number
- DE1514742A1 DE1514742A1 DE19651514742 DE1514742A DE1514742A1 DE 1514742 A1 DE1514742 A1 DE 1514742A1 DE 19651514742 DE19651514742 DE 19651514742 DE 1514742 A DE1514742 A DE 1514742A DE 1514742 A1 DE1514742 A1 DE 1514742A1
- Authority
- DE
- Germany
- Prior art keywords
- lead wires
- wires
- base
- semiconductor
- semiconductor wafer
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H10W72/20—
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D84/00—Integrated devices formed in or on semiconductor substrates that comprise only semiconducting layers, e.g. on Si wafers or on GaAs-on-Si wafers
- H10D84/60—Integrated devices formed in or on semiconductor substrates that comprise only semiconducting layers, e.g. on Si wafers or on GaAs-on-Si wafers characterised by the integration of at least one component covered by groups H10D10/00 or H10D18/00, e.g. integration of BJTs
- H10D84/611—Combinations of BJTs and one or more of diodes, resistors or capacitors
- H10D84/613—Combinations of vertical BJTs and one or more of diodes, resistors or capacitors
- H10D84/617—Combinations of vertical BJTs and only diodes
-
- H10P14/46—
-
- H10P14/6309—
-
- H10P95/00—
-
- H10W74/43—
-
- H10W76/161—
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10T—TECHNICAL SUBJECTS COVERED BY FORMER US CLASSIFICATION
- Y10T29/00—Metal working
- Y10T29/49—Method of mechanical manufacture
- Y10T29/49002—Electrical device making
- Y10T29/49117—Conductor or circuit manufacturing
- Y10T29/49169—Assembling electrical component directly to terminal or elongated conductor
Landscapes
- Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
- Electroplating Methods And Accessories (AREA)
- Electrodes Of Semiconductors (AREA)
Description
- Halbleiteranordnung (Zusatz zu Patent .....o......°. (Patentanmeldung ISE/Reg.305.7 vom 20.1.1'965 mit Priorität der Anmeldung Nr. 378b/64 vom 29.1.1964 von Großbritannien Die Erfindung bezieht sich auf Halbleiteranordnungen mit Umhüllung nach dem Hauptpatent, bei denen ein Halbleiterplättchen mit darin erzeugten Elektroden entgegengesetzten Leitungstypsq die auf der gleichen Fläche des Halbleiterplättchens angeordnet sind, mit Lötkontakten auf einem Sockel mit Anschlußdrähten. befestigt sind.
- Durch die Montage und Umhüllung ist das Halbleiterplättchen gegen mechanische Einwirkung und eine ungünstige Atmosphäre geschützt-und die Anordnung kann mit Zuleitungsdrähten an eine elektrische Schaltung angeschlossen werden.
- Gegenstand der Erfi%ung ist die Ausbildung es Sockels und ein einfaches und billiges Verfahren zu seiner Herstellung.
- Es wird gemäß der Erfindung ein Sockel zur Verwendung bei Halbleiteranordnungen nach dem Hauptpatent vorgeschlagen» der eine Dichtung enthält' in die mehrere Drähte so eingebettet sind, daB' sie an beiden Enden herausragen und daß sie eine Reihe von langen Enden und eine Reihe von kurzen Enden bilden und daß die kurzen Enden der Zuleitungsdrähte am Ende so abgeflacht sind, daß diese Abflachungen in einer Ebene und in rechtem Winkel zu der allgemeinen Richtung der langen Drahtenden angeordnet sind und die Abflachungen eine solche Zage zueinander haben, daß sie der Zage der Kontakte des Halbleiterplättchens entsprechen.
- Es wird ferner ein Verfahre. zur Vorbereitung der Zuleitungsdrähte eines Sockels vorgeschlagen, der sich als Träger für das Plättehen einer Ralbleitervorrchtung mit einer Anzahl von auf einer-Fläche in einer Ebene angeordneten getrennten Kontakten eignet, bei dem die Enden der Drähte, die das Plättchen tragen sollen, so behandelt werden, daß eine Anzahl von ebenen, in einer gemeinsamen Ebene liegenden Flächen erzeugt werden, die eine den Kontakten auf den Plättchen entsprechende Zage zueinander haben, Die Erfindung soll anhand der Figuren näher erläutert werden. Figur 1 zeigt die Seitenansicht eines Sockels mit einer Glasmetalldurchführung, bei dem drei Drahte durch die Abdichtung geführt sind.
- Figur 2 zeigt die Seitenansicht eines Sockels, der in ein Werkzeug eingeführt ist, mit dem die kurzen Enden der Zuleitun--;sdrähte die richtige Form erhalten.
- Figur 3a zeigt in Seitenansicht den Sockel, nachdem die Draht: enden die entsprechende Form erhalten haben, Figur 3b zeigt eine Draufsicht auf den Sockel nach Figur Sao Figur 4 zeigt eine Seitenansicht des Sockels mit einem auf den Drahtenden angebrachten Halbleiterplattcheno
Schleifrad 4 über die Flächen Das über die ebene Stirnfläche des Werkzeugs überstehende Material der Zuleitungsdrähte wird so entfernt, so daß der Sockel danach aussieht, wie dies in Figur 3a in Seitenansicht und Figur 3b in Draufsicht dargestellt ist. Die verformten Zuleitungsdrähte sind in Figur 3b von oben zu sehen. Dabei wurden die Abflachungen 5, die in einer gemeinsamen Ebene angeordnet sind und zwar in rechtem Winkel zur allgemeinen Richtung der langen Enden der Zuleitungsdrähte, an den Drahtenden erzeugt. Die Abflachungen haben zueinander die gleiche Zage wie die Kontaktzonen des Transistors, der darauf angeordnet werden soll. Die relative Zage der Abflachungen ist durch die Form der Ausnehmung im Werkzeug 3 bestimmt. Y Nach der Entfernung aus dem Werkzeug wird der Sockel in eine Glanzätzlösung eingetaucht, um den Grat zu entfernen und die metallische Oberfläche für die nachfolgende Plattierung geeignet zu machen. Die Plattierung wird in bekannter Weise durchgeführt und dabei Nickel, Gold oder ein anderes geeignetes Material auf die freiliegenden Metalli:-,ZÄ*,chen aufplattiert. - Die Abflachungen 5 können vor dem-Verbinden mit den Kontakten des Transistorplättchens mit Lot überzogen werden.
- In Figur 4 ist eine Seitenansicht eines Sockels mit einem Transi-.storplättchen dargestellt, das mit dem Sockel verbunden istg wie dies im Hauptpatent beschrieben ist.
- Das Verfahren zur Verformung des Sockels ist nicht auf Sockel mit drei Zuleitungsdrähten beschränkt. Es kann z.Bn auch ein Sockel mit acht Zuleitungsdrähten, als auch ein solcher mit zwei Zuleitungsdrähten nach dem genannten Verfahren vorbereitet werden. Solche verschiedene Sockel können auch bei anderen Halbleiteranordnungen verwendet werden, wie z.B. bei Festkörperschaltungen, integrierten Schaltungen, gesteuerten Siliziumgleichrichtern und Dioden. Es ist möglich, drei Enden der Zuleitungsdrähteg die aus der ebenen Stirnfläche des Werkzeugs herausstehen, auch in anderer Weise als durch Schleifen zu entfernen, beispielsweise durch ein elektrolytisches Verfahren oder durch Schneiden.
- Anstelle von Gläsdurchführungen können auch Keramikdurchführungen oder Kunststoffdurchführungen mit Metallrand verwendet werden und das Verfahren ist nicht beschränkt auf das Bearbeiten der Enden von Zuleitungsdrähteno In der obigen Beschreibung ist ein Werkzeug angegeben, mit dem zwei Verfahrensschritte durchgeführt werden und zwar das Biegen der Drähte in eine bestimmte Form und die Entfernung des unerwünschten Materials von den Enden dieser Drahte. Es können jedoch auch zwei Werkzeuge verwendet werden, welche diese beiden Verfahrensschritte nacheinander ausführen.
- Die beschriebenen und dargestellten Ausführungsbeispiele sollen jedoch. keine. Beschränkung des Erfindungsgedankens bedeuten.
Claims (1)
- Patentansprüches 1.) Halbleiteranordnung mit Umhüllung, bei der ein Halbleiterplättchen mit darin erzeugten Elektroden entgegengesetzten Zeitungstyps, die auf der gleichen Fläche des Halbleiterplättchens angeordnet sind, mit Lötkontakten auf einem Sockel mit Anschlußdrähten bestigt ist nach Patent ............ (Patentanmeldung ISE/&eg.-3057 vom 20.1.1965), dadurch gekennzeichnet, ä&der Sockel aus einer Isolierdurchführung mit einer Anzahl von Drähten besteht, die auf beiden Seiten aus der Durchführung so herausragen, daß auf einer Seite lange Enden und auf der anderen Seite kurze Enden vorhanden sind, daß die kurzen Enden der Zuleitungsdrähte in einer gemeinsamen Ebene liegende Abflachungen besitzen, die in rechtem Winkel zu der allgemeinen Richtung der langen Enden angeordnet ist/ und daß die Abflachungen eine solche relative Zage zueinander haben, daß sie den auf dem Halbleiterplättchen angeordneten Kontakten entpfsrechen. 2.) Halbleiteranordnung nach Anspruch 1, dadurch gekennzeichnet, daß der Sockel eine Glas-Metall-Abdichtung enthält. 3.) Halbleiteranordnung nach Anspruch 1, dadurch gekennzeichnet, daß der Sockel eine Keramik-Metall-Abdichtung enthält, 4.) Halbleiteranordnung nach Anspruch -1, dadurch gekennzeichnet, daß der Sockel eine Kunststoff-Metall-Abdichtung enthält. 5.) Verfahren zum Behandeln der Zuleitungsdrähte des Sockels für eine Halbleiteranordnung nach ,Anspruch 1 bis 4, dadurch gekennzeichnet, daß an den Enden der Drähte, an denen das Plättchen befestigt werden soll, eine Anzahl von in einer Ebene angeordneten Abflachungen erzeugt wird, deren gegenseitige Zage der Lage der Kontakte auf dem Halbleiterplättchen entspricht. 6ö) Verfahren nach .Anspruch 5' dadurch gekennzeichnete daß der Sockel in die Ausnehmung eines Werkzeugs eingeführt - und dadurch die Zuleitungsdrähte in eine gewünschte Form gebogen werden. 7.) Verfahren nach Anspruch 5' dadurch gekennzeichnete daß ein -- Werkzeug verwendet wird, das eine ebene Oberfläche hat' in der ein Loch angeordnet ist, durch das die Enden der Zuleitungsdrähte herausragen und daß Mittel vorgesehen sind, um die herausragenden Teile der Zuleitungsdrähte zu entfernen. 8.-). Verfahren nach Anspruch-6 und 7, dadurch gekennzeichnet' .daß das Biegen und Entfernen der Enden der Zuleitungsdrähte mit ein und demselben Werkzeug vorgenommen wird, bei dem das Loch in der Ausnehmung angeordnet isto
Applications Claiming Priority (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| GB3785/64A GB1036164A (en) | 1962-04-16 | 1964-01-29 | Improvements in or relating to semiconductor devices |
| GB3786/64A GB1036165A (en) | 1962-05-25 | 1964-01-29 | Improvements in or relating to semiconductor devices |
| GB6100/64A GB1036166A (en) | 1964-02-13 | 1964-02-13 | Improvements in or relating to semiconductor devices |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| DE1514742A1 true DE1514742A1 (de) | 1969-08-14 |
Family
ID=27254326
Family Applications (2)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| DE1514736A Expired DE1514736C3 (de) | 1964-01-29 | 1965-01-21 | Verfahren zum Herstellen einer Mehrzahl von Halbleiterbauelementen |
| DE19651514742 Pending DE1514742A1 (de) | 1964-01-29 | 1965-02-06 | Halbleiteranordnung |
Family Applications Before (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| DE1514736A Expired DE1514736C3 (de) | 1964-01-29 | 1965-01-21 | Verfahren zum Herstellen einer Mehrzahl von Halbleiterbauelementen |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US3324357A (de) |
| BE (1) | BE659624A (de) |
| DE (2) | DE1514736C3 (de) |
| NL (3) | NL6501141A (de) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE2238121A1 (de) * | 1971-08-11 | 1973-03-01 | Philips Nv | Verfahren zum bilden von flachen oberseiten an drahtfoermigen stromleitern, die durch den glasboden der grundplatte eines bauelementengehaeuses gefuehrt sind |
Families Citing this family (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE1514881C3 (de) * | 1965-10-15 | 1975-05-28 | Telefunken Patentverwertungsgesellschaft Mbh, 7900 Ulm | Verfahren zum Kontaktieren eines Halbleiterbauelementes |
| US3474358A (en) * | 1966-01-18 | 1969-10-21 | Sanders Associates Inc | Multiple-path electronic component |
| US3437883A (en) * | 1966-12-09 | 1969-04-08 | Bunker Ramo | Micromodular electronic package utilizing cantilevered support leads |
| GB1258580A (de) * | 1967-12-28 | 1971-12-30 | ||
| US3636619A (en) * | 1969-06-19 | 1972-01-25 | Teledyne Inc | Flip chip integrated circuit and method therefor |
| US3909319A (en) * | 1971-02-23 | 1975-09-30 | Shohei Fujiwara | Planar structure semiconductor device and method of making the same |
Family Cites Families (17)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US2668867A (en) * | 1952-03-21 | 1954-02-09 | Vitro Corp Of America | Photocell construction |
| US2799814A (en) * | 1953-09-01 | 1957-07-16 | Sylvania Electric Prod | Germanium photodiode |
| US2965962A (en) * | 1954-12-07 | 1960-12-27 | Rca Corp | Hermetic seal and method of making the same |
| US2888736A (en) * | 1955-03-31 | 1959-06-02 | Raytheon Mfg Co | Transistor packages |
| US2897377A (en) * | 1955-06-20 | 1959-07-28 | Rca Corp | Semiconductor surface treatments and devices made thereby |
| US2862160A (en) * | 1955-10-18 | 1958-11-25 | Hoffmann Electronics Corp | Light sensitive device and method of making the same |
| US3021461A (en) * | 1958-09-10 | 1962-02-13 | Gen Electric | Semiconductor device |
| US2948835A (en) * | 1958-10-21 | 1960-08-09 | Texas Instruments Inc | Transistor structure |
| US3225416A (en) * | 1958-11-20 | 1965-12-28 | Int Rectifier Corp | Method of making a transistor containing a multiplicity of depressions |
| DE1154874C2 (de) * | 1960-04-26 | 1964-04-09 | Heinrich Menzel | Transistor fuer Hochfrequenzschaltungen |
| US3159775A (en) * | 1960-11-30 | 1964-12-01 | Sylvania Electric Prod | Semiconductor device and method of manufacture |
| NL272139A (de) * | 1960-12-15 | 1900-01-01 | ||
| US3241010A (en) * | 1962-03-23 | 1966-03-15 | Texas Instruments Inc | Semiconductor junction passivation |
| US3178621A (en) * | 1962-05-01 | 1965-04-13 | Mannes N Glickman | Sealed housing for electronic elements |
| US3184658A (en) * | 1962-05-22 | 1965-05-18 | Texas Instruments Inc | Semiconductor device and header combination |
| US3271625A (en) * | 1962-08-01 | 1966-09-06 | Signetics Corp | Electronic package assembly |
| US3239719A (en) * | 1963-07-08 | 1966-03-08 | Sperry Rand Corp | Packaging and circuit connection means for microelectronic circuitry |
-
1964
- 1964-12-28 US US421178A patent/US3324357A/en not_active Expired - Lifetime
-
1965
- 1965-01-21 DE DE1514736A patent/DE1514736C3/de not_active Expired
- 1965-01-29 NL NL6501141A patent/NL6501141A/xx unknown
- 1965-01-29 NL NL6501142A patent/NL6501142A/xx unknown
- 1965-02-06 DE DE19651514742 patent/DE1514742A1/de active Pending
- 1965-02-12 BE BE659624D patent/BE659624A/xx unknown
- 1965-02-12 NL NL6501745A patent/NL6501745A/xx unknown
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE2238121A1 (de) * | 1971-08-11 | 1973-03-01 | Philips Nv | Verfahren zum bilden von flachen oberseiten an drahtfoermigen stromleitern, die durch den glasboden der grundplatte eines bauelementengehaeuses gefuehrt sind |
Also Published As
| Publication number | Publication date |
|---|---|
| US3324357A (en) | 1967-06-06 |
| BE659624A (de) | 1965-08-12 |
| DE1514736A1 (de) | 1969-02-20 |
| NL6501142A (de) | 1965-07-30 |
| NL6501745A (de) | 1965-08-16 |
| DE1514736C3 (de) | 1975-10-30 |
| NL6501141A (de) | 1965-07-30 |
| DE1514736B2 (de) | 1975-03-20 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| EP0092086B1 (de) | Anschlussvorrichtung für ein plattenförmiges elektrisches Gerät | |
| DE69128464T2 (de) | Halbleiteranordnung und ihr herstellungsverfahren | |
| DE1514742A1 (de) | Halbleiteranordnung | |
| DE2333273C2 (de) | Elektrischer Verbinder zum Anschluß von Schaltungen auf Karten | |
| DE9305285U1 (de) | Leiterplatte | |
| DE1916554A1 (de) | Halbleiter-Anordnung und Verfahren zu ihrer Herstellung | |
| DE1292755B (de) | Verfahren zum serienmaessigen Sockeln und Gehaeuseeinbau von Halbleiterbauelementen | |
| DE1514363B1 (de) | Verfahren zum Herstellen von passivierten Halbleiterbauelementen | |
| EP0042137A2 (de) | Verfahren zum Anbringen und Befestigen von parallel zueinander verlaufenden Stromzuführungsdrähten an gegenüber befindlichen Seitenflächen elektrischer Bauelemente | |
| DE2855972C2 (de) | Halbleiteranordnung mit zwei integrierten und antiparallel geschalteten Dioden sowie Verfahren zu ihrer Herstellung | |
| DE2356840A1 (de) | Verlaengerungsvorrichtung fuer kontaktelemente von elektrischen steckverbindungen | |
| DE1514881C3 (de) | Verfahren zum Kontaktieren eines Halbleiterbauelementes | |
| DE1227965C2 (de) | Mikrominiaturisierte Schaltungsanordnung | |
| DE2008342A1 (de) | Mehrpolige Steckvorrichtung fur elek trische Leitungsverbindungen | |
| DE1614567C3 (de) | Halbleiterbauelement und Verfahren zu seiner Herstellung | |
| DE19750316A1 (de) | Siliziumfolie als Träger von Halbleiterschaltungen als Teil von Karten | |
| DE1277446B (de) | Verfahren zum Herstellen von Halbleiterbauelementen mit vollstaendig gekapseltem Halbleiterelement | |
| DE1285581C2 (de) | Traeger mit einer Mikroschaltung und Verfahren zu seiner Herstellung | |
| DE2030809A1 (de) | Halbleiter-Anordnung | |
| DE2057126C3 (de) | Anordnung und Verfahren zur Kontaktierung von Halbleiterbauelementen | |
| DE112022006419T5 (de) | Halbleitervorrichtung und Verfahren zur Produktion der Halbleitervorrichtung | |
| DE1564443C3 (de) | Verfahren zur Herstellung einer Halbleiteranordnung | |
| DE1258235B (de) | Verfahren zur Herstellung einer, die Sperrspannungsfestigkeit erhoehenden Randzonenprofilierung von Siliziumscheiben | |
| DE69100058T2 (de) | Loetverfahren fuer die befestigung eines elementes, wie z.b. eines hybriden schaltkreissubstrats auf einer waermeableitenden unterlage. | |
| DE2118431A1 (de) | Kontakt für Halbleiterbauteile |