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CN101136160B - 影像显示系统与影像显示驱动方法 - Google Patents

影像显示系统与影像显示驱动方法 Download PDF

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Abstract

本发明提供一影像显示系统的一实施例，包括一像素阵列、一第一栅极驱动器以及一第二栅极驱动器。该第一栅极驱动器，设置于该像素阵列的一第一边，包括一第一位移寄存器以及一第一与门。该第一位移寄存器，接收一第一时钟信号与一启动信号，用以产生一第一控制信号。该第一与门，接收一第二时钟信号与该第一控制信号，用以产生一第一栅极信号。该第二栅极驱动器，设置于该像素阵列的一第二边，其中该第二边相对于该第一边，包括一第二位移寄存器以及一第二与门。该第二位移寄存器，接收该第一栅极信号与该第二时钟信号，用以产生一第二控制信号。该第二与门，接收该第一时钟信号与该第二控制信号，用以产生一第二栅极信号。

Description

影像显示系统与影像显示驱动方法 
技术领域
本发明涉及一种栅极驱动器，特别是涉及显示面板上的一种双边栅极驱动器。 
背景技术
图1为一个现有显示面板的示意图。在图1中，像素阵列12与用以驱动像素阵列12的栅极驱动器11被设置在基板10之上。栅极驱动器11具有多个栅极驱动单元，如栅极驱动单元13，而且每一个栅极驱动单元用以驱动像素阵列12上一对应的栅极线。在现有显示面板上，栅极驱动器11只会被设置在像素阵列12的一边，因此如果像素阵列12是具有高分辨率的像素阵列，则会使得栅极驱动器11的布局面积增加。举例来说，如果栅极驱动单元13所需要的布局区域的面积是XY(也就是布局区域的宽度为X，布局区域的长度为Y)，而且当栅极线的数目增加一倍的时候，所需的栅极驱动单元数目也会增加一倍，这也使得栅极驱动器11所需的布局区域会增加，而这有可能使得所需的基板10面积变大，或是会减少了像素阵列12的可布局的面积。 
发明内容
本发明提供了多个影像显示系统。 
本发明提供一影像显示系统的一实施例，包括一像素阵列、一第一栅极驱动器以及一第二栅极驱动器。该第一栅极驱动器，设置于该像素阵列的一第一边，包括一第一位移寄存器以及一第一与门。该第一位移寄存器，接收一第一时钟信号与一启动信号，用以产生一第一控制信号。该第一与门，接收一第二时钟信号与该第一控制信号，用以产生一第一栅极信号。该第二栅极驱动器，设置于该像素阵列的一第二边，其中该第二边相对于该第一边，包括一第二位移寄存器以及一第二与门。该第二位移寄存器，接收该第一栅极信号与该第二时钟信号，用以产生一第二控制信号。该第二与门，接收该 第一时钟信号与该第二控制信号，用以产生一第二栅极信号。 
本发明还提供一种影像显示驱动方法的一实施例，适用于一像素阵列，其中该像素阵列包含了一第一栅极驱动器，设置于该像素阵列的一第一边，以及一第二栅极驱动器，设置于该像素阵列相对于该第一边的一第二边，该驱动方法包括：输入一启动信号至该第一栅极驱动器；当该启动信号与一第一时钟信号为逻辑高电平时，产生一第一致能信号；当该第一致能信号与一第二时钟信号为逻辑高电平时，产生并传送一第一驱动信号至该第二栅极驱动器，用以产生一第二致能信号；以及当该第二致能信号与该第一时钟信号为逻辑高电平时，产生一第二驱动信号。 
附图说明
图1为一个现有显示面板的示意图。 
图2为根据本发明的一显示面板的一实施例的示意图。 
图3为根据本发明的一显示面板的另一实施例的示意图。 
图4为图3的显示面板的实施例的驱动时序图。 
图5为图3中的第一位移寄存器的一实施例的电路示意图。 
图6为图5的位移寄存器的实施例的的时序图。 
图7为根据本发明之一影像显示系统的一实施例的示意图。 
附图符号说明 
10～基板 
11～栅极驱动器 
12、21～像素阵列 
20～显示面板 
22～第二栅极驱动器 
23～第一栅极驱动器 
13、24～驱动单元 
31～第一位移寄存器 
32～与门 
33～电位转换器 
34～电位转换器 
35与门 
36～第二位移寄存器 
37～第一栅极驱动单元 
38～第二栅极驱动单元 
51～时钟反相器 
52～反相器 
53～时钟反相器 
70～电子装置 
71～显示面板 
72～输入装置 
具体实施方式
图2为根据本发明的一显示面板的一实施例的示意图。显示面板20包括一第一栅极驱动器23、一第二栅极驱动器22以及一像素阵列21。该第一栅极驱动器23被配置在像素阵列21的一第一边，且该第二栅极驱动器22被布局在像素阵列21相对于该第一边的一第二边。该第一栅极驱动器23与该第二栅极驱动器22根据一时钟控制器(图中未绘出)输出的多个控制信号，用以循序地驱动像素阵列21上的每一条栅极线(图中未绘出)。该第一栅极驱动器23与该第二栅极驱动器22包括多个驱动单元，如驱动单元24。因为栅极驱动器被分成两个栅极驱动器，第一栅极驱动器23与第二栅极驱动器22，因此每一个驱动单元的布局区域的宽度可以减少为X/2，每一个驱动单元的布局区域的长度则变为2Y，如此一来每一个驱动单元的布局面积与图1中的栅极驱动单元13的面积一样。但利用如图2这样的布局方式，可使得显示面板得到一较佳的显示效果。 
图3为根据本发明的一显示面板的另一实施例的示意图。显示面板包括一像素阵列30、一第一栅极驱动器以及一第二栅极驱动器。该第一栅极驱动器与该第二栅极驱动器包括多个驱动单元，如驱动单元37与38。在本实施例中，第一栅极驱动单元37包括一第一位移寄存器31、一与门32以及一电位转换器33，而第二栅极驱动单元38包括一第二位移寄存器36、一与门35以及一电位转换器34。第一位移寄存器、第三位移寄存器以及第五位移寄存器被配置在像素阵列30的一第一边，而第二栅极驱动器中的第二位移寄存 器、第四位移寄存器以及第六位移寄存器被布局在像素阵列30相对于该第一边的一第二边。第一位移寄存器31接收一启动信号STV、一第一时钟信号CLKL以及一反相第一时钟信号XCLKL，且当启动信号STV与第一时钟信号CLKL位于逻辑高电平时，输出一第一控制信号SR1。与门32接收一第二时钟信号CLKR与该第一控制信号SR1，并于该第二时钟信号CLKR与该第一控制信号SR1位于逻辑高电平时，输出一驱动信号。电位转换器33接收该驱动信号并增强该驱动信号的驱动能力，如增加驱动信号的驱动电流，用以输出栅极信号G1。接着，栅极信号G1通过对应的栅极线被传送到第二栅极驱动单元38。当第二位移寄存器36接收栅极信号G1，且第二时钟信号CLKR位于逻辑高电平时，第二位移寄存器36输出的控制信号SR2亦位于逻辑高电平。接着，当第一时钟信号CLKL位于逻辑高电平时，栅极信号G1亦位于逻辑高电平。根据上述的运作机制，每一个位移寄存器都可以被前一级的位移寄存器输出的栅极信号所致能，其中若该位移寄存器为第一位移寄存器，则该第一位移寄存器则必须由一启动信号所致能，如启动信号STV。 
为了进一步的说明图3的实施例的运作方式，请参考图4。图4为图3的显示面板的实施例的驱动时序图。在时间T1，启动信号STV与第一时钟信号CLKL位于逻辑高电平，因此第一控制信号SR1亦位于逻辑高电平。在时间T2，第一时钟信号CLKL位于逻辑低电平，但第一控制信号SR1因为被锁存(latch)在第一位移寄存器，所以仍位于逻辑高电平。在时间T3，第二时钟信号CLKR与第一控制信号SR1皆位于逻辑高电平，且输入与门32，因此由与门32输出的栅极信号G1亦位于逻辑高电平。此时，因为接收到的栅极信号G1与第二时钟信号CLKR皆位于逻辑高电平，所以由第二位移寄存器36产生的第二控制信号SR2亦位于逻辑高电平。在时间T4，第二时钟信号CLKR变成逻辑低电平，因此栅极信号G1亦变成逻辑低电平，但是第二控制信号SR2仍位于逻辑高电平。在时间T5，启动信号STV与第二时钟信号CLKR位于逻辑低电平，且因为第一时钟信号CLKL与第二控制信号SR2仍位于逻辑高电平，所以栅极信号G2仍位于逻辑高电平。上述说明仅以第一位移寄存器31与第二位移寄存器36为例说明，至于第二位移寄存器、第三位移寄存器、第四位移寄存器、第五位移寄存器以及第六位移寄存器的运作与第一位移寄存器31与第二位移寄存器36的运作相同。 
在图4中，注意到第一时钟信号CLKL与第二时钟信号CLKR是没有重迭的，换句话说，两个时钟的上升或下降边缘是位于不同的时间点。为了避免第一时钟信号CLKL与第二时钟信号CLKR重迭，第一时钟信号CLKL与该第二时钟信号CLKR是由一非重迭式时钟信号产生器所产生。另外一个产生第一时钟信号与第二时钟信号的方法则包括下列步骤：产生该第一时钟信号，其中该第一时钟信号的工作周期小于50％；藉由对第一时钟信号做一相位延迟，用以产生第二时钟信号。再者，另一个产生两个非重迭(non-overlap)信号的方法则包括下列步骤：产生该第一时钟信号；产生一反相的第一时钟信号；调整第一时钟信号与反相的第一时钟信号的工作周期，使得两个信号为非重迭的信号。 
图5为图3中的第一位移寄存器的一实施例的电路示意图。组件51与53为时钟反相器，其中时钟反相器51只有在接收到的时钟信号为逻辑高电平时才会运作，而时钟反相器53只有在接收到的时钟信号为逻辑低电平时才会运作。时钟反相器51受控于第一时钟信号CLKL，具有一输入端以及一输出端，其中该输入端用以接收启动信号STV，该输出端耦接至端点N1。反相器52受具有一输入端以及一输出端，其中该输入端耦接至端点N1，该输出端耦接至端点N2。时钟反相器53受控于反相第一时钟信号XCLKL，具有一输入端以及一输出端，其中该输入端耦接至端点N2，该输出端耦接至端点N1。 
为了更清楚说明图5的位移寄存器的实施例的运作，请参考图6。图6为图5的位移寄存器的实施例的时序图。在图6中，时钟信号CLK表示第一时钟信号CLKL，时钟信号XCLK表示反相第一时钟信号XCLKL。在时间T1，时钟信号CLK位于逻辑高电平，因此时钟反相器51就被致能，而且，同一时间启动信号STV亦位于逻辑高电平，因此在端点N1读取到的信号为逻辑低电平，端点N2读取到的信号为逻辑高电平。在时间T2，时钟信号CLK位于逻辑低电平，因此时钟反相器51就被关闭，同一时间因为时钟信号XCLK为逻辑高电平，所以时钟反相器53被致能。因为时钟反相器51被关闭，所以第一控制信号SR1会被锁存在由时钟反相器53与反相器52形成的回路之中。在时间T3中，时钟反相器51因为时钟信号CLK位于逻辑高电平而被致能，且启动信号STV位于逻辑低电平，因此可以在端点N1读取逻辑高电平的信号，且第一控制信号SR1为逻辑低电平。 
图7为根据本发明的一影像显示系统的一实施例的示意图。在本实施例中，影像显示系统可能由显示面板71或一电子装置70所实现。电子装置70包含了一输入装置72与一显示面板71(如图2所示的显示面板20)。输入装置72用以提供显示面板71输入信号，使得显示面板71显示对应的影像。在一较佳实施例中，电子装置70可能为一移动电话、数字相机、个人数字助理、笔记型计算机、桌上型计算机、电视、车用显示器或是可携式DVD播放器。 
虽然本发明已以具体实施例披露如上，然其仅为了易于说明本发明的技术内容，而并非将本发明狭义地限定于该实施例，本领域的技术人员在不脱离本发明的精神和范围的前提下可作若干的更动与润饰，因此本发明的保护范围以本发明的权利要求为准。 

Claims (15)

1.一种影像显示系统，包括：
一像素阵列；
一第一栅极驱动器，设置于该像素阵列的一第一边，包括：
一第一位移寄存器，接收一第一时钟信号与一启动信号，用以产生一第一控制信号；以及
一第一与门，接收一第二时钟信号与该第一控制信号，用以产生一第一栅极信号；以及
一第二栅极驱动器，设置于该像素阵列的一第二边，其中该第二边相对于该第一边，包括：
一第二位移寄存器，接收该第一栅极信号与该第二时钟信号，用以产生一第二控制信号；以及
一第二与门，接收该第一时钟信号与该第二控制信号，用以产生一第二栅极信号。
2.如权利要求1所述的影像显示系统，其中该第一时钟信号的一工作周期小于50％。
3.如权利要求1所述的影像显示系统，其中该第二时钟信号的一工作周期小于50％。
4.如权利要求1所述的影像显示系统，其中该第一时钟信号为该第二时钟信号的一非重迭式时钟信号。
5.如权利要求1所述的影像显示系统，其中该第一时钟信号与该第二时钟信号是由一非重迭式时钟信号产生器所产生。
6.如权利要求1所述的影像显示系统，其中该第一位移寄存器包括：
一第一时钟反相器，具有一输入端，用以接收该启动信号以及一输出端，其中当第一时钟信号为逻辑高电平时，该第一时钟反相器被致能；
一第一反相器，具有一输入端与一输出端，其中该第一反相器的输入端耦接该第一时钟反相器的输出端，该第一反相器的输出端输出该第一控制信号；以及
一第二时钟反相器，具有一输入端与一输出端，其中该第二时钟反相器的输入端耦接该第一反相器的输出端，该第二时钟反相器的输出端耦接该第一时钟反相器的输出端。
7.如权利要求1所述的影像显示系统，其中该第一栅极驱动器与该第二栅极驱动器皆具有多个驱动单元。
8.如权利要求1所述的影像显示系统，还包括一显示面板，其中该像素阵列、该第一栅极驱动器与该第二栅极驱动器形成在该显示面板上的一部分。
9.如权利要求8所述的影像显示系统，还包括一电子装置，其中该电子装置包括：
该显示面板；以及
一输入装置，耦接该显示面板，用以提供输入信号至该显示面板以显示影像。
10.如权利要求9所述的影像显示系统，其中该电子装置为一移动电话、数字相机、个人数字助理、笔记型计算机、桌上型计算机、电视、车用显示器或是可携式DVD播放器。
11.一种影像显示驱动方法，适用于一像素阵列，其中该像素阵列包含一第一栅极驱动器，设置于该像素阵列的一第一边，以及一第二栅极驱动器，设置于该像素阵列相对于该第一边的一第二边，该方法包括：
输入一启动信号至该第一栅极驱动器；
当该启动信号与一第一时钟信号为逻辑高电平时，产生一第一致能信号；
当该第一致能信号与一第二时钟信号为逻辑高电平时，产生并传送一第一驱动信号至该第二栅极驱动器，用以产生一第二致能信号；以及
当该第二致能信号与该第一时钟信号为逻辑高电平时，产生一第二驱动信号。
12.如权利要求11所述的影像显示驱动方法，其中该第一时钟信号的一工作周期小于50％。
13.如权利要求11所述的影像显示驱动方法，其中该第二时钟信号的一工作周期小于50％。
14.如权利要求11所述的影像显示驱动方法，其中该第一时钟信号为该第二时钟信号的一非重迭式时钟信号。
15.如权利要求11所述的影像显示驱动方法，其中该第一时钟信号与该第二时钟信号是由一非重迭式时钟信号产生器所产生。
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