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WO2018134922A1 - 準同型演算装置、暗号システム及び準同型演算プログラム - Google Patents

準同型演算装置、暗号システム及び準同型演算プログラム Download PDF

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WO2018134922A1
WO2018134922A1 PCT/JP2017/001589 JP2017001589W WO2018134922A1 WO 2018134922 A1 WO2018134922 A1 WO 2018134922A1 JP 2017001589 W JP2017001589 W JP 2017001589W WO 2018134922 A1 WO2018134922 A1 WO 2018134922A1
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WO
WIPO (PCT)
Prior art keywords
ciphertext
encryption
homomorphic
unit
policy
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Ceased
Application number
PCT/JP2017/001589
Other languages
English (en)
French (fr)
Inventor
良 廣政
豊 川合
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to CN201780082960.9A priority Critical patent/CN110169010B/zh
Priority to US16/467,442 priority patent/US11139952B2/en
Priority to JP2018562789A priority patent/JP6522263B2/ja
Priority to PCT/JP2017/001589 priority patent/WO2018134922A1/ja
Publication of WO2018134922A1 publication Critical patent/WO2018134922A1/ja
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Ceased legal-status Critical Current

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    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L9/00Cryptographic mechanisms or cryptographic arrangements for secret or secure communications; Network security protocols
    • H04L9/008Cryptographic mechanisms or cryptographic arrangements for secret or secure communications; Network security protocols involving homomorphic encryption
    • GPHYSICS
    • G09EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09CCIPHERING OR DECIPHERING APPARATUS FOR CRYPTOGRAPHIC OR OTHER PURPOSES INVOLVING THE NEED FOR SECRECY
    • G09C1/00Apparatus or methods whereby a given sequence of signs, e.g. an intelligible text, is transformed into an unintelligible sequence of signs by transposing the signs or groups of signs or by replacing them by others according to a predetermined system
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L9/00Cryptographic mechanisms or cryptographic arrangements for secret or secure communications; Network security protocols
    • H04L9/08Key distribution or management, e.g. generation, sharing or updating, of cryptographic keys or passwords
    • H04L9/0861Generation of secret information including derivation or calculation of cryptographic keys or passwords
    • H04L9/0869Generation of secret information including derivation or calculation of cryptographic keys or passwords involving random numbers or seeds

Definitions

  • This invention relates to a technique for computing data with encryption.
  • Homomorphic encryption is an encryption technology that can operate with data encrypted. Recently, the use of cloud services is spreading, but due to concerns about cracking and cloud reliability, it is possible to store data after encrypting it in the cloud. Homomorphic encryption is a technology that enables the use of a cloud service without sacrificing security because it can perform operations on encrypted data without decrypting it.
  • Attribute-based homomorphic encryption is an encryption technique that allows a decryptor to be controlled flexibly according to specified conditions in order to improve the convenience of homomorphic encryption.
  • the ciphertext is associated with a certain attribute and with a decryption permission condition with a decryption key, and only when the ciphertext is decrypted with a key that satisfies the decryption permission condition, You can get the correct plaintext.
  • Non-Patent Document 1 describes the first method of attribute-based homomorphic encryption. In the method described in Non-Patent Document 1, there is a problem that a homomorphic operation can be performed only between ciphertexts having the same attribute.
  • Non-Patent Document 2 describes a method of attribute-based homomorphic encryption that solves the problem of Non-Patent Document 1.
  • Non-Patent Document 2 shows configurations of two cryptographic techniques called single target attribute-based homomorphic encryption and multiple target attribute-based homomorphic encryption.
  • the single target attribute-based homomorphic encryption is an encryption method that can perform a homomorphic operation with respect to a certain decryption permission condition as long as ciphertexts related to the attribute satisfying the condition.
  • the multi-target attribute-based homomorphic encryption is an encryption method that can perform homomorphic operation as long as ciphertexts relating to attributes satisfying any one condition with respect to a plurality of decryption permission conditions.
  • the ciphertext Y obtained by performing a homomorphic operation on the ciphertext X to be operated can decrypt the ciphertext X to be operated.
  • the decryption permission condition of the ciphertext Z is a set of decryption permission conditions associated with the ciphertext Y. Unless it is included in, homomorphic operations cannot be performed.
  • An object of the present invention is to enable flexible homomorphic operations.
  • the homomorphic arithmetic device is: An encryption element C plaintext ⁇ is set, the encryption element C x attribute x is set, the plaintext ⁇ is set, the attribute x is not decoded by the decryption key sk f corresponding to the policy f satisfying cryptographic element F
  • a ciphertext acquisition unit that acquires a ciphertext ct including: A policy acquisition unit that acquires a policy set F that is a set of policies;
  • the cipher element C included in the ciphertext ct acquired by the ciphertext acquisition unit can be decrypted by the cipher element F by the decryption key sk F corresponding to the policy set F acquired by the policy acquisition unit by converting the cryptographic elements C-in such a ciphertext conversion unit for converting the ciphertext ct to ⁇ ciphertext ct,
  • a homomorphism arithmetic unit for generating a homomorphic operation g was carried out cip
  • FIG. 1 is a configuration diagram of a cryptographic system 10 according to a first embodiment.
  • 1 is a configuration diagram of a key generation device 20 according to Embodiment 1.
  • FIG. 1 is a configuration diagram of an encryption device 30 according to Embodiment 1.
  • FIG. 1 is a configuration diagram of a homomorphic arithmetic device 40 according to Embodiment 1.
  • FIG. 1 is a configuration diagram of a decoding device 50 according to Embodiment 1.
  • FIG. 5 is a flowchart of Setup processing according to the first embodiment. 4 is a flowchart of KeyGen processing according to the first embodiment. 6 is a flowchart of Enc processing according to the first embodiment. 5 is a flowchart of Eval processing according to the first embodiment.
  • FIG. 4 is a flowchart of Dec processing according to the first embodiment.
  • the block diagram of the key generation apparatus 20 which concerns on the modification 1.
  • FIG. The block diagram of the encryption apparatus 30 which concerns on the modification 1.
  • FIG. The block diagram of the homomorphic arithmetic unit 40 which concerns on the modification 1.
  • FIG. The block diagram of the decoding apparatus 50 which concerns on the modification 1.
  • Embodiment 1 FIG. *** Explanation of configuration *** With reference to FIG. 1, the structure of the encryption system 10 which concerns on Embodiment 1 is demonstrated.
  • the encryption system 10 includes a key generation device 20, an encryption device 30, a homomorphic operation device 40, and a decryption device 50.
  • the key generation device 20, the encryption device 30, the homomorphic operation device 40, and the decryption device 50 are connected via a network 60.
  • the network 60 is the Internet as a specific example.
  • the network 60 may be another type of network such as a LAN (Local Area Network).
  • the key generation device 20 is a computer.
  • the key generation device 20 includes hardware including a processor 21, a memory 22, a storage 23, and a communication interface 24.
  • the processor 21 is connected to other hardware via a signal line, and controls these other hardware.
  • the key generation device 20 includes an acquisition unit 211, a master key generation unit 212, a decryption key generation unit 213, and an output unit 214 as functional components.
  • the functions of the acquisition unit 211, the master key generation unit 212, the decryption key generation unit 213, and the output unit 214 are realized by software.
  • the storage 23 stores programs that realize the functions of the acquisition unit 211, the master key generation unit 212, the decryption key generation unit 213, and the output unit 214. This program is read into the memory 22 by the processor 21 and executed by the processor 21. Thereby, the functions of the acquisition unit 211, the master key generation unit 212, the decryption key generation unit 213, and the output unit 214 are realized.
  • the storage 23 implements the function of the master key storage unit 231.
  • the encryption device 30 is a computer.
  • the encryption device 30 includes hardware including a processor 31, a memory 32, a storage 33, and a communication interface 34.
  • the processor 31 is connected to other hardware via a signal line, and controls these other hardware.
  • the encryption device 30 includes an acquisition unit 311, an encryption unit 312, and an output unit 313 as functional components.
  • the functions of the acquisition unit 311, the encryption unit 312, and the output unit 313 are realized by software.
  • the storage 33 stores programs that realize the functions of the acquisition unit 311, the encryption unit 312, and the output unit 313. This program is read into the memory 32 by the processor 31 and executed by the processor 31. As a result, the functions of the acquisition unit 311, the encryption unit 312, and the output unit 313 are realized.
  • the storage 33 implements the function of the public parameter storage unit 331.
  • the homomorphic arithmetic device 40 is a computer.
  • the homomorphic arithmetic device 40 includes hardware including a processor 41, a memory 42, a storage 43, and a communication interface 44.
  • the processor 41 is connected to other hardware via a signal line, and controls these other hardware.
  • the homomorphic operation device 40 includes an acquisition unit 411, a ciphertext conversion unit 412, a homomorphic operation unit 413, and an output unit 414 as functional components.
  • the acquisition unit 411 includes a public parameter acquisition unit 415, a ciphertext acquisition unit 416, a policy acquisition unit 417, and a calculation acquisition unit 418.
  • the acquisition unit 411, the ciphertext conversion unit 412, the homomorphic calculation unit 413, the output unit 414, the public parameter acquisition unit 415, the ciphertext acquisition unit 416, the policy acquisition unit 417, and the calculation acquisition unit 418 The function is realized by software.
  • the storage 43 includes an acquisition unit 411, a ciphertext conversion unit 412, a homomorphic calculation unit 413, an output unit 414, a public parameter acquisition unit 415, a ciphertext acquisition unit 416, a policy acquisition unit 417, A program for realizing the function with the acquisition unit 418 is stored. This program is read into the memory 42 by the processor 41 and executed by the processor 41. Thus, the acquisition unit 411, the ciphertext conversion unit 412, the homomorphic calculation unit 413, the output unit 414, the public parameter acquisition unit 415, the ciphertext acquisition unit 416, the policy acquisition unit 417, and the calculation acquisition unit The function with 418 is realized. Further, the storage 43 realizes the functions of the public parameter storage unit 431 and the ciphertext storage unit 432.
  • the decoding device 50 is a computer.
  • the decoding device 50 includes hardware of a processor 51, a memory 52, a storage 53, and a communication interface 54.
  • the processor 51 is connected to other hardware via a signal line, and controls these other hardware.
  • the decoding device 50 includes an acquisition unit 511, a decoding unit 512, and an output unit 513 as functional components.
  • the functions of the acquisition unit 511, the decoding unit 512, and the output unit 513 are realized by software.
  • the storage 53 stores programs that realize the functions of the acquisition unit 511, the decoding unit 512, and the output unit 513. This program is read into the memory 52 by the processor 51 and executed by the processor 51. Thereby, the function of the acquisition part 511, the decoding part 512, and the output part 513 is implement
  • the storage 53 realizes functions of a key storage unit 531, a condition storage unit 532, and a result storage unit 533.
  • the processors 21, 31, 41, 51 are ICs (Integrated Circuits) that perform arithmetic processing. Specific examples of the processors 21, 31, 41, 51 are a CPU (Central Processing Unit), a DSP (Digital Signal Processor), and a GPU (Graphics Processing Unit).
  • CPU Central Processing Unit
  • DSP Digital Signal Processor
  • GPU Graphics Processing Unit
  • the memories 22, 32, 42, and 52 are storage devices that temporarily store data.
  • the memories 22, 32, 42, and 52 are SRAM (Static Random Access Memory) and DRAM (Dynamic Random Access Memory) as specific examples.
  • the storages 23, 33, 43, and 53 are storage devices that store data.
  • the storages 23, 33, 43, and 53 are HDDs (Hard Disk Drives) as a specific example.
  • the storages 23, 33, 43, and 53 are SD (registered trademark, Secure Digital) memory card, CF (Compact Flash), NAND flash, flexible disk, optical disk, compact disk, Blu-ray (registered trademark) disk, DVD (Digital Versatile). It may be a portable storage medium such as (Disk).
  • the communication interfaces 24, 34, 44, and 54 are interfaces for communicating with external devices.
  • the communication interfaces 24, 34, 44, and 54 are Ethernet (registered trademark), USB (Universal Serial Bus), and HDMI (registered trademark, High-Definition Multimedia Interface) ports.
  • the key generation device 20 may include a plurality of processors that replace the processor 21.
  • the encryption device 30 includes a plurality of processors that replace the processor 31, the homomorphic arithmetic device 40 includes a plurality of processors that replace the processor 41, and the decryption device 50 includes a plurality of processors that replace the processor 51.
  • a processor may be provided.
  • the plurality of processors share the execution of a program that realizes the function of each functional component.
  • Each processor is an IC that performs arithmetic processing in the same manner as the processors 21, 31, 41, and 51.
  • the operation of the cryptographic system 10 according to the first embodiment corresponds to the cryptographic method according to the first embodiment. Also, this corresponds to the encryption program processing according to the first embodiment.
  • the operation of the cryptographic system 10 is divided into a Setup process, a KeyGen process, an Enc process, an Eval process, and a Dec process.
  • Non-Patent Document 2 parts different from the contents described in Non-Patent Document 2 will be mainly described, and the same parts as the contents described in Non-Patent Document 2 are already known contents, and thus a part of the description is omitted. To do.
  • n, q, and ⁇ are parameters in the LWE (Learning With Errors) problem.
  • the LWE problem is a known problem.
  • Equation 12 m, N, M.M. g T is as shown in Equation 12.
  • y shown in Equation 13 is a vector that satisfies Equation 14.
  • I n is the unit matrix of n rows and n columns
  • a 0 n ⁇ m is a matrix of n rows and m columns of all elements 0.
  • F ⁇ ⁇ 0,1 ⁇ L ⁇ ⁇ 0,1 ⁇ is a policy class that can be calculated by a Boolean circuit having a depth d F.
  • G ⁇ ⁇ 0,1 ⁇ * ⁇ ⁇ 0,1 ⁇ is the class of operations that can be calculated by the Boolean circuit of depth d G.
  • the setup process is mainly executed by the key generation apparatus 20 when the cryptographic system 10 is initially set.
  • the setup process according to the first embodiment corresponds to the master key generation method and the process of the master key generation program according to the first embodiment.
  • Step S11 Acquisition process
  • the acquisition unit 211 of the key generation apparatus 20 acquires parameters ⁇ , L, d F , and d G. Specifically, the acquisition unit 211 receives parameters ⁇ , L, d F and d G input by the administrator of the cryptographic system 10 or the like via the communication interface 24. The acquisition unit 211 writes the accepted parameters ⁇ , L, d F , and d G into the memory 22.
  • Step S12 Master key generation process
  • the master key generation unit 212 of the key generation device 20 generates a pair of the public parameter pp and the master secret key msk. Specifically, as shown in Equation 15, the master key generation unit 212 generates a pair (A, A ⁇ 0 ⁇ 1 ) of the matrix A and the trap door A ⁇ 0 ⁇ 1 .
  • the TrapGen algorithm is described in Non-Patent Document 2.
  • the matrix A is a matrix shown in Equation 16
  • the trapdoor A ⁇ 0 ⁇ 1 is an algorithm shown in Equation 17.
  • the master key generation unit 212 has matrices B, B 0 , B 1 ,. . . , B L and define B ⁇ x .
  • the master key generation unit 212 generates a vector v and a seed ⁇ of a PRF (PseudoRandom Function) as shown in Equation 19. PRF.
  • PRF Physical Random Function
  • the master key generation unit 212 sets (A, B 0 , B ⁇ x , B, v) as the public parameter pp and (A ⁇ 0 ⁇ 1 , ⁇ ) as the master secret key msk.
  • the master key generation unit 212 writes the public parameter pp to the memory 22 and writes the public parameter pp and the master secret key msk to the master key storage unit 231.
  • Step S13 Output processing
  • the output unit 214 of the key generation device 20 outputs the public parameter pp. Specifically, the output unit 214 reads the public parameter pp from the memory 22. Then, the output unit 214 transmits the public parameter pp to the encryption device 30, the homomorphic operation device 40, and the decryption device 50 via the communication interface 24.
  • Step S14 Public parameter acquisition process
  • the acquisition unit 311 of the encryption device 30, the public parameter acquisition unit 415 of the homomorphic calculation device 40, and the acquisition unit 511 of the decryption device 50 acquire the public parameter pp.
  • the acquisition unit 311 receives the public parameter pp transmitted by the output unit 214 via the communication interface 34.
  • the acquisition unit 311 writes the received public parameter pp in the public parameter storage unit 331.
  • the public parameter acquisition unit 415 of the homomorphic arithmetic device 40 receives the public parameter pp transmitted by the output unit 214 via the communication interface 44.
  • the public parameter acquisition unit 415 writes the received public parameter pp into the public parameter storage unit 431.
  • the acquisition unit 511 of the decryption device 50 receives the public parameter pp transmitted by the output unit 214 via the communication interface 54.
  • the acquisition unit 511 writes the received public parameter pp in the key storage unit 531.
  • the key generation device 20 executes the Setup algorithm shown in Equation 20 to generate the public parameter pp and the master secret key msk.
  • the KeyGen process is mainly executed by the key generation apparatus 20 when generating a new decryption key sk f .
  • the KeyGen process according to the first embodiment corresponds to the decryption key generation method and the process of the decryption key generation program according to the first embodiment.
  • Step S21 Decryption key request process
  • the acquisition unit 511 of the decryption device 50 requests the key generation device 20 to generate the decryption key sk f .
  • the acquisition unit 511 receives a policy f indicating a decryption permission condition input by a user of the decryption device 50 or the like.
  • the policy f for example, user attributes are set.
  • the acquisition unit 511 transmits the input policy f to the key generation device 20 and requests generation of the decryption key sk f associated with the policy f.
  • the acquisition unit 511 writes the policy f transmitted when the generation of the decryption key sk f is requested to the condition storage unit 532.
  • Step S22 Acquisition process
  • the acquisition unit 211 of the key generation device 20 acquires the policy f. Specifically, the acquisition unit 211 receives the policy f transmitted from the decryption device 50 via the communication interface 24. The acquisition unit 211 writes the received policy f in the memory 22.
  • Step S23 Decryption key generation process
  • the decryption key generation unit 213 of the key generation device 20 generates a decryption key sk f associated with the policy f. Specifically, the decryption key generation unit 213 reads the policy f from the memory 22 and reads the public parameter pp and the master secret key msk from the master key storage unit 231. The decryption key generation unit 213 calculates the matrix B f as shown in Equation 21.
  • the Eval algorithm is described in Non-Patent Document 2.
  • the decryption key generation unit 213 generates a matrix r f as shown in Equation 22.
  • is as shown in Equation 23.
  • Expression 24 is established.
  • the decryption key generation unit 213 writes the matrix r f in the memory 22 as the decryption key sk f .
  • Step S24 Output processing
  • the output unit 214 of the key generation device 20 outputs the decryption key sk f . Specifically, the output unit 214 reads the decryption key sk f from the memory 22. Then, the output unit 214 transmits the decryption key sk f to the decryption device 50 via the communication interface 24.
  • Step S25 Decryption key acquisition process
  • the acquisition unit 511 of the decryption device 50 acquires the decryption key sk f . Specifically, the acquisition unit 511 receives the decryption key sk f transmitted by the output unit 214 via the communication interface 54. The acquisition unit 511 writes the received decryption key sk f in the key storage unit 531.
  • the key generation device 20 executes the KeyGen algorithm expressed by Equation 25 to generate the decryption key sk f .
  • the Enc process according to the first embodiment will be described.
  • the Enc process is mainly executed by the encryption device 30 when generating the ciphertext ct.
  • the Enc process according to the first embodiment corresponds to the encryption method and the encryption program process according to the first embodiment.
  • Step S31 Acquisition process
  • the acquisition unit 311 of the encryption device 30 acquires the plaintext ⁇ and the attribute x. Specifically, the acquisition unit 311 receives the plaintext ⁇ and the attribute x input by the user of the encryption device 30 or the like via the communication interface 34.
  • Plaintext ⁇ is a message to be transmitted after being encrypted, and plaintext ⁇ ⁇ 0, 1 ⁇ .
  • the attribute x is an attribute associated with the ciphertext, and attribute x ⁇ ⁇ 0, 1 ⁇ L.
  • the acquisition unit 311 writes the plaintext ⁇ and the attribute x in the memory 32.
  • Step S32 Encryption processing
  • the encryption unit 312 of the encryption device 30 sets the attribute x and generates a ciphertext ct obtained by encrypting the plaintext ⁇ . Specifically, the encryption unit 312 reads the public parameter pp from the public parameter storage unit 331 and reads the plaintext ⁇ and the attribute x from the memory 32. Encryption unit 312, as shown in Expression 26, generates the a matrix S matrix E A and the error vector e v.
  • the encryption unit 312 performs i ⁇ ⁇ 0, 1,. . . , L ⁇ and matrix R i, j are generated for each integer i of j ⁇ [M]. As shown in Equation 28, the encryption unit 312 performs i ⁇ ⁇ 0, 1,. . . , L ⁇ and a matrix E i [j] are generated for each integer i of j ⁇ [M].
  • E i [j] and E A [j] indicates the j-th column of each matrix E i and a matrix E A.
  • the encryption unit 312 generates a matrix C as shown in Equation 29, and generates a matrix C x as shown in Equation 30.
  • a plaintext ⁇ is set in the matrix C, and the matrix C can be decrypted by the decryption key sk f corresponding to the policy f satisfied by the attribute x.
  • Equation 31 represents a tensor product.
  • it is Formula 32.
  • the encryption unit 312 generates a matrix F as shown in Equation 34.
  • a plaintext ⁇ and a matrix R that is a random number are set in the matrix F.
  • the matrix F includes the matrix B instead of the matrix B 0 included in the matrix, and is configured not to be decrypted by the decryption key sk f corresponding to the policy f satisfied by the attribute x.
  • the encryption unit 312 performs i ⁇ ⁇ 0, 1,. . . , L ⁇ , for each integer j for j ⁇ [M], and for each integer k for k ⁇ [N], a matrix E (k) A , a vector e (k) v, and a matrix R (K) i and j are generated.
  • the encryption unit 312 generates a vector E (k) i and a matrix E (k) as shown in Expression 36.
  • E (k) i [j] and matrix E (k) A [j] indicate the j-th column of matrix E (k) i and matrix E (k) A , respectively.
  • the encryption unit 312 performs the matrix S (1) ,.
  • the encryption unit 312 generates a matrix D as shown in Equation 38, and generates a matrix D (k) x as shown in Equation 39. That is, the matrix D is an encrypted matrix R that is a random number included in the matrix F.
  • the encryption unit 312 uses the attribute x, the matrix C, the matrix C x , the matrix F, the matrix D, and the matrix D (k) x for each integer k of k ⁇ [N] as encryption elements.
  • the ciphertext ct is written into the memory 32.
  • the ciphertext ct the matrix C is an encryption element plaintext ⁇ is set, the matrix C x is an encryption element attribute x is set, the matrix R is plaintext ⁇ and the random number are set,
  • a matrix F that is an encryption element that is not decrypted by the decryption key sk f corresponding to the policy f that the attribute x satisfies, and a matrix D that is an encryption element obtained by encrypting the matrix R that is a random number are included.
  • Step S33 output processing
  • the output unit 313 of the encryption device 30 outputs the ciphertext ct. Specifically, the output unit 313 reads the ciphertext ct from the memory 32. Then, the output unit 313 transmits the ciphertext ct to the homomorphic arithmetic device 40 via the communication interface 34.
  • Step S34 Ciphertext Acquisition Process
  • the ciphertext acquisition unit 416 of the homomorphic arithmetic device 40 receives the ciphertext ct transmitted by the output unit 313 via the communication interface 44.
  • the ciphertext acquisition unit 416 writes the received ciphertext ct into the ciphertext storage unit 432.
  • the encryption device 30 executes the Enc algorithm expressed by Equations 40 to 41 to generate the ciphertext ct.
  • the Eval process is executed by the homomorphic operation device 40 when performing a homomorphic operation on the ciphertext ct.
  • the Eval process according to the first embodiment corresponds to the homomorphic operation method according to the first embodiment and the process of the homomorphic operation program.
  • Step S41 Ciphertext Acquisition Process
  • the ciphertext acquisition unit 416 performs ciphertext ct (1) ,. . . , Ct (k) .
  • k is an integer of 1 or more.
  • the ciphertext acquisition unit 416 receives the ciphertexts ct (1) ,... Designated by the user of the homomorphic operation device 40 via the communication interface 44. . . , Ct (k) is read from the ciphertext storage unit 432.
  • the ciphertext acquisition unit 416 reads the ciphertext ct (1) ,. . . , Ct (k) are written to the memory 42.
  • Step S42 Policy acquisition processing
  • d is an integer of 1 or more.
  • the policy acquisition unit 417 receives the policy set F input by the user of the homomorphic arithmetic device 40 or the like via the communication interface 44.
  • the policy acquisition unit 417 writes the accepted policy set F in the memory 42.
  • i 1,. . . , K for each integer i
  • the ciphertext ct (i) is one of the f 1 ,. . . , F d must be satisfied.
  • Step S43 Calculation acquisition process
  • the operation acquisition unit 418 of the homomorphic operation device 40 acquires a homomorphic operation g to be executed. Specifically, the operation acquisition unit 418 receives a homomorphic operation g input by a user or the like of the homomorphic operation device 40 via the communication interface 44. The operation acquisition unit 418 writes the accepted homomorphic operation g in the memory 42.
  • the Apply algorithm is executed, and the ciphertext ct (i) will be described later. If it is the ciphertext ct * output in step S46, the Apply algorithm is not executed. If the ciphertext ct (i) is the ciphertext ct * output in step S46 described later, only the expansion algorithm is executed.
  • write ciphertext ct (i) is the ciphertext ct of interest, writing the ciphertext ct ⁇ and the ⁇ ciphertext ct (i) is converted ciphertext ct (i) . Further, a policy f j satisfied by the target ciphertext ct (i) is written as policy f.
  • the Apply algorithm will be described.
  • the ciphertext conversion unit 412 calculates the matrix H as shown in Equation 42.
  • the EvRelation algorithm is described in Non-Patent Document 2.
  • the ciphertext conversion unit 412 generates a matrix C ⁇ f as shown in Equation 43.
  • the ciphertext conversion unit 412 generates a matrix D (i) f for each integer i of i ⁇ [k] as shown in Equation 44.
  • the ciphertext conversion unit 412 generates a matrix D f as shown in Equation 45.
  • the ciphertext conversion unit 412 executes the Apply algorithm shown in Equation 46.
  • Ciphertext conversion unit 412 as it is the matrix F ⁇ matrix F.
  • Ciphertext conversion unit 412 as shown in Expression 47, to generate a matrix D ⁇ .
  • the ciphertext conversion unit 412 generates the matrices C 1 to 4 as shown in Equation 48.
  • the matrix X is as shown in Equation 49.
  • the matrix s is as shown in Formula 50.
  • the vector r ′ f ⁇ ⁇ 0, 1 ⁇ N is a vector obtained by querying f for a random oracle. That is, the vector r ′ f is a random vector.
  • B f is as shown in Equation 21.
  • the ciphertext conversion unit 412 executes the expansion algorithm shown in Formula 51.
  • the homomorphic operation unit 413 writes the generated ciphertext ct * into the memory 42.
  • the homomorphic operation unit 413 calculates each cryptographic element as shown in Equation 52.
  • Step S46 Output processing
  • the output unit 414 of the homomorphic operation device 40 outputs the ciphertext ct * . Specifically, the output unit 414 reads the ciphertext ct * from the memory 42. Then, the output unit 414 writes the ciphertext ct * into the ciphertext storage unit 432.
  • the homomorphic operation device 40 executes the evaluation algorithm shown in Formula 53 to generate the ciphertext ct * .
  • the Op algorithm is a homomorphic arithmetic algorithm described in Non-Patent Document 3.
  • the Dec process according to the first embodiment will be described with reference to FIG.
  • the Dec process is mainly executed by the decryption device 50 when decrypting the ciphertext ct.
  • the Dec process according to the first embodiment corresponds to the decoding method and the decoding program process according to the first embodiment.
  • Step S51 Acquisition process
  • the acquisition unit 511 transmits a ciphertext ct (F) acquisition request to the homomorphic arithmetic device 40 via the communication interface 54.
  • the output unit 414 of the homomorphic arithmetic device 40 reads the requested ciphertext ct (F) from the ciphertext storage unit 432. At this time, if the ciphertext ct (F) is the ciphertext ct output in step S33 of FIG.
  • the ciphertext conversion unit 412 of the homomorphic operation device 40 executes the above-described Apply algorithm,
  • the output unit 414 transmits the converted ciphertext ct (F) to the decryption device 50 via the communication interface 44.
  • the acquisition unit 511 receives the ciphertext ct (F) transmitted from the homomorphic arithmetic device 40.
  • the acquisition unit 511 writes the received ciphertext ct (F) in the memory 52.
  • Step S52 Decoding process
  • the decryption unit 512 concatenates the decryption keys sk fj for each integer j with j ⁇ [d] to generate a decryption key r F T.
  • the decoding unit 512 calculates a vector c as shown in Equation 55. Decoding unit 512, as shown in Expression 56 to calculate the ⁇ value mu. Here, the vector u is as shown in Formula 57.
  • Step S53 Output processing
  • the output unit 513 of the decoding device 50, the absolute value of ⁇ value ⁇ outputs a 0 if it is less than q / 4, and outputs a 1 otherwise.
  • the decryption device 50 executes the Dec algorithm shown in Formula 58 to decrypt the ciphertext ct (F) .
  • the ciphertext ct (f) : (C ⁇ f , F, D ⁇ f ) is obtained.
  • the ciphertext ct (f) satisfies the relations (1) to (3) shown in Formula 59 for the decryption key t ⁇ Z q m + N + 1 and the small random matrix R ⁇ Z q n ⁇ M. Yes.
  • the state satisfying the relationships (1) to (3) shown in Formula 59 is maintained.
  • Equation 59 (2) the relationship shown in Equation 59 (2) is satisfied.
  • Equation 47 The matrix D 1 is generated as shown in Equation 47. At this time, the relationship shown in Formula 60 is established. Therefore, the relationship of (59) in Equation 59 is satisfied.
  • the matrix C 1- is generated as shown in Equation 48.
  • the relationship of Formula 61 is established by the configuration of the matrix X. Therefore, the relationship of Formula 62 is established.
  • the relationship of Formula 63 is established, and the relationship of Formula (1) of Formula 59 is satisfied.
  • the expansion algorithm is executed with the ciphertext ct * obtained as a result of the execution of the homomorphic operation g instead of the ciphertext ct generated by the encryption device 30.
  • the ciphertext ct * obtained as a result of the execution of the homomorphic operation g can also be subjected to a flexible homomorphic operation, similarly to the ciphertext ct generated by the encryption device 30.
  • the ciphertext transformation unit 412 an encryption element in a matrix C and matrix C x contained in the ciphertext ct acquired by the ciphertext acquisition unit 416, the matrix F and a cryptographic element the matrix D is a cryptographic element, into a matrix C ⁇ a cryptographic element decodable by the decryption key sk F corresponding to the obtained policy set F by the policy acquisition unit 417.
  • ciphertext conversion unit 412 converts the ciphertext ct to ⁇ ciphertext ct.
  • the ciphertext transformation unit 412 uses the matrix F and the matrix D to enable the homomorphic operation to be performed while maintaining the relationship established between the ciphertext, the decryption key, and the random number R. Yes.
  • the functional components of the key generation device 20, the encryption device 30, the homomorphic calculation device 40, and the decryption device 50 are realized by software.
  • the functional components may be realized by hardware. The first modification will be described with respect to differences from the first embodiment.
  • the key generation device 20 includes a processing circuit 25 instead of the processor 21, the memory 22, and the storage 23.
  • the processing circuit 25 is a dedicated electronic circuit that implements the functional components of the key generation device 20 and the functions of the memory 22 and the storage 23.
  • the encryption device 30 When the function is realized by hardware, the encryption device 30 includes a processing circuit 35 instead of the processor 31, the memory 32, and the storage 33.
  • the processing circuit 35 is a dedicated electronic circuit that implements the functional components of the encryption device 30 and the functions of the memory 32 and the storage 33.
  • the homomorphic operation device 40 includes a processing circuit 45 instead of the processor 41, the memory 42, and the storage 43.
  • the processing circuit 45 is a dedicated electronic circuit that implements the functional components of the homomorphic arithmetic device 40 and the functions of the memory 42 and the storage 43.
  • the decoding device 50 includes a processing circuit 55 instead of the processor 51, the memory 52, and the storage 53.
  • the processing circuit 55 is a dedicated electronic circuit that implements the functional components of the decoding device 50 and the functions of the memory 52 and the storage 53.
  • the processing circuits 25, 35, 45, and 55 are a single circuit, a composite circuit, a programmed processor, a processor programmed in parallel, a logic IC, a GA (Gate Array), an ASIC (Application Specific Integrated Circuit), and an FPGA (Field-). Programmable Gate Array) is assumed.
  • the function of each functional component of the key generation device 20 may be realized by one processing circuit 25, or the function of each functional component may be distributed to a plurality of processing circuits 25.
  • each functional component may be realized by one processing circuit 35, 45, 55, or each functional component These functions may be distributed to a plurality of processing circuits 35, 45, and 55.
  • ⁇ Modification 2> As a second modification, some functions may be realized by hardware, and other functions may be realized by software. That is, some of the functional components may be realized by hardware, and other functions may be realized by software.
  • processors 21, 31, 41, 51, the memories 22, 32, 42, 52, the storages 23, 33, 43, 53, and the processing circuits 25, 35, 45, 55 are collectively referred to as “processing circuits”. That is, the function of each functional component is realized by the processing circuitry.
  • Equation 64 represents a random selection from A to y according to the distribution of A. That is, in Equation 64, y is a random number.
  • Formula 65 represents selecting y from A uniformly. That is, in Expression 65, y is a uniform random number.
  • Formula 66 represents that y is a set defined by z, or y is a set substituted with z.
  • Expression 67 represents that the machine (algorithm) A outputs a for the input x.
  • Z q represents an integer group of order q.
  • Y ⁇ Z q v indicates that y is a vector having v elements on Z q .
  • y ⁇ Z q v ⁇ w indicates that y is a matrix of v rows and w columns having elements on Z q .

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Abstract

暗号化装置(30)は、平文μが設定された暗号要素Cと、属性xが設定された暗号要素Cと、平文μが設定され、属性xが満たすポリシーfに対応する復号鍵skによって復号されない暗号要素Fとを含む暗号文ctを生成する。準同型演算装置(40)は、暗号文ctに含まれる暗号要素Cを、暗号要素Fにより、ポリシー取得部によって取得されたポリシー集合Fに対応する復号鍵skによって復号可能な暗号要素Cに変換することにより、暗号文ctを暗号文ctに変換する。準同型演算装置(40)は、暗号文ctに対して準同型演算gを行い暗号文ctを生成する。

Description

準同型演算装置、暗号システム及び準同型演算プログラム
 この発明は、データを暗号化したまま演算する技術に関する。
 準同型暗号とは、データを暗号化したまま演算できる暗号技術である。昨今、クラウドサービスの利用が広まりつつあるが、クラッキングとクラウドの信頼性の懸念とから、クラウドにはデータを暗号化した上で保管することが考えられる。準同型暗号は、暗号化されているデータに対して、復号することなく演算を施すことができるため、安全性を損なうことなくクラウドサービスの利用を可能とする技術である。
 準同型暗号の利便性を向上するために、指定された条件に従って復号者を柔軟に制御可能にした暗号技術が属性ベース準同型暗号である。属性ベース準同型暗号では、暗号文がある属性に関連するとともに、復号鍵がある復号許可条件に関連しており、属性が復号許可条件を満たすような鍵で暗号文を復号したときにだけ、正しい平文を得ることができる。
 非特許文献1には、属性ベース準同型暗号の初めての方式が記載されている。非特許文献1に記載された方式では、同一の属性に関する暗号文同士でしか準同型演算できないという課題がある。
 非特許文献2には、非特許文献1の課題を解決した属性ベース準同型暗号の方式が記載されている。
 非特許文献2には、単一ターゲット属性ベース準同型暗号と複数ターゲット属性ベース準同型暗号と呼ばれる2つの暗号技術の構成が示されている。単一ターゲット属性ベース準同型暗号は、ある1つの復号許可条件に対して、その条件を満たす属性に関する暗号文同士であれば準同型演算を行える暗号方式である。複数ターゲット属性ベース準同型暗号は、複数の復号許可条件に対して、いずれかの条件を満たす属性に関する暗号文同士であれば準同型演算可能な暗号方式である。
C.Gentry,A.Sahai,and B.Waters."Homomorphic Encryption from Learning with Errors: Conceptually-Simpler,Asymptotically-Faster,Attribute-Based".In CRYPTO 2013,pages 75-92,2013. Z.Brakerski,D.Cash,R.Tsabary,and H.Wee."Targeted Homomorphic Attribute Based Encryption".In TCC 2016-B,pages 330-360,2016. C.Peikert,and S.Shiehian"Multi-Key FHE from LWE, Revisited" 2016
 非特許文献2に示されている複数ターゲット属性ベース準同型暗号では、演算対象の暗号文Xに対して準同型演算を行って得られる暗号文Yは、演算対象の暗号文Xを復号可能な復号許可条件の集合Fに関連付けられる。暗号文Yを用いて、再び別の準同型演算前の暗号文Zと準同型演算を行う際には、暗号文Zの復号許可条件が、暗号文Yが関連付けられた復号許可条件の集合Fに含まれていない限り、準同型演算を行うことができない。
 そのため、暗号文X,Y,Zの復号許可条件によっては、暗号文X,Y,Zを全て事前に収集し、一度に準同型演算を行う必要がある。したがって、例えば、暗号化された時系列データについて準同型演算を行う際には、事前に演算に用いられる時系列データをすべて収集し、保持しておくための膨大な記憶容量が必要となる。
 この発明は、柔軟な準同型演算を可能にすることを目的とする。
 この発明に係る準同型演算装置は、
 平文μが設定された暗号要素Cと、属性xが設定された暗号要素Cと、前記平文μが設定され、前記属性xが満たすポリシーfに対応する復号鍵skによって復号されない暗号要素Fとを含む暗号文ctを取得する暗号文取得部と、
 ポリシーの集合であるポリシー集合Fを取得するポリシー取得部と、
 前記暗号文取得部によって取得された前記暗号文ctに含まれる前記暗号要素Cを、前記暗号要素Fにより、前記ポリシー取得部によって取得された前記ポリシー集合Fに対応する復号鍵skによって復号可能な暗号要素Cに変換することにより、前記暗号文ctを暗号文ctに変換する暗号文変換部と、
 前記暗号文変換部によって変換された前記暗号文ctに対して準同型演算gを行い暗号文ctを生成する準同型演算部と
を備える。
 この発明では、暗号要素Fを用いて、暗号要素Cを暗号要素Cに変換する。これにより、暗号要素C内の要素をポリシー集合Fに関連付けてしまうことなく、準同型演算を行うことが可能になる。そのため、暗号文ctを入力として再び柔軟な準同型演算を行うことが可能になる。
実施の形態1に係る暗号システム10の構成図。 実施の形態1に係る鍵生成装置20の構成図。 実施の形態1に係る暗号化装置30の構成図。 実施の形態1に係る準同型演算装置40の構成図。 実施の形態1に係る復号装置50の構成図。 実施の形態1に係るSetup処理のフローチャート。 実施の形態1に係るKeyGen処理のフローチャート。 実施の形態1に係るEnc処理のフローチャート。 実施の形態1に係るEval処理のフローチャート。 実施の形態1に係るDec処理のフローチャート。 変形例1に係る鍵生成装置20の構成図。 変形例1に係る暗号化装置30の構成図。 変形例1に係る準同型演算装置40の構成図。 変形例1に係る復号装置50の構成図。
 実施の形態1.
 ***構成の説明***
 図1を参照して、実施の形態1に係る暗号システム10の構成を説明する。
 暗号システム10は、鍵生成装置20と、暗号化装置30と、準同型演算装置40と、復号装置50とを備える。
 鍵生成装置20と、暗号化装置30と、準同型演算装置40と、復号装置50とは、ネットワーク60を介して接続される。ネットワーク60は、具体例としては、インターネットである。ネットワーク60は、LAN(Local Area Network)といった他の種類のネットワークであってもよい。
 図2を参照して、実施の形態1に係る鍵生成装置20の構成を説明する。
 鍵生成装置20は、コンピュータである。
 鍵生成装置20は、プロセッサ21と、メモリ22と、ストレージ23と、通信インタフェース24とのハードウェアを備える。プロセッサ21は、信号線を介して他のハードウェアと接続され、これら他のハードウェアを制御する。
 鍵生成装置20は、機能構成要素として、取得部211と、マスタ鍵生成部212と、復号鍵生成部213と、出力部214とを備える。取得部211と、マスタ鍵生成部212と、復号鍵生成部213と、出力部214との機能はソフトウェアにより実現される。
 ストレージ23には、取得部211と、マスタ鍵生成部212と、復号鍵生成部213と、出力部214との機能を実現するプログラムが記憶されている。このプログラムは、プロセッサ21によりメモリ22に読み込まれ、プロセッサ21によって実行される。これにより、取得部211と、マスタ鍵生成部212と、復号鍵生成部213と、出力部214との機能が実現される。
 また、ストレージ23は、マスタ鍵記憶部231の機能を実現する。
 図3を参照して、実施の形態1に係る暗号化装置30の構成を説明する。
 暗号化装置30は、コンピュータである。
 暗号化装置30は、プロセッサ31と、メモリ32と、ストレージ33と、通信インタフェース34とのハードウェアを備える。プロセッサ31は、信号線を介して他のハードウェアと接続され、これら他のハードウェアを制御する。
 暗号化装置30は、機能構成要素として、取得部311と、暗号化部312と、出力部313とを備える。取得部311と、暗号化部312と、出力部313との機能はソフトウェアにより実現される。
 ストレージ33には、取得部311と、暗号化部312と、出力部313との機能を実現するプログラムが記憶されている。このプログラムは、プロセッサ31によりメモリ32に読み込まれ、プロセッサ31によって実行される。これにより、取得部311と、暗号化部312と、出力部313との機能が実現される。
 また、ストレージ33は、公開パラメータ記憶部331の機能を実現する。
 図4を参照して、実施の形態1に係る準同型演算装置40の構成を説明する。
 準同型演算装置40は、コンピュータである。
 準同型演算装置40は、プロセッサ41と、メモリ42と、ストレージ43と、通信インタフェース44とのハードウェアを備える。プロセッサ41は、信号線を介して他のハードウェアと接続され、これら他のハードウェアを制御する。
 準同型演算装置40は、機能構成要素として、取得部411と、暗号文変換部412と、準同型演算部413と、出力部414とを備える。取得部411は、公開パラメータ取得部415と、暗号文取得部416と、ポリシー取得部417と、演算取得部418とを備える。取得部411と、暗号文変換部412と、準同型演算部413と、出力部414と、公開パラメータ取得部415と、暗号文取得部416と、ポリシー取得部417と、演算取得部418との機能はソフトウェアにより実現される。
 ストレージ43には、取得部411と、暗号文変換部412と、準同型演算部413と、出力部414と、公開パラメータ取得部415と、暗号文取得部416と、ポリシー取得部417と、演算取得部418との機能を実現するプログラムが記憶されている。このプログラムは、プロセッサ41によりメモリ42に読み込まれ、プロセッサ41によって実行される。これにより、取得部411と、暗号文変換部412と、準同型演算部413と、出力部414と、公開パラメータ取得部415と、暗号文取得部416と、ポリシー取得部417と、演算取得部418との機能が実現される。
 また、ストレージ43は、公開パラメータ記憶部431と、暗号文記憶部432との機能を実現する。
 図5を参照して、実施の形態1に係る復号装置50の構成を説明する。
 復号装置50は、コンピュータである。
 復号装置50は、プロセッサ51と、メモリ52と、ストレージ53と、通信インタフェース54とのハードウェアを備える。プロセッサ51は、信号線を介して他のハードウェアと接続され、これら他のハードウェアを制御する。
 復号装置50は、機能構成要素として、取得部511と、復号部512と、出力部513とを備える。取得部511と、復号部512と、出力部513との機能はソフトウェアにより実現される。
 ストレージ53には、取得部511と、復号部512と、出力部513との機能を実現するプログラムが記憶されている。このプログラムは、プロセッサ51によりメモリ52に読み込まれ、プロセッサ51によって実行される。これにより、取得部511と、復号部512と、出力部513との機能が実現される。
 また、ストレージ53は、鍵記憶部531と、条件記憶部532と、結果記憶部533との機能を実現する。
 プロセッサ21,31,41,51は、演算処理を行うIC(Integrated Circuit)である。プロセッサ21,31,41,51は、具体例としては、CPU(Central Processing Unit)、DSP(Digital Signal Processor)、GPU(Graphics Processing Unit)である。
 メモリ22,32,42,52は、データを一時的に記憶する記憶装置である。メモリ22,32,42,52は、具体例としては、SRAM(Static Random Access Memory)、DRAM(Dynamic Random Access Memory)である。
 ストレージ23,33,43,53は、データを保管する記憶装置である。ストレージ23,33,43,53は、具体例としては、HDD(Hard Disk Drive)である。また、ストレージ23,33,43,53は、SD(登録商標,Secure Digital)メモリカード、CF(CompactFlash)、NANDフラッシュ、フレキシブルディスク、光ディスク、コンパクトディスク、ブルーレイ(登録商標)ディスク、DVD(Digital Versatile Disk)といった可搬記憶媒体であってもよい。
 通信インタフェース24,34,44,54は、外部の装置と通信するためのインタフェースである。通信インタフェース24,34,44,54は、具体例としては、Ethernet(登録商標)、USB(Universal Serial Bus)、HDMI(登録商標,High-Definition Multimedia Interface)のポートである。
 図2では、プロセッサ21は、1つだけ示されている。しかし、鍵生成装置20は、プロセッサ21を代替する複数のプロセッサを備えていてもよい。同様に、暗号化装置30は、プロセッサ31を代替する複数のプロセッサを備え、準同型演算装置40は、プロセッサ41を代替する複数のプロセッサを備え、復号装置50は、プロセッサ51を代替する複数のプロセッサを備えていてもよい。これら複数のプロセッサは、各機能構成要素の機能を実現するプログラムの実行を分担する。それぞれのプロセッサは、プロセッサ21,31,41,51と同じように、演算処理を行うICである。
 ***動作の説明***
 図6から図10を参照して、実施の形態1に係る暗号システム10の動作を説明する。
 実施の形態1に係る暗号システム10の動作は、実施の形態1に係る暗号方法に相当する。また、実施の形態1に係る暗号プログラムの処理に相当する。
 暗号システム10の動作は、Setup処理と、KeyGen処理と、Enc処理と、Eval処理と、Dec処理とに分けられる。
 以下の説明では、非特許文献2に記載された内容と異なる部分を中心に説明し、非特許文献2に記載された内容と同一の部分について既に公知の内容であるため、一部説明を省略する。
 以下の説明における符号について説明する。
 n,q,χは、LWE(Learning With Errors)問題におけるパラメータである。LWE問題は公知の問題である。Decisional LWE問題(DLWE問題)は、次のように定義される。
 <DLWE問題>
 λはセキュリティパラメータであり、n=n(λ)とq=q(λ)とは整数であり、χ=χ(λ)は整数Z上の確率分布であるとする。DLWEn,q,χ問題は、全てのm=poly(n)に対して、数11とする場合に、(A,sA+e)と(A,u)とが計算的に見分けがつかないというものである。
Figure JPOXMLDOC01-appb-M000008
 m、N,M.gは、数12に示す通りである。
Figure JPOXMLDOC01-appb-M000009
 任意のx∈Zに対して、数13に示すyは、数14を満たすベクトルである。
Figure JPOXMLDOC01-appb-M000010
Figure JPOXMLDOC01-appb-M000011
 任意の自然数n,mに対して、Iはn行n列の単位行列であり、0n×mは要素が全て0のn行m列の行列である。任意のi∈[n]に対して、e∈{0,1}は、n要素目が1でその他が0の標準基底ベクトルである。なお、i∈[n]は、i=1,...,nを意味する。
 F⊆{0,1}→{0,1}は、深さdのブーリアンサーキットで計算できるポリシーのクラスである。G⊆{0,1}→{0,1}は、深さdのブーリアンサーキットで計算できる演算のクラスである。
 図6を参照して、実施の形態1に係るSetup処理を説明する。
 Setup処理は、暗号システム10の初期設定時等に、主に鍵生成装置20によって実行される。実施の形態1に係るSetup処理は、実施の形態1に係るマスタ鍵生成方法とマスタ鍵生成プログラムの処理とに相当する。
 (ステップS11:取得処理)
 鍵生成装置20の取得部211は、パラメータλ,L,d,dを取得する。
 具体的には、取得部211は、通信インタフェース24を介して、暗号システム10の管理者等によって入力されたパラメータλ,L,d,dを受け付ける。取得部211は、受け付けられたパラメータλ,L,d,dをメモリ22に書き込む。
 (ステップS12:マスタ鍵生成処理)
 鍵生成装置20のマスタ鍵生成部212は、公開パラメータppとマスタ秘密鍵mskとのペアを生成する。
 具体的には、マスタ鍵生成部212は、数15に示すように、行列AとトラップドアAτ0 -1とのペア(A,Aτ0 -1)を生成する。
Figure JPOXMLDOC01-appb-M000012
 TrapGenアルゴリズムは非特許文献2に記載されている。ここで、行列Aは数16に示す行列であり、トラップドアAτ0 -1は数17に示すアルゴリズムである。
Figure JPOXMLDOC01-appb-M000013
Figure JPOXMLDOC01-appb-M000014
 マスタ鍵生成部212は、数18に示すように、行列B,B,B,...,Bを生成し、B を定義する。
Figure JPOXMLDOC01-appb-M000015
 マスタ鍵生成部212は、数19に示すように、ベクトルvとPRF(PseudoRandom Function)のシードσとを生成する。
Figure JPOXMLDOC01-appb-M000016
 PRF.Genアルゴリズムは非特許文献2に記載されている。
 マスタ鍵生成部212は、(A,B,B ,B,v)を公開パラメータppとし、(Aτ0 -1,σ)をマスタ秘密鍵mskとする。マスタ鍵生成部212は、公開パラメータppをメモリ22に書き込むとともに、公開パラメータpp及びマスタ秘密鍵mskをマスタ鍵記憶部231に書き込む。
 (ステップS13:出力処理)
 鍵生成装置20の出力部214は、公開パラメータppを出力する。
 具体的には、出力部214は、メモリ22から公開パラメータppを読み出す。そして、出力部214は、通信インタフェース24を介して、公開パラメータppを暗号化装置30と準同型演算装置40と復号装置50とに送信する。
 (ステップS14:公開パラメータ取得処理)
 暗号化装置30の取得部311と、準同型演算装置40の公開パラメータ取得部415と、復号装置50の取得部511とは、公開パラメータppを取得する。
 具体的には、取得部311は、通信インタフェース34を介して、出力部214によって送信された公開パラメータppを受信する。取得部311は、受信された公開パラメータppを公開パラメータ記憶部331に書き込む。
 また、準同型演算装置40の公開パラメータ取得部415は、通信インタフェース44を介して、出力部214によって送信された公開パラメータppを受信する。公開パラメータ取得部415は、受信された公開パラメータppを公開パラメータ記憶部431に書き込む。
 また、復号装置50の取得部511は、通信インタフェース54を介して、出力部214によって送信された公開パラメータppを受信する。取得部511は、受信された公開パラメータppを鍵記憶部531に書き込む。
 つまり、鍵生成装置20は、数20に示すSetupアルゴリズムを実行して、公開パラメータppとマスタ秘密鍵mskとを生成する。
Figure JPOXMLDOC01-appb-M000017
 図7を参照して、実施の形態1に係るKeyGen処理を説明する。
 KeyGen処理は、新たな復号鍵skを生成する際に、主に鍵生成装置20によって実行される。実施の形態1に係るKeyGen処理は、実施の形態1に係る復号鍵生成方法と復号鍵生成プログラムの処理とに相当する。
 (ステップS21:復号鍵依頼処理)
 復号装置50の取得部511は、復号鍵skの生成を鍵生成装置20に依頼する。
 具体的には、取得部511は、復号装置50の利用者等によって入力された復号許可条件を示すポリシーfを受け付ける。ポリシーfは、例えば、利用者の属性が設定される。そして、取得部511は、入力されたポリシーfを鍵生成装置20に送信して、ポリシーfに関連付けられた復号鍵skの生成を要求する。
 取得部511は、復号鍵skの生成を要求した際に送信されたポリシーfを条件記憶部532に書き込む。
 (ステップS22:取得処理)
 鍵生成装置20の取得部211は、ポリシーfを取得する。
 具体的には、取得部211は、通信インタフェース24を介して、復号装置50から送信されたポリシーfを受信する。取得部211は、受信されたポリシーfをメモリ22に書き込む。
 (ステップS23:復号鍵生成処理)
 鍵生成装置20の復号鍵生成部213は、ポリシーfに関連付けられた復号鍵skを生成する。
 具体的には、復号鍵生成部213は、メモリ22からポリシーfを読み出し、マスタ鍵記憶部231から公開パラメータpp及びマスタ秘密鍵mskを読み出す。復号鍵生成部213は、数21に示すように、行列Bを計算する。
Figure JPOXMLDOC01-appb-M000018
 Evalアルゴリズムは非特許文献2に記載されている。
 復号鍵生成部213は、ランダムオラクルにクエリして行列r’=O(A,f)∈{0,1}を得る。つまり、復号鍵生成部213は、ランダムな行列r’を生成する。復号鍵生成部213は、数22に示すように、行列rを生成する。
Figure JPOXMLDOC01-appb-M000019
 ここで、τは数23に示す通りである。
Figure JPOXMLDOC01-appb-M000020
 このとき、トラップドアAτ0 -1は数17に示すアルゴリズムであるから、数24が成立する。
Figure JPOXMLDOC01-appb-M000021
 復号鍵生成部213は、行列rを復号鍵skとしてメモリ22に書き込む。
 (ステップS24:出力処理)
 鍵生成装置20の出力部214は、復号鍵skを出力する。
 具体的には、出力部214は、メモリ22から復号鍵skを読み出す。そして、出力部214は、通信インタフェース24を介して、復号鍵skを復号装置50に送信する。
 (ステップS25:復号鍵取得処理)
 復号装置50の取得部511は、復号鍵skを取得する。
 具体的には、取得部511は、通信インタフェース54を介して、出力部214によって送信された復号鍵skを受信する。取得部511は、受信された復号鍵skを鍵記憶部531に書き込む。
 つまり、鍵生成装置20は、数25に示すKeyGenアルゴリズムを実行して、復号鍵skを生成する。
Figure JPOXMLDOC01-appb-M000022
 図8を参照して、実施の形態1に係るEnc処理を説明する。
 Enc処理は、暗号文ctを生成する際に、主に暗号化装置30によって実行される。実施の形態1に係るEnc処理は、実施の形態1に係る暗号化方法と暗号化プログラムの処理とに相当する。
 (ステップS31:取得処理)
 暗号化装置30の取得部311は、平文μと、属性xとを取得する。
 具体的には、取得部311は、通信インタフェース34を介して、暗号化装置30の利用者等によって入力された平文μと属性xとを受け付ける。平文μは、暗号化した上で送信するメッセージであり、平文μ∈{0,1}である。属性xは、暗号文に関連付けられる属性であり、属性x∈{0,1}である。取得部311は、平文μと属性xとをメモリ32に書き込む。
 (ステップS32:暗号化処理)
 暗号化装置30の暗号化部312は、属性xを設定して平文μを暗号化した暗号文ctを生成する。
 具体的には、暗号化部312は、公開パラメータ記憶部331から公開パラメータppを読み出すとともに、メモリ32から平文μと属性xとを読み出す。暗号化部312は、数26に示すように、行列Sと行列Eとエラーベクトルeとを生成する。
Figure JPOXMLDOC01-appb-M000023
 暗号化部312は、数27に示すように、i∈{0,1,...,L}の各整数iと、j∈[M]の各整数jとについて、行列Ri,jを生成する。
Figure JPOXMLDOC01-appb-M000024
 暗号化部312は、数28に示すように、i∈{0,1,...,L}の各整数iと、j∈[M]の各整数jとについて、行列E[j]を生成する。ここで、E[j]及びE[j]は、それぞれ行列E及び行列Eのj列目を示す。
Figure JPOXMLDOC01-appb-M000025
 暗号化部312は、数29に示すように行列Cを生成し、数30に示すように行列Cを生成する。
Figure JPOXMLDOC01-appb-M000026
Figure JPOXMLDOC01-appb-M000027
 行列Cには、平文μが設定されており、属性xが満たすポリシーfに対応する復号鍵skによって復号可能な構成になっている。
 ここで、数31は、テンソル積を示す。
Figure JPOXMLDOC01-appb-M000028
 また、数32である。
Figure JPOXMLDOC01-appb-M000029
 暗号化部312は、数33に示すように、行列Rと行列Eとを生成する。
Figure JPOXMLDOC01-appb-M000030
 暗号化部312は、数34に示すように、行列Fを生成する。
Figure JPOXMLDOC01-appb-M000031
 数34に示すように、行列Fには、平文μと乱数である行列Rとが設定されている。行列Fは、行列に含まれる行列Bに代えて行列Bが含まれており、属性xが満たすポリシーfに対応する復号鍵skによって復号されない構成になっている。
 暗号化部312は、数35に示すように、i∈{0,1,...,L}の各整数iと、j∈[M]の各整数jと、k∈[N]の各整数kとについて、行列E(k) と、ベクトルe(k) と、行列R(k) i,jとを生成する。
Figure JPOXMLDOC01-appb-M000032
 暗号化部312は、数36に示すように、ベクトルE(k) と行列E(k)とを生成する。ここで、E(k) [j]及び行列E(k) [j]は、それぞれ行列E(k) 及び行列E(k) のj列目を示す。
Figure JPOXMLDOC01-appb-M000033
 暗号化部312は、数37に示すように、行列S(1),...,S(N)を生成する。
Figure JPOXMLDOC01-appb-M000034
 暗号化部312は、数38に示すように行列Dを生成し、数39に示すように行列D(k) を生成する。
Figure JPOXMLDOC01-appb-M000035
Figure JPOXMLDOC01-appb-M000036
 つまり、行列Dは、行列Fに含まれる乱数である行列Rが暗号化されている。
 暗号化部312は、属性xと、行列Cと、行列Cと、行列Fと、行列Dと、k∈[N]の各整数kについての行列D(k) とを暗号要素とする暗号文ctを、メモリ32に書き込む。つまり、暗号文ctには、平文μが設定された暗号要素である行列Cと、属性xが設定された暗号要素である行列Cと、平文μと乱数である行列Rとが設定され、属性xが満たすポリシーfに対応する復号鍵skによって復号されない暗号要素である行列Fと、乱数である行列Rが暗号化された暗号要素である行列Dとが含まれる。
 (ステップS33:出力処理)
 暗号化装置30の出力部313は、暗号文ctを出力する。
 具体的には、出力部313は、メモリ32から暗号文ctを読み出す。そして、出力部313は、通信インタフェース34を介して、暗号文ctを準同型演算装置40に送信する。
 (ステップS34:暗号文取得処理)
 準同型演算装置40の暗号文取得部416は、通信インタフェース44を介して、出力部313によって送信された暗号文ctを受信する。暗号文取得部416は、受信された暗号文ctを暗号文記憶部432に書き込む。
 つまり、暗号化装置30は、数40から数41に示すEncアルゴリズムを実行して、暗号文ctを生成する。
Figure JPOXMLDOC01-appb-M000037
Figure JPOXMLDOC01-appb-M000038
 図9を参照して、実施の形態1に係るEval処理を説明する。
 Eval処理は、暗号文ctに対して準同型演算を行う際に、準同型演算装置40によって実行される。実施の形態1に係るEval処理は、実施の形態1に係る準同型演算方法と準同型演算プログラムの処理とに相当する。
 (ステップS41:暗号文取得処理)
 暗号文取得部416は、演算対象の暗号文ct(1),...,ct(k)を取得する。ここで、kは1以上の整数である。
 具体的には、暗号文取得部416は、通信インタフェース44を介して、準同型演算装置40の利用者等によって指定された暗号文ct(1),...,ct(k)を暗号文記憶部432から読み出す。暗号文取得部416は、読み出された暗号文ct(1),...,ct(k)をメモリ42に書き込む。
 (ステップS42:ポリシー取得処理)
 準同型演算装置40のポリシー取得部417は、ポリシーの集合であるポリシー集合F:={f,...,f}を取得する。ここで、dは、1以上の整数である。
 具体的には、ポリシー取得部417は、通信インタフェース44を介して、準同型演算装置40の利用者等によって入力されたポリシー集合Fを受け付ける。ポリシー取得部417は、受け付けられたポリシー集合Fをメモリ42に書き込む。
 なお、準同型演算を行うためには、ステップS41で読み出されたi=1,...,kの各整数iについての暗号文ct(i)が、ポリシー集合Fに含まれるいずれかのf,...,fを満たす必要がある。言い換えると、i=1,...,kの各整数iについての暗号文ct(i)が、いずれかのf,...,fに関連付けられた復号鍵skで復号可能である必要がある。つまり、i=1,...,kの各整数iについての暗号文ct(i)に設定された属性を属性xとすると、i=1,...,kの各整数iについて、あるj∈[d]に対して、f(x)=0を満たす必要がある。
 (ステップS43:演算取得処理)
 準同型演算装置40の演算取得部418は、実行する準同型演算gを取得する。
 具体的には、演算取得部418は、通信インタフェース44を介して、準同型演算装置40の利用者等によって入力された準同型演算gを受け付ける。演算取得部418は、受け付けられた準同型演算gをメモリ42に書き込む。
 (ステップS44:暗号文変換処理)
 準同型演算装置40の暗号文変換部412は、i=1,...,kの各整数iについての暗号文ct(i)を暗号文ct(i)~:=(C,F,D)に変換する。
 具体的には、暗号文変換部412は、i=1,...,kの各整数iについての暗号文ct(i)を対象として、まずApplyアルゴリズムを実行し、その後Expansionアルゴリズムを実行する。但し、Applyアルゴリズムは、1度も準同型演算が行われていない暗号文ct(i)についてのみ実行される。つまり、暗号文ct(i)が暗号化装置30によって生成され、図8のステップS33で出力された暗号文ctである場合には、Applyアルゴリズムは実行され、暗号文ct(i)が後述するステップS46で出力された暗号文ctである場合には、Applyアルゴリズムは実行されない。暗号文ct(i)が後述するステップS46で出力された暗号文ctである場合には、Expansionアルゴリズムだけが実行される。
 ここでは、表記の簡略化のため、対象とする暗号文ct(i)を暗号文ctと書き、暗号文ct(i)が変換された暗号文ct(i)~を暗号文ctと書く。また、対象とする暗号文ct(i)が満たすポリシーfをポリシーfと書く。
 Applyアルゴリズムについて説明する。
 暗号文変換部412は、数42に示すように、行列Hを計算する。
Figure JPOXMLDOC01-appb-M000039
 EvRelationアルゴリズムは非特許文献2に記載されている。
 暗号文変換部412は、行列C:=Hを生成する。暗号文変換部412は、数43に示すように、行列C^fを生成する。
Figure JPOXMLDOC01-appb-M000040
 暗号文変換部412は、i∈[k]の各整数iについて、数44に示すように、行列D(i) を生成する。
Figure JPOXMLDOC01-appb-M000041
 暗号文変換部412は、数45に示すように、行列Dを生成する。
Figure JPOXMLDOC01-appb-M000042
 暗号文変換部412は、行列D^:=D+Dを生成する。
 つまり、暗号文変換部412は、数46に示すApplyアルゴリズムを実行する。
Figure JPOXMLDOC01-appb-M000043
 Expansionアルゴリズムについて説明する。
 ここで、対象とする暗号文ct(i)が後述するステップS46で出力された暗号文ct:=(C,F,D)である場合には、C^:=C,F:=F,D^:=Dとする。
 暗号文変換部412は、行列Fをそのまま行列Fとする。
 暗号文変換部412は、数47に示すように、行列Dを生成する。
Figure JPOXMLDOC01-appb-M000044
 暗号文変換部412は、数48に示すように、行列Cを生成する。
Figure JPOXMLDOC01-appb-M000045
 ここで、行列Xは、数49に示す通りである。
Figure JPOXMLDOC01-appb-M000046
 また、行列sは、数50に示す通りである。
Figure JPOXMLDOC01-appb-M000047
 なお、ベクトルr’∈{0,1}は、fをランダムオラクルにクエリすることによって得られるベクトルである。つまり、ベクトルr’は、ランダムなベクトルである。また、Bは、数21に示す通りである。
 暗号文変換部412は、暗号文ct:=(C,F,D)をメモリ42に書き込む。
 つまり、暗号文変換部412は、数51に示すExpansionアルゴリズムを実行する。
Figure JPOXMLDOC01-appb-M000048
 (ステップS45:準同型演算処理)
 準同型演算装置40の準同型演算部413は、i=1,...,kの各整数iについての暗号文ct(i)~に対して、準同型演算gを実行して、暗号文ct:=(C,F,D)を生成する。
 具体的には、準同型演算部413は、i=1,...,kの各整数iについての暗号文ct(i)~を読み出す。そして、準同型演算部413は、i=1,...,kの各整数iについての暗号文ct(i)~を入力として、非特許文献3の“3.2 Homomorphic Operations”に記載された準同型演算の演算方法に従い、準同型演算gを実行して、暗号文ctを生成する。準同型演算部413は、生成された暗号文ctをメモリ42に書き込む。
 具体例として、2つの暗号文ct(1)~:=(C,F,D)とct(2)~:=(C,F,D)とについて、準同型加算する場合を説明する。この場合、準同型演算部413は、C:=C+C,F:=F+F,D:=D+Dのように、各暗号要素を計算する。
 また、具体例として、2つの暗号文ct(1)~:=(C,F,D)とct(2)~:=(C,F,D)とについて、準同型乗算する場合を説明する。この場合、準同型演算部413は、数52に示すように、各暗号要素を計算する。
Figure JPOXMLDOC01-appb-M000049
 (ステップS46:出力処理)
 準同型演算装置40の出力部414は、暗号文ctを出力する。
 具体的には、出力部414は、メモリ42から暗号文ctを読み出す。そして、出力部414は、暗号文ctを暗号文記憶部432に書き込む。
 つまり、準同型演算装置40は、数53に示すEvaluationアルゴリズムを実行して、暗号文ctを生成する。
Figure JPOXMLDOC01-appb-M000050
 なお、H.Opアルゴリズムは、非特許文献3に記載された準同型演算の演算アルゴリズムのことである。
 図10を参照して、実施の形態1に係るDec処理を説明する。
 Dec処理は、暗号文ctを復号する際に、主に復号装置50によって実行される。実施の形態1に係るDec処理は、実施の形態1に係る復号方法と復号プログラムの処理とに相当する。
 (ステップS51:取得処理)
 復号装置50の取得部511は、復号の対象とする暗号文ct(F):=(C^,F,D^)を取得する。
 具体的には、取得部511は、通信インタフェース54を介して、準同型演算装置40に暗号文ct(F)の取得要求を送信する。準同型演算装置40の出力部414は、取得要求を受信すると、要求された暗号文ct(F)を暗号文記憶部432から読み出す。この際、準同型演算装置40の暗号文変換部412は、暗号文ct(F)が図8のステップS33で出力された暗号文ctである場合には、上述したApplyアルゴリズムを実行して、暗号文ctを暗号文ct(F):=(C^,F,D^)に変換する。また、準同型演算装置40の暗号文変換部412は、暗号文ct(F)が図9のステップS46で出力された暗号文ct:=(C,F,D)である場合には、暗号文ct(F):=(C^:=C,F:=F,D^:=D)に変換する。そして、出力部414は、変換された暗号文ct(F)を、通信インタフェース44を介して復号装置50に送信する。取得部511は、準同型演算装置40から送信された暗号文ct(F)を受信する。取得部511は、受信された暗号文ct(F)をメモリ52に書き込む。
 暗号文ct(F)は、ポリシー集合F:={f,...,f}に関連付けられた復号鍵skf1,...,skfdによって復号可能な暗号文であることを意味する。
 (ステップS52:復号処理)
 復号装置50の復号部512は、暗号文ct(F)を復号鍵skf1:=rf1,...,skfd:=rfdにより復号して、値μを計算する。
 具体的には、復号部512は、j∈[d]の各整数jについて、ランダムオラクルにクエリして行列r’fj:=O(A,f)を取得する。復号部512は、数54に示すように、j∈[d]の各整数jについての復号鍵skfjを連結して、復号鍵r を生成する。
Figure JPOXMLDOC01-appb-M000051
 復号部512は、数55に示すように、ベクトルcを計算する。
Figure JPOXMLDOC01-appb-M000052
 復号部512は、数56に示すように、値μを計算する。
Figure JPOXMLDOC01-appb-M000053
 ここで、ベクトルuは、数57に示す通りである。
Figure JPOXMLDOC01-appb-M000054
 (ステップS53:出力処理)
 復号装置50の出力部513は、値μの絶対値がq/4未満であれば0を出力し、そうでなければ1を出力する。
 つまり、復号装置50は、数58に示すDecアルゴリズムを実行して、暗号文ct(F)を復号する。
Figure JPOXMLDOC01-appb-M000055
 ***実施の形態1の効果***
 以上のように、実施の形態1に係る暗号システム10では、暗号要素Fを用いて、暗号要素である行列Cを暗号要素である行列Cに変換する。これにより、暗号要素C内の要素をポリシー集合Fに関連付けてしまうことなく、準同型演算を行うことが可能になる。そのため、暗号文ctを入力として再び柔軟な準同型演算を行うことが可能になる。
 暗号文ctを入力として再び柔軟な準同型演算を行うことが可能になるという効果が得られる理由を説明する。
 暗号化装置30により生成された暗号文ct:=(x,C,C,F,D,{D(k) )を入力として、図9のステップS44で説明したApplyアルゴリズムが実行された結果、暗号文ct(f):=(C^,F,D^)が得られたとする。
 このとき、暗号文ct(f)は、復号鍵t∈Z m+N+1と、小さなランダム行列R∈Z n×Mとに対して数59に示す(1)から(3)の関係を満たしている。
Figure JPOXMLDOC01-appb-M000056
 暗号文ct(f)を入力として、図9のステップS44で説明したExpansionアルゴリズムが実行された結果、暗号文ct:=(C,F,D)が得られたとする。このとき、暗号文ctは、復号鍵tに、復号鍵tを連結してできる復号鍵t:=[t||t]と、ランダム行列Rとに対して、以下に説明するように、数59に示す(1)から(3)の関係を満たす状態が保持されている。
 行列Fがそのまま行列Fになる。そのため、ランダム行列Rがそのままランダム行列Rになる。したがって、数59の(2)に示す関係は満たされる。
 行列Dは、数47に示すように生成される。このとき、数60に示す関係が成立する。
Figure JPOXMLDOC01-appb-M000057
 したがって、数59の(3)の関係は満たされる。
 行列Cは、数48に示すように生成される。このとき、行列Xの構成により、数61の関係が成立する。
Figure JPOXMLDOC01-appb-M000058
 したがって、数62の関係が成立する。
Figure JPOXMLDOC01-appb-M000059
 その結果、数63の関係が成立しており、数59の(1)の関係は満たされる。
Figure JPOXMLDOC01-appb-M000060
 暗号文ctを入力として、図9のステップS45で説明した準同型演算gが実行された結果、暗号文ct:=(C,F,D)が得られたとする。このとき、非特許文献3で説明されているように、暗号文ctについても、数59に示す(1)から(3)の関係を満たす状態が保持されている。
 つまり、暗号化装置30により生成された暗号文ctを入力としてApplyアルゴリズムが実行された結果得られた暗号文ct(f)が満たす関係を、準同型演算gが実行された結果得られた暗号文ctが保持している。そのため、暗号化装置30により生成された暗号文ctに代えて、準同型演算gが実行された結果得られた暗号文ctを入力としてExpansionアルゴリズムが実行された場合にも、この関係を満たす状態とすることができる。その結果、準同型演算gが実行された結果得られた暗号文ctについても、暗号化装置30により生成された暗号文ctと同様に、柔軟な準同型演算を行うことが可能である。
 つまり、図9のステップS44では、暗号文変換部412は、暗号文取得部416によって取得された暗号文ctに含まれる暗号要素である行列C及び行列Cを、暗号要素である行列F及び暗号要素である行列Dにより、ポリシー取得部417によって取得されたポリシー集合Fに対応する復号鍵skによって復号可能な暗号要素である行列Cに変換する。また、暗号文変換部412は、行列Dについても、合わせて行列Dに変換する。これにより、暗号文変換部412は、暗号文ctを暗号文ctに変換する。
 すなわち、暗号文変換部412は、平文μが設定された暗号要素である行列Cと、属性xが設定された暗号要素である行列Cとを、平文μと乱数である行列Rとが設定され、属性xが満たすポリシーfに対応する復号鍵skによって復号されない暗号要素である行列Fと、乱数である行列Rが暗号化された暗号要素である行列Dとを用いて変換する。このように、暗号文変換部412は、行列F及び行列Dを用いることにより、暗号文と復号鍵及び乱数Rとの間に成立する関係性を保持したまま、準同型演算を実行可能にしている。
 ***他の構成***
 <変形例1>
 実施の形態1では、鍵生成装置20と暗号化装置30と準同型演算装置40と復号装置50との機能構成要素がソフトウェアで実現された。しかし、変形例1として、機能構成要素はハードウェアで実現されてもよい。この変形例1について、実施の形態1と異なる点を説明する。
 図11を参照して、変形例1に係る鍵生成装置20の構成を説明する。
 機能がハードウェアで実現される場合、鍵生成装置20は、プロセッサ21とメモリ22とストレージ23とに代えて、処理回路25を備える。処理回路25は、鍵生成装置20の機能構成要素と、メモリ22とストレージ23との機能とを実現する専用の電子回路である。
 図12を参照して、変形例1に係る暗号化装置30の構成を説明する。
 機能がハードウェアで実現される場合、暗号化装置30は、プロセッサ31とメモリ32とストレージ33とに代えて、処理回路35を備える。処理回路35は、暗号化装置30の機能構成要素と、メモリ32とストレージ33との機能とを実現する専用の電子回路である。
 図13を参照して、変形例1に係る準同型演算装置40の構成を説明する。
 機能がハードウェアで実現される場合、準同型演算装置40は、プロセッサ41とメモリ42とストレージ43とに代えて、処理回路45を備える。処理回路45は、準同型演算装置40の機能構成要素と、メモリ42とストレージ43との機能とを実現する専用の電子回路である。
 図14を参照して、変形例1に係る復号装置50の構成を説明する。
 機能がハードウェアで実現される場合、復号装置50は、プロセッサ51とメモリ52とストレージ53とに代えて、処理回路55を備える。処理回路55は、復号装置50の機能構成要素と、メモリ52とストレージ53との機能とを実現する専用の電子回路である。
 処理回路25,35,45,55は、単一回路、複合回路、プログラム化したプロセッサ、並列プログラム化したプロセッサ、ロジックIC、GA(Gate Array)、ASIC(Application Specific Integrated Circuit)、FPGA(Field-Programmable Gate Array)が想定される。
 鍵生成装置20の各機能構成要素の機能を1つの処理回路25で実現してもよいし、各機能構成要素の機能を複数の処理回路25に分散させて実現してもよい。同様に、暗号化装置30と準同型演算装置40と復号装置50とのそれぞれについて、各機能構成要素の機能を1つの処理回路35,45,55で実現してもよいし、各機能構成要素の機能を複数の処理回路35,45,55に分散させて実現してもよい。
 <変形例2>
 変形例2として、一部の機能がハードウェアで実現され、他の機能がソフトウェアで実現されてもよい。つまり、各機能構成要素のうち、一部の機能がハードウェアで実現され、他の機能がソフトウェアで実現されてもよい。
 プロセッサ21,31,41,51とメモリ22,32,42,52とストレージ23,33,43,53と処理回路25,35,45,55とを、総称して「プロセッシングサーキットリー」という。つまり、各機能構成要素の機能は、プロセッシングサーキットリーにより実現される。
 ***記法の説明***
 Aがランダムな変数または分布であるとき、数64は、Aの分布に従いAからyをランダムに選択することを表す。つまり、数64において、yは乱数である。
Figure JPOXMLDOC01-appb-M000061
 Aが集合であるとき、数65は、Aからyを一様に選択することを表す。つまり、数65において、yは一様乱数である。
Figure JPOXMLDOC01-appb-M000062
 数66は、yがzにより定義された集合であること、又はyがzを代入された集合であることを表す。
Figure JPOXMLDOC01-appb-M000063
 aが定数であるとき、数67は、機械(アルゴリズム)Aが入力xに対しaを出力することを表す。
Figure JPOXMLDOC01-appb-M000064
 Zは、位数qの整数の群を示す。また、y∈Z は、yはZ上のv個の要素を有するベクトルであることを示す。また、y∈Z v×wは、yはZ上の要素を持つ、v行w列の行列であることを示す。
 10 暗号システム、20 鍵生成装置、21 プロセッサ、22 メモリ、23 ストレージ、24 通信インタフェース、25 処理回路、211 取得部、212 マスタ鍵生成部、213 復号鍵生成部、214 出力部、231 マスタ鍵記憶部、30 暗号化装置、31 プロセッサ、32 メモリ、33 ストレージ、34 通信インタフェース、35 処理回路、311 取得部、312 暗号化部、313 出力部、331 公開パラメータ記憶部、40 準同型演算装置、41 プロセッサ、42 メモリ、43 ストレージ、44 通信インタフェース、45 処理回路、411 取得部、412 暗号文変換部、413 準同型演算部、414 出力部、415 公開パラメータ取得部、416 暗号文取得部、417 ポリシー取得部、418 演算取得部、431 公開パラメータ記憶部、432 暗号文記憶部、50 復号装置、51 プロセッサ、52 メモリ、53 ストレージ、54 通信インタフェース、55 処理回路、511 取得部、512 復号部、513 出力部、531 鍵記憶部、532 条件記憶部、533 結果記憶部、λ セキュリティパラメータ、pp 公開パラメータ、msk マスタ秘密鍵、sk 復号鍵、μ 平文、x 属性、ct,ct(F),ct,ct 暗号文、F ポリシー集合、g 準同型演算。

Claims (9)

  1.  平文μが設定された暗号要素Cと、属性xが設定された暗号要素Cと、前記平文μが設定され、前記属性xが満たすポリシーfに対応する復号鍵skによって復号されない暗号要素Fとを含む暗号文ctを取得する暗号文取得部と、
     ポリシーの集合であるポリシー集合Fを取得するポリシー取得部と、
     前記暗号文取得部によって取得された前記暗号文ctに含まれる前記暗号要素Cを、前記暗号要素Fにより、前記ポリシー取得部によって取得された前記ポリシー集合Fに対応する復号鍵skによって復号可能な暗号要素Cに変換することにより、前記暗号文ctを暗号文ctに変換する暗号文変換部と、
     前記暗号文変換部によって変換された前記暗号文ctに対して準同型演算gを行い暗号文ctを生成する準同型演算部と
    を備える準同型演算装置。
  2.  前記暗号要素Fには、乱数Rが設定され、
     前記暗号文ctには、前記乱数Rが暗号化された暗号要素Dが含まれ、
     前記暗号文変換部は、前記暗号要素Cを、前記暗号要素F及び前記暗号要素Dにより、前記暗号要素Cに変換する
    請求項1に記載の準同型演算装置。
  3.  前記暗号文ctは、数1に示す前記暗号要素Cと、数2に示す前記暗号要素Cと、数3に示す前記暗号要素Fと、数4に示す暗号要素Dとを含む
    請求項2に記載の準同型演算装置。
    Figure JPOXMLDOC01-appb-M000001
    Figure JPOXMLDOC01-appb-M000002
    Figure JPOXMLDOC01-appb-M000003
    Figure JPOXMLDOC01-appb-M000004
  4.  前記暗号変換部は、数5に示すように前記暗号要素Cを暗号要素C^に変換し、数6に示すように前記暗号要素C^を前記暗号要素Cに変換する
    請求項3に記載の準同型演算装置。
    Figure JPOXMLDOC01-appb-M000005
    Figure JPOXMLDOC01-appb-M000006
  5.  前記準同型演算部は、前記暗号要素Cに対して前記準同型演算gを行い暗号要素Cを生成し、前記暗号要素Fに対して前記準同型演算gを行い暗号要素Fを生成し、前記暗号要素Dを変換した暗号要素Dに対して前記準同型演算gを行い暗号要素Dを生成し、前記暗号要素Cと前記暗号要素Fと前記暗号要素Dとを含む前記暗号文ctを生成する
    請求項3又は4に記載の準同型演算装置。
  6.  前記暗号変換部は、数7に示すように前記暗号要素Dを前記暗号要素Dに変換する
    請求項5に記載の準同型演算装置。
    Figure JPOXMLDOC01-appb-M000007
  7.  前記準同型演算部は、前記暗号要素Cに対して準同型演算gを行い生成された暗号要素Cを含む前記暗号文ctを生成し、
     前記暗号文取得部は、前記準同型演算部によって生成された前記暗号文ctを取得し、
     前記暗号文変換部は、前記暗号文ctに含まれる前記暗号要素Cを、前記暗号要素Fにより、前記復号鍵skとは異なる復号鍵skF’によって復号可能な暗号要素Cに変換することにより、暗号文ctを暗号文ctに変換する
    請求項1に記載の準同型演算装置。
  8.  平文μが設定された暗号要素Cと、属性xが設定された暗号要素Cと、前記平文μが設定され、前記属性xが満たすポリシーfに対応する復号鍵skによって復号されない暗号要素Fとを含む暗号文ctを生成する暗号化装置と、
     前記暗号化装置によって生成された前記暗号文ctに含まれる前記暗号要素Cを、前記暗号要素Fにより、ポリシーの集合であるポリシー集合Fに対応する復号鍵skによって復号可能な暗号要素Cに変換することにより、前記暗号文ctを暗号文ctに変換し、変換された前記暗号文ctに対して準同型演算gを行い暗号文ctを生成する準同型演算装置と
    を備える暗号システム。
  9.  平文μが設定された暗号要素Cと、属性xが設定された暗号要素Cと、前記平文μが設定され、前記属性xが満たすポリシーfに対応する復号鍵skによって復号されない暗号要素Fとを含む暗号文ctを取得する暗号文取得処理と、
     ポリシーの集合であるポリシー集合Fを取得するポリシー取得処理と、
     前記暗号文取得処理によって取得された前記暗号文ctに含まれる前記暗号要素Cを、前記暗号要素Fにより、前記ポリシー取得処理によって取得された前記ポリシー集合Fに対応する復号鍵skによって復号可能な暗号要素Cに変換することにより、前記暗号文ctを暗号文ctに変換する暗号文変換処理と、
     前記暗号文変換処理によって変換された前記暗号文ctに対して準同型演算gを行い暗号文ctを生成する準同型演算処理と
    をコンピュータに実行させる準同型演算プログラム。
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