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WO2005093799A1 - 半導体装置の製造方法及び基板処理装置 - Google Patents

半導体装置の製造方法及び基板処理装置 Download PDF

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WO2005093799A1
WO2005093799A1 PCT/JP2005/005699 JP2005005699W WO2005093799A1 WO 2005093799 A1 WO2005093799 A1 WO 2005093799A1 JP 2005005699 W JP2005005699 W JP 2005005699W WO 2005093799 A1 WO2005093799 A1 WO 2005093799A1
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WO
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substrate
reaction furnace
semiconductor device
purge
manufacturing
Prior art date
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PCT/JP2005/005699
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English (en)
French (fr)
Inventor
Takaaki Noda
Kenichi Suzaki
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Kokusai Denki Electric Inc
Original Assignee
Hitachi Kokusai Electric Inc
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Publication date
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    • C—CHEMISTRY; METALLURGY
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    • H01L21/02617—Deposition types
    • H01L21/0262—Reduction or decomposition of gaseous compounds, e.g. CVD

Definitions

  • the present invention relates to a method for manufacturing a semiconductor device.
  • a thin film is formed on a substrate by a low pressure CVD method (chemical vapor deposition method).
  • a boron-doped silicon film is formed by a low pressure CVD method.
  • diborane has been used to dope a silicon film with boron.
  • a gas is introduced from the lower part of the furnace body while a plurality of wafers are vertically stacked and supported on a boat in the reaction furnace, raised vertically, and the gas is used to perform thermal CVD.
  • the force in the bottom region (lower region) in the CVD device is reduced over the entire region up to the top region (upper region).
  • the in-plane uniformity was poor at 10-20%.
  • Patent Document 1 JP-A-2003-178992
  • An object of the present invention is to provide a method of forming a boron-doped silicon film by low-pressure CVD using, for example, monosilane and trichloride boron, for example, in the case where boron is doped like boron. It is an object of the present invention to provide a method of manufacturing a semiconductor device capable of producing a film having good uniformity in element concentration and growth rate between batches.
  • a first feature of the present invention is that a step of carrying a substrate into a reaction furnace, a step of performing processing on the substrate in the reaction furnace, Performing a first purge by evacuating the reaction furnace and supplying inert gas at least once in a state in which the processed substrate is accommodated in the furnace; and Unloading the substrate, after unloading the processed substrate from the reaction furnace, and before loading the next substrate to be processed into the reaction furnace, in a state where at least a product substrate is not contained in the reaction furnace.
  • a step of performing a second purge by performing at least one or more of evacuation and supply of an inert gas to the reactor, and a pressure in the reactor per unit time in the second purge step.
  • the amount of pressure change in the reactor per unit time in the second purge step is greater than 30 PaZ seconds and 500 PaZ seconds or less.
  • a difference between a maximum pressure and a minimum pressure in the reaction furnace in the second purge step is determined by the first purge. The difference is made larger than the difference between the maximum pressure and the minimum pressure in the reaction furnace in the step.
  • the evacuation and the supply of the inert gas are repeated a plurality of times, and the evacuation and the inert gas in the second purging step are repeated.
  • the cycle of gas supply is shorter than the cycle of evacuation and inert gas supply in the first purge step.
  • the evacuation and the supply of the inert gas are repeated a plurality of times, and the evacuation and the supply of the inert gas in the second purge step are performed.
  • the number of cycles is Is larger than the number of cycles of the evacuation and the supply of the inert gas in the purge step.
  • the evacuation and the supply of the inert gas are repeated a plurality of times, and the inside of the reaction furnace is evacuated in the first purge step.
  • the first purging step is performed in a state in which a support for supporting a substrate is accommodated in the reaction furnace.
  • the second purging step includes at least a support that does not support a product substrate. This is performed in a state where the utensil is stored in the reaction furnace. More preferably, the first purging step is performed in a state where a support for supporting a substrate is accommodated in the reaction furnace, and the second purging step supports a dummy substrate without supporting a product substrate.
  • the above-mentioned support is accommodated in the reaction furnace.
  • a gas containing boron is used.
  • a boron-doped silicon film is formed on the substrate.
  • the second purge step is performed on the substrate.
  • This process is performed every time the process is performed.
  • a step of loading a substrate on a support a step of loading the support loaded with the substrate into a reaction furnace, and a step of loading the substrate in the reaction furnace Performing a process on the substrate; unloading the support supporting the processed substrate from the reaction furnace; and unloading the support and removing the processed substrate from the support.
  • the purging is performed by evacuating the reaction furnace and supplying the inert gas at least once without introducing a reactive gas into the reaction furnace.
  • the purging step is performed in a state where a dummy substrate is supported without supporting a product substrate on the support tool.
  • the purging step comprises: This is performed every time the processing is performed.
  • the amount of pressure change in the reactor per unit time in the purging step is set to more than 30 PaZ seconds and 500 PaZ seconds or less.
  • FCP is a method of generating a sudden pressure fluctuation by opening and closing the main valve in a short cycle in the reactor of a low-pressure CVD system, thereby purging the reactor strongly.
  • FCP it is possible to remove, for example, boron adhering to the inside of a reaction furnace, a boat, a dummy wafer, and the like, and to make the furnace state before film formation uniform, thereby achieving a boron concentration after film formation. And fluctuation of the growth rate can be suppressed.
  • a third feature of the present invention is that a reactor for processing a substrate, a gas supply line for supplying gas into the reactor, and a loading / unloading port for loading / unloading the substrate into / from the reactor. Controlling the apparatus so that the first purge is performed by evacuating the reaction furnace and supplying the inert gas at least once in a state where the processed substrate is accommodated in the reaction furnace, After unloading the substrate after processing from the reaction furnace and before loading the substrate to be processed next into the reaction furnace, vacuuming the reaction furnace in a state where at least a product substrate is not accommodated in the reaction furnace.
  • the second purge is controlled by supplying the inert gas at least once or more, and the pressure change amount in the reaction furnace per unit time in the second purge is determined by the first purge.
  • Unit time per purge And a controller for controlling the pressure change amount to be larger than the pressure change amount in the reaction furnace.
  • FIG. 1 is a schematic view showing a substrate processing apparatus according to an embodiment of the present invention.
  • FIG. 2 is a flowchart showing a film forming procedure in a method for manufacturing a semiconductor device according to an embodiment of the present invention.
  • FIG. 3 is a flowchart showing an FCP procedure in a method of manufacturing a semiconductor device according to an embodiment of the present invention.
  • FIG. 4 is a diagram showing a change in B concentration in three consecutive runs in an example according to the present invention.
  • FIG. 5 is a graph showing the dependence of the B concentration on the idling time between batches in Examples and Comparative Examples according to the present invention.
  • FIG. 6 is a diagram showing a change in growth rate in three consecutive runs in an example according to the present invention.
  • FIG. 7 is a graph showing the dependence of the growth rate on the inter-notch idling time in the example according to the present invention and the comparative example.
  • FIG. 8 is a diagram comparing a normal cycle purge and an FCP in the method of manufacturing a semiconductor device according to the embodiment of the present invention.
  • the cause of the boron concentration fluctuation between notches is considered as follows. That is, since the amount of boron before film formation desorbs from the inner wall of the reactor, the surface of the boat, etc., depending on the idling time between batches, the amount of boron doped during film formation changes, and the boron concentration fluctuates. It is possible.
  • the film growth occurs due to the catalytic effect of boron, it is considered that the growth rate fluctuates due to the fluctuation of the boron concentration.
  • a certain amount of boron trichloride before the film formation is passed through the furnace, It is conceivable that the inside of the furnace is coated beforehand. In the former case, there is a concern that boron segregates at the interface between the substrate and the film, and in the latter case, there is a concern that cleaning may be hindered by the oxidized wall surface during furnace gas cleaning. I can't say.
  • FCP Flust Cycle Purge
  • FIG. 1 shows a schematic structural diagram of a hot wall type batch type vertical pressure reduction CVD apparatus as a substrate processing apparatus of the present invention.
  • This decompression CVD apparatus uses monosilane (SiH) and trichloride boron (BC1) as reaction gas and uses it as a support in a reaction furnace. With a plurality of wafers vertically stacked and supported on the boat, gas is introduced from the lower part of the furnace body and raised vertically, and the gas is used to perform boron doping on the wafers by thermal CVD. It forms a silicon thin film, that is, a boron-doped amorphous silicon thin film or a boron-doped polysilicon thin film.
  • a hot-wall furnace which is a quartz-made reaction tube, which is an outer tube of the reaction furnace 12, that is, an outer tube, is provided inside heaters 6a-6d divided into four zones, which heats the ueno 4 as a substrate.
  • the tube 1 and the inner tube 2 inside the outer tube 1 are installed with their axes vertical!
  • a vacuum can be drawn between the two tubes by using a mechanical booster pump 7 and a dry pump 8. Therefore, the reaction gas introduced into the inner tube 2 rises vertically inside the inner tube 2 and descends between the two tubes to be exhausted.
  • a quartz boat 3 in which a plurality of uenos 4 are stacked vertically and aligned in the center is loaded in an inner tube 2.
  • reference numeral 10 denotes a boat rotation shaft, which is connected to a rotation mechanism 17.
  • a stainless steel lid (seal cap) 11 is connected to a boat elevator 18 as a loading / unloading device (elevating device).
  • the boat 3, the rotating shaft 10, the lid 11, and the rotating mechanism 17 are lifted and lowered by the boat elevator 18, so that the boat 3 is loaded into the reaction furnace 12 or unloaded. .
  • the lid 11 is in close contact with a stainless steel furnace Roman-hold 15 that supports the outer tube 1 and the inner tube 2 via an O-ring 11a as a sealing member to seal the inside of the reaction furnace 12. Further, the boat 3 is rotated in the reaction furnace 12 via the rotation shaft 10 by the rotation mechanism 17.
  • the boat 3 is provided with a total of 172 slots for supporting the ueno and the boat 4.
  • the tenth slot from the bottom slot to the tenth slot is the lower dummy area D1
  • the slots belonging to the lower dummy area D1 support the dummy wafer 4.
  • the product wafer area P is the 167th slot of the 11th force
  • the product wafer 4 is supported in the slots belonging to the product wafer area P.
  • the 168th to 172th slot is the top This is a dummy area D2, and a dummy ueno 4 is supported in a slot belonging to the upper dummy area D2.
  • the heater zone is located below the heater 6d corresponding to the L zone.
  • the top region T, the center region C, and the bottom region B in FIG. 1 are the region where the product wafer 4 up to the 167th slot and the product wafer 4 from the 37th to 128th slot, respectively. Indicates the area where the exists, the product ueno from the 11th to the 36th slot, and the area where the 4 exists.
  • the bottom L (Lower) zone corresponds to the area below the first slot where there is almost no wafer.
  • the second lower CL (Center Lower) zone (corresponding to heater 6c) corresponds to the area where dummy wafers 4 and product wafers 4 coexist in the 2nd to 56th slots, and the third lowermost zone
  • the second CU (Center Upper) zone from the top corresponds to the area where product wafer 4 and dummy wafer 4 coexist from slot 57 to slot 172, and the fourth from the bottom
  • the uppermost U (Upper) zone corresponds to the region where the upper wafer does not exist.
  • a nozzle (straight nozzle) 13 that supplies monosilane gas (SiH) is made of quartz.
  • the furnace is provided in a furnace ROM 15 below a region facing the heater and below the reaction tube.
  • the quartz nozzle 14 for supplying the Sanshio-Dani boron gas (BC1) has different lengths.
  • boron trichloride can be supplied from a plurality of locations on the way, and the partial pressure of the boron trichloride gas (BC 1) is adjusted at each position in the reactor 10.
  • nozzle straight nozzle 14a
  • nozzle 13 for supplying monosilane gas (SiH), in the area facing the heater.
  • each gas outlet is parallel to the wafer surface
  • the opening is directed in a desired direction, that is, in the horizontal direction, and each gas is ejected in a direction parallel to the wafer surface, that is, in the horizontal direction.
  • the gas outlets of the L-shaped nozzles 14b that supply boron trichloride gas (BC1) are
  • the opening is formed in a direction perpendicular to the surface, that is, upward in the vertical direction, and the gas is ejected in a direction perpendicular to the surface of the wafer, that is, in the vertical direction.
  • the nozzle 13 is connected to a gas line 20.
  • the gas line 20 is divided into two branches, and one of the two branches is connected to a monosilane gas (SiH 2) source 23 via a mass flow controller 21 as a flow rate control means and a valve 22.
  • SiH 2 monosilane gas
  • the other of the two branches is connected to a nitrogen gas (N) source 26 via a mass flow controller 24 as a flow rate control means and a valve 25.
  • N nitrogen gas
  • gas line 27 Connected to gas line 27.
  • This gas line 27 is connected to a boron trichloride gas (BC1) source 30 through a mass flow controller 28 as a flow control means and a valve 29.
  • BC1 boron trichloride gas
  • the mechanical booster pump 7 and the dry pump 8 described above are provided in an exhaust pipe 16 having one end connected to a furnace port manifold 15. Further, the exhaust pipe 16 is provided with a main valve 9. An APC (automatic pressure control) valve is used for the main valve 9, and the opening is automatically adjusted so that the pressure in the reaction furnace 12 becomes a predetermined value.
  • APC automatic pressure control
  • the controller 31 as a control means includes a heating temperature of the heaters 6a to 6d, opening and closing of the main valve 9, driving of the mechanical booster pump 7, driving of the dry pump 8, driving of the boat elevator 18, and driving of the rotating mechanism 17. It controls the drive, the opening of the mass flow controllers 21, 24 and 28, and the opening and closing of the knobs 22, 25 and 29.
  • step S10 the inside of the reactor 12 is cooled down to the film forming temperature. After the dwelling, the boat 3 loaded with the wafer 4 is inserted (inserted) into the reaction furnace 12 in step S12.
  • step S14 the inside of the reactor (reactor 12) is evacuated, and in the next step S16, N purging is performed in order to desorb water and the like adsorbed on the boat 3 and the tubes 1 and 2.
  • step S18 the leak in the reactor (reactor 12)
  • next step S20 the flow rates of monosilane and boron trichloride are set, the gas is flowed into the reaction furnace 12 to stabilize the pressure, and in the next step S22, the wafer 4 Next, a boron-doped silicon film, that is, a boron-doped amorphous silicon film or a boron-doped polysilicon film is formed.
  • the next step S24 the inside of the reaction tube and the inside of the tube are cycle purged with N (first purge step).
  • This first purge step is a normal cycle purge (Normal Cycle Purege: hereinafter referred to as NCP).
  • NCP Normal Cycle Purege
  • Cycle purge is performed only with the supply and stop of 2. After performing NCP for, for example, three to several cycles in step S24, the process proceeds to step S26.
  • the NCP purge conditions are, for example, as follows.
  • step S28 the boat 3 is unloaded, and in the next step S30, the jets 4 are naturally cooled. Finally, in step S32, take out Ueno 4 from boat 3.
  • FCP Figure 3 shows the procedure.
  • step S34 the boat 3 on which the product wafer is not loaded is loaded (inserted) into the reaction furnace 12 again.
  • the dummy wafer may be removed from the boat 3 or may be loaded.
  • step S36 the mechanical booster pump 7 and the dry pump 8 are driven to start evacuation.
  • the pressure in the reactor (reactor 12) reaches a predetermined value, for example, about 1. OkPa
  • step S38 the main valve 9 is opened and exhausted.
  • the main valve 9 is closed, and in the next step S42, N gas is again supplied to the reactor (reactor 12).
  • step S44 it is determined whether or not the force of the cycle of steps S38-S42 has reached a predetermined value, for example, 100 times. If the force has not reached the predetermined value, the process returns to step S38, and this cycle is repeated until the predetermined value is reached. repeat.
  • Step S38 If the step of S42 has reached the predetermined value, the process proceeds to the next step S46. In step S46, N is introduced into the reactor 12 until the pressure in the reactor 12 reaches the atmospheric pressure.
  • step S48 is introduced into the reactor 12 until the pressure in the reactor 12 reaches the atmospheric pressure.
  • step 3 unload the boat 3 with no product wafer loaded, and in step S50, if a dummy wafer is loaded in the boat 3, cool the dummy wafer, and in the next step S52, That is, the film formation shown in FIG. 2 is started.
  • the FCP is preferred! /
  • the purge conditions are as follows.
  • Pressure change per unit time 30 PaZ seconds to 500 PaZ seconds, preferably lOOPaZ seconds to 500 PaZ seconds
  • the FCP is characterized by an extremely large pressure change per unit time as compared with a normal cycle purge! /, (Speed,).
  • FIG. 8 is a graph comparing the FCP shown in Steps S38-S44 and the NCP shown in Step S24 with a graph showing the amount of pressure change in the reactor with the passage of time.
  • the horizontal axis of the graph represents the passage of time (seconds), and the vertical axis represents the pressure (Pa) in the reactor.
  • MV open and “N2 STOP” refer to the operation of stopping the supply of N2 while the main valve is open in the FCP, and are indicated by hatched circles.
  • M.V.closed and N2IN indicate the operation of supplying N2 with the main valve closed, and are indicated by white circles.
  • N2 STOP refers to an operation of stopping supply of N2 in the NCP, and is indicated by a black inverted triangle.
  • N2 IN means an operation of stopping supply of N2 in the NCP, and is indicated by a white inverted triangle.
  • the solid line shows the pressure change at FCP, and the dotted line shows the pressure change at NCP.
  • the FCP opens and closes the main valve (MV) to perform cycle purge.
  • the NCP supplies N while the main knob remains open.
  • Cycle purge is performed by stopping.
  • the pressure change in the reactor per unit time of FCP is larger than that of NCP.
  • the maximum pressure change per unit time is about 7 PaZ seconds, while in FCP it is about 500 PaZ seconds.
  • the difference between the maximum pressure and the minimum pressure (pressure fluctuation width) of FCP is larger than that of NPC.
  • the pressure fluctuation range is 1000-1200Pa, whereas in NCP it is about 20-100Pa.
  • FCP also has a larger number of cycles than NCP. For example, in FCP, the number of cycles is 10 to 200, whereas in NCP, it is 3 to several.
  • the total pressure in the reaction furnace 12 was 66.5 Pa
  • the SiH flow rate was 0.2 slm
  • the flow rate was set to 0.002slm and the furnace temperature was set to 380-400 ° C.
  • the FCP has a maximum pressure (the ultimate pressure when supplying N2) of 1200 Pa, a minimum pressure (the ultimate pressure during evacuation) of 0.1 lPa, a time per cycle of lmin, and a pressure fluctuation from the maximum pressure to the minimum pressure. 5 seconds, 100 cycles, total time 100 min, N
  • the film forming process was performed in the same manner as in the example, and the FCP was not performed.
  • Fig. 4 the dependence of the B concentration on the number of batches (runs) in the example, that is, the product in which the boron (B) concentration in three consecutive runs is placed in the slot (# 89) in the center area is shown. The measured results are shown for the wafer. By conducting the FCP, it was confirmed that the fluctuation of the B concentration was less than 2%.
  • FIG. 5 shows the dependency of the B concentration between batches on the idle time between the example and the comparative example.
  • the B concentration sharply decreases after 2 to 6 hours of idling, and its variation including B concentration after 24 hours of idling is about ⁇ 4%.
  • the B concentration change was less than ⁇ 2% even after idling for 24 hours. ing. From the results in FIGS. 4 and 5, it can be seen that the FCP can improve the uniformity of the B concentration between batches.
  • FIG. 6 the dependence of the growth rate of the boron-doped silicon thin film of the example on the number of batches (runs), that is, the change in the growth rate in three consecutive runs is represented by the top region slot (# 167) and the bottom region slot.
  • the measurement results of the product wafer placed in (# 11) are shown. By conducting the FCP, it was confirmed that the fluctuation of the growth rate was less than 2%.
  • FIG. 7 shows the dependence of the growth rate of the boron-doped silicon thin film on the idle time between batches in the example and the comparative example.
  • the growth rate varied greatly depending on the idle time between batches, whereas in the example (with FCP), the growth rate fluctuated even after idling for 24 hours, and even after idling for 38 hours. Is almost nonexistent. From the results shown in FIGS. 6 and 7, it is understood that the FCP can improve the uniformity between the notches in the growth rate.
  • the FCP is composed of BC1 and C1 components adhering to the components inside the reactor, ie, boats and dummy wafers, as well as the inner walls of reaction tubes, manifolds, seal caps, and the like.
  • a substrate processing apparatus comprising: control means for performing control so as to repeatedly perform evacuation and supply of an inert gas to a reaction furnace without a plate.
  • This invention can be utilized for the manufacturing method of the semiconductor device which has the process of processing a board

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Abstract

　本発明の目的は、例えばモノシランと三塩化ホウ素とを使用し、減圧ＣＶＤ法によってボロンドープシリコン膜を成膜するような場合、例えばボロンのようにドープされる元素の濃度と成長速度とのバッチ間均一性が良好な膜を作製することができる半導体装置の製造方法を提供することにある。 　本発明は、反応炉内に処理後の基板を収容した状態で、前記反応炉に対する真空引きと不活性ガスの供給を少なくとも１回以上行うことにより第１のパージを行うステップと、処理後の基板を前記反応炉より搬出後、次に処理する基板を前記反応炉内に搬入する前に、前記反応炉に少なくとも製品基板を収容していない状態で、前記反応炉に対する真空引きと不活性ガスの供給とを少なくとも１回以上行うことにより第２のパージを行うステップ（Ｓ３８～Ｓ４４）とを有する。

Description

明 細 書
半導体装置の製造方法及び基板処理装置 技術分野
[0001] 本発明は、半導体装置を製造する方法に関する。
背景技術
[0002] IC、 LSI等の半導体装置を製造する工程にぉ 、ては、減圧 CVD法 (化学気相堆 積法）によって、基板上に薄膜を成膜することが行われている。そのような成膜方法 の 1つとして、減圧 CVD法によって、ボロンをドープしたシリコン膜を成膜することが 実施されている。従来、シリコン膜にボロンをドープするのにジボランが用いられてい た。この場合に、反応炉内でボートに複数枚のウェハを垂直方向に積層支持した状 態で、炉体下部よりガスを導入し、垂直方向に上昇させ、そのガスを用いて、熱 CVD 法により、前記ウェハ上に薄膜を形成する減圧 CVD装置を用いると、 CVD装置内の ボトム領域 (下部領域)力もトップ領域 (上部領域)までの全領域にぉ 、て、膜厚およ び抵抗率の面内均一性が 10— 20%と悪かった。
上記の膜厚面内均一性は、ジボランに代えて三塩ィ匕ホウ素を用いることによって大 幅に改善され、全領域で膜厚面内均一性が 1%以下であるようなボロンドープポリシ リコン膜が得られることが判明している (特許文献 1参照)。
[0003] 特許文献 1：特開 2003— 178992号公報
発明の開示
発明が解決しょうとする課題
[0004] し力しながら、シリコンに三塩ィ匕ホウ素を用いてボロンをドープした膜を成膜する場 合において、成膜ラン (成膜バッチ処理)と次の成膜ランとの間が空くと、次の成膜ラ ンにお 、て B (ホウ素)濃度と成長速度が減少してしまうと 、う問題があり、この場合、 次の成膜ランでは製品を入れないで一度成膜ランを実施してカゝら連続で製品を入れ て成膜ランを実施する必要があった。
[0005] ところが、製品を入れないで一度成膜ランを実施すると、製品処理の効率が悪くなり 、また時間を力 4ナてランを実施しても必ずしも再現性良く B濃度と成長速度が得られ るものではない。
[0006] 本発明の目的は、例えばモノシランと三塩ィ匕ホウ素とを使用し、減圧 CVD法によつ てボロンドープシリコン膜を成膜するような場合、例えばボロンのようにドープされる元 素の濃度と成長速度とのバッチ間均一性が良好な膜を作製することができる半導体 装置の製造方法を提供することにある。
課題を解決するための手段
[0007] 上記課題を解決するため、本発明の第 1の特徴とするところは、基板を反応炉内に 搬入するステップと、前記反応炉内で基板に対して処理を行うステップと、前記反応 炉内に処理後の基板を収容した状態で、前記反応炉に対する真空引きと不活性ガ スの供給を少なくとも 1回以上行うことにより第 1のパージを行うステップと、前記反応 炉より処理後の基板を搬出するステップと、処理後の基板を前記反応炉より搬出後、 次に処理する基板を前記反応炉内に搬入する前に、前記反応炉に少なくとも製品基 板を収容していない状態で、前記反応炉に対する真空引きと不活性ガスの供給とを 少なくとも 1回以上行うことにより第 2のパージを行うスッテツプとを有し、前記第 2のパ ージステップにおける単位時間当たりの反応炉内の圧力変化量を、前記第 1のパー ジステップにおける単位時間当たりの反応炉内の圧力変化量よりも大きくした半導体 装置の製造方法にある。
[0008] 好適には、前記第 2のパージステップにおける単位時間当たりの反応炉内の圧力 変化量を 30PaZ秒より大きく 500PaZ秒以下とする。また好適には、請求項 1に記 載した半導体装置の製造方法にお 、て、前記第 2のパージステップにおける前記反 応炉内の最大圧力と最小圧力との差を、前記第 1のパージステップにおける前記反 応炉内の最大圧力と最小圧力との差よりも大きくする。また好適には、前記第 1のパ ージステップ及び第 2のパージステップにお 、ては、真空引きと不活性ガスの供給を 複数回繰り返すようにし、前記第 2のパージステップにおける真空引きと不活性ガス 供給のサイクルを、前記第 1のパージステップにおける真空引きと不活性ガス供給の サイクルよりも短くする。また好適には、前記第 1のパージステップ及び第 2のパージ ステップにおいては、真空引きと不活性ガスの供給を複数回繰り返すようにし、前記 第 2のパージステップにおける真空引きと不活性ガス供給のサイクル数を、前記第 1 のパージステップにおける真空引きと不活性ガス供給のサイクル数よりも多くする。ま た好適には、前記第 1のパージステップ及び第 2のパージステップにおいては、真空 引きと不活性ガスの供給を複数回繰り返すようにし、前記第 1のパージステップでは、 前記反応炉内を排気する排気ラインに設けられた排気バルブを開いた状態で前記 反応炉内に不活性ガスを供給し、前記第 2のパージステップでは、前記排気バルブ を閉じた状態で前期反応炉内に不活性ガスを供給する。また好適には、前記第 1の パージステップは、基板を支持した支持具を前記反応炉内に収容した状態で行!ヽ、 前記第 2のパージステップは、少なくとも製品基板を支持していない支持具を前記反 応炉内に収容した状態で行う。また好適には、前記第 1のパージステップは、基板を 支持した支持具を前記反応炉内に収容した状態で行い、前記第 2のパージステップ は、製品基板を支持することなくダミー基板を支持した支持具を前記反応炉内に収 容した状態で行う。また好適には、前記基板処理ステップでは、ホウ素を含むガスを 用いる。また好適には、前記基板処理ステップでは、基板上にボロンドープシリコン 膜を形成する。また好適には、前記基板処理ステップでは、モノシラン (SiH )と三塩
4 化ホウ素（BC1 )を用いる。また好適には、前記第 2のパージステップは、基板に対す
3
る処理を行う度に毎回行う。
[0009] 本発明の第 2の特徴とするところは、基板を支持具に装填するステップと、基板を装 填した前記支持具を反応炉内にロードするステップと、前記反応炉内で基板に対し て処理を行うステップと、処理後の基板を支持した前記支持具を反応炉よりアンロー ドするステップと、前記支持具をアンロードした後、処理後の基板を前記支持具より取 り出すステップと、処理後の基板を取り出した後、少なくとも製品基板を前記支持具 に装填することなく前記支持具を前記反応炉内にロードするステップと、少なくとも製 品基板を装填して!/、な!、前記支持具を前記反応炉内に収容した状態で、前記反応 炉内に反応性ガスを導入することなく前記反応炉に対する真空引きと不活性ガスの 供給を少なくとも 1回以上行うことによりパージを行うステップと、を有することを特徴と する半導体装置の製造方法にある。
[0010] 好適には、前記パージステップは、前記支持具に製品基板を支持することなくダミ 一基板を支持した状態で行う。また好適には、前記パージステップは、基板に対する 処理を行う度に毎回行う。また好適には、前記パージステップにおける単位時間当た りの反応炉内の圧力変化量を 30PaZ秒より大きく 500PaZ秒以下とする。
[0011] 前記第 2のパージステップ又はパージステップにおいては、 FCP (Fast Cycle
Purge)を用いるとよい。 FCPとは、減圧 CVD装置の反応炉内において、メインバル ブをショートサイクルで開閉することによって急激な圧力変動を発生させて、反応炉 内を強力にパージする方法である。この FCPを用いると、反応炉内、ボート、ダミーゥ ェハ等に付着した例えばホウ素を除去し、成膜前の炉内状態を一様にすることがで き、これにより成膜後のホウ素濃度や成長速度の変動を抑えることができる。
[0012] 本発明の第 3の特徴とするところは、基板を処理する反応炉と、前記反応炉内にガ スを供給するガス供給ラインと、前記反応炉内に基板を搬入搬出する搬入搬出装置 と、前記反応炉内に処理後の基板を収容した状態で、前記反応炉に対する真空引き と不活性ガスの供給を少なくとも 1回以上行うことにより第 1のパージを行うように制御 すると共に、処理後の基板を前記反応炉より搬出後、次に処理する基板を前記反応 炉内に搬入する前に、前記反応炉内に少なくとも製品基板を収容しない状態で、前 記反応炉に対する真空引きと不活性ガスの供給を少なくとも 1回以上行うことにより第 2のパージを行うように制御し、更に、前記第 2のパージにおける単位時間当たりの反 応炉内の圧力変化量を、前記第 1のパージにおける単位時間当たりの反応炉内の 圧力変化量よりも大きくするように制御するコントローラと、を有する基板処理装置に ある。
本発明の基板処理装置においては、前述した種々の方法を実施することができる。 図面の簡単な説明
[0013] [図 1]本発明の実施形態に係る基板処理装置を示す概略図である。
[図 2]本発明の実施形態に係る半導体装置の製造方法における成膜手順を示すフロ 一チャートである。
[図 3]本発明の実施形態に係る半導体装置の製造方法における FCP手順を示すフ ローチャートである。
[図 4]本発明に係る実施例において連続 3ランでの B濃度の変化を示す図である。
[図 5]本発明に係る実施例と比較例とにおいて B濃度のバッチ間アイドリング時間依 存性を示す図である。
[図 6]本発明に係る実施例において連続 3ランでの成長速度の変化を示す図である。
[図 7]本発明に係る実施例と比較例とにおいて成長速度のノ ツチ間アイドリング時間 依存性を示す図である。
[図 8]本発明の実施形態に係る半導体装置の製造方法において、通常サイクルパー ジと FCPとを比較した図である。
発明を実施するための最良の形態
[0014] 次に本発明の実施形態を図面に基づいて説明する。
本発明がなされる前の予備的考察として、ノツチ間のボロン濃度変動の原因は次 のように考えられる。即ち、成膜前のボロンの、反応炉内壁面やボート表面等からの 脱離量力バッチ間のアイドリング時間により異なってくるため、成膜時にドープされる ボロン量が変化してボロン濃度が変動することが考えられる。
また、本実施形態のプロセスではボロンの触媒効果により膜成長が起こるため、ボ ロン濃度が変動することで成長速度が変動することが考えられる。成長前のボロンの 、反応炉内壁面やボート表面等力 の脱離量をできるだけ一定にするには、成膜前 にある一定量の三塩ィ匕ホウ素を炉内に流すことや、成膜前に炉内を酸ィ匕コ一ティン グすることが考えられる。し力し前者は基板と膜との界面にボロンが偏析する懸念が あり、後者は炉内ガスクリーニング時に酸ィ匕された壁面でクリーニングが阻害される懸 念があり、いずれも好ましい方策とはいえない。そこで、本発明者は、鋭意検討の結 果、これらの問題を解決することができる FCP (Fast Cycle Purge)という強力なパ ージ方法を見出した。この FCPを成膜前に常時行うことにより、反応炉内壁面やボー ト表面等力 のボロンの脱離を促進させ、成膜前のボロンの反応炉内壁面やボート 表面等からの脱離量を安定化させることができ、バッチ間のボロン濃度や成長速度 の安定 ¾を改善できることが判明した。
本発明の実施形態は、このような考察に基づいてなされたものである。
[0015] 図 1において、本発明の基板処理装置としてのホットウォール式のバッチ式縦型減 圧 CVD装置の構造概略図が示されている。この減圧 CVD装置は、反応ガスとして モノシラン (SiH )と三塩ィ匕ホウ素（BC1 )とを使用して、反応炉内で支持具としての ボートに複数枚のウェハを垂直方向に積層支持した状態で、炉体下部よりガスを導 入し垂直方向に上昇させ、そのガスを用いて、熱 CVD法により、前記ウェハ上に、ボ ロンドープシリコン薄膜、すなわち、ボロンドープアモルファスシリコン薄膜またはボロ ンドープポリシリコン薄膜を形成するものである。
[0016] ホットウォール炉を構成し、基板としてのウエノ、 4を加熱する、 4ゾーンに分かれたヒ ータ 6a— 6dの内側に、反応炉 12の外筒である石英製の反応管すなわちアウターチ ユーブ 1およびアウターチューブ 1内部のインナーチューブ 2が、軸を垂直にして設置 されて!/、る。この 2種のチューブの間をメカ-カルブースタポンプ 7およびドライポンプ 8を用いて真空引きができるようにしてある。従って、インナーチューブ 2内側に導入 される反応ガスは、インナーチューブ 2内を垂直に上昇し、 2種のチューブの間を下 降して排気される。複数枚のウエノ、 4が中心をそろえて垂直方向に積層して装填され た石英製のボート 3はインナーチューブ 2内に設置されている。ウェハ 4が反応ガスに さらされた時に、気相中およびウェハ 4表面での反応により、ウェハ 4上に薄膜が形 成される。なお、ボート 3のウェハ 4の装填された領域よりも下方の領域に装填された 断熱板 5は、ウエノ、 4が存在する位置範囲内の温度を均一化するためのものである。 また、図 1中、 10はボート回転軸であり、回転機構 17に連結されている。また、 11は ステンレス製の蓋 (シールキャップ)であり、搬入搬出装置 (昇降装置）としてのボート エレベータ 18に連結されている。このボートエレベータ 18により、ボート 3、回転軸 10 、蓋 11及び回転機構 17がー体となって昇降させられ、ボート 3を反応炉 12内にロー ドし、あるいはアンロードさせるようになつている。蓋 11は、アウターチューブ 1および インナーチューブ 2を支持するステンレス製の炉ロマ-ホールド 15に、シール部材と しての Oリング 11aを介して密着して反応炉 12内を密閉する。また、回転機構 17によ り、回転軸 10を介してボート 3が反応炉 12内で回転させられるようになつている。
[0017] なお、ボート 3には、ウエノ、 4を支持するスロットが合計 172個設けられている。例え ば一番下のスロットから数えて 10スロット目までが下部ダミー領域 D1であり、この下 部ダミー領域 D1に属するスロットにはダミーウェハ 4が支持される。また、例えば 11 力も 167スロット目までが製品ウェハ領域 Pであり、この製品ウェハ領域 Pに属するス ロットには製品ウェハ 4が支持される。また、例えば 168から 172スロット目までが上部 ダミー領域 D2であり、この上部ダミー領域 D2に属するスロットにはダミーウエノ、 4が 支持される。なお、ボート 3のウェハ配列領域 (D2、 P、 D1)よりも下方には、複数枚 の断熱板 5を支持する複数のスロットが設けられており、断熱板 5は、後述する 4つに 分かれたヒータゾーンのうち Lゾーンに対応するヒータ 6dよりも下側に配置される。ま た、図 1中のトップ領域 T、センタ領域 C、ボトム領域 Bとは、それぞれ、 129力 167 スロット目までの製品ウェハ 4の存在する領域、 37から 128スロット目までの製品ゥェ ハ 4の存在する領域、 11から 36スロット目までの製品ウエノ、 4の存在する領域のこと を示している。また、 4つに分かれたヒータゾーンのうち、一番下の L(Lower)ゾーン (ヒ ータ 6dに対応)は 1スロット目より下側の、ウェハが殆ど存在しない領域に対応してお り、下から二番目の CL(Center Lower)ゾーン (ヒータ 6cに対応)は 2から 56スロット目ま でのダミーウェハ 4と製品ウェハ 4とが混在する領域に対応しており、下から三番目す なわち上から二番目の CU(Center Upper)ゾーン (ヒータ 6bに対応)は 57から 172スロ ット目までの製品ウェハ 4とダミーウェハ 4とが混在する領域に対応しており、下から 四番目すなわち一番上の U(Upper)ゾーン (ヒータ 6aに対応)はそれより上側のウェハ の存在しな 、領域に対応して 、る。
モノシランガス (SiH )を供給する例えば石英製のノズル (ストレートノズル） 13はヒ
4
ータと対向する領域より下方であって反応管下方の炉ロマ-ホールド 15に設けられ ている。三塩ィ匕ホウ素ガス (BC1 )を供給する例えば石英ノズル 14は、長さの異なる
3
ものが複数本反応炉 12内に設置されており、三塩化ホウ素を複数箇所から途中供 給することが可能であり、三塩ィ匕ホウ素ガス (BC1 )の分圧を反応炉 10内各位置にお
3
いて制御することができる。即ち、三塩ィ匕ホウ素ガス (BC1 )を供給する石英ノズル 14
3
は複数本、ここでは合計 5本設けられており、そのうちの 1本のノズル (ストレートノズル 14a)は、モノシランガス（SiH )を供給するノズル 13とともにヒータと対向する領域よ
4
り下方であって反応管下方の炉口マ-ホールド 15に設けられており、その他の 4本 のノズル (L字状ノズル） 14bは、前記炉ロマ-ホールドを通り、それぞれの噴出口が 30スロット目、 70スロット目、 110スロット目、 150スロット目の位置に対応するように、 それぞれ等間隔に設けられており、三塩ィ匕ホウ素を、反応炉 10内の垂直方向におけ る複数箇所から途中供給可能に構成されている。 なお、モノシランガス（SiH )を供給するストレートノズル 13と三塩化ホウ素ガス（BC
4
1 )を供給するストレートノズル 14aとは、それぞれのガス噴出口がウェハ表面と平行
3
な方向、すなわち水平方向に向いて開口しており、それぞれのガスをウェハ表面と平 行な方向、すなわち水平方向に向力つて噴出させるように構成されている。また、三 塩化ホウ素ガス (BC1 )を供給する複数の L字状ノズル 14bのガス噴出口はウェハ表
3
面とは垂直な方向、すなわち鉛直方向上方に向けて開口しており、ガスをウェハ表 面とは垂直な方向、すなわち鉛直方向に向力つて噴出させるように構成されている。
[0019] また、ノズル 13は、ガスライン 20に接続されている。このガスライン 20は、 2股に別 れ、この 2股に分かれた一方が流量制御手段としてのマスフローコントローラ 21及び バルブ 22を介してモノシランガス（SiH )源 23に接続されている。また、ガスライン 20
4
の 2股に別れた他方は、流量制御手段としてのマスフローコントローラ 24及びバルブ 25を介して窒素ガス（N )源 26に接続されている。 5本のノズル 14は、 5本に別れた
2
ガスライン 27に接続されている。このガスライン 27は、流量制御手段としてのマスフ口 一コントローラ 28及びバルブ 29を介して三塩化ホウ素ガス（BC1 )源 30に接続され
3
ている。
[0020] 前述したメカ-カルブースタポンプ 7とドライポンプ 8とは、一端が炉口マ-ホールド 15に接続された排気管 16に設けられている。さらに、この排気管 16にはメインバル ブ 9が設けられている。このメインバルブ 9には、 APC (automatic pressure control)バ ルブが用いられており、反応炉 12内の圧力を所定値となるよう自動的に開度を調節 するようになっている。
[0021] なお、制御手段としてのコントローラ 31は、ヒータ 6a— 6dの加熱温度、メインバルブ 9の開閉、メカ-カルブースタポンプ 7、ドライポンプ 8の駆動、ボートエレベータ 18の 駆動、回転機構 17の駆動、マスフローコントローラ 21、 24、 28の開度、ノ レブ 22、 2 5、 29の開閉等を制御する。
[0022] 次に上記基板処理装置を用いて、半導体装置の製造工程の一工程として基板上 にボロンドープシリコン膜を生成する成膜方法について説明する。成膜手順を図 2に 示す。なお、以下の説明において、基板処理装置を構成する各部の動作はコント口 ーラ 31により制御される。まずステップ S10において、反応炉 12内を成膜温度に安 定ィ匕させた後、ステップ S12においてウェハ 4を装填したボート 3を反応炉 12内に口 ード (挿入)する。次にステップ S14においてリアクター (反応炉 12)内を排気し、次の ステップ S16において、ボート 3やチューブ 1、 2に吸着した水分等を脱離させるため に Nパージを行なう。次のステップ S18においては、リアクター（反応炉 12)内リーク
2
チェックを行なった後、次のステップ S20において、モノシランと三塩化ホウ素の流量 を設定し、反応炉 12内にガスを流して圧力を安定ィ匕させ、次のステップ S 22におい て、ウェハ 4上にボロンドープシリコン膜、すなわち、ボロンドープアモルファスシリコン 膜またはボロンドープポリシリコン膜の成膜を行なう。成膜が終了したら次のステップ S24において、反応管内及び配管内を Nでサイクルパージする（第 1のパージステツ
2
プ)。
[0023] この第 1のパージステップは通常のサイクルパージ（Normal Cycle Purege:以下 NC Pという）であり、メインバルブ 9は開いたままで、前述したバルブ 25を開閉して Nガス
2 の供給、停止のみでサイクルパージを実施する。ステップ S24で NCPを例えば 3— 数サイクル実施した後、ステップ S26へ進む。 NCPのパージ条件は例えば次の通り である。
1サイクルあたりの時間： 4一 6min
1サイクルあたりの真空引き時間： 2— 3min
1サイクルあたりの N供給時間： 2— 3min
2
トータル時間： 12— 18min
最小圧力（真空引きの際の到達圧力）：0. 05— lPa
最大圧力（N供給時の到達圧力）： 20— lOOPa
2
サイクル数： 3 数回
N供給量： 0. 5— lslm
2
単位時間当たりの圧力変化量： 7PaZ秒以下
[0024] 次のステップ S26において、 Nでリアクター内を大気圧まで戻す。大気圧に戻った
2
ら次のステップ S28においてボート 3をアンロードし、次のステップ S30においてゥェ ノ、 4を自然冷却する。最後にステップ S32にお 、てウエノ、 4をボート 3から取り出す。
[0025] 次に成膜終了後の反応炉内を FCPにてパージする方法について説明する。 FCP 手順を図 3に示す。図 2に示した成膜が終了した後、ステップ S34において、製品ゥ ェハを装填していないボート 3を再度反応炉 12にロード (挿入)する。この場合、ダミ 一ウェハはボート 3から除いてもよいし、装填しておいてもよい。次にステップ S36に ぉ 、て、メカニカルブースタポンプ 7とドライポンプ 8とを駆動して真空引きを開始する 。リアクター (反応炉 12)内の圧力が所定値、例えば 1. OkPa程度になったら、次のス テツプ S38でメインバルブ 9を一気に開けて排気する。次のステップ S40においては 、メインバルブ 9を閉じ、次のステップ S42で再度 Nガスをリアクター（反応炉 12)に
2
導入する。次のステップ S44においては、ステップ S38— S42のサイクルが所定値、 例えば 100回に達した力否かを判定し、所定値に達していない場合はステップ S38 に戻り、所定値に達するまでこのサイクルを繰り返す。ステップ S38— S42のステップ が所定値に達した場合は次のステップ S46に進む。ステップ S46においては、反応 炉 12内の圧力が大気圧になるまで反応炉 12内に Nを導入する。次のステップ S48
2
において、製品ウェハを装填していないボート 3をアンロードし、次のステップ S50に おいて、ボート 3にダミーウェハを装填していた場合は、ダミーウェハを冷却し、次の ステップ S52において、次のバッチ、すなわち図 2に示した成膜を開始する。
なお、 FCPの好まし!/、パージ条件は次の通りである。
1サイクルあたりの時間： 0. 5— 2min
1サイクルあたりの真空引き時間： 0. 25— lmin
1サイクルあたりの N供給時間： 0. 25— lmin
2
トータル時間： 20— lOOmin
最小圧力（真空引きの際の到達圧力）：0. 05— lPa
最大圧力（N供給時の到達圧力）： 1000— 1200Pa
2
サイクル数： 10 200回
N供給量： 0. 5— lslm
2
単位時間当たりの圧力変化量： 30PaZ秒一 500PaZ秒、好ましくは lOOPaZ秒 一 500PaZ秒
なお、単位時間当たりの圧力変化量が 500PaZ秒を越えると、反応炉ゃポンプへ の負担が大きなつて基板処理装置のインターロック上実施するのは難しい。 このように、 FCPは通常のサイクルパージと比較して、単位時間あたりの圧力変化 量が極めて大き!/、（速 、）ことが特徴である。
[0026] 図 8にステップ S38— S44に示した FCPと、ステップ S24に示した NCPとの、時間 の経過に対する反応炉内の圧力変化量を表すグラフを比較して示す。グラフの横軸 は、時間の経過 (秒)を、縦軸は反応炉内の圧力（Pa)をそれぞれ表して 、る。図中 M. V.開、 N2 STOPとは、 FCPにおいてメインバルブを開いた状態で N2の供給 を停止する動作をいい、ハッチングをかけた丸で示す。また、図中 M. V.閉、 N2 I Nとは、メインバルブを閉じた状態で N2を供給する動作をいい、白丸で示す。また、 図中 N2 STOPとは、 NCPにおいて、 N2の供給を停止する動作をいい、黒の逆三 角で示す。また、図中 N2 INとは、 NCPにおいて、 N2を供給を停止する動作をい い、白の逆三角で示す。また、実線は FCPにおける圧力変化を、点線は NCPにおけ る圧力変化をそれぞれ表している。上述のように FCPはメインバルブ (M. V. )を開 閉してサイクルパージを行う。一方、 NCPは、メインノ レブは開いたままで Nの供給
2
、停止によりサイクルパージを行う。
図 8からも分力るように、 FCPは、 NCPと比較して単位時間当たりの反応炉内の圧 力変化量が大きい。例えば NCPでは単位時間当たりの圧力変化量が最大で 7PaZ 秒程度であるのに対し、 FCPでは最大で 500PaZ秒程度である。また、 FCPは、 NP Cと比較して最大圧力と最小圧力との差 (圧力変動幅）が大きい。例えば FCPでは圧 力変動幅が 1000— 1200Paであるのに対し、 NCPでは 20— lOOPa程度である。ま た、 FCPは、 NCPと比較してサイクル数が多い。例えば FCPではサイクル数が 10— 200回であるの〖こ対し、 NCPでは 3—数回である。
[0027] 上述したように、 FCPは NCPと比較して特に反応炉内での単位時間当たりの圧力 変化量が大きいので (FCPの単位時間当たりの圧力変化量は NCPの 4一 70倍以上 )、単位時間当たりに反応炉内を通過するガス流量、すなわちパージに寄与するガス 流量も多くなり、圧倒的にパージ効果が大きい。
[0028] 特に三塩化ホウ素（BC1 )を用いるプロセスを行う場合、 NCPのみを行うようにする
3
と、温度の比較的低いボトム領域 B力 炉ロ部にかけての領域には、 BC1が離脱し
3 やすい形態で多く存在する。このようにして残留した BC1は、ボートアンロードの際に HC1となって炉口部（ステンレス製のマ-ホールドやシールキャップ等）を腐食させる 原因となり、次の成膜ランにおけるボロンドープシリコン膜の成長速度等に影響を及 ぼす。すなわち、特に三塩ィ匕ホウ素（BC1 )を用いるプロセスを行う場合には、 NCP
3
では、十分なパージ効果は得られない。そこで、上記実施形態では、 FCPという強力 なパージを実施するようにしている。これにより上記低温部に残留しょうとする BC1を
3 十分に除去することができ、次の成膜ランにおける基板処理に影響を及ぼさな 、よう にすることができる。
[0029] 次に実施例と比較例について説明する。
実施例：
前述した減圧 CVD装置を用い、反応ガスとしてモノシラン (SiH )と三塩ィ匕ホウ素（
4
BC1 )とを使用して、ボロンドープシリコン薄膜を形成した。成膜処理を行った毎に F
3
CPを実施した。
成膜処理は、反応炉 12内のトータル圧力を 66. 5Pa、 SiH流量を 0. 2slm、 BC1
4 3 流量を 0. 002slm、炉内温度を 380— 400° Cとして実施した。
FCPは、最大圧力（N2供給時の到達圧力）を 1200Pa、最小圧力（真空引きの際 の到達圧力）を 0. lPa、 1サイクル当たりの時間を lmin、圧力を最大圧力から最小 圧力までに変動させる時間を 5秒、サイクル数を 100回、トータル時間を 100min、 N
2供給量を lslmとして実施した。
比較例：
実施例と同様に成膜処理を行 ヽ、 FCPは実施しなカゝつた。
[0030] 図 4にお 、て、実施例の B濃度のバッチ（ラン）回数依存性、即ち連続 3ランでのボ ロン (B)濃度をセンタ領域のスロット（ # 89)に載置した製品ウェハにっ 、て測定した 結果が示されている。 FCPを実施することにより、 B濃度の変動は 2%未満に収まつ ていることが確認できた。
[0031] 図 5にお 、て、実施例と比較例との B濃度のバッチ間アイドル時間依存性が示され ている。比較例 (FCP無し)では、 B濃度は 2— 6時間のアイドリングで急激に減少し、 24時間アイドリング後の B濃度も含めてそのばらつきは約 ±4%である。それに対し、 実施例 (FCP有り）では、 24時間アイドリング後でも B濃度変化は ± 2%未満に収まつ ている。図 4及び図 5の結果から、 FCPを実施することにより B濃度のバッチ間均一性 を向上させることができることが分かる。
[0032] 図 6において、実施例のボロンドープシリコン薄膜の成長速度のバッチ (ラン）回数 依存性、すなわち連続 3ランでの成長速度の変化をトップ領域のスロット（# 167)と ボトム領域のスロット（# 11)に載置した製品ウェハについて測定した結果が示されて いる。 FCPを実施することにより、成長速度の変動は 2%未満に収まっていることが確 認できた。
[0033] 図 7において、実施例と比較例とのボロンドープシリコン薄膜の成長速度のバッチ 間アイドル時間依存性が示されている。比較例 (FCP無し)では、成長速度がバッチ 間アイドル時間により大きくばらついているのに対し、実施例 (FCP有り）では、 24時 間アイドリング後でも、更には 38時間アイドリング後でも成長速度の変動はほとんど 無い。図 6及び図 7の結果から、 FCPを実施することにより成長速度のノツチ間均一 性を向上させることができることが分かる。
[0034] 以上述べたように、 FCPは、反応炉内の構成部材、すなわちボートやダミーウェハ 、更には反応管、マ-ホールド、シールキャップの内壁等に付着した BC1や C1成分
3 を脱離させやすい。この理由は、 FCPは反応炉内に Nを高圧までためて一気に引く
2
ため、単位時間当たりの圧力変化が大きぐパージガス量も多くなり、パージ効果が 圧倒的に大きくなるためである。
[0035] なお、上記実施形態及び実施例にお!ヽては、減圧 CVD装置に適用したものを示 したが、本発明はこれに限定されるものではなぐボロンドープ拡散装置を含め、ポロ ン (B)を含むガスを用いる装置全般に適用できるし、ボロン以外、例えば PH等のリ
3 ン（P)を含むガスや AsH等の砒素 (As)を含むガス等を用 ヽる装置にについても適
3
用することができる。
[0036] 以上のように、本発明は、特許請求の範囲に記載した事項を特徴とするが、さらに 次のような実施形態が含まれる。
(1)基板を処理する反応炉と、反応炉内に処理ガスを供給する供給手段と、反応 炉内に基板を搬入搬出する搬入搬出手段と、この搬入搬出手段により基板を反応炉 から搬出した後、次に処理する基板を搬入する前に、反応炉内に少なくとも製品基 板が無い状態で反応炉に対する真空引きと不活性ガスの供給を繰り返すよう制御す る制御手段と、を有することを特徴とする基板処理装置。
(2)基板を装填するためのボートと、基板を処理する反応炉と、反応炉内に処理ガ スを供給する供給手段と、反応炉内にボートを搬入搬出する搬入搬出手段と、この 搬入搬出手段により基板と共にボートを反応炉力 搬出した後、次に処理する基板 を搬入する前に反応炉内に少なくとも製品基板を装填していない空のボートを挿入 した状態で反応炉に対する真空引きと不活性ガスの供給を少なくとも 1回以上行うよ う制御する制御手段と、を有することを特徴とする基板処理装置。
産業上の利用可能性
本発明は、基板を処理する工程を有する半導体装置の製造方法に利用することが できる。

Claims

請求の範囲
[1] 基板を反応炉内に搬入するステップと、
前記反応炉内で基板に対して処理を行うステップと、
前記反応炉内に処理後の基板を収容した状態で、前記反応炉に対する真空引きと 不活性ガスの供給を少なくとも 1回以上行うことにより第 1のパージを行うステップと、 前記反応炉より処理後の基板を搬出するステップと、
処理後の基板を前記反応炉より搬出後、次に処理する基板を前記反応炉内に搬 入する前に、前記反応炉に少なくとも製品基板を収容していない状態で、前記反応 炉に対する真空引きと不活性ガスの供給とを少なくとも 1回以上行うことにより第 2の パージを行うスッテツプとを有し、
前記第 2のパージステップにおける単位時間当たりの反応炉内の圧力変化量を、 前記第 1のパージステップにおける単位時間当たりの反応炉内の圧力変化量よりも 大きくしたことを特徴とする半導体装置の製造方法。
[2] 請求項 1に記載した半導体装置の製造方法にぉ 、て、前記第 2のパージステップ における単位時間当たりの反応炉内の圧力変化量を 30PaZsecより大きく 500PaZ sec以下としたことを特徴とする半導体装置の製造方法。
[3] 請求項 1に記載した半導体装置の製造方法にぉ 、て、前記第 2のパージステップ における前記反応炉内の最大圧力と最小圧力との差を、前記第 1のパージステップ における前記反応炉内の最大圧力と最小圧力との差よりも大きくしたことを特徴とす る半導体装置の製造方法。
[4] 請求項 1に記載した半導体装置の製造方法にぉ 、て、前記第 1のパージステップ 及び第 2のパージステップにおいては、真空引きと不活性ガスの供給を複数回繰り 返すようにし、前記第 2のパージステップにおける真空引きと不活性ガス供給のサイ クルを、前記第 1のパージステップにおける真空引きと不活性ガス供給のサイクルより も短くしたことを特徴とする半導体装置の製造方法。
[5] 請求項 1に記載した半導体装置の製造方法にぉ 、て、前記第 1のパージステップ 及び第 2のパージステップにおいては、真空引きと不活性ガスの供給を複数回繰り 返すようにし、前記第 2のパージステップにおける真空引きと不活性ガス供給のサイ クル数を、前記第 1のパージステップにおける真空引きと不活性ガス供給のサイクル 数よりも多くしたことを特徴とする半導体装置の製造方法。
[6] 請求項 1に記載した半導体装置の製造方法にぉ 、て、前記第 1のパージステップ 及び第 2のパージステップにおいては、真空引きと不活性ガスの供給を複数回繰り 返すようにし、前記第 1のパージステップでは、前記反応炉内を排気する排気ライン に設けられた排気バルブを開いた状態で前記反応炉内に不活性ガスを供給し、前 記第 2のパージステップでは、前記排気バルブを閉じた状態で前記反応炉内に不活 性ガスを供給することを特徴とする半導体装置の製造方法。
[7] 請求項 1に記載した半導体装置の製造方法にぉ 、て、前記第 1のパージステップ は、基板を支持した支持具を前記反応炉内に収容した状態で行い、前記第 2のパー ジステップは、少なくとも製品基板を支持して ヽな ヽ支持具を前記反応炉内に収容し た状態で行うことを特徴とする半導体装置の製造方法。
[8] 請求項 1に記載した半導体装置の製造方法にぉ 、て、前記第 1のパージステップ は、基板を支持した支持具を前記反応炉内に収容した状態で行い、前記第 2のパー ジステップは、製品基板を支持することなくダミー基板を支持した支持具を前記反応 炉内に収容した状態で行うことを特徴とする半導体装置の製造方法。
[9] 請求項 1に記載した半導体装置の製造方法にぉ 、て、前記基板処理ステップでは 、ホウ素を含むガスを用いることを特徴とする半導体装置の製造方法。
[10] 請求項 1に記載した半導体装置の製造方法にぉ 、て、前記基板処理ステップでは 、基板上にボロンドープシリコン膜を形成することを特徴とする半導体装置の製造方 法。
[11] 請求項 1に記載した半導体装置の製造方法にぉ 、て、前記基板処理ステップでは 、モノシラン (SiH )と三塩ィ匕ホウ素 (BCl )を用いることを特徴とする半導体装置の製
4 3
造方法。
[12] 請求項 1に記載した半導体装置の製造方法にぉ 、て、前記第 2のパージステップ は、基板に対する処理を行う度に毎回行うことを特徴とする半導体装置の製造方法。
[13] 基板を支持具に装填するステップと、
基板を装填した前記支持具を反応炉内にロードするステップと、 前記反応炉内で基板に対して処理を行うステップと、
処理後の基板を支持した前記支持具を反応炉よりアンロードするステップと、 前記支持具をアンロードした後、処理後の基板を前記支持具より取り出すステップ と、
処理後の基板を取り出した後、少なくとも製品基板を前記支持具に装填することな く前記支持具を前記反応炉内にロードするステップと、
少なくとも製品基板を装填していない前記支持具を前記反応炉内に収容した状態 で、前記反応炉内に反応性ガスを導入することなく前記反応炉に対する真空引きと 不活性ガスの供給を少なくとも 1回以上行うことによりパージを行うステップと、 を有することを特徴とする半導体装置の製造方法。
[14] 請求項 13に記載した半導体装置の製造方法にぉ 、て、前記パージステップは、前 記支持具に製品基板を支持することなくダミー基板を支持した状態で行うことを特徴 とする半導体装置の製造方法。
[15] 請求項 13に記載した半導体装置の製造方法において、前記パージステップは、基 板に対する処理を行う度に毎回行うことを特徴とする半導体装置の製造方法。
[16] 請求項 13に記載した半導体装置の製造方法において、前記パージステップにお ける単位時間当たりの反応炉内の圧力変化量を 30PaZsecより大きく 500PaZsec 以下としたことを特徴とする半導体装置の製造方法。
[17] 基板を処理する反応炉と、
前記反応炉内にガスを供給するガス供給ラインと、
前記反応炉内に基板を搬入搬出する搬入搬出装置と、
前記反応炉内に処理後の基板を収容した状態で、前記反応炉に対する真空引きと 不活性ガスの供給を少なくとも 1回以上行うことにより第 1のパージを行うように制御す ると共に、処理後の基板を前記反応炉より搬出後、次に処理する基板を前記反応炉 内に搬入する前に、前記反応炉内に少なくとも製品基板を収容しない状態で、前記 反応炉に対する真空引きと不活性ガスの供給を少なくとも 1回以上行うことにより第 2 のパージを行うように制御し、更に、前記第 2のパージにおける単位時間当たりの反 応炉内の圧力変化量を、前記第 1のパージにおける単位時間当たりの反応炉内の 圧力変化量よりも大きくするように制御するコントローラと、 を有することを特徴とする基板処理装置。
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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2008078518A1 (ja) * 2006-12-27 2008-07-03 Sharp Kabushiki Kaisha 半導体層製造方法および半導体層製造装置ならびにこれらを用いて製造される半導体デバイス
JP2009124070A (ja) * 2007-11-19 2009-06-04 Hitachi Kokusai Electric Inc 半導体装置の製造方法および基板処理装置
US8716147B2 (en) 2007-11-19 2014-05-06 Hitachi Kokusai Electric Inc. Manufacturing method of semiconductor device and substrate processing apparatus

Families Citing this family (14)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
TWI360179B (en) * 2003-09-19 2012-03-11 Hitachi Int Electric Inc Method for manufacturing a semiconductor device, a
JP5560344B2 (ja) * 2010-09-29 2014-07-23 株式会社アルバック 薄膜製造方法
JP2012174819A (ja) * 2011-02-21 2012-09-10 Sokudo Co Ltd 熱処理装置および熱処理方法
KR101364701B1 (ko) * 2011-11-17 2014-02-20 주식회사 유진테크 위상차를 갖는 반응가스를 공급하는 기판 처리 장치
KR101408084B1 (ko) * 2011-11-17 2014-07-04 주식회사 유진테크 보조가스공급포트를 포함하는 기판 처리 장치
JP2014045168A (ja) * 2012-07-30 2014-03-13 Tokyo Electron Ltd 不純物拡散方法
JP6055637B2 (ja) * 2012-09-20 2016-12-27 株式会社日立国際電気 クリーニング方法、半導体装置の製造方法、基板処理装置及びプログラム
JP2014192485A (ja) 2013-03-28 2014-10-06 Hitachi Kokusai Electric Inc 半導体装置の製造方法、基板処理方法及び基板処理装置
JP6107327B2 (ja) * 2013-03-29 2017-04-05 東京エレクトロン株式会社 成膜装置及びガス供給装置並びに成膜方法
JP6332089B2 (ja) * 2015-03-16 2018-05-30 豊田合成株式会社 半導体素子の製造方法
JP6523119B2 (ja) * 2015-09-28 2019-05-29 株式会社Ｋｏｋｕｓａｉ Ｅｌｅｃｔｒｉｃ 半導体装置の製造方法、基板処理装置およびプログラム
WO2017153827A1 (en) 2016-03-07 2017-09-14 Wallbrooke Investments Ltd. Inductive heating apparatus and related method
KR20220076343A (ko) * 2020-11-30 2022-06-08 에이에스엠 아이피 홀딩 비.브이. 기판 처리 장치의 반응 챔버 내에 배열되도록 구성된 인젝터
KR20220143222A (ko) * 2021-04-15 2022-10-25 삼성전자주식회사 박막 증착 장치 및 박막 증착 방법

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2000058543A (ja) * 1998-08-10 2000-02-25 Tokyo Electron Ltd 酸化処理方法および酸化処理装置
JP2001234345A (ja) * 2000-02-25 2001-08-31 Denso Corp 薄膜の形成方法
JP2003178992A (ja) * 2001-10-05 2003-06-27 Hitachi Kokusai Electric Inc 半導体デバイスの製造方法
JP2004281832A (ja) * 2003-03-18 2004-10-07 Matsushita Electric Ind Co Ltd 半導体製造装置内での半導体基板搬送方法および半導体製造装置

Family Cites Families (23)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0553356A (ja) * 1991-08-27 1993-03-05 Kyocera Corp グロー放電分解成膜装置のパージ方法
JPH06196408A (ja) * 1992-12-24 1994-07-15 Nec Kansai Ltd 縦型ｌｐｃｖｄ装置及び薄膜成長方法
JP3262623B2 (ja) * 1993-02-17 2002-03-04 東京エレクトロン株式会社 減圧処理方法及び装置
US5525160A (en) * 1993-05-10 1996-06-11 Tokyo Electron Kabushiki Kaisha Film deposition processing device having transparent support and transfer pins
JPH08181112A (ja) 1994-12-22 1996-07-12 Mitsubishi Electric Corp ドライエッチング装置の洗浄法およびそれを用いた半導体装置の製法
JP3476638B2 (ja) * 1996-12-20 2003-12-10 東京エレクトロン株式会社 Ｃｖｄ成膜方法
US6276072B1 (en) * 1997-07-10 2001-08-21 Applied Materials, Inc. Method and apparatus for heating and cooling substrates
US6182376B1 (en) * 1997-07-10 2001-02-06 Applied Materials, Inc. Degassing method and apparatus
JPH11168135A (ja) * 1997-12-03 1999-06-22 Toshiba Corp 基板保管装置および基板保管方法
WO2000014782A1 (en) * 1998-09-03 2000-03-16 Nippon Sanso Corporation Feed device for large amount of semiconductor process gas
US7192494B2 (en) * 1999-03-05 2007-03-20 Applied Materials, Inc. Method and apparatus for annealing copper films
US6136163A (en) * 1999-03-05 2000-10-24 Applied Materials, Inc. Apparatus for electro-chemical deposition with thermal anneal chamber
TW460942B (en) * 1999-08-31 2001-10-21 Mitsubishi Material Silicon CVD device, purging method, method for determining maintenance time for a semiconductor making device, moisture content monitoring device, and semiconductor making device with such moisture content monitoring device
JP2001250818A (ja) 1999-12-28 2001-09-14 Tokyo Electron Ltd 酸化処理装置及びそのクリーニング方法
EP1351283A4 (en) * 2000-12-05 2006-01-25 Tokyo Electron Ltd METHOD AND DEVICE FOR TREATING AN ARTICLE TO BE TREATED
JP4009100B2 (ja) * 2000-12-28 2007-11-14 東京エレクトロン株式会社 基板加熱装置および基板加熱方法
US6991999B2 (en) * 2001-09-07 2006-01-31 Applied Materials, Inc. Bi-layer silicon film and method of fabrication
US6905963B2 (en) 2001-10-05 2005-06-14 Hitachi Kokusai Electric, Inc. Fabrication of B-doped silicon film by LPCVD method using BCI3 and SiH4 gases
JP2003138378A (ja) * 2001-10-30 2003-05-14 Anelva Corp 薄膜形成方法
KR100449028B1 (ko) * 2002-03-05 2004-09-16 삼성전자주식회사 원자층 증착법을 이용한 박막 형성방법
JP2003289069A (ja) 2002-03-28 2003-10-10 Hitachi Kokusai Electric Inc 基板処理装置
JP2003347288A (ja) * 2002-05-30 2003-12-05 Tokyo Electron Ltd 半導体製造装置用インジェクタ、半導体製造装置及び半導体製造装置の洗浄方法
KR100469126B1 (ko) * 2002-06-05 2005-01-29 삼성전자주식회사 수소 함유량이 적은 박막 형성방법

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2000058543A (ja) * 1998-08-10 2000-02-25 Tokyo Electron Ltd 酸化処理方法および酸化処理装置
JP2001234345A (ja) * 2000-02-25 2001-08-31 Denso Corp 薄膜の形成方法
JP2003178992A (ja) * 2001-10-05 2003-06-27 Hitachi Kokusai Electric Inc 半導体デバイスの製造方法
JP2004281832A (ja) * 2003-03-18 2004-10-07 Matsushita Electric Ind Co Ltd 半導体製造装置内での半導体基板搬送方法および半導体製造装置

Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2008078518A1 (ja) * 2006-12-27 2008-07-03 Sharp Kabushiki Kaisha 半導体層製造方法および半導体層製造装置ならびにこれらを用いて製造される半導体デバイス
JP2008166366A (ja) * 2006-12-27 2008-07-17 Sharp Corp 半導体層製造方法および半導体層製造装置ならびにこれらを用いて製造される半導体デバイス
US8389389B2 (en) 2006-12-27 2013-03-05 Sharp Kabushiki Kaisha Semiconductor layer manufacturing method, semiconductor layer manufacturing apparatus, and semiconductor device manufactured using such method and apparatus
JP2009124070A (ja) * 2007-11-19 2009-06-04 Hitachi Kokusai Electric Inc 半導体装置の製造方法および基板処理装置
US8716147B2 (en) 2007-11-19 2014-05-06 Hitachi Kokusai Electric Inc. Manufacturing method of semiconductor device and substrate processing apparatus

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