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TWI627859B - 應用於多媒體裝置的解碼電路及相關的解碼方法 - Google Patents

應用於多媒體裝置的解碼電路及相關的解碼方法 Download PDF

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TWI627859B
TWI627859B TW106113373A TW106113373A TWI627859B TW I627859 B TWI627859 B TW I627859B TW 106113373 A TW106113373 A TW 106113373A TW 106113373 A TW106113373 A TW 106113373A TW I627859 B TWI627859 B TW I627859B
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李冠洲
鄭凱文
童泰來
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晨星半導體股份有限公司
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Abstract

本發明揭露了一種應用於一多媒體裝置的解碼電路，其用來解碼一編碼資料以產生一系統資訊，且該解碼電路包含有多個處理電路以及一決定電路。該多個處理電路係用來分別對該編碼資料來進行處理，以產生多個處理後訊號；其中該多個處理電路模組係分別對應於該系統資訊之一部分資訊的多種位元組合；以及該決定電路係用以根據該多個處理後訊號決定出該系統資訊。

Description

應用於多媒體裝置的解碼電路及相關的解碼方法
本發明係有關於多媒體裝置中的接收電路，尤指一種應用於多媒體裝置的解碼電路及相關的解碼方法。
在目前的第二代數位視訊廣播(DVB-S2)系統，接收器會對所接收的一實體層訊號(Physical Layer Signaling，PLS)編碼資料進行解碼來得到一包含7個位元的系統資訊，此系統資訊主要包含了調變方式、符碼率、是否有導引資料以及前向錯誤更正(Forward Error Correction，FEC)資料長度…等等。在目前推出的擴充型第二代數位視訊廣播(DVB-S2X)系統中，除了編碼方式有所不同之外，其系統資訊尚多出一個用來區別第二代數位視訊廣播以及擴充型第二代數位視訊廣播的位元。由於在解碼前，接收器尚無法確認8個位元的系統資訊為何，因此接收器在對實體層訊號編碼資料進行解碼時可能會遭遇錯誤，而需要重複解碼多次才可以解碼出正確的系統資訊；此外，當訊號品質不佳時更有可能會增加解碼錯誤的機率，因而造成效能的低落。
因此，本發明的目的之一在於提供一種應用於顯示裝置的解碼電路及相關的解碼方法，其可以快速且準確地對實體層訊號編碼資料進行解碼來得到系統資訊，以解決先前技術中的問題。
在本發明的一個實施例中，揭露了一種應用於一多媒體裝置的解碼電路，其解碼一編碼資料以產生一系統資訊，且該解碼電路包含有多個處理電路以及一決定電路。該多個處理電路係用來分別對該編碼資料進行處理，以產生多個處理後訊號；其中該多個處理電路係分別對應於該系統資訊之一部分資訊之多種位元組合；以及該決定電路係用以根據該多個處理後訊號來決定出該系統資訊。
在本發明的另一個實施例中，揭露了一種應用於一多媒體裝置的解碼方法，其用以解碼一編碼資料以產生一系統資訊，且該解碼方法包含以下步驟：使用多個處理電路分別對該編碼資料進行處理，以產生多個處理後訊號；其中該多個處理電路係分別對應於該系統資訊之一部分資訊之多種位元組合；以及根據該多個處理後訊號來決定出該系統資訊。
在本發明的另一個實施例中，揭露了一種一種應用於一多媒體裝置的解碼電路，用來解碼一編碼資料以產生一系統資訊，且該解碼電路包含有一處理電路以及一決定電路。該處理電路係用來分別對該編碼資料進行處理以產生多個處理後訊號，其中該多個處理後訊號係分別對應於該系統資訊之一部分資訊的多種位元組合；以及該決定電路耦接於該多個處理電路，且用來根據該多個處理後訊號決定出該部分資訊係對應該多種位元組合的其中之一。
請參考第1圖，其為根據本發明一實施例之應用於一多媒體裝置之電路100的方塊圖，其中在本實施例中，電路100係可設置於一電視或是一電視機上盒中，且符合擴充型第二代數位視訊廣播(DVB-S2X)系統的規格。參考第1圖，電路100包含了一訊框同步電路110、一訊框起始區段判斷電路120、一實體層訊號(PLS)編碼資料擷取電路130以及一解碼電路140。
在電路100的操作中，首先，訊框同步電路110透過天線接收一接收訊號，其中該接收訊號包含了多個訊框。第2圖所示為一訊框200的示意圖，其中訊框200包含了一實體層標頭以及多個資料槽(slot)，該些資料槽用來存放經過編碼的資料，而實體層標頭則包含了一訊框起始區段(start of frame, SOF)以及一PLS編碼資料(PLS code)，其中訊框起始區段包含了時間同步所需的資訊。訊框起始區段判斷電路120判斷出每一個訊框中之該訊框起始區段的位址，以供PLS編碼資料擷取電路130據以取得每一個訊框中的PLS編碼資料。解碼電路140對PLS編碼資料進行解碼以得到一系統資訊。
在DVB-S2X系統中，PLS編碼資料是由傳送端將系統資訊與一生成矩陣進行計算所產生的，詳細來說，系統資訊為一八位元的資料(b0, b1, …, b7)，其中第一個位元b0是用來表示此訊號是符合DVB-S2系統或是DVB-S2X系統，例如當第一個位元b0為“0”時表示訊號是符合DVB-S2系統，而當第一個位元b0為“1”時表示訊號是符合DVB-S2X系統；以及第八個位元b7則用來表示PLS編碼資料否具有一導引(pilot)資料，例如當第八個位元b7為“0”時表示沒有導引資料，而當第八個位元b7為“1”時表示具有導引資料。在DVB-S2系統中，生成矩陣為一6*32的矩陣，而傳送端會將系統資訊中的六個位元(b1, …, b6)和生成矩陣相乘以到一個1*32的中間矩陣(亦即，32位元的資料)，之後再透過系統資訊中的最後一個位元b7與中間矩陣的邏輯運算以產生出一個1*64的矩陣，之後再映射到一星座圖(constellation)後產生PLS編碼資料。另一方面，在DVB-S2X系統中，生成矩陣為一7*32的矩陣，而傳送端會將系統資訊中的前七個位元(b0, b1, …, b6)和生成矩陣相乘以到一個1*32的中間矩陣，之後再透過系統資訊中的最後一個位元b7與中間矩陣的邏輯運算以產生出一個1*64的矩陣，之後再映射到一星座圖(constellation)後產生PLS編碼資料。由於產生PLS編碼資料的方式為本領域具有通常知識者所熟知，故詳細的計算方式在此不予贅述。
以下為在DVB-S2系統中之生成矩陣的範例： 而以下為在DVB-SX2系統中之生成矩陣的範例： 。
本發明的主要特徵即是透過解碼電路140來將所接收到的PLS編碼資料準確且有效率地解碼還原成系統資訊，以供後續的操作。
請參考第3圖，其為根據本發明一實施例之解碼電路140的方塊圖。如第3圖所示，解碼電路140包含了一解攪亂(descrambler)電路302、四個處理電路310、320、330、340以及一決定電路304，其中處理電路310包含了一旋轉電路312、一轉換電路318，處理電路320包含了一旋轉電路322、一轉換電路328，處理電路330包含了一旋轉電路332、一轉換電路338，且處理電路340包含了一旋轉電路342、一轉換電路348。在本實施例中，解攪亂電路302係用來對PLS編碼訊號進行解攪亂操作以產生一解攪亂後PLS編碼訊號，而四個處理電路310、320、330、340係分別對該解攪亂後PLS編碼訊號採用不同的計算方式來進行處理，以分別產生第一、第二、第三與第四處理後訊號，其中四個處理電路310、320、330、340係分別對應於系統資訊之一部分資訊(第一個位元b0與第八個位元b7)的四種組合，且該些處理後訊號係用來反應該部分資訊具有哪一種位元組合。詳細來說，處理電路310、320、330、340係分別對應至位元組合為(b0=0、b7=0)、(b0=0、b7=1)、(b0=1、b7=1)、(b0=1、b7=0)的部分資訊，當PLS編碼訊號所對應到的系統資訊之該部分資訊具有(b0=0、b7=0)之組合時，處理電路310產生之該第一處理後訊號相對於其他處理後訊號將具有識別性(例如，特別高的數值)。類似的，處理電路320、330與340係分別能夠針對具有(b0=0、b7=1)、(b0=1、b7=1)、(b0=1、b7=0)之部分資訊的系統資訊所對應的解攪亂後PLS編碼訊號產生相對於其他處理後訊號具有識別性的第二、第三與第四處理後訊號。最後，決定電路304根據處理電路310、320、330、340所輸出的第一、第二、第三與第四處理後訊號來判斷出系統資訊之第一個位元b0與第八個位元b7的數值，並依據判斷結果進一步決定出其他的位元b1~b6。以下將詳述處理電路模組310、320、330、340中每一個電路元件以及決定電路304的操作。
旋轉電路312、322、332、342中，首先以旋轉電路312為例，旋轉電路312係用來將解攪亂後PLC編碼資料(64位元)的每一個位元值進行相位旋轉以映射到一軸線(在本實施例中為複數座標中的虛部軸)上以產生一第一旋轉後編碼資料，之後再將相鄰奇數點與偶數點所對應的第一旋轉後編碼資料的數值相加(亦即，第1個位元值和第2個位元值所對應的第一旋轉後編碼資料的數值相加、第3個位元值和第4個位元值所對應的第一旋轉後編碼資料的數值相加、…以此類推，且在本實施例中，第一旋轉後編碼資料的數值係指其在複數座標的虛部軸上的數值)以得到一第一資訊(1*32的矩陣)，其中旋轉電路312進行相位旋轉的方式係相關於DVB-S2系統的規格。旋轉電路322類似於旋轉電路312，係依據解攪亂後PLC編碼資料的每一個位元值產生一第二旋轉後編碼資料，之後再將相鄰奇數點與偶數點所對應的第二旋轉後編碼資料的數值相減以得到一第二資訊(1*32的矩陣)。請參考第4圖，其為旋轉電路312、322在進行相位旋轉的示意圖，其中圖示的“i”代表第“i”個位元，亦即“i”可以是1~32，y 2i-1代表著解攪亂後PLC編碼資料的奇數點的位元值，y 2i代表著解攪亂後PLC編碼資料的偶數點的位元值，“I”表示實部軸，且“Q”表示虛部軸。當解攪亂後PLC編碼資料的奇數點的位元值是“0”時，旋轉電路312、322會將其旋轉(π/4)以得到數值“+1”；當解攪亂後PLC編碼資料的奇數點的位元值是“1”時，旋轉電路312、322會將其旋轉(π/4)以得到數值“-1”；當解攪亂後PLC編碼資料的偶數點的位元值是“0”時，旋轉電路312、322會將其旋轉(-π/4)以得到數值“+1”；而當解攪亂後PLC編碼資料的偶數點的位元值是“1”時，旋轉電路312、322會將其旋轉(-π/4)以得到數值“-1”。
旋轉電路332類似於旋轉電路312，係依據解攪亂後PLC編碼資料的每一個位元來產生一第三旋轉後編碼資料，之後再將相鄰奇數點與偶數點所對應的第三旋轉後編碼資料的數值相加以得到一第三資訊(1*32的矩陣)，其與旋轉電路312的差異在於旋轉電路332進行相位旋轉的方式係相關於DVB-S2X系統的規格；旋轉電路342類似於旋轉電路322，係依據解攪亂後PLC編碼資料的每一個位元來產生一第四旋轉後編碼資料，之後再將相鄰奇數點與偶數點的數值所對應的第四旋轉後編碼資料相減以得到一第四資訊(1*32的矩陣)，其與旋轉電路322的差異在於旋轉電路342進行相位旋轉的方式是根據DVB-S2X系統的規格來進行。請參考第5圖，其為旋轉電路332、342在進行相位旋轉的示意圖，當解攪亂後PLC編碼資料的奇數點的位元值是“0”時，旋轉電路332、342會將其旋轉(-π/4)以得到數值“+1”；當解攪亂後PLC編碼資料的奇數點的位元值是“1”時，旋轉電路332、342會將其旋轉(-π/4)以得到數值“-1”；當解攪亂後PLC編碼資料的偶數點的位元值是“0”時，旋轉電路332、342會將其旋轉(π/4)以得到數值“-1”；而當解攪亂後PLC編碼資料的偶數點的位元值是“1”時，旋轉電路332、342會將其旋轉(π/4)以得到數值“+1”。
上述旋轉電路312所產生的第一資訊中的每一個數值可以表示如下： ； 旋轉電路322所產生的第二資訊中的每一個數值可以表示如下： ； 旋轉電路332所產生的第三資訊中的每一個數值可以表示如下： ； 旋轉電路342所產生的第四資訊中的每一個數值可以表示如下： 。
如前所述，針對任一種位元組合的該部分資訊，第一~第四資訊的其中之一將會有具有識別性(例如，特別高的數值)，實際上已經足夠供決定電路304用來判斷該部分資訊係為哪一種位元組合。接著，請參考第6圖，其為本發明另一實施例之解碼電路140的方塊圖，其中在第6圖所示的實施例中處理電路310、320、330、340更分別包含了疊加電路314、324、334、344。關於疊加電路314、324、334、344的操作，請同時參考第7圖，疊加電路314係用來將對應到不同訊框的多個第一資訊進行疊加以產生一第一疊加後資料，類似的，疊加電路324、334與344分別將對應到不同訊框的多個第二、第三與第四資訊進行疊加以產生一第二疊加後資料、一第三疊加後資料與一第四疊加後資料。由於疊加後的資料進一步增加了相互之間的區別性，因此對於該部分資訊的判斷將更準確。
轉換電路318、328、338與348係透過一矩陣轉換來解碼第一~第四資訊或者第一~第四疊加後資料中的PLS編碼。請注意，由於在DVB-S2X系統之傳送端中所用來產生PLS編碼訊號的生成矩陣的第一行並非均為0，因此在轉換電路338與348更分別包含一映射電路(未繪示)來移除生成矩陣之第一行對於PLS編碼訊號所造成的影響。換言之，轉換電路338與348所包含的映射電路會分別將第三疊加後資料以及第四疊加後資料的部分內容進行修改，以移除生成矩陣之第一行的影響。在本實施例中，映射電路336、346係分別將第三疊加後資料以及第四疊加後資料中的第0、3、8、10、12、13、18、20、21、23、24、25、27、28、29、31位元進行正負號的轉換來移除生成矩陣之第一行的影響。相對的，由於DVB-S2系統並沒有上述問題，故不需要額外的映射電路來對第一、第二疊加後資料進行處理。
最後，轉換電路318、328、338、348分別對第一、第二、第三、第四疊加後資料(其中第三、第四疊加後資料係經過映射電路與處理)進行資料轉換以產生第一、第二、第三、第四處理後訊號。在本實施例中，轉換電路318、328、338、348分別對第一、第二、第三、第四疊加後資料乘上一個32*32的哈達瑪矩陣(Hadamard matrix)以產生第一、第二、第三、第四處理後訊號。其中轉換電路318的操作可以表示如下： 其中 是第一處理後訊號， 用來表示第一疊加後資料，而 為哈達瑪矩陣； 轉換電路328的操作可以表示如下： 其中 是第二處理後訊號， 用來表示第二疊加後資料； 轉換電路328的操作可以表示如下： 其中 是第三處理後訊號， 用來表示經過映射電路處理後之第三疊加後資料； 轉換電路348的操作可以表示如下： 其中 是第四處理後訊號， 用來表示經過映射電路處理後的第四疊加後資料。
最後，決定電路304根據第一、第二、第三、第四處理後訊號來判斷出系統資訊中b0、b7的數值，並據以決定出其他的位元b1~b6。詳細來說，決定電路304會先決定出第一、第二、第三、第四處理後訊號中具有最大數值的自變量(argument)如下： ； ； ； ； 決定電路304比較上述a0、a1、a2、a3的大小來決定出系統資訊中b0、b7的數值，亦即當a0的數值最大時，b0=0、b7=0；當a1的數值最大時，b0=0、b7=1；當a2的數值最大時，b0=1、b7=1；當a3的數值最大時，b0=1、b7=0。
接著，假設a0、a1、a2、a3中最大的數值為amax(會是介於0~31之間的整數)，則再透過對amax取二位元表示式便可以得到b1~b5的值，亦即： ； 最後再根據A max_index,amax的值是否大於0來判斷出系統資訊中b6的值，當A max_index,amax的值大於0時，b6為0，以及當A max_index,amax的值不大於0時，b6為1。其中max_index表示著amax是對應到a0、a1、a2、a3哪一個，亦即當amax是a0時max_index即為“0”、 當amax是a1時max_index即為“1”…以此類推。
如上所述，八個位元的系統資訊b0~b7便可以準確地得知，而此系統資訊主要包含了調變方式、符碼率、是否有導引資料以及前向錯誤更正資料長度…等資訊，而這些資訊可用來傳送給後端的項為補償或是等化器的元件來運用。
需注意的是，雖然以上的實施例係以DVB-S2X系統中的解碼電路為例，但本發明並不以此為限。在本發明之其他實施例中，只要解碼電路中具有多個處理電路模組來同時對編碼資料進行不同的計算，且每一個處理電路模組所產生之處理後訊號可以反映出一系統資訊中部份資訊的一特定位元組合，則本發明可以應用在各種不同的解碼電路中。此外，在一實施例中，當系統資訊中的部份資訊為N個位元時，該多個處理電路模組的數量為N的平方。此外，雖然本案中係由決定電路304根據第一、第二、第三、第四處理後訊號來判斷出系統資訊中b0、b7的值，然而如前所述，在本案提出之解碼電路140中，決定電路304亦可直接依據第一~第四資訊、或者第一~第四疊加後的資料中具有識別性(例如，特別高的數值)的其中之一來進行判斷。然而由決定電路304依據第一~第四處理後訊號進行前述判斷係可以同時決定系統資訊中b1~b6的值，因此更加有效率。
請參考第8圖，其為根據本發明另一實施例之解碼電路140的方塊圖。如第8圖所示，解碼電路140包含了一解攪亂電路802、一處理電路810以及一決定電路804，其中處理電路810包含了一旋轉電路812以及一轉換電路818。第8圖與第3圖所示的實施例的差異僅在於第3圖之實施例是採用四個不同的處理電路310~340來同步處理解攪亂後PLS編碼訊號，而第8圖所示之實施例則是採用分時處理的方式來處理解攪亂後PLS編碼訊號。具體來說，在第一個時間點，處理電路810的操作相同於處理電路310以產生一第一處理後訊號，在第二個時間點處理電路810的操作相同於處理電路320以產生一第二處理後訊號，在第三個時間點處理電路810的操作相同於處理電路330以產生一第三處理後訊號，且在第四個時間點處理電路810的操作相同於處理電路340以產生一第四處理後訊號。最後，決定電路304在收集到第一、第二、第三、第四處理後訊號之後便可以判斷出系統資訊中b0、b7的數值，並據以決定出其他的位元b1~b6。
第9圖為根據本發明一實施例之一種應用於一顯示裝置的解碼方法的流程圖。參考第1~7圖及以上所揭露的內容，解碼方法的流程如下所述：
步驟900：流程開始。
步驟902：接收一編碼資料，其中該編碼資料係由一系統資訊進行編碼所得到。
步驟904：使用多個處理電路分別對該編碼資料進行處理，以產生多個處理後訊號，其中該多個處理電路係分別對應於該系統資訊之一部分資訊之多種位元組合。
步驟906：根據該多個處理後訊號來決定出該系統資訊。
簡要歸納本發明，在本發明的解碼電路及相關的解碼方法中，係透過多個處理電路模組來對PLS編碼資料進行不同的運算，來得到多個處理後訊號，其中每一個處理電路模組系對應到PLS編碼資料所對應到之系統資訊之一部分資訊之一種位元組合，且其所產生處理後訊號可以反映出PLS編碼資料是否對應於該位元組合。透過本發明，可以一次就準確地對PLS編碼資料進行解碼以得到系統資訊，以避免先前技術中可能需要多次嘗試才可成功解碼的問題。 以上所述僅為本發明之較佳實施例，凡依本發明申請專利範圍所做之均等變化與修飾，皆應屬本發明之涵蓋範圍。
100‧‧‧電路
110‧‧‧訊框同步電路
120‧‧‧訊框起始區段判斷電路
130‧‧‧實體層訊號編碼資料擷取電路
140‧‧‧解碼電路
302、802‧‧‧解攪亂電路
310、320、330、340、810‧‧‧處理電路
312、322、332、342、812‧‧‧旋轉電路
314、324、334、344‧‧‧疊加電路
318、328、338、348、818‧‧‧轉換電路
304、804‧‧‧決定電路
900~906‧‧‧步驟
第1圖為根據本發明一實施例之應用於一顯示裝置之電路的方塊圖。 第2圖所示為一訊框的示意圖。 第3圖為根據本發明一實施例之解碼電路的方塊圖。 第4圖為旋轉電路312、322在進行相位旋轉的示意圖。 第5圖為旋轉電路332、342在進行相位旋轉的示意圖。 第6圖為根據本發明另一實施例之解碼電路的方塊圖。 第7圖為疊加電路的操作示意圖。 第8圖為根據本發明另一實施例之解碼電路的方塊圖。 第9圖為根據本發明一實施例之一種應用於一顯示裝置的解碼方法的流程圖。

Claims (20)

  1. 一種應用於一多媒體裝置的解碼電路，用來解碼一編碼資料以產生一系統資訊，該解碼電路包含有：多個處理電路，用來分別對該編碼資料進行處理以產生多個處理後訊號；其中該多個處理電路係分別對應於該系統資訊之一部分資訊的多種位元組合；以及一決定電路，耦接於該多個處理電路，用來根據該多個處理後訊號決定出該系統資訊。
  2. 如申請專利範圍第1項所述之解碼電路，其中該部分資訊包含N個位元，且該多個處理電路的數量為N的平方。
  3. 如申請專利範圍第1項所述之解碼電路，其中該多媒體裝置符合一數位視訊廣播(Digital Video Broadcasting，DVB)系統，且該編碼資料為一實體層訊號(Physical Layer Signaling，PLS)編碼資料。
  4. 如申請專利範圍第3項所述之解碼電路，其中該部分資訊包含一第一位元與一第二位元，其中該第一位元用來指示該編碼資料符合一第二代數位視訊廣播(DVB-S2)系統與一擴充型第二代數位視訊廣播(DVB-S2X)系統的其中之一，而該第二位元則用來指示該編碼資料是否具有一導引(pilot)資料。
  5. 如申請專利範圍第4項所述之解碼電路，其中該多個處理電路的其中一處理電路，係用來對該編碼資料進行處理以產生該多個處理後訊號的其 中之一，當該第一位元指示該擴充性第二代數位視訊廣播且該第二位元指示該編碼資料具有該導引資料時，該多個處理後訊號的該其中之一相較於其他處理後訊號具有識別性。
  6. 如申請專利範圍第5項所述之解碼電路，其中：該多個處理電路的該其中之一包含：一旋轉電路，用以將該編碼資料中的每一個位元值進行相位旋轉以映射到一軸線上以產生多個旋轉後編碼資料，以及將依據相鄰位元值所產生的兩個旋轉後編碼資料相加以得到一資訊；以及一轉換電路，用以根據該資訊來進行資料轉換以產生該多個處理後訊號的該其中之一。
  7. 如申請專利範圍第6項所述之解碼電路，其中：該多個處理電路的該其中之一另包含：一疊加電路，用以將對應到不同訊框的多個資訊進行疊加以產生一疊加後資料，其中該轉換電路係根據該疊加後資料來進行資料轉換以產生該多個處理後訊號的該其中之一。
  8. 如申請專利範圍第6項所述之解碼電路，其中該編碼資料係由該系統資訊與一生成矩陣相乘所產生，且該多個處理電路的該其中之一另包含：一映射電路，用以對該資訊進行映射處理以移除該生成矩陣中一特定內容的影響。
  9. 如申請專利範圍第1項所述之解碼電路，其中該決定電路決定出該多 個處理後訊號中具有最大數值的自變量，並再透過對該具有最大數值的自變量取二位元表示式來得到該系統資訊的一部分位元值。
  10. 如申請專利範圍第9項所述之解碼電路，其中該決定電路另根據該具有最大數值的自變量來決定出所對應到之處理後訊號中的一數值，並再根據該數值是否大於零來決定出該系統資訊的另一位元值。
  11. 一種應用於一多媒體裝置的解碼方法，其用來解碼一編碼資料以產生一系統資訊，且該解碼方法包含以下步驟：使用多個處理電路分別對該編碼資料進行處理，以產生多個處理後訊號；其中該多個處理電路係分別對應於該系統資訊之一部分資訊的多種位元組合；以及根據該多個處理後訊號來決定出該系統資訊。
  12. 如申請專利範圍第11項所述之解碼方法，其中該部分資訊包含N個位元，且該多個處理電路的數量為N的平方。
  13. 如申請專利範圍第11項所述之解碼方法，其中該多媒體裝置符合一數位視訊廣播(Digital Video Broadcasting，DVB)系統，該編碼資料為一實體層訊號(Physical Layer Signaling，PLS)編碼資料；該部分資訊包含一第一位元與一第二位元，其中該第一位元用來指示該編碼資料符合一第二代數位視訊廣播(DVB-S2)系統與一擴充型第二代數位視訊廣播(DVB-S2X)系統的其中之一，而該第二位元則用來指示該編碼資料是否具有一導引(pilot)資料。
  14. 如申請專利範圍第13項所述之解碼方法，其中該多個處理電路的其中一處理電路，係用來對該編碼資料進行處理以產生該多個處理後訊號的其中之一，當該第一位元指示該擴充性第二代數位視訊廣播且該第二位元指示該編碼資料具有該導引資料時，該多個處理後訊號的該其中之一相較於其他處理後訊號具有識別性。
  15. 如申請專利範圍第14項所述之解碼方法，其中對該編碼資料進行處理以產生該多個處理後訊號的其中之一的步驟包含：將該編碼資料中的每一個位元值進行相位旋轉以映射到一軸線上以產生多個旋轉後編碼資料，以及將依據相鄰位元值所產生的兩個旋轉後編碼資料相加以得到一資訊；以及根據該資訊來進行資料轉換以產生該多個處理後訊號的該其中之一。
  16. 如申請專利範圍第15項所述之解碼方法，其中對該編碼資料進行處理以產生該多個處理後訊號的其中之一的步驟另包含：將對應到不同訊框的多個資訊進行疊加以產生一疊加後資料；以及根據該資訊來進行資料轉換以產生該多個處理後訊號的該其中之一的步驟包含：根據該疊加後資料來進行資料轉換以產生該多個處理後訊號的該其中之一。
  17. 如申請專利範圍第15項所述之解碼方法，其中該編碼資料係由該系 統資訊與一生成矩陣相乘所產生，且對該編碼資料進行處理以產生該多個處理後訊號的其中之一的步驟另包含：對該資訊進行映射處理以移除該生成矩陣中一特定內容的影響。
  18. 如申請專利範圍第11項所述之解碼方法，其中根據該多個處理後訊號來決定出該系統資訊的步驟包含：決定出該多個處理後訊號中具有最大數值的自變量，並再透過對該具有最大數值的自變量取二位元表示式來得到該系統資訊的一部分位元值。
  19. 如申請專利範圍第18項所述之解碼方法，其中根據該多個處理後訊號來決定出該系統資訊的步驟另包含：另根據該具有最大數值的自變量來決定出所對應到之處理後訊號中的一數值，並再根據該數值是否大於零來決定出該系統資訊的另一位元值。
  20. 一種應用於一多媒體裝置的解碼電路，用來解碼一編碼資料以產生一系統資訊，該解碼電路包含有：一處理電路，用來分別對該編碼資料進行處理以產生多個處理後訊號；其中該多個處理後訊號係分別對應於該系統資訊之一部分資訊的多種位元組合；以及一決定電路，耦接於該多個處理電路，用來根據該多個處理後訊號決定出該部分資訊係對應該多種位元組合的其中之一。
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