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TWI508054B - 源極驅動器與降低其中峰値電流的方法 - Google Patents

源極驅動器與降低其中峰値電流的方法 Download PDF

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TWI508054B
TWI508054B TW102128111A TW102128111A TWI508054B TW I508054 B TWI508054 B TW I508054B TW 102128111 A TW102128111 A TW 102128111A TW 102128111 A TW102128111 A TW 102128111A TW I508054 B TWI508054 B TW I508054B
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Shun Hsun Yang
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Novatek Microelectronics Corp
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Description

源極驅動器與降低其中峰值電流的方法
本發明是有關於一種源極驅動器與降低其中峰值電流的方法。
圖1是說明傳統源極驅動器(Source Driver,SD)100的電路方塊示意圖。源極驅動器100耦接於時序控制器(timing controller)10與顯示面板20之間。電源電壓VDDA可以供電給源極驅動器100。依據時序控制器10的控制，源極驅動器100可以將時序控制器10所提供的畫素(pixel)資料轉換為驅動電壓，以及用此驅動電壓去驅動顯示面板20來顯示對應影像。源極驅動器100包括資料接收器(data receiver)110、閂鎖器(latch)120、數位類比轉換器(Digital Analog Converter,DAC)130與輸出緩衝器(output buffer)140。
圖2是說明圖1所示源極驅動器100的信號時序示意圖。請參照圖1與圖2。閂鎖器120經由資料接收器110接收時序控制器10送來的畫素資料，並將畫素資料鎖存於對應的通道中。依據 閂鎖信號LD的時序，閂鎖器120可以將鎖存於不同通道中的畫素資料D1、D2、D3、...、Dx-1與Dx輸出給數位類比轉換器130。數位類比轉換器130依據GAMMA電壓VG，將不同通道中的畫素資料D1~Dx分別轉換為對應的類比灰階電壓I1、I2、I3、...、Ix-1與Ix。輸出緩衝器140可以依據不同通道中的類比灰階電壓I1~Ix而分別輸出對應驅動電壓給顯示面板20的不同資料線Y1、Y2、Y3、...、Yx-1與Yx。
如圖2所示，由於閂鎖器120是依據閂鎖信號LD上升的時間點以並列的方式將新的畫素資料更新至數位類比轉換器130的輸入端，因此當新的畫素資料若與舊的畫素資料互為補數時，源極驅動器100的電源電流I(VDDA)將會產生大量的瞬間峰值電流。例如圖2所示，當新的(目前的)畫素資料(例如FF)若與舊的(先前的)畫素資料(例如00)互為補數時，源極驅動器100的電源電流I(VDDS)將會產生如圖2所示虛圈200處的瞬間峰值電流。此瞬間峰值電流往往會造成電源電壓VDDA的準位瞬間掉落，進而影響內部電路正常操作。除此之外，電源電壓VDDA的準位瞬間掉落也同時會對系統產生電磁干擾(EMI)的效應。
本發明提供一種源極驅動器與降低其中峰值電流的方法，以減少瞬間峰值電流。
本發明實施例所述一種源極驅動器包括閂鎖電路、位準 偏移器以及數位類比轉換電路。閂鎖電路鎖存至少一目前位元資料。閂鎖電路耦接至位準偏移器的輸入端。數位類比轉換電路耦接至位準偏移器的輸出端。當所述至少一目前位元資料不是至少一先前位元資料的補數時，閂鎖電路選擇輸出所述至少一目前位元資料至位準偏移器的輸入端以取代所述至少一先前位元資料，以及數位類比轉換電路輸出位準偏移器的輸出資料的對應電壓。當所述至少一目前位元資料與所述至少一先前位元資料互為補數時，閂鎖電路選擇輸出所述至少一先前位元資料至位準偏移器的輸入端，以及數位類比轉換電路輸出所述至少一目前位元資料的對應電壓。
本發明實施例所述一種降低源極驅動器峰值電流的方法包括：比較至少一目前位元資料與至少一先前位元資料；當所述至少一目前位元資料不是所述至少一先前位元資料的補數時，選擇將所述至少一目前位元資料輸出至源極驅動器的位準偏移器的輸入端以取代所述至少一先前位元資料，以及由數位類比轉換電路將位準偏移器的輸出資料轉換為對應電壓；以及當所述至少一目前位元資料與所述至少一先前位元資料互為補數時，選擇將所述至少一先前位元資料輸出至該位準偏移器的輸入端，以及由數位類比轉換電路輸出所述至少一目前位元資料的對應電壓。
基於上述，實施例所述源極驅動器與降低其中峰值電流的方法可以檢查目前位元資料與先前位元資料是不是互為補數。當目前位元資料與先前位元資料互為補數時，先前位元資料被選 擇輸出至位準偏移器的輸入端，以及由數位類比轉換電路輸出目前位元資料的對應電壓。因此，源極驅動器內部的位準偏移器及其他元件可以減少瞬間峰值電流。
為讓本發明的上述特徵和優點能更明顯易懂，下文特舉實施例，並配合所附圖式作詳細說明如下。
10、30‧‧‧時序控制器
20‧‧‧顯示面板
100、300、800、900、1100、1300、1500、1600‧‧‧源極驅動 器
110、311‧‧‧資料接收器
120‧‧‧閂鎖器
130、332、660、760、1450‧‧‧數位類比轉換器
140、333、670、770、1470‧‧‧輸出緩衝器
200、1000、1200‧‧‧虛圈
310、910、1110‧‧‧閂鎖電路
312‧‧‧移位暫存器
313、610、710、1410‧‧‧資料閂鎖器
314、316、331、620、650、720、750、1420、1460‧‧‧多工器
315、630、730、1430‧‧‧線閂鎖器
320、342、640、740、1440‧‧‧位準偏移器
330、1330‧‧‧數位類比轉換電路
340‧‧‧比較電路
341‧‧‧比較器
725、755‧‧‧反閘
B、G、R‧‧‧畫素資料
Ck[1]、Ck[x]‧‧‧閂鎖時脈
CLK‧‧‧時脈信號
D1、D2、D3、Dx-1、Dx‧‧‧畫素資料
Data(L1)、Data(L2)、M_Data(L1)、HVData、M_HVData‧‧‧畫素資料
Data(L1)[1]、Data(L2)[1]‧‧‧第一個通道畫素資料
Data(L1)[x]、Data(L2)[x]‧‧‧第x個通道畫素資料
DIO‧‧‧線資料起始信號
HV_INVER、HV_BYPASS‧‧‧第二控制信號
I(VDDS)‧‧‧電源電流
I1、I2、I3、Ix-1、Ix‧‧‧類比灰階電壓
INVER‧‧‧第一控制信號
LD‧‧‧閂鎖信號
M_LD‧‧‧信號
S510~S540‧‧‧步驟
VDDA‧‧‧電源電壓
VG‧‧‧GAMMA電壓
Y1、Y2、Y3、Yx-1、Yx‧‧‧資料線
圖1是說明傳統源極驅動器的電路方塊示意圖。
圖2是說明圖1所示源極驅動器的信號時序示意圖。
圖3是依據本發明實施例說明一種源極驅動器的電路方塊示意圖。
圖4是依照本發明實施例說明圖3所示源極驅動器的信號時序示意圖。
圖5是依據本發明實施例說明一種降低源極驅動器峰值電流的方法流程示意圖。
圖6是依據本發明實施例說明圖3所示多工器的實施範例示意圖。
圖7是依據本發明另一實施例說明圖3所示多工器的實施範例示意圖。
圖8是依據本發明再一實施例說明一種源極驅動器的電路方塊示意圖。
圖9是依據本發明又一實施例說明一種源極驅動器的電路方塊示意圖。
圖10是依照本發明實施例說明圖9所示源極驅動器的信號時序示意圖。
圖11是依據本發明再一實施例說明一種源極驅動器的電路方塊示意圖。
圖12是依照本發明實施例說明圖11所示源極驅動器的信號時序示意圖。
圖13是依據本發明更一實施例說明一種源極驅動器的電路方塊示意圖。
圖14是依據本發明實施例說明圖13所示多工器的實施範例示意圖。
圖15是依據本發明又一實施例說明一種源極驅動器的電路方塊示意圖。
圖16是依據本發明又一實施例說明一種源極驅動器的電路方塊示意圖。
在本案說明書全文(包括申請專利範圍)中所使用的「耦接」一詞可指任何直接或間接的連接手段。舉例而言，若文中描述第一裝置耦接於第二裝置，則應該被解釋成該第一裝置可以直接連接於該第二裝置，或者該第一裝置可以透過其他裝置或某種 連接手段而間接地連接至該第二裝置。另外，凡可能之處，在圖式及實施方式中使用相同標號的元件/構件/步驟代表相同或類似部分。不同實施例中使用相同標號或使用相同用語的元件/構件/步驟可以相互參照相關說明。
圖3是依據本發明實施例說明一種源極驅動器(Source Driver,SD)300的電路方塊示意圖。源極驅動器300耦接於時序控制器(timing controller)10與顯示面板20之間。顯示面板20可以是液晶顯示面板或是其他平面面板顯示器。依據時序控制器10的控制，源極驅動器300可以將時序控制器10所提供的畫素(pixel)資料轉換為驅動電壓，以及用此驅動電壓去驅動顯示面板20的資料線(或源極線)來顯示對應影像。
源極驅動器300包括閂鎖電路310、位準偏移器(level shifter)320以及數位類比轉換電路330。閂鎖電路310可以從時序控制器10接收並鎖存至少一目前位元資料，以及將所述至少一目前位元資料輸出至位準偏移器320的輸入端以取代至少一先前位元資料。所述至少一目前位元資料可以是單一資料通道中畫素資料的部份位元或全部位元，也可以是多個(甚至是全部)資料通道中畫素資料的部份位元或全部位元。位準偏移器320改變閂鎖電路310的輸出資料的電壓準位，並將調整電壓準位後的資料輸出至數位類比轉換電路330的輸入端。數位類比轉換電路330將位準偏移器320的輸出資料(數位資料)轉換為對應電壓(類比電壓)，並輸出此對應電壓至顯示面板20的資料線(或源極線) 來顯示對應影像。
本實施例並不限制閂鎖電路310的實現方式。例如，圖3所示實施例中的閂鎖電路310包括資料接收器(data receiver)311、移位暫存器(shift register)312、資料閂鎖器(data latch)313、多工器(multiplexer)314以及線閂鎖器(line latch)315。移位暫存器312從時序控制器10接收時脈信號CLK與線資料起始信號DIO。依據時脈信號CLK的時序，移位暫存器312可以將線資料起始信號DIO中的脈衝逐級傳遞於不同通道中，也就是將不同相位的閂鎖時脈Ck[1]、...、Ck[x]輸出至資料閂鎖器313的不同通道。於圖3所示實施例中，源極驅動器300被假設為具有x個通道。
圖4是依照本發明實施例說明圖3所示源極驅動器300的信號時序示意圖。請參照圖3與圖4。移位暫存器312將不同相位的閂鎖時脈Ck[1]~Ck[x]輸出至資料閂鎖器313。資料閂鎖器313經由資料接收器311接收時序控制器10送來的畫素資料R、G、B。依照不同通道的閂鎖時脈Ck[1]~Ck[x]的時序，時序控制器10送來的不同畫素資料會被鎖存在資料閂鎖器313的對應通道中。線閂鎖器315的輸出端耦接至位準偏移器320的輸入端。線閂鎖器315依據閂鎖信號LD鎖存線閂鎖器315的輸入端的資料。多工器314耦接於資料閂鎖器313的輸出端與線閂鎖器315的輸入端之間。多工器314依據第一控制信號INVER而選擇將資料閂鎖器313所輸出的目前位元資料或目前位元資料的補數傳送給線 閂鎖器315的輸入端。
例如，請參照圖4，假設時序控制器10在一先前期間中送來的畫素資料R、G、B皆為「00」，則資料閂鎖器313可以依照閂鎖時脈Ck[1]~Ck[x]的時序而將不同通道的畫素資料「00」鎖存在對應通道中。舉例來說，資料閂鎖器313可以依照閂鎖時脈Ck[1]的時序而將「00」鎖存在第一個通道，以及輸出畫素資料Data(L1)的第一個通道畫素資料Data(L1)[1]。同理可推，資料閂鎖器313可以依照閂鎖時脈Ck[x]的時序而將「00」鎖存在第x個通道，以及輸出畫素資料Data(L1)的第x個通道畫素資料Data(L1)[x]。線閂鎖器315可以經由多工器314接收到資料閂鎖器313的輸出資料。舉例來說，線閂鎖器315依據閂鎖信號LD鎖存資料閂鎖器313的輸出端的畫素資料Data(L1)，以及輸出閂鎖內容，即輸出畫素資料Data(L2)的第一個通道畫素資料Data(L2)[1]、...、第x個通道畫素資料Data(L2)[x]。在先前期間結束後，假設時序控制器10在一目前期間中送來的畫素資料為「FF」，則資料閂鎖器313可以將不同通道的畫素資料「FF」鎖存在對應通道中，以取代在先前期間中的先前畫素資料。例如，資料閂鎖器313將「FF」鎖存在第一個通道而輸出畫素資料Data(L1)的第一個通道畫素資料Data(L1)[1]，以及將「FF」鎖存在第x個通道而輸出畫素資料Data(L1)的第x個通道畫素資料Data(L1)[x]。
圖5是依據本發明實施例說明一種降低源極驅動器峰值電流的方法流程示意圖。步驟S510比較至少一目前位元資料與至 少一先前位元資料。本實施例並不限制步驟S510的實現方式。例如，在其他實施例中，源極驅動器300的前級電路(例如時序控制器10或其他電路)可以進行步驟S510，並對應控制閂鎖電路310與數位類比轉換電路330(詳參圖8的相關說明)。在本實施例中，圖3所示實施例中的源極驅動器300更包括比較電路340。比較電路340耦接至閂鎖電路310與數位類比轉換電路330。比較電路340可以進行步驟S510，以比較所述目前位元資料與所述先前位元資料。
當所述目前位元資料不是所述先前位元資料的補數時，比較電路340控制閂鎖電路310選擇輸出所述目前位元資料至位準偏移器320的輸入端，以及比較電路340控制數位類比轉換電路330輸出位準偏移器320的輸出資料的對應電壓。當所述目前位元資料與所述先前位元資料互為補數時，比較電路340控制閂鎖電路310選擇輸出所述先前位元資料至位準偏移器320的輸入端，以及比較電路340控制數位類比轉換電路330輸出所述目前位元資料的對應電壓。
在本實施例中，比較電路340包括比較器341與位準偏移器342。比較器341耦接至閂鎖電路310。比較器341可以進行步驟S510，以便比較所述目前位元資料與所述先前位元資料，並依據比較結果對應輸出第一控制信號INVER至閂鎖電路310，以控制閂鎖電路310選擇輸出所述目前位元資料或所述先前位元資料至位準偏移器320的輸入端。位準偏移器342耦接於比較器341 與數位類比轉換電路330之間。位準偏移器342將第一控制信號INVER轉換為第二控制信號HV_INVER給數位類比轉換電路330，以控制數位類比轉換電路330輸出位準偏移器320的輸出資料的對應電壓，或控制數位類比轉換電路330輸出所述目前位元資料的對應電壓。
所述位元資料與畫素資料的關係可以視實際產品的設計需求來決定。例如，在一些實施例中，所述位元資料可以是單一資料通道中畫素資料的部份位元或全部位元。也就是說，源極驅動器300可以配置x個比較器341與x個位準偏移器342。每一個比較器341各自從資料閂鎖器313接收畫素資料Data(L1)中單一個對應通道的畫素資料的部份位元或全部位元作為所述目前位元資料，以及每一個比較器341各自從線閂鎖器315接收畫素資料Data(L2)中單一個對應通道的畫素資料的部份位元或全部位元作為所述先前位元資料。在另一些實施例中，所述位元資料可以是多個(甚至是全部)資料通道中畫素資料的部份位元或全部位元。例如，以每N個通道為一組的方式將圖3所示x個通道分為P(即x/N)個通道組。也就是說，源極驅動器300可以配置P個比較器341與P個位準偏移器342。每一個比較器341各自從資料閂鎖器313接收畫素資料Data(L1)中N個對應通道的畫素資料的部份位元或全部位元作為所述目前位元資料，以及每一個比較器341各自從線閂鎖器315接收畫素資料Data(L2)中N個對應通道的畫素資料的部份位元或全部位元作為所述先前位元資料。
本實施例並不限制數位類比轉換電路330的實現方式。例如，圖3所示實施例中的數位類比轉換電路330包括多工器331、數位類比轉換器(Digital Analog Converter,DAC)332與輸出緩衝器(output buffer)333。多工器331耦接於位準偏移器320的輸出端與數位類比轉換器332的輸入端之間。位準偏移器342耦接於多工器331的控制端與比較器341的輸出端之間。位準偏移器342改變第一控制信號INVER的電壓準位，並將調整電壓準位後的控制信號(即第二控制信號HV_INVER)輸出至多工器331的控制端。多工器331依據第二控制信號HV_INVER而選擇將位準偏移器320的輸出傳送給數位類比轉換器332的輸入端，或選擇將位準偏移器320的輸出的補數傳送給數位類比轉換器332的輸入端。數位類比轉換器332依據GAMMA電壓VG，將不同通道中的畫素資料分別轉換為對應的類比灰階電壓。輸出緩衝器333耦接於數位類比轉換器332的輸出端與顯示面板20的資料線Y1~Yx之間。輸出緩衝器333可以依據數位類比轉換器332的不同通道中的類比電壓而分別輸出對應驅動電壓給顯示面板20的不同資料線Y1~Yx。
比較器341可以進行步驟S520，以便判斷所述目前位元資料是不是所述先前位元資料的補數，並對應控制閂鎖電路310與數位類比轉換電路330。當所述目前位元資料不是所述先前位元資料的補數時，比較器341可以進行步驟S530。當所述目前位元資料與所述先前位元資料互為補數時，比較器341可以進行步驟 S540。
當所述目前位元資料不是所述先前位元資料的補數時，於步驟S530中，比較器341藉由第一控制信號INVER去控制閂鎖電路310，以選擇將所述至少一目前位元資料(例如資料閂鎖器313的畫素資料Data(L1))輸出至位準偏移器320的輸入端而取代先前位元資料，以及藉由第二控制信號HV_INVER去控制數位類比轉換電路330將位準偏移器320的輸出資料轉換為對應電壓給顯示面板20。例如，當資料閂鎖器313的畫素資料Data(L1)不是線閂鎖器315的畫素資料Data(L2)的補數時，多工器314依據第一控制信號INVER選擇畫素資料Data(L1)作為畫素資料M_Data(L1)以輸出至線閂鎖器315的輸入端，以及多工器331依據第二控制信號HV_INVER選擇位準偏移器320所輸出的畫素資料HVData作為畫素資料M_HVData以輸出至數位類比轉換器332的輸入端。
當所述至少一目前位元資料與所述至少一先前位元資料互為補數時，於步驟S540中，比較器341藉由第一控制信號INVER去控制閂鎖電路310，以選擇將所述至少一先前位元資料(例如資料閂鎖器313的畫素資料Data(L1)的補數)輸出至位準偏移器320的輸入端，以及藉由第二控制信號HV_INVER去控制數位類比轉換電路330輸出所述至少一目前位元資料(例如資料閂鎖器313的畫素資料Data(L1))的對應電壓。例如，當資料閂鎖器313的畫素資料Data(L1)與線閂鎖器315的畫素資料Data(L2)互為補數 時，多工器314依據第一控制信號INVER選擇畫素資料Data(L1)的補數作為畫素資料M_Data(L1)以輸出至線閂鎖器315的輸入端，以及多工器331依據第二控制信號HV_INVER選擇位準偏移器320的畫素資料HVData的補數作為畫素資料M_HVData以輸出至數位類比轉換器332的輸入端。
以圖4為例，當目前位元資料(例如Data(L1)[1]~Data(L1)[x])為「FF」而先前位元資料(例如Data(L2)[1]~Data(L2)[x])為「00」時，目前位元資料與先前位元資料互為補數。當目前位元資料與先前位元資料互為補數時，多工器314選擇目前位元資料的補數(即「00」)作為畫素資料M_Data(L1)以輸出至線閂鎖器315的輸入端。因此，線閂鎖器315鎖存目前位元資料的補數(即「00」)，並輸「00」作為畫素資料Data(L2)。因此，位準偏移器320的畫素資料HVData[1]~HVData[x]維持於邏輯值「00」而沒有發生轉態。因此，當新的(目前的)畫素資料(例如FF)若與舊的(先前的)畫素資料(例如00)互為補數時，源極驅動器300的電源電流I(VDDS)的瞬間峰值電流(圖4所示虛圈400處)將會大幅減少。
然而，當目前位元資料與先前位元資料互為補數時，位準偏移器320的畫素資料HVData不是正確的邏輯值。因此，當目前位元資料與先前位元資料互為補數時，多工器331可以依據第二控制信號HV_INVER的控制而選擇位準偏移器320的畫素資料HVData的補數作為畫素資料M_HVData，以輸出至數位類比轉換 器332的輸入端。如圖4所示，多工器331輸出邏輯值為「FF」的畫素資料M_HVData[1]~M_HVData[x]至數位類比轉換器332的輸入端，以使數位類比轉換器332可以輸出正確的類比電壓。
圖6是依據本發明實施例說明圖3所示多工器的實施範例示意圖。圖6所示電路是單一位元的電路方塊示意圖。本領域具有通常知識者可以依據本實施例之教示而類推至多位元電路。圖6所示電路可以視為圖3所示多個通道中的多個位元中的其中一個位元電路。圖6所示資料閂鎖器610、多工器620、線閂鎖器630、位準偏移器640、多工器650、數位類比轉換器660與輸出緩衝器670可以分別互相參照於圖3所示資料閂鎖器313、多工器314、線閂鎖器315、位準偏移器320、多工器331、數位類比轉換器332與輸出緩衝器333。
請參照圖6，移位暫存器(未繪示，可參照圖3所示移位暫存器312)將閂鎖時脈提供給資料閂鎖器610的觸發端。資料閂鎖器610經由資料端D接收時序控制器(未繪示，可參照圖3所示時序控制器10)送來的畫素資料。依照閂鎖時脈的時序，資料端D的畫素資料會被鎖存在資料閂鎖器610中。多工器620的第一選擇端與第二選擇端分別耦接於資料閂鎖器610的正相輸出端Q與反相輸出端Qb。正相輸出端Q的信號與反相輸出端Qb的信號互為反相(即互為補數)。多工器620依據第一控制信號INVER而選擇將資料閂鎖器610的正相輸出端Q所輸出的目前位元資料傳送給線閂鎖器630的輸入端D，或選擇將資料閂鎖器610的反 相輸出端Qb所輸出的資料(即目前位元資料的補數)傳送給線閂鎖器630的輸入端D。線閂鎖器630依據閂鎖信號LD鎖存輸入端D的畫素資料，以及從輸出端Q輸出閂鎖內容給位準偏移器640。
位準偏移器640改變線閂鎖器630的輸出端Q的電壓準位，並將調整電壓準位後的資料輸出至多工器650。多工器650的第一選擇端與第二選擇端分別耦接於位準偏移器640的正相輸出端Q與反相輸出端Qb。正相輸出端Q的信號與反相輸出端Qb的信號互為反相(即互為補數)。多工器650依據第二控制信號HV_INVER而選擇將位準偏移器640的正相輸出端Q所輸出的資料傳送給數位類比轉換器660的輸入端，或選擇將位準偏移器640的反相輸出端Qb所輸出的資料傳送給數位類比轉換器660的輸入端。數位類比轉換器660依據GAMMA電壓VG，將多工器650所輸出的數位資料轉換為對應的類比灰階電壓，以及將此類比灰階電壓傳送至輸出緩衝器670的輸入端。輸出緩衝器670可以依據數位類比轉換器660所輸出的類比灰階電壓而輸出對應驅動電壓給顯示面板(未繪示，可參照圖3所示顯示面板20)的資料線。
圖7是依據本發明另一實施例說明圖3所示多工器的實施範例示意圖。圖7所示電路是單一位元的電路方塊示意圖。本領域具有通常知識者可以依據本實施例之教示而類推至多位元電路。圖7所示電路可以視為圖3所示多個通道中的多個位元中的其中一個位元電路。圖7所示資料閂鎖器710、多工器720、線閂鎖器730、位準偏移器740、多工器750、數位類比轉換器760與 輸出緩衝器770可以分別互相參照於圖3所示資料閂鎖器313、多工器314、線閂鎖器315、位準偏移器320、多工器331、數位類比轉換器332與輸出緩衝器333。
圖7所示資料閂鎖器710、多工器720、線閂鎖器730、位準偏移器740、多工器750、數位類比轉換器760與輸出緩衝器770可以分別參照圖6所示資料閂鎖器610、多工器620、線閂鎖器630、位準偏移器640、多工器650、數位類比轉換器660與輸出緩衝器670的相關說明而類推之。不同於圖6所示實施例之處，在於圖7所示實施例還包含反閘725與反閘755。
請參照圖7，反閘725的輸入端耦接至資料閂鎖器710的輸出端Q。多工器720的第一選擇端耦接至資料閂鎖器710的輸出端Q，而多工器720的第二選擇端耦接至反閘725的輸出端。反閘725可以提供資料閂鎖器710的輸出端Q的信號的反相信號(即補數)。多工器720依據第一控制信號INVER而選擇將資料閂鎖器710的輸出端Q所輸出的目前位元資料傳送給線閂鎖器730的輸入端D，或選擇將目前位元資料的補數傳送給線閂鎖器730的輸入端D。
反閘755的輸入端耦接至位準偏移器740的輸出端。多工器750的第一選擇端耦接於位準偏移器740的輸出端，而多工器750的第二選擇端耦接至反閘755的輸出端。反閘755可以提供位準偏移器740的輸出端信號的反相信號(即補數)。多工器750依據第二控制信號HV_INVER而選擇將位準偏移器740所輸出的 資料傳送給數位類比轉換器760的輸入端，或選擇將位準偏移器740的輸出資料的補數傳送給數位類比轉換器760的輸入端。
圖8是依據本發明再一實施例說明一種源極驅動器800的電路方塊示意圖。圖8所示源極驅動器800與其內部構件可以參照圖3所示源極驅動器300的相關說明而類推之。不同於圖3所示實施例之處，在於圖8所示實施例中閂鎖電路310的多工器314與數位類比轉換電路330的多工器331受控於時序控制器30。時序控制器30可以比較所述目前位元資料與所述先前位元資料。當所述目前位元資料不是所述先前位元資料的補數時，時序控制器30控制閂鎖電路310的多工器314選擇輸出所述目前位元資料至線閂鎖器315，以及時序控制器30控制數位類比轉換電路330的多工器331輸出位準偏移器320的輸出資料給數位類比轉換器332。當所述目前位元資料與所述先前位元資料互為補數時，時序控制器30控制閂鎖電路310的多工器314選擇輸出所述先前位元資料(即所述目前位元資料的補數)至線閂鎖器315，以及時序控制器30控制數位類比轉換電路330的多工器331輸出所述目前位元資料(即位準偏移器320的輸出資料的補數)給數位類比轉換器332。
圖9是依據本發明又一實施例說明一種源極驅動器900的電路方塊示意圖。源極驅動器900耦接於時序控制器10與顯示面板20之間。依據時序控制器10的控制，源極驅動器900可以將時序控制器10所提供的畫素資料轉換為驅動電壓，以及用此驅 動電壓去驅動顯示面板20的資料線(或源極線)來顯示對應影像。源極驅動器900包括閂鎖電路910、位準偏移器320以及數位類比轉換電路330。閂鎖電路910可以從時序控制器10接收並鎖存至少一目前位元資料，以及將所述至少一目前位元資料輸出至位準偏移器320的輸入端以取代至少一先前位元資料。所述目前位元資料可以是單一資料通道中畫素資料的部份位元或全部位元，也可以是多個(甚至是全部)資料通道中畫素資料的部份位元或全部位元。圖9所示源極驅動器900與其內部構件可以參照圖3所示源極驅動器300的相關說明或圖8所示源極驅動器800的相關說明而類推之。
圖9所示實施例中的閂鎖電路910包括資料接收器311、移位暫存器312、資料閂鎖器313、多工器314以及線閂鎖器315。不同於圖3所示實施例之處，在於圖9所示實施例是將多工器314耦接於線閂鎖器315與位準偏移器320之間。
圖10是依照本發明實施例說明圖9所示源極驅動器900的信號時序示意圖。請參照圖9與圖10，資料閂鎖器313經由資料接收器311接收時序控制器10送來的畫素資料R、G、B。依照不同通道的閂鎖時脈Ck[1]~Ck[x]的時序，時序控制器10送來的不同畫素資料會被鎖存在資料閂鎖器313的對應通道中。線閂鎖器315的輸入端耦接至資料閂鎖器313的輸出端，其中線閂鎖器315依據閂鎖信號LD鎖存線閂鎖器315的輸入端的資料。多工器314耦接於線閂鎖器315的輸出端與位準偏移器320的輸入端之 間。多工器314依據第一控制信號INVER而選擇將線閂鎖器315所輸出的目前位元資料傳送給位準偏移器320的輸入端，或選擇將所述目前位元資料的補數傳送給位準偏移器320的輸入端。
例如，請參照圖10，假設時序控制器10在一先前期間中送來的畫素資料R、G、B皆為「00」，則資料閂鎖器313可以依照閂鎖時脈Ck[1]~Ck[x]的時序而將不同通道的畫素資料「00」鎖存在對應通道中。舉例來說，資料閂鎖器313可以依照閂鎖時脈Ck[1]的時序而將「00」鎖存在第一個通道，以及輸出畫素資料Data(L1)的第一個通道畫素資料Data(L1)[1]。同理可推，資料閂鎖器313可以依照閂鎖時脈Ck[x]的時序而將「00」鎖存在第x個通道，以及輸出畫素資料Data(L1)的第x個通道畫素資料Data(L1)[x]。線閂鎖器315可以依據閂鎖信號LD而鎖存資料閂鎖器313所輸出的畫素資料Data(L1)。舉例來說，線閂鎖器315依據閂鎖信號LD而鎖存資料閂鎖器313的輸出端的畫素資料Data(L1)，以及輸出閂鎖內容，即輸出畫素資料Data(L2)的第一個通道畫素資料Data(L2)[1]、...、第x個通道畫素資料Data(L2)[x]。在先前期間結束後，假設時序控制器10在一目前期間中送來的畫素資料為「FF」，則資料閂鎖器313可以將不同通道的畫素資料「FF」鎖存在對應通道中，以取代在先前期間中的先前畫素資料。例如，資料閂鎖器313將「FF」鎖存在第一個通道而輸出畫素資料Data(L1)的第一個通道畫素資料Data(L1)[1]，以及將「FF」鎖存在第x個通道而輸出畫素資料Data(L1)的第x個通道畫素資料 Data(L1)[x]。依據閂鎖信號LD，線閂鎖器315鎖存邏輯值為「FF」的畫素資料Data(L1)，以及輸出邏輯值為「FF」的畫素資料Data(L2)，例如圖10所示第一個通道畫素資料Data(L2)[1]以及第x個通道畫素資料Data(L2)[x]。
比較電路340的比較器341可以比較所述目前位元資料(例如資料閂鎖器313所輸出的畫素資料Data(L1))與所述先前位元資料(例如線閂鎖器315所輸出的畫素資料Data(L2))，並依據比較結果對應輸出第一控制信號INVER至閂鎖電路910的多工器314。位準偏移器342將第一控制信號INVER轉換為第二控制信號HV_INVER給數位類比轉換電路330的多工器331。當所述目前位元資料不是所述先前位元資料的補數時，比較器341藉由第一控制信號INVER去控制閂鎖電路910的多工器314，以選擇將線閂鎖器315所輸出的畫素資料Data(L2)輸出至位準偏移器320的輸入端，以及比較器341藉由第二控制信號HV_INVER控制數位類比轉換電路330的多工器331，以選擇將位準偏移器320的輸出資料輸出至數位類比轉換器332。當所述目前位元資料與所述先前位元資料互為補數時，比較器341藉由第一控制信號INVER去控制閂鎖電路910的多工器314，以選擇將線閂鎖器315所輸出的畫素資料Data(L2)的補數輸出至位準偏移器320的輸入端，以及比較器341藉由第二控制信號HV_INVER控制控制數位類比轉換電路330的多工器331，以選擇將位準偏移器320的輸出資料的補數輸出至數位類比轉換器332。
以圖10為例，當目前位元資料(例如Data(L1)[1]~Data(L1)[x])為「FF」而先前位元資料(例如Data(L2)[1]~Data(L2)[x])為「00」時，目前位元資料與先前位元資料互為補數。當目前位元資料與先前位元資料互為補數時，多工器314選擇目前位元資料的補數(即「00」)作為畫素資料M_Data(L2)以輸出至位準偏移器320的輸入端。因此，位準偏移器320的畫素資料HVData[1]~HVData[x]維持於邏輯值「00」而沒有發生轉態。因此，當新的(目前的)畫素資料(例如FF)若與舊的(先前的)畫素資料(例如00)互為補數時，源極驅動器900的電源電流I(VDDS)的瞬間峰值電流(圖10所示虛圈1000處)將會大幅減少。
圖11是依據本發明再一實施例說明一種源極驅動器1100的電路方塊示意圖。源極驅動器1100耦接於時序控制器10與顯示面板20之間。依據時序控制器10的控制，源極驅動器1100可以將時序控制器10所提供的畫素資料轉換為驅動電壓，以及用此驅動電壓去驅動顯示面板20的資料線(或源極線)來顯示對應影像。源極驅動器1100包括閂鎖電路1110、位準偏移器320以及數位類比轉換電路330。閂鎖電路1110可以從時序控制器10接收並鎖存至少一目前位元資料，以及將所述至少一目前位元資料輸出至位準偏移器320的輸入端以取代至少一先前位元資料。所述目前位元資料可以是單一資料通道中畫素資料的部份位元或全部位元，也可以是多個(甚至是全部)資料通道中畫素資料的部份位元或全部位元。圖11所示源極驅動器1100與其內部構件可以參 照圖3所示源極驅動器300的相關說明或圖8所示源極驅動器800的相關說明而類推之。
圖11所示實施例中的閂鎖電路1110包括資料接收器311、移位暫存器312、資料閂鎖器313、線閂鎖器315以及多工器316。不同於圖3所示實施例之處，在於圖11所示實施例省略了資料閂鎖器313與線閂鎖器315之間的多工器，以及在線閂鎖器315的觸發端與閂鎖信號LD之間配置了多工器316。
圖12是依照本發明實施例說明圖11所示源極驅動器1100的信號時序示意圖。請參照圖11與圖12，資料閂鎖器313經由資料接收器311接收時序控制器10送來的畫素資料R、G、B。依照不同通道的閂鎖時脈Ck[1]~Ck[x]的時序，時序控制器10送來的不同畫素資料會被鎖存在資料閂鎖器313的對應通道中。線閂鎖器315的輸入端耦接至資料閂鎖器313的輸出端，而線閂鎖器315的輸出端耦接至位準偏移器320的輸入端。線閂鎖器315依據線閂鎖器315的觸發端的信號而鎖存線閂鎖器315的輸入端的資料。多工器316的共同端耦接於線閂鎖器315的觸發端以提供信號M_LD。多工器316依據第一控制信號INVER而選擇將閂鎖信號LD作為信號M_LD而傳送給線閂鎖器315的觸發端，或選擇將禁能信號(其具有固定邏輯值，例如「0」、「1」或其他邏輯態)作為信號M_LD而傳送給線閂鎖器315的觸發端。
例如，請參照圖12，假設時序控制器10在一先前期間中送來的畫素資料R、G、B皆為「00」，則資料閂鎖器313可以依 照閂鎖時脈Ck[1]~Ck[x]的時序而將不同通道的畫素資料「00」鎖存在對應通道中。舉例來說，資料閂鎖器313可以依照閂鎖時脈Ck[1]的時序而將「00」鎖存在第一個通道，以及輸出畫素資料Data(L1)的第一個通道畫素資料Data(L1)[1]。同理可推，資料閂鎖器313可以依照閂鎖時脈Ck[x]的時序而將「00」鎖存在第x個通道，以及輸出畫素資料Data(L1)的第x個通道畫素資料Data(L1)[x]。比較電路340的比較器341可以比較所述目前位元資料(例如資料閂鎖器313所輸出的畫素資料Data(L1))與所述先前位元資料(例如線閂鎖器315所輸出的畫素資料Data(L2))，並依據比較結果對應輸出第一控制信號INVER至閂鎖電路1110的多工器316。位準偏移器342將第一控制信號INVER轉換為第二控制信號HV_INVER給數位類比轉換電路330的多工器331。
線閂鎖器315可以依據其觸發端的信號而決定是否鎖存資料閂鎖器313所輸出的畫素資料Data(L1)。舉例來說，當閂鎖信號LD被傳送至線閂鎖器315的觸發端時，線閂鎖器315依據閂鎖信號LD而鎖存資料閂鎖器313的輸出端的畫素資料Data(L1)，以及輸出閂鎖內容，即輸出畫素資料Data(L2)的第一個通道畫素資料Data(L2)[1]、...、第x個通道畫素資料Data(L2)[x]。在先前期間結束後，假設時序控制器10在一目前期間中送來的畫素資料為「FF」，則資料閂鎖器313可以將不同通道的畫素資料「FF」鎖存在對應通道中，以取代在先前期間中的先前畫素資料。例如，資料閂鎖器313將「FF」鎖存在第一個通道而輸出畫素資料Data(L1) 的第一個通道畫素資料Data(L1)[1]，以及將「FF」鎖存在第x個通道而輸出畫素資料Data(L1)的第x個通道畫素資料Data(L1)[x]，如圖12所示。
當所述目前位元資料不是所述先前位元資料的補數時，比較器341藉由第一控制信號INVER去控制閂鎖電路1110的多工器316，以選擇將閂鎖信號LD輸出至線閂鎖器315的觸發端，以及比較器341藉由第二控制信號HV_INVER控制數位類比轉換電路330的多工器331，以選擇將位準偏移器320的輸出資料輸出至數位類比轉換器332。當閂鎖信號LD被傳送至線閂鎖器315的觸發端作為信號M_LD時，依據閂鎖信號LD，線閂鎖器315鎖存畫素資料Data(L1)，以及輸出畫素資料Data(L2)，例如圖12所示第一個通道畫素資料Data(L2)[1]以及第x個通道畫素資料Data(L2)[x]。
當所述目前位元資料與所述先前位元資料互為補數時，比較器341藉由第一控制信號INVER去控制閂鎖電路1110的多工器316，以選擇將所述禁能信號輸出至線閂鎖器315的觸發端，以及比較器341藉由第二控制信號HV_INVER控制控制數位類比轉換電路330的多工器331，以選擇將位準偏移器320的輸出資料的補數輸出至數位類比轉換器332。請參照圖11與圖12，由於閂鎖信號LD被遮蔽，線閂鎖器315不會將所述目前位元資料「FF」鎖存於線閂鎖器315內，因此線閂鎖器315所輸出的畫素資料Data(L2)[1]~Data(L2)[x]保持於先前位元資料「00」。因此，位準 偏移器320的畫素資料HVData[1]~HVData[x]維持於邏輯值「00」而沒有發生轉態。因此，當新的(目前的)畫素資料(例如FF)若與舊的(先前的)畫素資料(例如00)互為補數時，源極驅動器1100的電源電流I(VDDS)的瞬間峰值電流(圖12所示虛圈1200處)將會大幅減少。
圖13是依據本發明更一實施例說明一種源極驅動器1300的電路方塊示意圖。源極驅動器1300耦接於時序控制器10與顯示面板20之間。依據時序控制器10的控制，源極驅動器1300可以將時序控制器10所提供的畫素資料轉換為驅動電壓，以及用此驅動電壓去驅動顯示面板20的資料線(或源極線)來顯示對應影像。源極驅動器1300包括閂鎖電路310、位準偏移器320以及數位類比轉換電路1330。閂鎖電路310可以從時序控制器10接收並鎖存至少一目前位元資料，以及將所述至少一目前位元資料輸出至位準偏移器320的輸入端以取代至少一先前位元資料。所述目前位元資料可以是單一資料通道中畫素資料的部份位元或全部位元，也可以是多個(甚至是全部)資料通道中畫素資料的部份位元或全部位元。圖13所示源極驅動器1300與其內部構件可以參照圖3所示源極驅動器300的相關說明或圖8所示源極驅動器800的相關說明而類推之。
圖13所示實施例中的數位類比轉換電路1330包括多工器331、數位類比轉換器332與輸出緩衝器333。不同於圖3所示實施例之處，在於圖13所示實施例是將多工器331耦接於數位類 比轉換器332的輸出端與輸出緩衝器333的輸入端之間。數位類比轉換器332的輸入端耦接至位準偏移器320的輸出端。多工器331依據第二控制信號HV_BYPASS而選擇將數位類比轉換器332的輸出、第一灰階電壓或第二灰階電壓傳送給下一級電路(詳參圖14的相關說明)。
比較電路340的比較器341可以比較所述目前位元資料(例如資料閂鎖器313所輸出的畫素資料Data(L1))與所述先前位元資料(例如線閂鎖器315所輸出的畫素資料Data(L2))，並依據比較結果對應輸出第一控制信號INVER至閂鎖電路310的多工器314。位準偏移器342將第一控制信號INVER轉換為第二控制信號HV_BYPASS給數位類比轉換電路1330的多工器331。閂鎖電路310的線閂鎖器315將畫素資料Data(L2)傳送給位準偏移器320的輸入端。位準偏移器320將畫素資料HVData傳送給數位類比轉換電路1330的數位類比轉換器332的輸入端。數位類比轉換器332依據GAMMA電壓VG，將不同通道中的畫素資料分別轉換為對應的類比灰階電壓。
當所述目前位元資料不是所述先前位元資料的補數時，比較器341藉由第一控制信號INVER去控制閂鎖電路310的多工器314，以使多工器314選擇將資料閂鎖器313的畫素資料Data(L1)傳送至線閂鎖器315的輸入端，以及比較器341藉由第二控制信號HV_BYPASS控制數位類比轉換電路1330的多工器331，以使多工器331選擇將數位類比轉換器332的輸出電壓傳送至下一級 電路(例如輸出緩衝器333)的輸入端。當所述目前位元資料與所述先前位元資料互為補數時，比較器341藉由第一控制信號INVER去控制多工器314，以使多工器314選擇將畫素資料Data(L1)的補數傳送至線閂鎖器315的輸入端，以及比較器341藉由第二控制信號HV_BYPASS控制數位類比轉換電路1330的多工器331，以使多工器331選擇將第一灰階電壓(最低灰階電壓，例如畫素資料「00」所對應的灰階電壓)或第二灰階電壓(最高灰階電壓，例如畫素資料「FF」所對應的灰階電壓)傳送給下一級電路。
圖14是依據本發明實施例說明圖13所示多工器的實施範例示意圖。圖14所示電路是單一位元的電路方塊示意圖。本領域具有通常知識者可以依據本實施例之教示而類推至多位元電路。圖14所示電路可以視為圖13所示多個通道中的多個位元中的其中一個位元電路。圖14所示資料閂鎖器1410、多工器1420、線閂鎖器1430、位準偏移器1440、數位類比轉換器1450、多工器1460與輸出緩衝器1470可以分別互相參照於圖13所示資料閂鎖器313、多工器314、線閂鎖器315、位準偏移器320、數位類比轉換器332、多工器331與輸出緩衝器333。
圖14所示資料閂鎖器1410、多工器1420、線閂鎖器1430、位準偏移器1440、數位類比轉換器1450與輸出緩衝器1470可以分別參照於圖6所示資料閂鎖器610、多工器620、線閂鎖器630、位準偏移器640、數位類比轉換器660與輸出緩衝器670的 相關說明而類推之。不同於圖6所示實施例之處，在於圖14所示實施例省略了位準偏移器1440與數位類比轉換器1450之間的多工器，以及在數位類比轉換器1450的輸出端與輸出緩衝器1470的輸入端之間配置了多工器1460。
當目前位元資料不是先前位元資料的補數時，多工器1420依據第一控制信號INVER的控制而選擇將資料閂鎖器1410的正相輸出端Q所輸出的目前位元資料傳送給線閂鎖器1430的輸入端D，以及多工器1460依據第二控制信號HV_BYPASS的控制而選擇將數位類比轉換器1450的輸出電壓傳送至下一級電路(例如輸出緩衝器1470)的輸入端。當目前位元資料為最小值(例如「00」)而先前位元資料為最大值(例如「FF」)時，多工器1420依據第一控制信號INVER的控制而選擇將資料閂鎖器1410的反相輸出端Qb所輸出的資料(即目前位元資料的補數)傳送至線閂鎖器1430的輸入端D，以及多工器1460依據第二控制信號HV_BYPASS的控制而選擇將第一灰階電壓VG1傳送給下一級電路。所述第一灰階電壓VG1可以是在多個GAMMA電壓VG中畫素資料「00」所對應的灰階電壓，例如是GAMMA電壓VG中的最低灰階電壓。當目前位元資料為最大值(例如「FF」)而先前位元資料為最小值(例如「00」)時，多工器1420依據第一控制信號INVER的控制而選擇將資料閂鎖器1410的反相輸出端Qb所輸出的資料(即目前位元資料的補數)傳送至線閂鎖器1430的輸入端D，以及多工器1460依據第二控制信號HV_BYPASS的控制而 選擇將第二灰階電壓VG2傳送給下一級電路。所述第二灰階電壓VG2可以是在多個GAMMA電壓VG中畫素資料「FF」所對應的灰階電壓，例如是GAMMA電壓VG中的最高灰階電壓。
圖15是依據本發明又一實施例說明一種源極驅動器1500的電路方塊示意圖。源極驅動器1500耦接於時序控制器10與顯示面板20之間。依據時序控制器10的控制，源極驅動器1500可以將時序控制器10所提供的畫素資料轉換為驅動電壓，以及用此驅動電壓去驅動顯示面板20的資料線(或源極線)來顯示對應影像。源極驅動器1500包括閂鎖電路910、位準偏移器320以及數位類比轉換電路1330。圖15所示源極驅動器1500與其內部構件可以參照圖3所示源極驅動器300、圖8所示源極驅動器800、圖9所示源極驅動器900或圖13所示源極驅動器1300的相關說明而類推之。例如，圖15所示閂鎖電路910可以參照圖9的相關說明，而圖15所示數位類比轉換電路1330可以參照圖13與圖14的相關說明。請參照圖15，當目前位元資料與先前位元資料互為補數時，比較器341藉由第一控制信號INVER去控制多工器314，以使多工器314選擇將畫素資料Data(L2)的補數傳送至位準偏移器320的輸入端，以及比較器341藉由第二控制信號HV_BYPASS控制數位類比轉換電路1330的多工器331，以使多工器331選擇將GAMMA電壓VG中的第一灰階電壓或第二灰階電壓傳送給下一級電路。
圖16是依據本發明又一實施例說明一種源極驅動器 1600的電路方塊示意圖。源極驅動器1600耦接於時序控制器10與顯示面板20之間。依據時序控制器10的控制，源極驅動器1600可以將時序控制器10所提供的畫素資料轉換為驅動電壓，以及用此驅動電壓去驅動顯示面板20的資料線(或源極線)來顯示對應影像。源極驅動器1600包括閂鎖電路1110、位準偏移器320以及數位類比轉換電路1330。圖16所示源極驅動器1600與其內部構件可以參照圖3所示源極驅動器300、圖8所示源極驅動器800、圖11所示源極驅動器1100或圖13所示源極驅動器1300的相關說明而類推之。例如，圖16所示閂鎖電路1110可以參照圖11的相關說明，而圖16所示數位類比轉換電路1330可以參照圖13與圖14的相關說明。請參照圖16，當目前位元資料與先前位元資料互為補數時，比較器341藉由第一控制信號INVER去控制多工器314，以使多工器314選擇將畫素資料Data(L2)的補數傳送至位準偏移器320的輸入端，以及比較器341藉由第二控制信號HV_BYPASS控制數位類比轉換電路1330的多工器331，以使多工器331選擇將GAMMA電壓VG中的第一灰階電壓或第二灰階電壓傳送給下一級電路。
綜上所述，本發明諸實施例可以判斷資料，並依據判斷結果來降低峰值電流。判斷電路(例如比較電路340或時序控制器30)可以判斷目前位元資料與先前位元資料是否為補數。在一些實施例中，所述目前位元資料可以是資料閂鎖器313所輸出的畫素資料Data(L1)的部份位元或全部位元，而所述先前位元資料 可以是線閂鎖器315所輸出的畫素資料Data(L2)的部份位元或全部位元。判斷電路會依據判斷後的結果而對應控制多工器(例如多工器314、316及/或331)。若判斷結果顯示所述目前位元資料與所述先前位元資料互為補數，則所述目前位元資料的補數會被送至位準偏移器320，避免資料翻轉時產生的峰值電流。在所述目前位元資料的補數被送至位準偏移器320的同時，在電位轉換器320的輸出端與數位類比轉換器332的輸入端之間的多工器331可以將所述目前位元資料的補數還原為所述目前位元資料。若判斷結果顯示所述目前位元資料不是所述先前位元資料的補數，則所述目前位元資料會被送至位準偏移器320。由於所述目前位元資料與所述先前位元資料二者非補數關係，此時資料翻轉也不會有過多的峰值電流。
雖然本發明已以實施例揭露如上，然其並非用以限定本發明，任何所屬技術領域中具有通常知識者，在不脫離本發明的精神和範圍內，當可作些許的更動與潤飾，故本發明的保護範圍當視後附的申請專利範圍所界定者為準。
10‧‧‧時序控制器
20‧‧‧顯示面板
300‧‧‧源極驅動器
310‧‧‧閂鎖電路
311‧‧‧資料接收器
312‧‧‧移位暫存器
313‧‧‧資料閂鎖器
314、331‧‧‧多工器
315‧‧‧線閂鎖器
320、342‧‧‧位準偏移器
330‧‧‧數位類比轉換電路
332‧‧‧數位類比轉換器
333‧‧‧輸出緩衝器
340‧‧‧比較電路
341‧‧‧比較器
B、G、R‧‧‧畫素資料
Ck[1]、Ck[x]‧‧‧閂鎖時脈
CLK‧‧‧時脈信號
Data(L1)、Data(L2)、M_Data(L1)、HVData、M_HVData‧‧‧畫素資料
DIO‧‧‧線資料起始信號
HV_INVER‧‧‧第二控制信號
INVER‧‧‧第一控制信號
LD‧‧‧閂鎖信號
VDDA‧‧‧電源電壓
VG‧‧‧GAMMA電壓
Y1、Y2、Y3、Yx-1、Yx‧‧‧資料線

Claims (16)

  1. 一種源極驅動器，包括：一位準偏移器；一閂鎖電路，鎖存至少一目前位元資料，其中當所述至少一目前位元資料不是至少一先前位元資料的補數時，該閂鎖電路選擇輸出所述至少一目前位元資料至該位準偏移器的輸入端以取代所述至少一先前位元資料，以及當所述至少一目前位元資料與所述至少一先前位元資料互為補數時，該閂鎖電路選擇輸出所述至少一先前位元資料至該位準偏移器的該輸入端；以及一數位類比轉換電路，耦接至該位準偏移器的輸出端，其中當所述至少一目前位元資料不是所述至少一先前位元資料的補數時，該數位類比轉換電路輸出該位準偏移器的輸出的對應電壓，以及當所述至少一目前位元資料與所述至少一先前位元資料互為補數時，該數位類比轉換電路輸出所述至少一目前位元資料的對應電壓。
  2. 如申請專利範圍第1項所述的源極驅動器，其中所述至少一目前位元資料是該源極驅動器中一通道的資料的部份位元或全部位元。
  3. 如申請專利範圍第1項所述的源極驅動器，其中所述至少一目前位元資料是該源極驅動器中多個通道的資料的部份位元或全部位元。
  4. 如申請專利範圍第1項所述的源極驅動器，其中該閂鎖電 路包括：一資料閂鎖器，鎖存並輸出所述至少一目前位元資料；一線閂鎖器，其輸出端耦接至該位準偏移器的該輸入端，其中該線閂鎖器依據一閂鎖信號鎖存該線閂鎖器的輸入端的資料；以及一多工器，耦接於該資料閂鎖器的輸出端與該線閂鎖器的該輸入端之間，其中該多工器依據一第一控制信號而選擇將該資料閂鎖器所輸出的所述至少一目前位元資料或所述至少一目前位元資料的補數傳送給該線閂鎖器的該輸入端。
  5. 如申請專利範圍第1項所述的源極驅動器，其中該閂鎖電路包括：一資料閂鎖器，鎖存並輸出所述至少一目前位元資料；一線閂鎖器，其輸入端耦接至該資料閂鎖器的輸出端，其中該線閂鎖器依據一閂鎖信號鎖存該線閂鎖器的輸入端的資料；以及一多工器，耦接於該線閂鎖器的輸出端與該位準偏移器的該輸入端之間，其中該多工器依據一第一控制信號而選擇將該線閂鎖器所輸出的所述至少一目前位元資料或所述至少一目前位元資料的補數傳送給該位準偏移器的該輸入端。
  6. 如申請專利範圍第1項所述的源極驅動器，其中該閂鎖電路包括：一資料閂鎖器，鎖存並輸出所述至少一目前位元資料； 一線閂鎖器，其輸入端耦接至該資料閂鎖器的輸出端，而該線閂鎖器的輸出端耦接至該位準偏移器的該輸入端，其中該線閂鎖器依據該線閂鎖器的觸發端的信號而鎖存該線閂鎖器的輸入端的資料；以及一多工器，耦接於該線閂鎖器的該觸發端，其中該多工器依據一第一控制信號而選擇將一閂鎖信號或一禁能信號傳送給該線閂鎖器的該觸發端。
  7. 如申請專利範圍第1項所述的源極驅動器，其中該數位類比轉換電路包括：一數位類比轉換器；以及一多工器，耦接於該位準偏移器的該輸出端與該數位類比轉換器的輸入端之間，其中該多工器依據一第二控制信號而選擇將該位準偏移器的輸出或該位準偏移器的所述輸出的補數傳送給該數位類比轉換器的該輸入端。
  8. 如申請專利範圍第1項所述的源極驅動器，其中該數位類比轉換電路包括：一數位類比轉換器，其輸入端耦接至該位準偏移器的該輸出端；以及一多工器，耦接至該數位類比轉換器的輸出端，其中該多工器依據一第二控制信號而選擇將該數位類比轉換器的輸出、一第一灰階電壓或一第二灰階電壓傳送給下一級電路。
  9. 如申請專利範圍第1項所述的源極驅動器，更包括： 一比較電路，耦接至該閂鎖電路與該數位類比轉換電路，其中該比較電路比較所述至少一目前位元資料與所述至少一先前位元資料；其中當所述至少一目前位元資料不是所述至少一先前位元資料的補數時，該比較電路控制該閂鎖電路選擇輸出所述至少一目前位元資料至該位準偏移器的輸入端，以及該比較電路控制該數位類比轉換電路輸出該位準偏移器的輸出資料的對應電壓；以及其中當所述至少一目前位元資料與所述至少一先前位元資料互為補數時，該比較電路控制該閂鎖電路選擇輸出所述至少一先前位元資料至該位準偏移器的該輸入端，以及該比較電路控制該數位類比轉換電路輸出所述至少一目前位元資料的對應電壓。
  10. 如申請專利範圍第9項所述的源極驅動器，其中該比較電路包括：一比較器，耦接至該閂鎖電路，其中該比較器比較所述至少一目前位元資料與所述至少一先前位元資料，並依據比較結果對應輸出一第一控制信號至該閂鎖電路，以控制該閂鎖電路選擇輸出所述至少一目前位元資料或所述至少一先前位元資料至該位準偏移器的輸入端；以及一第二位準偏移器，耦接於該比較器與該數位類比轉換電路之間，其中該第二位準偏移器將該第一控制信號轉換為一第二控制信號給該數位類比轉換電路，以控制該數位類比轉換電路輸出該位準偏移器的輸出資料的對應電壓或所述至少一目前位元資料 的對應電壓。
  11. 如申請專利範圍第1項所述的源極驅動器，其中該閂鎖電路與該數位類比轉換電路受控於一時序控制器。
  12. 一種降低源極驅動器峰值電流的方法，包括：比較至少一目前位元資料與至少一先前位元資料；當所述至少一目前位元資料不是所述至少一先前位元資料的補數時，選擇將所述至少一目前位元資料輸出至該源極驅動器的一位準偏移器的輸入端以取代所述至少一先前位元資料，以及由一數位類比轉換電路將該位準偏移器的輸出資料轉換為對應電壓；以及當所述至少一目前位元資料與所述至少一先前位元資料互為補數時，選擇將所述至少一先前位元資料輸出至該位準偏移器的該輸入端，以及由該數位類比轉換電路輸出所述至少一目前位元資料的對應電壓。
  13. 如申請專利範圍第12項所述降低源極驅動器峰值電流的方法，其中所述至少一目前位元資料是該源極驅動器中一通道的資料的部份位元或全部位元。
  14. 如申請專利範圍第12項所述降低源極驅動器峰值電流的方法，其中所述至少一目前位元資料是該源極驅動器中多個通道的資料的部份位元或全部位元。
  15. 如申請專利範圍第12項所述降低源極驅動器峰值電流的方法，其中該數位類比轉換電路包括一數位類比轉換器；當所述 至少一目前位元資料不是所述至少一先前位元資料的補數時，選擇將該位準偏移器的該輸出資料傳送給該數位類比轉換器的輸入端；以及當所述至少一目前位元資料與所述至少一先前位元資料互為補數時，選擇將該位準偏移器的所述輸出資料的補數傳送給該數位類比轉換器的該輸入端。
  16. 如申請專利範圍第12項所述降低源極驅動器峰值電流的方法，其中該數位類比轉換電路包括耦接至該位準偏移器的輸出端的一數位類比轉換器；當所述至少一目前位元資料不是所述至少一先前位元資料的補數時，選擇將該數位類比轉換器的輸出傳送給下一級電路；以及當所述至少一目前位元資料與所述至少一先前位元資料互為補數時，選擇將一第一灰階電壓或一第二灰階電壓傳送給下一級電路。
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