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TWI540369B - 顯示面板 - Google Patents

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TWI540369B
TWI540369B TW104111597A TW104111597A TWI540369B TW I540369 B TWI540369 B TW I540369B TW 104111597 A TW104111597 A TW 104111597A TW 104111597 A TW104111597 A TW 104111597A TW I540369 B TWI540369 B TW I540369B
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electrode
pixel
edge
display panel
pixel electrode
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TW104111597A
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Inventor
賴呈暐
陳卓彥
丁天倫
Original Assignee
友達光電股份有限公司
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Publication date
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Priority to CN201510291872.2A priority patent/CN104880867B/zh
Priority to US14/813,133 priority patent/US9746721B2/en
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Description

顯示面板
本發明是有關於一種顯示面板，且特別是有關於一種具有高穿透率的顯示面板。
在顯示器的發展上，隨著光電技術與半導體製造技術的進步，具有高畫質、空間利用效率佳、低消耗功率、無輻射等優越特性的液晶顯示器已逐漸成為市場之主流。
液晶顯示器包括了背光模組以及液晶顯示面板。在液晶顯示面板的製造技術方面，目前已提出一種聚合物穩定配向(Polymer Stabilized Alignment,PSA)的技術，此技術是利用聚合物配向搭配具有多個分支狹縫的畫素電極以形成多領域配向(multi-domain alignment)。在液晶材料中摻入適當濃度的可聚合分子(單體)(以下稱液晶混合物)。接著，對液晶混合物施予一電壓。當施加電壓使液晶分子排列穩定時，則使用紫外光照射的方式讓可聚合分子(單體)鍵結成聚合物層，以完成穩定配向製程。
現行聚合物穩定配向技術所使用的畫素電極圖案存在的 問題是，當施加電壓時，液晶分子會向畫素中心傾倒，以形成多區域配向。然而，不同區域的液晶分子在區域邊界互相推擠而形成十字暗紋，當十字暗紋的寬度過寬，會造成穿透率下降的問題。
本發明提供一種顯示面板，透過改變聚合物穩定配向模式中液晶分子的傾倒方向，以縮減不同區域的液晶分子在區域邊界互相推擠所造成的十字暗紋寬度，達到提高穿透率的效果。
本發明的一種顯示面板，包括多個畫素單元。每一畫素單元包括第一基板、第二基板以及位於第一基板與第二基板之間的顯示介質。第一基板包括第一次畫素以及鄰接第一次畫素設置的第二次畫素。第一次畫素包括第一主動元件以及與第一主動元件電性連接的第一畫素電極，其中第一畫素電極具有第一主狹縫以及與第一主狹縫連接在一起的多個第一分支狹縫。第二次畫素包括第二主動元件以及與第二主動元件電性連接的第二畫素電極，其中第二畫素電極具有第二主狹縫以及與第二主狹縫連接在一起的多個第二分支狹縫。第一畫素電極的邊緣與第二畫素電極的邊緣之間具有最短距離。第二基板位於第一基板的對向，其上包括對應第一畫素電極設置的第一電極圖案以及對應第二畫素電極設置的第二電極圖案。第二電極圖案與第一電極圖案之間具有間隙寬度。連接部則位於第一電極圖案以及第二電極圖案之間以將第一電極圖案以及第二電極圖案連接在一起。
在本發明的一實施例中，第一畫素電極的邊緣與第二畫素電極的邊緣之間的最短距離為水平方向最短距離W1，且第二電極圖案與第一電極圖案之間的間隙寬度為水平方向間隙寬度L1。
在本發明的一實施例中，第一畫素電極的邊緣與第二畫素電極的邊緣之間的水平方向最短距離W1小於或等於第二電極圖案與第一電極圖案之間的水平方向間隙寬度L1。
在本發明的一實施例中，第一畫素電極的邊緣與第二畫素電極的邊緣之間的最短距離為垂直方向最短距離W2，且第二電極圖案與第一電極圖案之間的間隙寬度為垂直方向間隙寬度L2。
在本發明的一實施例中，第一畫素電極的邊緣與第二畫素電極的邊緣之間的垂直方向最短距離W2小於或等於第二電極圖案與第一電極圖案之間的垂直方向間隙寬度L2。
基於上述，在本發明所提出的顯示面板中，第一畫素電極具有第一主狹縫與多個第一分支狹縫，第二畫素電極具有第二主狹縫與多個第二分支狹縫。再者，第一畫素電極的邊緣與第二畫素電極的邊緣之間的水平方向最短距離W1小於或等於第二電極圖案與第一電極圖案之間的水平方向間隙寬度L1；第一畫素電極的邊緣與第二畫素電極的邊緣之間的垂直方向最短距離W2小於或等於第二電極圖案與第一電極圖案之間的垂直方向間隙寬度L2。如此一來，對應次畫素中心的液晶分子具有向外傾倒的趨勢，且對應次畫素邊緣的液晶分子亦具有向外傾倒的趨勢。畫素內液晶分子整體向外傾倒可達到縮減十字暗紋寬度以提高穿透率的效 果。
為讓本發明的上述特徵和優點能更明顯易懂，下文特舉實施例，並配合所附圖式作詳細說明如下。
100‧‧‧顯示面板
102‧‧‧第一基板
104‧‧‧畫素陣列層
110‧‧‧第二基板
112‧‧‧濾光層
114‧‧‧電極層
120‧‧‧顯示介質
130‧‧‧畫素單元
212、222、232、242‧‧‧主狹縫
214、224、234、244‧‧‧分支狹縫
302、304、306、308‧‧‧連接部
312、322、332、342‧‧‧電極圖案
412、422、432、442‧‧‧邊緣狹縫
502‧‧‧液晶分子
C1、C2、C3、C4‧‧‧接觸窗
CH1、CH2、CH3、CH4‧‧‧通道層
D1、D2、D3、D4‧‧‧汲極
DL1、DL2‧‧‧資料線
E‧‧‧電場
G1、G2、G3、G4‧‧‧閘極
P1、P2、P3、P4‧‧‧次畫素
PE1、PE2、PE3、PE4‧‧‧畫素電極
S1、S2、S3、S4‧‧‧源極
SL1、SL2‧‧‧掃描線
T1、T2、T3、T4‧‧‧主動元件
W1‧‧‧水平方向最短距離
W2‧‧‧垂直方向最短距離
L1‧‧‧水平方向間隙寬度
L2‧‧‧垂直方向間隙寬度
圖1是根據本發明一實施例之顯示面板的剖面示意圖。
圖2A是根據本發明一實施例之畫素陣列層的上視示意圖。
圖2B是根據本發明一實施例之電極層的上視示意圖。
圖3是圖2A之畫素陣列層與圖2B之電極層重疊的示意圖。
圖4A是繪示圖3剖面線A-A’施加電場後的剖面示意圖。
圖4B是繪示圖3剖面線B-B’施加電場後的剖面示意圖。
圖5A是根據本發明另一實施例之畫素陣列層的上視示意圖。
圖5B是根據本發明另一實施例之電極層的上視示意圖。
圖6是圖5A之畫素陣列層與圖5B之電極層重疊的示意圖。
圖7A是根據本發明又一實施例之畫素陣列層的上視示意圖。
圖7B是根據本發明又一實施例之電極層的上視示意圖。
圖8是圖7A之畫素陣列層與圖7B之電極層重疊的示意圖。
圖9是根據本發明再一實施例之電極層的上視示意圖。
圖1是根據本發明一實施例之顯示面板的剖面示意圖。 請先參照圖1，本實施例之顯示面板100包括第一基板102、第二基板110以及顯示介質120。
第一基板102之材質可為玻璃、石英、有機聚合物或是金屬等等。第一基板102上包括設置有畫素陣列層104。畫素陣列層104中的詳細組成結構將於後續段落說明。
第二基板110是位於第一基板102的對向。第二基板110之材質可為玻璃、石英或有機聚合物等等。第二基板110上包括設置有電極層114。電極層114為透明導電層，其材質包括金屬氧化物，例如是銦錫氧化物或者是銦鋅氧化物。電極層114之圖案設計將於後續段落作詳細說明。第二基板110上可更包括設置有濾光層112，其包括紅、綠、藍色濾光圖案。
顯示介質120位於第一基板102與第二基板110之間。顯示介質120包括液晶分子。由於本實施例之顯示面板為使用PSA技術之顯示面板，因此在顯示介質120中除了液晶分子之外，還包括單體化合物。換言之，在此顯示面板尚未進行單體化合物之熟化程序時，顯示介質120中包含有液晶分子以及單體化合物。當此顯示面板於進行單體化合物之熟化程序時，單體化合物會進行聚合反應而於畫素陣列層104以及電極層114之表面形成聚合物薄膜。因此當此顯示面板於進行單體化合物之熟化程序之後，此時顯示介質120主要為液晶分子。
圖2A是根據本發明一實施例之畫素陣列層的上視示意圖。圖2B是根據本發明一實施例之電極層的上視示意圖。圖3是 圖2A之畫素陣列層與圖2B之電極層重疊的示意圖。
請參照圖2A，畫素陣列層104包括掃描線SL1、資料線DL1、DL2以及次畫素P1、P2。在本實施例中，掃描線SL1與資料線DL1、DL2彼此不平行設置，且掃描線SL1與資料線DL1、DL2之間夾有絕緣層。換言之，掃描線SL1的延伸方向與資料線DL1、DL2的延伸方向不平行，較佳的是，掃描線SL1的延伸方向與資料線DL1、DL2的延伸方向垂直。基於導電性的考量，掃描線SL1與資料線DL1、DL2一般是使用金屬材料。然，本發明不限於此，根據其他實施例，掃描線SL1與資料線DL1、DL2也可以使用其他導電材料。例如：合金、金屬材料的氮化物、金屬材料的氧化物、金屬材料的氮氧化物、或其它合適的材料)、或是金屬材料與其它導材料的堆疊層。
次畫素P1、P2分別具有主動元件T1、T2以及畫素電極PE1、PE2。主動元件T1是與掃描線SL1以及資料線DL1電性連接，而主動元件T2是與掃描線SL1以及資料線DL2電性連接。在此，主動元件T1與T2例如是薄膜電晶體，其分別包括閘極G1與G2、通道層CH1與CH2、源極S1與S2以及汲極D1與D2。閘極G1、G2與掃描線SL1電性連接。源極S1與資料線DL1電性連接，源極S2與資料線DL2電性連接。通道層CH1、CH2位於閘極G1、G2之上方並且位於源極S1、S2與汲極D1、D2的下方。本實施例之主動元件T1、T2是以底部閘極型薄膜電晶體為例來說明，但本發明不限於此。在其他的實施例中，主動元件T1、 T2也可以是頂部閘極型薄膜電晶體。
畫素電極PE1、PE2分別與主動元件T1、T2電性連接。在本實施例中，畫素電極PE1、PE2是分別與主動元件T1、T2之汲極D1、D2電性連接。更詳細而言，在畫素電極PE1、PE2與主動元件T1、T2之汲極D1、D2兩者重疊之處更分別設置有接觸窗C1、C2，以使畫素電極PE1、PE2與汲極D1、D2電性連接。另外，在圖2A中，畫素電極PE1、PE2與掃描線SL1以及資料線DL1、DL2之間未重疊，但本發明不限於此。亦即，畫素電極PE1、PE2亦可與掃描線SL1以及資料線DL1、DL2重疊設置。
值得注意的是，畫素電極PE1具有主狹縫212以及與主狹縫212連接在一起的多個分支狹縫214。此外，畫素電極PE2亦具有主狹縫222以及與主狹縫222連接在一起的多個分支狹縫224。主狹縫212、222以及分支狹縫214、224為不具有導電材料的空隙區域。如圖2A所示，主狹縫212、222皆為十字形狹縫，而分支狹縫214、224分別自主狹縫212、222往四個方向延伸，且分支狹縫214、224與主狹縫212、222之間的夾角θ1、θ2不等於0度或90度。
請參照圖2B，電極層114包括多個電極圖案312、322。在本實施例中，電極圖案312、322皆為塊狀電極。特別是，電極圖案312是對應畫素電極PE1設置，且電極圖案322是對應畫素電極PE2設置。此外，在本實施例中，電極層114更包括連接部302。如圖2B所示，連接部302位於電極圖案312與電極圖案322 之間以將電極圖案312與電極圖案322連接在一起。
圖3主要是用以說明畫素電極PE1、PE2與電極圖案312、322之間的重疊情形，為了清楚表示，故省略繪示掃描線、資料線、主動元件等元件。請參照圖3，由於電極圖案312、322是分別對應畫素電極PE1、PE2配置，因此，畫素電極PE1、PE2與電極圖案312、322重疊設置。另外，位於電極圖案312、322之間的連接部302未與畫素電極PE1、PE2重疊。在本實施例中，圖2A、圖2B以及圖3所繪示的是圖1之顯示面板100中的一個畫素單元130。一般來說，顯示面板100是由多個畫素單元130重複排列而構成。
更詳細來說，請參照圖2A，畫素電極PE1的邊緣與畫素電極PE2的邊緣之間具有水平方向最短距離W1。具體而言，畫素電極PE1的邊緣與畫素電極PE2的邊緣之間具有相等的水平方向間隙，且所述水平方向等距間隙等於W1。另外，請參照圖2B，電極圖案312與電極圖案322之間具有水平方向間隙寬度L1。更具體而言，電極圖案312與電極圖案322之間具有相等的水平方向間隙，且所述水平方向等距間隙等於L1。值得注意的是，依據本發明之一實施例，畫素電極PE1的邊緣與畫素電極PE2的邊緣之間的水平方向最短距離W1小於或是等於電極圖案312與電極圖案322之間的水平方向間隙寬度L1。
圖4A是繪示圖3剖面線A-A’施加電場後的剖面示意圖。圖4B是繪示圖3剖面線B-B’施加電場後的剖面示意圖。圖4A為 對應次畫素的中央部位(剖面線A-A’)之處。圖4B為(剖面線B-B’)對應電極圖案312與畫素電極PE1的邊緣以及電極圖案322與畫素電極PE2的邊緣之間的位置。
請參照圖4A，位於電極圖案312與畫素電極PE1之間的顯示介質120包括液晶分子502，且當於電極圖案312與畫素電極PE1之間形成電場E時，顯示介質120之液晶分子502具有自次畫素中心向外傾倒的趨勢。由於液晶分子502會從次畫素中心向外傾倒，如此可以降低次畫素之十字暗紋的寬度，以增加顯示面板的穿透度。
此外，請參照圖4B，電極圖案312與電極圖案322之間具有水平方向間隙寬度L1，且畫素電極圖案PE1與畫素電極圖案PE2之間具有水平方向最短距離W1，且水平方向最短距離W1小於水平方向間隙寬度L1。當於電極圖案312與畫素電極PE1之間形成電場E時，液晶分子502往子畫素的邊緣外側傾倒。由於位於字畫素邊緣的液晶分子502也會往子畫素的外側傾倒，因此可以降低字畫素邊緣的暗紋寬度，以增加顯示面板的穿透度。
值得一提的是，上述圖4A以及圖4B之實施例是以水平方向最短距離W1小於水平方向間隙寬度L1為例來說明，但本發明不限於此。根據其他實施例，上述之水平方向最短距離W1亦可以等於水平方向間隙寬度L1。無論電極圖案312與電極圖案322之間具有水平方向間隙寬度L1大於畫素電極圖案PE1與畫素電極圖案PE2之間具有水平方向最短距離W1，或是電極圖案312與電 極圖案322之間具有水平方向間隙寬度L1等於畫素電極圖案PE1與畫素電極圖案PE2之間具有水平方向最短距離W1，都可以達到降低次畫素之十字暗紋寬度以及邊緣暗紋寬度以增加顯示面板穿透度之目的。
圖5A是根據本發明另一實施例之畫素陣列層的上視示意圖。圖5B是根據本發明另一實施例之電極層的上視示意圖。圖6是圖5A之畫素陣列層與圖5B之電極層重疊的示意圖。圖5A、圖5B以及圖6所示之實施例相似於圖2A、圖2B以及圖3所示之實施例，相同元件以相同標號表示且在此不予贅述。圖5A、圖5B以及圖6所示之實施例與圖2A、圖2B以及圖3所示之實施例不同之處在於，畫素單元包括位於畫素陣列層104之掃描線SL1與SL2、資料線DL1、次畫素P1、P3以及位於電極層114之電極圖案312、332以及連接部304。
如圖5A所示，次畫素P3具有主動元件T3以及畫素電極PE3。主動元件T3是與掃描線SL2以及資料線DL1電性連接。在此，主動元件T3例如是薄膜電晶體，其包括閘極G3、通道層CH3、源極S3以及汲極D3。閘極G3與掃描線SL2電性連接。源極S3與資料線DL1電性連接。通道層CH3位於閘極G3之上方並且位於源極S3與汲極D3的下方。本實施例之主動元件T3是以底部閘極型薄膜電晶體為例來說明，但本發明不限於此。在其他的實施例中，主動元件T3也可以是頂部閘極型薄膜電晶體。
請參照圖5A，畫素電極PE3與主動元件T3電性連接。 在本實施例中，畫素電極PE3是與主動元件T3之汲極D3電性連接。更詳細而言，在畫素電極PE3與主動元件T3之汲極D3兩者重疊之處更分別設置有接觸窗C3，以使畫素電極PE3與汲極D3電性連接。另外，在圖5A中，畫素電極PE3與掃描線SL2以及資料線DL1之間未重疊，但本發明不限於此，亦即畫素電極PE3亦可與掃描線SL2以及資料線DL1重疊。畫素電極PE3具有主狹縫232以及與主狹縫232連接在一起的多個分支狹縫234。需說明的是，主狹縫232以及分支狹縫234為不具有導電材料的空隙區域。如圖5A所示，主狹縫232為十字形狹縫，而分支狹縫234自主狹縫232往四個方向延伸，且分支狹縫234與主狹縫232之間的夾角θ3不等於0度或90度。
請參照圖5B，電極層114之電極圖案312、332皆為塊狀電極，其中電極圖案312是對應畫素電極PE1設置，且電極圖案332是對應畫素電極PE3設置。此外，在本實施例中，電極層114更包括連接部304，連接部304位於電極圖案312與電極圖案332之間以將電極圖案312與電極圖案332連接在一起。
圖6主要是用以說明畫素電極PE1、PE3與電極圖案312、332之間的重疊情形，其中為求清楚表示，故省略繪示掃描線SL1與SL2、資料線DL1、主動元件T1與T3以及介於畫素陣列層104與電極層114之間的顯示介質120。請參照圖6，由於電極圖案312、332是分別對應畫素電極PE1、PE3配置，因此畫素電極PE1、PE3與電極圖案312、332重疊。另外，連接部304未 與畫素電極PE1、PE3重疊。在本實施例中，圖5A、圖5B以及圖6所繪示的是圖1之顯示面板100中的一個畫素單元130。一般來說，顯示面板100是由多個畫素單元130重複排列而構成。
更詳細而言，如圖5A所示，畫素電極PE1的邊緣與畫素電極PE3的邊緣之間具有垂直方向最短距離W2。具體而言，畫素電極PE1的邊緣與畫素電極PE3的邊緣之間具有相等的垂直方向間隙，且所述垂直方向等距間隙等於W2。另外，如圖5B所示，電極圖案312與電極圖案332之間具有垂直方向間隙寬度L2。更具體而言，電極圖案312與電極圖案332之間具有相等的垂直方向間隙，且所述垂直方向等距間隙等於L2。值得注意的是，依據本發明之一實施例，畫素電極PE1的邊緣與畫素電極PE3的邊緣之間的垂直方向最短距離W2小於或是等於電極圖案312與電極圖案332之間的垂直方向間隙寬度L2。
圖7A是根據本發明另一實施例之畫素陣列層的上視示意圖。圖7B是根據本發明另一實施例之電極層的上視示意圖。圖8是圖7A之畫素陣列層與圖7B之電極層重疊的示意圖。圖7A、圖7B以及圖8所示之實施例相似於圖2A、圖2B以及圖3所示之實施例，相同元件以相同標號表示且在此不予贅述。圖7A、圖7B以及圖8所示之實施例與圖2A、圖2B以及圖3所示之實施例不同之處在於，畫素單元包括位於畫素陣列層104之掃描線SL1與SL2、資料線DL1與DL2、次畫素P1、P2、P3、P4以及位於電極層114之電極圖案312、322、332、342以及連接部302、304、306、 308。
請參照圖7A，次畫素P4具有主動元件T4以及畫素電極PE4。主動元件T4是與掃描線SL2以及資料線DL2電性連接。在此，主動元件T4例如是薄膜電晶體，其包括閘極G4、通道層CH4、源極S4以及汲極D4。閘極G4與掃描線SL2電性連接。源極S4與資料線DL2電性連接。通道層CH4位於閘極G4之上方並且位於源極S4與汲極D4的下方。本實施例之主動元件T4是以底部閘極型薄膜電晶體為例來說明，但本發明不限於此。在其他的實施例中，主動元件T4也可以是頂部閘極型薄膜電晶體。
請參照圖7A，畫素電極PE4與主動元件T4電性連接。在本實施例中，畫素電極PE4是與主動元件T4之汲極D4電性連接。更詳細而言，在畫素電極PE4與主動元件T4之汲極D4兩者重疊之處更分別設置有接觸窗C4，以使畫素電極PE4與汲極D4電性連接。另外，畫素電極PE4與掃描線SL2以及資料線DL2之間未重疊，但本發明不限於此，亦即畫素電極PE4亦可與掃描線SL2以及資料線DL2重疊。此外，畫素電極PE4具有主狹縫242以及與主狹縫242連接在一起的多個分支狹縫244。需說明的是，主狹縫242以及分支狹縫244為不具有導電材料的空隙區域。如圖7A所示，主狹縫242為十字形狹縫，而分支狹縫244自主狹縫242往四個方向延伸，且分支狹縫244與主狹縫242之間的夾角θ4不等於0度或90度。
請參照圖7B，電極層114之電極圖案312、322、332與 342皆為塊狀電極。電極圖案312是對應畫素電極PE1設置，電極圖案322是對應畫素電極PE2設置，電極圖案332是對應畫素電極PE3設置，電極圖案342是對應畫素電極PE4設置。此外，在本實施例中，除了連接部302、304之外，電極層114更包括連接部306、308。如圖5B所示，連接部306位於電極圖案332與電極圖案342之間以將電極圖案332與電極圖案342連接在一起，連接部308位於電極圖案322與電極圖案342之間以將電極圖案322與電極圖案342連接在一起。
圖8是圖7A之畫素陣列層與圖7B之電極層重疊的示意圖。圖8主要是用以說明畫素電極PE1、PE2、PE3、PE4與電極圖案312、322、332、342之間的重疊情形，其中為求清楚表示，故省略繪示掃描線SL1與SL2、資料線DL1與DL2、主動元件T1、T2、T3、T4以及介於畫素陣列層104與電極層114之間的顯示介質120。請參照圖8，由於電極圖案312、322、332、342是分別對應畫素電極PE1、PE2、PE3、PE4配置，因此，畫素電極PE1、PE2、PE3、PE4與部分電極圖案312、322、332、342重疊。另外，連接部302、304、306、308未與畫素電極PE1、PE2、PE3、PE4重疊。在本實施例中，圖7A、圖7B以及圖8所繪示的是圖1之顯示面板100中的一個畫素單元130。一般來說，顯示面板100是由多個畫素單元130重複排列而構成。
更詳細而言，請參照圖7A，畫素電極PE1的邊緣與畫素電極PE2的邊緣之間具有水平方向最短距離W1。畫素電極PE1 的邊緣與畫素電極PE3的邊緣之間具有垂直方向最短距離W2。請參照圖7B，電極圖案312與電極圖案322之間具有水平方向間隙寬度L1。電極圖案312與電極圖案332之間具有垂直方向間隙寬度L2。上述之水平方向最短距離W1小於或是等於上述之水平方向間隙寬度L1，垂直方向最短距離W2小於或是等於上述之垂直方向間隙寬度L2。
在上述的各實施例中，電極層114之電極圖案的邊緣皆為直線輪廓，但本發明不限於此。根據其他實施例，電極層114之各電極圖案的邊緣也可以包含邊緣狹縫，如下說明。
請參照圖9，圖9之電極層與上述圖7B之電極層不同之處在於，電極圖案312的邊緣具有多個邊緣狹縫412，電極圖案322的邊緣具有多個邊緣狹縫422，電極圖案332的邊緣具有多個邊緣狹縫432，且電極圖案342的邊緣具有多個邊緣狹縫442。在本實施例中，邊緣狹縫412、422、432、442的延伸方向分別與畫素電極中的分支狹縫(如圖7A所示分支狹縫214、224、234、244)的延伸方向平行。亦即，邊緣狹縫412的延伸方向與分支狹縫214的延伸方向平行，邊緣狹縫422的延伸方向與分支狹縫224的延伸方向平行，邊緣狹縫432的延伸方向與分支狹縫234的延伸方向平行，邊緣狹縫442的延伸方向與分支狹縫244的延伸方向平行。
實驗例
表1列出不同顯示面板的穿透率與其穿透率之增加率，其中比較例的顯示面板中的畫素單元為傳統聚合物穩定配向技術之畫素單元。實例1至實例2之顯示面板中的畫素單元如圖7A、圖7B以及圖8所示在實例1的顯示面板之畫素單元中，水平方向最短距離W1小於水平方向間隙寬度L1。在實例2的顯示面板之畫素單元中，最短距離W1等於間隙寬度L1。實例3之顯示面板中的畫素單元如圖7A以及圖9所示，亦即電極圖案為邊緣具有多個邊緣狹縫的塊狀電極，且最短距離W1等於間隙寬度L1。必須說明的是，在實例1、實例2與實例3中，水平方向最短距離W1等於垂直方向最短距離W2，且水平方向間隙寬度L1等於垂直方向間隙寬度L2，但本發明並不以此為限。
從上方表1可得知，比較例之顯示面板的穿透率為26.08%。相較之下，實例1的顯示面板的穿透率為28.99%，穿透率增加了11.16%。實例2的顯示面板之穿透率為30.27%，穿透率 增加了16.07%。實例3的顯示面板之穿透率為31.09%，穿透率增加了19.21%。此外，當水平方向最短距離W1等於水平方向間隙寬度L1時，穿透率比水平方向最短距離W1小於水平方向間隙寬度L1時更高。再者，當電極圖案為邊緣具有多個邊緣狹縫的塊狀電極，則能夠更進一步改善顯示面板的穿透率。
基於上述，在本發明所提出的顯示面板中，第一畫素電極具有第一主狹縫與多個第一分支狹縫，第二畫素電極具有第二主狹縫與多個第二分支狹縫。再者，第一畫素電極的邊緣與第二畫素電極的邊緣之間的水平方向最短距離W1小於或等於第二電極圖案與第一電極圖案之間的水平方向間隙寬度L1；第一畫素電極的邊緣與第二畫素電極的邊緣之間的垂直方向最短距離W2小於或等於第二電極圖案與第一電極圖案之間的垂直方向間隙寬度L2。如此一來，對應次畫素中心的液晶分子具有向外傾倒的趨勢，且對應次畫素邊緣的液晶分子亦具有向外傾倒的趨勢，因此，畫素內液晶分子整體向外傾倒可達到縮減十字暗紋寬度以提高顯示面板之穿透率。
雖然本發明已以實施例揭露如上，然其並非用以限定本發明，任何所屬技術領域中具有通常知識者，在不脫離本發明的精神和範圍內，當可作些許的更動與潤飾，故本發明的保護範圍當視後附的申請專利範圍所界定者為準。
PE1、PE2、PE3、PE4‧‧‧畫素電極
130‧‧‧畫素單元
212、222、232、242‧‧‧主狹縫
214、224、234、244‧‧‧分支狹縫
302、304、306、308‧‧‧連接部
312、322、332、342‧‧‧電極圖案

Claims (17)

  1. 一種顯示面板，包括多個畫素單元，每一畫素單元包括：一第一基板，該第一基板包括：一第一次畫素，包括一第一主動元件以及與該第一主動元件電性連接的一第一畫素電極，其中該第一畫素電極具有一第一主狹縫以及與該第一主狹縫連接在一起的多個第一分支狹縫；一第二次畫素，鄰接該第一次畫素設置，該第二次畫素包括一第二主動元件以及與該第二主動元件電性連接的一第二畫素電極，其中該第二畫素電極具有一第二主狹縫以及與該第二主狹縫連接在一起的多個第二分支狹縫，且該第一畫素電極的邊緣與該第二畫素電極的邊緣之間具有一最短距離；一第二基板，位於該第一基板的對向，該第二基板上包括：一第一電極圖案，對應該第一畫素電極設置，其中該第一電極圖案為一第一塊狀電極，且該第一塊狀電極的邊緣具有多個邊緣狹縫；一第二電極圖案，對應該第二畫素電極設置，其中該第二電極圖案為一第二塊狀電極，且該第二塊狀電極的邊緣具有多個邊緣狹縫，且該第二電極圖案與該第一電極圖案之間具有一間隙寬度；一連接部，位於該第一電極圖案以及該第二電極圖案之間以將該第一電極圖案以及該第二電極圖案連接在一起；以及一顯示介質，位於該第一基板與該第二基板之間。
  2. 如申請專利範圍第1項所述的顯示面板，其中該第一畫素電極的邊緣與該第二畫素電極的邊緣之間的該最短距離為一水平方向最短距離W1，且該第二電極圖案與該第一電極圖案之間的該間隙寬度為一水平方向間隙寬度L1。
  3. 如申請專利範圍第2項所述的顯示面板，其中該第一畫素電極的邊緣與該第二畫素電極的邊緣之間的該水平方向最短距離W1小於該第二電極圖案與該第一電極圖案之間的該水平方向間隙寬度L1。
  4. 如申請專利範圍第2項所述的顯示面板，其中該第一畫素電極的邊緣與該第二畫素電極的邊緣之間的該水平方向最短距離W1等於該第二電極圖案與該第一電極圖案之間的該水平方向間隙寬度L1。
  5. 如申請專利範圍第1項所述的顯示面板，其中該第一畫素電極的邊緣與該第二畫素電極的邊緣之間的該最短距離為一垂直方向最短距離W2，且該第二電極圖案與該第一電極圖案之間的該間隙寬度為一垂直方向間隙寬度L2。
  6. 如申請專利範圍第5項所述的顯示面板，其中該第一畫素電極的邊緣與該第二畫素電極的邊緣之間的該垂直方向最短距離W2小於該第二電極圖案與該第一電極圖案之間的該垂直方向間隙寬度L2。
  7. 如申請專利範圍第5項所述的顯示面板，其中該第一畫素 電極的邊緣與該第二畫素電極的邊緣之間的該垂直方向最短距離W2等於該第二電極圖案與該第一電極圖案之間的該垂直方向間隙寬度L2。
  8. 如申請專利範圍第1項所述的顯示面板，其中該第一畫素電極之該第一主狹縫為一十字形狹縫，且該第一畫素電極之該些第一分支狹縫自該第一主狹縫往四個方向延伸。
  9. 如申請專利範圍第8項所述的顯示面板，其中該些第一分支狹縫與該第一主狹縫之間的夾角不等於0度或90度。
  10. 如申請專利範圍第1項所述的顯示面板，其中該些邊緣狹縫的延伸方向與該些第一分支狹縫的延伸方向平行。
  11. 如申請專利範圍第1項所述的顯示面板，其中該第二畫素電極之該第二主狹縫為一十字形狹縫，且該第二畫素電極之該些第二分支狹縫自該第二主狹縫往四個方向延伸。
  12. 如申請專利範圍第11項所述的顯示面板，其中該些第二分支狹縫與該第二主狹縫之間的夾角不等於0度或90度。
  13. 如申請專利範圍第1項所述的顯示面板，其中該些邊緣狹縫的延伸方向與該些第二分支狹縫的延伸方向平行。
  14. 如申請專利範圍第1項所述的顯示面板，其中該第一畫素電極的邊緣與該第二畫素電極的邊緣之間具有一水平方向等距間隙，且該水平方向等距間隙等於W1。
  15. 如申請專利範圍第1項所述的顯示面板，其中該第一畫 素電極的邊緣與該第二畫素電極的邊緣之間具有一垂直方向等距間隙，且該垂直方向等距間隙等於W2。
  16. 如申請專利範圍第1項所述的顯示面板，其中該第二電極圖案與該第一電極圖案之間有一水平方向等距間隙，且該水平方向等距間隙等於L1。
  17. 如申請專利範圍第1項所述的顯示面板，其中該第二電極圖案與該第一電極圖案之間有一垂直方向等距間隙，且該垂直方向等距間隙等於L2。
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