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TWI382391B - 改善液晶顯示器線性殘影之方法 - Google Patents

改善液晶顯示器線性殘影之方法 Download PDF

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TWI382391B
TWI382391B TW097106791A TW97106791A TWI382391B TW I382391 B TWI382391 B TW I382391B TW 097106791 A TW097106791 A TW 097106791A TW 97106791 A TW97106791 A TW 97106791A TW I382391 B TWI382391 B TW I382391B
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Pei Chun Liao
Ting Jui Chang
Pin Miao Liu
Chien Huang Liao
Yu Chieh Chen
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Au Optronics Corp
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Description

改善液晶顯示器線性殘影之方法
本發明係有關一種改善液晶顯示器線性殘影的方法，更明確地說，係有關一種利用殘餘電壓來改善液晶顯示器線性殘影的方法。
請參考第1圖。第1圖係為習知液晶顯示器之橫剖面圖。液晶顯示器100係由兩片玻璃基板(上板UL和下板LL)所構成，兩片玻璃基板中間再注入液晶層LCL。液晶層中包含了液晶分子LC。玻璃基板LL上包含複數條資料線(未圖示)與複數條掃描線(未圖示)，以及複數個由掃描線與資料線交錯而形成的像素區(未圖示)。然而由於實際情況中非為理想，故在液晶層LCL中，除了液晶分子LC之外，還摻雜雜質分子P。雜質分子P如圖所示，可為正電性或負電性。
請參考第2圖。第2圖係為習知液晶顯示器於顯示畫面時之示意圖。如圖所示，當要顯示畫面時，玻璃基板UL與LL之間會加上一個電壓差使得液晶分子LC轉向。也就是說，在玻璃基板UL與LL之間會產生一個電場E。在液晶分子LC轉向的同時，雜質分子P也會因為本身之電性，隨著電場的方向移動。
請參考第3圖。第3圖係為習知液晶顯示器於顯示畫面一段時間後之示意圖。如圖所示，當顯示畫面一段時間後，玻璃基板UL與LL之間所加上的電場E會使得雜質分子P的移動更徹底。使得帶有正電的雜質分子P皆聚於一側，而帶有負電的雜質分子P皆聚於另外一側。這樣的情況，由於雜質分子P移動速度較慢，因此在電場E消失後，雜質分子P並不會馬上變回原本常態分布的狀況；這樣一來，雜質分子P便會在液晶層LCL中產生另外一個電場，而使得原本應該回到預定位置的液晶分子LC受到影響，造成無法回到原本預定位置。也就是說，若原本預設的電場為E1 ，雜質分子P聚集而產生的電場為E2 ，在理想狀態下，液晶分子LC所感受到的電場應為E1 ，而能夠根據電場E1 轉動到預定的位置，但是由於雜質分子P產生的電場E2 的作用，液晶分子LC實際上所感受到的電場變成(E1 ＋E2 )，因此液晶分子LC便無法順利轉動到預定的位置，因此產生了影像殘留的現象。
請參考第4圖。第4圖係為習知液晶顯示器於顯示畫面一段時間後之示意圖。雜質分子P所移動之方向，除了電場E的影響外，也會受到液晶分子LC轉向的影響。如第4圖所示，由於液晶分子LC受到電場E而略為傾斜，因此會造成雜質分子P除了在垂直方向上的移動外，也有水平方向的橫移。持續移動的結果將會造成雜質分子P堵塞(trap)於液晶顯示器100中的某些像素之間(堵塞的方式與畫面顯示的圖案有關)，造成堆積較多雜質分子P的像素所受到雜質分子P的影響較大，而堆積較少雜質分子P的像素所受到雜質分子P的影響較小。這樣一來，堆積較多雜質分子P的像素與堆積較少雜質分子P的像素的液晶分子LC的感受的電場將會有明顯不同，而造成顯示畫面時會有不均勻的情況，這就是所謂的線狀的影像殘留(image sticking of line shape type)。
本發明提供一種改善液晶顯示器線性殘影之方法。該液晶顯示器包含複數個像素。每個該像素皆包含一第一子像素與一第二子像素。該方法包含以一第一最佳共同電壓，驅動該複數個像素之該第一子像素；以一第二最佳共同電壓，驅動該複數個像素之該第二子像素；以及以一面板電壓，驅動該液晶顯示器，其中該面板電壓介於該第一最佳共同電壓與該第二最佳共同電壓之間。
因此，本發明提出一種使液晶顯示器上殘留電壓的方法，而產生垂直方向的電場，使得雜質分子P在水平方向上的移動速度降低，而減低線性殘影的情況產生。
請參考第5圖。第5圖係為本發明於液晶顯示器上外加殘餘偏壓以降低線性殘留之示意圖。如圖所示，本發明在上板UL與下板LL之間外加一偏壓VR 。因此，液晶層LCL中的雜質分子P將會被偏壓VR 所產生的電場所吸引而往垂直方向移動，如此便可降低由於雜質分子P水平方向移動後堆積所產生的線性殘留現象。
請參考第6圖。第6圖係為本發明於一像素上外加殘餘偏壓以降低線性殘留之示意圖。如圖所示，一像素PX可分為二子像素SPX1 與SPX2 ，而且分別在子像素SPX1 上加上電壓VR ，在子像素SPX2上加上電壓(－VR )。如此一來帶有正電性的雜質分子P在子像素SPX1 中將會往上移動；帶有正電性的雜質分子P在子像素SPX2 中將會往下移動，而能降低水平方向移動的速度。由於子像素SPX1 所加之偏壓為電壓VR 、子像素SPX2 所加之偏壓為電壓(－VR )，因此對於整體的像素PX來說，像素PX平均所接收的偏壓為0，亦即上下板間不會有電壓殘留。更明確地說，若一像素僅為單一像素，則所加諸的電壓VR 或(－VR )將會讓液晶顯示器在持續顯示正負畫面後造成壓差不均，而產生畫面閃爍的現象。將一像素分成兩個子像素SPX1 與SPX2 時，雖然於此實施例中，子像素SPX1 會造成較亮的閃爍、子像素SPX2 會造成較暗的閃爍，但只要將面板電壓適切地設置於電壓VR 與(－VR )之間，則子像素SPX1 與SPX2 亮暗閃爍順序交錯且程度相同，等效上就不會產生閃爍的現象。同時，子像素SPX1 與SPX2 仍能保有殘留電壓VR 與(－VR )，因此會增加雜質分子P垂直游離能力而相對減輕雜質分子P水平方向游移，如此一來便能有效減輕可以以解決線狀影像殘留的問題。
請參考第7圖。第7圖係為根據第6圖所示之方式驅動子像素SPX1 與SPX2 之示意圖。電壓VSPX1 係為驅動子像素SPX1 之電壓；電壓VSPX2 係為驅動子像素SPX2 之電壓。由圖可看出，電壓VSPX1 和VSPX2 係皆根據液晶的特性而需要有正負反轉交替的現象。然而電壓VSPX1 的電壓平均值為最佳共同電壓VOP_COM1 ，此與面板電壓VP 之差異為電壓(－VR )；電壓VSPX2 的電壓平均值為最佳共同電壓VOP_COM2 ，此與面板電壓VP 之差異為電壓VR 。於此實施例中，設定面板電壓VP 為最佳共同電壓VOP_COM1 以及VOP_COM2 之間的值。舉例來說，最佳共同電壓VOP_COM1 與VOP_COM2 二者之平均等於面板電壓VP 。
請參考第8圖。第8圖係為本發明利用殘餘電壓之第一實施例之電路之示意圖。子像素SPX1 包含對應的上板UL、液晶層LCL及下板LL。子像素SPX1 對應之上板UL接到一上板偏壓端，其上並載有電壓VUL ；子像素SPX1 對應之液晶層LCL中之液晶分子LC1 有一等效電容CLC1 ；子像素SPX1 對應之下板LL包含一開關SW1 與一儲存電容CST1 ；開關SW1 用來根據其控制端上的電壓VG 將灰階電壓VD 傳送至液晶層以提供液晶分子LC1 驅動電壓。另外，開關SW1 包含有一寄生電容CGS1 。儲存電容CST1 一端接於下板偏壓端，其上並載有電壓VLL ，另一端耦接於開關SW1 之一端用以儲存導通的電壓VD1 ’。電壓VD1 ’係用來驅動液晶分子LC1 轉動。電壓VD1 ’由於有饋通電壓VFT1 ，因此與灰階電壓VD 有些許差異(VD1 ’＝VD －VFT1 )，而且饋通電壓VFT1 正比於CGS1 /(CST1 ＋CLC1 )之比值。子像素SPX2 包含對應的上板UL、液晶層LCL及下板LL。子像素SPX2 對應之上板UL接到一上板偏壓端，其上並載有電壓VUL ；子像素SPX2 對應之液晶層LCL中之液晶分子LC2 有一等效電容CLC2 ；子像素SPX2 對應之下板LL包含一開關SW2 與一儲存電容CST2 ；開關SW2 用來根據其控制端上的電壓VG 將灰階電壓VD 傳送至液晶層以提供液晶分子LC2 驅動電壓。另外，開關SW2 包含有一寄生電容CGS2 。儲存電容CST2 一端接於下板偏壓端，其上並載有電壓VLL ，另一端耦接於開關SW2 之一端用以儲存導通的電壓VD2 ’，其中電壓VD2 ’係用來驅動液晶分子LC2 轉動。電壓VD2 ’由於有饋通電壓VFT2 ，因此與灰階電壓VD 有些許差異(V’D2 ＝VD －VFT2 )。饋通電壓VFT2 正比於CGS2 /(CST2 ＋CLC2 )之比值。因此，便可調整饋通電壓VFT1 與VFT2 的大小，使得最後驅動液晶分子LC1 與LC2 的電壓VD1 ’與VD2 ’不同，而達到第7圖具有殘留電壓之效果。調整饋通電壓VFT 的方法係以調整儲存電容CST 較為容易，因此可在子像素SPX1 與SPX2 分別設置不同容值的儲存電容CST1 與CST2 而使得饋通電壓VFT1 與VFT2 不同，進而使得電壓VD1 ’與VD2 ’不同。液晶分子LC1 之等效電容CLC1 之跨壓VSPX1 係為電壓(VD1 ’－VUL )；於此時將電壓VUL 設為0，因此電壓VSPX1 便為VD1 ’。液晶分子LC2 之等效電容CLC2 之跨壓VSPX2 係為電壓(VD2 ’－VUL )；於此時將電壓VUL 設為0，因此電壓VSPX2 便為VD2 ’。另外，於此圖式中，上板共同電壓VUL 與下板共同電壓VLL 皆與面板電壓VP 相同。
請參考第9圖。第9圖係根據第8圖之實施例之時序示意圖。如圖所示，灰階電壓VD 同時驅動子像素SPX1 與SPX2 。由於子像素SPX1 與SPX2 有個別不同之饋通電壓VFT1 與VFT2 ，因此子像素SPX1 之液晶分子LC1 最後所接收到的電壓將會如圖所示之電壓VSPX1 ，子像素SPX2 之液晶分子LC2 最後所接收到的電壓則會如圖所示之電壓VSPX2 。電壓VSPX1 平均值會等於最佳共同電壓VOP_COM1 ，其較面板電壓VP (設為0伏特)低電壓VR ；而電壓VSPX2 平均值會等於最佳共同電壓VOP_COM2 ，其較面板電壓VP 高電壓VR 。如前所述，這樣一來，子像素SPX2 會造成較亮的閃爍、子像素SPX1 會造成較暗的閃爍，但只要將面板VP 電壓適切地設置於最佳共同電壓VOP_COM1 與VOP_COM2 之間(意即電壓VR 與(－VR )之間)，則子像素SPX1 與SPX2 亮暗閃爍順序交錯且程度相同(於此實施例中，面板電壓VP 設為電壓VR 與(－VR )的平均值0)，等效上就不會產生閃爍的現象，而子像素SPX1 與SPX2 仍能保有殘留電壓VR 與(－VR )，因此會增加雜質分子P垂直游離能力而相對減輕雜質分子P水平方向游移，如此一來便能有效減輕可以以解決線狀影像殘留的問題。
請參考第10圖。第10圖係為本發明利用殘餘電壓之第二實施例之電路之示意圖。子像素SPX1 包含對應的上板UL、液晶層LCL及下板LL。子像素SPX1 對應之上板UL接到一偏壓端，其上並載有電壓VUL1 (上板共同電壓)；子像素SPX1 對應之液晶層LCL中之液晶分子LC1 有一等效電容CLC1 ；子像素SPX1 對應之下板LL包含一開關SW1 與一儲存電容CST ；開關SW1 用來根據其控制端上的電壓VG 將灰階電壓VD 傳送至液晶層以提供液晶分子LC1 驅動電壓。另外，開關SW1 包含有一寄生電容CGS 。儲存電容CST 一端接於下板偏壓端，其上並載有下板共同電壓VLL ，另一端耦接於開關SW1 之一端用以儲存導通的電壓VD ’。電壓VD ’係用來驅動液晶分子LC1 轉動。電壓VD ’由於有饋通電壓VFT ，因此與灰階電壓VD 有些許差異(VD ’＝VD －VFT )。子像素SPX2 包含對應的上板UL、液晶層LCL及下板LL。子像素SPX2 對應之上板UL接到一偏壓端，其上並載有電壓VUL2 (上板共同電壓)；子像素SPX2 對應之液晶層LCL中之液晶分子LC2 有一等效電容CLC2 ；子像素SPX2 對應之下板LL包含一開關SW2 與一儲存電容CST ；開關SW2 用來根據其控制端上的電壓VG 將灰階電壓VD 傳送至液晶層以提供液晶分子LC2 驅動電壓。另外，開關SW2 包含有一寄生電容CGS 。儲存電容CST 一端接於下板偏壓端，其上並載有下板共同電壓VLL ，另一端耦接於開關SW2 之一端用以儲存導通的電壓VD ’。電壓VD ’係用來驅動液晶分子LC2 轉動。電壓VD ’由於有饋通電壓VFT ，因此與灰階電壓VD 有些許差異(VD ’＝VD －VFT )。液晶分子LC1 之等效電容CLC1 之跨壓VSPX1 係為電壓(VD ’－VUL1 )；而液晶分子LC2 之等效電容CLC2 之跨壓VSPX2 係為電壓(VD ’－VUL2 )。因此，便可改變電壓VUL1 與VUL2 的大小，使得最後驅動液晶分子LC1 與LC2 的電壓VSPX1 與VSPX2 不同，達到第7圖具有殘留電壓之效果。
請參考第11圖。第11圖係根據第10圖之實施例之時序示意圖。如圖所示，灰階電壓VD 同時驅動子像素SPX1 與SPX2 。由於子像素SPX1 與SPX2 有個別不同之上板電壓VUL1 與VUL2 ，因此子像素SPX1 之液晶分子LC1 最後所接收到的電壓將會如圖所示之電壓VSPX1 ，子像素SPX2 之液晶分子LC2 最後所接收到的電壓則會如圖所示之電壓VSPX2 。舉例來說，設電壓VD ’為2伏特，上板電壓VUL1 為1伏特，子像素電壓VSPX1 便為1伏特(VD ’－VUL1 ＝2－1＝1)；上板電壓為(－1)伏特，子像素電壓VSPX2 便為3伏特(VD ’－VUL2 ＝2－(－1)＝3)...依此類推。電壓VSPX1 的平均值會等於一最佳共同電壓VOP_COM1 (如圖所示－1伏特)，其較面板電壓VP 低電壓VR ；而電壓VSPX2 的平均值會等於一最佳共同電壓VOP_COM2 (如圖所示1伏特)，其較面板電壓VP (設為0伏特)高電壓VR (1伏特)。如前所述，這樣一來，子像素SPX2 會造成較亮的閃爍、子像素SPX1 會造成較暗的閃爍，但只要將面板VP 電壓適切地設置於最佳共同電壓VOP_COM1 與VOP_COM2 之間(意即電壓VR 與(－VR )之間)，則子像素SPX1 與SPX2 亮暗閃爍順序交錯且程度相同(於此實施例中，面板電壓VP 設為電壓VR 與(－VR )的平均值0)，等效上就不會產生閃爍的現象，而子像素SPX1 與SPX2 仍能保有殘留電壓VR 與(－VR )，因此會增加雜質分子P垂直游離能力而相對減輕雜質分子P水平方向游移，如此一來便能有效減輕可以以解決線狀影像殘留的問題。
請參考第12圖。第12圖係為本發明利用殘餘電壓之第三實施例之電路之示意圖。子像素SPX1 包含對應的上板UL、液晶層LCL及下板LL。子像素SPX1 對應之上板UL接到一偏壓端，其上並載有電壓VUL (上板電壓)；子像素SPX1 對應之液晶層LCL中之液晶分子LC1 有一等效電容CLC1 ；子像素SPX1 對應之下板LL包含一開關SW1 與一儲存電容CST ；開關SW1 用來根據其控制端上的電壓VG 將灰階電壓VD1 傳送至液晶層以提供液晶分子LC1 驅動電壓。另外，開關SW1 包含有一寄生電容CGS 。儲存電容CST 一端接於下板偏壓端，其上並載有電壓VLL ，另一端耦接於開關SW1 之一端用以儲存導通的電壓VD1 ’。電壓VD1 ’係用來驅動液晶分子LC1 轉動。電壓VD1 ’由於有饋通電壓VFT ，因此與灰階電壓VD1 有些許差異(VD1 ’＝VD1 －VFT )。子像素SPX2 包含對應的上板UL、液晶層LCL及下板LL。子像素SPX2 對應之上板UL接到一偏壓端，其上並載有電壓VUL (上板電壓)；子像素SPX2 對應之液晶層LCL中之液晶分子LC2 有一等效電容CLC2 ；子像素SPX2 對應之下板LL包含一開關SW2 與一儲存電容CST ；開關SW2 用來根據其控制端上的電壓VG 將灰階電壓VD2 傳送至液晶層以提供液晶分子LC2 驅動電壓。另外，開關SW2 包含有一寄生電容CGS 。儲存電容CST 一端接於下板偏壓端，其上並載有電壓VLL ，另一端耦接於開關SW2 之一端用以儲存導通的電壓VD2 ’。電壓VD2 ’係用來驅動液晶分子LC2 轉動。電壓VD2 ’由於有饋通電壓VFT ，因此與灰階電壓VD 有些許差異(VD2 ’＝VD2 －VFT )。液晶分子LC1 之等效電容CLC1 之跨壓VSPX1 係為電壓(VDl ’－VUL )；而液晶分子LC2 之等效電容CLC2 之跨壓VSPX2 係為電壓(VD2 ’－VUL )。因此，便可改變灰階電壓VD1 與VD2 的大小，使得最後驅動液晶分子LC1 與LC2 的電壓VSPX1 與VSPX2 不同，而達到第7圖具有殘留電壓之效果。
請參考第13圖。第13圖係為一先前技術將灰階資料轉換成灰階電壓之示意圖。如圖所示，灰階資料GL(舉例來說，係為第32個灰階，亦即GL(32) )，經由時序控制器1310，根據一灰階/灰階轉換特性，轉換成正灰階GL(32＋) 與負灰階GL(32－) ，再經由枷瑪(gamma)電路1320，根據一灰階/電壓轉換特性(枷瑪曲線，gamma)轉換成灰階電壓VG1(32＋) 與VG1(32－) ，以作為最後傳送至像素之灰階電壓VD ；其中枷瑪電路1320之灰階/電壓轉換特性(gamma曲線)可為如枷瑪1.8(gamma 1.8)、枷瑪2.2(gamma 2.2)...等。
請參考第14圖。第14圖係為根據本發明之第三實施例之電路示意圖。與第13圖不同的是，第14圖中具有兩個枷瑪電路1421與1422，其中枷瑪電路1421與1422分別具有不同之枷瑪曲線。因此，當一灰階GL(例如第32個灰階，亦即GL(32) )經由時序控制器1410，根據一灰階/灰階轉換特性，轉換成正灰階GL(32＋) 與負灰階GL(32－) ，再分別經由枷瑪電路1421與1422，轉換成灰階電壓VG1(32＋) 與VG1(32－) 、灰階電壓VG2(32＋) 與VG2(32－) 作為最後傳送至子像素SPX1 與SPX2 之灰階電壓VD1 、VD2 。經由枷瑪電路1421轉換出來的灰階電壓VG1(32＋) 與VG1(32－) 之平均值將符合最佳共同電壓VOP_COM1 (設為－VR )、而經由枷瑪電路1422轉換出來的灰階電壓VG2(32＋) 與VG2(32－) 之平均值將符合最佳共同電壓VOP_COM1 (設為VR )。如前所述，這樣一來，子像素SPX2 會造成較亮的閃爍、子像素SPX1 會造成較暗的閃爍，但只要將面板VP 電壓適切地設置於最佳共同電壓VOP_COM1 與VOP_COM2 之間(意即電壓VR 與(－VR )之間)，則子像素SPX1 與SPX2 亮暗閃爍順序交錯且程度相同(於此實施例中，面板電壓VP 設為電壓VR 與(－VR )的平均值0)，等效上就不會產生閃爍的現象，而子像素SPX1 與SPX2 仍能保有殘留電壓VR 與(－VR )，因此會增加雜質分子P垂直游離能力而相對減輕雜質分子P水平方向游移，如此一來便能有效減輕可以以解決線狀影像殘留的問題。
請參考第15圖。第15圖係為根據本發明之第三實施例之電路示意圖。與第13圖不同的是，第15圖中具有兩個時序控制器1511、1512及對應的枷瑪電路1521、1522，其中枷瑪電路1421與1422係具有相同之枷瑪曲線。因此，當一灰階GL(例如第32個灰階，亦即GL(32) )分別經由時序控制器1511、1512，根據一第一灰階/灰階轉換特性與一第二灰階/灰階轉換特性，轉換成正灰階GL(60＋) 與負灰階GL(16－) 、正灰階GL(16＋) 與負灰階GL(60－) ，再分別經由枷瑪電路1521與1522，轉換成灰階電壓VG1(60＋) 與VG1(16－) 、灰階電壓VG1(16＋) 與VG1(60－) 作為最後傳送至子像素SPX1 與SPX2 之灰階電壓VD1 、VD2 ；其中該第一灰階/灰階轉換特性與該第二灰階/灰階轉換特性相異。經由時序控制器與枷瑪轉換電路轉換出的灰階電壓VG1(60＋) 與VG1(16－) 之平均值將符合最佳共同電壓VOP_COM1 (設為－VR )，經由時序控制器與枷瑪轉換電路轉換出的灰階電壓VG1(16＋) 與VG1(60－) 之平均值則符合最佳共同電壓VOP_COM2 (設為VR )。如前所述，這樣一來，子像素SPX2 會造成較亮的閃爍、子像素SPX1 會造成較暗的閃爍，但只要將面板VP 電壓適切地設置於最佳共同電壓VOP_COM1 與VOP_COM2 之間(意即電壓VR 與(－VR )之間)，則子像素SPX1 與SPX2 亮暗閃爍順序交錯且程度相同(於此實施例中，面板電壓VP 設為電壓VR 與(－VR )的平均值0)，等效上就不會產生閃爍的現象，而子像素SPX1 與SPX2 仍能保有殘留電壓VR 與(－VR )，因此會增加雜質分子P垂直游離能力而相對減輕雜質分子P水平方向游移，如此一來便能有效減輕可以以解決線狀影像殘留的問題。
請參考第16圖。第16圖係為本發明利用殘餘電壓降低線性殘影的方法1600之流程圖。根據上述三個實施例，可歸納出如第16圖之步驟。步驟說明如下：步驟1602：驅動液晶顯示器中像素PX之第一子像素SPX1 使第一子像素SPX1 載有電壓VSPX1 之平均值符合一第一最佳共同電壓VOP_COM1 ；步驟1603：驅動液晶顯示器中像素PX之第二子像素SPX2 使第二子像素SPX2 載有電壓VSPX2 之平均值符合一第二最佳共同電壓VOP_COM2 ；步驟1604：以一面板電壓VP ，驅動該液晶顯示器，其中該面板電壓VP 介於該第一最佳共同電壓VOP_COM1 與該第二最佳共同電壓VOP_COM2 之間；步驟1605：結束。
步驟1604中，最佳共同電壓VOP_COM1 與VOP_COM2 之平均係等於面板電壓VP 。
步驟1602與1603可根據本發明之第一實施例所揭露之方法，以平均值符合該面板電壓VP 之驅動電壓VD 驅動第一子像素SPX1 與第二子像素SPX2 、然後分別調整第一子像素SPX1 與第二子像素SPX2之等效電容(CST1 、CST2 )以使跨壓VSPX1 與VSPX2 之平均值分別符合第一最佳共同電壓VOP_COM1 與第二最佳共同電壓VOP_COM2 。
步驟1602與1603可根據本發明之第二實施例所揭露之方法，以平均值符合該面板電壓VP 之驅動電壓VD 驅動第一子像素SPX1 與第二子像素SPX2 、然後分別調整第一子像素SPX1 與第二子像素SPX2之上板電壓VUL1 與VUL2 以使跨壓VSPX1 與VSPX2 之平均值分別符合第一最佳共同電壓VOP_COM1 與第二最佳共同電壓VOP_COM2 。
步驟1602與1603可根據本發明之第三實施例與第14圖所揭露之方法，以平均值符合該第一最佳共同電壓VOP_COM1 之驅動電壓VD1 與平均值符合該第二最佳共同電壓VOP_COM2 之驅動電壓VD2 分別驅動第一子像素SPX1 與第二子像素SPX2 。而產生平均值符合該第一最佳共同電壓VOP_COM1 之驅動電壓VD1 係根據一第一灰階/電壓轉換特性，將灰階GL(32) 轉換為第一灰階電壓VG1(32＋) 、VG1(32－) ；產生平均值符合該第二最佳共同電壓VOP_COM2 之驅動電壓VD2 係根據一第二灰階/電壓轉換特性，將灰階GL(32) 轉換為第二灰階電壓VG2(32＋) 、VG2(32－) ；並且將第一子像素SPX1 與第二子像素SPX2 的上板電壓VUL 保持相同，如此一來，跨壓VSPX1 與VSPX2 之平均值便能分別符合第一最佳共同電壓VOP_COM1 與第二最佳共同電壓VOP_COM2 。
步驟1602與1603可根據本發明之第三實施例與第15圖所揭露之方法，以平均值符合該第一最佳共同電壓VOP_COM1 之驅動電壓VD1 與平均值符合該第二最佳共同電壓VOP_COM2 之驅動電壓VD2 分別驅動第一子像素SPX1 與第二子像素SPX2 。而產生平均值符合該第一最佳共同電壓VOP_COM1 之驅動電壓VD1 係根據一第一灰階/灰階轉換特性，將灰階GL(32) 轉換為灰階GL(60＋) 、GL(16－) 、然後再根據一灰階/電壓轉換特性，將灰階GL(60＋) 、GL(16－) 轉換成灰階電壓VG1(60＋) 、VG1(16－) 以作為驅動電壓VD1 ；產生平均值符合該第二最佳共同電壓VOP_COM2 之驅動電壓VD2 係根據一第二灰階/灰階轉換特性，將灰階GL(32) 轉換為灰階GL(16＋) 、GL(60－) 、然後再根據相同之灰階/電壓轉換特性，將灰階GL(16＋) 、GL(60－) 轉換成灰階電壓VG1(16＋) 、VG1(60－) 以作為驅動電壓VD2 ；並且將第一子像素SPX1 與第二子像素SPX2 的上板電壓VUL 保持相同，如此一來，跨壓VSPX1 與VSPX2 之平均值便能分別符合第一最佳共同電壓VOP_COM1 與第二最佳共同電壓VOP_COM2 。
綜上論述，本發明所提供之方法，能有效地利用液晶顯示器上殘餘之電壓，降低液晶顯示器的線性殘影，提供更好的顯示品質。
雖然本發明已以實施例揭露如上，然其並非用以限定本發明，任何具有本發明所屬技術領域之通常知識者，在不脫離本發明之精神和範圍內，當可作各種更動與潤飾，並可思揣其他不同的實施例，因此本發明之保護範圍當視後附申請專利範圍所界定者為準。
100．．．液晶顯示器
UL．．．上板
LL．．．下板
LCL．．．液晶層
LC．．．液晶分子
P．．．雜質分子
E．．．電場
VR 、VD1 ’、VD2 ’．．．電壓
PX．．．像素
SPX1 、SPX2 ．．．子像素
VOP_COM1 、VOP_COM2 ．．．最佳共同電壓
VSPX1 、VSPX2 ．．．像素電壓
VP ．．．面板電壓
VUL ．．．上板共同電壓
VLL ．．．下板共同電壓
CLC ．．．液晶等效電容
CST ．．．儲存電容
SW．．．開關
CGS ．．．寄生電容
VD 、VD ’．．．灰階電壓
1310、1410、1511、1512．．．時序控制器
GL．．．灰階
1320、1421、1422、1521、1522．．．枷瑪電路
1600．．．方法
1601－1605．．．步驟
第1圖係為習知液晶顯示器之橫剖面圖。
第2圖係為習知液晶顯示器於顯示畫面時之示意圖。
第3圖係為習知液晶顯示器於顯示畫面一段時間後之示意圖。
第4圖係為習知液晶顯示器於顯示畫面一段時間後之示意圖。
第5圖係為本發明於液晶顯示器上外加殘餘偏壓以降低線性殘留之示意圖。
第6圖係為本發明於一像素上外加殘餘偏壓以降低線性殘留之示意圖。
第7圖係為根據第6圖所示之方式驅動子像素之示意圖。
第8圖係為本發明利用殘餘電壓之第一實施例之電路之示意圖。
第9圖係根據第8圖之實施例之時序示意圖。
第10圖係為本發明利用殘餘電壓之第二實施例之電路之示意圖。
第11圖係根據第10圖之實施例之時序示意圖。
第12圖係為本發明利用殘餘電壓之第三實施例之電路之示意圖。
第13圖係為一先前技術將灰階資料轉換成灰階電壓之示意圖。
第14圖係為根據本發明之第三實施例之電路示意圖。
第15圖係為根據本發明之第三實施例之電路示意圖。
第16圖係為本發明利用殘餘電壓降低線性殘影的方法之流程圖。
1601－1605．．．步驟

Claims (9)

  1. 一種改善液晶顯示器線性殘影之方法，該液晶顯示器包含複數個像素，每個該像素皆包含一第一子像素與一第二子像素，該方法包含：以一第一最佳共同電壓，驅動該複數個像素之該第一子像素；以一第二最佳共同電壓，驅動該複數個像素之該第二子像素；以及以一面板電壓，驅動該液晶顯示器；其中該面板電壓介於該第一最佳共同電壓與該第二最佳共同電壓之間。
  2. 如請求項1所述之方法，其中該面板電壓係為該第一最佳共同電壓與該第二最佳共同電壓之平均值。
  3. 如請求項2所述之方法，其中以該第一最佳共同電壓，驅動該複數個像素之該第一子像素包含：以該面板電壓驅動該複數個像素之該第一子像素；及調整該複數個像素之該第一子像素之等效電容以使該複數個像素之該第一子像素之跨壓符合該第一最佳共同電壓；其中以該第二最佳共同電壓，驅動該複數個像素之該第二子像素包含：以該面板電壓驅動該複數個像素之該第二子像素；及調整該複數個像素之該第二子像素之等效電容以使該複數個 像素之該第二子像素之跨壓符合該第二最佳共同電壓。
  4. 如請求項2所述之方法，其中以該第一最佳共同電壓，驅動該複數個像素之該第一子像素包含：以該面板電壓驅動該複數個像素之該第一子像素；及調整該複數個像素之該第一子像素之一第一上板電壓以使該複數個像素之該第一子像素之跨壓符合該第一最佳共同電壓；其中該複數個像素之該第一子像素皆耦接於一第一上板共同端，該上板共同端載有該第一上板電壓；其中以該第二最佳共同電壓，驅動該複數個像素之該第二子像素包含：以該面板電壓驅動該複數個像素之該第二子像素；及調整該複數個像素之該第二子像素之一第二上板電壓以使該複數個像素之該第二子像素之跨壓符合該第二最佳共同電壓；其中該複數個像素之該第二子像素皆耦接於一第二上板共同端，該上板共同端載有該第二上板電壓。
  5. 如請求項4所述之方法，另包含以一下板電壓驅動該複數個像素之該第一子像素與該第二子像素；其中該複數個像素之該第一子像素與該第二子像素皆耦接於一下板共同端，該下板共同端載有該下板電壓。
  6. 如請求項5所述之方法，其中該下板電壓係為該面板電壓。
  7. 如請求項2所述之方法，其中以該第一最佳共同電壓，驅動該複數個像素之該第一子像素包含：以平均值符合該第一最佳共同電壓之驅動電壓驅動該複數個像素之該第一子像素；其中以該第二最佳共同電壓，驅動該複數個像素之該第二子像素包含：以平均值符合該第二最佳共同電壓之驅動電壓驅動該複數個像素之該第二子像素。
  8. 如請求項7所述之方法，其中以平均值符合該第一最佳共同電壓之驅動電壓驅動該複數個像素之該第一子像素包含：根據一第一灰階/電壓轉換特性，將一灰階轉換為一第一灰階電壓；及以該第一灰階電壓驅動該複數個像素之該第一子像素；其中以平均值符合該第二最佳共同電壓之驅動電壓驅動該複數個像素之該第二子像素包含：根據一第二灰階/電壓轉換特性，將該灰階轉換為一第二灰階電壓；及以該第二灰階電壓驅動該複數個像素之該第二子像素；其中該第一灰階電壓與該第二灰階電壓之平均值係分別符合 該第一最佳共同電壓與該第二最佳共同電壓。
  9. 如請求項7所述之方法，其中以平均值符合該第一最佳共同電壓之驅動電壓驅動該複數個像素之該第一子像素包含：根據一第一灰階/灰階轉換特性，將一灰階轉換為一第一灰階；根據一灰階/電壓轉換特性，將該第一灰階轉換為一第一灰階電壓；及以該第一灰階電壓驅動該複數個像素之該第一子像素；其中以平均值符合該第二最佳共同電壓之驅動電壓驅動該複數個像素之該第二子像素包含：根據一第二灰階/灰階轉換特性，將該灰階轉換為一第二灰階；根據該灰階/電壓轉換特性，將該第二灰階轉換為一第二灰階電壓；及以該第二灰階電壓驅動該複數個像素之該第二子像素；其中該第一灰階電壓與該第二灰階電壓之平均值係分別符合該第一最佳共同電壓與該第二最佳共同電壓。
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