[go: up one dir, main page]

TWI262567B - Bumped wafer structure - Google Patents

Bumped wafer structure Download PDF

Info

Publication number
TWI262567B
TWI262567B TW094100566A TW94100566A TWI262567B TW I262567 B TWI262567 B TW I262567B TW 094100566 A TW094100566 A TW 094100566A TW 94100566 A TW94100566 A TW 94100566A TW I262567 B TWI262567 B TW I262567B
Authority
TW
Taiwan
Prior art keywords
layer
wafer
nickel
titanium
alloy
Prior art date
Application number
TW094100566A
Other languages
English (en)
Other versions
TW200625482A (en
Inventor
Min-Lung Huang
Original Assignee
Advanced Semiconductor Eng
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Advanced Semiconductor Eng filed Critical Advanced Semiconductor Eng
Priority to TW094100566A priority Critical patent/TWI262567B/zh
Publication of TW200625482A publication Critical patent/TW200625482A/zh
Application granted granted Critical
Publication of TWI262567B publication Critical patent/TWI262567B/zh

Links

Classifications

    • H10W72/012

Landscapes

  • Wire Bonding (AREA)
  • Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)

Description

!262567 九、發明說明: 【發明所屬之技術領域】 本發明係關於一種具有凸塊之晶圓結構,且特別是有 關於一種能改善設置於晶圓銲墊與銲料凸塊間之球底金 屬層之接合強度之晶圓結構。 【先前技術】 鲁 在南度資訊化社會的今曰,多媒體應用市場不斷地急 速擴張,積體電路封裝技術也隨之朝電子裝置的數位化、 網路化、區域連接化以及使用人性化的趨勢發展。為達成 上述的要求,電子元件必須配合高速處理化、多功能化、 積集化、小型輕量化及低價化等多方面之要求,也因此積 體電路封裝技術也跟著朝向微型化、高密度化發展。其中 球格陣列式構裝(Ball Grid Array,BGA ),晶片尺寸構裝 (Chip-Scale Package,CSP ),覆晶構裝(Flip Chip,F/C ), • 多晶片模組(Multi-Chip Module,MCM )等高密度積體電 路封裝技術也因應而生。 其中覆晶構裳技術(Flip Chip Packaging Technology) 主要是利用面陣列(area array)的排列方式,將多個晶片銲 墊(bonding pad)配置於晶片(die)之主動表面(active surface),並在各個晶片銲墊上形成凸塊(bump),接著再將 晶片翻面(flip)之後,利用晶片銲墊上的凸塊分別電性 (electrically)及機械(mechanically)連接至基板(substrate)或 印刷電路板(PCB)之表面所對應的接合墊(mounting pad)。 1262567 再者,由於覆晶接合技術係可應用於高接腳數(High pin
Count)之晶片封裝結構’並同時具有縮小封裝面積及縮短 訊號傳輸路徑等多項優點,所以覆晶接合技術目前已經廣 泛地應用在晶片封裝領域。 而所謂的晶圓凸塊製程,則常見於覆晶技術(flip chip) 中’主要係在形成有多個晶片的晶圓上對外的接點(通常是 金屬銲塾;亦即為晶圓銲塾)上形成球底金屬層(ubm, 籲Under Bump Metallurgy Layer),接著於球底金屬層之上形 成凸塊或植入銲球以作為後續晶片與基板(substrate)電性 導通之連接介面。 明參知圖1,係為習知之具有凸塊之半導體晶圓剖面 示意圖100結構。晶圓100之主動表面1〇1上係具有保護 層102及複數個暴露出保護層1〇2之晶圓銲墊1〇4,另外 於晶圓銲墊上104形成有一球底金屬層1〇6,且球底金屬 層106上形成有一銲料凸塊1〇8。其中,球底金屬層1〇6 • 係配置於晶圓銲墊104與銲料凸塊108之間,用以作為晶 圓銲墊104及銲料凸塊1〇8間之接合介面。 請再參考圖1,習知之球底金屬層106主要包括黏著 層(adhesion layer) 106a、阻障層(barrier layer) 106b 及 潤濕層(wettable layer) 106c。黏著層i〇6a係用以增加晶 圓銲墊104與阻障層l〇6b間之接合強度,其材質例如為 鋁或鈦等金屬。而阻障層106b係用以防止阻障層l〇6b之 上下兩侧的金屬發生擴散(diffusion )的現象,其常用材 質例如為鎳飢合金及鎳等金屬。另外,潤濕層1 〇6c係用以 1262567 增加球底金屬展! ,, 曰1〇6對於銲料凸塊1〇8之、、上 (wetabi^^其常用材質包括銅等金屬。 1力 值得注意的是如圖!所示,當球底金屬層叫 層1〇6C的,、且成成分包括銅時,在迴銲(Reflow)過程期”、、 由於銲料凸塊108之锚托且⑼、叫、曰& 布王4間, <錫極易與潤濕層l〇6c之銅發生反應, 而生成”至屬化合物(Inter-Metallic Compound,IMC), 即CU6Sn5 ’進而在潤濕層l〇6c及銲料凸塊108間反應生 成’I金屬化合物層(IMC layer)。此外,當球底金屬層 106之阻障層1〇处的組成成分主要包括錄鈒合金、及錄金 屬時,在迴銲過程期間,銲料凸塊108之錫將先與潤濕層
106c之銅反應生成介金屬化合物,即c%Sn5,接著銲料凸 塊108之錫將再與阻障層1〇6b之鎳金屬粒子反應生成另 一種介金屬化合物,即见3%4。值得注意的是,由於銲料 凸塊108之錫與阻障層1〇6b之鎳於較長時間反應下,所 產生的"金屬化合物(即NhSii4)係為不連續之塊狀結構, 如此將使得銲料凸塊丨〇8易於從此處脫落(即黏著層106a 與阻障層106b之介面處)。 因此,如何提供解決上述問題,實為本發明之重要課 題0 【發明内容】 有鑑於此,本發明之目的係在於提出一種具有適於配 置在晶圓銲墊與銲料凸塊間之球底金屬層之晶圓結構,以 使该銲料凸塊中之錫金屬粒子與球底金屬層之反應速率 1262567 變緩並降低介金屬化合物(即Ni3Sn4)之生成速率,以解 決銲料凸塊易於脫落之問題,故可長時間地維持銲料凸塊 與晶圓銲墊間之接合強度,進而提高具有凸塊之晶圓結構 及晶片封裝結構之使用壽命。 緣是,為達上述目的,本發明係提出一種具有適於配 置在晶圓銲墊與銲料凸塊間之球底金屬層之具有凸塊之 晶圓結構,其中銲料凸塊之材質係包含錫,且球底金屬層 ^ 至少具有:一黏著層,配置於晶圓銲墊上;一鎳釩合金層, 配置於黏著層上;一潤濕層,配置於該鎳飢合金層上。其 中,潤濕層係為一錄銅合金層或欽銅合金層’其與凸塊中 之錫金屬粒子之反應速率遠比銅金屬層來得慢,故Cu6Sn5 介金屬化合物之生成亦較為緩慢。再者,承前所述,由於 欽銅合金層或鎳銅合金層與銲料凸塊中之錫金屬粒子反 應遲緩,故亦間接降低鎳飢合金層與錫金屬粒子之反應速 率,以避面鎳釩合金層與黏著層之界面處反應生成不連續 • 塊狀結構之介金屬化合物(即Ni3Sn4)。如此,可提升晶圓 結構於後續封裝製程及工作運算時之可靠度。 【實施方式】 以下將參照相關圖式,說明依本發明較佳實施例之具 有凸塊之晶圓結構。 請參考圖2,其顯示根據本發明之較佳實施例之具有 凸塊之晶圓結構的剖面示意圖。 晶圓200係具有保護層202及晶圓銲墊204,且晶圓 1262567 銲墊204上係形成有一球底金屬層2〇6。其中,保護層2〇2 係配置於晶圓主動表面2〇1上,用以保護晶圓2〇〇表面旅 具有一開口使晶圓銲墊204暴露出;而球底金屬層則主要 係由黏著層206a、阻障層206b及潤濕層2〇6c所組成。當 晶圓銲墊204為鋁銲墊時,黏著層/阻障層/潤濕層較佳地 可為鋁/鎳飢合金/鈦銅或鎳銅合金層三層結構。而當晶圓 鈐墊204為銅銲墊時,黏著層/阻障層/潤濕層較佳地玎為 • 鈦/鎳釩合金/鈦銅或鎳銅合金層三層結構或鈦/鋁/鎳釩合 金/鈦銅或鎳銅合金層四層結構。惟不論其黏著層、阻障 層、潤濕層是由何材料所組成,一般而纟,黏著層之材質 係選自於由鈦、鎢、鈦鎢合金、鈇鋁合金、鉻、鋁所組成 族群中之一種材質或其組合;阻障層之材質係為鎳釩合金; 而潤濕層之材質係選自於鈦銅合金、鎳銅合金或其所組成 之無群。其中’黏著層、阻障層及潤濕層可利用濺鍍之方 ^或電鑛之方式形成之,該保護層之材質可包含聚亞酿胺 (卩〇1}^111丨(16,?1)或本併環丁烯(26112;〇(^1(^1^116,]^;6)。 承上所述’由於銲料凸塊2〇8係形成於潤濕層2〇6c 上,即是所謂的鈦銅合金層或鎳銅合金層上,故銲料凸塊 208迴銲時,銲料凸塊2〇8中之錫係先與潤濕層2〇^中之 銅相互相反應,之後再往較下層之阻障層(即鎳釩合金層) 206b反應。由於潤濕層2〇&係為一鎳銅合金層或鈦銅合 金層,其與凸塊中之錫金屬粒子之反應速率遠比只且有銅 金屬層之潤濕層來得慢,故Cu6Sn5介金屬化合物之生成速 度亦較為缓慢。再者由於鈦銅合金層或鎳銅合金層與銲料 1262567 凸塊中之錫金屬粒子反應遲緩’故亦降低錄叙合金層與錫 金屬粒子之反應速率,以使鎳鈒合金層與黏著層之界面處 不易反應生成不連續塊狀結構之介金屬化合物(即 Ni3Sn4)。 由上可知,本發明之主要特徵係為形成一含鈦銅合金 層或鎳銅合金層之材質於與銲料凸塊相接合之球底金屬 層中,以取代原先球底金屬層中之銅金屬層,以降低及減 φ 緩Cu6Sn5介金屬化合物之生成速度。再者由於鈦銅合金層 或鎳銅合金層與銲料凸塊中之錫金屬粒子反應遲缓,故亦 降低鎳釩合金層與錫金屬粒子之反應速率,以使鎳釩合金 層與黏著層之界面處不易反應生成不連續塊狀結構之介 金屬化合物(即Ni3Sn4)。 於本實施例之詳細說明中所提出之具體的實施例僅 為了易於說明本發明之技術内容,而並非將本發明狹義地 限制於實施例,因此,在不超出本發明之精神及以下申請 • 專利範圍之情況,可作種種變化實施。 【圖式簡單說明】 圖1為習知之具有凸塊之晶圓結構剖面示意圖。 圖2為依照本發明較佳實施例之具有凸塊之晶圓結構 剖面示意圖。 元件符號說明: 100 ·晶 0 10 1262567 101:主動表面 102 :保護層 104 :晶圓銲墊 106 ··球底金屬層 106a:黏著層 106b:阻障層 106c:潤濕層 108 :銲料凸塊 200 :晶圓 201:主動表面 202 :保護層 204 :晶圓銲墊 206 :球底金屬層 206a:黏著層 206b:阻障層 φ 206c:潤濕層 208 :銲料凸塊

Claims (1)

1262567 十、申請專利範圍: 1· 一種具有凸塊之晶圓結構,包含: 一主動表面; 複數個晶圓銲墊,設置於該主動表面上; 一保護層,設置於該主動表面上且具有複數個開口暴 露出該等晶圓銲墊;及 複數個球底金屬層,係設置於該等晶圓銲墊上且每一 該等球底金屬層係分別包含一黏著層、一鎳凱合金 層與一潤濕層,該黏著層係與該晶圓銲墊連接,而 該鎳飢合金層係設置於該黏著層上,且該潤濕層係 設置於該鎳鈒合金層上,其中該潤濕層係為一鈦銅 合金層。 2. 如申請專利範圍第1項所述之具有凸塊之晶圓結構,其 中該黏著層之材質係選自於由鈦、鎮、鈦鎢合金、鉻、 I呂、鈦紹合金所組成族群中之一種材質。 3. 如申請專利範圍第1項所述之具有凸塊之晶圓結構,更 形成一銲料凸塊於該潤濕層上。 4. 如申請專利範圍第1項所述之具有凸塊之晶圓結構,其 中該保護層之材質係包含聚亞醯胺(P〇lyimide,PI)。 5. 如申請專利範圍第1項所述之具有凸塊之晶圓結構,其 12 1262567 保護層之材質係包含苯併環丁烯 (Benzocyclobutene,BCB)。 6·如申請專利範圍第2項所述之具有凸塊之晶圓結構,其 中該黏著層係為鈦金屬層/鋁金屬層兩層結構。 7. —種具有凸塊之晶圓結構,包含: 一主動表面; 複數個晶圓銲墊,設置於該主動表面上; 一保護層,設置於該主動表面上且具有複數個開口暴 露出該等晶圓銲墊;及 複數個球底金屬層,係設置於該等晶圓銲墊上且每一 該等球底金屬層係分別包含一黏著層、一鎳叙合金 層與一潤濕層,該黏著層係與該晶圓銲墊連接,而 該鎳釩合金層係設置於該黏著層上,且該潤濕層係 設置於該鎳奴合金層上,其中該潤濕層係為一鎳銅 合金層。 8. 如申請專利範圍第7項所述之具有凸塊之晶圓結構,其 中該黏著層之材質係選自於由鈦、鎢、鈦鎢合金、鉻、 鋁、鈦鋁合金所組成族群中之一種材質。 9. 如申請專利範圍第7項所述之具有凸塊之晶圓結構,更 形成一銲料凸塊於該潤濕層上。 13 I262567 ΐ〇·如申請專利範圍第7項所述之具有凸塊之晶圓結構,其 中该保護層之材質係包含聚亞醯胺(polyimide,PI)。 U·如申請專利範圍第7項之具有凸塊之晶圓結構,其中該 保護層之材質係包含苯併環丁烯 (Benzocyclobutene,BCB)。 12.如申請專利範圍第7項所述之具有凸塊之晶圓結構,复 中邊黏著層係為鈦金屬層/銘金屬層兩層結構。 14
TW094100566A 2005-01-07 2005-01-07 Bumped wafer structure TWI262567B (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
TW094100566A TWI262567B (en) 2005-01-07 2005-01-07 Bumped wafer structure

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
TW094100566A TWI262567B (en) 2005-01-07 2005-01-07 Bumped wafer structure

Publications (2)

Publication Number Publication Date
TW200625482A TW200625482A (en) 2006-07-16
TWI262567B true TWI262567B (en) 2006-09-21

Family

ID=37987768

Family Applications (1)

Application Number Title Priority Date Filing Date
TW094100566A TWI262567B (en) 2005-01-07 2005-01-07 Bumped wafer structure

Country Status (1)

Country Link
TW (1) TWI262567B (zh)

Also Published As

Publication number Publication date
TW200625482A (en) 2006-07-16

Similar Documents

Publication Publication Date Title
KR100876485B1 (ko) 주석 함량이 많은 땜납 범프의 이용을 가능하게 하는ubm층
JP6352205B2 (ja) 銅柱バンプ上の金属間化合物の接合のための構造
TWI220781B (en) Multi-chip package substrate for flip-chip and wire bonding
US8952271B2 (en) Circuit board, semiconductor device, and method of manufacturing semiconductor device
TWI231555B (en) Wafer level package and fabrication process thereof
TWI230450B (en) Under bump metallurgy structure
JPH07302797A (ja) 半導体素子ならびにその製造および使用方法
TW201112370A (en) Semiconductor flip chip package
US6864168B2 (en) Bump and fabricating process thereof
CN100509254C (zh) 焊料组合物,制备焊料连接的方法以及由其得到的制品
TW200408095A (en) Chip size semiconductor package structure
JP3700598B2 (ja) 半導体チップ及び半導体装置、回路基板並びに電子機器
US7518241B2 (en) Wafer structure with a multi-layer barrier in an UBM layer network device with power supply
TW589727B (en) Bumping structure and fabrication process thereof
TW583759B (en) Under bump metallurgy and flip chip
TWI223883B (en) Under bump metallurgy structure
US6891274B2 (en) Under-bump-metallurgy layer for improving adhesion
US20040065949A1 (en) [solder bump]
TWI262567B (en) Bumped wafer structure
TWI237860B (en) Integrated chip structure for wire bonding and flip chip assembly package and fabrication process thereof
US20040256737A1 (en) [flip-chip package substrate and flip-chip bonding process thereof]
TWI249211B (en) Bump structure
TWI242273B (en) Bump structure
TWI258195B (en) Bumped wafer structure
TWI237369B (en) Bump structure

Legal Events

Date Code Title Description
MK4A Expiration of patent term of an invention patent