SU1120325A1 - Arithmetic modulo n unit - Google Patents
Arithmetic modulo n unit Download PDFInfo
- Publication number
- SU1120325A1 SU1120325A1 SU833614145A SU3614145A SU1120325A1 SU 1120325 A1 SU1120325 A1 SU 1120325A1 SU 833614145 A SU833614145 A SU 833614145A SU 3614145 A SU3614145 A SU 3614145A SU 1120325 A1 SU1120325 A1 SU 1120325A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- inputs
- modular
- adder
- output
- outputs
- Prior art date
Links
- XUKUURHRXDUEBC-KAYWLYCHSA-N Atorvastatin Chemical compound C=1C=CC=CC=1C1=C(C=2C=CC(F)=CC=2)N(CC[C@@H](O)C[C@@H](O)CC(O)=O)C(C(C)C)=C1C(=O)NC1=CC=CC=C1 XUKUURHRXDUEBC-KAYWLYCHSA-N 0.000 claims description 2
- 238000010586 diagram Methods 0.000 description 2
- 239000000047 product Substances 0.000 description 2
- OQCFWECOQNPQCG-UHFFFAOYSA-N 1,3,4,8-tetrahydropyrimido[4,5-c]oxazin-7-one Chemical compound C1CONC2=C1C=NC(=O)N2 OQCFWECOQNPQCG-UHFFFAOYSA-N 0.000 description 1
- 235000019738 Limestone Nutrition 0.000 description 1
- 238000010276 construction Methods 0.000 description 1
- 230000008030 elimination Effects 0.000 description 1
- 238000003379 elimination reaction Methods 0.000 description 1
- 239000006028 limestone Substances 0.000 description 1
- 239000011159 matrix material Substances 0.000 description 1
- 239000013589 supplement Substances 0.000 description 1
Landscapes
- Complex Calculations (AREA)
Abstract
1.АРИСМЕТИЧЕСКОЕ УСТРОЙСТВО . ГЮ МОДУЛЮ, содержащее первый модульный сумматор, модульный вычитатель, первый и второй квадраторы, причем входы первого и второго квадраторов подключены соответственно к выходам первого модульного сумматора и модульного вычитател , входы которых соответственно объединены и вл ютс : входами соответственно первого и второго операндов устройства, о т л ичающеес тем, что, с целью расширени функциональных возможностей путем выполнени устройством операций сложени и дополнени , оно содержит первьй, второй и третий коммутаторы , элемент ИЛИ, второй и третий модульные сумматоры, причем первые выходы первого и второго квадраторов подключены соответственно к первому и второму входам второго модульного сумматора, выход которого вл етс выходом старшего «у-ичного разр да результата ( Ч, - модуль) арифметического устройства, вход переноса второго модульного сумматора подключен к выходу переноса третьего модульного сумматора и вл етс выходом переноса арифметического устройства, первые информационные входы первого и второго коммутаторов подключены соответственно к входам первого и второго операндов арифметического устройства , вторые информационные входы первого и второго KOMNryTaTopoB подключены соответственно к вторым выходам первого и второго квадраторов, выходы первого и второго коммутаторов подключены соответственно к первому и второму входам третьего модульного/ сумматорй, выход которого подключен СП к первому информационному входу трес тьего коммутатора, второй информационный вход которого подключен к выходу модульного вычитател , а выход вл етс выходом младшего « -ичного разр да результата арифметического устройства, первый и второй ю управл ющие входы первого и второго о 00 коммутаторов соответственно объединены , подключены к входам элемента ШШ Iv9 СП и вл ютс входами операций Умножение и Сложение ари(|н етического устройства, выход элемента ИЛИ подключен к первому управл ющему входу третьего коммутатора, второй управл ющий вход которого вл етс входом операций Дополнение арифметического устройства. 2. Устройство по п. 1, о т л ичающеес тем, что второй модульный сумматор содержит первую и вторую группы из гт сумматоров по основани м системы остаточных1. ARISMETIC DEVICE. HU MODULE containing the first modular adder, modular subtractor, first and second quadrants, with the inputs of the first and second quadrants connected respectively to the outputs of the first modular adder and modular subtractor, whose inputs are respectively combined and are: the inputs of the first and second operands of the device, respectively t it is due to the fact that, in order to expand the functionality by performing the device operations of addition and addition, it contains the first, second and third switches, The OR element, the second and third modular adders, the first outputs of the first and second quadrants are connected respectively to the first and second inputs of the second modular adder, the output of which is the output of the higher-order result (H, module) arithmetic unit, input the transfer of the second modular adder is connected to the transfer output of the third modular adder and is the transfer output of the arithmetic unit; the first information inputs of the first and second switches are connected respectively directly to the inputs of the first and second operands of the arithmetic unit, the second information inputs of the first and second KOMNryTaTopoB are connected respectively to the second outputs of the first and second quadrants, the outputs of the first and second switches are connected respectively to the first and second inputs of the third modular / summator, the output of which is connected to the first switch the information input of the cracked switch, the second information input of which is connected to the output of the modular subtractor, and the output is the output of the younger "- primary the result of the arithmetic unit, the first and second control inputs of the first and second and 00 switches, respectively, are combined, connected to the inputs of the IW9 SP element, and are the inputs of the Multiply and Addition operations (| of the practical device, the output of the OR element is connected to the first the control input of the third switch, the second control input of which is an input of operations; Addition of the arithmetic unit. 2. The device according to claim 1, wherein the second modular adder comprises the first and second groups of rm adders on the bases of the residual system
Description
классов, группу из п коммутаторов и элемент НЕ, причем соответстзующи.е входы J-X ( j 1j2,....,n) сумMaropqB первой и второй групп попарно об1 единены и вл ютс ссютветственно первым и вторьгм входами второго модульного сумматора, выходы J-X сумматоров первой и второй групп подключены соответственно к первым и вторьм информационным входам j-x коммутаторов В группы, выходы которь вл ютс выходом второго модульного сумматора, первые Я вторые управл ющие входы коммутаторов группы соответственно объединены и подключены соответственно к выходу элемента НЕ и входу переноса второго модульного iсумматора, к которому подключен вход элемента НЕ.classes, a group of n commutators and a NOT element, and the corresponding inputs. The inputs JX (j 1j2, ...., n) are the sum MaropqB of the first and second groups are pairwise united and are correspondingly the first and second inputs of the second modular adder, the outputs of the JX adders the first and second groups are connected respectively to the first and second information inputs jx of switches To the groups whose outputs are the output of the second modular adder, the first I and second control inputs of the switches of the group are respectively combined and connected respectively to the output element NOT and the transfer input of the second modular imatmator, to which the input element is NOT.
3. Устройство по п. 1, о т л ичающеес тем, что третий модульный сумматор содержит группу из h сумматоров по основани м системы остаточных классов, дополнительный сукиаТор по первому основанию системы остаточных классов, коммутатор , блок хранени констант нулевизации , сумматор нулевиэации, два элемента ИЛИ, причем первые и вторые входы сумматоров группы вл ютс соответственно первым и вторым входами третьего модульного сумм3. The device according to claim 1, wherein the third modular adder contains a group of h adders on the basis of the residual class system, an additional siesi on the first basis of the residual class system, a switch, a zero-storage unit, a null-adder, two the OR element, the first and second inputs of the group adders being the first and second inputs of the third modular sum, respectively.
2032520325
тора, первьм и второй входы дополнительного сумматора по первому основанию системы остаточных классов подключены к соответствующим входам первого cyi-iMaTopa группы, выход дополнительного сумматора подключен к первому информационному входу коммутатора , второй информационньй вход которого объединен с первым входом сумматора нулевиэации и подключен к выходу первого сумматора группы , выходы коммутатора и В-х (В 2 J .... h ) сумматоров группы вл ютс -выходом третьего модульного сумматора , входы блока хранени констант нулевиэацш подключены соответственно к вьпсодам В-хсумматоров группы , выход блока хранени констант нулевизации подключен к второму входу сумматора нулевизации, группа the torus, the first and second inputs of the additional adder on the first base of the residual class system are connected to the corresponding inputs of the first cyi-iMaTopa group, the output of the additional adder is connected to the first information input of the switch, the second information input of which is combined with the first input of the zero accumulator and connected to the output of the first adder the groups, the switch outputs and the B-x (B 2 J .... h) of the group adders are the output of the third modular adder, the inputs of the storage unit of the constant constants are connected respectively to the In-vpsodam hsummatorov group output constants nulevizatsii storage unit connected to the second input of the adder nulevizatsii group
( 1 О, рт-1, Рт-2, +1) выходов которого подключена к соответствующим входа - первого элемента ИЛИ, группа t--x ( 1,2,,.., р /2) выходов с мматора нулевиэации подключена к соответствующим входам второго элемента ИЛИ, выхода первого и второго элементов ИЛИ соединены соответственно с первьв4 и втор.ьа входами коммутатора, выход второго элемента ИЛИ вл етс выходом переноса третьего модульного суг-гматора,(1 О, рт-1, Рт-2, +1) the outputs of which are connected to the corresponding input - the first element OR, the group t - x (1.2 ,, .., р / 2) outputs from the zero-output mmator is connected to the corresponding inputs of the second OR element, the output of the first and second OR elements are connected respectively to the first 4 and second inputs of the switch, the output of the second OR element is the transfer output of the third modular sump,
Изобретение относитс к вычислительной технике и может быть использовано при построении вычислительных машин высокого быстродействи ,The invention relates to computing and can be used in the construction of computers of high speed,
Известно арифметическое устройство в системе остаточных классов, содержащее регистры первого и второго операндов, регистры контрольных кодов первого и второго операндов, блок модульных сумматоров, три сумматора , три блока посто нной пам ти, блок умножени , три группы элементоБ и, блок управлени и соответствующие св зи С О Недостатки данного устройства большой объем оборудовани и невысокое быстродействие, св занное со слоностью алгоритма контрол .An arithmetic unit in the system of residual classes is known, containing registers of the first and second operands, registers of control codes of the first and second operands, a block of modular adders, three adders, three blocks of permanent memory, a multiplication unit, three groups of elementoB, and a control unit and the corresponding link ziO o The disadvantages of this device are a large amount of equipment and low speed, due to the elephantiness of the control algorithm.
Наиболее близким к изобретению вл етс арифметическое устройство по модулю, содержащее модульный сумматор, первый и второй модульные вычитатели, первый и второй квадраторы , блок делени на константу, выход которого вл етс выходом устройства, а вход подключен к вьтходу второго модульного вычитател , входы которого подключены к выходам соответственно первого и второго квадраторов, входы KOTopioc подключены соответственно к выходам модульного сумматора и первого модульного вычитател , входы которых соответственно объединены и вл ютс входами операндов устройства 2 .Closest to the invention is an arithmetic unit modulo containing a modular adder, first and second modular subtractors, first and second quadrants, a division unit by a constant, the output of which is the output of the device, and the input connected to the output of the second modular subtractor whose inputs are connected to the outputs of the first and second quadrants respectively, the inputs of the KOTopioc are connected respectively to the outputs of the modular adder and the first modular subtractor, whose inputs are respectively combined and are The inputs of the device operands 2.
Недостаток известного арифметического устройства - ограниченные функциональные возможности. 31 Целью изобретени вл етс расширение функциональных возможностей путем выполнени устройством дополнительно операций сложени и дополнени . Поставленна цель достигаетс тем что арифметическое устройство по мо .дулю, содержащее первый, модульньй сумматор, модульный вычитатель, первый и второй квадраторы, причем входы первого и второго квадраторов подключены соответственно к выходам первого модульного сумматора и модульного вычитател , входы которых соответственно объединены и вл ютс входами соответственно первого и второго операндов устройства, содержит первый, второй и третий коммутаторы , элемент ИЛИ, второй и третий модульные сумматоры, причем первые выходы первого и второго квадраторов / подключены соответственно к первому и второму входам второго модульного сумматора , выход которого вл етс выходом старшего е,-ичного разр да результата ( ,- модуль) арифметического устройства , вход переноса второго модульно го сумматора подключен к выходу переноса третьего модульного сумматора и вл етс выходом переноса арифметиA disadvantage of the known arithmetic unit is its limited functionality. 31 The aim of the invention is to extend the functionality by performing additional addition and addition operations on the device. The goal is achieved by the arithmetic unit of a module containing the first modular adder, modular subtractor, first and second quadrants, the inputs of the first and second quadrants connected to the outputs of the first modular adder and modular subtractor, whose inputs are respectively combined and are inputs, respectively, of the first and second operands of the device, contains the first, second and third switches, the element OR, the second and third modular adders, the first outputs of the first O and the second quadrants / are connected respectively to the first and second inputs of the second modular adder, the output of which is the output of the highest e, -ary result of the result (, module) of the arithmetic unit, the transfer input of the second modular adder is connected to the transfer output of the third modular adder and is the output of the transfer arithmetic
ческого устройства, первые информационные входы первого и второго коммутаторов подключены соответственно к входам первого и второго операндов арифметического устройства, вторые информационные входы первого и второго коммутаторов подключены соответственно к вторьм выходам первого и второго квадраторов, выходы первого и второго коммутаторов подключены соответственно к первому и второму входам третьего модульного сумматора выход которого подключен к первому информационному входу третьего коммутатора , второй информационный вход которого подключен к выходу модульного вычитател , а выход вл етс выходом младшего с}, -ичного разр да результата арифметического устройства, первый и второй управл ющие входы первого и второго коммутаторов соотвественно объединены, подключены к соответственно к первому и второму входам элемента ИЛИ и вл ютс входами операций Умножение и Сложемне арифметического устройства, выход элемента ИЛИ подключен к первому управл ющему входу третьего коммуклассов , коммутатор, блок хранени констант нулевизации, сумматор нулевизации , два элемента ШШ, причем первые и вторые входы сумматоров группы вл ютс соответственно первьи и вторым входами третьего модульного сумматора, первый и второй входы дополнительного сумматора по первому основанию системы остаточных классов подключены к соответствующим входам первого думматора груп.пы, выход дополнительного сумматора подключен к перхвому информационному входу коммутатора , второй информационный вход которого объединен с первым входом сумматора нулевизации и подключен к , выходу первого сумматора группы, выходы коммутатора и В-х ( В 2,..., п) сумматоров группы вл ютс выходом третьего модульного сумматора, входы блока хранени констант нулевизации подключены соответственно к выходам В-х сумматоров группы, выход блока хранени констант нулевизации подключен к второму входу сумматора нулевизации, группа k-х (X О, р,-1, р -2,..., р /2+1) выходов которого подключена к соответ25 татора, второй управл ющий вход которого вл етс входом операции Дополнение арифметического устройства. При этом второй модульньй сумматор содержит две группы по м сумматоров по основани м системы остаточных классов, группу из п коммутаторов и элемент НЕ, причем соответствующие входы j -X ( J 1 , 2п ) сумматоров первой и второй групп попарно объединены и вл ютс соответственно первыми и вторыми входами второго модульного сумматора, выходы j-x сумматоров первой второй групп подключены соответственно к первьм и вторым информационным входам j-x коммутаторов В группы, выходы которых вл ютс вькодом второго модульного сумматора, первые и вторые управл ющие входы коммутаторов группы соответственно объединены и подключены соответственно к выходу элемента НЕ и входу переноса второго модульного сумматора, к которому подключен вход элемента НЕ. Кроме того, третий модульньй сумматор содержит группу из п сумматоров , по основани м системы остаточных классов, дополнительный сумматор по первому основанию системы остаточных 511 ствующим входам первого элемента ИЛИ группа -X ( Ь 1,2,,.., ) выходов сумматора нулевиэаций подключена к соответствуюгцкм входам второго элемента ИЛИ, выходы первого и второго элементов ИЛИ соединены соответственно с первым и вторым входами коммутатора, выход второго элемента ИЛИ вл етс выходом переноса третьего модульного сумматора. На фиг. 1 представлена структурна схема арифметического устройства по модулю, на фиг, 2 и 3 - функциональные схемы второго и третьего модульных сумматоров соответственно. Устройство содержит первый модуль ньй сумматор 1, модульный вычитатель 2, первьй 3 и второй 4 квадрато ры, первьй 5 и второй 6 коммутаторы, второй 7 и третий 8 модульные сумматоры , третий коммутатор 9 и элемент ИЛИ 10. Второй модульный сумматор 7 содер ) жит первую 11 и вторую 12 группы сумматоров, группы коммутаторов 13 и элемент НЕ 14, а третий модульный су матор 8 - группу сумматоров 15, дополнительный сумматор 16, коммутатор 17, блок 18 хранени констант нулевизации, сумматор 19 нулевизации и элементы ИЛИ 20 и 21. В основу работы арифметического устройства по модулю положено представление каждого операнда в коде системы остаточных классов СОК по совокупности из h оснований р- таких , что 24, Р. , H,,ci,-.,,lB ((b,ft,...,b,, где 5/., /3; - наименьшие не отрицательные вычеты чисел А и В по основа ни м Р; . При сложении операндов А и В, лежащих в диапазоне с , результат 5 мо жет достигать величины Факт переполнени при Р 2 обнаруживаетс с помощью нулевизации, в процессе которой и результата суммировани вычитаютс такие константы чтобы в результате получилс либо О, либо с . Если результат нулевизации О, то 5 С, П 0. Если результат нулевизации 1, тогда S С- ,, П 1 . Вычитание с эквивалентно изменению значени вычета по основанию Р- 2 на противоположное (С сумма , П - ) , 5 При Р 2 нулевизацию провод т по основани м р. р, а факт переполнени определ ют по вычету основани Р.. Это приводит к значительному повышению быстродействи . Дл повышени скорости нулевизацию провод т за один шаг сразу по всем основани м, кроме первого. При этом блок хранени констант нулевиг.ации имеет р. р, -.. р слов. Операци вычитани в данном устройстве вьшолн етс как сложение. пр мого кода первого операнда и дополнительного кода второго операнда, подаваемых на входы первого и второго операндов устройства. Модульные сумматоры 1, 11 и 15 формируют сумму поступающих на них операндов по основани м СОК, а модульный вычитатель 2 и сумматор 19 нулевизации разность поступающих на них операндов по основани м СОК. Модульные сумматоры 12 и 16 формируют величины сумм, уменьшенных на а по соответствующему основанию, Сумматор 19 нулевизации работает п основанию р, результат, представленньш в коде 1 из р , поступает с его выхода на элементы ИЛИ 20 и 21 дл формировани переноса. Блок 18 хранени констант нулевизации предтавл ет посто нную пам ть, содержащую минимальные числа нулевизации. Все модульные сумматоры и вычитатели могут быть выполнены комбинационными 3J, Операци у шожени в предлагаемом устройстве вьшолн етс по формуле . () 4 . 4 Достоинством данной формулы вл етс то, что она не требует квадратичного диапазона дл представлени произведени . . Введем обозначени : С А + В, d А -В, В результате возведени в квадрат и делени на 4 имеем , 0, Ис,-,)г(с,г,) .% гдеС и сЗ - старшие с -ичные разр ды квадрато.в, С и d - младшие с -ичные разр ды квадратов. Арифметическое устройство по модулю работает следующим образом. По одному из управл ющих входов на коммутаторы 5,6 или 9 подаетс сигнал, соответствующий вьшолн емой устройством операции: Умножение, Сложение или Дополнение. Затем исходные числа А и В р виде двоичных кодов вычетов по.основани м СОК поступают на входы первого модульного сумматора 1 и модульного вычитател которые- формируют их сумму и разност соответственно. При выполнении операции Дополнение (-) результат вычитани с модульного вычитател 2 поступает на второй информационный вход третьего коммутатора 9, который открыт по вто рому управл ющему входу, а с выхода снимаетс код дополнени § При этом выход второго модульного сумматора 7 и выхрд переноса третьего модульного сумматора 8 не опрашиваютс При вьшолнении операции .Сложение ( +) по вторым управл ющим входам открыты второй 5 и третий 6 коммутаторы и по первому управл ющем входу через элемент ИШ 10 открыт третий коммутатор 9. Операнды через первые информационные входы.первого и второго 6 коммутаторов поступают на вход третьего модульного сумматора 8, с выхода которого результат поступает на первый информационный вход третьего коммутатора 9, с выход которого снимаетс результат сложени С выхода переноса третьего модульногозз сумматора 8 снимаетс сигнал переноса . Выход второго модульного сумматора 7 не опрашиваетс . При вьтолнении операции Умножение (х) по nepBbW управл ющим вхо- 40 дам открыты первый 5 и второй 6 комЫутаторы и через элементы ИЛИ 10 по первому управл ющему входу открыт третий коммутатор 9. Операнды, поступившие на входы первого модульного сум- 45 матора 1 и модульного вычитател 2 в виде + Ви , поступают на входы соответственно первого 3 и второго 4 квадраторов, на выходе которых результаты по вл ютс в виде величин , Ср, d и Эд. Величины Э d. поступают на второй модульный сумматор 7, величины С и 5 через первый 5 и второй 6 коммутаторы - на входы третьего модульного сумматора 8, формирующего младший с, -ичньш разр д произведени с весом °, который , пройд третий коммутатор 9, по вл етс на выходе последнего. Одновременно третий сумматор 8 формирует сигнал переноса, который поступает на выход переноса устройства и на выход переноса второго модульного сумматора 7. Если П О, то на выход через коммутаторы 13 поступает результат суммировани С и d с сумматоров 1 1. Если П 1, то на выход через коммутаторы 13 поступает результат С + 5.., + 1 с выходов сумматоров 12. Результат на выходе второго модульного сумматора 7 представл ет .собой старший с -ичный разр д произведени . При выполнении операции Умножение выход переноса третьего модульного сумматора 8 не опрашиваетс . Предложенное арифметическое устройство по модулю может быть использовано и просто как арифметическое устройство в системе остаточных классов , если при вьтолнении всех трех операций опрашивать только выход третьего коммутатора 9. Таким образом, предложенное арифметическое устройство по модулю по сравнению с известньм, вьтолн ющим только одну модульную операцию умножени , выполн ет сложение и вычитание в системе остаточных классов, сложение и умножение а-ичных цифр. вычисл ет дополнительный код второго операнда, т.е. выполн ет вместо одной шестБ различных операций.the first information inputs of the first and second switches are connected respectively to the inputs of the first and second operands of the arithmetic device; the second information inputs of the first and second switches are connected respectively to the second outputs of the first and second quadrants; the outputs of the first and second switches are connected to the first and second inputs respectively The third modular adder whose output is connected to the first information input of the third switch, the second information input which is connected to the output of the modular detractor, and the output is the output of the lower c}, the minor bit of the result of the arithmetic unit, the first and second control inputs of the first and second switches are respectively combined, connected to the first and second inputs of the OR element, respectively, and are inputs of operations Multiplication and Computational arithmetic unit, the output of the element OR is connected to the first control input of the third communclass, the switch, the storage unit of the nullification constants, zeroing adder, two while the first and second inputs of the group adders are the first and second inputs of the third modular adder, the first and second inputs of the additional adder on the first base of the residual classes system are connected to the corresponding inputs of the first group ad, the output of the additional adder is connected to the primary the information input of the switch, the second information input of which is combined with the first input of the zeroing adder and connected to the output of the first group adder, the outputs of the comm Ator and Bx (B 2, ..., p) adders of the group are the output of the third modular adder, the inputs of the storage unit of the nullification constants are connected respectively to the outputs of the Bx adders of the group, the output of the storage unit of the nullification constants is connected to the second input of the zeroing adder , a group of k-x (X O, p, -1, p -2, ..., p / 2 + 1) outputs of which are connected to the corresponding controller, the second control input of which is the input of the operation Addition of the arithmetic unit. In this case, the second modular adder contains two groups of adders on the bases of the system of residual classes, a group of n commutators and the element NOT, and the corresponding inputs j -X (J 1, 2p) of the adders of the first and second groups are pairwise combined and are respectively the first and the second inputs of the second modular adder, the outputs jx of the adders of the first second group are connected respectively to the first and second information inputs jx of the switches to the B group, the outputs of which are the code of the second modular adder, the first and second control inputs of the group of switches respectively coupled and connected respectively to the output of NOT circuit and the input of the second module transferring the adder connected to the input of NOT. In addition, the third modular adder contains a group of n adders, on the bases of the system of residual classes, an additional adder on the first base of the system of residual 511 inputs of the first element OR group-X (L 1,2 ,, ..,) of the outputs of the null elimination is connected to the corresponding inputs of the second OR element, the outputs of the first and second OR elements are connected respectively to the first and second inputs of the switch, the output of the second OR element is the transfer output of the third modular adder. FIG. 1 is a block diagram of an arithmetic unit modulo; FIGS. 2 and 3 are functional diagrams of the second and third modular adders, respectively. The device contains the first module of the new adder 1, the modular subtractor 2, the first 3 and the second 4 quad, the first 5 and the second 6 switches, the second 7 and the third 8 modular adders, the third switch 9 and the element OR 10. The second modular adder 7 contains the first 11 and second 12 groups of adders, switch groups 13 and the NOT 14 element, and the third modular cooler 8 — a group of adders 15, an additional adder 16, a switch 17, a nullization constant storage unit 18, a nulling adder 19, and OR elements 20 and 21. The basis of the arithmetic device p the module is supposed to be a representation of each operand in the code of the system of residual classes of SOCs from the set of h bases p such that 24, P., H ,, ci, -., lB ((b, ft, ..., b ,, where 5 /., / 3; is the smallest non-negative deduction of the numbers A and B on the base of P.; When adding operands A and B lying in the range of c, the result 5 can reach the value of the fact Overflow with P 2 is detected by zeroization, in the course of which and the result of the summation, such constants are subtracted so that the result is either O or c. If the result of zeroization is O, then 5 C, P 0. If the result of zeroization is 1, then S С-, П 1. Subtraction with is equivalent to changing the value of the deduction on the basis of P-2 to the opposite (C sum, P -), 5. At P 2, the zero point is carried out on the basis of m p. p, and the fact of overflow is determined by deducting the base P. This leads to a significant increase in speed. To increase the speed, zeroing is carried out in one step at once on all bases, except the first. At the same time, the storage unit for constant null-ing has p. p, - .. p words. The subtraction operation in this device is accomplished as an addition. the direct code of the first operand and the additional code of the second operand applied to the inputs of the first and second operands of the device. The modular adders 1, 11, and 15 form the sum of the operands arriving at them along the bases of the SOC, and the modular subtractor 2 and the adder 19 nullify the difference between the operands arriving at them along the bases of the SOC. Modular adders 12 and 16 form the values of the amounts reduced by a for the corresponding base. The zeroing adder 19 operates at the base p, the result, represented in code 1 of p, comes from its output to the elements OR 20 and 21 to form the transfer. The null constant storage unit 18 represents a fixed memory containing minimum nuization numbers. All modular adders and subtractors can be performed with combinational 3J. The operation of cutting in the proposed device is performed by the formula. () four . 4 The advantage of this formula is that it does not require a quadratic range to represent the product. . We introduce the following notation: С А + В, d А -В, As a result of squaring and dividing by 4, we have, 0, Is, -,) g (s, g,).% Where C and s3 are the highest c-digit bits squared.c, C, and d are the lower c-primary bits of squares. Arithmetic unit modulo works as follows. One of the control inputs to the switches 5.6 or 9 is given a signal corresponding to the operation performed by the device: Multiplication, Addition or Addition. Then, the initial numbers A and B, in the form of binary deduction codes on the basis of the SOC, are fed to the inputs of the first modular adder 1 and the modular subtractor, which form their sum and difference, respectively. When performing the operation Supplement (-), the result of the subtraction from the modular subtractor 2 is fed to the second information input of the third switch 9, which is open at the second control input, and the exit code is removed from the output. The output of the second modular accumulator 7 and output of the third modular The adder 8 is not polled. When performing the operation. Adding (+) to the second control inputs opens the second 5 and third 6 switches and the first control input through the ISh 10 element opens the third switch 9. Operands through The first information inputs. The first and second 6 switches arrive at the input of the third modular adder 8, from which output the result goes to the first information input of the third switch 9, the output of which removes the result of the addition. The transfer signal is removed from the transfer output of the third modular adder 8. The output of the second modular adder 7 is not polled. When executing the multiplication operation (x) by nepBbW, the first 5 and second 6 switches are opened by the control inputs and the third switch 9 is opened via the first control input through the OR 10 elements 9. Operands received at the inputs of the first modular sum of matrix 1 and modular subtractor 2 in the form of + V, is fed to the inputs of the first 3 and second 4 quadrants, respectively, at the output of which the results appear in the form of, Cp, d and Ed. The values of e d. arrive at the second modular adder 7, the values of C and 5 through the first 5 and second 6 switches to the inputs of the third modular adder 8, which forms the lower C, is the first discharge of the product with a weight of °, which, having passed the third switch 9, appears the output of the latter. At the same time, the third adder 8 generates a transfer signal, which goes to the device’s output and the second modular adder’s output. 7. If P O, then the output through the switches 13 is the result of the summation C and d from the adders 1 1. If P 1, then the output through the switches 13 receives the result C + 5., + 1 from the outputs of the adders 12. The result at the output of the second modular adder 7 is the highest-order partial-output. During the operation Multiply, the output of the transfer of the third modular adder 8 is not polled. The proposed arithmetic unit modulo can be used simply as an arithmetic unit in the system of residual classes, if all three operations are polled, only the output of the third switch 9 is polled. Thus, the proposed unit arithmetic unit modulo only limestone, which performs only one modular operation multiplication, performs addition and subtraction in the system of residual classes, addition and multiplication of a-ary numerals. computes the additional code of the second operand, i.e. performs instead of one six different operations.
/7 / 7
Фи.1Phi.1
Пе/зВыи ffjTOffPe / H o ffjTOff
SjToff Sjtoff
.,, ... ,, ..
f dfTfopoi jco f dfTfopoi jco
f-nf-n
////
/ // /
/7/ 7
I . I Imr-..i4.I. I Imr - .. i4.
//
//
NTI Nti
/f/ f
/ -/7-/;/ - / 7- /;
a a
Si)Si)
2.J2.J
Claims (3)
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| SU833614145A SU1120325A1 (en) | 1983-07-07 | 1983-07-07 | Arithmetic modulo n unit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| SU833614145A SU1120325A1 (en) | 1983-07-07 | 1983-07-07 | Arithmetic modulo n unit |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| SU1120325A1 true SU1120325A1 (en) | 1984-10-23 |
Family
ID=21071648
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| SU833614145A SU1120325A1 (en) | 1983-07-07 | 1983-07-07 | Arithmetic modulo n unit |
Country Status (1)
| Country | Link |
|---|---|
| SU (1) | SU1120325A1 (en) |
-
1983
- 1983-07-07 SU SU833614145A patent/SU1120325A1/en active
Non-Patent Citations (1)
| Title |
|---|
| 1. Авторское свидетельство СССР № 881745, кл. G 06 F 7/72, 1980. 2.ТИИЭР, т. 68, № 4, апрель 1980, с. 114, рис. 3 (прототип). 3.Акушский И.Я., Юдицкий Д.И. Машинна арифметика в остаточных классах. И., Советское радио, 1968, с. 295-327. * |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| US3993891A (en) | High speed parallel digital adder employing conditional and look-ahead approaches | |
| US4354249A (en) | Processing unit for multiplying two mathematical quantities including at least one complex multiplier | |
| US4104729A (en) | Digital multiplier | |
| EP0862110A2 (en) | Wallace-tree multipliers using half and full adders | |
| US4490805A (en) | High speed multiply accumulate processor | |
| SU1120325A1 (en) | Arithmetic modulo n unit | |
| US20050080835A1 (en) | Semiconductor circuit for arithmetic processing and arithmetic processing method | |
| GB1476603A (en) | Digital multipliers | |
| SU1229757A1 (en) | Multiplying device | |
| RU2030783C1 (en) | Device for determination of number of units in binary eight-digit code | |
| SU1667059A2 (en) | Device for multiplying two numbers | |
| SU1111155A1 (en) | Matrix device for squaring and extracting square root | |
| SU1097995A1 (en) | Transformer from binary code to binary-coded decimal code | |
| SU1166097A1 (en) | Q-ary adder | |
| SU1064278A1 (en) | Device for modular addition | |
| SU1608660A1 (en) | Device for computing positional characteristics of modular code | |
| SU879584A1 (en) | Device for raising complex numbers to the power of two | |
| SU1363188A1 (en) | Parallel adder | |
| SU1259254A1 (en) | Device for multiplying numbers | |
| SU1116434A1 (en) | Arithmetic unit for fast fourier transform processors | |
| SU662942A1 (en) | Arithmetic device with conditional sums and self-checking | |
| SU1026141A1 (en) | Conveyer device for computing hyperbolic functions | |
| SU1381492A1 (en) | Divider | |
| SU1432512A1 (en) | Series computing device | |
| SU1578711A1 (en) | Multiplying device |