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KR950003132B1 - 플라즈마 디스플레이 판넬의 구조 및 구동방법 - Google Patents

플라즈마 디스플레이 판넬의 구조 및 구동방법 Download PDF

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KR950003132B1
KR950003132B1 KR1019920004969A KR920004969A KR950003132B1 KR 950003132 B1 KR950003132 B1 KR 950003132B1 KR 1019920004969 A KR1019920004969 A KR 1019920004969A KR 920004969 A KR920004969 A KR 920004969A KR 950003132 B1 KR950003132 B1 KR 950003132B1
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Abstract

내용 없음.

Description

플라즈마 디스플레이 판넬의 구조 및 구동방법
제 1 도는 본 발명에 따른 플라즈마 디스플레이 판넬의 구도회로의 구동을 설명하기 위한 것이다.
제2a도, 제2b도는 본 발명에 따른 일 실시예에 플라즈마 디스플레이 판넬의 구조를 나타내는 것이다.
제3a도, 제3b도는 본 발명에 따른 실시예의 플라즈마 디스플레이 판넬의 구조를 나타내는 것이다.
제4a도는 본 발명에 따른 플라즈마 디스플레이 판넬의 유지전극에 인가되는 일 실시예의 유지펄스를 나타내는 것이다.
제4b도는 본 발명에 따른 플라즈마 디스플레이 판넬의 유지전극에 인가되는 다른 실시예의 유지펄스를 나타내는 것이다.
제4c도는 본 발명에 따른 플라즈마 디스플레이 판넬의 또 다른 실시예의 유지펄스를 나타내는 것이다.
제4d도는 본 발명에 따른 플라즈마 디스플레이 판넬의 양극 및 음극에 인가되는 펄스를 나타내는 것이다.
제5a도-제5e도는 본 발명에 따른 플라즈마 디스플레이 판넬의 동작을 설명하기 위한 구조를 나타내는 것이다.
본 발명은 플라즈마 디스플레이이 판넬에 관한 것으로, 특히 플라즈마 디스플레이 판넬의 구조 및 구동방법에 관한 것이다.
종래의 면방전형(surface discharge type)플라즈마 디스플레이 판넬의 경우에 있어서는 주사와 유지를 동일전극 및 단일회로로 구동함으로 인해서 커플링(coupling)에 의한 이상동작이 일어날 가능성이 있고 회로를 구성하는데 비용이 많이 소모되었다.
본 발명의 목적은 주사음극과 유지전극을 완전히 분리함으로써 이상동작을 방지하고 신뢰성을 증가할 수 있는 플라즈마 디스플레이 판넬의 구조 및 구동방법을 제공하는데 있다.
이와같은 목적을 달성하기 위한 본 발명의 플라즈마 디스플레이 판넬의 구조는 상판 전면 유리에 양극을 형성하고 하판 후면 유리에 제 1 유지전극을 형성하고 상기 제 1 유지전극 위에 유전체를 도포하고 상기 제 1 유지전극 바로 위에 음극을 형성하고 상기 음극과 나란하게 교대로 제 2 유지전극을 형성하고 상기 음극과 제 2 유지전극 위에 유전체를 도포하고 구성되어 있다.
또한 상기 구성과 결부된 플라즈마 디스플레이 판넬의 구동방법은 상기 제 1 유지전극에 0V에서 V로 V에서 0V으로 변환하는 펄스를 인가하고, 상기 제 2 유지전극에 V에서 0V로, 0V에서 V로 변화하는 펄스를 인가하고, 상기, 제1, 2유지전극의 0V을 나타내는 기간에는 상기 음극에 스캔을 위한 네거티브 스캔 펄스가 인가되고 상기 양극에 데이타의 기입을 위한 포지티브 기입 펄스가 인가될 때에 데이타가 기입이되고, 소정 기간 경과후에 상기 제1, 2유지전극이 0V을 나타내는 시점에서 상기 음극에 네거티브 펄스를 인가하여 상기 기입된 데이타를 소거하는 것을 특징으로 한다.
첨부된 도면을 참고로하여 본 발명에 따른 플라즈마 디스플레이 판넬의 구조 및 구동방법을 설명하면 다음과 같다.
제 1 도는 본 발명에 따른 플라즈마 디스플레이 판넬의 구동을 설명하기 위한 구동회로를 나타내는 것이다.
제 1 도에 있어서, 양극(1), 상기 양극(1)과 직교하는 음극(2), 상기 음극(2)과 나란하게 놓여진 제 1 유지전극(3), 제 2 유지전극(4)로 이루어진 플라즈마 디스플레이 판넬(5), 상기 플라즈마 디스플레이 판넬(5)의 양극(1)을 구동하기 위한 양극구동회로(6), 상기 양극구동회로(6)의 출력신호를 각각 입력하는 베이스들과 상기 양극(1)에 각각 연결된 에미터들과 소정전압원에 공통 연결된 콜렉터들을 가진 스위칭 트랜지스터들(7), 상기 음극(2)을 구동하기 위한 음극구동회로(8), 상기 음극구동회로(8)의 출력신호를 각각 입력하는 베이스들과 소정전압원에 연결된 에미터들과 상기 음극(2)에 각각 연결된 콜렉터들을 가진 스위칭 트랜지스터들(9) 및 상기 제 1 유지전극 및 제 2 유지전극에 소정펄스를 인가하기 위한 유지펄스 인가회로(10)으로 구성되어 있다. 상기 구성에서 알수있듯이, 유지펄스가 인가되는 유지전극이 양극 및 음극과 완전히 분리 되어있다.
제 2 도는 본 발명에 플라즈마 디스플레이따른 플라즈마 디스플레이 판넬의 일 실시예의 구조를 나타내는 것이다.
제2a도에 있어서, 상판 전면 유리(11)에 양극(12) 및 형광막(18)을 형성하고, 하판 후면 유리(13)에 제 1 유지전극(14)을 형성하고 그 위에 유전체(15)를 도포하고 상기 유전체(15)위에 음극(16)를 형성하고 상기 음극(16)와 교대로 나란히 제 1 유지전극(17)을 형성하고 상기 제 2 유지전극(17) 및 상기 음극(16)위에 유전체(15)를 도포하였다. 여기에서, 상기 제 2 유지전극(17)이 제 1 유지전극(14)와 동일 평면상에 배치되어고 무방하다. 그리고 격벽은 상판과 하판중에 어느쪽에 형성되어도 상관없다.
제2b도는 상기 제2a도에 나타낸 구조의 전극배치를 나타낸 것이다.
제2b도에 있어서, 제 1 유지전극(14)위에 음극(16)과 제 2 유지전극(17)이 교대로 나란하게 배치되어 있고, 그 위에 양극(12)가 놓여져 있다.
제 3 도는 본 발명에 따른 플라즈마 디스플레이 판넬의 다른 실시예의 구조를 나타내는 것이다.
제3a도에 있어서, 상판 전면 유리(20)에 양극(21)을 형성하고, 하판 후면 유리(22)에 음극(23) 및 음극(23)과 교대로 나란하게 제 2 유지전극(24)을 형성하고 상기 음극(23) 및 제 2 유지전극(24)위에 제 1 유지전극(25) 및 격벽(26)을 형성하여 구성되어 있다.
제3b도는 제3a도에 나타낸 구조의 전극 배치를 나타내는 것이다.
제3b도에 있어서, 음극(K)가 놓여지고, 그 위에 제 1 유지전극(S1)과 제 2 유지전극(S2)가 교대로 나란하게 배열되고, 그 위에 양극(D)가 상기 음극(K)와 교차되게 놓여져 있다. 상기 제 1 유지전극(S2)의 거리(d2)보다 훨씬 가깝다. 그래서, 상기 제 1 유지전극(S1)과 상기 음극(K)사이에 형성되는 캐패시터를 크게 커플링이 원활하게 하기 위한 것이다.
여기에서, 상기 플라즈마 디스플레이 판넬의 구조는 음극과 양극이 나란하게 놓여져있고, 제1, 2유지전극의 형태가 가로 또는 세로로 나란하게 놓여지거나, 교차로 놓여지거나, 제 1 유지전극은 전면에 형성되고 제 2 유지전극은 가로 또는 세로 방향으로 하나 놓여질 수도 있다.
제4a도는 본 발명에 따른 플라즈마 디스플레이 판넬의 일실시예의 구동방법을 나타내는 것이다.
제4a도에 있어서, 제 1 유지전극에 인가되는 펄스는 0V에서 V로, V에서 0V으로 변화하는 펄스이고, 제 2 유지전극에 인가되는 펄스는 V에서 0V으로, OV으로 V로 변화하는 펄스이고, 상기 유지전극들의 진폭은 V이고, 주기는 Ts이다.
제4b도에 있어서, 제 1 유지전극에 인가되는 펄스는 -1/2V에서 0으로, 0에서 1/2V로, 1/2V에서 0으로, 0에서 -1/2V로 변화하는 펄스이고, 제 2 유지전극에 인가되는 펄스는 1/2V에서 0으로, 0에서 1/2V로 변환하는 펄스이고, 상기 유지펄스들의 진폭은 V이고, 주기는 Ts이다.
제4c도에 있어서, 제 1 유지전극에 인가되는 펄스는 0이고, 제 2 유지전극에 인가되는 펄스는 -V에서 0로, 0에서 V로, V에서 0으로, 0에서 -V로 변환하는 펄스이고, 상기 유지펄스들의 진폭은 V이고, 주기는 Ts이다.
기입이 일어나는 타이밍은 상기 유지펄스들의 전위가 0을 나타내는 기간이다. 그리고, 기입 후에 소거가 일어나는 타이밍은 메모리 방식의 그레이 스케일에 의해 결정되는 타이밍에서 일어난다.
제5a도 -제5e도는 상기 설명한 구조와 구동방법에 의거하여 동작을 설명하기 위한 구조도를 나타내는 것이다.
제5a도는 기입동작을 설명하기 위한 것이다. 기입이 일어나는 것은 음극에 네거티브 펄스가 인가되고, 양극에 포지티브 펄스가 인가될 때(즉, 제4d도의 기간 A에 해당한다.)에 상기 음극과 양극의 전위차가 방전개시전압을 초과하여 방전이 개시된다. 즉, 방전에서 생성된 +전하가 음극 위의 유전체 표면에 쌓이게 된다.
제5b도 벽전압이 상승되는 것을 나타내는 것이다. +전하의 축적에 의해 형성된 벽전압(wall voltage)은 주사가 끝난 후(즉, 제4d도의 기간 B에 해당한다.)에 주사전극은 플로팅(floating)되고 유지전극(S1)의 전위가 상승되므로 유전체층의 전위는 유지전압에 벽전압이 더해져 더욱 증가하게 된다. 즉, 캐패시터에 전하를 축적하고 플로팅시켜 한쪽단에 100V를 가한다면 다른쪽의 전위는 100V+캐패시터 충전 전압으로 상승하게 된다.
제5c도는 방전 유지를 설명하기 위한 것이다. 유지전극(S1)에 포지티브전압이 걸리고, 유지전극(S2)에 네거티브전압이 걸리면(즉, 제4d도의 기간 C에 해당한다.)음극 위의 유전체 위에 쌓여있던 +전하가 유지전극(S2)위의 유전체로 옮겨가고, 유지전극(S1)상의 유전체 위에 전자가 쌓이게 된다.
제5d도는 유지방전에 관하여 설명하기 위한 것이다. 유지전극(S1)에 네거티브전압이 걸리고, 유지전극(S2)위에 포지티브전압이 걸리면(즉, 제4d도의 기간 D에 해당한다.)유지전극(S2)상의 유전체 위에 전자가 쌓이고, 유지전극(S1)상의 유전체 위에 +전하가 쌓이게된다.
제5e도는 소거동작에 관하여 설명하기 위한 것이다. 소거는 음극에 짧은 시간 네거티브펄스를 가함으로써 음극과 유지전극(S2)사이에 짧은 방전이 일어나서 벽전하는 소멸하게된다.(즉, 제4d도의 기간 E에 해당한다.)
따라서, 본 발명의 플라즈마 디스플레이 판넬의 구조의 구동방법을 사용하면 유지를 위한 유지전극이 다른 전극과 완전히 분리됨으로써 안정한 메모리 동작을 실현할 수가 있다.

Claims (9)

  1. 상판 및 하판; 상기 상판에 소정간격으로 형성된 복수개의 양극들; 상기 하판에 상기복수개의 양극들과 직교하는 방향으로 소정간격으로 형성된 복수개의 제 1 유지전극들; 상기 제 1 유지전극들위에 형성된 제1절연층; 상기 제 1 절연층위에 상기 제 1 유지전극과 동일한 위치에 동일한 방향으로 형성된 복수개의 음극들; 상기 제 1 절연층위에 상기 복수개의 음극들사이에 소정 간격으로 형성된 복수개의 제 2 유지전극들; 상기 복수개의 제 2 유지전극들위에 형성된 제 2 절연층을 구비한 것을 특징으로 하는 플라즈마 디스플레이 판넬.
  2. 제 1 항에 있어서, 상기 복수개의 제 1 유지전극들은 상기 복수개의 음극들과 동일한 방향으로 나란하게 배열되고, 상기 복수개의 제 2 유지전극들은 상기 복수개의 양극들과 나란하게 배치된 것을 특징으로 하는 플라즈마 디스플레이 판넬.
  3. 제 1 항에 있어서, 상기 복수개의 제 1 유지전극들은 전면으로 형성되고, 상기 복수개의 제 2 유지전극들은 상기 복수개의 양극들과 나란하게 배열되는 것을 특징으로 하는 플라즈마 디스플레이 판넬.
  4. 제 1 항에 있어서, 상기 복수개의 제 1 유지전극들은 전면으로 형성되고, 상기 복수개의 제 2 유지전극들은 상기 복수개의 음극들과 나란하게 배열되는 것을 특징으로 하는 플라즈마 디스플레이 판넬.
  5. 제 1 항, 또는 제 8 항에 있어서, 상기 복수개의 제 1 유지전극들이 하나의 공통단자에 연결되어 있는 것을 특징으로 하는 플라즈마 디스플레이 판넬.
  6. 제1, 8, 9항 또는 제 10 항에 있어서, 상기 복수개의 제 2 유지전극들이 하나의 공통단자에 연결되어 것을 특징으로 하는 플라즈마 디스플레이 판넬.
  7. 제 1 항에 기재된 플라즈마 디스플레이 판넬의 구동하기 위한 구동방법에 있어서, 상기 제 1 유지전극에 0V에서 V로, V에서 0V로 변환하는 펄스를 인가하고, 상기 제 2 유지전극에 V에서 0V로, 0V에서 V로 변화하는 펄스를 인가하고, 상기 제 2 유지전극에 V에서 0V로, 0V에서 V로 변화하는 펄스를 인가하고, 상기 제 2 유지전극에 V에서 0V로, 0V에서 V로 변화하는 펄스를 인가하고 상기 제1, 2유지전극이 0V로 나타낼 때, 상기 음극에 네거티브 펄스를 인가하고 상기 양극에 포지티브 펄스를 인가하여 데이타를 기입하고 소정기간 경과 후에 상기 음극에 네거키브 펄스를 인가하여 상기 기입된 데이타를 소거하는 것을 특징으로 하는 플라즈마 디스플레이 판넬의 구동방법.
  8. 제 1 항에 기재된 플라즈마 디스플레이 판넬을 구동하기 위한 구동방법에 있어서, 상기 제 1 유지전극에 0V에서 -1/2V 로, -1/2V에서 0V로, 0V에서 1/2V로, 1/2V에서 0V로 변화하는 펄스를 인가하고, 상기 제 2 유지전극에 V에서 1/2V로, 1/2V에서 0V로, 0V에서 -1/2V로, -1/2에서 0V로 변화하는 펄스를 인가하고, 상기 제1, 2유지전극이 0V를 나타낼 때, 상기 음극에 네거티브 펄스를 인가하고 상기 양극에 포지티브 펄스를 인가하여 데이타를 기입하고, 소정시간 경과후에 상기 제1, 2유지전극이 0V를 나타낼 때, 상기 음극에 네거티브 펄스를 인가하여 상히 기입된 데이타를 소거하는 것을 특징으로 하는 플라즈마 디스플레이 판넬의 구동방법.
  9. 제 1 항에 기재된 플라즈마 디스플레이 판넬의 구동하기 위한 구동방법에 있어서, 상기 제 1 유지전극에 0V를 인가하고, 상기 제 2 유지전극에 0V에서 -V로, -V에서 0V로, -V에서 0V로, 0V에서 V로,V에서 0V로 변화하는 펄스를 인가하고, 상기 제1, 2유지전극이 0V를 나타낼 때, 상기 음극에 네거티브 펄스를 인가하고 상기 양극에 포지티브 펄스를 인가하여 데이타를 기입하고, 소정시간 경과 후에 상기 제1, 2유지전극이 0V를 나타낼 때 상기 음극에 네거티브 펄스를 인가하여 상기 기입된 데이타를 소거하는 것을 특징으로 하는 플라즈마 디스플레이 판넬의 구동방법.
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