KR900006830Y1 - Dtmf송수신기의 스트로브신호 발생회로 - Google Patents

Abstract

내용 없음.

Description

DTMF송수신기의 스트로브신호 발생회로

제1도는 DTMF송수신기의 블럭도.

제2도는 CPU와 DTMF송수신기의 인터페이스 회로도.

제3도는 본발명을 따른 스트로브 발생회로도.

제4도는 DTMF송수신기의 타이밍도.

제5도는 제3도의 동작 타이밍도.

* 도면의 주요부분에 대한 부호의 설명

10 : CPU 20 : DTMF송수신기

40 : 스트로브 발생기 30 : 디코더

41-43 : 인버터 44-45 : 게이트

46-47 : 플립플롭 48 : 버퍼

본 고안은 DTMF송수신기에 관한 것으로, 특히 DTMF송수신기의 스트로브 신호 발생회로에 관한 것이다.

DTMF송수신기(DTMF Transceiver)는 제1도에 도시한 바와 같이 구성되어 있으며, 4비트의 디지트 신호를 입력하여 16가지의 톤 신호를 발생하며 역으로 16가지의 톤신호를 입력하여 4비트의 디지트 신호를 발생한다.

제4도는 DTMF송수신기와 CPU의 인터페이싱 타이밍도로서, 제4도(a)는 시스템 클럭인 φ2 펄스파형도이고, 제4(b)는 CPU의 리드싸이클(ready cycle)이며, 제4도(b)는 CPU의 라이트 싸이클이며 그 특성은 하기 <표1>과 같다.

[표1]

상기 DTMF송수신기는 CPU에서 인가하는 제4도의 (a)와 같은 φ2신호에 의해 제4도(b)와 (c)같이 데이타를 리드/라이트 하는데 종래에는 DTMF송수신기의 스트로브 신호를 발생할시에 클럭을 분주하여 사용하였는데 리드싸이클의 경우 동기가 맞지않는 경우가 발생했었으며 CPU와 DTMF송수신기 사이의 인터페이싱 회로는 모터롤라 프로세서(MOTOROLA Processor)에만 제시되어 있어 타기종 프로세서와는 인터페이싱 할수 없는 문제점이 있었다.

따라서 본고안의 목적은 프로세서를 사용하는 시스템에서 DTMF송수신기를 사용할시 스트로브신호와 리드/라이트의 타이밍을 해결할수 있는 회로를 제공함에 있다.

이하 본고안을 도면을 참조하여 상세히 설명한다.

제2도는 프로세서와 DTMF송수신기의 인터페이스 회로로써 CPU(10)와, 상기 CPU(10)의 디지트를 받아 해당 톤을 발생하거나 톤을 수신하여 CPU(10)로 해당 디지트를 송출하는 DTMF송수신기(20)와, 상기 CPU(10)의 어드레스를 디코딩하여 소정 어드레스일시 상기 DTMF송수신기(20)를 인에이블 시키는 디코더(30)와, 상기 CPU(10)의 리드/라이트, 클럭 및 S2신호를 논리조합하여 스트로브신호(φ2)를 발생한 스트로브발생기(40)로 구성하며 제3도는 제4도중 스트로브발생기(40)의 구체회로도로서 인버터(41-43), 게이트(44-45), 플립플롭(46-47)과 버퍼(48)로 구성되어 있으며, 제5도는 CPU(10)의 제어신호에 따른 스트로브발생기(40)의 출력파형도를 나타내고 있다.

상술한 구성에 의거 본고안을 제2,3,5도를 참조하여 상세히 설명한다.

CPU(10)와 DTMF송수신기(20)의 인터페이스를 나타내는 제2도에서 DTMF송수신기(20)의 칩선택(Chip Select)는 어드레스를 디코딩하여 특정 어드레스를 억세스 할경우에만 인에이블 되도록 한다.

즉 CPU(10)에서 발생하는 어드레스(A4-A15)를 디코딩하는 디코더(30)의 출력에 따라 해당 어드레스가 특정 어드레스일시 DTMF송수신기(20)는 인에이블된다.

또한 CPU(10)의 어드레스(A3)는 DTMF송수신기(20)의 RSφ단자(Regester Select Input)에 연결하여 커맨드레지스터(command register)와 데이타레지스터(data register)를 구분하도록 하며 전술한 바와같이 DTMF톤데이타는 4비트(D0-D3)로 16가지 톤을 발생할수 있다.

DTMF송수신기(20)의 R/단자에는 CPU(10)의단자를 연결하여 사용하며 φ2단자는 스트로브신호를 본고안인 스트로브발생기(40)를 통하여 받는다.

스트로브발생기(40)는 제2도에서와 같이 CPU(10)로 부터 4가지 제어신호(,,CLKout, S2)신호를 받아 스트로브신호(φ2)를 발생한다.

제5도(a)는 CPU(10)에서 출력하는 클럭신호, S2신호, 리드신호와 라이트신호를 나타내고 있으며 이 4가지 신호를 가지고 제2도의 타이밍도에서 요구하는 DTMF송수신기(20)의 스트로브신호(φ2)를 발생한다.

제3도에서 인버터(43)와 게이트(44)의 출력을 반전하여 부논리곱하는 게이트(45)는 리드나 라이트를 하지않을 경우 로우 상태의 신호를 입력하므로 제2 플립플롭(47)을 리세트 상태로 만듬으로서 φ2신호를 로우상태를 유지한다.

먼저 제5도(b)를 참조하여 라이트싸이클(write cycle)을 설명한다.

제5도 (a)와 (b)와 같은 S2신호를 인버터(42)를 통해 반전시켜 플립플롭(46)의 세트()단에 인가하고, 제5도(a)의 (d)와 같은 라이트 신호()를 입력단자에 인가하며 제5도(a)의 (a)와 같은 클럭을 인버터(41)를 통해 반전시켜 제1플립플롭(46)의 클럭단에 인가한다.

여기서 S2는 라이트싸이클에서 거드타임(guard time)을 위해 사용한다.

이때 라이트 신호()는 인버터(41)를 통한 반전클럭에 의해 제1플립플롭(46)을 지나면 한클럭정도의 지연이 생기며 플립플롭(46)의 출력 및 라이트신호()를 반전시켜 입력하는 게이트(44)는 두입력을 논리곱하여 제5도 (b)의 (b)와 같이 출력한다.

이때신호를 1클럭정도 지연시키는 이유는 제4도에 표시한 바와같은 tRWS(φ2 발생이전에서 R/세트업시간)을 충분히 만족시키기 위함이다. 라이트신호 발생시 리드신호는 액티브상태가 아니므로 "하이"신호를 출력하며 인버터(43)를 통해 제5도 (b)의 (a)와 같이 "로우"신호를 출력하고 있으므로, 이 두신호를 반전하여 부논리곱하는 게이트(45)의 출력은 게이트(44)의 출력과 동일하므로 제5도 (b)의 (b)와같은 주기동안 제2플립플롭(47)의 리세트를 해제시킨다.

따라서 제2플립플롭(47)은 제5도 (a)의 (a)와같은 클럭에 의해 제5도 (b)의 (c)와같은 스트로브신호(φ2)를 발생하여 버퍼(48)를 통해 DTMF송수신기(20)의 φ2단에 인가한다.

다음으로 제5도 (c)를 참조하여 리드싸이클(read cycle)을 설명한다.

리드신호가 액티브 상태일시 라이트신호는 액티브상태가 될 수 없으므로 "하이"상태의 신호이며 이 신호에 의해 게이트(44)는 제5도 (c)의 (b)와 같이 "로우"상태를 유지하고 있다.

이때 인버터(43)를 통한 리드신호가 제5도(c)의 (a)와 같은 "하이"상태 이므로 게이트(45)는 인버터(43)의 출력과 동일한 주기동안 "하이"신호를 출력하여 제2플립플롭(47)의 리세트를 해제한다.

따라서 상기 제2플립플롭(47)은 제5도 (c)의 (c)와 같은 스트로브신호(φ2)를 버퍼(48)를 통해 DTMF송수신기(20)의 φ2단으로 송출한다.

DTMF송수신기(20)는 제4도의 리드싸이클에서와 같이 스트로브신호(φ2)의 폴링에지(falling edge)로 부터 20nSec까지만 유효데이타(Valid Data)가 출력되므로 CPU(10)의 리드신호(Signal)이 스트로브신호(φ2)의 포링에지와 동시에 인엑티브(inactive)되거나 그 전에 인엑티브 상태로 되어야 한다.

제3도에서는 게이트지연(gate delay)를 고려하면 스트로브신호(φ2)의 폴링에지 이전에 CPU(10)의 리드()가 인엑티브 상태로 된다.

상술한 바와같이 DTMF송수신기의 스트로브신호와 CPU의 리드, 라이트 타이밍을 정확히 동기시킬 수 있는 이점이 있다.

Claims (1)

1. CPU(10)와 인터페이싱하여 DTMF톤을 발생하거나 DTMF톤을 디지트데이타로 변환하여 CPU(10)로 출력하는 DTMF송수신기(20)의 스트로브 발생회로에 있어서, 리드사이클시 리드신호()의 상태를 반전하는 인버터(43)를 통해 리드신호 발생유무를 판단하는 제1수단과, 라이트싸이클시 라이트싸이클의 주기를 결정하기 위해 S2신호를 반전하는 인버터(42) 출력을 제1플립플롭(46)의 세트단()에 인가하고 클럭을 인버터(41)를 통해 상기 제1플립플롭(46)의 클럭단(CK)에 반전 인가하며 라이트신호()를 상기 제1플립플롭(46)의 데이타 입력단(D)에 인가하여 라이트신호를 1클럭지연시켜 세트업 시간을 만족시킨후 라이트신호()와 상기 제1플립플롭(46)의 출력을 반전입력하여 논리곱하는 게이트(44)를 통해 라이트신호의 발생유무를 판단하는 제2수단과, 상기 제1수단 및 제2수단의 출력을 반전입력하여 부논리곱하는 게이트(46)의 출력을 제2플립플롭(47)의 리세트단()에 인가하여 리드 또는 라이트신호 발생시 리세트를 해제하며 클럭에 의해 해당 리세트 해제 주기동안 리드 또는 라이트스토로브(φ2)를 발생하는 제3수단으로 이루어짐을 특징으로 하는 DTMF송수신기의 스트로브 신호 발생회로.