KR102008996B1 - Ｓｐｉ 수신 버퍼의 스턱비트 에러발생 판별방법 - Google Patents

Abstract

본 발명의 SPI 수신 버퍼의 스턱비트 에러발생 판별방법은, 제2 수신 데이터 패턴값이 제1 송신 데이터 패턴값과 동일한지를 판단하는 단계; 제2 수신 데이터 패턴값이 제1 송신 데이터 패턴값과 동일하지 않은 경우, SPI 버스라인에 에러가 발생한 것을 인식하는 단계; 제2 수신 데이터 패턴값이 제1 송신 데이터 패턴값과 동일한 경우, 제1 수신 데이터 패턴값이 초기화된 레지스터 값인지를 판단하는 단계; 제1 수신 데이터 패턴값이 초기화된 레지스터 값이 아닌 경우, SPI 수신 버퍼에 초기화 에러가 발생한 것을 인식하는 단계; 제1 수신 데이터 패턴값이 초기화된 레지스터 값인 경우, 제3 수신 데이터 패턴값이 제2 송신 데이터 패턴값과 동일한지를 판단하는 단계; 제3 수신 데이터 패턴값이 제2 송신 데이터 패턴값과 동일하지 않은 경우, SPI 수신 버퍼에 스턱비트 에러가 발생한 것을 인식하는 단계; 제3 수신 데이터 패턴값이 제2 송신 데이터 패턴값과 동일한 경우, 제4 수신 데이터 패턴값이 제3 송신 데이터 패턴값과 동일한지를 판단하는 단계; 및 제4 수신 데이터 패턴값이 제3 송신 데이터 패턴값과 동일하지 경우, SPI 수신 버퍼에 스턱비트 에러가 발생한 것을 인식하는 단계를 포함한다.

Description

ＳＰＩ 수신 버퍼의 스턱비트 에러발생 판별방법{SYSTEM AND METHOD FOR STUCK BIT ERROR OCCURRENCE DISTINCTION OR SERIAL PERIPHERAL INTERCONNECT RECEIVER BUFFER}

본 발명은 SPI 수신 버퍼의 스턱비트 에러발생 판별방법에 관한 것으로, 더욱 상세하게는 SPI 통신을 사용하는 마이크로 컨트롤러에서 수신 버퍼의 스턱비트 에러발생 판별방법에 관한 것이다.

종래에는 마이크로 컨트롤러에서 데이터를 송신할 때 PCB 패턴 체크를 위해 지정된 패턴 하나만을 송수신하도록 되어 있었다. 이 방식은 PCB 패턴에 이상이 없고 노이즈 등으로 인한 신호왜곡이 없는 경우에 송신 데이터 패턴값이 수신 버퍼에 동일하게 수신되는 것을 원리로 하여 PCB 패턴의 이상 유무를 확인하였다.

그러나, SPI 수신 버퍼에 스턱 비트가 생겨 특정 비트가 변경되지 않는 경우가 발생하는데, 변경되지 않는 데이터 패턴값이 송신 데이터 패턴값과 일치하는 경우에는 비정상적인 상태를 감지하는 것이 불가능하게 된다.

도 1은 종래의 송수신 데이터 패턴값을 나타낸 개략도이다. 도 1을 참조하면, 수신 버퍼의 4번째 비트가 1로 스턱된 경우에 송신 데이터 패턴값인 0xAAAA와 동일한 패턴값이 되어 에러 여부를 판별할 수 없고, 송신 데이터 패턴값이 수신되었을 경우 이를 판별할 수 없으므로 시스템이 정상적으로 동작할 수 없게 된다.

본 발명은 이와 같은 문제점을 해결하기 위해 창출된 것으로, 본 발명의 목적은 SPI 버스라인 상의 PCB 패턴 이상 여부를 체크함과 동시에 SPI 수신 버퍼에 스턱비트가 발생하였는지 판별할 수 있는 SPI 수신 버퍼의 스턱비트 에러발생 판별방법을 제공함에 있다.

상기 목적을 달성하기 위한 본 발명의 관점에 따른 SPI 수신 버퍼의 스턱비트 에러발생 판별방법은, 패턴값 판단부에서 제2 수신 데이터 패턴값이 제1 송신 데이터 패턴값과 동일한지를 판단하는 단계; 상기 제2 수신 데이터 패턴값이 상기 제1 송신 데이터 패턴값과 동일하지 않은 경우, 버스라인 에러발생 인식부에서 SPI(Serial Peripheral Interconnect) 버스라인(bus line)에 에러가 발생한 것을 인식하는 단계; 상기 제2 수신 데이터 패턴값이 상기 제1 송신 데이터 패턴값과 동일한 경우, 상기 패턴값 판단부에서 제1 수신 데이터 패턴값이 초기화된 레지스터 값인지를 판단하는 단계; 상기 제1 수신 데이터 패턴값이 상기 초기화된 레지스터 값이 아닌 경우, 초기화 에러발생 인식부에서 상기 SPI 수신 버퍼에 초기화 에러가 발생한 것을 인식하는 단계; 상기 제1 수신 데이터 패턴값이 상기 초기화된 레지스터 값인 경우, 상기 패턴값 판단부에서 제3 수신 데이터 패턴값이 제2 송신 데이터 패턴값과 동일한지를 판단하는 단계; 상기 제3 수신 데이터 패턴값이 상기 제2 송신 데이터 패턴값과 동일하지 않은 경우, 스턱비트 에러발생 인식부에서 상기 SPI 수신 버퍼에 스턱비트 에러(stuck bit error)가 발생한 것을 인식하는 단계; 상기 제3 수신 데이터 패턴값이 제2 송신 데이터 패턴값과 동일한 경우, 상기 패턴값 판단부에서 상기 제4 수신 데이터 패턴값이 제3 송신 데이터 패턴값과 동일한지를 판단하는 단계; 및 상기 제4 수신 데이터 패턴값이 상기 제3 송신 데이터 패턴값과 동일하지 경우, 상기 스턱비트 에러발생 인식부에서 상기 SPI 수신 버퍼에 스턱비트 에러가 발생한 것을 인식하는 단계;를 포함하는 것을 특징으로 한다.

한편, 본 발명의 바람직한 실시 예에 따르면, 패턴값 판단부에서 제2 수신 데이터 패턴값이 제1 송신 데이터 패턴값과 동일한지를 판단하는 단계; 상기 제2 수신 데이터 패턴값이 상기 제1 송신 데이터 패턴값과 동일하지 않은 경우, 버스라인 에러발생 인식부에서 SPI(Serial Peripheral Interconnect) 버스라인(bus line)에 에러가 발생한 것을 인식하는 단계; 상기 제2 수신 데이터 패턴값이 상기 제1 송신 데이터 패턴값과 동일한 경우, 명령응답 인식부에서 제1 수신 데이터 패턴값이 무효한 명령에 대한 응답인지를 판단하는 단계; 상기 제1 수신 데이터 패턴값이 상기 무효한 명령에 대한 응답이 아닌 경우, 동작에러 인식부에서 SPI 수신 버퍼의 동작이 에러인 것을 인식하는 단계; 상기 제1 수신 데이터 패턴값이 상기 무효한 명령에 대한 응답인 경우, 상기 패턴값 판단부에서 제3 수신 데이터 패턴값이 제2 송신 데이터 패턴값과 동일한지를 판단하는 단계; 상기 제3 수신 데이터 패턴값이 상기 제2 송신 데이터 패턴값과 동일하지 않은 경우, 스턱비트 에러발생 인식부에서 상기 SPI 수신 버퍼에 스턱비트 에러(stuck bit error)가 발생한 것을 인식하는 단계; 상기 제3 수신 데이터 패턴값이 제2 송신 데이터 패턴값과 동일한 경우, 상기 패턴값 판단부에서 상기 제4 수신 데이터 패턴값이 제3 송신 데이터 패턴값과 동일한지를 판단하는 단계; 및 상기 제4 수신 데이터 패턴값이 상기 제3 송신 데이터 패턴값과 동일하지 경우, 상기 스턱비트 에러발생 인식부에서 상기 SPI 수신 버퍼에 스턱비트 에러가 발생한 것을 인식하는 단계;를 포함하는 것을 특징으로 한다.

본 발명에서 제시하는 ＳＰＩ 수신 버퍼의 스턱비트 에러발생 판별방법은, SPI 버스라인 상의 PCB 패턴 이상 여부를 체크함과 동시에 SPI 수신 버퍼에 스턱비트가 발생하였는지 판별하기 때문에, 안정적인 통신 환경을 구현할 수 있는 효과를 갖는다.

도 1은 종래의 송수신 데이터 패턴값을 나타낸 개략도이다.
도 2는 본 발명의 일 실시예에 따른 SPI 수신 버퍼의 스턱비트 에러발생 판별시스템의 구성도이다.
도 3은 본 발명의 일 실시예에 따른 첫 번째 통신을 개시하는 경우 SPI 수신 버퍼의 스턱비트 에러발생 판별방법의 흐름도이다.
도 4는 본 발명의 일 실시예에 따른 첫 번째 통신 이후의 경우 SPI 수신 버퍼의 스턱비트 에러발생 판별방법의 흐름도이다.
도 5는 본 발명의 일 실시예에 따른 송수신 데이터 패턴값을 나타낸 개략도이다.

이하, 첨부된 도면을 참조하여 본 발명의 실시형태를 설명한다. 그러나, 본 발명의 실시형태는 여러 가지의 다른 형태로 변형될 수 있으며, 본 발명의 범위가 이하 설명하는 실시형태로만 한정되는 것은 아니다. 도면에서의 요소들의 형상 및 크기 등은 보다 명확한 설명을 위해 과장될 수 있으며, 도면상의 동일한 부호로 표시되는 요소는 동일한 요소이다.

도 2는 본 발명의 일 실시예에 따른 SPI 수신 버퍼의 스턱비트 에러발생 판별시스템의 구성도이다. 도 2를 참조하면, 본 발명의 일 실시예에 따른 SPI 수신 버퍼의 스턱비트 에러발생 판별시스템은, 패턴값 판단부(100), 버스라인 에러발생 인식부(200), 초기화 에러발생 인식부(300), 및 스턱비트 에러발생 인식부(400), 명령응답 인식부(500), 및 동작에러 인식부(600)를 포함한다.

먼저, 첫 번째 통신을 개시하는 경우 및 첫 번째 통신 이후의 경우에 모두 적용되는 SPI 수신 버퍼의 스턱비트 에러발생 판별시스템의 구성은 다음과 같다.

패턴값 판단부(100)는 제2 수신 데이터 패턴값이 제1 송신 데이터 패턴값과 동일한지를 판단한다. 또한, 패턴값 판단부(100)는 제3 수신 데이터 패턴값이 제2 송신 데이터 패턴값과 동일한 경우, 제4 수신 데이터 패턴값이 제3 송신 데이터 패턴값과 동일한지를 판단한다.

버스라인 에러발생 인식부(200)는 제2 수신 데이터 패턴값이 제1 송신 데이터 패턴값과 동일하지 않은 경우, SPI(Serial Peripheral Interconnect) 버스라인(bus line)에 에러가 발생한 것을 인식한다.

스턱비트 에러발생 인식부(400)는 제3 수신 데이터 패턴값이 제2 송신 데이터 패턴값과 동일하지 않은 경우, SPI 수신 버퍼에 스턱비트 에러(stuck bit error)가 발생한 것을 인식한다. 그리고, 스턱비트 에러발생 인식부(400)는 제4 수신 데이터 패턴값이 제3 송신 데이터 패턴값과 동일하지 경우, SPI 수신 버퍼에 스턱비트 에러가 발생한 것을 인식한다.

한편, 첫 번째 통신을 개시하는 경우에만 적용되는 SPI 수신 버퍼의 스턱비트 에러발생 판별시스템의 구성은 다음과 같다.

초기화 에러발생 인식부(300)는 제1 수신 데이터 패턴값이 초기화된 레지스터 값이 아닌 경우, SPI 수신 버퍼에 초기화 에러가 발생한 것을 인식한다.

패턴값 판단부(100)는 제2 수신 데이터 패턴값이 제1 송신 데이터 패턴값과 동일한 경우, 제1 수신 데이터 패턴값이 초기화된 레지스터 값인지를 판단한다. 또한, 패턴값 판단부(100)는 제1 수신 데이터 패턴값이 초기화된 레지스터 값인 경우, 제3 수신 데이터 패턴값이 제2 송신 데이터 패턴값과 동일한지를 판단한다.

또 한편, 첫 번째 통신 이후의 경우에 모두 적용되는 SPI 수신 버퍼의 스턱비트 에러발생 판별시스템의 구성은 다음과 같다.

명령응답 인식부(500)는 제2 수신 데이터 패턴값이 제1 송신 데이터 패턴값과 동일한 경우, 제1 수신 데이터 패턴값이 무효한 명령에 대한 응답인지를 판단한다.

동작에러 인식부(600)는 제1 수신 데이터 패턴값이 무효한 명령에 대한 응답이 아닌 경우, SPI 수신 버퍼의 동작이 에러인 것을 인식한다.

패턴값 판단부(100)는 제1 수신 데이터 패턴값이 무효한 명령에 대한 응답인 경우, 제3 수신 데이터 패턴값이 제2 송신 데이터 패턴값과 동일한지를 판단한다.

도 3은 본 발명의 일 실시예에 따른 첫 번째 통신을 개시하는 경우 SPI 수신 버퍼의 스턱비트 에러발생 판별방법의 흐름도이다. 도 2 및 도 3을 참조하면, 본 발명의 일 실시예에 따른 첫 번째 통신을 개시하는 경우 SPI 수신 버퍼의 스턱비트 에러발생 판별방법은 다음과 같다.

먼저, 패턴값 판단부(100)에서 제2 수신 데이터 패턴값이 제1 송신 데이터 패턴값과 동일한지를 판단한다(S110).

S110 단계 이후, 제2 수신 데이터 패턴값이 제1 송신 데이터 패턴값과 동일하지 않은 경우, 버스라인 에러발생 인식부(200)에서 SPI(Serial Peripheral Interconnect) 버스라인(bus line)에 에러가 발생한 것을 인식한다(S120).

그러나, S110 단계 이후, 제2 수신 데이터 패턴값이 제1 송신 데이터 패턴값과 동일한 경우, 패턴값 판단부(100)에서 제1 수신 데이터 패턴값이 초기화된 레지스터 값인지를 판단한다(S130).

S130 단계 이후, 제1 수신 데이터 패턴값이 초기화된 레지스터 값이 아닌 경우, 초기화 에러발생 인식부(300)에서 SPI 수신 버퍼에 초기화 에러가 발생한 것을 인식한다(S140).

그러나, S130 단계 이후, 제1 수신 데이터 패턴값이 초기화된 레지스터 값인 경우, 패턴값 판단부(100)에서 제3 수신 데이터 패턴값이 제2 송신 데이터 패턴값과 동일한지를 판단한다(S150).

S150 단계 이후, 제3 수신 데이터 패턴값이 제2 송신 데이터 패턴값과 동일하지 않은 경우, 스턱비트 에러발생 인식부(400)에서 SPI 수신 버퍼에 스턱비트 에러(stuck bit error)가 발생한 것을 인식한다(S160).

그러나, S150 단계 이후, 제3 수신 데이터 패턴값이 제2 송신 데이터 패턴값과 동일한 경우, 패턴값 판단부(100)에서 제4 수신 데이터 패턴값이 제3 송신 데이터 패턴값과 동일한지를 판단한다(S170).

S170 단계 이후, 제4 수신 데이터 패턴값이 제3 송신 데이터 패턴값과 동일하지 경우, 스턱비트 에러발생 인식부(400)에서 SPI 수신 버퍼에 스턱비트 에러가 발생한 것을 인식한다(S180).

도 4는 본 발명의 일 실시예에 따른 첫 번째 통신 이후의 경우 SPI 수신 버퍼의 스턱비트 에러발생 판별방법의 흐름도이다. 도 2 및 도 4를 참조하면, 본 발명의 일 실시예에 따른 첫 번째 통신 이후의 경우 SPI 수신 버퍼의 스턱비트 에러발생 판별방법은 다음과 같다.

먼저, 패턴값 판단부(100)에서 제2 수신 데이터 패턴값이 제1 송신 데이터 패턴값과 동일한지를 판단한다(S210).

S210 단계 이후, 제2 수신 데이터 패턴값이 제1 송신 데이터 패턴값과 동일하지 않은 경우, 버스라인 에러발생 인식부(200)에서 SPI(Serial Peripheral Interconnect) 버스라인(bus line)에 에러가 발생한 것을 인식한다(S220).

S210 단계 이후, 제2 수신 데이터 패턴값이 제1 송신 데이터 패턴값과 동일한 경우, 명령응답 인식부(500)에서 제1 수신 데이터 패턴값이 무효한 명령에 대한 응답인지를 판단한다(S230).

S230 단계 이후, 제1 수신 데이터 패턴값이 무효한 명령에 대한 응답이 아닌 경우, 동작에러 인식부(600)에서 SPI 수신 버퍼의 동작이 에러인 것을 인식한다(S240).

S230 단계 이후, 제1 수신 데이터 패턴값이 무효한 명령에 대한 응답인 경우, 패턴값 판단부(100)에서 제3 수신 데이터 패턴값이 제2 송신 데이터 패턴값과 동일한지를 판단한다(S250).

S250 단계 이후, 제3 수신 데이터 패턴값이 제2 송신 데이터 패턴값과 동일하지 않은 경우, 스턱비트 에러발생 인식부(400)에서 SPI 수신 버퍼에 스턱비트 에러(stuck bit error)가 발생한 것을 인식한다(S260).

S250 단계 이후, 제3 수신 데이터 패턴값이 제2 송신 데이터 패턴값과 동일한 경우, 패턴값 판단부(100)에서 제4 수신 데이터 패턴값이 제3 송신 데이터 패턴값과 동일한지를 판단한다(S270).

S270 단계 이후, 제4 수신 데이터 패턴값이 제3 송신 데이터 패턴값과 동일하지 경우, 스턱비트 에러발생 인식부(400)에서 SPI 수신 버퍼에 스턱비트 에러가 발생한 것을 인식한다(S280).

도 5는 본 발명의 일 실시예에 따른 송수신 데이터 패턴값을 나타낸 개략도이다. 도 5를 참조하면, 본 발명의 일 실시예에 따른 송수신 데이터 패턴값은 (i)첫 번째 통신을 개시하는 경우와, (ii) 첫 번째 통신 이후의 경우로 구분하여 설명할 수 있다.

(i) 첫 번째 통신을 개시하는 경우

송신측에서 0xAAAA를 송신하고 있을 때, 수신측의 SPI 수신 버퍼에는 0x0000이 수신됨을 알 수 있다. 이 수신된 패턴값은 초기화된 상태를 의미하며, 첫 번째로 0xAAAA를 송신한 후 수신한 SPI 수신 버퍼의 값을 읽었을 때 이 값이 0x0000이 아닌 경우 초기화에 이상이 있거나 SPI 버스라인에 문제가 있다는 것을 판별할 수 있다.

이후에, 송신측에서 송신한 0xAAAA가 그대로 수신되면 SPI 버스라인에는 이상이 없다는 것이 판별된다.

이후에, SPI 수신 버퍼의 스턱비트를 확인하기 위해 송신측에서 송신한 데이터 패턴값 0xAAAA, 0x5555, 0xAAAA에 따라 수신 버퍼에 수신된 데이터 패턴값이 그대로 변경되면 수신 버퍼에 스턱비트가 없음을 판별할 수 있다.

마지막으로, 무효한 명령(Invalid Command)을 송신한 후 다음 리커런스 타임(recurrence time)에 통신을 통해 읽은 데이터 패턴값이 무효한 명령에 대한 응답을 갖는 데이터 패턴값일 경우 무효한 명령에 대해서도 인식하여 처리되었음을 알 수 있다.

(ii) 첫 번째 통신 이후의 경우

무효한 명령을 수신한 경우 송신 데이터 패턴값은 대부분의 경우에는 정해져 있는 것이므로, 이를 이용하여 통신할 경우 명령을 수신하고 이에 대해 무효한 명령의 수신에 대한 판별하였다는 것을 의미한다. 그러므로, 통신의 정확도와 정상 동작여부에 대한 신뢰를 높일 수 있다. 무효한 명령에 대한 응답이 정확하면 그 이후에는 초기에 통신할 때와는 같은 방식으로 수신 버퍼의 스턱비트 에러를 체크하기 위해 0xAAAA, 0x5555, 0xAAAA의 순서로 데이터 패턴값을 송신하여 스턱비트 에러를 판별한다.

본 발명의 일 실시예와 관련하여, 종래에는 수신 버퍼의 4번째 비트가 1로 스턱된 경우에 송신 데이터 패턴값인 0xAAAA와 동일한 패턴값이 되어 에러 여부를 판별할 수 없고, 송신 데이터 패턴값이 수신되었을 경우 이를 판별할 수 없으므로 시스템이 정상적으로 동작할 수 없었다. 그러나, 본 발명의 일 실시예에서는 SPI 버스라인 상의 PCB 패턴 이상 여부를 체크함과 동시에 SPI 수신 버퍼에 스턱비트가 발생하였는지 판별할 수 있다.

본 발명은 상술한 실시형태 및 첨부된 도면에 의해 한정되지 아니한다. 첨부된 특허청구범위에 의해 권리범위를 한정하고자 하며, 특허청구범위에 기재된 본 발명의 기술적 사상을 벗어나지 않는 범위 내에서 다양한 형태의 치환, 변형 및 변경이 가능하다는 것은 당 기술분야의 통상의 지식을 가진 자에게 자명할 것이다.

100 : 패턴값 판단부 200 : 버스라인 에러발생 인신부
300 : 초기화 에러발생 인식부 400 : 스턱비트 에러발생 인식부
500 : 명령응답 인식부 600 : 동작에러 인식부

Claims (2)

1. 패턴값 판단부에서 제2 수신 데이터 패턴값이 제1 송신 데이터 패턴값과 동일한지를 판단하는 단계;
   상기 제2 수신 데이터 패턴값이 상기 제1 송신 데이터 패턴값과 동일하지 않은 경우, 버스라인 에러발생 인식부에서 SPI(Serial Peripheral Interconnect) 버스라인(bus line)에 에러가 발생한 것을 인식하는 단계;
   상기 제2 수신 데이터 패턴값이 상기 제1 송신 데이터 패턴값과 동일한 경우, 상기 패턴값 판단부에서 제1 수신 데이터 패턴값이 초기화된 레지스터 값인지를 판단하는 단계;
   상기 제1 수신 데이터 패턴값이 상기 초기화된 레지스터 값이 아닌 경우, 초기화 에러발생 인식부에서 SPI 수신 버퍼에 초기화 에러가 발생한 것을 인식하는 단계;
   상기 제1 수신 데이터 패턴값이 상기 초기화된 레지스터 값인 경우, 상기 패턴값 판단부에서 제3 수신 데이터 패턴값이 제2 송신 데이터 패턴값과 동일한지를 판단하는 단계;
   상기 제3 수신 데이터 패턴값이 상기 제2 송신 데이터 패턴값과 동일하지 않은 경우, 스턱비트 에러발생 인식부에서 상기 SPI 수신 버퍼에 스턱비트 에러 (stuck bit error)가 발생한 것을 인식하는 단계;
   상기 제3 수신 데이터 패턴값이 제2 송신 데이터 패턴값과 동일한 경우, 상기 패턴값 판단부에서 제4 수신 데이터 패턴값이 제3 송신 데이터 패턴값과 동일한지를 판단하는 단계; 및
   상기 제4 수신 데이터 패턴값이 상기 제3 송신 데이터 패턴값과 동일하지 경우, 상기 스턱비트 에러발생 인식부에서 상기 SPI 수신 버퍼에 스턱비트 에러가 발생한 것을 인식하는 단계;를 포함하는 것을 특징으로 하는 SPI 수신 버퍼의 스턱비트 에러발생 판별방법.
2. 패턴값 판단부에서 제2 수신 데이터 패턴값이 제1 송신 데이터 패턴값과 동일한지를 판단하는 단계;
   상기 제2 수신 데이터 패턴값이 상기 제1 송신 데이터 패턴값과 동일하지 않은 경우, 버스라인 에러발생 인식부에서 SPI(Serial Peripheral Interconnect) 버스라인(bus line)에 에러가 발생한 것을 인식하는 단계;
   상기 제2 수신 데이터 패턴값이 상기 제1 송신 데이터 패턴값과 동일한 경우, 명령응답 인식부에서 제1 수신 데이터 패턴값이 무효한 명령에 대한 응답인지를 판단하는 단계;
   상기 제1 수신 데이터 패턴값이 상기 무효한 명령에 대한 응답이 아닌 경우, 동작에러 인식부에서 SPI 수신 버퍼의 동작이 에러인 것을 인식하는 단계;
   상기 제1 수신 데이터 패턴값이 상기 무효한 명령에 대한 응답인 경우, 상기 패턴값 판단부에서 제3 수신 데이터 패턴값이 제2 송신 데이터 패턴값과 동일한지를 판단하는 단계;
   상기 제3 수신 데이터 패턴값이 상기 제2 송신 데이터 패턴값과 동일하지 않은 경우, 스턱비트 에러발생 인식부에서 상기 SPI 수신 버퍼에 스턱비트 에러(stuck bit error)가 발생한 것을 인식하는 단계;
   상기 제3 수신 데이터 패턴값이 제2 송신 데이터 패턴값과 동일한 경우, 상기 패턴값 판단부에서 제4 수신 데이터 패턴값이 제3 송신 데이터 패턴값과 동일한지를 판단하는 단계; 및
   상기 제4 수신 데이터 패턴값이 상기 제3 송신 데이터 패턴값과 동일하지 경우, 상기 스턱비트 에러발생 인식부에서 상기 SPI 수신 버퍼에 스턱비트 에러가 발생한 것을 인식하는 단계;를 포함하는 것을 특징으로 하는 SPI 수신 버퍼의 스턱비트 에러발생 판별방법.

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