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KR100830456B1 - Method for scrambling physical channel transmission format and apparatus for transmitting physical channel transmission format information - Google Patents

Method for scrambling physical channel transmission format and apparatus for transmitting physical channel transmission format information Download PDF

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KR100830456B1
KR100830456B1 KR1020020005389A KR20020005389A KR100830456B1 KR 100830456 B1 KR100830456 B1 KR 100830456B1 KR 1020020005389 A KR1020020005389 A KR 1020020005389A KR 20020005389 A KR20020005389 A KR 20020005389A KR 100830456 B1 KR100830456 B1 KR 100830456B1
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transmitting
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윤영우
권순일
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Abstract

본 발명은 물리채널 전송 포맷 정보를 전송하는 것에 관한 것으로 특히 송수신단이 다양한 포맷을 갖는 물리채널을 송수신할 때 전송 포맷을 스크램블링하여 송신하고, 이를 수신한 수신단이 물리채널의 전송 포맷을 효율적으로 검출할 수 있는 물리채널 전송 포맷 스크램블링 방법 및 물리채널 전송 포맷 정보 전송 장치에 관한 것이다. 이와 같은 물리채널 전송 포맷 스크램블링 방법은, 송신측에서 가변길이의 전송 포맷을 갖는 물리채널을 발생시켜 임의의 데이터를 수신측으로 송신하는 경우 상기 임의의 데이터를 상기 가변길이 전송 포맷의 정보를 포함하는 마스크 정보에 따라 스크램블링하여 전송한다.

Figure R1020020005389

블라인드 포맷, 스크램블링

The present invention relates to transmitting physical channel transmission format information. Particularly, when a transmitting and receiving end transmits and receives a physical channel having various formats, the present invention scrambles and transmits a transmission format, and the receiving end efficiently detects the transmission format of the physical channel. The present invention relates to a physical channel transmission format scrambling method and an apparatus for transmitting physical channel transmission format information. Such a physical channel transmission format scrambling method includes a mask including information of the variable length transmission format when generating a physical channel having a variable length transmission format at a transmitting side and transmitting arbitrary data to a receiving side. Scramble and transmit according to the information.

Figure R1020020005389

Blind Format, Scrambling

Description

물리채널 전송 포맷 스크램블링 방법 및 물리채널 전송 포맷 정보 전송 장치{Method for scrambling physical channel transmitting format and device for transmitting physical channel transmitting format information}Method for scrambling physical channel transmitting format and device for transmitting physical channel transmitting format information

도 1은 일반적인 F-SPDCCH의 전송 체인 블록 구성도1 is a block diagram of a transmission chain of a typical F-SPDCCH

도 2는 본 발명에 따른 F-SPDCCH의 전송 체인 블록 구성도2 is a block diagram of a transport chain block of an F-SPDCCH according to the present invention.

도 3은 도 2에 나타낸 스크램블러의 제 1 실시예를 나타낸 도면3 shows a first embodiment of the scrambler shown in FIG.

도 4는 본 발명 제 1 실시예에 따른 롱코드에 대한 스크램블링 포맷 삽입 상태를 나타낸 도면4 is a diagram illustrating a scrambling format insertion state for a long code according to the first embodiment of the present invention.

도 5는 도 2에 나타낸 스크램블러의 제 2 실시예를 나타낸 도면FIG. 5 shows a second embodiment of the scrambler shown in FIG.

본 발명은 물리채널 전송 포맷 정보를 전송하는 것에 관한 것으로 특히 송수신단이 다양한 포맷을 갖는 물리채널을 송수신할 때 전송 포맷을 스크램블링하여 송신하고, 이를 수신한 수신단이 물리채널의 전송 포맷을 효율적으로 검출할 수 있는 물리채널 전송 포맷 스크램블링 방법 및 물리채널 전송 포맷 정보 전송 장치에 관한 것이다. The present invention relates to transmitting physical channel transmission format information. Particularly, when a transmitting and receiving end transmits and receives a physical channel having various formats, the present invention scrambles and transmits a transmission format, and the receiving end efficiently detects the transmission format of the physical channel. The present invention relates to a physical channel transmission format scrambling method and an apparatus for transmitting physical channel transmission format information.                         

어떤 종류의 유무선 통신 시스템에서는, 특정 물리채널 (physical channel)이 여러 가지 형태의 포맷(format)으로 전송될 수 있으나, 수신측에서는 전송 포맷에 대한 명확한 정보 없이 그 채널을 수신해야하는 경우가 있다. 따라서, 수신단은 블라인드 포맷 검파(blind format detection)를 수행하여야 한다. 이와 같은 시스템의 한 예로써 차세대 이동 통신 시스템으로 개발되고 있는 1x-EVDV 시스템(Cdma2000-Revision-C)이 있다.In some types of wired and wireless communication systems, a specific physical channel may be transmitted in various formats, but the receiving side may need to receive the channel without clear information about the transmission format. Therefore, the receiving end should perform blind format detection. An example of such a system is the 1x-EVDV system (Cdma2000-Revision-C), which is being developed as a next generation mobile communication system.

1x-EVDV시스템에서는 Packet data를 전송하는 물리적 채널인 F-PDCH의 제어 정보를 전송하기 위하여 여러 개의 F-SPDCCH를 사용한다.In the 1x-EVDV system, multiple F-SPDCCHs are used to transmit control information of the F-PDCH, which is a physical channel for transmitting packet data.

즉 종래의 패킷 데이터 전송을 위한 무선 통신 시스템들은 패킷 데이터 전송을 위하여 패킷 데이터 채널(Packet Data Channel;이하 PDCH)과, 패킷 데이터 제어 채널(Packet Data Control Channel;이하 PDCCH) 등의 물리적 채널을 사용한다. That is, conventional wireless communication systems for packet data transmission use physical channels such as a packet data channel (PDCH) and a packet data control channel (PDCCH) for packet data transmission. .

상기 PDCH는 실제로 해당 단말기(혹은 사용자, 이하 단말기라 통칭)에 전송되어야 할 패킷 데이터들을 전송하는 채널이다. The PDCH is actually a channel for transmitting packet data to be transmitted to the corresponding terminal (or user, hereinafter referred to as terminal).

PDCCH는 상기 PDCH를 통해 전송되고 있는 데이터들을 해당 단말기가 오류 없이 제대로 수신할 수 있도록 해주는 제어 정보가 들어 있다. 여기서 PDCCH는 PPDCCH(Primary PDCCH)와, SPDCCH(Secondary PDCCH)의 두 가지를 사용한다. 이 중 SPDCCH는 필수적으로 사용되고, PPDCCH는 선택적으로 이용된다. The PDCCH includes control information that enables the terminal to properly receive data transmitted through the PDCH without error. Here, PDCCH uses two types of Primary PDCCH (PPDCCH) and Secondary PDCCH (SPDCCH). Among them, SPDCCH is essentially used, and PPDCCH is selectively used.

이때, SPDCCH는 순방향 채널로서 PDCH(packet data channel)을 사용하기 위한 제어 채널로써, PDCH를 통해 전송되는 데이터를 수신단측에서 복호화(decoding)하기 위하여 SPDCCH는 복호화(decoding)에 필요한 정보를 전송한다. In this case, the SPDCCH is a control channel for using a packet data channel (PDCH) as a forward channel. The SPDCCH transmits information necessary for decoding in order to decode data transmitted through the PDCH at the receiving end.                         

기본적으로 현재의 SPDCCH는 13~21bit의 디코딩(decoding)에 필요한 각종 정보들과 이 정보들의 수신 에러 유무를 검사하기 위한 6~8bit의 주기적 덧붙임 검사(cyclic redundancy checking : 이하 CRC라 약칭 함) 비트(bit), 그리고 8비트의 컨벌루션 부호화기 테일 비트(Convolutional encoder tail bit)로 구성이 된다. Basically, current SPDCCH is 6 ~ 8bit cyclic redundancy checking (CRC) bit to check various information necessary for decoding of 13 ~ 21bit and the reception error of this information. bit) and an 8-bit convolutional encoder tail bit.

이렇게 구성된 총 27~37비트(bit)의 정보들은 1/2 또는 1/4의 컨벌루션 부호화(Convolutional coding)를 거치며 54 ~ 64bit의 부호화된 비트(coded bit)(1/2 coding의 경우) 또는 108~128bit의 부호화된 비트(coded bit)(1/4 coding의 경우)를 만들어 낸다.A total of 27 to 37 bits of information thus constructed is convolutional coding of 1/2 or 1/4, and 54 to 64 bits of coded bit (for 1/2 coding) or 108 Produces ~ 128bit of coded bit (1/4 coding).

이하 첨부된 도면을 참조하여 종래 기술에 따른 부호 비트의 펑처링 방법을 설명하기로 한다.Hereinafter, a puncturing method of code bits according to the prior art will be described with reference to the accompanying drawings.

도 1은 일반적인 F-SPDCCH의 전송 체인 블록 구성도이다.1 is a configuration diagram of a transmission chain block of a general F-SPDCCH.

일반적인 F-SPDCCH로 전송된 데이터(입력 시퀀스)는 에러 검출 코드 추가 블록(101)에서 CRC 코드와 같은 에러 검출 코드가 부가된다. The data (input sequence) transmitted on the general F-SPDCCH is added with an error detection code such as a CRC code in the error detection code addition block 101.

그리고, 이 CRC 코드가 부가된 비트는 테일 비트 추가블록(102)에서 부호기의 최종 상태(state)를 알려진 상태(trellis termination)로 보내주기 위한 테일비트들이 부가된다. The bit to which the CRC code is added is added with tail bits for sending the final state of the encoder to a known termination in the tail bit addition block 102.

테일비트가 부가된 비트들은 부호화기(103)에서 컨벌루셔널 코드로 부호화된다. The bits to which the tail bits are added are encoded by the convolutional code in the encoder 103.

이러한 과정을 통해 생성된 부호화된 비트들은 전송하는 슬롯의 길이에 맞게 심볼반복블록(104)에서 반복되고, 상기 반복된 비트들은 펑처링 블록(105)에서 펑 처링된다. The encoded bits generated through this process are repeated in the symbol repetition block 104 according to the length of a slot to be transmitted, and the repeated bits are punctured in the puncturing block 105.

예를 들면 1x EVDV 시스템에서는 사용 가능한 왈시 코드(walsh code)수의 제한으로 인해 SPDCCH에서는 길이가 64칩인 왈시 코드(walsh code)를 사용한다. 따라서 한 슬롯당 들어가는 부호화된(coded bit)의 수는 48비트(bit)가 된다. For example, due to the limitation of the number of Walsh codes available in 1x EVDV systems, the SPDCCH uses Walsh codes of 64 chips in length. Therefore, the number of coded bits per slot is 48 bits.

SPDCCH에서는 전송을 하기 위해서 사용하는 슬롯(slot)의 길이가 1, 2, 4 슬롯(slot)이므로 1 슬롯(slot) 길이에는 48 부호화된 비트(coded bit)가, 2 슬롯(slot) 길이에는 96 부호화된 비트(coded bit), 그리고 4 슬롯(slot) 길이에는 192 부호화된 비트(coded bit)가 들어간다. In the SPDCCH, since slots used for transmission are 1, 2, or 4 slots, 48 coded bits are used for 1 slot and 96 slots are used for 2 slot. A coded bit and 4 slot lengths contain 192 coded bits.

예를 들어 도 1에서처럼 18비트(bit)의 정보 비트에 8비트 CRC, 8비트 부호화 테일 비트(encoder tail bit)의 경우에는 총 34비트(bit)의 정보가 만약 1 슬롯(slot)에 대해서 전송된다면 1/2 부호화(encoding)를 거치게 되면서 68비트(bit)의 부호화된 비트(coded bit)가 생성된다. 즉 전송하는 슬롯의 길이에 맞게 펑처링 블록(105)에서 펑처링된다.For example, as shown in FIG. 1, in the case of an 8-bit CRC and an 8-bit encoder tail bit with 18 bits of information bits, a total of 34 bits of information is transmitted for one slot. If it is, the half-encoding is performed and 68 bits of coded bits are generated. That is, the puncturing block 105 is punctured according to the length of the slot to transmit.

즉 1슬롯 길이에는 48 부호화된 비트(coded bit)가 전송되므로 68-48=20 즉 20비트(bit)만큼의 펑처링(puncturing)이 이루어진 후에 48 부호화된 비트(coded bit)가 1 슬롯(slot)을 통해 전송되어진다. That is, since 48 coded bits are transmitted in one slot length, 48-coded bits are stored in one slot after 68-48 = 20, that is, puncturing by 20 bits. Is sent via).

이때 같은 정보량이 4 슬롯(slot)으로 전송된다면 도 1에서 보듯이 1/4 부호화(coding)를 거쳐서 136 부호화된 비트(coded bit)를 만들어 내고 다시 심볼 반복(repetition)을 통해 272 비트를 생성해 낸다. 이 272 비트의 정보는 4 슬롯 즉 192비트로 전송되어야 하므로 272 - 192 = 80 비트의 펑처링(puncturing)을 하 여 192비트를 4 슬롯에 나누어 전송하게 된다. At this time, if the same information amount is transmitted in 4 slots, as shown in FIG. 1, 136 coded bits are generated through 1/4 coding, and 272 bits are generated through symbol repetition. Serve Since the 272 bits of information should be transmitted in 4 slots, that is, 192 bits, 272-192 = 80 bits are punctured to divide 192 bits into 4 slots.

상기 펑처링된 비트들은 블록 인터리버(106)에서 인터리빙되고, 변조기(107)에서 QPSK 방식에 의하여 변조된다. 이 변조된 신호는 왈쉬 코드들 중의 일부를 사용하여 I 채널 및 Q 채널로 분리된다.The punctured bits are interleaved in the block interleaver 106 and modulated by the QPSK scheme in the modulator 107. This modulated signal is separated into I and Q channels using some of the Walsh codes.

이때, 앞에서도 설명한 바와 같이 F-SPDCCH의 전송 길이는 1 slot, 2 slot, 4 slot일 수 있는데, 여기서, slot이란 1.25 msec의 시간 단위를 의미한다. 이때, 송신단은 지금 전송되고 있는 F-SPDCCH의 길이를 수신단에게 알려주지 않는다. 즉, 어떤 포맷인지를 수신단은 명확히 알 수 없다. 그러므로, 수신단은 수신된 F-SPDCCH의 전송 길이(혹은 포맷)가 무엇인지를 알기 위하여 세 가지 포맷(세 가지 길이 : 1 slot, 2 slot, 4 slot)에 대하여 전부 복호 과정을 수행하고, CRC를 검사한다. At this time, as described above, the transmission length of the F-SPDCCH may be 1 slot, 2 slots, or 4 slots, where the slot means a time unit of 1.25 msec. At this time, the transmitting end does not inform the receiving end of the length of the F-SPDCCH being transmitted. That is, the receiving end can not clearly know what format. Therefore, the receiver performs a decoding process for all three formats (three lengths: one slot, two slots, and four slots) to know what the transmission length (or format) of the received F-SPDCCH is. Check it.

이때, CRC=1라고 판정이 난 포맷을 정확한 포맷이라고 판단한다. At this time, it is determined that the format determined as CRC = 1 is the correct format.

여기서, CRC=1란 CRC 검사를 통해 F-SPDCCH상에 전달되는 데이터에 오류가 없다고 판단하는 경우를 의미한다. 반대로, CRC=0란 CRC 검사를 통해 F-SPDCCH상에 전달되는 데이터에 오류가 있다고 판단하는 경우를 의미한다.Here, CRC = 1 means that there is no error in the data transmitted on the F-SPDCCH through the CRC check. On the contrary, CRC = 0 means a case where it is determined that there is an error in data transmitted on the F-SPDCCH through the CRC check.

이와 같은 종래 기술에서는 오직 CRC만으로 수신단이 전송 채널의 포맷을 결정할 경우, 두 종류 이상의 포맷에 대하여 CRC가 1의 값을 가지는 경우가 발생할 수 있다. 이와 같은 경우, 수신단은 수신한 포맷이 어떤 종류의 포맷인지를 정확히 판단할 수 없다. 그러므로, 그와 같은 경우가 발생하는 것을 최소화하기 위한 또 다른 부가적인 장치가 필요하게 된다.In the prior art, when the receiver determines the format of the transmission channel using only the CRC, the CRC may have a value of 1 for two or more types of formats. In this case, the receiver cannot determine exactly what kind of format the received format is. Therefore, another additional device is needed to minimize the occurrence of such a case.

본 발명은 이상에서 언급한 종래 기술의 문제점을 감안하여 안출한 것으로서, 유무선 송신단이 특정 물리채널을 통해 데이터를 전송할 때 포맷 정보를 스크램블링하여 전송하도록 하고 수신단에서는 전송된 포맷 정보에 따라 수신된 데이터의 포맷 종류를 정확히 판단할 수 있는 물래채널 전송 포맷 스크램블링 방법 및 물리채널 전송 포맷 정보 전송 장치를 제공하기 위한 것이다.SUMMARY OF THE INVENTION The present invention has been made in view of the above-mentioned problems of the prior art, and allows a wired / wireless transmitter to scramble and transmit format information when transmitting data through a specific physical channel. It is an object of the present invention to provide a physical channel transmission format scrambling method and a physical channel transmission format information transmission apparatus capable of accurately determining a format type.

이상과 같은 본 발명의 일 특징에 따르면, 송신측에서 가변길이의 전송 포맷을 갖는 물리채널을 발생시켜 임의의 데이터를 수신측으로 송신하는 경우 상기 임의의 데이터를 상기 가변길이 전송 포맷의 정보를 포함하는 마스크 정보에 따라 스크램블링하여 전송한다.According to one aspect of the present invention as described above, when the transmitting side generates a physical channel having a variable length transmission format and transmits arbitrary data to the receiving side, the arbitrary data includes information of the variable length transmission format. Scrambled according to the mask information and transmitted.

바람직하게, 상기 스크램블링은, 상기 데이터에 에러 검출 코드를 추가하는 에러 검출 코드 추가 블록과, 상기 데이터에 상기 데이터를 부호화하는 부호기의 최종 상태를 알려주는 테일 비트를 추가하는 테일 비트 추가 블록과, 상기 테일 비트가 추가된 데이터를 컨벌루셔널 코드로 부호화하는 컨벌루셔널 부호화기와, 상기 부호화된 비트들을 전송하는 슬롯의 길이에 맞게 심볼반복하는 심볼 반복 블록과, 상기 심볼 반복된 비트들을 펑처링하는 펑처리 블록과, 상기 펑처링된 비트들을 인터리빙하는 블록 인터리버와, 상기 송신측 변조 방식에 따라 변조하는 변조 블록 중 어느 하나의 블록에서 출력된 데이터 또는 출력 비트에 스크램블링한다.Preferably, the scrambling comprises: an error detection code addition block for adding an error detection code to the data, a tail bit addition block for adding tail bits for indicating a final state of an encoder encoding the data to the data; A convolutional encoder for encoding data having tail bits added to the convolutional code, a symbol repetition block for symbol repetition according to a length of a slot for transmitting the encoded bits, and a puncture for puncturing the symbol repeated bits And a scrambling to data or output bits output from any one of a processing block, a block interleaver interleaving the punctured bits, and a modulation block modulated according to the transmission-side modulation scheme.

그리고 상기 송신단은 상기 스크램블링을 위한 스크램블러를 더 구비하며, 상기 스크램블러는 롱 코드 발생기 또는 천이 레지스트 중 하나로 구성된다. The transmitter further includes a scrambler for the scrambling, wherein the scrambler is composed of one of a long code generator or a transition resist.                         

바람직하게, 상기 롱 코드 발생기를 사용하는 경우 상기 롱 코드 필드 중 상기 롱 코드 필드의 필드0, 필드 1, 필드 3 및 필드 4를 X라 하고, 상기 전송 포맷 정보 코드를 L2, L1, L0라 할 때, Preferably, when the long code generator is used, field 0, field 1, field 3, and field 4 of the long code field of the long code fields are referred to as X, and the transport format information codes are referred to as L2, L1, and L0. time,

XXXXXXXXXXXXXXXXXXXXXL2L1L0XXXXXXXXXXXXXXXXXXXX 의 롱 코드 패턴을 갖는다.It has a long code pattern of XXXXXXXXXXXXXXXXXXXXXL2L1L0XXXXXXXXXXXXXXXXXXXX.

상기와 같은 본 발명의 다른 특징에 따르면, 송신측에서 가변길이의 전송 포맷을 갖는 물리채널을 통해 임의의 데이터를 전송하는 전송체인에 있어서, 상기 임의의 데이터에 상기 가변길이 전송 포맷의 정보를 포함하는 마스크(mask)정보를 이용하여 스크램블링하는 스크램블러(Scrambler)를 포함한다.According to another aspect of the present invention, in the transmission chain for transmitting arbitrary data through a physical channel having a variable length transmission format at the transmitting side, the arbitrary data includes the information of the variable length transmission format And a scrambler that scrambles using mask information.

바람직하게, 상기 스크램블러는 롱 코드 발생기 또는 천이 레지스트 중 하나를 사용하여 실시한다.Preferably, the scrambler is carried out using either a long code generator or a transition resist.

삭제delete

본 발명의 일 양태로서 하나 이상의 슬롯을 가지는 패킷 제어 데이터의 전송을 위해 통신 채널을 이용하는 무선 통신 방법에 있어서, 스크램블러에서 상기 슬롯의 개수를 이용하여 생성되는 스크램블링 시퀀스로 상기 패킷 제어 데이터를 스크램블 하는 단계 및 상기 스크램블된 패킷 제어 데이터를 전송하는 단계를 포함한다.
본 발명의 다른 양태로서 하나 이상의 슬롯을 가지는 패킷 제어 데이터를 전송하는 송신장치를 포함하는 무선 통신 시스템에 있어서, 상기 슬롯의 개수를 이용하여 생성되는 스크램블링 시퀀스로 상기 패킷 제어 데이터를 스크램블 하는 스크램블러 및 상기 스크램블된 패킷 제어 데이터를 전송하는 전송부를 포함한다.
상술한 본 발명의 두 가지 양태에 있어서, 상기 슬롯의 개수는 가변적이고 상기 슬롯의 길이는 고정될 수 있다. 또한, 상기 슬롯의 개수에 의존하지 않는 디스크램블링 시퀀스로 상기 스크램블된 패킷 제어 데이터를 디스크램블 하는 단계 또는 수신 단의 디스크램블러를 더 포함할 수 있다.
또한, 상기 스크램블링 시퀀스는 상기 스크램블러의 출력 비트 및 상기 패킷 제어 데이터의 슬롯의 개수를 이용하여 생성되고, 상기 디스크램블링 시퀀스는 상기 디스크램블러의 출력 비트를 이용하여 생성되며, 상기 스크램블러의 출력 비트와 상기 디스크램블러의 출력 비트는 서로 일치할 수 있다.
또한, 상기 스크램블링 시퀀스는 상기 슬롯의 개수와 슬롯 유닛의 시스템 시간에 따라 생성될 수 있고 상기 스크램블링 시퀀스는 상기 슬롯의 개수에 기반한 서로 다른 롱 코드 마스크에 따라 생성될 수 있으며, 상기 슬롯의 개수는 1개, 2개 및 4개의 슬롯 중 어느 하나로 이루어질 수 있다.
한편, 상기 패킷 제어 데이터에 에러 검출 코드를 더하고 상기 에러 검출 코드가 더해진 패킷 제어 데이터에 테일 비트를 더하고 상기 테일 비트가 더해진 패킷 제어 데이터를 인코딩하며 전송 슬롯 길이에 정합하도록 상기 인코딩된 패킷 제어 데이터에 심볼 반복 또는 펑처링을 수행하고 상기 심볼 반복 또는 펑처링된 패킷 제어 데이터를 인터리빙하여 상기 인터리브된 데이터를 변조하여 전송할 수도 있다.
이하 본 발명의 바람직한 일 실시 예에 따른 구성 및 작용을 첨부된 도면을 참조하여 설명한다.
도 2는 본 발명에 따른 F-SPDCCH의 전송 체인 블록 구성도이다.
In one aspect of the present invention, a wireless communication method using a communication channel for transmission of packet control data having one or more slots, the method comprising: scrambling the packet control data with a scrambling sequence generated using the number of slots in a scrambler And transmitting the scrambled packet control data.
In another aspect of the present invention, a wireless communication system including a transmitting device for transmitting packet control data having one or more slots, comprising: a scrambler for scrambled the packet control data with a scrambling sequence generated using the number of slots; And a transmitter for transmitting the scrambled packet control data.
In the two aspects of the present invention described above, the number of slots is variable and the length of the slots can be fixed. The method may further include descrambling the scrambled packet control data in a descrambling sequence that does not depend on the number of slots, or may further include a descrambler at a receiving end.
The scrambling sequence is generated using the output bits of the scrambler and the number of slots of the packet control data, and the descrambling sequence is generated using the output bits of the descrambler, and the output bits of the scrambler and the The output bits of the descrambler may coincide with each other.
Further, the scrambling sequence may be generated according to the number of slots and the system time of a slot unit, and the scrambling sequence may be generated according to different long code masks based on the number of slots, and the number of slots is 1 It may consist of any one of two, two and four slots.
Meanwhile, an error detection code is added to the packet control data, a tail bit is added to the packet control data to which the error detection code is added, the packet control data to which the tail bit is added is encoded, and the packet control data is encoded to match the transmission slot length. The interleaved data may be modulated and transmitted by performing symbol repetition or puncturing and interleaving the symbol repetition or punctured packet control data.
Hereinafter, a configuration and an operation according to an exemplary embodiment of the present invention will be described with reference to the accompanying drawings.
2 is a block diagram of a transport chain block of an F-SPDCCH according to the present invention.

본 발명에 따른 F-SPDCCH의 전송 체인 블록은 1x-EVDV시스템에서 패킷 데이터(Packet data)를 전송하는 물리적 채널인 F-PDCH의 제어 정보를 전송하기 위하여 사용하는 F-SPDCCH를 나타낸 것으로 편의상, F-SPDCCH은 두 개가 사용된다고 가정하고, 각각을 F-SPDCCH0, F-SPDCCH1이라고 명한다. 또한, 각 F-SPDCCH이 가질 수 있는 전송 포맷의 종류는 전송 길이(1 slot, 2 slot, 4 slot)에 따라 세 가지가 있 다고 가정한다. 그리고 그 포맷을 FM(i, N)라고 명한다. 이때, FM(i, N)에서 i=0, 1 은 각각 F-SPDCCH0, F-SPDCCH1을 의미하고, N=1,2,4는 1 slot, 2 slot, 4 slot을 각각 의미한다. 이와 같은 가정은 설명의 편의상일 뿐, 구분해야 할 채널의 수나 포맷의 수가 다른 시스템일지라도 자연스럽게 본 발명의 내용을 적용할 수 있을 것다. The transport chain block of the F-SPDCCH according to the present invention shows the F-SPDCCH used for transmitting control information of the F-PDCH, which is a physical channel for transmitting packet data in the 1x-EVDV system. Assume that two SPDCCHs are used, namely F-SPDCCH0 and F-SPDCCH1. In addition, it is assumed that there are three types of transmission formats that each F-SPDCCH may have according to transmission lengths (1 slot, 2 slots, and 4 slots). The format is called FM (i, N). In this case, i = 0, 1 in FM (i, N) mean F-SPDCCH0 and F-SPDCCH1, and N = 1, 2, and 4 mean 1 slot, 2 slot, and 4 slot, respectively. This assumption is only for convenience of explanation, and even if the system has a different number of channels or formats to be distinguished, the contents of the present invention may be naturally applied.

도 2에 나타낸 F-SPDCCH 전송 체인의 블록 구성은 도 1과 유사하지만, 수신단이 F-SPDCCH에 대한 블라인드 포맷 검파를 오류없이 수행하기 위한 스크램블러(Scrambler)(109)를 부가하고, 스크램블러(Scrambler)를 미리 설정한 원칙에 따라 포맷 정보를 사용하여 구동시킨다. The block configuration of the F-SPDCCH transmission chain shown in FIG. 2 is similar to that of FIG. 1, but the receiver adds a scrambler 109 for error-free blind format detection for the F-SPDCCH, and a scrambler. Is driven using the format information according to a preset principle.

여기서, 스크램블러(109)는 0과 1을 비교적 랜덤하게 발생시키는 장치이다. 스크램블러(109)의 첨가 위치는 도 1에 나타낸 P1, P2, P3 , P4 , P5 , P6 및 P7 중 어느 곳이라도 가능하다. Here, the scrambler 109 is a device that generates 0 and 1 relatively randomly. The addition position of the scrambler 109 can be any one of P1, P2, P3, P4, P5, P6, and P7 shown in FIG.

도 2에서는 P7부분에 스크램블러(109)를 첨가한 경우를 나타내었다. 2 illustrates a case in which the scrambler 109 is added to the P7 portion.

도 2에서 Mask(i,N)은 FM(Format)(i,N)와 1:1 대응 관계에 있는 변수로써, 스크램블러(109)의 출력을 채널 포맷에 따라 다르게 발생시켜주는 역할을 한다.In FIG. 2, Mask (i, N) is a variable having a 1: 1 correspondence with FM (Format) (i, N), and serves to generate an output of the scrambler 109 differently according to a channel format.

도 3은 도 2에 나타낸 스크램블러의 제 1 실시예를 나타낸 도면이고, 도 4 본 발명 제 1 실시예에 따른 롱코드에 대한 스크램블링 포맷 삽입 상태를 나타낸도면이다.3 is a diagram illustrating a first embodiment of the scrambler shown in FIG. 2, and FIG. 4 is a diagram illustrating a scrambling format insertion state for a long code according to the first embodiment of the present invention.

도 3에서는 도 2에 나타낸 스크램블러(Scrambler)(109)를 구현하기 위하여 기존의 코드분할다중접속(CDMA) 시스템이 사용하는 롱 코드(long code) 발생기를 사용한다.In FIG. 3, a long code generator used by an existing code division multiple access (CDMA) system is used to implement the scrambler 109 shown in FIG.

도 3에 나타낸 롱 코드 발생기(109a)는 고속의 칩(chip) 전송율로 출력 비트를 발생시키고, 스크램블링 비트 추출기(109b)는 롱 코드 발생기(109a)에서 고속으로 출력되는 비트들 중 필요한 비트만을 추출한다. 그리고, 스크램블링 비트 반복기(109c)는 필요에 따라(option) 첨가되는 부분으로 스크램블링 비트 추출기(109b)의 출력을 필요에 따라 반복해 준다. 이때, Mask(i,N)은 FM(i,N)과 1:1 대응 관계에 있으며, 기존의 롱 코드 마스크(long code mask)와 동일한 동작 원리를 가진다.The long code generator 109a shown in FIG. 3 generates output bits at a high chip rate, and the scrambling bit extractor 109b extracts only necessary bits among the bits output at high speed from the long code generator 109a. do. The scrambling bit repeater 109c repeats the output of the scrambling bit extractor 109b as necessary to be added as needed. In this case, Mask (i, N) has a 1: 1 correspondence with FM (i, N), and has the same operation principle as that of a conventional long code mask.

도 4는 도 3에 나타낸 롱 코드 발생기(109a)의 특성을 규정하는 다항식이 42차일 경우, Mask(i,N)의 한 가지 예로써, 필드 0, 필드 1, 필드 3, 필드 4는 사용 시스템에서 다른 채널들과 구분 가능한 특정 숫자로 고정시킨다. 그리고, 필드 2는 FM(i,N)에 따라 미리 약속된 값이다. FIG. 4 is an example of Mask (i, N) when the polynomial that defines the characteristics of the long code generator 109a shown in FIG. 3 is 42th order. Field 0, field 1, field 3, and field 4 are used systems. Fixed at a specific number distinguishable from other channels. And, field 2 is a value previously promised according to FM (i, N).

표 1에서는 몇 가지 예를 나타내었다.Table 1 shows some examples.

FM(0,1)FM (0,1) FM(0,2)FM (0,2) FM(0,4)FM (0,4) FM(1,1)FM (1,1) FM(1,2)FM (1,2) FM(1,4)FM (1,4) L2 L1 L0L2 L1 L0 000000 001001 010010 100100 101101 110110 제 1 예First example 000000 001001 010010 011011 100100 101101 제 2 예2nd example 000000 001001 010010 000000 001001 010010 제 3 예Third example

도 5는 도 2에 나타낸 스크램블러의 제 2 실시예를 나타낸 도면이다.FIG. 5 is a diagram illustrating a second embodiment of the scrambler shown in FIG. 2.

도 5는 제안된 Scrambler를 구현하기 위하여 통상의 천이(Shift) 레지스터를 이용할 수 있다. 5 may use a conventional shift register to implement the proposed sccrambler.

즉 도 5는 천이 레지스터를 규정하는 다항식이 h(D)=D17+D14+1인 경우의 한 가지 예시도로써, Mask(i,N)은 FM(i,N)과 1:1 대응 관계에 있으며, 이 값을 이용하 여 천이 레지스터의 메모리 값을 초기화시킨다.5 is an exemplary diagram when the polynomial that defines the transition register is h (D) = D 17 + D 14 +1, and Mask (i, N) corresponds to FM (i, N) 1: 1. Is used to initialize the memory value of the transition register.

도 5와 관련된 Mask(i,N)의 한 가지 예로써 다음과 같이 나타낼 수 있다.As an example of Mask (i, N) related to FIG. 5, it may be represented as follows.

Mask(i,N)=(1 1 1 1 1 1 1 1 1 1 1 1 1 1 L2 L1 L0)------(1)Mask (i, N) = (1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 L2 L1 L0) ------ (1)

여기서 (1)의 (L2 L1 L0)의 값에 대한 예로써 표 1에 있는 값들이 사용될 수 있다.Here, as an example of the value of (L2 L1 L0) of (1), the values in Table 1 may be used.

도 5와 관련한 Mask(i,N)의 또 다른 예로써, Mask(i,N)에 시간 정보를 추가하여 다음과 같이 나타낼 수 있다.As another example of Mask (i, N) related to FIG. 5, time information may be added to Mask (i, N) as follows.

Mask(i,N)=(1 1 1 1 1 1 1 1 1 1 1 1 T1 T0 L2 L1 L0)------(2)Mask (i, N) = (1 1 1 1 1 1 1 1 1 1 1 1 1 T1 T0 L2 L1 L0) ------ (2)

여기서, (2)의 (L2 L1 L0)의 값에 대한 예로써 표 1에 있는 값들이 사용될 수 있다. 또한, (2)의 (T1 T0)은 현재 전송 시간에 따른 변수이다. 한 가지 예로써, 현재 전송 slot 시간을 Slot(t)라고 하고, Slot(t)의 값이 {0, 1, 2, ... , 14, 15} 중의 어느 하나라고 가정한다. 이때, Val= (Slot(t) % 4)라고 하면, Val는 {0, 1, 2, 3}중의 어느 한 값을 가지게 되며, T1과 T0와 Val과의 관계는 표 2와 같이 정의 될 수 있다.Here, the values in Table 1 may be used as an example of the value of (L2 L1 L0) in (2). Also, (T1 T0) in (2) is a variable according to the current transmission time. As an example, assume that the current transmission slot time is called Slot (t) and that the value of Slot (t) is any one of {0, 1, 2, ..., 14, 15}. If Val = (Slot (t)% 4), Val has any one of {0, 1, 2, 3}, and the relationship between T1 and T0 and Val can be defined as shown in Table 2. have.

ValVal 00 1One 22 33 T1 T0T1 T0 0000 0101 1010 1111

이상의 설명에서 본 발명은 순방향 채널 중 하나인 SPDCCH를 예로 들어 설명하였지만, 특허청구범위에 의해 나타난 발명의 사상 및 영역으로부터 벗어나지 않는 한도 내에서 다양한 개조 및 변화가 가능하다는 것을 당업계에서 통상의 지식을 가진 자라면 누구나 쉽게 알 수 있을 것이다.In the above description, the present invention has been described by taking SPDCCH, which is one of the forward channels as an example, but it is possible to make various modifications and changes without departing from the spirit and scope of the invention as indicated by the claims. Anyone who owns it can easily find out.

본 발명에 따른 블라인드 포맷 스크램블링 방법 및 검출 방법에 있어서는, 가변길이의 물리채널 전송 포맷을 전송 데이터에 스크램블링하여 전송함으로서 수신측에서 정확한 포맷 검출이 가능하여 전송된 채널에 사용된 자원의 낭비를 줄일 수 있으며, 그 결과 시스템의 전체 성능을 향상시킬 수 있는 효과가 있다.In the blind format scrambling method and detection method according to the present invention, by scrambling and transmitting a variable-length physical channel transmission format to transmission data, accurate format detection is possible at the receiving side, thereby reducing waste of resources used in the transmitted channel. As a result, there is an effect that can improve the overall performance of the system.

Claims (15)

하나 이상의 슬롯을 가지는 패킷 제어 데이터의 전송을 위해 통신 채널을 이용하는 무선 통신 방법에 있어서,A wireless communication method using a communication channel for transmission of packet control data having one or more slots, the method comprising: 스크램블러에서 상기 슬롯의 개수를 이용하여 생성되는 스크램블링 시퀀스로 상기 패킷 제어 데이터를 스크램블 하는 단계; 및Scrambled the packet control data with a scrambling sequence generated using the number of slots in a scrambler; And 상기 스크램블된 패킷 제어 데이터를 전송하는 단계Transmitting the scrambled packet control data 를 포함하는 무선 통신 방법.Wireless communication method comprising a. 제 1 항에 있어서,The method of claim 1, 상기 슬롯의 개수는 가변적이고 상기 슬롯의 길이는 고정되는 것을 특징으로 하는, 무선 통신 방법.Wherein the number of slots is variable and the length of the slots is fixed. 제 1 항에 있어서,The method of claim 1, 수신 단의 디스크램블러에서 상기 슬롯의 개수에 의존하지 않는 디스크램블링 시퀀스로 상기 스크램블된 패킷 제어 데이터를 디스크램블 하는 단계를 더 포함하는 무선 통신 방법.And descrambling the scrambled packet control data in a descrambling sequence that does not depend on the number of slots in a descrambler of a receiving end. 제 3 항에 있어서,The method of claim 3, wherein 상기 스크램블링 시퀀스는 상기 스크램블러의 출력 비트 및 상기 패킷 제어 데이터의 슬롯의 개수를 이용하여 생성되고, The scrambling sequence is generated using the output bits of the scrambler and the number of slots of the packet control data, 상기 디스크램블링 시퀀스는 상기 디스크램블러의 출력 비트를 이용하여 생성되며,The descrambling sequence is generated using output bits of the descrambler, 상기 스크램블러의 출력 비트와 상기 디스크램블러의 출력 비트는 서로 일치하는 것을 특징으로 하는, 무선 통신 방법.And an output bit of the scrambler and an output bit of the descrambler coincide with each other. 제 1 항에 있어서,The method of claim 1, 상기 스크램블링 시퀀스는 상기 슬롯의 개수와 슬롯 유닛의 시스템 시간에 따라 생성되는 무선 통신 방법.The scrambling sequence is generated according to the number of slots and the system time of a slot unit. 제 1 항에 있어서,The method of claim 1, 상기 스크램블링 시퀀스는 상기 슬롯의 개수에 기반한 서로 다른 롱 코드 마스크에 따라 생성되는 무선 통신 방법.The scrambling sequence is generated according to different long code masks based on the number of slots. 제 1 항에 있어서,The method of claim 1, 상기 슬롯의 개수는 1개, 2개 및 4개의 슬롯 중 어느 하나로 이루어지는 무선 통신 방법.The number of slots is a wireless communication method consisting of any one, two and four slots. 제 1 항에 있어서,The method of claim 1, 상기 패킷 제어 데이터에 에러 검출 코드를 더하는 단계;Adding an error detection code to the packet control data; 상기 에러 검출 코드가 더해진 패킷 제어 데이터에 테일 비트를 더하는 단계;Adding tail bits to packet control data to which the error detection code is added; 상기 테일 비트가 더해진 패킷 제어 데이터를 인코딩하는 단계;Encoding packet control data to which the tail bits are added; 전송 슬롯 길이에 정합하도록 상기 인코딩된 패킷 제어 데이터에 심볼 반복 또는 펑처링을 수행하는 단계;Performing symbol repetition or puncturing on the encoded packet control data to match a transmission slot length; 상기 심볼 반복 또는 펑처링된 패킷 제어 데이터를 인터리빙하는 단계; 및Interleaving the symbol repetition or punctured packet control data; And 상기 인터리브된 데이터를 변조하는 단계를 더 포함하는 무선 통신 방법.And modulating the interleaved data. 하나 이상의 슬롯을 가지는 패킷 제어 데이터를 전송하는 송신장치를 포함하는 무선 통신 시스템에 있어서,A wireless communication system comprising a transmitter for transmitting packet control data having at least one slot, 상기 슬롯의 개수를 이용하여 생성되는 스크램블링 시퀀스로 상기 패킷 제어 데이터를 스크램블 하는 스크램블러; 및A scrambler that scrambles the packet control data with a scrambling sequence generated using the number of slots; And 상기 스크램블된 패킷 제어 데이터를 전송하는 전송부Transmitter for transmitting the scrambled packet control data 를 포함하는 무선 통신 시스템.Wireless communication system comprising a. 제 9 항에 있어서,The method of claim 9, 상기 슬롯의 개수는 가변적이고 상기 슬롯의 길이는 고정되는 것을 특징으로 하는, 무선 통신 시스템.Wherein the number of slots is variable and the length of the slots is fixed. 제 9 항에 있어서,The method of claim 9, 상기 슬롯의 개수에 의존하지 않는 디스크램블링 시퀀스로 상기 스크램블된 패킷 제어 데이터를 디스크램블 하는 디스크램블러를 더 포함하는 무선 통신 시스템.And a descrambler for descrambling the scrambled packet control data in a descrambling sequence that does not depend on the number of slots. 제 9 항에 있어서,The method of claim 9, 상기 스크램블링 시퀀스는 상기 슬롯의 개수와 슬롯 유닛의 시스템 시간에 따라 생성되는 무선 통신 시스템.The scrambling sequence is generated according to the number of slots and the system time of a slot unit. 제 9 항에 있어서,The method of claim 9, 상기 스크램블링 시퀀스는 슬롯의 개수에 기반한 서로 다른 롱 코드 마스크에 따라 생성되는 무선 통신 시스템.The scrambling sequence is generated according to different long code masks based on the number of slots. 제 9 항에 있어서,The method of claim 9, 상기 슬롯의 개수는 1개, 2개 및 4개의 슬롯 중 어느 하나로 이루어지는 무선 통신 시스템.And the number of slots is any one of one, two, and four slots. 제 9 항에 있어서,The method of claim 9, 상기 패킷 제어 데이터에 에러 검출 코드를 더하는 에러 검출 코드 부가 모듈;An error detection code addition module for adding an error detection code to the packet control data; 상기 에러 검출 코드가 더해진 패킷 제어 데이터에 테일 비트를 더하는 테일 비트 부가 모듈;A tail bit addition module for adding tail bits to packet control data to which the error detection code is added; 상기 테일 비트가 더해진 패킷 제어 데이터를 인코딩하는 인코더;An encoder for encoding packet control data plus the tail bits; 전송 슬롯 길이에 맞도록 상기 인코딩된 패킷 제어 데이터에 심볼 반복을 수행하는 심볼반복 모듈;A symbol repetition module for performing symbol repetition on the encoded packet control data to fit a transmission slot length; 상기 전송 슬롯 길이에 맞도록 상기 인코딩된 패킷 제어 데이터에 펑쳐링을 수행하는 펑처링 모듈;A puncturing module for puncturing the encoded packet control data to fit the transmission slot length; 상기 심볼 반복 또는 펑처링된 패킷 제어 데이터를 인터리빙하는 인터리버; 및An interleaver for interleaving the symbol repetition or punctured packet control data; And 상기 인터리브된 데이터를 변조하는 변조기를 더 포함하는 무선 통신 시스템.And a modulator to modulate the interleaved data.
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