KR100649700B1 - How to read data from WLAN module with Marvell chipset - Google Patents
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Abstract
마벨 칩셋을 구비한 무선랜 모듈에서 웨이트 신호를 사용할 수 없는 경우 데이터를 읽는 방법에 있어서, 상기 칩셋의 에스큐유 커맨드 리드 베이스 어드레스 로우 레지스터 및 에스큐유 커맨드 리드 베이스 어드레스 하이 레지스터에서, 읽어 들여야 하는 커맨드 리스폰스의 하위/상위 어드레스를 각각 읽어 들이는 제1 단계; 상기 제1 단계에서 읽어 들인 커맨드 리스폰스의 하위/상위 어드레스를 각각 상기 칩셋의 리드 베이스 어드레스 로우 레지스터 및 리드 베이스 어드레스 하이 레지스터에 기록하는 제2 단계; 상기 제2 단계에서 기록된 하위 어드레스에 따라 상기 칩셋의 아이오 쥐비(I/O GB) 레지스터에서 하위 2바이트를 읽어 들이고, 상기 제2 단계에서 기록된 상위 어드레스에 따라 상기 칩셋의 상기 아이오 쥐비 레지스터에서 상위 2바이트를 읽어 들이는 제3 단계; 및 상기 제1 단계에서 읽어들인 하위 어드레스에 4를 더하여 상기 리드 베이스 어드레스 로우 레지스터에 기록하고, 새로이 기록된 하위 어드레스값에 따라 상기 제3 단계를 반복하는 제4 단계를 포함하는 마벨 칩셋을 구비한 무선랜 모듈에서 데이터를 읽는 방법이 개시된다.In a method of reading data when a weight signal is not available in a WLAN module having a Marvell chipset, a command response to be read from the SQU command read base address low register and the SQU command lead base address high register of the chipset A first step of reading each of the lower and upper addresses of a; A second step of writing the lower and upper addresses of the command response read in the first step into a read base address low register and a read base address high register of the chipset, respectively; Reads the lower 2 bytes from the I / O GB register of the chipset according to the lower address written in the second step, and reads the lower 2 bytes from the Io Zubi register of the chipset according to the upper address written in the second step A third step of reading the upper two bytes; And a fourth step of adding 4 to the lower address read in the first step and writing the result in the read base address row register, and repeating the third step according to the newly written lower address value. A method of reading data from a WLAN module is disclosed.
Description
도 1은 종래의 MSM6500 칩셋과 마벨 칩셋을 갖는 무선랜 모듈의 연결구조를 도시한 블록도이다.1 is a block diagram showing a connection structure of a WLAN module having a conventional MSM6500 chipset and Marvell chipset.
도 2의 (a) 및 (b)는 정상적으로 읽어 들인 데이터와 웨이트 신호가 연결되지 않은 경우에 읽어 들인 데이터를 각각 도시한 도면이다.2 (a) and 2 (b) show the data read when the data read normally and the weight signal are not connected.
도 3은 본 발명에 따른 커맨드 리스폰스를 읽어들이는 방법을 도시한 순서도이다.3 is a flowchart illustrating a method of reading a command response according to the present invention.
도 4는 본 발명에 따른 수신 데이터 패킷을 읽어들이는 방법을 도시한 순서도이다.4 is a flowchart illustrating a method of reading a received data packet according to the present invention.
*도면의 주요부분에 대한 부호의 설명** Explanation of symbols for main parts of drawings *
10: MSM6500 20: 마벨 칩셋을 갖는 무선랜 모듈10: MSM6500 20: WLAN module with Marvell chipset
본 발명은 마벨(Marvell?)사의 무선랜 칩셋(이하, '마벨 칩셋'이라 함)을 이용한 무선랜 모듈에서 데이터를 읽는 방법에 관한 것으로, 더욱 상세하게는 마벨 칩셋을 채용한 무선랜 모듈에서 웨이트 신호를 이용할 수 없는 경우에도 데이터를 읽는 동작이 정상적으로 수행할 수 있는 마벨 칩셋을 구비한 무선랜 모듈에서 데이터를 읽는 방법에 관한 것이다.The present invention relates to a method of reading data from a wireless LAN module using Marvell's wireless LAN chipset (hereinafter referred to as 'Marvell chipset'), and more specifically, to a weight of a wireless LAN module employing a Marvell chipset. The present invention relates to a method of reading data from a wireless LAN module having a Marvell chipset, in which a data reading operation can be normally performed even when a signal is not available.
최근 차세대 유무선 통합기술로 주목받고 있는 무선랜(Wireless Local Area Network: WLAN)이 차기 통신시장의 핵심 이슈로 부각되고 있으며, 무선랜 기술의 발달은 IT 산업의 질적 변화를 불러올 전망이다. 특히, 무선랜은 단말기의 형태가 노트북 컴퓨터와 PDA(Personal Digital Assistant) 등 이동 단말기를 지향하고 있어, 무선랜을 사용하는 지역 및 범위가 다양해지고 또한 넓어지고 있다.Recently, Wireless Local Area Network (WLAN), which is attracting attention as the next generation wired / wireless integrated technology, is emerging as a key issue in the next communication market, and the development of WLAN technology is expected to bring about qualitative changes in the IT industry. In particular, the wireless LAN is a mobile terminal such as a notebook computer and a PDA (Personal Digital Assistant) in the form of a terminal, and the area and range of using the wireless LAN are diversified and widened.
이러한 무선랜을 이용하기 위한 하드웨어인 무선랜 카드(무선랜 모듈)는, 피씨아이(PCI), 유에스비(USB), 피씨엠씨아이에이(PCMCIA) 슬롯에 삽입하여 사용하는 외장형이었으나, 최근 장치의 소형화(예를 들어, 피디에이(PDA), 스마트폰 등)에 따라 내장형(embedded) 환경으로 변화해 가고 있다. 특히 휴대폰 제조업체에서 여러 가지 목적으로 휴대폰에 무선랜을 장착하려는 시도가 이루어지고 있다. 이를 위해서, 대표적인 휴대폰 프로세서인 퀄컴(Qualcomm?)사의 MSM6500을 이용하여 휴대폰에 무선랜 모듈 제어할 수 있는 기술이 요구되고 있다. The wireless LAN card (wireless LAN module), which is a hardware for using such a wireless LAN, has been externally used by being inserted into a PCI, USB, or PCMCIA slot, but has recently been miniaturized. (For example, PDAs, smartphones, etc.) are changing to an embedded environment. In particular, attempts are being made by cell phone manufacturers to equip their cell phones with wireless LANs for various purposes. To this end, there is a demand for a technology for controlling a wireless LAN module in a mobile phone using MSM6500 of Qualcomm, a representative mobile phone processor.
상기 MSM6500은 2개의 외부 버스 인터페이스(external bus interface: EBI) 를 제공한다. 그 중 하나의 외부 버스 인터페이스는 에스디램(SDRAM)용으로 사용되고 다른 하나의 외부 버스 인터페이스는 각종 외부 장치들이 연결되는데 사용된다. 마벨 칩셋을 갖는 무선랜 모듈은 상기 외부 장치들의 연결에 사용되는 외부 버스 인터페이스에 도 1과 같은 연결구조로 연결된다.The MSM6500 provides two external bus interfaces (EBI). One external bus interface is used for SDRAM and the other external bus interface is used to connect various external devices. The WLAN module having the Marvell chipset is connected to the external bus interface used to connect the external devices in a connection structure as shown in FIG. 1.
도 1에 도면부호 '21'로 표시된 바와 같이, MSM6500(10)의 외부 장치 연결에 사용되는 외부 버스 인터페이스는 마벨 칩셋을 갖는 무선랜 모듈(20)에서 출력되는 웨이트(wait) 신호를 처리하기 위한 핀을 갖지 않는다. 상기 마벨 칩셋은 무선랜 모듈의 프로세스를 위하여 마벨사에서 제조되는 칩셋으로, 8305, 8381 및 8385과 같은 일련번호를 갖는 다양한 종류의 칩셋이 있다.As indicated by reference numeral '21' in FIG. 1, an external bus interface used to connect an external device of the
이 웨이트 신호는 일반적으로 호스트 시스템(host system)에서 주변장치에게 읽기(read) 또는 쓰기(write)를 요청하는 경우에, 미리 정해진 시간 이전에 응답을 하지 못하는 경우 주변장치가 호스트에 이를 알리기 위한 용도로 사용되는 신호이다. 여기에서는 MSM6500(10)이 호스트가 되고, 마벨 칩셋을 갖는 무선랜 모듈(20)이 주변 장치가 된다. 따라서, 마벨 칩셋을 갖는 무선랜 모듈(20)에서 정해진 시간 내에 해당 동작을 마치지 못하는 경우 웨이트 신호를 사용해서 이를 MSM6500(10)으로 알려야 하지만, MSM6500에서는 웨이트 신호를 수신할 수 있는 핀을 갖지 못하므로, 미리 정해진 시간이 되면 읽기 또는 쓰기 동작을 종료해 버리게 된다. This weight signal is generally used when the host system requests a peripheral device to read or write, and the peripheral device notifies the host when it cannot respond before a predetermined time. This is the signal used. In this case, the MSM6500 10 is a host, and the
본 발명의 발명자들은 마벨 칩셋(8305, 8381 및 8385)을 갖는 모선랜 모듈(20)에 대한 연구 개발을 통해 웨이트 신호의 동작방식을 확인한 결과, 쓰기 동작에서는 웨이트 신호가 사용되지 않고, 읽기 동작에서만 사용된다는 것을 확인 하였 다. 즉, MSM6500에 웨이트 신호가 연결되지 못함으로써 도 2에 도시된 것과 같이 읽기 동작에서 주기적으로 읽어들인 데이터가 손실되는 것을 확인하였다.The inventors of the present invention have confirmed the operation of the weight signal through research and development of the
도 2의 (a)는 정상적인 동작이 이루어지는 경우 읽어 들인 데이터를 도시한 것이며, 도 2의 (b)는 도 2의 (a)에 도시된 것과 동일한 데이터를 웨이트 신호가 연결되지 않은 경우에 읽어들인 데이터를 도시한 것이다. 도 2의 (a)와 도 2의 (b)를 비교하면, 웨이트 신호가 연결되지 않은 경우, 33번째 데이터부터 매 32바이트마다 2바이트씩 데이터가 잘못 읽히게 되며, 이 잘못 읽히게 되는 데이터는 32바이트 이전의 값이 읽히게 된다. 예를 들어, 도 2의 (a)에서와 같이 32번지(0020)와 33번지(0021)에서 정상적으로 읽혀야 하는 값은 33, 38인데, 웨이트 신호가 연결되지 않는 경우에는, 도 2의 (b)의 도면부호 'E1'으로 표시된 바와 같이 00번지 및 01번지에 있던 05, 3F가 읽히는 문제가 발생한다. 이와 같이 웨이트 신호가 연결되지 못한 경우, 64, 65번지(E2)에서는, 정상적으로 동작한 경우 32, 33번지에 해당하는 값이 읽히고, 마찬가지의 패턴으로 데이터가 잘못 읽히게 되는 오류가 반복된다.FIG. 2 (a) shows data read when normal operation is performed, and FIG. 2 (b) reads the same data as shown in FIG. 2 (a) when the weight signal is not connected. The data is shown. Comparing FIG. 2A with FIG. 2B, when the weight signal is not connected, two bytes of data are read incorrectly every 32 bytes from the 33rd data. Values older than 32 bytes will be read. For example, as shown in (a) of FIG. 2, the values that should be normally read at 32 and 33 (0021) are 33 and 38, but when the weight signal is not connected, FIG. As indicated by the reference numeral 'E1', a problem occurs in which 05 and 3F at 00 and 01 are read. In this way, when the weight signal is not connected, at 64 and 65 (E2), the values corresponding to 32 and 33 are read in the case of normal operation, and an error in which data is incorrectly read in the same pattern is repeated.
본 발명은 전술한 종래 기술의 문제점을 해결하기 위해 안출된 것으로, 그 목적은, MSM6500과 같이 웨이트 신호를 사용할 수 없는 프로세서를 이용한 경우에도 정상적으로 데이터의 읽기가 가능한 마벨 칩셋을 구비한 무선랜 모듈에서 데이 터를 읽는 방법을 제공하는데 있다.The present invention has been made to solve the above-mentioned problems of the prior art, an object of the present invention is a wireless LAN module having a Marvell chipset that can normally read data even when using a processor that can not use the weight signal, such as MSM6500 To provide a way to read the data.
상기 목적을 달성하기 위한 기술적 구성으로서, 본 발명은,As a technical configuration for achieving the above object, the present invention,
마벨 칩셋을 구비한 무선랜 모듈에서 웨이트 신호를 사용할 수 없는 경우 데이터를 읽는 방법에 있어서,In a method of reading data when the weight signal is not available in a WLAN module having a Marvell chipset,
상기 칩셋의 에스큐유 커맨드 리드 베이스 어드레스 로우(SQU Command Read Base Address Low) 레지스터 및 에스큐유 커맨드 리드 베이스 어드레스 하이(SQU Command Read Base Address High) 레지스터에서, 읽어 들여야 하는 커맨드 리스폰스(Command Response)의 하위/상위 어드레스를 각각 읽어 들이는 제1 단계;In the SQU Command Read Base Address Low register and the SQU Command Read Base Address High register of the chipset, the lower / lower of the Command Response to be read. A first step of reading each upper address;
상기 제1 단계에서 읽어 들인 커맨드 리스폰스의 하위/상위 어드레스를 각각 상기 칩셋의 리드 베이스 어드레스 로우(Read Base Address Low) 레지스터 및 리드 베이스 어드레스 하이(Read Base Address High) 레지스터에 기록하는 제2 단계;A second step of writing the lower / higher addresses of the command response read in the first step into a read base address low register and a read base address high register of the chipset, respectively;
상기 제2 단계에서 기록된 하위 어드레스에 따라 상기 칩셋의 아이오 쥐비(I/O GB) 레지스터에서 하위 2바이트를 읽어 들이고, 상기 제2 단계에서 기록된 상위 어드레스에 따라 상기 칩셋의 상기 아이오 쥐비 레지스터에서 상위 2바이트를 읽어 들이는 제3 단계; 및Reads the lower 2 bytes from the I / O GB register of the chipset according to the lower address written in the second step, and reads the lower 2 bytes from the Io Zubi register of the chipset according to the upper address recorded in the second step. A third step of reading the upper two bytes; And
상기 제1 단계에서 읽어들인 하위 어드레스에 4를 더하여 상기 리드 베이스 어드레스 로우 레지스터에 기록하고, 새로이 기록된 하위 어드레스값에 따라 상기 제3 단계를 반복하는 제4 단계를 포함하는 마벨 칩셋을 구비한 무선랜 모듈에서 데 이터를 읽는 방법을 제공한다.And a fourth step of repeating the third step according to the newly written lower address value by adding 4 to the lower address read in the first step and writing to the read base address row register. It provides a way to read data from the LAN module.
이 방법에서, 상기 제4 단계는, 읽어 들여야 하는 상기 커맨드 리스폰스를 모두 읽어들일 때까지 반복되는 것을 특징으로 한다.In this method, the fourth step is repeated until all the command responses to be read are read.
또한, 본 발명은, 마벨 칩셋을 구비한 무선랜 모듈에서 웨이트 신호를 사용할 수 없는 경우 데이터를 읽는 방법에 있어서,The present invention also provides a method of reading data when a weight signal is not available in a WLAN module having a Marvell chipset.
상기 칩셋의 에스큐유 리드 베이스 어드레스 로우(SQU Read Base Address Low) 레지스터 및 에스큐유 리드 베이스 어드레스 하이(SQU Read Base Address High) 레지스터에서, 읽어 들여야 하는 수신 데이터 패킷(rx data packet)의 하위/상위 어드레스를 각각 읽어 들이는 제1 단계;In the SQU Read Base Address Low register and the SQU Read Base Address High register of the chipset, a lower / higher address of a rx data packet to be read. First step of reading each;
상기 제1 단계에서 읽어 들인 수신 데이터 패킷의 하위/상위 어드레스를 각각 상기 칩셋의 리드 베이스 어드레스 로우(Read Base Address Low) 레지스터 및 리드 베이스 어드레스 하이(Read Base Address High) 레지스터에 기록하는 제2 단계;A second step of writing a lower / higher address of the received data packet read in the first step into a read base address low register and a read base address high register of the chipset, respectively;
상기 제2 단계에서 기록된 하위 어드레스에 따라 상기 칩셋의 아이오 쥐비(I/O GB) 레지스터에서 하위 2바이트를 읽어 들이고, 상기 제2 단계에서 기록된 상위 어드레스에 따라 상기 칩셋의 상기 아이오 쥐비 레지스터에서 상위 2바이트를 읽어 들이는 제3 단계; 및Reads the lower 2 bytes from the I / O GB register of the chipset according to the lower address written in the second step, and reads the lower 2 bytes from the Io Zubi register of the chipset according to the upper address recorded in the second step. A third step of reading the upper two bytes; And
상기 제1 단계에서 읽어들인 하위 어드레스에 4를 더하여 상기 리드 베이스 어드레스 로우 레지스터에 기록하고, 새로이 기록된 하위 어드레스값에 따라 상기 제3 단계를 반복하는 제4 단계를 포함하는 마벨 칩셋을 구비한 무선랜 모듈에서 데이터를 읽는 방법을 제공한다.And a fourth step of repeating the third step according to the newly written lower address value by adding 4 to the lower address read in the first step and writing to the read base address row register. Provides a way to read data from the LAN module.
이 방법에서, 상기 제4 단계는, 읽어 들여야 하는 상기 수신 데이터 패킷을 모두 읽어들일 때까지 반복되는 것을 특징으로 한다.In this method, the fourth step is repeated until all the received data packets to be read are read out.
마벨 칩셋은 8305, 8381 및 8385 등의 종류에 따라 일부의 기능 차이가 존재하지만, 공통적으로 내부 메모리로부터 커맨드 리스폰스(Command Response)와 수신 데이터 패킷(rx date packet)을 읽어들이기 위한 여러가지 통로를 제공한다. 일반적으로 커맨드 리스폰스를 읽어들이기 위한 통로로는 커맨드 레지스터(register)를 이용하며, 수신 데이터 패킷을 읽어들이기 위한 통로로는 아이오(I/O) 레지스터를 이용한다. 이와 같은 일반적인 데이터를 읽어들이는 방법은 웨이트 신호를 이용할 수 없는 경우 전술한 종래기술의 문제점을 나타낸다.Marvell chipsets have some functional differences according to types such as 8305, 8381, and 8385, but they provide various paths for reading command response and rx date packet from internal memory. . In general, a command register is used as a path for reading a command response, and an I / O register is used as a path for reading a received data packet. This general method of reading data represents the problem of the prior art described above when the weight signal is not available.
상기 커맨드 레지스터 및 아이오 레지스터와는 별도로 내부 메모리를 읽어들일 수 있는 통로로 아이오 쥐비 레지스터(I/O GB Register)를 이용하는 방법이 있다. 이 아이오 쥐비 레지스터는 일반적으로는 사용되지 않는 레지스터이다.There is a method of using the I / O GB register as a path through which the internal memory can be read separately from the command register and the IO register. This Io Jubi register is a register that is not normally used.
본 발명의 발명자들은 마벨 칩셋을 갖는 모선랜 모듈에 대한 연구 개발을 통해, 마벨 칩셋의 아이오 쥐비 레지스터를 통해 데이터를 읽어들이는 경우, 웨이트 신호를 이용할 수 없는 경우에도 정상적으로 데이터를 읽어들일 수 있다는 것을 발견하였으며, 마벨 칩셋의 아이오 쥐비 레지스터를 통해 데이터를 읽어들이기 위한 방법을 찾아 내었다.The inventors of the present invention have researched and developed a mother module having a Marvell chipset, and when reading data through the Io Zubi register of the Marvell chipset, the data can be read normally even when the weight signal is not available. I found a way to read data through the Marvell chipset's Io Zubi register.
이하에서는 첨부된 도면을 참조하여, 본 발명에 따른 마벨 칩셋을 구비한 무선랜 모듈에서 데이터를 읽는 방법을 더욱 상세하게 설명한다.Hereinafter, with reference to the accompanying drawings, a method of reading data in a WLAN module having a Marvell chipset according to the present invention will be described in more detail.
도 3은 본 발명에 따른 커맨드 리스폰스를 읽어들이는 방법을 도시한 순서도이다.3 is a flowchart illustrating a method of reading a command response according to the present invention.
먼저, 마벨 칩셋의 에스큐유 커맨드 리드 베이스 어드레스 로우(SQU Command Read Base Address Low) 레지스터값을 읽어들이고(S31), 에스큐유 커맨드 리드 베이스 어드레스 하이(SQU Command Read Base Address High) 레지스터값을 읽어 들인다(S32). 상기 에스큐유 커맨드 리드 베이스 어드레스 로우 레지스터는 읽어 들이고자 하는 커맨드 리스폰스의 하위 어드레스를 기록하는 레지스터이며, 상기 에스큐유 커맨드 리드 베이스 어드레스 하이 레지스터는 읽어 들이고자 하는 커맨드 리스폰스의 상위 어드레스를 기록하는 레지스터이다. 즉, 이 과정을 통해 읽어 들이고자 하는 커맨드 리스폰스의 하위/상위의 주소를 읽어 들이게 되는 것이다. 이 때 읽어 들인 커맨드 리스폰스의 하위/상위 어드레스는 프로그램 상의 변수에 임시 저장될 수 있다.First, the SQU Command Read Base Address Low register value of the Marvell chipset is read (S31), and the SQU Command Read Base Address High register value is read (SQU Command Read Base Address Low). S32). The SQU command read base address row register is a register for recording a lower address of a command response to be read, and the SQU command read base address high register is a register for recording a high address of a command response to be read. In other words, this process reads the lower / higher addresses of the command response that you want to read. At this time, the low / high address of the command response read may be temporarily stored in a variable in the program.
다음으로, 상기 에스큐유 커맨드 리드 베이스 어드레스 로우 레지스터에서 읽어들인 값을 마벨 칩셋의 리드 베이스 어드레스 로우(Read Base Address Low) 레지스터에 기록하고, 상기 에스큐유 커맨드 리드 베이스 어드레스 하이 레지스터에서 읽어들인 값을 마벨 칩셋의 리드 베이스 어드레스 하이(Read Base Address High) 레지스터에 기록한다(S33).Next, the value read from the SQU command read base address low register is written to the Read Base Address Low register of the Marvell chipset, and the value read from the SQU command read base address high register is marveled. The chip is written to the read base address high register of the chipset (S33).
다음으로, 상기 리드 베이스 어드레스 로우 레지스터에 기록된 하위 어드레스에 따라 상기 칩셋의 아이오 쥐비(I/O GB) 레지스터에서 하위 2바이트를 읽어 들이고, 상기 리드 베이스 어드레스 하이 레지스터에 기록된 상위 어드레스에 따라 상기 칩셋의 상기 아이오 쥐비 레지스터에서 상위 2바이트를 읽어 들인다(S34).Next, the lower two bytes are read from the I / O GB register of the chipset according to the lower address written in the read base address row register, and the lower two bytes are read according to the upper address written in the read base address high register. The upper two bytes are read from the Io Zubi register of the chipset (S34).
상기 아이오 쥐비 레지스터에는 읽어들여야 할 커맨드 리스폰스가 기록된 레지스터이다. 본 발명에서는 어드레스를 변경하면서 상위 2바이트 및 하위 2바이트씩 순차적으로 데이터를 읽어들인다.The I / O Zambi register is a register in which a command response to be read is recorded. In the present invention, data is sequentially read out by the upper two bytes and the lower two bytes while changing the address.
이를 위해, 다음으로 읽기가 완료되었는지 확인하고(S35), 확인 결과 읽어 들이려고 하는 커맨드 리스폰스가 모두 수신된 경우가 아니라면 상기 하위 어드레스에 4를 더하여(S46) 상기 리드 베이스 어드레스 로우 레지스터에 새로이 기록하고, 새로이 기록된 하위 어드레스값에 따라 상기 아이오 쥐비 레지스터를 읽는 동작을 수행한다. 이와 같은 동작은, 읽어들이고자 하는 커맨드 리스폰스를 모두 읽어 들일 때까지 반복해서 수행된다. 예를 들어, 총 20바이트의 커맨드 리스폰스가 수신되어야 하는 경우, 도 3에서 S34로 표시된 아이오 쥐비 레지스터를 읽는 과정은 총 5번 반복되는 것이다.To this end, it is checked whether the read is completed next (S35), and if the command response to be read is not received, adding 4 to the lower address (S46) and newly writing to the read base address row register. The read operation of the Io-Jumby register is performed according to the newly written lower address value. This operation is performed repeatedly until all command responses to be read are read. For example, if a total of 20 bytes of command response should be received, the process of reading the Io Zubi register indicated by S34 in FIG. 3 is repeated five times in total.
도 4는 본 발명에 따른 수신 데이터 패킷을 읽어들이는 방법을 도시한 순서 도이다.4 is a flowchart illustrating a method of reading a received data packet according to the present invention.
먼저, 마벨 칩셋의 에스큐유 리드 베이스 어드레스 로우(SQU Read Base Address Low) 레지스터값을 읽어들이고(S41), 에스큐유 리드 베이스 어드레스 하이(SQU Read Base Address High) 레지스터값을 읽어 들인다(S42). 상기 에스큐유 리드 베이스 어드레스 로우 레지스터는 읽어 들이고자 하는 수신 데이터 패킷의 하위 어드레스를 기록하는 레지스터이며, 상기 에스큐유 리드 베이스 어드레스 하이 레지스터는 읽어 들이고자 하는 수신 데이터 패킷의 상위 어드레스를 기록하는 레지스터이다. 즉, 이 과정을 통해 읽어 들이고자 하는 수신 데이터 패킷의 하위/상위의 주소를 읽어 들이게 되는 것이다. 이 때 읽어 들인 수신 데이터 패킷의 하위/상위 어드레스는 프로그램 상의 변수에 임시 저장될 수 있다.First, the SQU Read Base Address Low register value of the Marvell chipset is read (S41), and the SQU Read Base Address High register value is read (S42). The SQU read base address row register is a register that records a lower address of a received data packet to be read, and the SQU read base address high register is a register that records an upper address of a received data packet to be read. In other words, this process reads the lower and upper addresses of the received data packet to be read. At this time, the low / high address of the received data packet read may be temporarily stored in a variable on the program.
다음으로, 상기 에스큐유 리드 베이스 어드레스 로우 레지스터에서 읽어들인 값을 마벨 칩셋의 리드 베이스 어드레스 로우(Read Base Address Low) 레지스터에 기록하고, 상기 에스큐유 리드 베이스 어드레스 하이 레지스터에서 읽어들인 값을 마벨 칩셋의 리드 베이스 어드레스 하이(Read Base Address High) 레지스터에 기록한다(S43).Next, the value read from the SQU lead base address low register is written to the Read Base Address Low register of the Marvell chipset, and the value read from the SQU read base address high register is written to the Marvell chipset. Write to the read base address high register (S43).
다음으로, 상기 리드 베이스 어드레스 로우 레지스터에 기록된 하위 어드레스에 따라 상기 칩셋의 아이오 쥐비(I/O GB) 레지스터에서 하위 2바이트를 읽어 들이고, 상기 리드 베이스 어드레스 하이 레지스터에 기록된 상위 어드레스에 따라 상기 칩셋의 상기 아이오 쥐비 레지스터에서 상위 2바이트를 읽어 들인다(S44).Next, the lower two bytes are read from the I / O GB register of the chipset according to the lower address written in the read base address row register, and the lower two bytes are read according to the upper address written in the read base address high register. The upper two bytes are read from the Io Zubi register of the chipset (S44).
상기 아이오 쥐비 레지스터에는 읽어들여야 할 수신 데이터 패킷이 기록된 레지스터이다. 본 발명에서는 어드레스를 변경하면서 상위 2바이트 및 하위 2바이트씩 순차적으로 데이터를 읽어들인다.The Io Jubi register is a register in which received data packets to be read are recorded. In the present invention, data is sequentially read out by the upper two bytes and the lower two bytes while changing the address.
이를 위해, 다음으로 읽기가 완료되었는지 확인하고(S45), 확인 결과 읽어 들이려고 하는 수신 데이터 패킷이 모두 수신된 경우가 아니라면 상기 하위 어드레스에 4를 더하여(S46) 상기 리드 베이스 어드레스 로우 레지스터에 새로이 기록하고, 새로이 기록된 하위 어드레스값에 따라 상기 아이오 쥐비 레지스터를 읽는 동작을 수행한다. 이와 같은 동작은, 읽어들이고자 하는 수신 데이터 패킷을 모두 읽어 들일 때까지 반복해서 수행된다. 예를 들어, 총 2 킬로바이트의 커맨드 리스폰스가 수신되어야 하는 경우, 도 4에서 S44로 표시된 아이오 쥐비 레지스터를 읽는 과정은 총 500번 반복되는 것이다.To this end, it is checked whether the read is completed next (S45), and if not all received data packets to be read are received, 4 is added to the lower address (S46) and newly written to the read base address row register. And reads the Io Zumby register according to the newly written lower address value. This operation is repeatedly performed until all the received data packets to be read are read. For example, if a total of 2 kilobyte command responses are to be received, the process of reading the Io Zumby register indicated by S44 in FIG. 4 is repeated 500 times in total.
본 발명의 발명자들은, 전술한 바와 같은 아이오 쥐비 레지스터를 이용하여 커맨드 리스폰스 및 수신 데이터 패킷을 읽어들이는 방법이, 도 2의 (b)에 도시된 것과 같이 웨이트 신호를 수신하지 못하는 경우 발생하는 문제점을 해결하여, 도 2의 (a)와 같은 정상 데이터를 읽어들일 수 있음을 확인하였다.The inventors of the present invention have a problem that the method of reading the command response and the received data packet using the Io Zubi register as described above does not receive the weight signal as shown in FIG. It was confirmed that the normal data as shown in FIG. 2 (a) can be read.
이상에서 설명한 바와 같이, 본 발명에 따르면, MSM6500과 같이 웨이트 신호를 사용할 수 없는 프로세서를 이용한 경우에도 마벨 칩셋을 구비한 무선랜 모듈에서 정상적으로 데이터의 읽기가 가능한 효과가 있다.As described above, according to the present invention, even when using a processor that cannot use the weight signal, such as the MSM6500, the WLAN module having the Marvell chipset can normally read data.
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