JPH1116917A - Bump forming method and apparatus - Google Patents
Bump forming method and apparatusInfo
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Abstract
(57)【要約】
【課題】 効率的にしかも適正かつ確実にバンプを形成
し得るバンプ形成方法及び接合装置を提供する。
【解決手段】 2つ以上のダイシングした半導体チップ
Sまたはプリント基板を所定位置に位置決め配置し、一
括で導電性ボールを用いたバンプを形成する。半導体チ
ップSまたはプリント基板の電極部とボール配列手段に
よって配列保持された導電性ボールとを位置合わせする
ための位置出し手段を含んでいる。位置出し手段は、各
半導体チップSに対応した位置に凹溝11が形成されて
成るトレー10を含んでいる。2つ以上のダイシングし
た半導体チップSを用いることにより、複数個同時にバ
ンプ形成を行うことで生産性を格段に向上させることが
できる。
PROBLEM TO BE SOLVED: To provide a bump forming method and a bonding apparatus capable of forming a bump efficiently, appropriately and reliably. SOLUTION: Two or more diced semiconductor chips S or printed circuit boards are positioned and arranged at predetermined positions, and bumps using conductive balls are collectively formed. Positioning means for aligning the semiconductor chip S or the electrode portion of the printed circuit board with the conductive balls arranged and held by the ball arranging means is included. The positioning means includes a tray 10 in which a concave groove 11 is formed at a position corresponding to each semiconductor chip S. By using two or more diced semiconductor chips S, a plurality of bumps can be formed at the same time, thereby significantly improving productivity.
Description
【0001】[0001]
【発明の属する技術分野】本発明は、半導体チップの電
極やプリント基板等に微小金属ボールで成るバンプを形
成するための方法および装置に関するものである。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a method and an apparatus for forming bumps made of minute metal balls on electrodes of a semiconductor chip, printed circuit boards, and the like.
【0002】[0002]
【従来の技術】従来より半導体チップの電極と外部回路
等との接合媒体となるバンプとして、ウェハバンプ,ス
タッドバンプおよび転写バンプ等が知られている。近
年、半導体装置の高密度化に伴って、電極の狭ピッチ化
あるいはバンプの微小化が進んでいる。バンプを形成す
べき微小金属ボールを予め半導体チップの電極と同一座
標に配列させ、それを一括で電極上に接合するようにし
たバンプの形成方法が実用化されつつある。2. Description of the Related Art Conventionally, wafer bumps, stud bumps, transfer bumps, and the like have been known as bumps serving as bonding media between electrodes of a semiconductor chip and external circuits. In recent years, as the density of semiconductor devices has increased, the pitch of electrodes has been reduced or the size of bumps has been reduced. A bump forming method in which minute metal balls on which bumps are to be formed are arranged in advance at the same coordinates as electrodes of a semiconductor chip, and the bumps are collectively bonded on the electrodes is being put to practical use.
【0003】例えば本出願人はすでに、特開平7−15
37675号公報により開示されるように、半導体チッ
プの電極パッドと同一位置となるように微小金属ボール
が配列されている配列基板から、半導体チップ1つ分の
金属ボール群を一括でピックアップし、これを接合用ス
テージまで搬送し、被接合部に接合するようにしたバン
プ形成方法を提案した。[0003] For example, the present applicant has already disclosed in
As disclosed in Japanese Patent No. 37675, a metal ball group for one semiconductor chip is collectively picked up from an array substrate on which minute metal balls are arrayed at the same position as the electrode pads of the semiconductor chip. A method of forming a bump, in which the substrate is transported to a joining stage and joined to a portion to be joined, is proposed.
【0004】[0004]
【発明が解決しようとする課題】ところで、上述のよう
な従来のバンプ形成方法において、ダイシングした半導
体チップを接合ステージに1つずつ配置し、各半導体チ
ップにバンプを形成するようにしている。従って、従来
方法においては製造効率もしくは生産性の点で改善の余
地があった。In the above-described conventional bump forming method, dicing semiconductor chips are arranged one by one on a bonding stage, and bumps are formed on each semiconductor chip. Therefore, the conventional method has room for improvement in terms of manufacturing efficiency or productivity.
【0005】また、従来ウェハ段階で、つまりウェハを
ダイシングする前の状態で1つ以上の半導体チップにバ
ンプを形成するものが知られている。しかしながら、そ
のウェハ内に不良品半導体チップが含まれている場合に
は、良品の半導体チップのみならず不良品半導体チップ
にもバンプを形成してしまう。この方法においても高い
生産性を実現するのが難しかった。[0005] Conventionally, bumps are formed on one or more semiconductor chips at the wafer stage, that is, before dicing the wafer. However, if a defective semiconductor chip is included in the wafer, bumps are formed not only on good semiconductor chips but also on defective semiconductor chips. Even with this method, it was difficult to achieve high productivity.
【0006】本発明はかかる実情に鑑み、効率的にしか
も適正かつ確実にバンプを形成し得るバンプ形成方法及
び接合装置を提供することを目的とする。The present invention has been made in view of the above circumstances, and has as its object to provide a bump forming method and a bonding apparatus capable of forming a bump efficiently, appropriately, and reliably.
【0007】[0007]
【課題を解決するための手段】本発明によるバンプ形成
方法は、2つ以上のダイシングした半導体チップまたは
プリント基板を所定位置に位置決め配置し、一括で導電
性ボールを用いたバンプを形成する。According to the bump forming method of the present invention, two or more diced semiconductor chips or printed circuit boards are positioned and arranged at predetermined positions, and bumps are formed at once using conductive balls.
【0008】また、本発明によるバンプ形成方法は、2
つ以上のダイシングした半導体チップまたはプリント基
板の電極部に対応する位置に導電性ボールを配列保持す
る工程と、半導体チップまたはプリント基板の電極部と
配列保持された前記導電性ボールとを位置合わせする工
程と、配列保持された前記導電性ボールを半導体チップ
またはプリント基板の電極部に転写接合する工程と、を
含んでいる。また、本発明によるバンプ形成方法におい
て、前記配列保持された導電性ボールの配列状態を検査
する工程を、さらに含んでいることを特徴とする。[0008] Further, the bump forming method according to the present invention comprises the steps of:
Arranging and holding conductive balls at positions corresponding to one or more diced semiconductor chips or printed circuit board electrode portions, and aligning the semiconductor chip or printed circuit board electrode portions with the arrayed and held conductive balls. And a step of transferring and joining the conductive balls held in alignment to an electrode portion of a semiconductor chip or a printed circuit board. The method of forming a bump according to the present invention may further include a step of inspecting an arrangement state of the conductive balls held in the arrangement.
【0009】また、本発明によるバンプ形成装置は、2
つ以上のダイシングした半導体チップまたはプリント基
板の電極部に対応する位置に導電性ボールを配列保持す
るボール配列手段と、半導体チップまたはプリント基板
の電極部と前記ボール配列手段によって配列保持された
導電性ボールとを位置合わせするための位置出し手段
と、前記配列保持された導電性ボールを半導体チップま
たはプリント基板の電極部に転写接合する転写接合手段
と、を含んでいる。Further, the bump forming apparatus according to the present invention has a
Ball arranging means for arranging and holding conductive balls at positions corresponding to one or more diced semiconductor chips or printed circuit board electrode parts; and conductive means arranged and held by the semiconductor chip or printed circuit board electrode parts and the ball arranging means. Positioning means for positioning the ball is provided, and transfer joining means for transferring and joining the conductive balls held in alignment to an electrode portion of a semiconductor chip or a printed circuit board.
【0010】また、本発明によるバンプ形成装置におい
て、前記位置出し手段は、各半導体チップに対応した位
置に凹溝が形成されて成るトレーを含んでいることを特
徴とする。また、本発明によるバンプ形成装置におい
て、前記位置出し手段は、各半導体チップに対応した位
置に凹溝が形成されたステージを含んでいることを特徴
とする。また、本発明によるバンプ形成装置において、
前記位置出し手段は、直交および回転座標が独立に制御
可能な2つ以上のステージを含んでいることを特徴とす
る。また、本発明によるバンプ形成装置において、前記
位置出し手段は、各半導体チップを位置決めし、その位
置に吸引固定し得るように構成されたステージを含んで
いることを特徴とする。Further, in the bump forming apparatus according to the present invention, the positioning means includes a tray having a groove formed at a position corresponding to each semiconductor chip. Further, in the bump forming apparatus according to the present invention, the positioning means includes a stage in which a concave groove is formed at a position corresponding to each semiconductor chip. Further, in the bump forming apparatus according to the present invention,
The positioning means includes two or more stages whose orthogonal and rotational coordinates can be independently controlled. Further, in the bump forming apparatus according to the present invention, the positioning means includes a stage configured to position each semiconductor chip and fix the semiconductor chip at the position by suction.
【0011】本発明によれば、2つ以上のダイシングし
た半導体チップを位置決め配置し、これらの半導体チッ
プに導電性ボールを接合してバンプを形成する。ダイシ
ング後の半導体チップ、しかも良品を選択して用いるこ
とで生産性を格段に向上させることができる。ちなみに
ウェハ段階で、ダイシングする前の2つ以上の半導体チ
ップにバンプ形成する場合では、不良品の半導体チップ
が含まれるため生産効率を上げるのが難しい。According to the present invention, two or more diced semiconductor chips are positioned and arranged, and conductive balls are bonded to these semiconductor chips to form bumps. By selecting and using a semiconductor chip after dicing and a good product, the productivity can be remarkably improved. Incidentally, when bumps are formed on two or more semiconductor chips before dicing at the wafer stage, it is difficult to increase production efficiency because defective semiconductor chips are included.
【0012】また、ダイシング後の2つ以上の半導体チ
ップを所定のステージ上に位置決め配置する際、位置出
し手段によって半導体チップを相互に正確に位置決めす
ることができる。これによりボール配列手段と導電性ボ
ールの位置合わせを効率よく、正確に行うことができ
る。When two or more semiconductor chips after dicing are positioned and arranged on a predetermined stage, the semiconductor chips can be accurately positioned relative to each other by the positioning means. Thus, the alignment between the ball arranging means and the conductive balls can be performed efficiently and accurately.
【0013】なお、位置出し手段の例として、トレーま
たはステージに形成された半導体チップあるいはプリン
ト基板等の大きさよりも大きな凹溝に半導体チップある
いはプリント基板等を置き、トレーまたはステージを適
度に傾斜することで凹溝の角部で半導体チップ等の位置
合わせを行うことができる。As an example of the positioning means, a semiconductor chip or a printed board is placed in a groove larger than a semiconductor chip or a printed board formed on the tray or the stage, and the tray or the stage is appropriately inclined. Thus, the positioning of the semiconductor chip or the like can be performed at the corners of the concave groove.
【0014】[0014]
【発明の実施の形態】以下、図面に基づき、本発明によ
るバンプ形成方法およびその装置の好適な実施の形態を
説明する。この実施形態において、2つ以上のダイシン
グした半導体チップを所定位置に位置決め配置し、一括
で導電性ボールを用いたバンプを形成する。図1のよう
にウェハWがダイシングされる。ダイシングされた半導
体チップSは、図2のように搬送ヘッド100によって
ステージ1上の所定位置に位置決め配置される。搬送ヘ
ッド100は、ダイシングされたウェハWのうちから選
択された良品の半導体チップSのみをステージ1に配置
する。このとき2つ以上の搬送ヘッド100を用いれ
ば、2つ以上の半導体チップSを迅速に配置することが
できる。DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS Preferred embodiments of a bump forming method and apparatus according to the present invention will be described below with reference to the drawings. In this embodiment, two or more diced semiconductor chips are positioned and arranged at predetermined positions, and bumps using conductive balls are collectively formed. The wafer W is diced as shown in FIG. The diced semiconductor chip S is positioned and arranged at a predetermined position on the stage 1 by the transfer head 100 as shown in FIG. The transfer head 100 arranges only the good semiconductor chips S selected from the diced wafers W on the stage 1. At this time, if two or more transport heads 100 are used, two or more semiconductor chips S can be quickly arranged.
【0015】また、図3のようにバンプを形成すべき導
電性ボールBを配列保持するボール配列手段として、ボ
ール配列ヘッド200を備えている。配列ヘッド200
は、2つ以上の半導体チップSの電極部に対応する多数
のボール配列孔201aを有する配列基板201を備
え、吸引チャンバ202を介して真空引されるようにな
っている。吸引チャンバ202には、真空吸引源として
の真空ポンプ203が接続され、図示のようにボール配
列ヘッド200は、そのボール配列孔201aにて導電
性ボールBを配列保持する。Further, as shown in FIG. 3, a ball array head 200 is provided as a ball array means for arraying and holding conductive balls B on which bumps are to be formed. Array head 200
Is provided with an array substrate 201 having a large number of ball array holes 201a corresponding to the electrode portions of two or more semiconductor chips S, and is evacuated via a suction chamber 202. A vacuum pump 203 as a vacuum suction source is connected to the suction chamber 202, and the ball arrangement head 200 arranges and holds the conductive balls B in the ball arrangement holes 201a as shown in the drawing.
【0016】ボール配列ヘッド200は図示しない移動
搬送機構によって、図4のように水平および上下方向に
移動可能に支持されている。導電性ボールBの供給部で
導電性ボールBを配列保持したボール配列ヘッド200
は、この移動搬送機構によってステージ1まで搬送され
る。ボール配列ヘッド200は、ステージ1上の所定位
置に位置決め配置されている半導体チップSに対して位
置合わせされながら、導電性ボールBを対応する半導体
チップSに接合するように構成される。The ball array head 200 is supported by a moving transport mechanism (not shown) so as to be movable in the horizontal and vertical directions as shown in FIG. Ball arrangement head 200 in which conductive balls B are arranged and held in a supply section of conductive balls B
Is transported to the stage 1 by this moving transport mechanism. The ball array head 200 is configured to join the conductive balls B to the corresponding semiconductor chips S while being aligned with the semiconductor chips S positioned and arranged at predetermined positions on the stage 1.
【0017】搬送ヘッド100によって半導体チップS
をステージ1に配置する際、図5に示したように各半導
体チップSに対応した位置に凹溝11が形成されて成る
トレー10を使用する。このトレー10は、半導体チッ
プSの電極部と、ボール配列ヘッド200によって配列
保持された導電性ボールBとを位置合わせするための位
置合わせ手段として機能する。凹溝11はそれ自体、お
よび相互間で高い寸法精度で形成されており、半導体チ
ップSを正確に位置決めすることができる。The semiconductor chip S is transported by the transport head 100.
Is arranged on the stage 1, a tray 10 having a concave groove 11 formed at a position corresponding to each semiconductor chip S as shown in FIG. 5 is used. The tray 10 functions as a positioning unit for positioning the electrode portions of the semiconductor chip S and the conductive balls B arranged and held by the ball arrangement head 200. The concave groove 11 is formed with high dimensional accuracy between itself and each other, so that the semiconductor chip S can be accurately positioned.
【0018】トレー10に形成される凹溝11は好まし
くは、図6に示したように適度なテーパ状に形成された
ガイド部12を有する。このようなガイド部12を設け
ることで半導体チップSを凹溝11に円滑にセットする
ことができる。なお、これらの凹溝11およびガイド部
12は、別体のトレー10を用いずに、すなわちステー
ジ1自体に予め形成しておくこともできる。The concave groove 11 formed in the tray 10 preferably has a guide portion 12 formed in an appropriate tapered shape as shown in FIG. By providing such a guide portion 12, the semiconductor chip S can be set smoothly in the concave groove 11. Note that these concave grooves 11 and guide portions 12 may be formed in advance without using the separate tray 10, that is, in the stage 1 itself.
【0019】前述のようにステージ1上には、2つ以上
のダイシングした半導体チップSが配置される。図7は
その場合の半導体チップSの配置例を示すもので、4つ
の半導体チップS1 〜S4 を正方形状に(図7
(A))、あるいは4つの半導体チップS1 〜S4 を列
設するかたちで(図7(B))配置する。なお、これら
図示した配置例に限らず、2つ以上のダイシングした半
導体チップSを所定位置に位置決め配置してもよい。As described above, two or more diced semiconductor chips S are arranged on the stage 1. FIG. 7 shows an example of the arrangement of the semiconductor chips S in that case. The four semiconductor chips S1 to S4 are squared (FIG. 7).
(A)) or four semiconductor chips S1 to S4 are arranged in a row (FIG. 7B). The arrangement is not limited to the illustrated arrangement example, and two or more diced semiconductor chips S may be positioned and arranged at predetermined positions.
【0020】あるいはまた、トレー10またはステージ
1に2つ以上の半導体チップあるいはプリント基板等を
並べる際、たとえば図8に示すように対象とする半導体
チップSあるいはプリント基板等の大きさよりも大きな
凹溝11を形成する。この凹溝11にまず、図8(A)
のように半導体チップS1 〜S4 あるいはプリント基板
等を置き、トレー10またはステージ1を適度に傾斜す
ることで凹溝11の角部で半導体チップS1 〜S4 等の
位置合わせを行う(図8(B))。Alternatively, when arranging two or more semiconductor chips or printed boards on the tray 10 or the stage 1, for example, as shown in FIG. 8, a concave groove larger than the size of the target semiconductor chip S or printed board or the like. 11 is formed. First, as shown in FIG.
The semiconductor chips S1 to S4 or the printed circuit board are placed as described above, and the tray 10 or the stage 1 is appropriately inclined to align the semiconductor chips S1 to S4 at the corners of the concave groove 11 (FIG. 8B )).
【0021】凹溝11内で半導体チップS1 〜S4 等を
位置合わせする際、図8(B)のように半導体チップS
1 〜S4 をその背面側から吸引孔13で吸引固定する。
そしてこの位置決め状態を保持しながら、図8(C)の
ようにトレー10またはステージ1が元の状態位置に戻
される。When aligning the semiconductor chips S1 to S4 and the like in the concave groove 11, as shown in FIG.
1 to S4 are suction-fixed from the back side by suction holes 13.
Then, while maintaining this positioning state, the tray 10 or the stage 1 is returned to the original state position as shown in FIG.
【0022】一方、ボール配列ヘッド200は導電性ボ
ールBの供給部において、バンプを形成するための導電
性ボールBを収容する容器20上方から、所定タイミン
グで該容器20内に下降する(図9(A))。さらに、
図9(B)のように吸引チャンバ202を介して真空引
することで、配列基板201のボール配列孔201aに
て導電性ボールBを配列保持する。なお、配列基板20
1のボール配列孔201aに導電性ボールBを吸着させ
る際、容器20を加振することで容器20内で導電性ボ
ールBを浮遊状態にし、吸着し易くする等の手段がとら
れる。On the other hand, the ball arrangement head 200 descends at a predetermined timing into the container 20 from above the container 20 for accommodating the conductive balls B for forming bumps in the conductive ball B supply section (FIG. 9). (A)). further,
As shown in FIG. 9B, the conductive balls B are arranged and held in the ball arrangement holes 201a of the arrangement substrate 201 by evacuating through the suction chamber 202. The array substrate 20
When the conductive balls B are adsorbed to the one ball arrangement hole 201a, a measure is taken such that the conductive balls B are floated in the container 20 by vibrating the container 20 to facilitate the adsorption.
【0023】図9(C)のように配列基板201の各ボ
ール配列孔201aに1つの導電性ボールBが吸着され
る。ここで、導電性ボールBを吸着する際、配列基板2
01から余剰ボールを除去して各ボール配列孔201a
に1つの導電性ボールBを吸着させるための余剰ボール
除去手段をさらに含んでいる。この余剰ボール除去手段
は例えば、配列基板201に微振動を与えることにより
余分な導電性ボールBを配列基板201から離脱させる
ように構成することができる。As shown in FIG. 9C, one conductive ball B is sucked into each ball array hole 201a of the array substrate 201. Here, when adsorbing the conductive balls B, the arrangement substrate 2
01 to remove the extra balls from each ball arrangement hole 201a.
Further includes a surplus ball removing means for adsorbing one conductive ball B. The surplus ball removing means can be configured, for example, to apply a minute vibration to the array substrate 201 so that the extra conductive balls B are separated from the array substrate 201.
【0024】さらに、上記のように配列基板201に配
列保持された導電性ボールBの配列状態が検査される。
この場合、図9(C)に示すように配列基板201の下
方から画像認識手段(TVカメラ)30により導電性ボ
ールBの配列状態を撮影し、配列状態の良否を確認する
ことができる。Further, the arrangement state of the conductive balls B arranged and held on the arrangement substrate 201 as described above is inspected.
In this case, as shown in FIG. 9C, the arrangement state of the conductive balls B can be photographed from below the arrangement substrate 201 by the image recognition means (TV camera) 30, and the quality of the arrangement state can be confirmed.
【0025】導電性ボールBを適正に配列保持したボー
ル配列ヘッド200は、ステージ1上の半導体チップS
に対して位置合わせされながら降下し、これにより導電
性ボールBを対応する各半導体チップSの電極に接合す
ることができる。The ball array head 200 in which the conductive balls B are properly arranged and held is mounted on the semiconductor chip S on the stage 1.
, And the conductive balls B can be joined to the electrodes of the corresponding semiconductor chips S.
【0026】このように2つ以上のダイシングした半導
体チップSをステージ1上に位置決め配置し、これらの
半導体チップSに導電性ボールBを接合してバンプを形
成する。ダイシング後の良品の半導体チップSを用いる
ことで、製造工程から不良品を除くことができ生産性を
格段に向上させることができる。The two or more diced semiconductor chips S are positioned and arranged on the stage 1, and conductive balls B are bonded to these semiconductor chips S to form bumps. By using non-defective semiconductor chips S after dicing, defective products can be removed from the manufacturing process, and productivity can be significantly improved.
【0027】上記実施形態における位置出し手段の他の
態様として、直交(x−y)および回転座標(θ)が独
立に制御可能な2つ以上のステージを含んでいる。この
場合1つのステージ上で1つの半導体チップを位置決め
配置して導電性ボールBを接合し、つぎのステージ上で
つぎの半導体チップを位置決め配置して導電性ボールB
を接合し、この操作が必要回数だけ繰り返される。位置
出し手段のさらに別の態様として、各半導体チップを位
置決めし、その位置に吸引固定し得るように構成された
ステージを含んでいる。Another aspect of the positioning means in the above embodiment includes two or more stages whose orthogonal (xy) and rotational coordinates (θ) can be independently controlled. In this case, one semiconductor chip is positioned and arranged on one stage to join the conductive balls B, and the next semiconductor chip is positioned and arranged on the next stage to form the conductive balls B.
And this operation is repeated as many times as necessary. As still another aspect of the positioning means, the positioning means includes a stage configured to position each semiconductor chip and fix the semiconductor chip at the position.
【0028】上記実施形態においては、半導体チップの
電極にバンプを形成する例を説明した。本発明によれば
2つ以上の半導体チップは、同種のものである必要はな
く、異なる種類の半導体チップを含んでいてもよい。半
導体チップの場合に限らず、たとえばプリント基板等に
対しても本発明を有効を適用可能であり、上記実施形態
と同様な作用効果を得ることができる。In the above embodiment, the example in which the bumps are formed on the electrodes of the semiconductor chip has been described. According to the invention, the two or more semiconductor chips need not be of the same type, but may include different types of semiconductor chips. The present invention is not limited to the case of the semiconductor chip, but can be applied to, for example, a printed circuit board or the like, and the same operational effects as those of the above embodiment can be obtained.
【0029】[0029]
【発明の効果】以上説明したように本発明によれば、こ
の種のバンプを形成する際、2つ以上のダイシングした
半導体チップを用いることにより、複数個同時にバンプ
形成を行うことで生産性を格段に向上させることができ
る。この場合、良品の半導体チップを選択可能としたこ
とで、100%近くまで良品率を高めよく、歩留り向上
を図ることができる等の利点を有している。As described above, according to the present invention, when this kind of bump is formed, by using two or more diced semiconductor chips, a plurality of bumps are simultaneously formed to improve productivity. It can be significantly improved. In this case, since a non-defective semiconductor chip can be selected, the non-defective product rate can be increased to nearly 100%, and the yield can be improved.
【図1】本発明におけるウェハダイシング工程を示す斜
視図である。FIG. 1 is a perspective view showing a wafer dicing step in the present invention.
【図2】本発明におけるダイシング後の半導体チップの
位置決め配置工程を示す斜視図である。FIG. 2 is a perspective view showing a step of positioning and arranging a semiconductor chip after dicing in the present invention.
【図3】本発明に係るボール配列ヘッドの構成例を示す
図である。FIG. 3 is a diagram showing a configuration example of a ball array head according to the present invention.
【図4】本発明におけるボール配列ヘッドの移動搬送の
様子を示す図である。FIG. 4 is a diagram showing a state of moving and transporting a ball array head according to the present invention.
【図5】本発明に係る半導体チップのためのトレーの構
成例を示す図である。FIG. 5 is a diagram showing a configuration example of a tray for a semiconductor chip according to the present invention.
【図6】本発明に係る上記トレーの凹溝の構成例を示す
図である。FIG. 6 is a view showing a configuration example of a concave groove of the tray according to the present invention.
【図7】本発明におけるステージ上の半導体チップの配
置例を示す平面図である。FIG. 7 is a plan view showing an example of the arrangement of semiconductor chips on a stage according to the present invention.
【図8】本発明におけるステージ等での半導体チップ等
の位置決め手段の例を示すそれぞれ斜視図である。FIG. 8 is a perspective view showing an example of positioning means for a semiconductor chip or the like on a stage or the like in the present invention.
【図9】本発明に係るボール配列ヘッドのボール配列工
程を順に示す図である。FIG. 9 is a view sequentially showing a ball arrangement step of the ball arrangement head according to the present invention.
1 ステージ 10 トレー 11 凹溝 12 ガイド部 20 ボール容器 100 搬送ヘッド 200 ボール配列ヘッド 201 配列基板 201a ボール配列孔 202 吸引チャンバ 203 真空ポンプ B 導電性ボール S 半導体チップ Reference Signs List 1 stage 10 tray 11 concave groove 12 guide section 20 ball container 100 transfer head 200 ball array head 201 array substrate 201a ball array hole 202 suction chamber 203 vacuum pump B conductive ball S semiconductor chip
───────────────────────────────────────────────────── フロントページの続き (72)発明者 菊地 利治 川崎市中原区井田3−35−1 新日本製鐵 株式会社技術開発本部内 ────────────────────────────────────────────────── ─── Continuing from the front page (72) Inventor Toshiharu Kikuchi 3-35-1 Ida, Nakahara-ku, Kawasaki-shi Nippon Steel Corporation Technology Development Division
Claims (8)
またはプリント基板を所定位置に位置決め配置し、一括
で導電性ボールを用いたバンプを形成することを特徴と
するバンプ形成方法。1. A bump forming method comprising: positioning at least two diced semiconductor chips or printed boards at predetermined positions; and forming bumps using conductive balls at a time.
またはプリント基板の電極部に対応する位置に導電性ボ
ールを配列保持する工程と、 半導体チップまたはプリント基板の電極部と、配列保持
された前記導電性ボールとを位置合わせする工程と、 配列保持された前記導電性ボールを半導体チップまたは
プリント基板の電極部に転写接合する工程と、を含んで
いることを特徴とするバンプ形成方法。2. A step of arranging and holding conductive balls at positions corresponding to two or more diced semiconductor chips or electrode parts of a printed board; and an electrode part of the semiconductor chip or printed board; A step of aligning conductive balls with each other, and a step of transferring and bonding the conductive balls held in alignment to an electrode portion of a semiconductor chip or a printed circuit board.
状態を検査する工程を、さらに含んでいることを特徴と
する請求項2に記載のバンプ形成方法。3. The bump forming method according to claim 2, further comprising a step of inspecting an arrangement state of the conductive balls held in the arrangement.
またはプリント基板の電極部に対応する位置に導電性ボ
ールを配列保持するボール配列手段と、 半導体チップまたはプリント基板の電極部と前記ボール
配列手段によって配列保持された導電性ボールとを位置
合わせするための位置出し手段と、 前記配列保持された導電性ボールを半導体チップまたは
プリント基板の電極部に転写接合する転写接合手段と、
を含んでいることを特徴とするバンプ形成装置。4. A ball arranging means for arranging and holding conductive balls at positions corresponding to two or more diced semiconductor chips or electrode parts of a printed circuit board; and an electrode part of the semiconductor chip or printed circuit board and the ball arranging means. Positioning means for aligning the aligned and held conductive balls, Transfer joining means for transferring and joining the aligned and held conductive balls to an electrode portion of a semiconductor chip or a printed circuit board,
A bump forming apparatus comprising:
て、 前記位置出し手段は、各半導体チップに対応した位置に
凹溝が形成されて成るトレーを含んでいることを特徴と
するバンプ形成装置。5. The bump forming apparatus according to claim 4, wherein said positioning means includes a tray having a groove formed at a position corresponding to each semiconductor chip. .
て、 前記位置出し手段は、各半導体チップに対応した位置に
凹溝が形成されたステージを含んでいることを特徴とす
るバンプ形成装置。6. The bump forming apparatus according to claim 4, wherein said positioning means includes a stage in which a concave groove is formed at a position corresponding to each semiconductor chip.
て、 前記位置出し手段は、直交および回転座標が独立に制御
可能な2つ以上のステージを含んでいることを特徴とす
るバンプ形成装置。7. The bump forming apparatus according to claim 4, wherein said positioning means includes two or more stages whose orthogonal and rotational coordinates can be independently controlled.
て、 前記位置出し手段は、各半導体チップを位置決めし、そ
の位置に吸引固定し得るように構成されたステージを含
んでいることを特徴とするバンプ形成装置。8. The bump forming apparatus according to claim 4, wherein said positioning means includes a stage configured to position each semiconductor chip and to fix said semiconductor chip by suction. Bump forming equipment.
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18172597A JPH1116917A (en) | 1997-06-23 | 1997-06-23 | Bump forming method and apparatus |
| PCT/JP1997/002996 WO1998009323A1 (en) | 1996-08-29 | 1997-08-28 | Method and device for forming very small ball bump |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18172597A JPH1116917A (en) | 1997-06-23 | 1997-06-23 | Bump forming method and apparatus |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH1116917A true JPH1116917A (en) | 1999-01-22 |
Family
ID=16105796
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18172597A Pending JPH1116917A (en) | 1996-08-29 | 1997-06-23 | Bump forming method and apparatus |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH1116917A (en) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100425946B1 (en) * | 2002-02-20 | 2004-04-01 | 주식회사 칩팩코리아 | METHOD FOR FORMING Au STUD BUMP OF FLIP CHIP PACKAGE |
| JP2011077493A (en) * | 2009-02-10 | 2011-04-14 | Hioki Ee Corp | Substrate manufacturing apparatus, substrate manufacturing method, spherical body-mounted substrate, and electronic component-mounted substrate |
-
1997
- 1997-06-23 JP JP18172597A patent/JPH1116917A/en active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100425946B1 (en) * | 2002-02-20 | 2004-04-01 | 주식회사 칩팩코리아 | METHOD FOR FORMING Au STUD BUMP OF FLIP CHIP PACKAGE |
| JP2011077493A (en) * | 2009-02-10 | 2011-04-14 | Hioki Ee Corp | Substrate manufacturing apparatus, substrate manufacturing method, spherical body-mounted substrate, and electronic component-mounted substrate |
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Legal Events
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|---|---|---|---|
| A131 | Notification of reasons for refusal |
Effective date: 20050517 Free format text: JAPANESE INTERMEDIATE CODE: A131 |
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| A521 | Written amendment |
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| A02 | Decision of refusal |
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