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JPH031681A - image recording device - Google Patents

image recording device

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Publication number
JPH031681A
JPH031681A JP1135558A JP13555889A JPH031681A JP H031681 A JPH031681 A JP H031681A JP 1135558 A JP1135558 A JP 1135558A JP 13555889 A JP13555889 A JP 13555889A JP H031681 A JPH031681 A JP H031681A
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JP
Japan
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memory
signal
image
compressor
speed
Prior art date
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Application number
JP1135558A
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Japanese (ja)
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JP2906444B2 (en
Inventor
Tomishige Taguchi
富茂 田口
Hiroyuki Horii
博之 堀井
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Canon Inc
Original Assignee
Canon Inc
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Publication date
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Publication of JPH031681A publication Critical patent/JPH031681A/en
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.

Description

【発明の詳細な説明】 [産業上の利用分野] 本発明は、静止画を記録媒体に記録する画像記録装置に
関する。
DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to an image recording device that records still images on a recording medium.

[従来の技術] 画像記録装置の一例として、例えばディジタル・スチル
・カメラがある。このようなスチル・カメラでは、一般
に、外部記録媒体として相対的に書込み速度の遅いメモ
リ素子を使用しており、連写速度を上げるために、カメ
ラ本体に複数枚のフレーム・メモリを設け、1つのフレ
ーム・メモリの記憶画像を外部記録媒体に書き込む間に
、別のフレーム・メモリに撮影画像を書き込むという構
成が提案されている(例えば昭和63年特許出願公告第
64485号)。
[Prior Art] An example of an image recording device is, for example, a digital still camera. Such still cameras generally use a memory element with a relatively slow writing speed as an external recording medium, and in order to increase the continuous shooting speed, multiple frame memories are installed in the camera body, and one A configuration has been proposed in which a captured image is written in another frame memory while an image stored in one frame memory is written to an external recording medium (for example, Patent Application Publication No. 64485 of 1988).

[発明が解決しようとする課題] しかし、上記従来例では、例えば速写速度を上げるため
にはカメラ本体のフレーム・メモリの個数を増さなけれ
ばならず、回路の大型化、コストの情報を招き、更には
、メモリ量の増大に伴い消費電力も増加する。
[Problem to be solved by the invention] However, in the above conventional example, in order to increase the speed of snapshots, for example, it is necessary to increase the number of frame memories in the camera body, which leads to an increase in circuit size and cost information. Furthermore, as the amount of memory increases, power consumption also increases.

そこで本発明は、このような欠点を解消した画像記録装
置を・提示することを目的とする。
Therefore, an object of the present invention is to provide an image recording device that eliminates such drawbacks.

[課題を解決するための手段] 本発明の係る画像記録装置は、画像情報を比較的低速の
記録媒体に記録する画像記録装置であって、画像信号を
画面単位に一時記憶するメモリと、連続記録速度を指定
する指定手段と、信号圧縮率を選択自在な圧縮手段とを
具備し、当該指定手段により指定された連続記録速度に
応じた圧縮率で当該圧縮手段が当該メモリの読出し信号
を圧縮し、圧縮信号を記録媒体に供給することを特徴と
する。
[Means for Solving the Problems] An image recording device according to the present invention is an image recording device that records image information on a relatively low-speed recording medium, and includes a memory that temporarily stores image signals on a screen-by-screen basis, and a continuous It is equipped with a specification means for specifying a recording speed and a compression means that can freely select a signal compression rate, and the compression means compresses the read signal of the memory at a compression rate corresponding to the continuous recording speed specified by the specification means. and supplies the compressed signal to the recording medium.

[作用コ 上記圧縮手段により圧縮することにより、連続記録速度
を上げても、比較的低速の記録媒体への供給速度を圧縮
率に応じて低く抑えることができる。即ち、連続記録の
ための専用メモリは必要無くなる。
[Operation] By compressing with the compression means described above, even if the continuous recording speed is increased, the supply speed to a relatively low-speed recording medium can be kept low in accordance with the compression ratio. That is, there is no need for a dedicated memory for continuous recording.

[実施例] 以下、図面を参照して本発明の詳細な説明する。[Example] Hereinafter, the present invention will be described in detail with reference to the drawings.

第1図は本発明の一実施例の構成ブロック図を示す。第
1図において、10は撮影レンズ、12は絞り、14は
シャッタであり、これらは撮影光学系を構成する。16
は撮影光学系による光学像を電気信号に変換する固体撮
像素子、18はアンプ、20はアナログ信号をディジタ
ル化するA/D変換器、22はタイミング制御回路、2
4はタイミング制御回路22の基準信号を発生する発振
回路である。26は撮影画像信号を一時記憶するフレー
ム・メモリ、28はフレーム・メモリ26を制御するメ
モリ制御回路、30はフレーム・メモリ26の書込みア
ドレス信号を発生する書込みアドレス発生回路、32は
読出しアドレスを発生する読出しアドレス発生回路、3
6は書込みアドレス発生回路30及び読出しアドレス発
生回路32の何れか一方の出力をフレーム・メモリ26
のアドレス端子に印加するスイッチ、38は、書込み及
び読出しを切り換えるバッファである。
FIG. 1 shows a block diagram of an embodiment of the present invention. In FIG. 1, 10 is a photographic lens, 12 is a diaphragm, and 14 is a shutter, which constitute a photographic optical system. 16
18 is an amplifier; 20 is an A/D converter that digitizes an analog signal; 22 is a timing control circuit;
Reference numeral 4 denotes an oscillation circuit that generates a reference signal for the timing control circuit 22. 26 is a frame memory for temporarily storing photographed image signals; 28 is a memory control circuit for controlling the frame memory 26; 30 is a write address generation circuit for generating a write address signal for the frame memory 26; 32 is for generating a read address. read address generation circuit, 3
6 outputs either the write address generation circuit 30 or the read address generation circuit 32 to the frame memory 26.
A switch 38 applied to the address terminal of is a buffer that switches between writing and reading.

40は図示装置の全体を制御するシステム制御回路、4
2は圧縮率al(本実施例では1/2)の圧縮器、44
は圧縮率a2 (本実施例では1/4)の圧縮器、46
は圧縮率a3 (本実施例では1/6)の圧縮器、48
は圧縮しない無圧縮器(即ち、圧縮率ゼロの圧縮器)で
ある。50は、圧縮器42゜44.46及び無圧縮器4
8からのアドレス、データ、及びライト信号を切り換え
るスイッチ、52はスイッチ50で選択されたアドレス
、データ、及びライト信号をにより外部メモリ・パック
54へのデータ書込みを制御するメモリ・パック制御回
路である。
40 is a system control circuit that controls the entire illustrated device;
2 is a compressor with a compression ratio al (1/2 in this embodiment); 44
is a compressor with a compression ratio a2 (1/4 in this example), 46
is a compressor with a compression ratio of a3 (1/6 in this example), 48
is a non-compressor (ie, a compressor with zero compression ratio). 50 is a compressor 42°44.46 and a non-compressor 4
A switch 52 is a memory pack control circuit that controls data writing to the external memory pack 54 using the address, data, and write signals selected by the switch 50. .

外部メモリ・パック54は例えば、バッテリ・バックア
ップされたSRAM、消費電力を抑えるために書込み速
度遅くした大写ff1D RA M、バッテリ・バック
アップは不要であるが書き込み速度の遅いEEPROM
などの固体メモリ素子からなる。各メモリ・パックの書
込み速度は、電池バックアップのSRAMで200ns
ec/byte、電池バックアップの低消費電力のDR
AMで2 p sec/byte。
The external memory pack 54 may be, for example, a battery-backed SRAM, a large-scale FF1D RAM whose writing speed is slowed to reduce power consumption, or an EEPROM which does not require battery backup but has a slow writing speed.
It consists of solid-state memory elements such as. Write speed for each memory pack is 200ns with battery-backed SRAM
ec/byte, low power consumption DR with battery backup
2 psec/byte in AM.

EEFROMで31 p sec/byteである。ま
た、フレーム・メモリ26の画素サイズが512X48
0画素としたときの、1画面の信号を全て外部メモリ・
パック54に書き込むのに要する時間は、電池バックア
ップのSRAMで49m5ec、電池バックアップの低
消費電力のDRAMで490m5ec、 ’EEPRO
Mで7 、61 secである。
EEFROM is 31 psec/byte. Also, the pixel size of the frame memory 26 is 512x48.
All the signals of one screen when the pixel is set to 0 are stored in external memory.
The time required to write to the pack 54 is 49m5ec for battery-backed SRAM and 490m5ec for low-power DRAM with battery backup.
M is 7.61 sec.

56はシャッタ・ボタン操作に連動するシャッタ・スイ
ッチ、58.60は連写モードの選択スイッチ、62は
スイッチ・インターフェース回路、64は、スイッチ5
8.60による速写モード選択信号を、圧縮器42,4
4.46及び無圧縮器48の選択信号C3I 、C52
、C33,C34に変換するBCDバイナリ・デコーダ
である。66は圧縮器42゜44.46及び無圧縮器4
8のアドレス及びリード信号を選択して読出しアドレス
発生回路32に印加するスイッチである。
56 is a shutter switch linked to shutter button operation, 58.60 is a continuous shooting mode selection switch, 62 is a switch interface circuit, and 64 is a switch 5.
The snapshot mode selection signal according to 8.60 is transmitted to the compressors 42 and 4.
4.46 and selection signals C3I and C52 of the non-compressor 48
, C33, C34. 66 is a compressor 42°44.46 and a non-compressor 4
This is a switch that selects the address and read signal of No. 8 and applies it to the read address generation circuit 32.

次に、第1図の動作を説明する。シャッタ・ボタンを押
すと、システム制御回路40は撮像素子16に最適な光
量が入射するように絞り12を制御し、シャッタ・スピ
ード設定器(図示せず)により設定されたシャッタ時間
だけ、シャッタ14を開く。撮像素子16は撮影光学系
による光学像を電気信号に変・換する。この電気信号は
タイミング制御回路22からのタイミング信号に同期し
て順次読み出され、アンプ18で増幅され、A/D変換
器20により例えば8ビツトのディジタル信号に変換さ
れる。タイミング制御回路22は発振器24からのクロ
ックを適当に分周して、撮像素子16、A/D変換器2
0及びメモリ制御回路28の各動作のタイミング信号を
発生する。
Next, the operation shown in FIG. 1 will be explained. When the shutter button is pressed, the system control circuit 40 controls the diaphragm 12 so that the optimum amount of light is incident on the image sensor 16, and the shutter 14 is operated for the shutter time set by a shutter speed setting device (not shown). open. The image sensor 16 converts an optical image produced by a photographing optical system into an electrical signal. This electrical signal is sequentially read out in synchronization with the timing signal from the timing control circuit 22, amplified by the amplifier 18, and converted into, for example, an 8-bit digital signal by the A/D converter 20. The timing control circuit 22 appropriately divides the clock from the oscillator 24 and outputs it to the image sensor 16 and the A/D converter 2.
0 and a timing signal for each operation of the memory control circuit 28.

システム制御回路40は、シャッタ14を閉じると同時
に、信号ENをロー(L)にして、バッファ38を活動
状態にし、A/D変換器20の出力をフレーム・メモリ
26に導く。信号■により、スイッチ36は書込みアド
レス発生回路30の出力側に接続しており、フレーム・
メモリ26はメモリ制御回路28のライト信号Wに同期
して、書込みアドレス発生回路30の書込みアドレス信
号によるアドレスに、バッファ38からのデータを書き
込む。撮像素子16からの一連の読出しが終了すると、
メモリ制御回路28は取込み終了信号をシステム制御回
路40に送り、フレーム・メモリ26に画像が取込まれ
たことを知らせる。なお、フレーム・メモリ26への一
画面の取込みが終了すると、書込みアドレス発生回路3
0は活動を停止し、電力消費を抑える。
System control circuit 40 simultaneously closes shutter 14 by driving signal EN low, activating buffer 38 and directing the output of A/D converter 20 to frame memory 26 . The switch 36 is connected to the output side of the write address generation circuit 30 by the signal ■, and the frame
The memory 26 writes data from the buffer 38 to the address specified by the write address signal of the write address generation circuit 30 in synchronization with the write signal W of the memory control circuit 28 . When a series of readings from the image sensor 16 is completed,
Memory control circuit 28 sends a capture completion signal to system control circuit 40, informing it that the image has been captured in frame memory 26. Note that when one screen has been captured into the frame memory 26, the write address generation circuit 3
0 stops activity and reduces power consumption.

次に、システム制御回路40はスイッチ・インターフェ
ース回路62を介して連写モート選択スイッチ58,6
0の状態を読み取り、制御信号5EL1.5EL2によ
り、表1に示すようにスイッチ50゜66を制御する。
Next, the system control circuit 40 passes the continuous shooting mode selection switches 58 and 6 through the switch interface circuit 62.
The state of 0 is read and the switch 50°66 is controlled by control signals 5EL1 and 5EL2 as shown in Table 1.

連写速度は、スイッチ58,60により表1に示すよう
に選択できるものとす条。
The continuous shooting speed can be selected using switches 58 and 60 as shown in Table 1.

コマ取りモードを説明する。このとき、スイッチ58.
60は共にオンである。コマ取りモードでは、シャッタ
・ボタンが押されるたびにシャッタ14が開閉し、撮像
素子16による画像信号を上記の手順でフレーム・メモ
リ26に一時格納する。表1に示すように、無圧縮器4
8が選択され、制御信号5ELI、5EL2によりスイ
ッチ50.66は無圧縮器48に接続しており、フレー
ム・メモリ26の記憶画像信号は、読出しアドレス発生
回路32の読出しアドレス信号に従い読み出されて、無
圧縮器48及びメモリ・パック制御回路52を介して外
部メモリ・パック54に書き込まれる。
Explain the stop-motion mode. At this time, switch 58.
60 are both on. In the time-lapse mode, the shutter 14 opens and closes each time the shutter button is pressed, and the image signal from the image sensor 16 is temporarily stored in the frame memory 26 in the above-described procedure. As shown in Table 1, the non-compressor 4
8 is selected, the switch 50.66 is connected to the non-compressor 48 by the control signals 5ELI and 5EL2, and the stored image signal of the frame memory 26 is read out according to the read address signal of the read address generation circuit 32. , is written to external memory pack 54 via decompressor 48 and memory pack control circuit 52.

外部メモリ・パック54に例えば大写1iDRAMを使
用した場合、現在の技術で2Mb y t e程度の容
量を持つメモリ・パックが試作されており、無圧縮の場
合、このメモリ・パックに520x480画素の画像を
8枚記憶できる。
If, for example, Daisha 1iDRAM is used as the external memory pack 54, a memory pack with a capacity of about 2 Mbyte has been prototyped using current technology, and if it is not compressed, this memory pack can store an image of 520 x 480 pixels. Can store 8 images.

表1 速写の場合を説明する。スイッチ58がオフでスイッチ
60がオフの場合、4コマ/秒、スイッチ58がオンで
スイッチ60がオフの場合、8コマ/秒、スイッチ58
がオフでスイッチ60がオンの場合12コマ/秒である
。1つの画像を外部メモリ・パックに記憶させるのに許
容される時間は250m5ecであり、DRAM製の外
部メモリ・パック54の書込み速度490m5ecの約
倍のスピードか必要になる。従って、この場合には、圧
縮器42により、記録情報量を半分に減らし、1画素毎
の外部メモリ・パック54への書込み時間を短縮する。
Table 1 Explains the case of quick photography. When switch 58 is off and switch 60 is off, 4 frames per second; when switch 58 is on and switch 60 is off, 8 frames per second; switch 58
When the switch 60 is off and the switch 60 is on, the rate is 12 frames/second. The allowable time for storing one image in the external memory pack is 250 m5ec, which is approximately twice the write speed of the external memory pack 54 made of DRAM, which is 490 m5ec. Therefore, in this case, the compressor 42 reduces the amount of recorded information by half and shortens the writing time to the external memory pack 54 for each pixel.

同様に、8コマ/秒の場合には、圧縮器44により1/
4に書込み情報量を圧縮し、12コマ/秒の場合には圧
縮器46により1/6に圧縮する。
Similarly, in the case of 8 frames/second, the compressor 44
In the case of 12 frames/sec, the amount of written information is compressed to 1/6 by the compressor 46.

速写時には、圧縮器42,44.46の1つを活動状態
にしておけばよいので、電力消費節減の観点から、使用
しない圧縮器42,44.46及び無圧縮器48への電
源を遮断しておくのが好ましい。
During quick shooting, it is sufficient to keep one of the compressors 42, 44, 46 active, so from the perspective of reducing power consumption, the power to the unused compressors 42, 44, 46 and non-compressor 48 is cut off. It is preferable to keep it.

このような圧縮器42,46.48としては、例えば以
下のようにする。即ち、圧縮器42は、DPCMffi
子化テーブル4ビットで1/2圧縮し、圧縮器44はサ
ブサンプリング及びDPCMffi子化テーブル4ビッ
トで174圧縮し、圧縮器46は、3画素毎の代表値を
DPCMffi子化テーブル4ビットで1/6圧縮する
For example, the compressors 42, 46, and 48 are as follows. That is, the compressor 42
The compressor 44 performs subsampling and 174 compression using the DPCMffi child table 4 bits, and the compressor 46 compresses the representative value of every 3 pixels by 1/2 using the DPCMffi child table 4 bits. /6 compression.

上記実施例では、無圧縮器及び複数の圧縮器から選択利
用して異なる圧縮処理を行なうようにしているが、圧縮
率を外部制御できる高速ディジタル信号処理回路を経由
するようにし、外部制御信号により、その画像圧縮率(
無圧縮を含む。)を切り換えるようにしてもよい。また
、外部メモリ・パックとしては固体メモリ素子の場合を
例に取って説明したが、磁気バブル・メモリ、磁気ディ
スク、光ディスクなどのその他の記録媒体を使用しても
よいことはいうまでもない。更には、圧縮方式としてD
PCMの場合を説明したが、その他の、ベクトル量子化
、ブロック符号化、離散コサイン変換などであってもよ
い。
In the above embodiment, different compression processes are performed by selectively using a non-compressor and a plurality of compressors, but the compression rate is passed through a high-speed digital signal processing circuit that can be externally controlled, and is controlled by an external control signal. , its image compression rate (
Including uncompressed. ) may be switched. Further, although the external memory pack has been described using a solid-state memory element as an example, it goes without saying that other recording media such as a magnetic bubble memory, a magnetic disk, an optical disk, etc. may also be used. Furthermore, as a compression method, D
Although the case of PCM has been described, other methods such as vector quantization, block coding, and discrete cosine transformation may also be used.

また電子スチル・カメラを例に説明゛したが、本発明は
これに限らず、他の記録装置にも適用出できることは勿
論である。
Further, although the description has been given using an electronic still camera as an example, the present invention is not limited to this, and it goes without saying that it can be applied to other recording devices.

[発明の効果] 以上の説明から容易に理解できるように、本発明によれ
ば、メモリ容量を増すことなしに、連続画像を、比較的
低速の画像記録媒体に記録することができるようになっ
た。
[Effects of the Invention] As can be easily understood from the above explanation, according to the present invention, continuous images can be recorded on a relatively low-speed image recording medium without increasing the memory capacity. Ta.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本発明の一実施例の構成ブロック図である。 10:撮影レンズ 12:絞り 14:シャッタ16:
固体撮像素子 18:アンプ 22:タイミング制御回
路 26:フレーム・メモリ 28:メモリ制御回路 
30:書込みアドレス発生回路 32:続出しアドレス
発生回路 38:バッファ 40ニジステム制御回路 
42,44゜46:圧縮器 48:無圧縮器 52:メ
モリ・パック制御回路 54:外部メモリ・パック 5
6:シャッタ・スイッチ 58,60:連写モード選択
スイッチ 64 : BCDバイナリ・デコーダ
FIG. 1 is a block diagram of an embodiment of the present invention. 10: Photographic lens 12: Aperture 14: Shutter 16:
Solid-state image sensor 18: Amplifier 22: Timing control circuit 26: Frame memory 28: Memory control circuit
30: Write address generation circuit 32: Successive address generation circuit 38: Buffer 40 System control circuit
42, 44° 46: Compressor 48: Non-compressor 52: Memory pack control circuit 54: External memory pack 5
6: Shutter switch 58, 60: Continuous shooting mode selection switch 64: BCD binary decoder

Claims (1)

【特許請求の範囲】[Claims] 画像情報を比較的低速の記録媒体に記録する画像記録装
置であって、画像信号を画面単位に一時記憶するメモリ
と、連続記録速度を指定する指定手段と、信号圧縮率を
選択自在な圧縮手段とを具備し、当該指定手段により指
定された連続記録速度に応じた圧縮率で当該圧縮手段が
当該メモリの読出し信号を圧縮し、圧縮信号を記録媒体
に供給することを特徴とする画像記録装置。
An image recording device that records image information on a relatively low-speed recording medium, comprising a memory that temporarily stores image signals on a screen-by-screen basis, a designation means for designating a continuous recording speed, and a compression means that can freely select a signal compression rate. An image recording device, characterized in that the compression means compresses the readout signal of the memory at a compression rate according to the continuous recording speed designated by the designation means, and supplies the compressed signal to the recording medium. .
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Cited By (2)

* Cited by examiner, † Cited by third party
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US6674538B2 (en) 1991-05-14 2004-01-06 Canon Kabushiki Kaisha Image reproduction system for reproducing a still image from a video tape
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