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JPH07271939A - 非接触ｉｃカード，カードリーダライタ及びカード装置 - Google Patents

非接触ｉｃカード，カードリーダライタ及びカード装置

Info

Publication number
JPH07271939A
JPH07271939A JP6060821A JP6082194A JPH07271939A JP H07271939 A JPH07271939 A JP H07271939A JP 6060821 A JP6060821 A JP 6060821A JP 6082194 A JP6082194 A JP 6082194A JP H07271939 A JPH07271939 A JP H07271939A
Authority
JP
Japan
Prior art keywords
transmission
circuit
converting
reception
electric signal
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP6060821A
Other languages
English (en)
Inventor
Sozo Fujioka
宗三 藤岡
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Renesas Design Corp
Mitsubishi Electric Corp
Mitsubishi Electric Semiconductor Systems Corp
Original Assignee
Renesas Design Corp
Mitsubishi Electric Corp
Mitsubishi Electric Semiconductor Systems Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Renesas Design Corp, Mitsubishi Electric Corp, Mitsubishi Electric Semiconductor Systems Corp filed Critical Renesas Design Corp
Priority to JP6060821A priority Critical patent/JPH07271939A/ja
Priority to EP01116095A priority patent/EP1146475B1/en
Priority to DE69532339T priority patent/DE69532339T2/de
Priority to DE69532837T priority patent/DE69532837T2/de
Priority to EP00109743A priority patent/EP1035502B1/en
Priority to DE69527736T priority patent/DE69527736T2/de
Priority to EP95100357A priority patent/EP0675459B1/en
Priority to US08/375,981 priority patent/US5604342A/en
Priority to KR1019950005719A priority patent/KR100189764B1/ko
Publication of JPH07271939A publication Critical patent/JPH07271939A/ja
Priority to US08/742,756 priority patent/US5753902A/en
Pending legal-status Critical Current

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    • G—PHYSICS
    • G06—COMPUTING OR CALCULATING; COUNTING
    • G06K—GRAPHICAL DATA READING; PRESENTATION OF DATA; RECORD CARRIERS; HANDLING RECORD CARRIERS
    • G06K7/00—Methods or arrangements for sensing record carriers, e.g. for reading patterns
    • G06K7/10—Methods or arrangements for sensing record carriers, e.g. for reading patterns by electromagnetic radiation, e.g. optical sensing; by corpuscular radiation
    • G06K7/10009—Methods or arrangements for sensing record carriers, e.g. for reading patterns by electromagnetic radiation, e.g. optical sensing; by corpuscular radiation sensing by radiation using wavelengths larger than 0.1 mm, e.g. radio-waves or microwaves
    • G06K7/10316—Methods or arrangements for sensing record carriers, e.g. for reading patterns by electromagnetic radiation, e.g. optical sensing; by corpuscular radiation sensing by radiation using wavelengths larger than 0.1 mm, e.g. radio-waves or microwaves using at least one antenna particularly designed for interrogating the wireless record carriers
    • G—PHYSICS
    • G06—COMPUTING OR CALCULATING; COUNTING
    • G06K—GRAPHICAL DATA READING; PRESENTATION OF DATA; RECORD CARRIERS; HANDLING RECORD CARRIERS
    • G06K17/00—Methods or arrangements for effecting co-operative working between equipments covered by two or more of main groups G06K1/00 - G06K15/00, e.g. automatic card files incorporating conveying and reading operations
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    • G06K19/06—Record carriers for use with machines and with at least a part designed to carry digital markings characterised by the kind of the digital marking, e.g. shape, nature, code
    • G06K19/067—Record carriers with conductive marks, printed circuits or semiconductor circuit elements, e.g. credit or identity cards also with resonating or responding marks without active components
    • G06K19/07—Record carriers with conductive marks, printed circuits or semiconductor circuit elements, e.g. credit or identity cards also with resonating or responding marks without active components with integrated circuit chips
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    • G06K7/10297—Methods or arrangements for sensing record carriers, e.g. for reading patterns by electromagnetic radiation, e.g. optical sensing; by corpuscular radiation sensing by radiation using wavelengths larger than 0.1 mm, e.g. radio-waves or microwaves arrangements for handling protocols designed for non-contact record carriers such as RFIDs NFCs, e.g. ISO/IEC 14443 and 18092

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Abstract

(57)【要約】 【構成】 非接触ＩＣカード２Ａは、ＣＰＵ、ＲＯＭ、
ＲＡＭ等からなる制御部２４Ａを有し、受信回路２２に
接続された１ビットのフリップ・フロップ（Ｆ／Ｆ）２
７をさらに備える。制御部２４Ａのプログラムにより、
受信データを１ビットずつ受信し、スタートフラグのビ
ットパターンを検出できたときにＵＡＲＴ２３を受信可
能にする。 【効果】 スタートフラグを確実に検出でき、ひいては
通信エラーレートを下げ、通信信頼性を向上できる。

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】この発明は、通信媒体として電波
を使用した非接触ＩＣカード、カードリーダライタ及び
カード装置に関するものである。
【０００２】
【従来の技術】従来の非接触ＩＣカード及びカードリー
ダライタの構成について図１９及び図２０を参照しなが
ら説明する。図１９は、従来の非接触ＩＣカード及びカ
ードリーダライタからなるカード装置の構成を示すブロ
ック図である。また、図２０は、従来のカードリーダラ
イタの受信回路を示す図である。
【０００３】図１９において、カードリーダライタ１
は、ホストコンピュータ（ＨＯＳＴ）に接続されホスト
コンピュータとのコミュニケーションを行う入出力回路
１１と、全体の制御やデータの処理を行う制御部１２
と、シリアルデータをパラレルデータへまたはその逆の
変換を行うＵＡＲＴ１３と、このＵＡＲＴ１３から送ら
れてくるシリアルデータのデジタル信号を変調して電気
信号へ変換する送信回路１４と、電気信号を電波として
送信する送信アンテナ１５と、受信した電波を電気信号
へ変換する受信アンテナ１６と、電気信号を復調してデ
ジタル信号へ変換する受信回路１７と、上記各部に例え
ば５Ｖ電源を供給する電源回路１８とを備える。なお、
制御部１２はＣＰＵ、ＲＯＭ、ＲＡＭ等から構成されて
いる。
【０００４】また、図１９において、非接触ＩＣカード
２は、受信した電波を電気信号へ変換したり、その逆を
行う送受信アンテナ２１と、電気信号を復調してデジタ
ル信号へ変換する受信回路２２と、シリアルデータをパ
ラレルデータへまたはその逆の変換を行うＵＡＲＴ２３
と、全体の制御やデータの処理を行う制御部２４と、Ｕ
ＡＲＴ２３から送られてくるシリアルデータのデジタル
信号を変調して電気信号へ変換する送信回路２５と、バ
ッテリーなどの電源回路２６とを備える。なお、制御部
１２はＣＰＵ、ＲＯＭ、ＲＡＭ等から構成されている。
【０００５】図２０において、受信回路１７は、受信ア
ンテナ１６に接続された受信バッファ１７１と、ＡＧＣ
（オートゲインコントロール）１７２と、復調部１７３
とを備える。
【０００６】つぎに、従来の非接触ＩＣカード及びカー
ドリーダライタの動作について図２１、図２２、図２３
及び図２４を参照しながら説明する。図２１及び図２２
は、カードリーダライタから非接触ＩＣカードへ送られ
る信号の形態を示す図である。また、図２３及び図２４
は、非接触ＩＣカードの動作を示すフローチャートであ
る。
【０００７】基本的な動作は、カードリーダライタ１か
ら非接触ＩＣカード２へコマンドを送り、非接触ＩＣカ
ード２はそのコマンドを実行して結果をカードリーダラ
イタへ送り返す。カードリーダライタ１から非接触ＩＣ
カード２へ送られる信号は、図２１（ａ）に示すよう
に、まずトリガ信号を送り、２ビットの間隔の後、スタ
ートフラグ、つづいて図２２に示すデータが送られる。
【０００８】１フレームのデータ構成は、図２２に示す
ように、１ビットのスタートビットと、８ビットのデー
タと、１ビットのパリティビットと、２ビットのストッ
プビットとからなる。なお、上記スタートフラグは、１
フレーム中の８ビットのデータが所定のビットパターン
を有する１フレームのデータである。
【０００９】非接触ＩＣカード２は、まず、図２１
（ａ）に示すトリガ信号を受信すると、スリープ状態か
ら動作状態になり受信許可とする（図２３のステップ３
０〜３２）。次に、同図（ａ）に示すスタートフラグを
受信すると図２２に示すデータブロックの受信を開始す
る（ステップ３３〜３４）。そして、コマンドの実行結
果の返信等の処理終了後、スリープ状態へ移行する（ス
テップ３５）。
【００１０】非接触ＩＣカード２のＵＡＲＴ２３のデー
タ受信は、１ビットのスタートビットを検出して開始さ
れ、以降の８ビットをデータとして受信する（図２４の
ステップ４０）。２ビットのストップビットはデータ間
の切れ目であり、これが検出できないとフレーミングエ
ラーとし、今回受信したデータは取り込まずに次のスタ
ートビット（図２２に示すように、ＨからＬへ変化した
１ビット）を検出すると、つまり同期がとれるまで待っ
てステップ４０へ戻る（ステップ４１〜４２）。フレー
ミングエラーが起こらない場合には、次のデータを受信
する（ステップ４３）。
【００１１】つまり、スタートビットを正常に検出でき
なかった場合、フレーミングエラーが起こるまで、正常
に、次のスタートビットを検出できない可能性が高い。
【００１２】図２１（ａ）に示すように、トリガ信号を
受信してから特定のビットパターンを有するデータブロ
ックであるスタートフラグを受信する。非接触ＩＣカー
ド２内では、トリガ信号終了まで待って受信許可にする
ので、トリガ信号が正常に受信できればスタートフラグ
は確実に受信できる。
【００１３】しかし、図２１（ｂ）に示す点線のよう
に、トリガ信号が抜けてトリガ信号がうまく受信できな
かった場合（例えば、非接触ＩＣカード２とカードリー
ダライタ１の間が通信可能のぎりぎりの距離の場合）で
も、非接触ＩＣカード２は起動し、受信許可にしてしま
うため、Ａの部分をスタートフラグ中のスタートビット
と間違って受信する。そして、ＵＡＲＴ２３は８ビット
単位でデータ処理を行いので、その後のスタートフラグ
を正常に受信することができず、データブロック全体を
読みとばしてしまう。
【００１４】つづいて、カードリーダライタ１の受信回
路１７の動作について説明する。カードリータライタ１
と非接触ＩＣカード２間の距離で電波の強さが大きく変
化するので、受信回路１７は、ゲインを調整する必要が
あり、ＡＧＣ１７２を内蔵している。ところが、このＡ
ＧＣ１７２は、一度ゲインが低くなると、元のゲインに
戻るまでに時間が必要である。カードリーダライタ１
は、周波数が同じ送信アンテナ１５と受信アンテナ１６
をもっているため、自身の受信アンテナ１６で自身の送
信した電波（大変強い）を受信してしまい、送信してか
らしばらくの間、ゲインが低下してしまう。その結果と
して、非接触ＩＣカード２との通信距離が短くなってし
まう。
【００１５】
【発明が解決しようとする課題】上述したような従来の
非接触ＩＣカードでは、カードリーダライタ１からのト
リガ信号をうまく受信できなかった場合、スタートフラ
グを確実に受信できず、データブロック全体を読みとば
してしまい、通信エラーレートを上げ、通信信頼性をそ
こなうという問題点があった。また、上述したような従
来のカードリーダライタでは、送信と受信の周波数が同
じであるため、送信電波を受信アンテナ１６で受信して
しまう。そして、この強い電波のために受信回路１７の
ＡＧＣ１７２のゲインが下がり、そのために受信感度が
下がり、通信距離が短くなり、ひいては通信エラーレー
トを上げ、通信信頼性をそこなうという問題点があっ
た。さらに、従来のカードリーダライタでは、送信と受
信の周波数が同じであるため、送信アンテナ１５と受信
アンテナ１６が干渉しあい、送信、受信信号の波形がく
ずれ、通信エラーレートを上げ、通信信頼性をそこなう
という問題点があった。
【００１６】この発明は、前述した問題点を解決するた
めになされたもので、トリガ信号をうまく受信できなか
った場合でも、スタートフラグを確実に受信でき、ま
た、受信回路の受信感度の回復を待って、あるいは受信
感度の低下を防いで通信距離を延ばすことができ、さら
に、送信アンテナと受信アンテナの干渉を防ぎ、ひいて
は通信エラーレートを下げ、通信信頼性を向上すること
ができる非接触ＩＣカード、カードリーダライタ及びカ
ード装置を得ることを目的とする。
【００１７】
【課題を解決するための手段】この発明の請求項１に係
る非接触ＩＣカードは、受信回路からの受信データを１
ビット毎にモニタし、スタートフラグを検出したときに
ＵＡＲＴを受信許可にする制御部を備えたものである。
【００１８】この発明の請求項２に係る非接触ＩＣカー
ドは、カードリーダライタによる電波の送信が終了して
から前記カードリーダライタのＡＧＣの感度が回復する
までの時間が経過してから応答信号を返信する制御部を
備えたものである。
【００１９】この発明の請求項３に係るカードリーダラ
イタは、トリガ信号とスタートフラグの間隔を１フレー
ム以上とする制御部を備えたものである。
【００２０】この発明の請求項４に係るカードリーダラ
イタは、トリガ信号とスタートフラグの間にダミーデー
タを挿入する制御部を備えたものである。
【００２１】この発明の請求項５に係るカードリーダラ
イタは、受信アンテナと受信回路の間に送信中は両者を
切り離すスイッチ回路をさらに備えたものである。
【００２２】この発明の請求項６に係るカードリーダラ
イタは、受信アンテナと受信回路の間に送信中はスイッ
チング時のノイズが上記受信回路へ伝わらないタイミン
グで両者を切り離すスイッチ回路をさらに備えたもので
ある。
【００２３】この発明の請求項７に係るカードリーダラ
イタは、送信中は共振しないようにできるスイッチ回路
を有する受信アンテナを備えたものである。
【００２４】この発明の請求項８に係るカードリーダラ
イタは、受信中は共振しないようにできるスイッチ回路
を有する送信アンテナを備えたものである。
【００２５】この発明の請求項９に係るカードリーダラ
イタは、直列共振回路からなる送信アンテナを備えたも
のである。
【００２６】この発明の請求項１０に係るカードリーダ
ライタは、送信中は共振しないようにできるスイッチ回
路を有する受信アンテナと、直列共振回路からなる送信
アンテナとを備えたものである。
【００２７】この発明の請求項１１に係るカードリーダ
ライタは、受信アンテナと受信回路の間に送信中は両者
を切り離すスイッチ回路と、直列共振回路からなる送信
アンテナと、トリガ信号とスタートフラグの間にダミー
データを挿入する制御部とを備えたものである。
【００２８】この発明の請求項１２に係るカード装置
は、第１の受信回路からの受信データを１ビット毎にモ
ニタし、スタートフラグを検出したときに第１のＵＡＲ
Ｔを受信許可にする第１の制御部を有する非接触ＩＣカ
ードと、直列共振回路からなる受信アンテナ、及び前記
受信アンテナと受信回路の間に送信中は両者を切り離す
スイッチ回路を有するカードリーダライタとを備えたも
のである。
【００２９】この発明の請求項１３に係るカード装置
は、カードリーダライタによる電波の送信が終了してか
ら前記カードリーダライタのＡＧＣの感度が回復するま
での時間が経過してから応答信号を返信する第１の制御
部を有する非接触ＩＣカードと、直列共振回路からなる
送信アンテナ、及びトリガ信号とスタートフラグの間に
ダミーデータを挿入する第２び制御部を有するカードリ
ーダライタとを備えたものである。
【００３０】
【作用】この発明の請求項１に係る非接触ＩＣカードに
おいては、１ビットづつデータを受信し、スタートフラ
グを検出したときにＵＡＲＴを受信許可にするので、ス
タートフラグを確実に受信できる。
【００３１】この発明の請求項２に係る非接触ＩＣカー
ドにおいては、カードリーダライタのＡＧＣの受信感度
の回復を待つので、通信距離を延ばすことができる。
【００３２】この発明の請求項３に係るカードリーダラ
イタにおいては、トリガ信号とスタートフラグの間を１
フレーム以上空けるので、非接触ＩＣカード側ではスタ
ートフラグを確実に受信できる。
【００３３】この発明の請求項４に係るカードリーダラ
イタにおいては、トリガ信号とスタートフラグの間にダ
ミーデータを挿入するので、非接触ＩＣカード側ではフ
レーミングエラーが発生し、次のスタートフラグを確実
に受信できる。
【００３４】この発明の請求項５に係るカードリーダラ
イタにおいては、送信中は受信アンテナと受信回路を切
り離すので、ＡＧＣの受信感度の低下を防ぎ、通信距離
を延ばすことができる。
【００３５】この発明の請求項６に係るカードリーダラ
イタにおいては、送信中はスイッチイング時のノイズが
受信回路に伝わらないようなタイミングで受信アンテナ
と受信回路を切り離すので、ＡＧＣの受信感度の低下を
防ぎ、通信距離を延ばすことができる。
【００３６】この発明の請求項７に係るカードリーダラ
イタにおいては、送信中は受信アンテナを共振しないよ
うにするので、送信アンテナと受信アンテナの干渉を防
ぐことができる。
【００３７】この発明の請求項８に係るカードリーダラ
イタにおいては、受信中は送信アンテナを共振しないよ
うにするので、送信アンテナと受信アンテナの干渉を防
ぐことができる。
【００３８】この発明の請求項９に係るカードリーダラ
イタにおいては、受信中は送信アンテナを共振しないよ
うにするので、送信アンテナと受信アンテナの干渉を防
ぐことができる。
【００３９】この発明の請求項１０に係るカードリーダ
ライタにおいては、送信中は受信アンテナを共振しない
ように、受信中は送信アンテナを共振しないようにする
ので、送信アンテナと受信アンテナの干渉を防ぐことが
できる。
【００４０】この発明の請求項１１に係るカードリーダ
ライタにおいては、トリガ信号とスタートフラグの間に
ダミーデータを挿入するので、非接触ＩＣカード側では
フレーミングエラーが発生し、次のスタートフラグを確
実に受信できる。また、送信中はスイッチイング時のノ
イズが受信回路に伝わらないようなタイミングで受信ア
ンテナと受信回路を切り離すので、ＡＧＣの受信感度の
低下を防ぎ、通信距離を延ばすことができる。さらに、
受信中は送信アンテナを共振しないようにするので、送
信アンテナと受信アンテナの干渉を防ぐことができる。
【００４１】この発明の請求項１２に係るカード装置に
おいては、非接触ＩＣカード側ではスタートフラグを確
実に受信でき、カードリーダライタ側ではＡＧＣの受信
感度の低下を防ぎ、通信距離を延ばすことができ、送信
アンテナと受信アンテナの干渉を防ぐことができる。
【００４２】この発明の請求項１３に係るカード装置に
おいては、非接触ＩＣカード側ではスタートフラグを確
実に受信でき、カードリーダライタ側ではＡＧＣの受信
感度の低下を防ぎ、通信距離を延ばすことができ、送信
アンテナと受信アンテナの干渉を防ぐことができる。
【００４３】
【実施例】
実施例１．この発明の実施例１に係る非接触ＩＣカード
の構成について図１を参照しながら説明する。図１は、
この発明の実施例１に係る非接触ＩＣカード２Ａの構成
を示すブロック図であり、送受信アンテナ２１〜ＵＡＲ
Ｔ２３、送信回路２５及び電源回路２６は上述した従来
の非接触ＩＣカード２のものと同じである。なお、各図
中、同一符号は同一又は相当部分を示す。
【００４４】図１において、非接触ＩＣカード２Ａは、
ＣＰＵ、ＲＯＭ、ＲＡＭ等からなり、従来の制御部２４
とは機能が異なる制御部２４Ａを有し、受信回路２２に
接続された１ビットのフリップ・フロップ（Ｆ／Ｆ）２
７をさらに備える。
【００４５】つぎに、この実施例１に係る非接触ＩＣカ
ード２Ａの動作について図２及び図３を参照しながら説
明する。図２は、この実施例１に係る非接触ＩＣカード
２Ａが受信する信号を示す図である。また、図３は、こ
の実施例１に係る非接触ＩＣカード２Ａの制御部２４Ａ
の動作を示すフローチャートである。
【００４６】図１に示すように、受信回路２２から送ら
れてくる受信データをＵＡＲＴ２３に送る前に制御部２
４Ａでモニタできるように、非接触ＩＣカード２ＡはＦ
／Ｆ２７を有する。そして、制御部２４Ａのプログラム
により、受信データを１ビットずつ受信し、スタートフ
ラグのビットパターンを検出できたときにＵＡＲＴ２３
を受信可能にする。そうすればトリガ信号にぬけがあっ
ても、スタートフラグを検出することができる。
【００４７】制御部２４Ａは、Ｆ／Ｆ２７から１ビット
ずつ受信し、１ビットごとに、受信したビット列をスタ
ートフラグのビットパターンと比較する（図３のステッ
プ５０〜５２）。例えば、図２に示すように、スタート
フラグが１６進数の「５Ａ」（以下、「５ＡH」と表現
する。）場合、前後のスタートビットとパリティビット
を含め「００１０１１０１００」のパターンを探す。ス
タートフラグを検出したときには、ＵＡＲＴ２３を受信
許可とし、データ受信を開始する（ステップ５３〜５
４）。
【００４８】すなわち、この実施例１に係る非接触ＩＣ
カード２Ａは、ＵＡＲＴ２３が８ビットまとめて受信す
るので、受信データの状態を制御部３４Ａのプログラム
でモニタできるＦ／Ｆ２７を設けたものである。トリガ
信号も受信データと同じラインで入ってくるため、ＵＡ
ＲＴ２３はデータかトリガかを区別することができな
い。しかし、Ｆ／Ｆ２７と制御部２４Ａは、１ビットづ
つモニタし、結果的には両者を区別できることになる。
制御部２４Ａは、スタートフラグのビットパターンが、
例えば５ＡHの場合、トリガ信号で起動してから１ビッ
トずつ受信を開始し、５ＡHのパターンを検出してから
ＵＡＲＴ２３を受信許可にしている。したがって、スタ
ートフラグを確実に検出でき、ひいては通信エラーレー
トを下げ、通信信頼性を向上できる。
【００４９】実施例２．この発明の実施例２に係る非接
触ＩＣカードについて図４、図５及び図６を参照しなが
ら説明する。図４は、この発明の実施例２に係る非接触
ＩＣカード２Ｂの構成を示すブロック図であり、送受信
アンテナ２１〜ＵＡＲＴ２３、送信回路２５及び電源回
路２６は上述した従来の非接触ＩＣカード２のものと同
じである。また、図５は、この実施例２に係る非接触Ｉ
Ｃカード２Ｂの動作を説明するための、カードリーダラ
イタ１の受信回路１７のＡＧＣ１７２の感度特性を示す
図である。さらに、図６は、この実施例２に係る非接触
ＩＣカード２Ｂの制御部２４Ｂの動作を示すフローチャ
ートである。
【００５０】図４において、非接触ＩＣカード２Ｂは、
ＣＰＵ、ＲＯＭ、ＲＡＭ等からなり、従来の制御部２４
とは機能が異なる制御部２４Ｂを備える。
【００５１】周波数が同一の送信と受信のアンテナ１５
及び１６をもっていれば、送信アンテナ１５で送信した
電波を自身の受信アンテナ１６で受信してしまうことに
なる。カードリーダライタ１は、受信距離を長くするた
めに、受信回路１７にＡＧＣ１７２を備え、受信感度を
調整している。ところが、ＡＧＣ１７２は、一度感度が
下がると回復するのに時間がかかるため、カードリーダ
ライタ１が送信する強い電波をカードリーダライタ１自
身が受信すると、非接触ＩＣカードが応答するまでに感
度が回復しない。
【００５２】そこで、図５に示すように、カードリーダ
ライタ（Ｒ／Ｗ）１のＡＧＣ１７２の受信感度が回復し
てから非接触ＩＣカード２Ｂが応答するように、非接触
ＩＣカード２Ｂに応答待ち時間を設けた。その結果、カ
ードリーダライタ１と非接触ＩＣカード２Ｂの通信距離
の低下を防ぐことができ、ひいては通信エラーレートを
下げ、通信信頼性を向上できる。
【００５３】すなわち、図６に示すように、ステップ６
５において、非接触ＩＣカード２Ｂの制御部２４Ｂは、
カードリーダライタ１からのデータブロック受信後、応
答待ち時間、例えば数ｍｓ待ち、応答を返す。なお、他
の処理（ステップ６０〜６４、６６）は、図２３の処理
と同様である。
【００５４】実施例３．この発明の実施例３に係るカー
ドリーダライタについて図７及び図８を参照しながら説
明する。図７は、この発明の実施例３に係るカードリー
ダライタ１Ａの構成を示すブロック図であり、入出力回
路１１、及びＵＡＲＴ１３〜電源回路１８は上述した従
来のカードリーダライタ１のものと同じである。また、
図８は、この実施例３に係るカードリーダライタ１Ａか
ら非接触ＩＣカード２へ送信される信号を示す図であ
る。
【００５５】図７において、カードリーダライタ１Ａ
は、ＣＰＵ、ＲＯＭ、ＲＡＭ等からなり、従来の制御部
１２とは機能が異なる制御部１２Ａを備える。
【００５６】図８に示すように、カードリーダライタ１
Ａの制御部１２Ａは、送信の際、トリガ信号とスタート
フラグの間に１バイトの００Hを入れる。すなわち、ト
リガ信号の後、１フレーム中の８ビットのデータ部分が
「００H」のデータ、その後、１フレーム中の８ビット
のデータ部分が例えば「５ＡH」のスタートフラグ、そ
の後、通常のデータが続くように、データを送信する。
【００５７】図２１（ｂ）に示すように、非接触ＩＣカ
ード２は、トリガ信号のＡの部分をスタートビットとし
て誤って検出してしまっても次に００Hがくるので、フ
レーミングエラーを起こし、次のスタートフラグを正常
に受信することができ、ひいては通信エラーレートを下
げ、通信信頼性を向上できる。
【００５８】実施例４．この発明の実施例４に係るカー
ドリーダライタについて図９及び図１０を参照しながら
説明する。図９は、この発明の実施例４に係るカードリ
ーダライタ１Ｂの構成を示すブロック図であり、入出力
回路１１、及びＵＡＲＴ１３〜電源回路１８は上述した
従来のカードリーダライタ１のものと同じである。ま
た、図１０は、この実施例４に係るカードリーダライタ
１Ｂから非接触ＩＣカード２へ送信される信号を示す図
である。
【００５９】図９において、カードリーダライタ１Ｂ
は、ＣＰＵ、ＲＯＭ、ＲＡＭ等からなり、従来の制御部
１２とは機能が異なる制御部１２Ｂを備える。
【００６０】図１０に示すように、カードリーダライタ
１Ｂの制御部１２Ｂは、トリガ信号とスタートフラグの
送信の間に１フレーム（１２ビット）以上の間隔をと
る。すなわち、トリガ信号の後、例えばタイマーにより
１フレーム相当の時間だけ待ち、その後、１フレーム中
の８ビットのデータ部分が例えば「５ＡH」のスタート
フラグ、その後、通常のデータが続くように、データを
送信する。
【００６１】非接触ＩＣカード２は、受信する際、図２
１（ｂ）に示すように、トリガ信号にぬけがある場合、
トリガ受信後すぐに受信許可になっても、トリガ信号の
ぬけでトリガ信号終了となる。そして、次のＡの部分を
スタートビットとして検出し、なにか１バイトのデータ
を受信するが、スタートフラグと一致する可能性は極め
て少ないためその１バイトは読み飛ばされ、次のスター
トフラグを正常に受信することができ、ひいては通信エ
ラーレートを下げ、通信信頼性を向上できる。
【００６２】実施例５．この発明の実施例５に係るカー
ドリーダライタについて図１１を参照しながら説明す
る。図１１は、この発明の実施例５に係るカードリーダ
ライタ１Ｃの構成を示すブロック図であり、入出力回路
１１、及びＵＡＲＴ１３〜電源回路１８は上述した従来
のカードリーダライタ１のものと同じである。
【００６３】図１１において、カードリーダライタ１Ｃ
は、ＣＰＵ、ＲＯＭ、ＲＡＭ等からなり、従来の制御部
１２とは機能が異なる制御部１２Ｃを有し、アナログス
イッチ（例えば、Ｍ７４ＨＣ４０６６）又はリレーから
なるスイッチ回路１９をさらに備える。
【００６４】カードリーダライタ１Ｃは、受信距離を長
くするために、受信回路１７にＡＧＣ１７２を備え、受
信感度を調整している。ところが、ＡＧＣ１７２は、一
度感度が下がると回復するのに時間がかかるため、カー
ドリーダライタ１Ｃが送信する強い電波をカードリーダ
ライタ１Ｃ自身が受信すると、非接触ＩＣカード２が応
答するまでに感度が回復しない。
【００６５】そこで、図１１に示すように、受信アンテ
ナ１６と受信回路１７の間にスイッチ回路１９を設け、
制御部１２Ｃは、送信中を知らせる送信ステータス信号
によりスイッチ回路１９をＯＦＦにする。その結果、送
信中は受信アンテナ１６と受信回路１７が切り離され、
受信回路１７は動作しない。したがって、ＡＧＣ１７２
の感度は下がらず、カードリーダライタ１Ｃと非接触Ｉ
Ｃカード２の通信距離の低下を防ぐことができ、ひいて
は通信エラーレートを下げ、通信信頼性を向上できる。
【００６６】実施例６．この発明の実施例６に係るカー
ドリーダライタについて図１２、図１３及び図１４を参
照しながら説明する。図１２は、この発明の実施例６に
係るカードリーダライタ１Ｄの構成を示すブロック図で
あり、入出力回路１１、及びＵＡＲＴ１３〜電源回路１
８は上述した従来のカードリーダライタ１のものと同じ
である。また、図１３は、この実施例６に係るカードリ
ーダライタ１Ｄのスイッチ回路の構成を示す図である。
さらに、図１４は、この実施例６に係るカードリーダラ
イタ１Ｄの制御部の動作を示す図である。
【００６７】図１２において、カードリーダライタ１Ｄ
は、ＣＰＵ、ＲＯＭ、ＲＡＭ等からなり、従来の制御部
１２とは機能が異なる制御部１２Ｄを有し、アナログス
イッチ（例えば、Ｍ７４ＨＣ４０６６）等からなるスイ
ッチ回路１９Ａをさらに備える。
【００６８】図１３において、スイッチ回路１９Ａは、
ショットキーダイオード１９１及び１９２と、抵抗１９
３と、制御部１２Ｄのコントロール信号ＡによりＯＮ、
ＯＦＦするアナログスイッチ１９４と、制御部１２Ｄの
コントロール信号ＢによりＯＮ、ＯＦＦするアナログス
イッチ１９５と、制御部１２Ｄのコントロール信号Ｃに
よりＯＮ、ＯＦＦするアナログスイッチ１９６とを備え
る。
【００６９】アナログスイッチ１９４〜１９６は、コン
トロール信号Ａ、Ｂ、Ｃが“Ｈ”のときＯＮ、“Ｌ”の
ときＯＦＦするものである。ただし、完全にＯＦＦする
のではなく、ＯＮの時は例えば４５Ω、ＯＦＦの時は例
えば１０9Ωになる。したがって、アナログスイッチ１
９４だけでは完全に受信アンテナ１６と受信回路１７を
切断できないため、アナログスイッチ１９５、１９６や
抵抗１９３、ショットキーダイオード１９１、１９２な
どを組み合わせている。ショットキーダイオード１９
１、１９２は、受信アンテナ１６で受信した信号をクラ
ンプするためのもので、ショットキーダイオード１９
１、１９２の順電圧（ＶF）以上の振幅になるとそれ以
上の電圧をカットし、結果的に受信信号を順電圧ＶF以
上の振幅にしない。
【００７０】制御部１２Ｄは、送信時は、コントロール
信号Ａを“Ｌ”にしてアナログスイッチ１９４をＯＦＦ
にし、かつコントロール信号Ｂ及びＣを“Ｈ”にしてア
ナログスイッチ１９５及び１９６をＯＮにする。受信時
は、コントロール信号Ａを“Ｈ”にしてアナログスイッ
チ１９４をＯＮにし、かつコントロール信号Ｂ及びＣを
“Ｌ”にしてアナログスイッチ１９５及び１９６をＯＦ
Ｆにする。
【００７１】抵抗１９３は、アナログスイッチ１９５が
ＯＮのとき受信アンテナ１６から入ってくる電気信号
を、アナログスイッチ１９５のＯＮ抵抗（４５Ω）とで
分圧し、Ｐ１の点の電圧を下げることを目的として挿入
されている。例えば、抵抗１９３が２００Ωで、アナロ
グスイッチ１９５のＯＮ抵抗が４５Ωであれば、受信ア
ンテナ１６からの信号が３００ｍＶのとき、点Ｐ１の電
圧は５５ｍＶとなる。
【００７２】その後、アナログスイッチ１９４（ＯＦＦ
抵抗１０9Ω）と１９６（ＯＮ抵抗４５Ω）により、受
信回路１７に入力される電圧は、ほとんど０に近い値に
なる。抵抗成分だけで考えるとアナログスイッチ１９４
及び１９６の２つだけで十分だと思われるが、実際に
は、アナログスイッチ１９４の入力、出力が容量結合す
ることが考えられるため、点Ｐ１で電圧を下げておく必
要がある。
【００７３】受信する場合は、アナログスイッチ１９４
をＯＮ、アナログスイッチ１９５及び１９６をＯＦＦに
して行う。受信アンテナ１６と受信回路１７の間には、
直列に抵抗１９３がつながることになるが、分圧されな
いので、受信アンテナ１６からの受信電圧は、そのまま
受信回路１７に伝わる。
【００７４】また、アナログスイッチ１９４とアナログ
スイッチ１９５及び１９６のスイッチングのタイミング
は、図１４に示すように、タイムラグを設けた方が、ス
イッチングの際の受信回路１７への影響が少ないことが
分かっている。アナログスイッチ１９４がＯＮする際の
スイッチングノイズが受信回路１７に伝わってしまうた
め、アナログスイッチ１９５及び１９６をＯＮしてお
き、受信回路１７に伝わらないようにする。
【００７５】アナログスイッチ１９４〜１９６は、デジ
タル回路で動作しているため、動作時にデジタルノイズ
が発生する。受信アンテナ１６の信号が＋、−にふれる
ので、通常、アナログスイッチ１９４〜１９６の電源は
±電源と使用しなければならないが、このスイッチ回路
１９Ａならあまり一側に大きくふれないので、一つの電
源（例えば、５Ｖ単一電源）でスイッチングできる。つ
まり、上記実施例５と同様の効果を奏するとともに、カ
ードリーダライタ１Ｄの電源（電源回路１８）を１つに
することができ、安価に構成することができる。
【００７６】実施例７．この発明の実施例７に係るカー
ドリーダライタについて図１５を参照しながら説明す
る。図１５は、この発明の実施例７に係るカードリーダ
ライタ１Ｅの構成を示すブロック図であり、入出力回路
１１、及びＵＡＲＴ１３〜送信アンテナ１５、受信回路
１７及び電源回路１８は上述した従来のカードリーダラ
イタ１のものと同じである。
【００７７】図１５において、カードリーダライタ１Ｅ
は、ＣＰＵ、ＲＯＭ、ＲＡＭ等からなり、従来の制御部
１２とは機能が異なる制御部１２Ｅを備え、またアナロ
グスイッチ又はリレーからなるスイッチ回路１６１を有
する受信アンテナ１６Ａを備える。
【００７８】送信中は受信アンテナが共振しないよう
に、受信アンテナ１６Ａは、アナログスイッチ又はリレ
ーからなるスイッチ回路１６１を内蔵し、制御部１２Ｅ
からの送信ステータス信号でスイッチ回路１６１を制御
できるようにしたものである。
【００７９】制御部１２Ｅは、送信中は、スイッチ回路
１６１をＯＮして受信アンテナ１６Ａが共振しないよう
にし、受信時は、スイッチ回路１６１をＯＦＦして電波
を受信する。その結果、送信アンテナ１５と受信アンテ
ナ１６Ａの干渉を防ぎ、ひいては通信エラーレートを下
げ、通信信頼性を向上できる。
【００８０】実施例８．この発明の実施例８に係るカー
ドリーダライタについて図１６及び図１７を参照しなが
ら説明する。図１６は、この発明の実施例８に係るカー
ドリーダライタ１Ｆの構成を示すブロック図であり、入
出力回路１１、ＵＡＲＴ１３、送信回路１４、及び受信
アンテナ１６〜電源回路１８は上述した従来のカードリ
ーダライタ１のものと同じである。また、図１７は、こ
の実施例８に係るカードリーダライタ１Ｆの受信信号の
波形を示す図である。
【００８１】図１６において、カードリーダライタ１Ｆ
は、ＣＰＵ、ＲＯＭ、ＲＡＭ等からなり、従来の制御部
１２とは機能が異なる制御部１２Ｆを備え、またアナロ
グスイッチ又はリレーからなるスイッチ回路１５１を有
する送信アンテナ１５Ａを備える。
【００８２】送信アンテナ１５Ａと受信アンテナ１６の
両方が、並列共振回路で構成されているカードリーダラ
イタ１Ｅは、受信を行う際に、送信アンテナ１５Ａも電
波を受信する。そのため、両方のアンテナが共振し、共
振周波数の僅かなずれから、位相がずれ、受信アンテナ
１６は、図１７（ｃ）に示すように、送信アンテナ１５
Ａと受信アンテナ１６の合成した波形を受信する。した
がって、同図（ｃ）の矢印で示すように、受信波形が歪
んでしまい、受信アンテナ１６は正常な受信波形が得ら
れなくなってしまう。
【００８３】そこで、カードリーダライタ１Ｆの制御部
１２Ｆは、受信中は受信ステータス信号によりスイッチ
回路１５１をＯＮにして、送信アンテナ１５Ａの共振を
ふせぎ、図１７（ｂ）に示すように、波形が歪まない信
号を受信し、また送信時はスイッチ回路１５１をＯＦＦ
するようにする。なお、図１７（ａ）は、非接触ＩＣカ
ード２からの信号波形である。したがって、送信アンテ
ナ１５と受信アンテナ１６Ａの干渉を防ぎ、ひいては通
信エラーレートを下げ、通信信頼性を向上できる。
【００８４】実施例９．この発明の実施例９に係るカー
ドリーダライタについて図１８を参照しながら説明す
る。図１８は、この発明の実施例９に係るカードリーダ
ライタ１Ｇの構成を示すブロック図であり、入出力回路
１１〜送信回路１４、及び受信アンテナ１６〜電源回路
１８は上述した従来のカードリーダライタ１のものと同
じである。
【００８５】図１８において、カードリーダライタ１Ｇ
は、直列共振回路で構成された送信アンテナ１５Ｂを備
える。
【００８６】送信アンテナ１５Ｂを直列共振回路で構成
すれば、並列共振回路のように、ループになっていない
ので、電波を受信しない。したがって、受信アンテナ１
６の受信波形に影響を与えず、ひいては通信エラーレー
トを下げ、通信信頼性を向上できる。
【００８７】送信アンテナ１５Ｂに、直列共振回路か並
列共振回路を用いる場合、前者の方が後者よりドライブ
時の電流が大きいため、直列共振回路を使用する場合は
カードリーダライタ１Ｇの電源回路１８の容量を大きく
する必要がある。ただし、直列共振回路は、低い電圧で
もドライブできるので、電源は並列共振回路のように２
電源にする必要はない（直列共振の場合、電圧はＱで決
まる。）。
【００８８】実施例１０．実施例７と、実施例８又は実
施例９とを組み合わせることにより、受信距離を延長す
ることができ、受信アンテナに対する送信アンテナの影
響を解消でき、ひいては通信エラーレートを下げ、通信
信頼性を向上できるカードリーダライタを得ることが可
能である。
【００８９】実施例１１．実施例３又は実施例４と、実
施例５又は実施例６と、実施例８又は実施例９とを組合
わせることにより、送信信号の形態を変え、また、送信
時の受信回路に対する影響を解消し、さらに、受信アン
テナに対する送信アンテナの影響を解消することができ
るカードリーダライタを得ることが可能である。また、
非接触ＩＣカード側では、スタートフラグをより確実に
受信できる。したがって、通信エラーレートを下げ、通
信信頼性を向上できるカードリーダライタ及び非接触Ｉ
Ｃカードを得ることが可能である。
【００９０】実施例１２．実施例１又は実施例２の非接
触ＩＣカードと、実施例１１のカードリーダライタとを
組み合わせることにより、通信エラーレートを下げ、通
信信頼性を向上できるカード装置（カードシステム）を
得ることが可能である。
【００９１】
【発明の効果】この発明の請求項１に係る非接触ＩＣカ
ードは、以上説明したとおり、受信回路からの受信デー
タを１ビット毎にモニタし、スタートフラグを検出した
ときにＵＡＲＴを受信許可にする制御部を備えたので、
スタートフラグを確実に受信でき、ひいては通信エラー
レートを下げ、通信信頼性を向上することができるとい
う効果を奏する。
【００９２】この発明の請求項２に係る非接触ＩＣカー
ドは、以上説明したとおり、カードリーダライタによる
電波の送信が終了してから前記カードリーダライタのＡ
ＧＣの感度が回復するまでの時間が経過してから応答信
号を返信する制御部を備えたので、通信距離を延ばすこ
とができ、ひいては通信エラーレートを下げ、通信信頼
性を向上することができるという効果を奏する。
【００９３】この発明の請求項３に係るカードリーダラ
イタは、以上説明したとおり、トリガ信号とスタートフ
ラグの間隔を１フレーム以上とする制御部を備えたの
で、非接触ＩＣカード側ではスタートフラグを確実に受
信でき、ひいては通信エラーレートを下げ、通信信頼性
を向上することができるという効果を奏する。
【００９４】この発明の請求項４に係るカードリーダラ
イタは、以上説明したとおり、トリガ信号とスタートフ
ラグの間にダミーデータを挿入する制御部を備えたの
で、非接触ＩＣカード側ではフレーミングエラーが発生
し、次のスタートフラグを確実に受信でき、ひいては通
信エラーレートを下げ、通信信頼性を向上することがで
きるという効果を奏する。
【００９５】この発明の請求項５に係るカードリーダラ
イタは、以上説明したとおり、受信アンテナと受信回路
の間に送信中は両者を切り離すスイッチ回路をさらに備
えたので、ＡＧＣの受信感度の低下を防ぎ、通信距離を
延ばすことができ、ひいては通信エラーレートを下げ、
通信信頼性を向上することができるという効果を奏す
る。
【００９６】この発明の請求項６に係るカードリーダラ
イタは、以上説明したとおり、受信アンテナと受信回路
の間に送信中はスイッチング時のノイズが上記受信回路
へ伝わらないタイミングで両者を切り離すスイッチ回路
をさらに備えたので、ＡＧＣの受信感度の低下を防ぎ、
通信距離を延ばすことができ、ひいては通信エラーレー
トを下げ、通信信頼性を向上することができるという効
果を奏する。
【００９７】この発明の請求項７に係るカードリーダラ
イタは、以上説明したとおり、送信中は共振しないよう
にできるスイッチ回路を有する受信アンテナを備えたの
で、送信アンテナと受信アンテナの干渉を防ぐことがで
き、ひいては通信エラーレートを下げ、通信信頼性を向
上することができるという効果を奏する。
【００９８】この発明の請求項８に係るカードリーダラ
イタは、以上説明したとおり、受信中は共振しないよう
にできるスイッチ回路を有する送信アンテナを備えたの
で、送信アンテナと受信アンテナの干渉を防ぐことがで
き、ひいては通信エラーレートを下げ、通信信頼性を向
上することができるという効果を奏する。
【００９９】この発明の請求項９に係るカードリーダラ
イタは、以上説明したとおり、直列共振回路からなる送
信アンテナを備えたので、送信アンテナと受信アンテナ
の干渉を防ぐことができ、ひいては通信エラーレートを
下げ、通信信頼性を向上することができるという効果を
奏する。
【０１００】この発明の請求項１０に係るカードリーダ
ライタは、以上説明したとおり、送信中は共振しないよ
うにできるスイッチ回路を有する受信アンテナと、直列
共振回路からなる送信アンテナとを備えたので、送信ア
ンテナと受信アンテナの干渉を防ぐことができ、ひいて
は通信エラーレートを下げ、通信信頼性を向上すること
ができるという効果を奏する。
【０１０１】この発明の請求項１１に係るカードリーダ
ライタは、以上説明したとおり、受信アンテナと受信回
路の間に送信中は両者を切り離すスイッチ回路と、直列
共振回路からなる送信アンテナと、トリガ信号とスター
トフラグの間にダミーデータを挿入する制御部とを備え
たので、非接触ＩＣカード側ではフレーミングエラーが
発生し、次のスタートフラグを確実に受信でき、カード
リーダライタ側ではＡＧＣの受信感度の低下を防ぎ、通
信距離を延ばすことができ、また、送信アンテナと受信
アンテナの干渉を防ぐことができ、ひいては通信エラー
レートを下げ、通信信頼性を向上することができるとい
う効果を奏する。
【０１０２】この発明の請求項１２に係るカード装置
は、以上説明したとおり、第１の受信回路からの受信デ
ータを１ビット毎にモニタし、スタートフラグを検出し
たときに第１のＵＡＲＴを受信許可にする第１の制御部
を有する非接触ＩＣカードと、直列共振回路からなる受
信アンテナ、及び前記受信アンテナと第２の受信回路の
間に送信中は両者を切り離すスイッチ回路を有するカー
ドリーダライタとを備えたので、非接触ＩＣカード側で
はスタートフラグを確実に受信でき、カードリーダライ
タ側ではＡＧＣの受信感度の低下を防ぎ、通信距離を延
ばすことができ、送信アンテナと受信アンテナの干渉を
防ぐことができ、ひいては通信エラーレートを下げ、通
信信頼性を向上することができるという効果を奏する。
【０１０３】この発明の請求項１３に係るカード装置
は、以上説明したとおり、カードリーダライタによる電
波の送信が終了してから前記カードリーダライタのＡＧ
Ｃの感度が回復するまでの時間が経過してから応答信号
を返信する第１の制御部を有する非接触ＩＣカードと、
直列共振回路からなる送信アンテナ、及びトリガ信号と
スタートフラグの間にダミーデータを挿入する第２の制
御部を有するカードリーダライタとを備えたので、非接
触ＩＣカード側ではスタートフラグを確実に受信でき、
カードリーダライタ側ではＡＧＣの受信感度の低下を防
ぎ、通信距離を延ばすことができ、送信アンテナと受信
アンテナの干渉を防ぐことができ、ひいては通信エラー
レートを下げ、通信信頼性を向上することができるとい
う効果を奏する。
【図面の簡単な説明】
【図１】この発明の実施例１に係る非接触ＩＣカードの
構成を示すブロック図である。
【図２】この発明の実施例１に係る非接触ＩＣカードが
受信する信号形態を示す図である。
【図３】この発明の実施例１に係る非接触ＩＣカードの
動作を示すフローチャートである。
【図４】この発明の実施例２に係る非接触ＩＣカードの
構成を示すブロック図である。
【図５】この発明の実施例２に係る非接触ＩＣカードの
動作を説明するための、カードリーダライタの動作を示
す図である。
【図６】この発明の実施例２に係る非接触ＩＣカードの
動作を示すフローチャートである。
【図７】この発明の実施例３に係るカードリーダライタ
の構成を示すブロック図である。
【図８】この発明の実施例３に係るカードリーダライタ
が送信する信号形態を示す図である。
【図９】この発明の実施例４に係るカードリーダライタ
の構成を示すブロック図である。
【図１０】この発明の実施例４に係るカードリーダライ
タが送信する信号形態を示す図である。
【図１１】この発明の実施例５に係るカードリーダライ
タの構成を示すブロック図である。
【図１２】この発明の実施例６に係るカードリーダライ
タの構成を示すブロック図である。
【図１３】この発明の実施例６に係るカードリーダライ
タのスイッチ回路の構成を示す図である。
【図１４】この発明の実施例６に係るカードリーダライ
タの動作を示す図である。
【図１５】この発明の実施例７に係るカードリーダライ
タの構成を示すブロック図である。
【図１６】この発明の実施例８に係るカードリーダライ
タの構成を示すブロック図である。
【図１７】この発明の実施例８に係るカードリーダライ
タの動作を示す図である。
【図１８】この発明の実施例９に係るカードリーダライ
タの構成を示すブロック図である。
【図１９】従来の非接触ＩＣカードとカードリーダライ
タからなるカード装置の構成を示すブロック図である。
【図２０】従来のカードリーダライタの受信回路の構成
を示す図である。
【図２１】従来のカードリーダライタから非接触ＩＣカ
ードへの送信信号の形態を示す図である。
【図２２】従来のカードリーダライタから非接触ＩＣカ
ードへの送信信号の形態を示す図である。
【図２３】従来の非接触ＩＣカードの動作を示すフロー
チャートである。
【図２４】従来の非接触ＩＣカードの動作を示すフロー
チャートである。
【符号の説明】 １Ａ、１Ｂ、１Ｃ カードリーダライタ １Ｄ、１Ｅ、１Ｆ カードリーダライタ １Ｇ カードリーダライタ ２Ａ、２Ｂ 非接触ＩＣカード １１ 入出力回路 １２Ａ、１２Ｂ、１２Ｃ 制御部 １２Ｄ、１２Ｅ、１２Ｆ 制御部 １３ ＵＡＲＴ １４ 送信回路 １５、１５Ａ、１５Ｂ 送信アンテナ １６、１６Ａ 受信アンテナ １７ 受信回路 １８ 電源回路 １９、１９Ａ スイッチ回路 ２１ 送受信アンテナ ２２ 受信回路 ２３ ＵＡＲＴ ２４Ａ、２４Ｂ 制御部 ２５ 送信回路 ２６ 電源回路 ２７ Ｆ／Ｆ

Claims (13)

    【特許請求の範囲】
  1. 【請求項１】 受信した電波を電気信号へ変換しその逆
    を行う送受信アンテナと、受信電気信号を復調してデジ
    タル信号へ変換する受信回路と、前記デジタル信号のシ
    リアルデータをパラレルデータへ変換しその逆を行うＵ
    ＡＲＴと、前記ＵＡＲＴからのシリアルデータのデジタ
    ル信号を変調して送信電気信号へ変換する送信回路と、
    全体の制御を行う制御部とを備える非接触ＩＣカードに
    おいて、前記制御部は、前記受信回路からの受信データ
    を１ビット毎にモニタし、スタートフラグを検出したと
    きに前記ＵＡＲＴを受信許可にすることを特徴とする非
    接触ＩＣカード。
  2. 【請求項２】 受信した電波を電気信号へ変換しその逆
    を行う送受信アンテナと、受信電気信号を復調してデジ
    タル信号へ変換する受信回路と、前記デジタル信号のシ
    リアルデータをパラレルデータへ変換しその逆を行うＵ
    ＡＲＴと、前記ＵＡＲＴからのシリアルデータのデジタ
    ル信号を変調して送信電気信号へ変換する送信回路と、
    全体の制御を行う制御部とを備える非接触ＩＣカードに
    おいて、前記制御部は、カードリーダライタによる電波
    の送信が終了してから前記カードリーダライタのＡＧＣ
    の感度が回復するまでの時間が経過してから応答信号を
    返信することを特徴とする非接触ＩＣカード。
  3. 【請求項３】 シリアルデータをパラレルデータへ変換
    しその逆の変換を行うＵＡＲＴと、前記ＵＡＲＴからの
    シリアルデータのデジタル信号を変調して送信電気信号
    へ変換する送信回路と、前記送信電気信号を電波として
    送信する送信アンテナと、受信した電波を受信電気信号
    へ変換する受信アンテナと、前記受信電気信号を復調し
    てデジタル信号へ変換する受信回路と、全体の制御を行
    う制御部とを備えるカードリーダライタにおいて、前記
    制御部は、トリガ信号とスタートフラグの間隔を１フレ
    ーム以上としたことを特徴とするカードリーダライタ。
  4. 【請求項４】 前記制御部は、前記トリガ信号と前記ス
    タートフラグの間にダミーデータを挿入したことを特徴
    とする請求項３記載のカードリーダライタ。
  5. 【請求項５】 シリアルデータをパラレルデータへ変換
    しその逆の変換を行うＵＡＲＴと、前記ＵＡＲＴからの
    シリアルデータのデジタル信号を変調して送信電気信号
    へ変換する送信回路と、前記送信電気信号を電波として
    送信する送信アンテナと、受信した電波を受信電気信号
    へ変換する受信アンテナと、前記受信電気信号を復調し
    てデジタル信号へ変換する受信回路と、全体の制御を行
    う制御部とを備えるカードリーダライタにおいて、前記
    受信アンテナと前記受信回路の間に送信中は両者を切り
    離すスイッチ回路をさらに備えたことを特徴とするカー
    ドリーダライタ。
  6. 【請求項６】 前記スイッチ回路は、スイッチング時の
    ノイズが前記受信回路へ伝わらないタイミングで両者を
    切り離すことを特徴とする請求項５記載のカードリーダ
    ライタ。
  7. 【請求項７】 シリアルデータをパラレルデータへ変換
    しその逆の変換を行うＵＡＲＴと、前記ＵＡＲＴからの
    シリアルデータのデジタル信号を変調して送信電気信号
    へ変換する送信回路と、前記送信電気信号を電波として
    送信する送信アンテナと、受信した電波を受信電気信号
    へ変換する並列共振回路からなる受信アンテナと、前記
    受信電気信号を復調してデジタル信号へ変換する受信回
    路と、全体の制御を行う制御部とを備えるカードリーダ
    ライタにおいて、前記受信アンテナは、送信中は共振し
    ないようにできるスイッチ回路を有することを特徴とす
    るカードリーダライタ。
  8. 【請求項８】 シリアルデータをパラレルデータへ変換
    しその逆の変換を行うＵＡＲＴと、前記ＵＡＲＴからの
    シリアルデータのデジタル信号を変調して送信電気信号
    へ変換する送信回路と、前記送信電気信号を電波として
    送信する並列共振回路からなる送信アンテナと、受信し
    た電波を受信電気信号へ変換する受信アンテナと、前記
    受信電気信号を復調してデジタル信号へ変換する受信回
    路と、全体の制御を行う制御部とを備えるカードリーダ
    ライタにおいて、前記送信アンテナは、受信中は共振し
    ないようにできるスイッチ回路を有することを特徴とす
    るカードリーダライタ。
  9. 【請求項９】 シリアルデータをパラレルデータへ変換
    しその逆の変換を行うＵＡＲＴと、前記ＵＡＲＴからの
    シリアルデータのデジタル信号を変調して送信電気信号
    へ変換する送信回路と、前記送信電気信号を電波として
    送信する送信アンテナと、受信した電波を受信電気信号
    へ変換する受信アンテナと、前記受信電気信号を復調し
    てデジタル信号へ変換する受信回路と、全体の制御を行
    う制御部とを備えるカードリーダライタにおいて、前記
    送信アンテナは、直列共振回路からなることを特徴とす
    るカードリーダライタ。
  10. 【請求項１０】 シリアルデータをパラレルデータへ変
    換しその逆の変換を行うＵＡＲＴと、前記ＵＡＲＴから
    のシリアルデータのデジタル信号を変調して送信電気信
    号へ変換する送信回路と、前記送信電気信号を電波とし
    て送信する送信アンテナと、受信した電波を受信電気信
    号へ変換する受信アンテナと、前記受信電気信号を復調
    してデジタル信号へ変換する受信回路と、全体の制御を
    行う制御部とを備えるカードリーダライタにおいて、前
    記受信アンテナは、並列共振回路からなり送信中は共振
    しないようにできるスイッチ回路を有し、前記送信アン
    テナは、直列共振回路からなることを特徴とするカード
    リーダライタ。
  11. 【請求項１１】 シリアルデータをパラレルデータへ変
    換しその逆の変換を行うＵＡＲＴと、前記ＵＡＲＴから
    のシリアルデータのデジタル信号を変調して送信電気信
    号へ変換する送信回路と、前記送信電気信号を電波とし
    て送信する送信アンテナと、受信した電波を受信電気信
    号へ変換する受信アンテナと、前記受信電気信号を復調
    してデジタル信号へ変換する受信回路と、全体の制御を
    行う制御部とを備えるカードリーダライタにおいて、前
    記受信アンテナと前記受信回路の間に送信中は両者を切
    り離すスイッチ回路をさらに備え、前記送信アンテナは
    直列共振回路からなり、前記制御部は前記トリガ信号と
    前記スタートフラグの間にダミーデータを挿入すること
    を特徴とするカードリーダライタ。
  12. 【請求項１２】 受信した電波を電気信号へ変換しその
    逆を行う送受信アンテナ、受信電気信号を復調してデジ
    タル信号へ変換する第１の受信回路、前記デジタル信号
    のシリアルデータをパラレルデータへ変換しその逆を行
    う第１のＵＡＲＴ、前記第１のＵＡＲＴからのシリアル
    データのデジタル信号を変調して送信電気信号へ変換す
    る第１の送信回路、及び前記受信回路からの受信データ
    を１ビット毎にモニタし、スタートフラグを検出したと
    きに前記ＵＡＲＴを受信許可にする第１の制御部を有す
    る非接触ＩＣカード、並びにシリアルデータをパラレル
    データへ変換しその逆の変換を行う第２のＵＡＲＴ、前
    記第２のＵＡＲＴからのシリアルデータのデジタル信号
    を変調して送信電気信号へ変換する第２の送信回路、前
    記送信電気信号を電波として送信する送信アンテナ、受
    信した電波を受信電気信号へ変換する直列共振回路から
    なる受信アンテナ、前記受信電気信号を復調してデジタ
    ル信号へ変換する第２の受信回路、全体の制御を行う第
    ２の制御部、及び前記受信アンテナと前記受信回路の間
    に送信中は両者を切り離すスイッチ回路を有するカード
    リーダライタを備えたことを特徴とするカード装置。
  13. 【請求項１３】 受信した電波を電気信号へ変換しその
    逆を行う送受信アンテナ、受信電気信号を復調してデジ
    タル信号へ変換する第１の受信回路、前記デジタル信号
    のシリアルデータをパラレルデータへ変換しその逆を行
    う第１のＵＡＲＴ、前記第１のＵＡＲＴからのシリアル
    データのデジタル信号を変調して送信電気信号へ変換す
    る第１の送信回路、及び所定の時間が経過してから応答
    信号を返信する第１の制御部を有する非接触ＩＣカー
    ド、並びにシリアルデータをパラレルデータへ変換しそ
    の逆の変換を行う第２のＵＡＲＴ、前記第２のＵＡＲＴ
    からのシリアルデータのデジタル信号を変調して送信電
    気信号へ変換する第２の送信回路、前記送信電気信号を
    電波として送信する直列共振回路からなる送信アンテ
    ナ、受信した電波を受信電気信号へ変換する受信アンテ
    ナ、前記受信電気信号を復調してデジタル信号へ変換す
    る第２の受信回路、及び前記トリガ信号と前記スタート
    フラグの間にダミーデータを挿入する第２の制御部を有
    するカードリーダライタを備え、前記所定の時間は、前
    記カードリーダライタによる電波の送信が終了してから
    前記カードリーダライタのＡＧＣの感度が回復するまで
    の時間であることを特徴とするカード装置。
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