JPH0426785B2 - - Google Patents
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- Publication number
- JPH0426785B2 JPH0426785B2 JP60247619A JP24761985A JPH0426785B2 JP H0426785 B2 JPH0426785 B2 JP H0426785B2 JP 60247619 A JP60247619 A JP 60247619A JP 24761985 A JP24761985 A JP 24761985A JP H0426785 B2 JPH0426785 B2 JP H0426785B2
- Authority
- JP
- Japan
- Prior art keywords
- tab
- heat sink
- heat
- wiring pattern
- connection terminal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
Links
Classifications
-
- H10W76/60—
-
- H10W76/157—
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/34—Strap connectors, e.g. copper straps for grounding power devices; Manufacturing methods related thereto
- H01L2224/39—Structure, shape, material or disposition of the strap connectors after the connecting process
- H01L2224/40—Structure, shape, material or disposition of the strap connectors after the connecting process of an individual strap connector
- H01L2224/401—Disposition
- H01L2224/40151—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/40221—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/40225—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
-
- H10W70/63—
-
- H10W72/07337—
-
- H10W72/07653—
-
- H10W90/734—
-
- H10W90/736—
Landscapes
- Cooling Or The Like Of Semiconductors Or Solid State Devices (AREA)
Description
【発明の詳細な説明】
[産業上の利用分野]
本発明は、電子部品の実装構造に関し、特にテ
ープキヤリア方式で組立てられたIC(以下TAB
IC)のパツケージングにおける実装構造に関す
るものである。
ープキヤリア方式で組立てられたIC(以下TAB
IC)のパツケージングにおける実装構造に関す
るものである。
[従来の技術]
従来この種の電子部品の実装構造は、TAB IC
の絶縁と放熱を目的として、第2図の様にセラミ
ツク基板8上に厚摸技術にて配線パターン9を設
けその上にTAB IC1を熱伝導性接着剤10を用
いて接着実装し封止し、次にセラミツク基板8の
反対側に良熱伝導材料を使用したヒートシンク2
を熱伝導性接着剤10を用いて接着し放熱する構
造となつていた。また配線パターン9の一端と
TAB IC1との間がICリード3およびICリード
接続端子4,11を介して接続されており、配線
パターン9の他端にはI/Oパツド5が形成され
ていた。更にTAB IC1およびICリード3は封
止用キヤツプ6で封止されていた。
の絶縁と放熱を目的として、第2図の様にセラミ
ツク基板8上に厚摸技術にて配線パターン9を設
けその上にTAB IC1を熱伝導性接着剤10を用
いて接着実装し封止し、次にセラミツク基板8の
反対側に良熱伝導材料を使用したヒートシンク2
を熱伝導性接着剤10を用いて接着し放熱する構
造となつていた。また配線パターン9の一端と
TAB IC1との間がICリード3およびICリード
接続端子4,11を介して接続されており、配線
パターン9の他端にはI/Oパツド5が形成され
ていた。更にTAB IC1およびICリード3は封
止用キヤツプ6で封止されていた。
[解決すべき問題点]
上述した従来の電子部品の実装構造では、セラ
ミツク基板8上にTAB IC1を実装しそのセラミ
ツク基板8にヒートシンク2を接着する構造であ
りTAB IC1からの熱がセラミツク基板8を介し
てヒートシンク2に熱伝導され放熱する構造であ
るため、放熱効果が良くないという欠点があつ
た。またセラミツク基板8とヒートシンク2とを
使用するため、コストがかかるという欠点もあつ
た。
ミツク基板8上にTAB IC1を実装しそのセラミ
ツク基板8にヒートシンク2を接着する構造であ
りTAB IC1からの熱がセラミツク基板8を介し
てヒートシンク2に熱伝導され放熱する構造であ
るため、放熱効果が良くないという欠点があつ
た。またセラミツク基板8とヒートシンク2とを
使用するため、コストがかかるという欠点もあつ
た。
[問題点の解決手段]
上述した従来の問題点を解決すべく本発明は、
セラミツク基板を除去することにより放熱効果お
よび経費効率を改善してなる電子部品の実装構造
を提供せんとするものである。
セラミツク基板を除去することにより放熱効果お
よび経費効率を改善してなる電子部品の実装構造
を提供せんとするものである。
そのために本発明は、良熱伝導材料を使用した
ヒートシンク上に直接ポリイミド絶縁層と配線パ
ターンを設け、該ヒートシンク上に直接TAB IC
を取付け、該TAB ICを封止用キヤツプにて封止
してなることを特徴とする電子部品の実装構造を
提供するものである。
ヒートシンク上に直接ポリイミド絶縁層と配線パ
ターンを設け、該ヒートシンク上に直接TAB IC
を取付け、該TAB ICを封止用キヤツプにて封止
してなることを特徴とする電子部品の実装構造を
提供するものである。
[実施例]
次に本発明について添付図面を参照しつつ具体
的に説明する。
的に説明する。
第1図は、本発明の電子部品の実装構造の一実
施例の縦断面図である。
施例の縦断面図である。
放熱用ヒートシンク2に熱伝導性接着剤10に
よりTAB IC1が直接接着されている。TAB IC
1のリード接続端子11に接続されたICリード
3はポリイミド絶縁層7上の配線パターンすなわ
ちリード接続端子4に接続され、I/Oパツド5
に接続されている。封止用キヤツプ6はI/Oパ
ツド5の内側にTAB IC1を保護する形でポリイ
ミド絶縁層12を介して接着されている。
よりTAB IC1が直接接着されている。TAB IC
1のリード接続端子11に接続されたICリード
3はポリイミド絶縁層7上の配線パターンすなわ
ちリード接続端子4に接続され、I/Oパツド5
に接続されている。封止用キヤツプ6はI/Oパ
ツド5の内側にTAB IC1を保護する形でポリイ
ミド絶縁層12を介して接着されている。
従つて、I/Oパツド5からリード接続端子
4、ICリード3およびリード接続端子11を介
して給電されたときTAB IC1は発熱する。
TAB IC1の発熱した熱は熱伝導性接着剤10を
介して直接に放熱用ヒートシンク2に伝達され、
放熱用ヒートシンク2により外部環境に放出され
る。このとき放熱用ヒートシンク2とリード接続
端子4との間およびリード接続端子4と封止用キ
ヤツプ6との間にはポリイミド絶縁層7,12が
配置されているのでリード接続端子4およびI/
Oパツド5を介して外部部材(図示せず)に対し
TAB IC1の発生した熱が伝達されることが十分
に防止されている。
4、ICリード3およびリード接続端子11を介
して給電されたときTAB IC1は発熱する。
TAB IC1の発熱した熱は熱伝導性接着剤10を
介して直接に放熱用ヒートシンク2に伝達され、
放熱用ヒートシンク2により外部環境に放出され
る。このとき放熱用ヒートシンク2とリード接続
端子4との間およびリード接続端子4と封止用キ
ヤツプ6との間にはポリイミド絶縁層7,12が
配置されているのでリード接続端子4およびI/
Oパツド5を介して外部部材(図示せず)に対し
TAB IC1の発生した熱が伝達されることが十分
に防止されている。
[発明の効果]
以上説明したように本発明は、良熱伝導材料を
使用した放熱用のヒートシンク上に直接ポリイミ
ド絶縁層と配線パターンを設けその上にTAB IC
を実装する構造でありTAB ICが直接ヒートシン
クに接合されているので、放熱効果が高く、パツ
ケージ1つ1つの高速化が実現できるという効果
をもつ。また放熱用のヒートシンクを基板として
代用しており高価なセラミツク基板を使用しない
ためコストが安くなるという効果がある。
使用した放熱用のヒートシンク上に直接ポリイミ
ド絶縁層と配線パターンを設けその上にTAB IC
を実装する構造でありTAB ICが直接ヒートシン
クに接合されているので、放熱効果が高く、パツ
ケージ1つ1つの高速化が実現できるという効果
をもつ。また放熱用のヒートシンクを基板として
代用しており高価なセラミツク基板を使用しない
ためコストが安くなるという効果がある。
第1図は本発明の電子部品の放熱構造の一実施
例を使用した電子部品の縦断面図、第2図は従来
のICパツケージング構造を使用した電子部品の
縦断面図である。 1:TAB IC、2:放熱用ヒートシンク、3:
ICリード、4:ICリード接続端子、5:I/O
パツド、6:封止用キヤツプ、7:ポリイミド絶
縁層、8:セラミツク基板、9:導体パターン、
10:熱伝導性接着剤、11:リード接続端子、
12:ポリイミド絶縁層。
例を使用した電子部品の縦断面図、第2図は従来
のICパツケージング構造を使用した電子部品の
縦断面図である。 1:TAB IC、2:放熱用ヒートシンク、3:
ICリード、4:ICリード接続端子、5:I/O
パツド、6:封止用キヤツプ、7:ポリイミド絶
縁層、8:セラミツク基板、9:導体パターン、
10:熱伝導性接着剤、11:リード接続端子、
12:ポリイミド絶縁層。
Claims (1)
- 1 良熱伝導材料を使用したヒートシンク上に直
接ポリイミド絶縁層と配線パターンを設け、該ヒ
ートシンク上に直接TAB ICを取付け、該TAB
ICを封止用キヤツプにて封止してなることを特
徴とする電子部品の実装構造。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60247619A JPS62106651A (ja) | 1985-11-05 | 1985-11-05 | 電子部品の実装構造 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60247619A JPS62106651A (ja) | 1985-11-05 | 1985-11-05 | 電子部品の実装構造 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS62106651A JPS62106651A (ja) | 1987-05-18 |
| JPH0426785B2 true JPH0426785B2 (ja) | 1992-05-08 |
Family
ID=17166201
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60247619A Granted JPS62106651A (ja) | 1985-11-05 | 1985-11-05 | 電子部品の実装構造 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62106651A (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0524763A2 (en) * | 1991-07-22 | 1993-01-27 | Motorola, Inc. | RF device package |
| JP2007234886A (ja) * | 2006-03-01 | 2007-09-13 | Compal Communications Inc | 散熱構成を有する電子素子アセンブリ |
-
1985
- 1985-11-05 JP JP60247619A patent/JPS62106651A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS62106651A (ja) | 1987-05-18 |
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Legal Events
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