JPH04257111A - 積層チップπ型フィルタ - Google Patents
積層チップπ型フィルタInfo
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- JPH04257111A JPH04257111A JP6088991A JP6088991A JPH04257111A JP H04257111 A JPH04257111 A JP H04257111A JP 6088991 A JP6088991 A JP 6088991A JP 6088991 A JP6088991 A JP 6088991A JP H04257111 A JPH04257111 A JP H04257111A
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Links
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Landscapes
- Coils Or Transformers For Communication (AREA)
- Fixed Capacitors And Capacitor Manufacturing Machines (AREA)
- Filters And Equalizers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】本発明は、ＥＭＩ除去フィルタと
して用いられるインダクタとコンデンサとから構成され
た積層チップπ型フィルタ、特にＥＭＩを除去するとと
もにサージ吸収能力を備えた積層チップπ型フィルタに
関する。
して用いられるインダクタとコンデンサとから構成され
た積層チップπ型フィルタ、特にＥＭＩを除去するとと
もにサージ吸収能力を備えた積層チップπ型フィルタに
関する。
【０００２】
【従来の技術】従来から積層チップバリスタ及び積層チ
ップインダクタは知られている。また積層チップ部品の
ＥＭＩ除去用π型フィルタとして、■積層チップコンデ
ンサ（Ｃ）２素子と積層チップコイル（Ｌ）１素子とを
積層する等してワンチップに搭載し、同時焼成して一体
化したもの、■積層コンデンサ２素子とチップインダク
タ１素子とを組み合わせて接着又は埋め込んでワンチッ
プに一体化したもの等があった。これらの積層チップπ
型フィルタは、積層コンデンサ２素子とチップインダク
タ１素子とを組み合わせてπ型等価回路を構成し、ＥＭ
Ｉ除去用フィルタとして使用している。
ップインダクタは知られている。また積層チップ部品の
ＥＭＩ除去用π型フィルタとして、■積層チップコンデ
ンサ（Ｃ）２素子と積層チップコイル（Ｌ）１素子とを
積層する等してワンチップに搭載し、同時焼成して一体
化したもの、■積層コンデンサ２素子とチップインダク
タ１素子とを組み合わせて接着又は埋め込んでワンチッ
プに一体化したもの等があった。これらの積層チップπ
型フィルタは、積層コンデンサ２素子とチップインダク
タ１素子とを組み合わせてπ型等価回路を構成し、ＥＭ
Ｉ除去用フィルタとして使用している。
【０００３】
【発明が解決しようとする課題】しかしながら、上記の
従来の積層チップπ型フィルタは、いずれの場合も積層
コンデンサ２素子とチップインダクタ１素子とを組み合
わせたものであり、サージ吸収効果がない。そのため、
上記の従来の積層チップπ型フィルタを使用したワープ
ロ、パソコン等の電子機器においてキーボード等からデ
ータを入力する場合には、人体からでる静電気が入るの
を阻止できず、ＩＣ，ＬＳＩ等を損傷するおそれがあっ
た。
従来の積層チップπ型フィルタは、いずれの場合も積層
コンデンサ２素子とチップインダクタ１素子とを組み合
わせたものであり、サージ吸収効果がない。そのため、
上記の従来の積層チップπ型フィルタを使用したワープ
ロ、パソコン等の電子機器においてキーボード等からデ
ータを入力する場合には、人体からでる静電気が入るの
を阻止できず、ＩＣ，ＬＳＩ等を損傷するおそれがあっ
た。
【０００４】本発明は、このような事情に鑑みてなされ
たものであり、小型であって、ＥＭＩをよく除去すると
ともにサージ吸収能力を備えた積層チップπ型フィルタ
を提供することを目的としている。
たものであり、小型であって、ＥＭＩをよく除去すると
ともにサージ吸収能力を備えた積層チップπ型フィルタ
を提供することを目的としている。
【０００５】
【課題を解決するための手段】本発明に係る積層チップ
π型フィルタは、対向電極を有するバリスタシートが積
層されてなる積層チップコンデンサ２素子と、帯状導体
線路が形成されたフェライトシートが積層されてなる積
層チップインダクタ１素子とからなり、このインダクタ
の前記積層チップコンデンサに対向する面には帯状導体
線路が形成されていないフェライトシートから形成され
たフェライト層が介在して前記積層チップコンデンサと
積層チップインダクタとは積層されて一体化されている
ことを特徴とする。また、前記積層チップインダクタの
前記積層チップコンデンサに対向する面には対向電極を
有しないバリスタシートが介在していることを特徴とす
る。
π型フィルタは、対向電極を有するバリスタシートが積
層されてなる積層チップコンデンサ２素子と、帯状導体
線路が形成されたフェライトシートが積層されてなる積
層チップインダクタ１素子とからなり、このインダクタ
の前記積層チップコンデンサに対向する面には帯状導体
線路が形成されていないフェライトシートから形成され
たフェライト層が介在して前記積層チップコンデンサと
積層チップインダクタとは積層されて一体化されている
ことを特徴とする。また、前記積層チップインダクタの
前記積層チップコンデンサに対向する面には対向電極を
有しないバリスタシートが介在していることを特徴とす
る。
【０００６】
【作用】上記のように構成された本発明に係る積層チッ
プπ型フィルタは、インダクタは帯状導体線路のターン
数やフェライトシートの材質を変えることにより所望の
値のインダクタンスを容易に選択できるとともに、小型
にできる。コンデンサについても、バリスタシートの材
質、厚み、対向電極の面積を調整することにより、所望
の値の容量を容易に選択できるとともに、小型にできる
。従って、フィルタとして周波数特性が良好なものが選
択できるとともに、小型になる。また、積層チップコン
デンサに対向するインダクタの面には帯状導体線路が形
成されていないフェライト層又はバリスタ層が介在して
いること等により、層の密着性がよくなり、磁束のもれ
を減らすことになりインダクタンスを大きくし、小型化
が図れるとともに、実装密度を高くでき、寄生インダク
タンスや浮遊容量による影響が少なくなり、減衰特性の
バラツキが少ない周波数特性のよい信頼性の高いＥＭＩ
除去フィルタが得られる。また、サージ電圧が発生した
場合は、バリスタが吸収するので、高電圧によりＩＣ，
ＬＳＩ等が損傷するおそれがなくなる。
プπ型フィルタは、インダクタは帯状導体線路のターン
数やフェライトシートの材質を変えることにより所望の
値のインダクタンスを容易に選択できるとともに、小型
にできる。コンデンサについても、バリスタシートの材
質、厚み、対向電極の面積を調整することにより、所望
の値の容量を容易に選択できるとともに、小型にできる
。従って、フィルタとして周波数特性が良好なものが選
択できるとともに、小型になる。また、積層チップコン
デンサに対向するインダクタの面には帯状導体線路が形
成されていないフェライト層又はバリスタ層が介在して
いること等により、層の密着性がよくなり、磁束のもれ
を減らすことになりインダクタンスを大きくし、小型化
が図れるとともに、実装密度を高くでき、寄生インダク
タンスや浮遊容量による影響が少なくなり、減衰特性の
バラツキが少ない周波数特性のよい信頼性の高いＥＭＩ
除去フィルタが得られる。また、サージ電圧が発生した
場合は、バリスタが吸収するので、高電圧によりＩＣ，
ＬＳＩ等が損傷するおそれがなくなる。
【０００７】
【実施例】以下、本発明の実施例を図面に基づいて説明
する。図１〜図３において、１は積層チップπ型フィル
タで、２素子からなる積層チップコンデンサ２，４と１
素子からなる積層チップインダクタ３とが積層され一体
化され、外形が直方体をなしている。図３に示すように
、積層チップコンデンサ２は、バリスタシート２ｅ，２
ｆにそれぞれ形成された対向第１及び第２電極５ａ，５
ｂが対向せしめられているとともに、バリスタシート２
ａ〜２ｆが順次積層されて一体化されて１素子が形成さ
れている。この積層チップコンデンサ２に隣接して帯状
導体線路、電極等の形成されていないフェライトシート
３ａが積層され、次いで帯状導体線路８ａ，８ｂが形成
されたフェライトシート３ｂ，３ｃ、さらに帯状導体線
路、電極等の形成されていないフェライトシート３ｄが
積層されて一体化されて積層チップインダクタ３が１素
子形成されている。さらに、この帯状導体線路も電極も
形成されていないフェライトシート３ｄを介して積層チ
ップコンデンサ４が１素子積層されている。積層チップ
コンデンサ４は、表面に互いに対向してそれぞれ対向第
１及び第２電極１１ａ，１１ｂが形成されているバリス
タシート４ａ，４ｂ及び電極等がないバリスタシート４
ｃ〜４ｅが順次積層されて一体化されて形成されている
。
する。図１〜図３において、１は積層チップπ型フィル
タで、２素子からなる積層チップコンデンサ２，４と１
素子からなる積層チップインダクタ３とが積層され一体
化され、外形が直方体をなしている。図３に示すように
、積層チップコンデンサ２は、バリスタシート２ｅ，２
ｆにそれぞれ形成された対向第１及び第２電極５ａ，５
ｂが対向せしめられているとともに、バリスタシート２
ａ〜２ｆが順次積層されて一体化されて１素子が形成さ
れている。この積層チップコンデンサ２に隣接して帯状
導体線路、電極等の形成されていないフェライトシート
３ａが積層され、次いで帯状導体線路８ａ，８ｂが形成
されたフェライトシート３ｂ，３ｃ、さらに帯状導体線
路、電極等の形成されていないフェライトシート３ｄが
積層されて一体化されて積層チップインダクタ３が１素
子形成されている。さらに、この帯状導体線路も電極も
形成されていないフェライトシート３ｄを介して積層チ
ップコンデンサ４が１素子積層されている。積層チップ
コンデンサ４は、表面に互いに対向してそれぞれ対向第
１及び第２電極１１ａ，１１ｂが形成されているバリス
タシート４ａ，４ｂ及び電極等がないバリスタシート４
ｃ〜４ｅが順次積層されて一体化されて形成されている
。
【０００８】バリスタシート２ｅの対向第１電極５ａに
接続して引出し電極６ａがシートの１辺に沿って形成さ
れ、バリスタシート２ｆの対向第２電極５ｂから引出し
電極７，７が前記引出し電極６ａと離れた２箇所の辺の
縁に延びて形成されている。積層チップコンデンサ２は
、バリスタシートを積層して形成するので小型になると
ともに、対向第１電極５ａ及び対向第２電極５ｂの対向
面積を変えることにより容量を変更できるので、周波数
特性を所望のものに選択することが可能となる。
接続して引出し電極６ａがシートの１辺に沿って形成さ
れ、バリスタシート２ｆの対向第２電極５ｂから引出し
電極７，７が前記引出し電極６ａと離れた２箇所の辺の
縁に延びて形成されている。積層チップコンデンサ２は
、バリスタシートを積層して形成するので小型になると
ともに、対向第１電極５ａ及び対向第２電極５ｂの対向
面積を変えることにより容量を変更できるので、周波数
特性を所望のものに選択することが可能となる。
【０００９】積層チップインダクタ３のフェライトシー
ト３ｂの帯状導体線路８ａは、概略コの字状にシート３
ｃのやや中央部で３辺に沿って屈曲されて形成され、そ
の一方の端は図３上で左側の端部に沿って形成された引
出し電極９ａに接続され、やや短く形成された他方の端
にはスルーホール１０が設けられている。フェライトシ
ート３ｂと隣接するフェライトシート３ｃには、帯状導
体線路８ｂが帯状導体線路８ａと同様にして概略逆Ｊ字
形状に屈曲して形成され、スルーホール１０に対向する
位置の近辺に一端が位置し、他方の端は図３上で右側の
端部に沿って形成された引出し電極９ｂに接続されてい
る。帯状導体線路８ａ，８ｂが形成されたフェライトシ
ート３ｂ，３ｃ・・・を順次重ね合わせて帯状導体線路
８ａ，８ｂ，・・・を順次接続すると、巻き数の多い所
望のインダクタンスのインダクタを形成することができ
る。それにより、所望の周波数特性のものを選択できる
。また、電極が形成されていないフェライトシート又は
バリスタシートからなる層がインダクタとコンデンサ間
に介在している等により、層の密着性がよくなり磁束の
もれを減らすことになりインダクタンスを大きくし小型
化が図れるとともに、実装密度を高くできる。この電極
が形成されていないフェライトの枚数は複数枚であって
も差し支えない。
ト３ｂの帯状導体線路８ａは、概略コの字状にシート３
ｃのやや中央部で３辺に沿って屈曲されて形成され、そ
の一方の端は図３上で左側の端部に沿って形成された引
出し電極９ａに接続され、やや短く形成された他方の端
にはスルーホール１０が設けられている。フェライトシ
ート３ｂと隣接するフェライトシート３ｃには、帯状導
体線路８ｂが帯状導体線路８ａと同様にして概略逆Ｊ字
形状に屈曲して形成され、スルーホール１０に対向する
位置の近辺に一端が位置し、他方の端は図３上で右側の
端部に沿って形成された引出し電極９ｂに接続されてい
る。帯状導体線路８ａ，８ｂが形成されたフェライトシ
ート３ｂ，３ｃ・・・を順次重ね合わせて帯状導体線路
８ａ，８ｂ，・・・を順次接続すると、巻き数の多い所
望のインダクタンスのインダクタを形成することができ
る。それにより、所望の周波数特性のものを選択できる
。また、電極が形成されていないフェライトシート又は
バリスタシートからなる層がインダクタとコンデンサ間
に介在している等により、層の密着性がよくなり磁束の
もれを減らすことになりインダクタンスを大きくし小型
化が図れるとともに、実装密度を高くできる。この電極
が形成されていないフェライトの枚数は複数枚であって
も差し支えない。
【００１０】バリスタシート４ａ〜４ｅが積層されて形
成された積層チップコンデンサ４のバリスタシート４ａ
の表面には、対向第１電極１１ａ及びこれに接続して図
３上の右端に引出し電極１２が形成されている。対向第
１電極１１ａに対向して対向第２電極１１ｂが形成され
たバリスタシート４ｂの表面には，対向第２電極１１ｂ
から引出し電極１３が前記引出し電極６ａと離れた２箇
所の辺の端縁に延びて形成されている。積層チップコン
デンサ４は、バリスタシートを積層して形成するので小
型になるとともに、対向第１電極１１ａ及び対向第２電
極１１ｂの対向面積を変えることにより容量を変更でき
るので、周波数特性を所望のものに選択することが可能
である。
成された積層チップコンデンサ４のバリスタシート４ａ
の表面には、対向第１電極１１ａ及びこれに接続して図
３上の右端に引出し電極１２が形成されている。対向第
１電極１１ａに対向して対向第２電極１１ｂが形成され
たバリスタシート４ｂの表面には，対向第２電極１１ｂ
から引出し電極１３が前記引出し電極６ａと離れた２箇
所の辺の端縁に延びて形成されている。積層チップコン
デンサ４は、バリスタシートを積層して形成するので小
型になるとともに、対向第１電極１１ａ及び対向第２電
極１１ｂの対向面積を変えることにより容量を変更でき
るので、周波数特性を所望のものに選択することが可能
である。
【００１１】バリスタシート２ａ〜２ｆ及び４ａ〜４ｅ
は非直線性抵抗のセラミックスである酸化亜鉛（ＺｎＯ
）系、酸化錫（ＳｎＯ２ ）系、チタン酸ストロンチウ
ム（ＳｒＴｉＯ３ ）系，チタン酸バリウム（ＢａＴｉ
Ｏ３ ）系等の各種のバリスタセラミクス材料から成形
される。フェライトシート３ａ〜３ｄはＭｎ−Ｚｎ系フ
ェライト、Ｎｉ−Ｚｎ系フェライト等の磁性体の粉末か
ら成形される。シートの成形は、特に制限されず、粉末
プレス法、押出法、流し込み法、シート法等により行わ
れる。また、帯状導体線路及び電極の形成は、特に制限
されず、シートの表面に塗布、印刷、メッキ、スパッタ
リング等により行われる。
は非直線性抵抗のセラミックスである酸化亜鉛（ＺｎＯ
）系、酸化錫（ＳｎＯ２ ）系、チタン酸ストロンチウ
ム（ＳｒＴｉＯ３ ）系，チタン酸バリウム（ＢａＴｉ
Ｏ３ ）系等の各種のバリスタセラミクス材料から成形
される。フェライトシート３ａ〜３ｄはＭｎ−Ｚｎ系フ
ェライト、Ｎｉ−Ｚｎ系フェライト等の磁性体の粉末か
ら成形される。シートの成形は、特に制限されず、粉末
プレス法、押出法、流し込み法、シート法等により行わ
れる。また、帯状導体線路及び電極の形成は、特に制限
されず、シートの表面に塗布、印刷、メッキ、スパッタ
リング等により行われる。
【００１２】積層チップコンデンサ２，４の２素子と積
層チップインダクタ３の１素子とを積層して直方体のブ
ロックとし、外部電極１４ａ，１４ｂ及び１５が図１に
示すようにして形成される。すると図２に示す等価回路
の積層チップπ型フィルタが得られる。
層チップインダクタ３の１素子とを積層して直方体のブ
ロックとし、外部電極１４ａ，１４ｂ及び１５が図１に
示すようにして形成される。すると図２に示す等価回路
の積層チップπ型フィルタが得られる。
【００１３】図４は、積層チップπ型フィルタの他の実
施例の一部の構成を示す分解斜視図である。積層チップ
コンデンサは、対向電極のないバリスタシート２２ａ〜
２２ｃ及び対向第１電極２５ａの形成されたバリスタシ
ート２２ｄ、対向第２電極２５ｂの形成されたバリスタ
シート２２ｅと、さらに対向第３電極２５ｃの形成され
たバリスタシート２２ｆが順次積層されて形成されてい
る。この積層チップコンデンサに隣接して電極も導体線
路も形成されていないフェライトシート２３ａが積層さ
れ、次いで順次帯状導体線路２８ａ，２８ｂが形成され
たフェライトシート２３ｂ，２３ｃ及び電極等のないフ
ェライトシート２３ｄ〜２３ｆが順次積層されて一体化
されて積層チップインダクタが形成されている。積層チ
ップインダクタの積層チップコンデンサに対向する面に
は電極がないフェライトシート２３ａが介在している。
施例の一部の構成を示す分解斜視図である。積層チップ
コンデンサは、対向電極のないバリスタシート２２ａ〜
２２ｃ及び対向第１電極２５ａの形成されたバリスタシ
ート２２ｄ、対向第２電極２５ｂの形成されたバリスタ
シート２２ｅと、さらに対向第３電極２５ｃの形成され
たバリスタシート２２ｆが順次積層されて形成されてい
る。この積層チップコンデンサに隣接して電極も導体線
路も形成されていないフェライトシート２３ａが積層さ
れ、次いで順次帯状導体線路２８ａ，２８ｂが形成され
たフェライトシート２３ｂ，２３ｃ及び電極等のないフ
ェライトシート２３ｄ〜２３ｆが順次積層されて一体化
されて積層チップインダクタが形成されている。積層チ
ップインダクタの積層チップコンデンサに対向する面に
は電極がないフェライトシート２３ａが介在している。
【００１４】対向第１電極２５ａに接続して引出し電極
２６ａが一辺に沿って形成され、バリスタシート２２ｅ
の対向第２電極２５ｂから引出し電極２７が２か所引出
し電極２６ａと離れた位置の辺の端縁に延びて形成され
ている。バリスタシート２２ｆの対向第３電極２５ｃに
接続して引出し電極２６ｂが引出し電極２６ａと反対側
に位置する辺に沿って形成されている。そして、バリス
タシート２２ａ〜２２ｆが積層され、対向第１電極２５
ａと対向第２電極２５ｂ間、及び対向第２電極２５ｂと
対向第３電極２５ｃ間でそれぞれコンデンサが形成され
て２素子からなる積層チップコンデンサとなる。帯状導
体線路２８ａはフェライトシート２３ｂの表面に概略コ
の字状にシート２３ｂの３辺に沿って屈曲されて形成さ
れ、その一方の端は図４上で左側の端部に沿って形成さ
れた引出し電極２９ａに接続されている。帯状導体線路
２８ｂはフェライトシート２３ｃに形成され、一方の端
はスルーホール２０を介して帯状導体線路２８ａに接続
され、他方の端は引出し電極２９ｂに接続されている。 １素子からなる積層チップインダクタ２３は、フェライ
トシート２３ａ〜２３ｆが積層されて形成されている。
２６ａが一辺に沿って形成され、バリスタシート２２ｅ
の対向第２電極２５ｂから引出し電極２７が２か所引出
し電極２６ａと離れた位置の辺の端縁に延びて形成され
ている。バリスタシート２２ｆの対向第３電極２５ｃに
接続して引出し電極２６ｂが引出し電極２６ａと反対側
に位置する辺に沿って形成されている。そして、バリス
タシート２２ａ〜２２ｆが積層され、対向第１電極２５
ａと対向第２電極２５ｂ間、及び対向第２電極２５ｂと
対向第３電極２５ｃ間でそれぞれコンデンサが形成され
て２素子からなる積層チップコンデンサとなる。帯状導
体線路２８ａはフェライトシート２３ｂの表面に概略コ
の字状にシート２３ｂの３辺に沿って屈曲されて形成さ
れ、その一方の端は図４上で左側の端部に沿って形成さ
れた引出し電極２９ａに接続されている。帯状導体線路
２８ｂはフェライトシート２３ｃに形成され、一方の端
はスルーホール２０を介して帯状導体線路２８ａに接続
され、他方の端は引出し電極２９ｂに接続されている。 １素子からなる積層チップインダクタ２３は、フェライ
トシート２３ａ〜２３ｆが積層されて形成されている。
【００１５】図５は、外部電極の他の実施例を示す斜視
図であり、図３の引出し電極７，１３に接続して帯状の
外部電極１５ａが、直方体のブロックの周囲に帯状に巻
かれて形成されている。
図であり、図３の引出し電極７，１３に接続して帯状の
外部電極１５ａが、直方体のブロックの周囲に帯状に巻
かれて形成されている。
【００１６】上記のように本発明に係る積層チップπ型
フィルタは、インダクタンスは帯状導体線路のターン数
やシートの材質により変更でき、容量は、バリスタシー
トの材質、厚み、対向電極の面積を変更することにより
、所望の値の容量を容易に選択できることから周波数特
性が良好なものに選択できるとともに小型になる。また
、積層チップインダクタ素子と積層チップコンデンサ素
子との対向する面には電極がないシートが介在し、層の
密着性をよくして磁束のもれを減らし、インダクタンス
を大きくして小型化している。積層チップπ型フィルタ
として小型にでき、寄生インダクタンスや浮遊容量によ
る影響が少なくなり、減衰特性のバラツキが少ない周波
数特性のよい信頼性の高い高性能なＥＭＩ除去フィルタ
が得られる。また、サージ電圧が発生した場合は、バリ
スタ層を通して導通するので、高電圧によりＩＣ，ＬＳ
Ｉ等が損傷するおそれがなくなる。なお、上記実施例に
おいて、インダクタの積層チップコンデンサに対向する
面に帯状導体線路が形成されていないフェライト層を介
在させる例について説明したが、これはバリスタ層であ
ってもよいし、両者を介在させたものであってもよい。 その他、本発明は上記実施例に限定されず要旨を逸脱し
ない範囲において種々の変更、修正実施が可能である。
フィルタは、インダクタンスは帯状導体線路のターン数
やシートの材質により変更でき、容量は、バリスタシー
トの材質、厚み、対向電極の面積を変更することにより
、所望の値の容量を容易に選択できることから周波数特
性が良好なものに選択できるとともに小型になる。また
、積層チップインダクタ素子と積層チップコンデンサ素
子との対向する面には電極がないシートが介在し、層の
密着性をよくして磁束のもれを減らし、インダクタンス
を大きくして小型化している。積層チップπ型フィルタ
として小型にでき、寄生インダクタンスや浮遊容量によ
る影響が少なくなり、減衰特性のバラツキが少ない周波
数特性のよい信頼性の高い高性能なＥＭＩ除去フィルタ
が得られる。また、サージ電圧が発生した場合は、バリ
スタ層を通して導通するので、高電圧によりＩＣ，ＬＳ
Ｉ等が損傷するおそれがなくなる。なお、上記実施例に
おいて、インダクタの積層チップコンデンサに対向する
面に帯状導体線路が形成されていないフェライト層を介
在させる例について説明したが、これはバリスタ層であ
ってもよいし、両者を介在させたものであってもよい。 その他、本発明は上記実施例に限定されず要旨を逸脱し
ない範囲において種々の変更、修正実施が可能である。
【００１７】
【発明の効果】上記のように、本発明に係る積層チップ
π型フィルタは所望の特性のものを比較的容易に選択で
きるとともに小型にできる。また、減衰特性のバラツキ
が少ない周波数特性のよい信頼性の高いフィルタであっ
て、サージ電圧が発生した場合は、コンデンサのバリス
タ機能により吸収し、高電圧によりＩＣ，ＬＳＩ等が損
傷するのを防ぐことができる。
π型フィルタは所望の特性のものを比較的容易に選択で
きるとともに小型にできる。また、減衰特性のバラツキ
が少ない周波数特性のよい信頼性の高いフィルタであっ
て、サージ電圧が発生した場合は、コンデンサのバリス
タ機能により吸収し、高電圧によりＩＣ，ＬＳＩ等が損
傷するのを防ぐことができる。
【００１８】
【図１】本発明に係る積層チップπ型フィルタの斜視図
である。
である。
【図２】その等価回路図である。
【図３】その一部の構成を示す分解斜視図である。
【図４】本発明の他の実施例の一部の構成を示す分解斜
視図である。
視図である。
【図５】本発明による外部電極の他の実施例の斜視図で
ある。
ある。
１ 積層チップπ型フィルタ。
２，４ 積層チップコンデンサ。
３ 積層チップインダクタ。
２ａ〜２ｆ，４ａ〜４ｅ，２２ａ〜２２ｆ バリスタ
シート。 ３ａ〜３ｄ ２３ａ〜２３ｆ フェライトシート。 ５ａ，５ｂ，１１ａ，１１ｂ，２５ａ，２５ｂ，２５ｃ
対向電極
シート。 ３ａ〜３ｄ ２３ａ〜２３ｆ フェライトシート。 ５ａ，５ｂ，１１ａ，１１ｂ，２５ａ，２５ｂ，２５ｃ
対向電極
Claims (2)
- 【請求項１】 対向電極を有するバリスタシートが積
層されてなる積層チップコンデンサ２素子と、帯状導体
線路が形成されたフェライトシートが積層されてなる積
層チップインダクタ１素子とからなり、このインダクタ
の前記積層チップコンデンサに対向する面には帯状導体
線路が形成されていないフェライトシートから形成され
たフェライト層が介在して前記積層チップコンデンサと
積層チップインダクタとは積層されて一体化されている
ことを特徴とする積層チップπ型フィルタ。 - 【請求項２】 前記積層チップインダクタの前記積層
チップコンデンサに対向する面には対向電極を有しない
バリスタシートが介在していることを特徴とする請求項
１の積層チップπ型フィルタ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6088991A JPH04257111A (ja) | 1991-02-09 | 1991-02-09 | 積層チップπ型フィルタ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6088991A JPH04257111A (ja) | 1991-02-09 | 1991-02-09 | 積層チップπ型フィルタ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04257111A true JPH04257111A (ja) | 1992-09-11 |
Family
ID=13155378
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6088991A Pending JPH04257111A (ja) | 1991-02-09 | 1991-02-09 | 積層チップπ型フィルタ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04257111A (ja) |
Cited By (15)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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| US8692725B2 (en) | 2007-12-20 | 2014-04-08 | Harada Industry Co., Ltd. | Patch antenna device |
| US8941544B2 (en) | 2008-07-08 | 2015-01-27 | Harada Industry Co., Ltd. | Vehicle roof mount antenna |
| US8994475B2 (en) | 2008-05-27 | 2015-03-31 | Harada Industry Co., Ltd. | Vehicle-mounted noise filter |
| USD726696S1 (en) | 2012-09-12 | 2015-04-14 | Harada Industry Co., Ltd. | Vehicle antenna |
| US9153864B2 (en) | 2011-02-15 | 2015-10-06 | Harada Industry Co., Ltd. | Vehicle pole antenna |
| US9225055B2 (en) | 2011-03-24 | 2015-12-29 | Harada Industry Co., Ltd. | Antenna device |
-
1991
- 1991-02-09 JP JP6088991A patent/JPH04257111A/ja active Pending
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| US8994475B2 (en) | 2008-05-27 | 2015-03-31 | Harada Industry Co., Ltd. | Vehicle-mounted noise filter |
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| US9287610B2 (en) | 2011-03-24 | 2016-03-15 | Harada Industry Co., Ltd. | Antenna device |
| US9680201B2 (en) | 2011-03-24 | 2017-06-13 | Harada Industry Co., Ltd. | Antenna device |
| US9825351B2 (en) | 2011-03-24 | 2017-11-21 | Harada Industry Co., Ltd. | Antenna device |
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