[go: up one dir, main page]

JP5379065B2 - プローブカード及びその製造方法 - Google Patents

プローブカード及びその製造方法 Download PDF

Info

Publication number
JP5379065B2
JP5379065B2 JP2010098013A JP2010098013A JP5379065B2 JP 5379065 B2 JP5379065 B2 JP 5379065B2 JP 2010098013 A JP2010098013 A JP 2010098013A JP 2010098013 A JP2010098013 A JP 2010098013A JP 5379065 B2 JP5379065 B2 JP 5379065B2
Authority
JP
Japan
Prior art keywords
substrate
probe card
electrode
elastic body
contact
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Active
Application number
JP2010098013A
Other languages
English (en)
Other versions
JP2011226963A (ja
Inventor
晶紀 白石
秀明 坂口
光敏 東
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Shinko Electric Industries Co Ltd
Original Assignee
Shinko Electric Industries Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Shinko Electric Industries Co Ltd filed Critical Shinko Electric Industries Co Ltd
Priority to JP2010098013A priority Critical patent/JP5379065B2/ja
Priority to US13/089,522 priority patent/US20110260744A1/en
Publication of JP2011226963A publication Critical patent/JP2011226963A/ja
Priority to US14/067,685 priority patent/US8922234B2/en
Application granted granted Critical
Publication of JP5379065B2 publication Critical patent/JP5379065B2/ja
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • GPHYSICS
    • G01MEASURING; TESTING
    • G01RMEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
    • G01R1/00Details of instruments or arrangements of the types included in groups G01R5/00 - G01R13/00 and G01R31/00
    • G01R1/02General constructional details
    • G01R1/06Measuring leads; Measuring probes
    • G01R1/067Measuring probes
    • G01R1/073Multiple probes
    • G01R1/07307Multiple probes with individual probe elements, e.g. needles, cantilever beams or bump contacts, fixed in relation to each other, e.g. bed of nails fixture or probe card
    • GPHYSICS
    • G01MEASURING; TESTING
    • G01RMEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
    • G01R1/00Details of instruments or arrangements of the types included in groups G01R5/00 - G01R13/00 and G01R31/00
    • G01R1/02General constructional details
    • G01R1/06Measuring leads; Measuring probes
    • G01R1/067Measuring probes
    • G01R1/073Multiple probes
    • G01R1/07307Multiple probes with individual probe elements, e.g. needles, cantilever beams or bump contacts, fixed in relation to each other, e.g. bed of nails fixture or probe card
    • G01R1/07314Multiple probes with individual probe elements, e.g. needles, cantilever beams or bump contacts, fixed in relation to each other, e.g. bed of nails fixture or probe card the body of the probe being perpendicular to test object, e.g. bed of nails or probe with bump contacts on a rigid support
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/40Forming printed elements for providing electric connections to or between printed circuits
    • H05K3/4007Surface contacts, e.g. bumps
    • GPHYSICS
    • G01MEASURING; TESTING
    • G01RMEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
    • G01R1/00Details of instruments or arrangements of the types included in groups G01R5/00 - G01R13/00 and G01R31/00
    • G01R1/02General constructional details
    • G01R1/06Measuring leads; Measuring probes
    • G01R1/067Measuring probes
    • G01R1/073Multiple probes
    • G01R1/07307Multiple probes with individual probe elements, e.g. needles, cantilever beams or bump contacts, fixed in relation to each other, e.g. bed of nails fixture or probe card
    • G01R1/0735Multiple probes with individual probe elements, e.g. needles, cantilever beams or bump contacts, fixed in relation to each other, e.g. bed of nails fixture or probe card arranged on a flexible frame or film
    • GPHYSICS
    • G01MEASURING; TESTING
    • G01RMEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
    • G01R1/00Details of instruments or arrangements of the types included in groups G01R5/00 - G01R13/00 and G01R31/00
    • G01R1/02General constructional details
    • G01R1/06Measuring leads; Measuring probes
    • G01R1/067Measuring probes
    • G01R1/073Multiple probes
    • G01R1/07307Multiple probes with individual probe elements, e.g. needles, cantilever beams or bump contacts, fixed in relation to each other, e.g. bed of nails fixture or probe card
    • G01R1/07364Multiple probes with individual probe elements, e.g. needles, cantilever beams or bump contacts, fixed in relation to each other, e.g. bed of nails fixture or probe card with provisions for altering position, number or connection of probe tips; Adapting to differences in pitch
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2201/00Indexing scheme relating to printed circuits covered by H05K1/00
    • H05K2201/03Conductive materials
    • H05K2201/0302Properties and characteristics in general
    • H05K2201/0314Elastomeric connector or conductor, e.g. rubber with metallic filler
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2201/00Indexing scheme relating to printed circuits covered by H05K1/00
    • H05K2201/03Conductive materials
    • H05K2201/0332Structure of the conductor
    • H05K2201/0364Conductor shape
    • H05K2201/0367Metallic bump or raised conductor not used as solder bump
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2201/00Indexing scheme relating to printed circuits covered by H05K1/00
    • H05K2201/10Details of components or other objects attached to or integrated in a printed circuit board
    • H05K2201/10227Other objects, e.g. metallic pieces
    • H05K2201/10378Interposers
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2203/00Indexing scheme relating to apparatus or processes for manufacturing printed circuits covered by H05K3/00
    • H05K2203/15Position of the PCB during processing
    • H05K2203/1572Processing both sides of a PCB by the same process; Providing a similar arrangement of components on both sides; Making interlayer connections from two sides
    • YGENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y10TECHNICAL SUBJECTS COVERED BY FORMER USPC
    • Y10TTECHNICAL SUBJECTS COVERED BY FORMER US CLASSIFICATION
    • Y10T29/00Metal working
    • Y10T29/49Method of mechanical manufacture
    • Y10T29/49002Electrical device making
    • Y10T29/49117Conductor or circuit manufacturing
    • Y10T29/49124On flat or curved insulated base, e.g., printed circuit, etc.
    • Y10T29/49155Manufacturing circuit on or in base

Landscapes

  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Manufacturing & Machinery (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Measuring Leads Or Probes (AREA)
  • Testing Or Measuring Of Semiconductors Or The Like (AREA)

Description

本発明は、プローブカード及びその製造方法に関する。
従来、半導体装置の製造工程は、半導体チップの電気的特性を検査する検査工程を含む。この工程に用いられる半導体検査装置は、ウェハ状態の半導体チップに形成された電極パッドと電気的に接続されるプローブ針を有している。半導体検査装置は、例えば、プローブ針を介して半導体チップに形成された回路に電気信号を供給するとともに、同回路から出力される信号をプローブ針を介して受け取り、この受け取った信号に基づいて回路の動作を検査することにより、半導体チップの良否を判定する。
近年、半導体チップにおいては、素子の高集積化および処理信号数の増加によって、半導体チップに形成される電極パッドの数が増加(多ピン化)するとともに、電極パッドの狭ピッチ化が進んでいる。従って、個々の電極パッドにプローブ針を精度良く接触させることが難しくなっている。このため、基板に接続のための端子を複数形成し、複数の電極パッドに対する接続を一括して行うことが各種提案されている。
例えば、特許文献1に開示されたコンタクトプローブは、プローブ本体と一体形成されたコンタクト用突起を有している。プローブ本体とコンタクト用突起は、異方性導電樹脂による樹脂成形によって形成されている。
特開2001−52779号公報
ところで、半導体チップは、その表面にパシベーション膜が形成されている。そして、電極パッドは、パシベーション膜に形成された開口部から露出している。一方、上記特許文献1に開示されたコンタクト用突起は、樹脂成形により、四角錐や半球型に形成されている。このため、パシベーション膜から露出している電極パッドの大きさ(開口部の寸法)とパシベーション膜の膜厚との比(アスペクト比)によっては、コンタクト用突起を電極パッドに接触させることができないおそれがある。
本発明は上記問題点を解決するためになされたものであって、その目的は、半導体チップに形成された複数の電極パッドに確実に接触させることが可能なプローブカード及びその製造方法を提供することにある。
本発明の一観点によれば、検査対象物の電気的検査を行う際に、前記検査対象物に形成された電極パッドと電気的に接続されるプローブカードは、前記検査対象物と対向配置される第1の面と、前記第1の面と反対側の面を有する基板本体と、前記基板本体の第1の面と第2の面との間を貫通する貫通電極と、前記基板本体の前記第1の面から前記第2の面に向かって形成された収容部に充填された弾性体と、前記弾性体に配置され、前記基板本体の前記第1の面から前記第2の面に向かって延びる支持体と、前記電極パッドと対応して形成され、前記支持体の端部に接続され、前記貫通電極と電気的に接続された接触用バンプと、を有る。この構成によれば、弾性体に設けられた支持体の端部に接続された接触用バンプ、検査対象物の電極パッドに接触させることができる。
検査対象物の電気的検査を行う際に、前記検査対象物に形成された電極パッドと電気的に接続されるプローブカードは、基板に、底部から開口方向に向かって延びる柱部を有する第1の深穴と、第2の深穴を形成する工程と、前記第1の深穴に弾性体を充填する工程と、前記基板を薄化して基板本体を形成し、前記第1及び第2の深穴をそれぞれ第1及び第2の貫通孔とし、前記柱部を前記基板から離間させて支持体とする工程と、前記第2の貫通孔に貫通電極を形成する工程と、前記電極パッドと対応し、前記支持体に接続された接触用バンプを形成する工程と、を含む方法により製造される。この方法によれば、弾性体設けられた支持体に接続された接触用バンプを有するプローブカードが容易に製造される。
また、検査対象物の電気的検査を行う際に、前記検査対象物に形成された電極パッドと電気的に接続されるプローブカードは、基板に第1の深穴を形成する工程と、前記第1の深穴に弾性体を充填する工程と、前記基板を薄化して基板本体を形成し、前記第1の深穴を第1の貫通孔とする工程と、前記弾性体に第2の貫通孔を形成する工程と、前記第2の貫通孔に貫通電極を形成する工程と、前記貫通電極に接続された接触用バンプを形成する工程と、を含む方法により製造される。この方法によれば、弾性体により支持された貫通電極に接続された接触用バンプを有するプローブカードが容易に製造される。
本発明の一観点によれば、半導体チップに形成された複数の電極パッドに確実に接触させることが可能なプローブカード及びその製造方法を提供することができる。
第一実施形態の基板検査装置の概略構成図。 プローブカードの下面図。 (a)〜(c)はプローブカードの製造工程を示す模式図。 (a)〜(f)はプローブカードの製造工程を示す模式図。 第二実施形態のプローブカードの断面図。 (a)〜(d)はプローブカードの製造工程を示す模式図。 (a)〜(e)はプローブカードの製造工程を示す模式図。 第三実施形態のプローブカードの断面図。 (a)〜(e)はプローブカードの製造工程を示す模式図。 (a)〜(e)はプローブカードの製造工程を示す模式図。 (a)(b)は別のプローブカードの下面図。 (a)(b)は別のプローブカードの断面図。 (a)(b)は別のプローブカードの製造工程を示す模式図。 別のプローブカードの一部下面図。
以下、添付図面を参照して各実施形態を説明する。尚、添付図面は、構造の概略を説明するためのものであり、実際の大きさを表していない。
(第一実施形態)
以下、第一実施形態を図1〜図4に従って説明する。
図1に示すように、検査対象物10を検査する半導体検査装置20は、テスタ21と、そのテスタ21に接続されたプローブ装置22とを有している。
検査対象物10は、例えば複数個の半導体チップが形成された1枚の半導体ウェーハであって、個々の半導体チップに切断される前の状態(ウェーハ状態)のものである。検査対象物10は、半導体チップの素子に接続される複数の電極パッド11を有している。また、検査対象物10には、パシベーション膜12が形成され、電極パッド11はパシベーション膜12に形成された開口部12aから露出している。
プローブ装置22は、配線基板30とプローブカード40を含む。配線基板30の下面30aには複数の接続用バンプ30bが形成されている。接続用バンプ30bの材料は、例えば金スズ半田である。また、配線基板30は、接続用バンプ30bをテスタ21と接続するための配線(図示略)が形成されている。図1では、配線基板30とプローブカード40とを離間させて示しているが、プローブカード40は配線基板30の接続用バンプ30bと接続されている。
プローブカード40は、基板本体41を有している。基板本体41は、検査対象物10の基板と同じ材料(ここではシリコン)により形成されている。尚、基板本体41の材料として、セラミック、ガラス、樹脂(例えば、絶縁樹脂)、金属(例えば、Cu)等を用いることができる。
プローブカード40には、基板本体41の上面と下面との間を貫通する複数の貫通電極42が設けられている。貫通電極42は、基板本体41の上面と下面との間を貫通する貫通孔41a内に固定されている。図2は、1つの半導体チップに対応するプローブカード40の部分を示している。複数(図2において10個)の貫通電極42は、互いに離間して配置されている。貫通電極42は、例えば銅(Cu)である。図1に示すように、貫通電極42は、絶縁膜43(例えばシリコン酸化膜)により基板本体41と絶縁されている。尚、図1には、プローブカード40の断面が示されているが、基板本体41や貫通電極42等を判りやすくするために、絶縁膜43のハッチングを省略している。貫通電極42は、配線基板30の接続用バンプ30bと対応する位置に形成されている。そして、貫通電極42の上端は、配線基板30の接続用バンプ30bと接続される。
また、プローブカード40には、基板本体41の上面と下面との間を貫通する複数の弾性体44が設けられている。弾性体44は、基板本体41の上面と下面との間を貫通する貫通孔41b内に固定されている。弾性体44は、弾性を有する樹脂、例えばシリコーン樹脂である。本実施形態では、図2に示すように、1つの半導体チップに対して2つの弾性体44が設けられ、各弾性体44は、所定の方向に沿って延びるように形成されている。尚、弾性体44が延びる方向は、検査対象物10の電極パッド11の配列方向に対応している。
基板本体41の下面には複数の配線45が形成されている。配線45は、銅、ニッケル(Ni)、ニッケル合金、等よりなる。図2に示すように、配線45の第1端部は、それぞれ貫通電極42の下面と接続されている。配線45の第2端部は、弾性体44の下面に、その弾性体44が延びる方向に沿って配列されている。
図1に示すように、配線45の第2端部下面には、それぞれ接触用バンプ46が形成されている。従って、図2に示すように、1つの弾性体44に対して複数の接触用バンプ46が形成されている。言い換えれば、複数の接触用バンプ46に対して、1つの貫通孔41bと、その貫通孔41b内に配置された1つの弾性体44が形成されている。
接触用バンプ46は、ニッケル、銅、ニッケル合金、等である。接触用バンプ46は、検査対象物10の電極パッド11と対応する位置に形成されている。接触用バンプ46は、例えば、配線45の第2端部下面から下方に延びる円柱状に形成されている。
そして、接触用バンプ46の形状は、電極パッド11の露出している部分、パシベーション膜12の膜厚に応じて形成されている。例えば、電極パッド11上のパシベーション膜12の膜厚を10μmとすると、接触用バンプ46は直径が15μm、上下方向の長さが20μmに設定されている。
図2に示すように、上記の弾性体44は、接触用バンプ46の配列方向に沿って延びる略長方形状(角部にRが付けられている)に形成されている。そして、配線45は、弾性体44の一方の長辺(第1の長辺)側から他方の長辺(第2の長辺)側に向かう方向、つまり貫通孔41b及び弾性体44の短辺方向に沿って延びるように形成されている。そして、接触用バンプ46は、配線45が交差してない弾性体44の長辺、すなわち弾性体44の第1の長辺に近接して配置されている。これは、弾性体44上の配線45の長さを長くすることにより、後述する接触用バンプ46の移動による弾性体44の伸縮を配線45が吸収し易くする。よって、弾性体44の伸縮により配線45に加わる応力が緩和され、配線45の断線を防止する。なお、応力の緩和を必要としない場合には、弾性体44の形状、又は接触用バンプ46の配置位置を適宜変更してもよい。
上記のように構成されたプローブ装置22は、図示しない検査台上に固定された検査対象物10と平行に支持される。そして、プローブ装置22は、プローブカード40の接触用バンプ46が検査対象物10の電極パッド11に対向するように相互に位置決めされ、接触用バンプ46が電極パッド11と接触される。
図1の左下に拡大して示すように、接触用バンプ46は、検査対象物10の形状、詳しくは電極パッド11を露出させるパシベーション膜12の開口形状、膜厚に応じて形成されている。従って、パシベーション膜12が厚くなれば、それに応じて接触用バンプ46の上下方向の長さ、つまりアスペクト比が変更可能である。従って、接触用バンプ46を確実に電極パッド11に接触させることができる。また、パシベーション膜12の形状に応じて接触用バンプ46の形状を設定することができるため、検査対象物10の形状変更に容易に対応することができる。
接触用バンプ46が電極パッド11に接触されると、その接触用バンプ46の直上には、弾性体44が配置されている。弾性体44は、弾性を有しているため、接触用バンプ46は、上下方向に変位可能である。従って、複数の接触用バンプ46の長さがばらついても、弾性体44が形成された貫通孔41b内に接触用バンプ46入り込むことで、接触用バンプ46の長さのばらつきが弾性体44によって吸収され、各接触用バンプ46をそれぞれ電極パッド11に接触させることができる。
また、プローブ装置22と検査対象物10とが相対的に傾いても、同様に各接触用バンプ46をそれぞれ電極パッド11に接触させることができる。つまり、プローブ装置22が傾いて支持されると、その傾きに応じて、先に電極パッド11と接触する接触用バンプ46が弾性体44が形成された貫通孔41b内に入り込むことで、他の接触用バンプ46を電極パッド11に接触させることができるようになる。
また、例えばプローブ装置22を押し下げることにより検査対象物10とプローブ装置22とを相対的に接近させると、弾性体44の弾性力によって接触用バンプ46が電極パッド11に向かって押圧されるため、接触用バンプ46と電極パッド11とを確実に電気的に接続することができる。
なお、弾性体44は、基板本体41を貫通して形成されている。つまり、弾性体44は、基板本体41の上面に露出している。従って、接触用バンプ46が貫通孔41b内に進入すると、弾性体44が貫通孔41aから上方に向かって膨出する。この膨出により、接触用バンプ46と電極パッド11との間にかかる圧力(押圧力)を緩和することができる。
上記のように、検査対象物10に形成された複数の半導体チップの電極パッド11に接触用バンプ46をそれぞれ接触させて電気的に接続することができる。このため、複数の半導体チップに対する検査を並行して実施することができるため、個々の半導体チップを順次検査する場合と比べて、検査対象物10に係る検査時間を短縮することができる。
また、基板本体41の材料として検査対象物10と同じ材料(シリコン)を用いることにより、プローブカード40と検査対象物10との間の熱膨張係数の差が緩和されるため、半導体チップに設けられた電極パッド11に接触用バンプ46を精度良く接触させることができる。また、検査により検査対象物10の温度を変更する場合には、その温度に応じて基板本体41が伸縮するため、接触用バンプ46と電極パッド11との相対的な位置ずれを抑えることができる。
次に、上記のプローブカード40の製造工程を説明する。なお、基板本体41の材料をシリコンとした場合の製造工程について説明する。
先ず、図3(a)に示すように、シリコンウェハである基板51を用意する。基板51の厚みは、例えば725μm〜775μmである。
次に、図3(b)に示すように、開口部が設けられたマスク(図示略)を用い、この開口部を通して基板51を高アスペクト比エッチング(例えば、深堀RIE:Deep Reactive Ion Etching)にてエッチングを行い、基板51に、図1に示す貫通電極42に対応する深穴51aと、弾性体44に対応する深穴51bとを形成する。
次に、図3(c)に示すように、基板51を熱酸化することにより、基板51の全面及び深穴51a,51bの内面にシリコン酸化膜である絶縁膜52を形成する。
次に、図4(a)に示すように、例えば真空印刷により、深穴51bに弾性樹脂53を充填する。
次に、バックグラインドによって基板51を下面から研削することにより、深穴51a,51bを貫通孔とするように基板51を薄化する。この基板51は、薄化により形成された貫通孔41a,41bを有している。薄化された基板51の厚みは、例えば200μmである。つまり、図3(b)に示す工程によって形成される深穴51a,51bは、薄化された基板51の厚みよりも深く形成される。
次に、図4(c)に示すように、例えば低温CVDにより、基板41の下面(研削面)にシリコン酸化膜からなる絶縁膜54を形成する。この絶縁膜54と上記工程により形成された絶縁膜52により、図1に示す絶縁膜43が構成される。これにより、図1に示すように、貫通孔41a,41bを有する基板本体41が形成されるとともに、貫通孔41b内に充填された弾性体44が形成される。
次に、図4(d)に示すように、メッキや導体ペースト充填等の方法により、貫通孔41a内に貫通電極42を形成する。
次に、図4(e)に示すように、開口部が設けられたマスク(図示略)を用い、この開口部を通して例えば物理気相成長(PVD:Physical Vapor Deposition)やメッキ等により、配線45を形成する。
次に、図4(f)に示すように、例えばメッキにより、配線45の第2端部に接触用バンプ46を形成する。
以上記述したように、本実施の形態によれば、以下の効果を奏する。
(1)プローブカード40には、基板本体41の上面と下面との間を貫通する弾性体44が設けられている。基板本体41には、基板本体41の下面には複数の配線45が形成されている。配線45の第2端部は、弾性体44の下面に配置されている。そして、配線45の第2端部下面には、検査対象物10の電極パッド11と対応する位置に、その電極パッド11と電気的に接続される接触用バンプ46が形成されている。接触用バンプ46は、検査対象物10の形状、詳しくは電極パッド11を露出させるパシベーション膜12の開口形状、膜厚に応じて柱状に形成されている。従って、パシベーション膜12が厚くなれば、それに応じて接触用バンプ46の上下方向の長さ(高さ)、つまりアスペクト比が変更可能である。従って、接触用バンプ46を確実に電極パッド11に接触させることができる。また、パシベーション膜12の形状に応じて接触用バンプ46の形状を設定することができるため、検査対象物10の形状変更に容易に対応することができる。
(2)接触用バンプ46の直上には、弾性体44が配置されている。弾性体44は、弾性を有しているため、接触用バンプ46は、上下方向に変位可能である。従って、複数の接触用バンプ46の長さがばらついても、弾性体44が形成された貫通孔41b内に接触用バンプ46入り込むことで、接触用バンプ46の長さのばらつきが弾性体44によって吸収され、各接触用バンプ46をそれぞれ電極パッド11に接触させることができる。
(3)プローブ装置22と検査対象物10とが相対的に傾いても、同様に各接触用バンプ46をそれぞれ電極パッド11に接触させることができる。つまり、プローブ装置22が傾いて支持されると、その傾きに応じて、先に電極パッド11と接触する接触用バンプ46が弾性体44が形成された貫通孔41b内に入り込むことで、他の接触用バンプ46を電極パッド11に接触させることができるようになる。
また、例えばプローブ装置22を押し下げることにより検査対象物10とプローブ装置22とを相対的に接近させると、弾性体44の弾性力によって接触用バンプ46が電極パッド11に向かって押圧されるため、接触用バンプ46と電極パッド11とを確実に電気的に接続することができる。
(第二実施形態)
以下、第二実施形態を図5〜図7に従って説明する。
尚、第一実施形態と同じ部材については同じ符号を付してその説明の全て又は一部を省略する。
図5に示すように、半導体検査装置20aは、テスタ21とプローブ装置22aを有している。プローブ装置22aは、配線基板31とプローブカード60を含む。配線基板31の下面31aには複数の接続用パッド31bが形成されている。接続用パッド31bは、例えば銅、ニッケル、ニッケル合金などである。また、配線基板31には、接続用パッド31bとテスタ21を接続するための配線(図示略)が形成されている。
プローブカード60は、基板本体41を有している。基板本体41は、検査対象物10の基板と同じ材料(ここではシリコン)により形成されている。尚、基板本体41の材料として、樹脂(例えば、絶縁樹脂)、金属(例えば、Cu)等を用いることができる。
プローブカード60には、基板本体41の上面と下面との間を貫通する複数の貫通電極42が設けられている。貫通電極42は、基板本体41の上面と下面との間を貫通する貫通孔41a内に固定されている。
また、プローブカード60には、基板本体41の上面と下面との間を貫通する複数の弾性体61が設けられている。弾性体61は、基板本体41の上面と下面との間を貫通する貫通孔41b内に固定されている。弾性体61は、弾性を有する樹脂、例えばシリコーン樹脂である。
更に、プローブカード60には、弾性体61の上面と下面の間を貫通する複数の支持体62が設けられている。支持体62は、弾性体61の上面と下面との間を貫通する貫通孔61a内に固定されている。支持体62は、基板本体41と同じ材料(シリコン)により形成され、表面は絶縁膜(シリコン酸化膜)により覆われている。
基板本体41の下面には、第一実施形態と同様に、複数の配線45が形成されている。基板本体41の上面には複数の配線63が形成されている。各配線63は、銅、ニッケル、ニッケル合金、等よりなる。上面に形成された配線63の第1端部は貫通電極42の上端と接続されている。配線63の第2端部上面には、配線基板31の接続用パッド31bと接続される接続用バンプ64が形成されている。この接続用バンプ64は、例えば金スズ半田である。
基板本体41の下面に形成された配線45は、その第1端部が貫通電極42の下端と接続され、第2端部が支持体62の下端に接続されている。そして、この配線45の第2端部下面には接触用バンプ46が形成されている。従って、接触用バンプ46と支持体62は一体的に移動する。
上記したように、支持体62は、弾性体61を貫通して形成されている。従って、支持体62の移動方向は、弾性体61により規制される。つまり、支持体62は、基板本体41に対して上下方向に移動する。そして、支持体62に配線45を介して接続された接触用バンプ46は、支持体62とともに、基板本体41に対して上下方向に移動する。つまり、支持体62を設けることにより、接触用バンプ46を安定して上下方向に移動させることができる。
そして、接触用バンプ46と支持体62とが一体的に移動することにより、支持体62の上端が、基板本体41の上面から突出する。このため、接続用バンプ64は、基板本体41の上面から突出する支持体62が配線基板31に接触しないように、その形状が設定されている。例えば、接続用バンプ64の高さ(上下方向の長さ)は、接触用バンプ46が移動可能な距離、つまり接触用バンプ46の長さ以上に設定される。
次に、上記のプローブカード60の製造工程を説明する。なお、第一実施形態と同様に、基板本体41の材料をシリコンとした場合の製造工程について説明する。
先ず、図6(a)に示すように、シリコンウェハである基板51を用意する。
次に、図6(b)に示すように、開口部が設けられたマスク(図示略)を用い、この開口部を通して基板51をDRIEにてエッチングを行い、基板51に、図1に示す貫通電極42に対応する深穴51aと、弾性体61に対応する深穴71とを形成する。このとき、深穴71には、支持体62を形成するために、深穴71の底部から上方に向かって延びる円柱状の柱部72が形成される。
次に、図6(c)に示すように、基板51を熱酸化することにより、基板51の全面、深穴51a,71の内面及び柱部72の側面にシリコン酸化膜である絶縁膜52を形成する。
次に、図6(d)に示すように、例えば真空印刷により、深穴71に弾性樹脂73を充填する。
次に、図7(a)に示すように、バックグラインドによって基板51を下面から研削することにより、図6(d)に示す深穴51a,71を貫通孔とするように基板51を薄化する。これにより、柱部72が基板本体51から分離される。また、深穴71に充填された弾性樹脂73により、基板51を貫通する弾性体61が形成される。
次に、図7(b)に示すように、例えば低温CVDにより、基板51の下面にシリコン酸化膜からなる絶縁膜54を形成する。これにより、図5に示す基板本体41が形成される。
次に、図7(c)に示すように、メッキや導体ペースト充填等の方法により、貫通孔41a内に貫通電極42を形成する。
次に、図7(d)に示すように、開口部が設けられたマスク(図示略)を用い、この開口部を通して例えば物理気相成長(PVD:Physical Vapor Deposition)やメッキ等により、配線45,63を形成する。
次に、図7(e)に示すように、例えばメッキにより、接続用バンプ64と接触用バンプ46とをそれぞれ形成する。
以上記述したように、本実施の形態によれば、第一実施形態の効果に加えて、以下の効果を奏する。
(4)プローブカード60には、弾性体61の上面と下面の間を貫通する複数の支持体62が設けられている。基板本体41の下面に形成された配線45は、その第1端部が貫通電極42の下端と接続され、第2端部が支持体62の下端に接続されている。そして、この配線45の第2端部下面には接触用バンプ46が形成されている。従って、接触用バンプ46と支持体62は一体的に移動する。支持体62は、基板本体41に対して上下方向に移動する。そして、支持体62に配線45を介して接続された接触用バンプ46は、支持体62とともに、基板本体41に対して上下方向に移動する。従って、支持体62を設けることにより、接触用バンプ46を安定して上下方向に移動させることができる。
(5)プローブカード60と配線基板31を接続する接続用バンプ64の高さ(上下方向の長さ)は、接触用バンプ46が移動可能な距離、つまり接触用バンプ46の長さ以上に設定される。従って、接続用バンプ64は、基板本体41の上面から突出する支持体62が配線基板31に接触しない、すなわち、接触用バンプ46及び支持体62の移動を許容することができる。
(第三実施形態)
以下、第三実施形態を図8〜図10に従って説明する。
尚、第一,第二実施形態と同じ部材については同じ符号を付してその説明の全て又は一部を省略する。
図8に示すように、半導体検査装置20bはテスタ21とプローブ装置22bを有している。プローブ装置22bは、配線基板31とプローブカード80を含む。プローブカード80は、第二実施形態のプローブカード60と同様に、弾性体61の上面と下面との間を貫通する貫通孔61a内に固定された支持体81を有している。そして、本実施形態の支持体81は、導電性を有する材料(例えば銅)により形成されている。
次に、上記のプローブカード80の製造工程を説明する。なお、第一,第二実施形態と同様に、基板本体41の材料をシリコンとした場合の製造工程について説明する。
先ず、図9(a)に示すように、シリコンウェハである基板51を用意する。
次に、図9(b)に示すように、開口部が設けられたマスク(図示略)を用い、この開口部を通して基板51をDRIEにてエッチングを行い、基板51に、図1に示す貫通電極42に対応する深穴51aと、弾性体61に対応する深穴51bとを形成する。
次に、図9(c)に示すように、基板51を熱酸化することにより、基板51の全面及び深穴51a,51bの内面にシリコン酸化膜である絶縁膜52を形成する。
次に、図9(d)に示すように、例えば真空印刷により、深穴51bに弾性樹脂53を充填する。
次に、図9(e)に示すように、バックグラインドによって基板51を下面から研削することにより、深穴51a,51bを貫通孔とするように基板51を薄化する。
次に、図10(a)に示すように、例えば低温CVDにより、基板51の下面にシリコン酸化膜からなる絶縁膜54を形成する。
次に、図10(b)に示すように、例えばレーザ加工により、弾性体61に貫通孔61aを形成する。
次に、図10(c)に示すように、メッキや導体ペースト充填等の方法により、基板本体41に形成した貫通孔41a内に貫通電極42を形成するとともに、弾性体61に形成した貫通孔61a内に支持体81を形成する。
次に、図10(d)に示すように、開口部が設けられたマスク(図示略)を用い、この開口部を通して例えば物理気相成長(PVD:Physical Vapor Deposition)やメッキ等により、配線45,63を形成する。
次に、図10(e)に示すように、例えばメッキにより、接続用バンプ64と接触用バンプ46とをそれぞれ形成する。
以上記述したように、本実施の形態によれば、第一,第二実施形態の効果に加えて、以下の効果を奏する。
(6)プローブカード80は、弾性体61の上面と下面との間を貫通する貫通孔61a内に固定された支持体81を有している。そして、本実施形態の支持体81は、導電性を有する材料(例えば銅)により形成されている。このように、支持体81を、基板本体41の材料と同一のもののみならず、様々な材料により形成することができる。
尚、上記各実施の形態は、以下の態様で実施してもよい。
・弾性体44の形状を適宜変更してもよい。例えば、図11(a)に示すように、接触用バンプ46の個々に対応して弾性体44aを形成するようにしてもよい。つまり、各接触用バンプ46毎に対応する貫通孔41c及び弾性体44aを形成する。貫通孔41c及び弾性体44aの平面形状は、図11(a)に示すように、略長方形状に形成される。そして、接触用バンプ46に接続される配線45は、弾性体44aの一方の短辺(第1の短辺)側から他方の短辺(第2の短辺)側に向かって、弾性体44aの長辺方向に沿って延びるように形成される。そして、接触用バンプ46は、配線45が形成されていない短辺、つまり第1の短辺に近接して配置される。このような構成により、第一実施形態(図2参照)と同様に、配線45が弾性体44aの伸縮を吸収し易くなる。よって、弾性体44aの伸縮による配線45に加わる応力が緩和され、配線45の断線を防止することができる。また、このように弾性体44aを形成することで、個々の弾性体44aを分離形成する必要があるものの、各接触用バンプ46が、近接する接触用バンプ46の影響を受けることない。
また、図11(b)に示すように、接触用バンプ46の個々に対応して貫通孔41d及び弾性体44bを形成しても良い。この場合、貫通孔41d及び弾性体44bの平面形状は、略矩形状又は円形状に形成される。そして、接触用バンプ46は、例えば略矩形状又は円形状に形成された弾性体44bの中心に位置するようにその弾性体44b上に配置される。
・図12(a)に示すように、基板本体41の上面と下面のうちの少なくとも一方に多層配線層91,92を形成してもよい。多層配線層91,92は、例えばビルドアップ法により配線層と絶縁層を積層して形成される。多層配線層91,92を形成することにより、貫通電極42を任意の位置に形成することが可能となる。
また、図12(b)に示すように、支持体81を導電性を有する材料(金属)により形成した場合、支持体81を貫通電極として用いることができる。言い換えれば、弾性体61の上面と下面の間を貫通する貫通電極(支持体81)を形成し、その貫通電極(支持体81)の端部に接触用バンプ46を形成する。このように構成することにより、基板本体41の下面に対する配線形成の工程を省略することができる。なお、基板本体41の上面における接続は、図12(b)に示すように、多層配線層91を用いることも、上記各実施形態と同様に単層の配線を用いることもできる。
例えば図12(a)に示すように多層配線層91,92を用いた場合、図13(a)に示すように、貫通電極42を形成した後、例えば、ビルドアップ法で配線層と絶縁層を積層して多層配線層91,92を形成する。このとき、弾性体61を充填した貫通孔41bの上方及び下方は、接触用バンプ46の形成及び接触用バンプ46の上下方向の動きを妨げないよう、多層配線層の不形成部分93とする。そして、図13(b)に示すように、接触用バンプ46を形成する。
・図14に示すように、配線45に、弾性体44aの伸縮を吸収するための曲折部45aを設けても良い。
・絶縁膜として、シリコン酸化膜(SiO)以外に、シリコン窒化膜(SiN)などを形成するようにしてもよい。また、複数種類の絶縁膜、例えばシリコン酸化膜とシリコン窒化膜とを積層するようにしてもよい。
・上記実施形態における製造工程を適宜変更してもよい。例えば、図4(d)に示す貫通電極42を形成する工程を、絶縁膜54を形成する工程(図4(c))、又は薄化する工程(図4(b))の前に実施するようにしてもよい。
・第一実施形態において、弾性体44を基板本体41を貫通しないように形成する、つまり接触用バンプ46から上方に向かって基板本体41に形成した凹部(収容部)としてもよい。例えば、製造工程において、弾性体44を形成する深穴51b(図3(b)参照)の深さを、薄化した基板本体41の厚みよりも浅くする。このようにしても、接触用バンプ46の直上に弾性体44が配置され、その弾性体44により接触用バンプ46の上下方向の移動が許容される。
・上記実施形態は、ウェハ状態の半導体チップを検査するために用いられるプローブカード40,60,80に具体化したが、個辺化された半導体チップを検査するために用いられるプローブカードに具体化してもよい。
・検査対象物として上記の半導体ウェーハ以外に、複数の端子を有するもの、例えば半導体パッケージとしてもよい。
・接触用バンプ46の表面に金層を設けてもよい。金層は、例えばめっきにより形成される。金層を設けることにより、接触用バンプ46と電極パッド11との接触抵抗を低減することができる。
・接触用バンプ46の形状を適宜変更してもよい。例えば、検査対象物10の形状に応じて、アスペクト比が低い場合に、例えば半球状や略球状としてもよい。
・上記第二、第三実施形態において、第一実施形態と同様に、接続用バンプ64を配線基板31側に設けるようにしてもよい。
10 検査対象物
11 電極パッド
30,31 配線基板
40,60,80 プローブカード
41 基板本体
41b 貫通孔(収容部)
42 貫通電極
44,61 弾性体
46 接触用バンプ
62 支持体
64 接続用バンプ
81 支持体(貫通電極)

Claims (6)

  1. 検査対象物の電気的検査を行う際に、前記検査対象物に形成された電極パッドと電気的に接続されるプローブカードであって、
    前記検査対象物と対向配置される第1の面と、前記第1の面と反対側の面を有する基板本体と、
    前記基板本体の第1の面と第2の面との間を貫通する貫通電極と、
    前記基板本体の前記第1の面から前記第2の面に向かって形成された収容部に充填された弾性体と、
    前記弾性体に配置され、前記基板本体の前記第1の面から前記第2の面に向かって延びる支持体と、
    前記電極パッドと対応して形成され、前記支持体の端部に接続され、前記貫通電極と電気的に接続された接触用バンプと、
    を有することを特徴とするプローブカード。
  2. 前記収容部は、前記基板本体の前記第1の面と前記第2の面との間を貫通する貫通孔である、ことを特徴とする請求項1記載のプローブカード。
  3. 前記支持体は、前記弾性体を貫通するように形成された前記貫通電極である、ことを特徴とする請求項1又は2記載のプローブカード。
  4. 前記基板本体の前記第2の面には、配線基板に形成された電極パッドと電気的に接続される接続用バンプを有し、該接続用バンプは、前記接触用バンプの移動に応じた高さに設定されてなる、ことを特徴とする請求項1乃至のうちの何れか一項に記載のプローブカード。
  5. 検査対象物の電気的検査を行う際に、前記検査対象物に形成された電極パッドと電気的に接続されるプローブカードの製造方法であって、
    基板に、底部から開口方向に向かって延びる柱部を有する第1の深穴と、第2の深穴を形成する工程と、
    前記第1の深穴に弾性体を充填する工程と、
    前記基板を薄化して基板本体を形成し、前記第1及び第2の深穴をそれぞれ第1及び第2の貫通孔とし、前記柱部を前記基板から離間させて支持体とする工程と、
    前記第2の貫通孔に貫通電極を形成する工程と、
    前記電極パッドと対応し、前記支持体に接続された接触用バンプを形成する工程と、
    を含むことを特徴とするプローブカードの製造方法。
  6. 検査対象物の電気的検査を行う際に、前記検査対象物に形成された電極パッドと電気的に接続されるプローブカードの製造方法であって、
    基板に第1の深穴を形成する工程と、
    前記第1の深穴に弾性体を充填する工程と、
    前記基板を薄化して基板本体を形成し、前記第1の深穴を第1の貫通孔とする工程と、
    前記弾性体に第2の貫通孔を形成する工程と、
    前記第2の貫通孔に貫通電極を形成する工程と、
    前記貫通電極に接続された接触用バンプを形成する工程と、
    を含むことを特徴とするプローブカードの製造方法。
JP2010098013A 2010-04-21 2010-04-21 プローブカード及びその製造方法 Active JP5379065B2 (ja)

Priority Applications (3)

Application Number Priority Date Filing Date Title
JP2010098013A JP5379065B2 (ja) 2010-04-21 2010-04-21 プローブカード及びその製造方法
US13/089,522 US20110260744A1 (en) 2010-04-21 2011-04-19 Probe card and method for manufacturing probe card
US14/067,685 US8922234B2 (en) 2010-04-21 2013-10-30 Probe card and method for manufacturing probe card

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2010098013A JP5379065B2 (ja) 2010-04-21 2010-04-21 プローブカード及びその製造方法

Publications (2)

Publication Number Publication Date
JP2011226963A JP2011226963A (ja) 2011-11-10
JP5379065B2 true JP5379065B2 (ja) 2013-12-25

Family

ID=44815277

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2010098013A Active JP5379065B2 (ja) 2010-04-21 2010-04-21 プローブカード及びその製造方法

Country Status (2)

Country Link
US (2) US20110260744A1 (ja)
JP (1) JP5379065B2 (ja)

Families Citing this family (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP6033130B2 (ja) * 2013-03-13 2016-11-30 新光電気工業株式会社 プローブガイド板及びその製造方法
TWI592071B (zh) * 2014-11-14 2017-07-11 Mpi Corp Multilayer circuit board
KR101953962B1 (ko) * 2017-01-09 2019-03-04 서울대학교산학협력단 비아를 포함하는 신축성 기판 형성 방법 및 비아를 가지는 신축성 기판
CN108289387A (zh) * 2018-01-25 2018-07-17 郑州云海信息技术有限公司 一种含有焊针的线路板设计加工方法
CN109721023B (zh) * 2019-01-03 2020-08-28 北京先通康桥医药科技有限公司 一种柔性传感器阵列、触诊探头及其制备方法
JP2021165732A (ja) * 2020-04-01 2021-10-14 株式会社東芝 抵抗マッピング装置、抵抗測定装置、抵抗測定方法、プログラム、及び記録媒体
KR102846947B1 (ko) * 2024-04-01 2025-08-18 주식회사 오럼머티리얼 반도체 테스트 장치 및 그 제조 방법

Family Cites Families (20)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5886877A (en) 1995-10-13 1999-03-23 Meiko Electronics Co., Ltd. Circuit board, manufacturing method therefor, and bump-type contact head and semiconductor component packaging module using the circuit board
JP2977124B2 (ja) * 1995-10-13 1999-11-10 株式会社メイコー 回路基板とその製造方法、その回路基板を用いたバンプ式コンタクトヘッド
US5926029A (en) * 1997-05-27 1999-07-20 International Business Machines Corporation Ultra fine probe contacts
US6256882B1 (en) * 1998-07-14 2001-07-10 Cascade Microtech, Inc. Membrane probing system
JP3565086B2 (ja) * 1999-04-16 2004-09-15 富士通株式会社 プローブカード及び半導体装置の試験方法
JP2001052779A (ja) 1999-08-09 2001-02-23 Nec Corp コンタクトプローブの構造とその製造方法
JP2001165956A (ja) * 1999-12-06 2001-06-22 Micronics Japan Co Ltd プローブシート組立体及びプローブカード
US6906539B2 (en) * 2000-07-19 2005-06-14 Texas Instruments Incorporated High density, area array probe card apparatus
US6965244B2 (en) * 2002-05-08 2005-11-15 Formfactor, Inc. High performance probe system
US7071715B2 (en) * 2004-01-16 2006-07-04 Formfactor, Inc. Probe card configuration for low mechanical flexural strength electrical routing substrates
CN100539061C (zh) * 2004-03-31 2009-09-09 Jsr株式会社 探针设备,配备有该探针设备的晶片检测设备,以及晶片检测方法
US7230437B2 (en) * 2004-06-15 2007-06-12 Formfactor, Inc. Mechanically reconfigurable vertical tester interface for IC probing
US7688095B2 (en) * 2004-07-30 2010-03-30 International Business Machines Corporation Interposer structures and methods of manufacturing the same
KR100640632B1 (ko) * 2005-01-29 2006-10-31 삼성전자주식회사 프로브 카드 및 그 제조방법
JP5005195B2 (ja) 2005-07-13 2012-08-22 東京エレクトロン株式会社 プローブカード製造方法
JP5374079B2 (ja) * 2008-06-20 2013-12-25 東京エレクトロン株式会社 検査用接触構造体
US7888957B2 (en) * 2008-10-06 2011-02-15 Cascade Microtech, Inc. Probing apparatus with impedance optimized interface
US8410806B2 (en) * 2008-11-21 2013-04-02 Cascade Microtech, Inc. Replaceable coupon for a probing apparatus
TWI359535B (en) * 2008-12-30 2012-03-01 King Yuan Electronics Co Ltd Zif connectors and semiconductor testing device an
US8264249B2 (en) * 2009-08-02 2012-09-11 Chunghwa Precision Test Tech. Co., Ltd. Vertical probe card

Also Published As

Publication number Publication date
JP2011226963A (ja) 2011-11-10
US20110260744A1 (en) 2011-10-27
US20140055157A1 (en) 2014-02-27
US8922234B2 (en) 2014-12-30

Similar Documents

Publication Publication Date Title
JP5379065B2 (ja) プローブカード及びその製造方法
JP4340517B2 (ja) 半導体装置及びその製造方法
US6545228B2 (en) Semiconductor device with a plurality of stacked boards and method of making
JP5500870B2 (ja) 接続端子付き基板及び電子部品のソケット等
US9502390B2 (en) BVA interposer
US9167710B2 (en) Embedded packaging with preformed vias
WO2012067177A1 (ja) 配線板及びその製造方法
CN101358998A (zh) 复数梁合成型接触端子
KR20090054390A (ko) 반도체 장치
JP2012198194A (ja) プローブカード及びその製造方法
JP5408602B2 (ja) 多層配線基板
US20100052711A1 (en) Probe card and manufacturing method of the same
JP2013093366A (ja) フレキシブル配線基板およびその製造方法
KR101933015B1 (ko) 반도체 장치의 패드 구조물, 그의 제조 방법 및 패드 구조물을 포함하는 반도체 패키지
US6667627B2 (en) Probe for inspecting semiconductor device and method of manufacturing the same
US9476913B2 (en) Probe card
WO2016021397A1 (ja) 貫通電極基板及びその製造方法、並びに貫通電極基板を用いた半導体装置
US9470718B2 (en) Probe card
TWI857011B (zh) 檢查治具
JP2011103334A (ja) 半導体装置及び半導体装置の製造方法
KR101101589B1 (ko) 프로브 기판 및 그의 제조 방법
CN112768422B (zh) 芯片封装结构及其制作方法
JP2001242219A (ja) 検査用プローブ基板及びその製造方法
JP2005201813A (ja) 半導体検査装置及びコンタクトの製造方法
CN113823601A (zh) 半导体封装装置及其制造方法

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20121221

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20130724

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20130730

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20130830

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20130917

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20130926

R150 Certificate of patent or registration of utility model

Ref document number: 5379065

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150

Free format text: JAPANESE INTERMEDIATE CODE: R150