JP3645765B2 - はんだ接続部構造、bga型半導体パッケージの実装構造およびbga型半導体パッケージの実装プロセス - Google Patents
はんだ接続部構造、bga型半導体パッケージの実装構造およびbga型半導体パッケージの実装プロセス Download PDFInfo
- Publication number
- JP3645765B2 JP3645765B2 JP32273799A JP32273799A JP3645765B2 JP 3645765 B2 JP3645765 B2 JP 3645765B2 JP 32273799 A JP32273799 A JP 32273799A JP 32273799 A JP32273799 A JP 32273799A JP 3645765 B2 JP3645765 B2 JP 3645765B2
- Authority
- JP
- Japan
- Prior art keywords
- solder
- semiconductor package
- type semiconductor
- substrate
- bga type
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
Images
Classifications
-
- H10W90/724—
Landscapes
- Electric Connection Of Electric Components To Printed Circuits (AREA)
- Wire Bonding (AREA)
Description
【発明の属する技術分野】
この発明は、一般に、はんだ接続部構造に関するものであり、より特定的には、BGA(Ball Grid Array)型半導体パッケージのような底部に凹凸電極を有する半導体パッケージを、基板上に電気的に接続するBGA型半導体パッケージのはんだ接続部構造に関する。この発明は、また、そのようなBGA型半導体パッケージの実装構造に関する。この発明は、さらに、BGA型半導体パッケージの実装構造に使用するはんだペーストに関する。この発明は、さらに、BGA型半導体パッケージの電極形成プロセスに関する。この発明は、さらに、BGA型半導体パッケージの実装プロセスに関する。
【0002】
【従来の技術】
BGA型半導体パッケージは、その底部にエリアアレイ状に電極を配置して、実装面積の縮小化を特徴としているが、その接続構造上、はんだ接続部の応力緩和機構が弱い。
【0003】
はんだ接続部の寿命は、接続断面積、はんだ高さ、体積などに依存し、はんだ高さを高くすることで改善されることが知られている。
【0004】
そこで、はんだに濡れない材料(ソルダレジストなど)でダムを造り、はんだを筒状にして、高さを高くする方法などが提案されている。
【0005】
【発明が解決しようとする課題】
しかしながら、はんだを筒状に形成すると、はんだ自体の表面張力により、はんだが球形になろうとする。このため、筒状の部分で、はんだが分断される現象が生じ、ひいては接続不良が生じるという問題点があった。
【0006】
この発明は、上記のような問題点を解決するためになされたもので、接続不良を起こさないはんだ接続部構造を提供することを目的とする。
【0007】
この発明は、また、接続不良を生じさせないBGA型半導体パッケージの実装構造を提供することを目的とする。
【0008】
この発明は、さらに、接続不良を起こさないはんだペーストを提供することを目的とする。
【0009】
この発明のさらに他の目的は、接続不良を起こさないように改良された、BGA型半導体パッケージの電極形成プロセスを提供することにある。
【0010】
この発明のさらに他の目的は、接続不良を起こさないように改良された、BGA型半導体パッケージの実装プロセスを提供することにある。
【0011】
【課題を解決するための手段】
請求項1に係るはんだ接続部構造は、一方の基板に設けられ、はんだと、該はんだより融点が高く、少なくとも表面がはんだに濡れる組成からなる異種材料を含む第1はんだを備える。他方の基板に、はんだからなる第2はんだが設けられている。一方の基板と他方の基板との少なくとも一方の表面上に凹部が形成され、上記第1はんだと上記第2はんだとを接触させて、これらを溶融し、異種材料を一方の基板と他方の基板との少なくとも一方における凹部内の電極近傍に偏在させてなる。
【0012】
この発明の好ましい実施態様によれば、上記異種材料の比重は、はんだと略等しい。また、異種材料の比重がはんだより大きくてもよい。また、上記異種材料は、はんだより比重が大きい異種材料と、はんだより比重が小さい異種材料とから構成してもよい。
【0013】
また、上記異種材料の形状は、球形であるのが好ましい。
また、上記異種材料は、はんだに濡れる材質からなっているものでもよく、また、その表面をはんだに濡れる金属で被覆したものでもよい。
【0014】
請求項2に係るBGA型半導体パッケージの実装構造においては、一方の基板に、はんだと、該はんだより融点が高く、少なくとも表面がはんだに濡れる組成からなる異種材料を含む第1はんだが設けられている。他方の基板に、はんだからなる第2はんだが設けられている。一方の基板と他方の基板との少なくとも一方の表面上に凹部が形成され、上記第1はんだと上記第2はんだとを接触させ、これらを溶融し、異種材料を一方の基板と他方の基板との少なくとも一方における凹部内の電極近傍に偏在させてなる。
【0015】
請求項2に係る発明においても、異種材料としては、上記請求項1の好ましい実施態様の中で用いたものが使用できる。
【0016】
また、異種材料の大きさは、次式を満足しているものが好ましい。
D−{B−(B2−ρ2)1/2}/2<A<2D
D:凹部高さ:ρ:凹部幅:A:異種材料径,B:はんだボール径
上記はんだとして、無鉛はんだを用いるのが好ましい。
【0017】
はんだペーストは、ある局面では、はんだ粉体と、フラックス剤と、はんだより融点が高く、表面がはんだに濡れる組成からなる異種材料の粉体とからなる。
【0018】
この発明によれば、上記異種材料の比重は、はんだと略等しい。
また、上記異種材料の比重ははんだよりも大きくてもよい。
【0019】
さらに、上記異種材料の比重ははんだより小さいのが好ましい場合もある。
上記異種材料は、はんだより比重が大きい異種材料と、はんだより比重が小さい異種材料とからなってもよい。
【0020】
また、上記異種材料の形状は、球形であるのが好ましい。
また、上記異種材料は、該異種材料の表面がはんだに濡れる金属で被覆されているのが好ましい。
【0025】
請求項3に係るBGA型半導体パッケージの実装プロセスにおいては、まず、はんだ粉体と、フラックス剤と、はんだより融点が高く、少なくとも表面がはんだに濡れる組成からなる異種材料の粉体とからなるはんだペーストを、実装基板に印刷する。上記実装基板の上にBGA型半導体パッケージを載置する。上記はんだペーストを溶融させ、それによって、上記BGA型半導体パッケージを、異種材料が部分的に混入したはんだを介して、上記実装基板に電気的に接続する一方で、前記実装基板と前記BGA型半導体パッケージとの少なくとも一方の表面上に形成された凹部内の電極近傍に前記異種材料を偏在させる。
【0026】
請求項4に係るBGA型半導体パッケージの実装プロセスにおいては、まず、実装基板の上にスクリーン印刷用の開口部を有するステンシルを形成する。上記ステンシル開口部に、はんだより融点が高く、少なくとも表面がはんだに濡れる組成からなる異種材料を載置する。はんだペーストを上記実装基板の上に印刷する。上記ステンシルを取外す。はんだボールを有するBGA型半導体パッケージを、上記実装基板の上に載置する。上記はんだペーストを溶融させ、それによって、上記BGA型半導体パッケージのはんだボールと上記実装基板を接続するとともに、該はんだボール中に上記異種材料を混入せしめる一方で、前記実装基板と前記BGA型半導体パッケージとの少なくとも一方の表面上に形成された凹部内の電極近傍に前記異種材料を偏在させる。
【0027】
請求項5に係るBGA型半導体パッケージの実装プロセスにおいては、まず、はんだで互いに接続すべき一方の基板と他方の基板を準備する。はんだからなる第1はんだを上記一方の基板に形成する。はんだより融点が高い組成からなり、かつはんだより比重が小さい第1の異種材料と、はんだより融点が高い組成からなり、かつはんだより比重が大きい第2の異種材料とを含む第2はんだを上記他方の基板に形成する。上記第1はんだと上記第2はんだとを接触させて、これらを溶融する。
【0028】
【発明の実施の形態】
以下、この発明の実施の形態を図について説明する。
【0029】
実施の形態1
実施の形態1に係るはんだ接続部構造は、はんだを用いた接続凹部に、融点がはんだより高い金属からなる異種材料を配設し、凹部の電極に異種材料を含んだはんだを介して、電気的接続を行なうはんだ接続部構造に係る。
【0030】
図1を参照して、接続凹部は、絶縁体2の開口部と電極パッド3で構成される。接続凹部には、異種材料1が配設されている。はんだボール6が、凹部に電気的に接続している。図中、16は封止樹脂を表わしている。
【0031】
BGA型半導体パッケージの実装構造のはんだボール中に、異種材料を挿入し、電気的接続を行なうBGA型半導体パッケージの実装プロセスを図2と図3により説明する。図2を参照して、実装基板13に、ステンシル12を用いて、はんだペースト7を印刷する。図中、14は印刷スキージである。その後、ステンシル12を取除く。
【0032】
図3を参照して、BGA型半導体パッケージ5のはんだボール6中に、異種材料である金属1を混入する。電気的接続を行なうBGA型半導体パッケージ5を、実装基板13の上にマウントする。リフロー炉を通過させ、BGA型半導体パッケージ5のはんだボール6とはんだペースト7が溶融し、両者が接合される。なお、図3中、3は電極パッドを表わしており、15はLSIチップを表わしており、16は封止樹脂を表わしている。BGA型半導体パッケージ5と実装基板13とを電気的に接続される接続部内で、絶縁体2の開口部に金属1を存在させているので、実装基板8と接続する際の、はんだ6の分離問題が解消され、かつ、金属1によって、電気的接続が補われる。
【0033】
実施の形態2
実施の形態2においては、融点がはんだより高く、かつ、比重がはんだと同等の異種材料の一例として、黄銅(Cu−Zn合金、比重=8.44g/cm3)を用いた。このとき、はんだ(Sn−Pb共晶)の比重は、8.3〜8.5g/cm3であり、異種材料とはんだの比重はほぼ同等である。また他の実施例として、異種材料とはんだの組合せに、亜鉛(比重=7.143g/cm3)とはんだ(Sn−3.5Ag−0.7CuまたはSn−4.7Ag−1.7CuまたはSn−0.7CuまたはSn−9Zn、いずれも比重=7.27〜7.4g/cm3)を用いても、差し支えない。これらの場合、比重は相互に略同等であるため、はんだ溶融時に、異種材料の移動が発生しないことが特徴として現れる。
【0034】
実施の形態3
本実施の形態では、融点がはんだより高く、かつ比重がはんだよりも大きい異種材料の一例として、Cu(比重=8.96g/cm3)を用いた。はんだ(比重=8.3〜8.5g/cm3)に比べて比重は大きく、異種材料は、はんだ溶融時に沈降して局所的に偏在する特性を有する。たとえば、本接続構造を持つ半導体装置を上に配置し、基板に実装し、基板のはんだを溶融することにより、異種材料が基板側に偏在することが特徴となって、接合が実現される。
【0035】
図4を参照して、はんだ6の接続部よりも比重が大きい異種材料1を用いたBGA型半導体パッケージを、実装基板の表面に実装した場合、異種材料1がはんだ6の溶融時にはんだ6内で降下するため、図5を参照して、BGA型半導体パッケージの絶縁体2の開口部中には、異種材料1を載置できない。
【0036】
しかしながら、図6を参照して、実装基板13のビア部4中には、異種材料1を載置でき、BGA型半導体パッケージの実装構造を実現できる。
【0037】
また、図7と図8を参照して、はんだ6の接続部よりも比重が大きい異種材料1を用いて、BGA型半導体パッケージを実装基板13の裏面に実装する際には、BGA型半導体パッケージが180°回転するため、はんだ6の溶融時には、異種材料1は実装基板13の電極側に降下し、そして、再度180°回転させると、BGS型半導体パッケージの絶縁体2の開口部中に異種材料1が載置された、BGS型半導体パッケージの実装構造を実現できる。
【0038】
実施の形態4
融点がはんだより高く、かつ、比重がはんだよりも小さい異種材料の一例として、Fe(比重=7.87g/cm3)あるいはAl(比重=2.699g/cm3)を用いた。係る異種材料は、はんだ(比重=8.3〜8.5g/cm3)に比べて比重が小さいので、異種材料ははんだ溶融時に浮上して、局所的に偏在する特性を有する。たとえば、本接続構造を持つ半導体装置を上に配置し、基板に実装し、基板のはんだを溶融することにより、異種材料が半導体パッケージ側に偏在することを特徴とする接合が実現できる。
【0039】
図9(a)を参照して、はんだ6接続部よりも比重が小さい異種材料1を用いた場合は、異種材料1がはんだ溶融時にはんだ6内で浮上するため、BGA型半導体パッケージの絶縁体2の開口部中には異種材料1は存在していない。しかし、図9(b)を参照して、BGA型半導体パッケージを実装基板13の表面に実装する際に、BGA型半導体パッケージを180°回転させると、再度のはんだ6の溶融時に、異種材料1が浮上する。その結果、図10を参照して、BGA型半導体パッケージの絶縁体2の開口部中に異種材料1が載置されたBGA型半導体パッケージの実装構造を実現できる。
【0040】
しかし、図11を参照して、両面実装する場合において、実装基板13の裏側に実装する際には、BGA型半導体パッケージの実装構造の場合、再度180°回転させる。そのため、はんだ溶融時には、図11に示すように、異種材料1が浮上する。そして、図12を参照して、実装基板13のビア部4中に異種材料1が載置されたBGA型半導体パッケージの実装構造を実現できる。
【0041】
実施の形態5
融点がはんだより高く、かつ、比重がはんだよりも大きい異種材料と、比重がはんだより小さい異種材料の組合せとして、一例としてCu(比重=8.96g/cm3)、Fe(比重=7.87g/cm3)、はんだ(比重=8.3〜8.5g/cm3)を用いた。本実施の形態においては、はんだ溶融時に沈降する異種材料と浮上する異種材料が存在するので、接合部の上面と下面に異種材料が偏って載置された接合構造を得ることができる。
【0042】
実施の形態6
はんだ溶融時に、はんだとの比重の差異により、溶融はんだ内で異種材料を移動しやすくするため、異種材料の形状を略球形とした。
【0043】
実施の形態7
本実施の形態においては、一例としてはんだに濡れる材質からなる異種材料を用いたが、その他の材料であってもよい。たとえば、はんだとの濡れ合い特性を向上せしめるため、異種材料の表面に、たとえばAu−Niめっき等を施したものでもよい。
【0044】
実施の形態8
本実施の形態においては、図13を参照して、異種材料1の径Aを、絶縁体2の開口部の高さよりも小さく設定した。絶縁体2の開口部の高さをD、絶縁体2の開口径をρ、はんだボール径をB、異種材料1の径をAとすると、はんだボール8が絶縁体2の開口部に配設されているとき、はんだボール8と電極パッド3とのクリアランスは、
D−{B−(B2−ρ2)1/2}/2
より大きいので、はんだボール8が溶融した際には、異種材料1とはんだボール8との濡れ合いは可能である。
【0045】
また、図14を参照して、異種材料1の径Aが絶縁体2の開口部の高さよりも大きい場合、少なくとも異種材料1の半径A/2より、絶縁体2の開口部高さが大きいので、はんだボール8をボール吸着装置によってマウントした際に、絶縁体2の開口部から、はんだボール8が外れることはない。
【0046】
実施の形態9
以上の実施の形態において、はんだボールの材質として、Sn−Pb共晶はんだ、Sn−3.5Ag−0.7Cu,Sn−4.7Ag−1.7Cu,Sn−0.7CuおよびSn−9Zn等の無鉛はんだが有効である。
【0047】
実施の形態10
本実施の形態もまた、BGA型半導体パッケージのはんだボール中に異種材料を挿入し、電気的接続を行なう、BGA型半導体パッケージの電極形成プロセスに関する。本実施の形態においては、はんだ粉体とフラックス剤と異種材料を混練したペースト状のはんだを用いる。
【0048】
まず、図15を参照して、BGA型半導体パッケージ内の絶縁体2の開口部に、異種材料1を混合したはんだペースト10を印刷する。
【0049】
図16を参照して、はんだボール8をボール吸着装置9により吸着し、はんだペーストを印刷したBGA型半導体パッケージの絶縁体2の開口部に、配置する。異種材料1を予め混合することにより、印刷直前に異種材料1を挿入する工程を省略することができる。リフロー炉等を用いて加熱し、はんだボール8とはんだペースト7を溶融して接合する。
【0050】
実施の形態11
本実施の形態では、実施の形態10の具体例として、融点がはんだより高く、かつ、比重がはんだと同等の異種材料の一例として、黄銅(Cu−Zn合金,比重=8.44g/cm3)を用いた。このとき、はんだ(Sn−Pb共晶)の比重は、8.3〜8.5g/cm3であり、異種材料とはんだの比重はほぼ同等である。また、他の実施例として、異種材料とはんだの組合せに、亜鉛(比重=7.143g/cm3)とはんだ(Sn−3.5Ag−0.7Cuまたは、Sn−4.7Ag−1.7Cuまたは、Sn−0.7Cuまたは、Sn−9Zn、いずれも比重=7.27〜7.4g/cm3)を用いても差し支えない。これらの場合、比重が相互に略同等であるため、はんだ溶融時に異種材料の移動が発生しない特徴を有する。
【0051】
実施の形態12
本実施の形態では、実施の形態10の具体例として、融点がはんだより高く、かつ、比重がはんだよりも大きい異種材料の一例として、Cu(比重=8.96g/cm3)を用いた。はんだ(比重=8.3〜8.5g/cm3)に比べて比重は大きく、異種材料は、はんだ溶融時に沈降して局所的に偏在する特性を有する。
【0052】
実施の形態13
本実施の形態では、実施の形態10の具体例として、融点がはんだより高く、かつ、比重がはんだよりも小さい異種材料の一例として、Fe(比重=7.87g/cm3)あるいはAl(比重=2.699g/cm3)を用いた。はんだ(比重=8.3〜8.5g/cm3)に比べて、異種材料の比重が小さいので、異種材料は、はんだ溶融時に浮上して局所的に偏在する。
【0053】
実施の形態14
本実施の形態では、実施の形態10の具体例として、融点がはんだより高く、かつ、比重がはんだよりも大きい異種材料と、小さい異種材料の組合せとして、一例としてCu(比重=8.96g/cm3),Fe(比重=7.87g/cm3),はんだ(比重8.3〜8.5g/cm3)を用いた。本実施の形態においては、はんだ溶融時に沈降する異種材料と浮上する異種材料を有し、接合部の上面と下面に異種材料が偏って存在する接合構造を得ることができる。
【0054】
実施の形態15
本実施の形態では、実施の形態10の具体例として、はんだ溶融時に、はんだとの比重の差異により、溶融はんだ内で異種材料が移動しやすくするため、異種材料の形状を略球形とした。
【0055】
実施の形態16
本実施の形態では、実施の形態10の具体例として、異種材料とはんだとの濡れ合い特性を向上せしめるために、異種材料にAu−Niめっき等を施したものを用いた。
【0056】
実施の形態17
本実施の形態は、BGA型半導体パッケージのはんだボール中に異種材料を挿入し、電気的接続を行なう、BGA型半導体パッケージの電極形成プロセスに関する。
【0057】
図17を参照して、電極面を仰向けにしたBGA型半導体パッケージの、絶縁体2の開口部中に異種材料1を配置する。
【0058】
その後、図16に示すように、はんだボール8を、ボール吸着装置9により、はんだペースト7を印刷した後のBGA型半導体パッケージの絶縁体2の開口部に、配設する。リフロー炉等を用いて加熱し、はんだボール8とはんだペースト7を溶融して、これらを接合する。
【0059】
実施の形態18
実施の形態18も、また、BGA型半導体パッケージのはんだボール中に異種材料を挿入し、電気的接続を行なう、BGA型半導体パッケージの電極形成プロセスに係る。
【0060】
図17を参照して、電極面を仰向けにしたBGA型半導体パッケージの、絶縁体2の開口部中に異種材料1を配置する。
【0061】
図18を参照して、BGA型半導体パッケージの絶縁体2の開口部に、はんだペースト7を印刷する。
【0062】
図16に示すように、はんだボール8を、ボール吸着装置9により、はんだペースト7を印刷後のBGA型半導体パッケージの絶縁体2の開口部に、配設する。リフロー炉等を用いて加熱し、はんだボール8とはんだペースト7を溶融して、これらを接合する。
【0063】
実施の形態19
実施の形態19は、BGA型半導体パッケージのはんだボール中に異種材料を挿入し、電気的接続を行なう、BGA型半導体パッケージの電極形成プロセスに係る。
【0064】
図19を参照して、BGA型半導体パッケージ内の絶縁体2の開口部にはんだペースト7を印刷する。異種材料1を混入させたはんだボール11を、ボール吸着装置9により、はんだペースト7を印刷した後のBGA型半導体パッケージ内の絶縁体2の開口部に配設する。リフロー炉等を用いて加熱し、はんだボール11とはんだペースト7を溶融して、これらを接合する。
【0065】
実施の形態20
本実施の形態はBGA型半導体パッケージの実装構造のはんだボール中に、異種材料を混入し電気的接続を行なう、BGA型半導体パッケージの実装プロセスに係る。
【0066】
図20を参照して、基板13に、異種材料1を混練したはんだペースト10を印刷する。
【0067】
図21を参照して、BGA型半導体パッケージ5を、異種材料1が混練されたはんだペースト10が印刷されている実装基板13上に搭載する。
【0068】
リフロー炉等を用いて加熱し、BGA型半導体パッケージ5のはんだボール6とはんだペースト10を溶融して接合する。異種材料1を予め混合することにより、印刷直前に異種材料1を挿入する時間を省くことができる。
【0069】
実施の形態21
本実施の形態は、BGA型半導体パッケージの実装構造のはんだボール中に、異種材料を混入し、電気的接続を行なう、BGA型半導体パッケージの実装プロセスに係る。
【0070】
図22を参照して、基板13に、はんだペーストを印刷するための、ステンシル12を配設し、該ステンシル12の開口部に異種材料1を載置する。
【0071】
図23を参照して、異種材料1を挿入した後のステンシル12の開口部に、はんだペースト7を印刷スキージ14により供給し、その後ステンシル12を取外す。その後、図21を参照して、BGA型半導体パッケージ5を、異種材料1とはんだペースト10が印刷されている実装基板13上に搭載する。リフロー炉等を用いて加熱し、はんだボール8とはんだペースト7を溶融して、これらを接合する。
【0072】
実施の形態22
本実施の形態では、実施の形態11の具体例として、融点がはんだより高く、かつ、比重がはんだよりも大きい異種材料と、小さい異種材料の組合せとして、一例としてCu(比重=8.96g/cm3)、Fe(比重=7.87g/cm3)、はんだ(比重=8.3〜8.5g/cm3)を用いた。本実施の形態においては、はんだ溶融時に沈降する異種材料と浮上する異種材料を有し、接合部の上面と下面に異種材料が偏って含有された接合構造を得ることができる。
【0073】
実施の形態23
図24を参照して、はんだ6の接続部よりも比重が小さい異種材料1と比重が大きい異種材料1を用いてなるBGA型半導体パッケージを、実装基板13に実装した場合、実装基板13の表側でのはんだ6の溶融時に、比重が大きい異種材料1は、実装基板13の電極ビア4に沈降し、比重が小さい異種材料1はBGA型半導体パッケージの絶縁体2の開口部に浮上して、電極部を形成することができる。
【0074】
また同様に、図25を参照して、上記記載のはんだ6の接続部よりも比重が小さい種材料1と比重が大きい異種材料15を用いてなるBGA型半導体パッケージを実装基板13に両面実装した場合、異種材料1は、はんだの比重の差によって浮上または降下し、凹部に異種材料1を存在させることができる。図中、17は電極パッドである。
【0075】
今回開示された実施の形態はすべての点で例示であって制限的なものではないと考えられるべきである。本発明の範囲は上記した説明ではなくて特許請求の範囲によって示され、特許請求の範囲と均等の意味および範囲内でのすべての変更が含まれることが意図される。
【0076】
【発明の効果】
以上説明したとおり、この発明によれば、BGA型半導体パッケージ内のパッド部と電気的に接続される部分(バンプ)において、絶縁体の開口部内に異種材料が存在することにより、接続部でのはんだ分離現象を解消し、生産歩留まりの向上、実装後の接続信頼性の向上を図ることができる。
【図面の簡単な説明】
【図1】 本発明によるはんだを用いた接続凹部に異種材料が存在する接続部構造の断面図である。
【図2】 実装基板にステンシルを用いてはんだペーストを印刷している様子を示した断面図である。
【図3】 凹部に異種材料が存在するBGA型半導体パッケージを実装基板にマウントを行なっている様子を示した断面図である。
【図4】 凹部にはんだより比重が大きい異種材料が存在するBGA型半導体パッケージの断面図である。
【図5】 異種材料がはんだより比重が小さい場合の、はんだ溶融時におけるBGA型半導体パッケージの実装構造の断面図である。
【図6】 はんだより比重が大きい異種材料が実装基板の凹部に存在するBGA型半導体パッケージの実装構造の断面図である。
【図7】 凹部にはんだと同等の比重を持った異種材料が存在するBGA型半導体パッケージの断面図である。
【図8】 BGA型半導体パッケージを実装基板の裏側に実装を行なっている場合の、断面図である。
【図9】 はんだより比重が小さい異種材料が存在するBGA型半導体パッケージの断面図(a)とペーストを印刷された実装基板に半導体パッケージをマウントしているときの断面図(b)である。
【図10】 異種材料浮上後のBGA型半導体パッケージの実装構造の断面図である。
【図11】 はんだより比重が小さい異種材料が存在するBGA型半導体パッケージを実装基板の裏に実装を行なったときの断面図である。
【図12】 実装基板の凹部に、はんだより比重が小さい異種材料が浮上して、凹部内に異種材料が存在するBGA型半導体パッケージの実装構造の断面図である。
【図13】 本発明に係るはんだを用いた接続凹部に異種材料が存在する、接続部構造の定義を説明するための図であり、異種材料径が絶縁体開口部高さよりも小さい場合を示した図である。
【図14】 本発明に係るはんだを用いた接続凹部に異種材料が存在する、接続部構造を定義するもので、異種材料径が絶縁体開口部高さよりも大きい場合を示した図である。
【図15】 BGA型半導体パッケージ凹部に異種材料が混合されたはんだペーストを印刷しているときの断面図である。
【図16】 ペースト印刷されたBGA型半導体パッケージ凹部にはんだボールを、ボール吸着装置で、マウントを行なっているときの断面図である。
【図17】 BGA型半導体パッケージ凹部に異種材料を挿入したときの断面図である。
【図18】 BGA型半導体パッケージ凹部に、はんだペーストを印刷しているときの、断面図である。
【図19】 ペースト印刷されたBGA型半導体パッケージ凹部に、異種材料が混合されたはんだボールを、ボール吸着装置でマウントを行なっているときの断面図である。
【図20】 実装基板に、ステンシルを用いて、異種材料が混合されたはんだペーストを印刷しているときの断面図である。
【図21】 ペースト印刷された実装基板に、はんだボールを、ボール吸着装置でマウントを行なっているときの断面図である。
【図22】 実装基板に、ステンシルを用いて、異種材料を載置しているときの断面図である。
【図23】 実装基板に、ステンシルを用いて、はんだペーストを印刷しているときの断面図である。
【図24】 はんだより比重が大きいおよび小さい両異種材料が、実装基板およびBGA型半導体パッケージ凹部に存在する、BGA型半導体パッケージの実装構造の断面図である。
【図25】 図24に示すBGA型半導体パッケージの実装構造を両面実装した場合での、はんだ溶融時におけるBGA型半導体パッケージの実装構造の断面図である。
【符号の説明】
1 異種材料、2 BGA型半導体パッケージにおける絶縁体、3 電極パッド、6 はんだ、16 封止樹脂。
Claims (5)
- 一方の基板に設けられ、はんだと、該はんだより融点が高く、少なくとも表面がはんだに濡れる組成からなる異種材料とを含む第1はんだと、
他方の基板に設けられ、はんだからなる第2はんだと、を備え、
前記一方の基板と前記他方の基板との少なくとも一方の表面上に凹部が形成され、
前記第1はんだと前記第2はんだとを接触させて、これらを溶融し、前記異種材料を前記一方の基板と前記他方の基板との少なくとも一方における前記凹部内の電極近傍に偏在させてなる、はんだ接続部構造。 - 一方の基板に設けられ、はんだと、該はんだより融点が高く、少なくとも表面がはんだに濡れる組成からなる異種材料とを含む第1はんだと、
他方の基板に設けられ、はんだからなる第2はんだとを備え、
前記一方の基板と前記他方の基板との少なくとも一方の表面上に凹部が形成され、
前記第1はんだと前記第2はんだとを接触させ、これらを溶融し、前記異種材料を前記一方の基板と前記他方の基板との少なくとも一方における前記凹部内の電極近傍に偏在させてなる、BGA型半導体パッケージの実装構造。 - はんだ粉体と、フラックス剤と、はんだより融点が高く、少なくとも表面がはんだに濡れる組成からなる異種材料の粉体とからなるはんだペーストを、実装基板に印刷する工程と、
前記実装基板の上にBGA型半導体パッケージを載置する工程と、
前記はんだペーストを溶融させ、それによって、前記BGA型半導体パッケージを、前記異種材料が部分的に混入したはんだを介して、前記実装基板に電気的に接続する一方で、前記実装基板と前記BGA型半導体パッケージとの少なくとも一方の表面上に形成された凹部内の電極近傍に前記異種材料を偏在させる工程と、を備えたBGA型半導体パッケージの実装プロセス。 - 実装基板の上にスクリーン印刷用の開口部を有するステンシルを形成する工程と、
前記ステンシル開口部に、はんだより融点が高く、少なくとも表面がはんだに濡れる組成からなる異種材料を載置する工程と、
はんだペーストを前記実装基板の上に印刷する工程と、
前記ステンシルを取外す工程と、
はんだボールを有するBGA型半導体パッケージを、前記実装基板の上に載置する工程と、
前記はんだペーストを溶融させ、それによって前記BGA型半導体パッケージのはんだボールと前記実装基板を接続するとともに、該はんだボール中に前記異種材料を混入せしめる一方で、前記実装基板と前記BGA型半導体パッケージとの少なくとも一方の表面上に形成された凹部内の電極近傍に前記異種材料を偏在させる工程と、を備えたBGA型半導体パッケージの実装プロセス。 - はんだで互いに接続すべき一方の基板と他方の基板を準備する工程と、
はんだからなる第1はんだを前記一方の基板に形成する工程と、
はんだより融点が高い組成からなり、かつはんだより比重が小さい第1の異種材料と、はんだより融点が高い組成からなり、かつはんだより比重が大きい第2の異種材料とを含む第2はんだを前記他方の基板に形成する工程と、
前記第1はんだと前記第2はんだとを接触させて、これらを溶融する工程と、
を備えたBGA型半導体パッケージの実装プロセス。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP32273799A JP3645765B2 (ja) | 1999-11-12 | 1999-11-12 | はんだ接続部構造、bga型半導体パッケージの実装構造およびbga型半導体パッケージの実装プロセス |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP32273799A JP3645765B2 (ja) | 1999-11-12 | 1999-11-12 | はんだ接続部構造、bga型半導体パッケージの実装構造およびbga型半導体パッケージの実装プロセス |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP2001144127A JP2001144127A (ja) | 2001-05-25 |
| JP3645765B2 true JP3645765B2 (ja) | 2005-05-11 |
Family
ID=18147077
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP32273799A Expired - Fee Related JP3645765B2 (ja) | 1999-11-12 | 1999-11-12 | はんだ接続部構造、bga型半導体パッケージの実装構造およびbga型半導体パッケージの実装プロセス |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3645765B2 (ja) |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN101395976A (zh) * | 2006-03-03 | 2009-03-25 | 松下电器产业株式会社 | 电子元件安装体、具有焊料凸点的电子元件、焊料树脂混合材料、电子元件安装方法以及电子元件制造方法 |
| JP4875926B2 (ja) * | 2006-05-29 | 2012-02-15 | イビデン株式会社 | 多層配線板及びその製造方法 |
| JP2009054892A (ja) | 2007-08-28 | 2009-03-12 | Panasonic Electric Works Co Ltd | Ledチップの実装方法 |
| JP5542470B2 (ja) * | 2009-02-20 | 2014-07-09 | パナソニック株式会社 | はんだバンプ、半導体チップ、半導体チップの製造方法、導電接続構造体、および導電接続構造体の製造方法 |
-
1999
- 1999-11-12 JP JP32273799A patent/JP3645765B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JP2001144127A (ja) | 2001-05-25 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| JP3565047B2 (ja) | 半田バンプの形成方法および半田バンプの実装方法 | |
| JP4633630B2 (ja) | 半田付用のフラックスおよび半田付方法 | |
| TWI280829B (en) | Mounting substrate and mounting method of electronic part | |
| KR100776114B1 (ko) | 땜납 접합용 페이스트 및 이를 이용한 땜납 접합 방법 | |
| JPH09232464A (ja) | Bga接続構造及びその形成方法 | |
| CN100586258C (zh) | 用于焊接电子元件的方法和电子元件的焊接结构 | |
| KR20070115660A (ko) | 솔더 페이스트 | |
| JP3645765B2 (ja) | はんだ接続部構造、bga型半導体パッケージの実装構造およびbga型半導体パッケージの実装プロセス | |
| JP2008006499A (ja) | 半田ペースト | |
| JP2009283628A (ja) | 半導体素子実装方法 | |
| JP2007251053A (ja) | 半導体装置の実装構造及びその実装構造の製造方法 | |
| JP2000223831A (ja) | Bgaによる表面実装用ペーストはんだと表面実装方法 | |
| JP4027534B2 (ja) | 電子部品の実装方法 | |
| JP4435663B2 (ja) | はんだ材料、電子部品、及び電子部品の製造方法 | |
| JP3200613B2 (ja) | 電子部品の半田付け方法 | |
| JPH10509842A (ja) | 単一合金半田被覆基板 | |
| JP3304854B2 (ja) | 半田バンプ形成方法 | |
| JP2000271782A (ja) | 半田接合用の金属ペーストおよび半田接合方法 | |
| JP2003198116A (ja) | はんだ付け方法および接合構造体 | |
| JP3493999B2 (ja) | 半田バンプの形成方法および半田バンプの実装方法 | |
| JP2000317672A (ja) | 部品実装用クリームはんだ | |
| JPH08288640A (ja) | ボールグリッドアレイプリント配線板の半田付け方法 |
Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20041026 |
|
| A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20041224 |
|
| TRDD | Decision of grant or rejection written | ||
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20050125 |
|
| A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20050204 |
|
| R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20080210 Year of fee payment: 3 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090210 Year of fee payment: 4 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20100210 Year of fee payment: 5 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20100210 Year of fee payment: 5 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110210 Year of fee payment: 6 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120210 Year of fee payment: 7 |
|
| LAPS | Cancellation because of no payment of annual fees |