JP3305240B2 - 液晶表示パネル駆動装置と駆動方法 - Google Patents
液晶表示パネル駆動装置と駆動方法Info
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- Liquid Crystal (AREA)
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Description
【０００１】
【発明の属する技術分野】本発明は液晶表示パネルにお
ける表示特性を改善した液晶表示パネル駆動装置および
駆動方法に関するものである。
ける表示特性を改善した液晶表示パネル駆動装置および
駆動方法に関するものである。
【０００２】また、本発明は液晶表示パネルにおける応
答速度改善回路に関するものである。
答速度改善回路に関するものである。
【０００３】
【従来の技術】従来、液晶表示パネルの表示特性を改善
する装置としては、特公平７−５２３３１号広報に記載
の装置やＵＳＰ５１１９０８４に記載の装置のように応
答速度の改善を目的とするものがあった。
する装置としては、特公平７−５２３３１号広報に記載
の装置やＵＳＰ５１１９０８４に記載の装置のように応
答速度の改善を目的とするものがあった。
【０００４】
【発明が解決しようとする課題】しかしながら、これら
の従来例では、応答速度を改善するために加減算を行う
補正量が表示を行うデータの信号レベルとは無関係であ
るという問題があった。
の従来例では、応答速度を改善するために加減算を行う
補正量が表示を行うデータの信号レベルとは無関係であ
るという問題があった。
【０００５】例えば、ＰＤＬＣ液晶を用いた表示装置で
は、前記フレームの信号レベルと現フレームの信号レベ
ルの絶対値により応答速度は大きく異なる。
は、前記フレームの信号レベルと現フレームの信号レベ
ルの絶対値により応答速度は大きく異なる。
【０００６】ここで、最大輝度レベルの０％〜１００％
までの応答速度は十分に速いが、０％から１０％までの
応答速度は非常に遅い。
までの応答速度は十分に速いが、０％から１０％までの
応答速度は非常に遅い。
【０００７】この様に、前フレームの信号レベルと現フ
レームの信号レベルの値により、応答速度は大きく異な
るため、従来例の様に信号レベルによらない一定の補正
方法では、最適な応答速度の改善ができなかった。
レームの信号レベルの値により、応答速度は大きく異な
るため、従来例の様に信号レベルによらない一定の補正
方法では、最適な応答速度の改善ができなかった。
【０００８】例えば、応答速度の速い信号レベルに合わ
せて調整を行うと応答速度の遅い信号レベルでは十分な
改善効果が得られず、逆に応答速度の遅い信号レベルに
合わせて調整を行うと応答速度の速い信号レベルでは過
度に補正するためノイズの目立つ映像となるという問題
があった。
せて調整を行うと応答速度の遅い信号レベルでは十分な
改善効果が得られず、逆に応答速度の遅い信号レベルに
合わせて調整を行うと応答速度の速い信号レベルでは過
度に補正するためノイズの目立つ映像となるという問題
があった。
【０００９】
【課題を解決するための手段】本発明による液晶表示パ
ネル駆動装置は、入力映像信号の信号レベルを検出する
第１の信号レベル検出手段と、前記入力映像信号を任意
の一定時間だけ遅延させるメモリ手段と、該メモリ手段
の出力の信号レベルを検出する第２の信号レベル検出手
段と、前記第１の信号レベル検出手段と前記第２の信号
レベル検出手段との出力と、前記任意の一定時間とをも
とにして、前記入力映像信号を補正して出力する補正表
示映像信号演算手段と、を備えることを特徴とする。
ネル駆動装置は、入力映像信号の信号レベルを検出する
第１の信号レベル検出手段と、前記入力映像信号を任意
の一定時間だけ遅延させるメモリ手段と、該メモリ手段
の出力の信号レベルを検出する第２の信号レベル検出手
段と、前記第１の信号レベル検出手段と前記第２の信号
レベル検出手段との出力と、前記任意の一定時間とをも
とにして、前記入力映像信号を補正して出力する補正表
示映像信号演算手段と、を備えることを特徴とする。
【００１０】また、本発明による液晶表示パネル駆動装
置は、入力映像信号の信号レベルをエンコードする第１
のエンコード手段と、前記入力映像信号を任意の一定時
間だけ遅延させるメモリ手段と、該メモリ手段の出力の
信号レベルをエンコードする第２のエンコード手段と、
前記第１および第２のエンコード手段の出力を基に補正
値を得る補正映像信号演算手段と、前記入力映像信号に
前記補正値を加減算する加減算手段と、を備えることを
特徴とする。
置は、入力映像信号の信号レベルをエンコードする第１
のエンコード手段と、前記入力映像信号を任意の一定時
間だけ遅延させるメモリ手段と、該メモリ手段の出力の
信号レベルをエンコードする第２のエンコード手段と、
前記第１および第２のエンコード手段の出力を基に補正
値を得る補正映像信号演算手段と、前記入力映像信号に
前記補正値を加減算する加減算手段と、を備えることを
特徴とする。
【００１１】更に、本発明による液晶表示パネル駆動装
置は、入力映像信号の信号レベルをエンコードする第１
のエンコード手段と、前記入力映像信号の信号レベルを
エンコードする第２のエンコード手段と、該第２のエン
コード手段の出力を任意の一定時間だけ遅延させるメモ
リ手段と、前記第１のエンコード手段の出力と前記メモ
リ手段の出力とを基に補正値を得る補正映像信号演算手
段と、前記入力映像信号に前記補正値を加減算する加減
算手段と、を備えることを特徴とする。
置は、入力映像信号の信号レベルをエンコードする第１
のエンコード手段と、前記入力映像信号の信号レベルを
エンコードする第２のエンコード手段と、該第２のエン
コード手段の出力を任意の一定時間だけ遅延させるメモ
リ手段と、前記第１のエンコード手段の出力と前記メモ
リ手段の出力とを基に補正値を得る補正映像信号演算手
段と、前記入力映像信号に前記補正値を加減算する加減
算手段と、を備えることを特徴とする。
【００１２】更に、本発明による液晶表示パネル駆動装
置は、入力映像信号の信号レベルをエンコードするエン
コード手段と、該エンコード手段の出力を任意の一定時
間だけ遅延させるメモリ手段と、前記エンコード手段の
出力と前記メモリ手段の出力とを基に補正値を得る補正
映像信号演算手段と、前記入力映像信号に前記補正値を
加減算する加減算手段と、を備えることを特徴とする。
置は、入力映像信号の信号レベルをエンコードするエン
コード手段と、該エンコード手段の出力を任意の一定時
間だけ遅延させるメモリ手段と、前記エンコード手段の
出力と前記メモリ手段の出力とを基に補正値を得る補正
映像信号演算手段と、前記入力映像信号に前記補正値を
加減算する加減算手段と、を備えることを特徴とする。
【００１３】更に、本発明による液晶表示パネル駆動装
置は、前記補正表示映像信号演算手段が、液晶表示パネ
ルの駆動電圧対表示輝度のステップ応答出力の前記任意
の一定時間後の値のステップ前後のレベルへの依存性に
基づき、前記第１の信号レベル検出手段の出力と前記第
２の信号レベル検出手段の出力との差と、前記液晶表示
パネルの表示輝度のステップレベルとの間に線形関係が
保たれるように前記入力映像信号を補正することを特徴
とする。
置は、前記補正表示映像信号演算手段が、液晶表示パネ
ルの駆動電圧対表示輝度のステップ応答出力の前記任意
の一定時間後の値のステップ前後のレベルへの依存性に
基づき、前記第１の信号レベル検出手段の出力と前記第
２の信号レベル検出手段の出力との差と、前記液晶表示
パネルの表示輝度のステップレベルとの間に線形関係が
保たれるように前記入力映像信号を補正することを特徴
とする。
【００１４】更に、本発明による液晶表示パネル駆動装
置は、前記補正映像信号演算手段がルックアップテーブ
ルよりなることを特徴とする。
置は、前記補正映像信号演算手段がルックアップテーブ
ルよりなることを特徴とする。
【００１５】更に、本発明による液晶表示パネル駆動装
置は、前記任意の一定時間が前記入力映像信号が液晶表
示パネルの同一画素を再度駆動するまでの時間であるこ
とを特徴とする。
置は、前記任意の一定時間が前記入力映像信号が液晶表
示パネルの同一画素を再度駆動するまでの時間であるこ
とを特徴とする。
【００１６】本発明による液晶表示パネル駆動方法は、
液晶表示パネルの駆動電圧対表示輝度のステップ応答出
力の任意の一定時間後の値のステップ前後のレベルへの
依存性に基づき、映像信号のステップレベルと前記液晶
表示パネルの表示輝度のステップレベルとの間に線形関
係が保たれるように補正した前記映像信号で駆動するこ
とを特徴とする。
液晶表示パネルの駆動電圧対表示輝度のステップ応答出
力の任意の一定時間後の値のステップ前後のレベルへの
依存性に基づき、映像信号のステップレベルと前記液晶
表示パネルの表示輝度のステップレベルとの間に線形関
係が保たれるように補正した前記映像信号で駆動するこ
とを特徴とする。
【００１７】また、 本発明による液晶表示パネル駆動
方法は、上記の液晶表示パネル駆動方法において、現在
の前記映像信号のレベルが低いときに、該レベルが高い
ときよりも細かく補正することを特徴とする。
方法は、上記の液晶表示パネル駆動方法において、現在
の前記映像信号のレベルが低いときに、該レベルが高い
ときよりも細かく補正することを特徴とする。
【００１８】更に、本発明による液晶表示パネル駆動方
法は、前記任意の一定時間は前記映像信号が液晶表示パ
ネルの同一画素を再度駆動するまでの時間であることを
特徴とする。
法は、前記任意の一定時間は前記映像信号が液晶表示パ
ネルの同一画素を再度駆動するまでの時間であることを
特徴とする。
【００１９】［作用］動画表示をした場合においても、
残像のより少ない映像を表示することが可能となるた
め、応答速度の遅い液晶表示パネルであっても、動画表
示を行う用途に用いることが可能となる。
残像のより少ない映像を表示することが可能となるた
め、応答速度の遅い液晶表示パネルであっても、動画表
示を行う用途に用いることが可能となる。
【００２０】
［実施形態１］図１は、実施形態１による液晶表示パネ
ル駆動装置の構成を示すブロック図である。図１におい
て１は現在の入力映像の入力端子、２は、現在の入力映
像信号を入力とする第１のレベル検出手段、３は一定時
間前の映像信号を一定時間遅らせるためのメモリ手段、
４はメモリ手段３より出力される一定時間前の映像信号
を入力とする第２のレベル検出手段であり、５は前記現
在の入力映像信号と前記第１のレベル検出手段１と前記
第２のレベル検出手段２に接続され、それらの入力信号
をもとにして、表示する映像信号を演算する補正表示映
像信号演算手段である。６は補正表示映像信号演算手段
５の出力が接続される出力端子である。
ル駆動装置の構成を示すブロック図である。図１におい
て１は現在の入力映像の入力端子、２は、現在の入力映
像信号を入力とする第１のレベル検出手段、３は一定時
間前の映像信号を一定時間遅らせるためのメモリ手段、
４はメモリ手段３より出力される一定時間前の映像信号
を入力とする第２のレベル検出手段であり、５は前記現
在の入力映像信号と前記第１のレベル検出手段１と前記
第２のレベル検出手段２に接続され、それらの入力信号
をもとにして、表示する映像信号を演算する補正表示映
像信号演算手段である。６は補正表示映像信号演算手段
５の出力が接続される出力端子である。
【００２１】まず、図６を参照して本発明の液晶表示パ
ネルにおける応答速度補正回路で行われている応答速度
補正の原理について説明する。
ネルにおける応答速度補正回路で行われている応答速度
補正の原理について説明する。
【００２２】図６においてＳｉは液晶表示パネルによっ
て表示されるべき映像信号の入力信号である。
て表示されるべき映像信号の入力信号である。
【００２３】一般に液晶表示パネルに使用されている液
晶が持つ粘性により、液晶分子の配向の変化が電界の変
化に対して遅れて起こるため、液晶表示パネルに例えば
ステップ上の電圧状の信号Ｓｉが入力された場合にも液
晶の過度応答特性により、液晶表示パネルの表示の状態
が図６（ａ）のＳｏで示されるように立上りが遅れる。
晶が持つ粘性により、液晶分子の配向の変化が電界の変
化に対して遅れて起こるため、液晶表示パネルに例えば
ステップ上の電圧状の信号Ｓｉが入力された場合にも液
晶の過度応答特性により、液晶表示パネルの表示の状態
が図６（ａ）のＳｏで示されるように立上りが遅れる。
【００２４】立ち下がりも同様に遅れるが図示は省略す
る。
る。
【００２５】また、本実施形態では、図６（ｂ）は前記
した図６（ａ）に示されている液晶表示素子における表
示の状態が図中のＳｏのように、液晶の過度応答特性に
よって入力信号Ｓｉの時間軸上での変化状態に対して遅
れる分が図６（ｂ）におけるＳｏ′のように実質的に補
正された状態になるように、補正表示映像信号演算手段
５が、補正表示映像手段ステップ上の入力信号Ｓｉを予
め信号Ｓｃに変換する。
した図６（ａ）に示されている液晶表示素子における表
示の状態が図中のＳｏのように、液晶の過度応答特性に
よって入力信号Ｓｉの時間軸上での変化状態に対して遅
れる分が図６（ｂ）におけるＳｏ′のように実質的に補
正された状態になるように、補正表示映像信号演算手段
５が、補正表示映像手段ステップ上の入力信号Ｓｉを予
め信号Ｓｃに変換する。
【００２６】ここで補正済の映像出力Ｓｃとしては、１
フィールドの期間内に所望の信号レベルに到達する信号
レベルが選ばれる。
フィールドの期間内に所望の信号レベルに到達する信号
レベルが選ばれる。
【００２７】例えば、リフレッシュレートが６０Ｈｚの
映像信号を表示する場合、約１６．６ｍｓ以内に液晶の
応答が所望の最終値に到達しなければ、正確な表示を行
うことができず、残像が発生する。
映像信号を表示する場合、約１６．６ｍｓ以内に液晶の
応答が所望の最終値に到達しなければ、正確な表示を行
うことができず、残像が発生する。
【００２８】従って、液晶表示パネルに出力される映像
信号レベルとしては、前記１６．６ｍｓ前後に液晶の応
答が所望の値に到達する信号レベルを用いる。
信号レベルとしては、前記１６．６ｍｓ前後に液晶の応
答が所望の値に到達する信号レベルを用いる。
【００２９】図７を用いて、補正済映像出力信号Ｓｃの
演算方法について説明する。
演算方法について説明する。
【００３０】図７に液晶の入力電圧対表示輝度のステッ
プ応答における過度特性を示す。
プ応答における過度特性を示す。
【００３１】線ａは、表示輝度が０％から３０％に変化
する場合の過度特性を示す。
する場合の過度特性を示す。
【００３２】線ｂは、表示輝度が０％から５０％に変化
する場合の過度特性、線ｃは、表示輝度が０％から７０
％に変化する場合の過度特性である。
する場合の過度特性、線ｃは、表示輝度が０％から７０
％に変化する場合の過度特性である。
【００３３】例えば、ＮＴＳＣのＴＶ映像の１フィール
ド期間は約１６．６ｍｓ（＝１／６０［ｓｅｃ］）であ
るため、液晶表示パネルの応答速度は１６．６ｍｓ以内
であることが望まれる。
ド期間は約１６．６ｍｓ（＝１／６０［ｓｅｃ］）であ
るため、液晶表示パネルの応答速度は１６．６ｍｓ以内
であることが望まれる。
【００３４】リフレッシュレート６０Ｈｚにて輝度３０
％を表示しようとする場合には、約１６．６ｍｓ以内に
最終値に到達しなければならないが、実際には図７に示
す様に約１６．６ｍｓでは最終値の約３０％（表示輝度
１０％）までしか到達することができない。
％を表示しようとする場合には、約１６．６ｍｓ以内に
最終値に到達しなければならないが、実際には図７に示
す様に約１６．６ｍｓでは最終値の約３０％（表示輝度
１０％）までしか到達することができない。
【００３５】そのため、動画表示の場合に残像を発生す
るという問題があった。
るという問題があった。
【００３６】ここで、図７の線ｂは１６．６ｍｓにて表
示輝度の３０％に到達することができる。
示輝度の３０％に到達することができる。
【００３７】従って、１フィールド後に表示すべき輝度
が０％から３０％に変化する場合は、表示輝度が０％か
ら５０％に変化するような表示信号を印加する。
が０％から３０％に変化する場合は、表示輝度が０％か
ら５０％に変化するような表示信号を印加する。
【００３８】これにより、１６．６ｍｓで表示輝度３０
％に到達することができる。
％に到達することができる。
【００３９】本例では、表示輝度が０％からの場合につ
いてのみ説明したが、他の表示輝度から別の表示輝度に
変化する場合においても同様の方法にて補正済映像出力
信号を算出する。
いてのみ説明したが、他の表示輝度から別の表示輝度に
変化する場合においても同様の方法にて補正済映像出力
信号を算出する。
【００４０】以上のように、補正後の映像出力信号Ｓｃ
は入力信号のレベルと一定時間前の入力信号のレベル
と、その時間により決定される。
は入力信号のレベルと一定時間前の入力信号のレベル
と、その時間により決定される。
【００４１】このように演算された補正後の映像出力信
号を出力端子６を介して、液晶表示パネルに印加するこ
とにより、図６（ｂ）のＳｏ′のような最適な表示を得
ることができる。
号を出力端子６を介して、液晶表示パネルに印加するこ
とにより、図６（ｂ）のＳｏ′のような最適な表示を得
ることができる。
【００４２】ここで、補正済映像出力Ｓｃの演算結果
は、目的とする輝度に完全に一致する必要はなく、必要
な演算精度および補正効果の好み等により適宜調整され
る。
は、目的とする輝度に完全に一致する必要はなく、必要
な演算精度および補正効果の好み等により適宜調整され
る。
【００４３】補正表示映像信号演算手段は、例えば、現
在フィールドの入力映像信号レベルと１フィールド前の
入力映像信号レベルとをアドレスとし、補正後の映像出
力信号Ｓｃをデータとするルックアップテーブル（以
下、ＬＵＴと称する）で構成することができる。
在フィールドの入力映像信号レベルと１フィールド前の
入力映像信号レベルとをアドレスとし、補正後の映像出
力信号Ｓｃをデータとするルックアップテーブル（以
下、ＬＵＴと称する）で構成することができる。
【００４４】また、本実施形態では、ＮＴＳＣ信号の１
フィールド時間（１６．６ｍｓ）の周期で液晶パネルの
同一画素を駆動するとしたが、周期はこれに限定される
ものではなく、ＮＴＳＣ信号の１フレーム周期、ＰＡＬ
／ＳＥＣＯＭ信号のフィールド周期又はフレーム周期、
ＶＧＡ信号やＳＶＧＡ信号のリフレッシュレートに対応
した周期であってもよい。この場合、各種の信号に対応
した補正表示映像信号手段５の特性を予め用意しておい
て、信号の種類に応じて特性を切り替えることにより各
種の信号に対応することができる。
フィールド時間（１６．６ｍｓ）の周期で液晶パネルの
同一画素を駆動するとしたが、周期はこれに限定される
ものではなく、ＮＴＳＣ信号の１フレーム周期、ＰＡＬ
／ＳＥＣＯＭ信号のフィールド周期又はフレーム周期、
ＶＧＡ信号やＳＶＧＡ信号のリフレッシュレートに対応
した周期であってもよい。この場合、各種の信号に対応
した補正表示映像信号手段５の特性を予め用意しておい
て、信号の種類に応じて特性を切り替えることにより各
種の信号に対応することができる。
【００４５】また、各々のリフレッシュレートに対して
独立にＬＵＴを持つのではなく、平均的な補正値を持つ
ＬＵＴで代用してもよい。
独立にＬＵＴを持つのではなく、平均的な補正値を持つ
ＬＵＴで代用してもよい。
【００４６】［実施形態２］図２は実施形態２による液
晶表示パネル駆動装置の構成を示すブロック図である。
これは実施形態１の液晶表示パネル駆動装置の詳細な回
路構成の一例である。
晶表示パネル駆動装置の構成を示すブロック図である。
これは実施形態１の液晶表示パネル駆動装置の詳細な回
路構成の一例である。
【００４７】２０１は現在の映像信号を入力するための
入力端子、２０２は現在の映像信号を入力とする第１の
エンコーダ回路（エンコーダ１）、２０３は１フレーム
または１フィールドだけ映像信号を遅延させるためのフ
レームメモリ、２０４はフレームメモリ２０３より出力
される１フレームまたは１フィールド前の映像信号を入
力とする第２のエンコーダ回路（エンコーダ２）であ
り、２０５は第１のエンコーダ回路２０１と第２のエン
コーダ回路２０３に接続されるＬＵＴ、２０６は現在の
映像信号とＬＵＴ２０５より出力される補正データを加
減算するための加算器であり、２０７は出力端子であ
る。ＬＵＴ２０５と加減算器２０６で実施形態１の補正
表示映像信号演算手段５を形成する。
入力端子、２０２は現在の映像信号を入力とする第１の
エンコーダ回路（エンコーダ１）、２０３は１フレーム
または１フィールドだけ映像信号を遅延させるためのフ
レームメモリ、２０４はフレームメモリ２０３より出力
される１フレームまたは１フィールド前の映像信号を入
力とする第２のエンコーダ回路（エンコーダ２）であ
り、２０５は第１のエンコーダ回路２０１と第２のエン
コーダ回路２０３に接続されるＬＵＴ、２０６は現在の
映像信号とＬＵＴ２０５より出力される補正データを加
減算するための加算器であり、２０７は出力端子であ
る。ＬＵＴ２０５と加減算器２０６で実施形態１の補正
表示映像信号演算手段５を形成する。
【００４８】以下、本実施形態を詳細に説明する。
【００４９】映像入力端子２０１より入力された映像信
号Ｓｉは、第１のエンコーダ回路２０２に入力される。
号Ｓｉは、第１のエンコーダ回路２０２に入力される。
【００５０】ここで、現在の映像信号Ｓｉは８ｂｉｔの
信号とする。
信号とする。
【００５１】図３に第１のエンコーダ回路の詳細回路を
示す。
示す。
【００５２】入力端子３０１よりエンコーダ回路に入力
された映像信号Ｓｉは、比較器３０２〜３１６にて各々
比較レベル３２２〜３３６と比較される。本実施例では
１５個の比較器を用いることにより入力８ｂｉｔを１６
状態に変換し、その出力をエンコーダ３１７にて４ｂｉ
ｔの信号に変換する。３１８は出力端子である。
された映像信号Ｓｉは、比較器３０２〜３１６にて各々
比較レベル３２２〜３３６と比較される。本実施例では
１５個の比較器を用いることにより入力８ｂｉｔを１６
状態に変換し、その出力をエンコーダ３１７にて４ｂｉ
ｔの信号に変換する。３１８は出力端子である。
【００５３】ここで、比較レベルは、演算精度が要求さ
れる信号レベル範囲では細かく設定され、演算精度が要
求されない信号レベル範囲では荒く設定される。例え
ば、信号レベルが低い範囲では比較レベルを細かく設定
し、信号レベルが高い範囲では比較レベルを粗く設定す
る。
れる信号レベル範囲では細かく設定され、演算精度が要
求されない信号レベル範囲では荒く設定される。例え
ば、信号レベルが低い範囲では比較レベルを細かく設定
し、信号レベルが高い範囲では比較レベルを粗く設定す
る。
【００５４】これにより、入力の信号レベルにより演算
精度の重み付けをすることが可能となる。
精度の重み付けをすることが可能となる。
【００５５】図２において、第１のエンコーダ回路２０
２より出力された信号は、ＬＵＴ２０５に入力される。
２より出力された信号は、ＬＵＴ２０５に入力される。
【００５６】また、フレームメモリ２０３には、映像入
力端子２０１より入力される映像信号を書込まれ、次の
フレームまたはフィールドが映像入力端子より入力され
るときに、以前に書込みした１フレームまたは１フィー
ルド前の映像信号がフレームメモり２０３から読み出さ
れる。２０３より読み出された１フレームまたは１フィ
ールド前の映像信号は、第２のエンコーダ回路２０４に
入力される。
力端子２０１より入力される映像信号を書込まれ、次の
フレームまたはフィールドが映像入力端子より入力され
るときに、以前に書込みした１フレームまたは１フィー
ルド前の映像信号がフレームメモり２０３から読み出さ
れる。２０３より読み出された１フレームまたは１フィ
ールド前の映像信号は、第２のエンコーダ回路２０４に
入力される。
【００５７】第２のエンコーダ回路２０４の構成は図３
に示す第１のエンコード回路２０２の構成と同一である
ので重複する説明は省略する。
に示す第１のエンコード回路２０２の構成と同一である
ので重複する説明は省略する。
【００５８】フレームメモリより出力された１フレーム
または１フィールド前の映像信号は、第２のエンコーダ
回路２０４に入力され、入力信号のレベルにより重み付
けされた信号に変換される。ここでは、第１のエンコー
ダ回路と同様に８ｂｉｔの入力信号を４ｂｉｔに変換す
るものとして説明する。
または１フィールド前の映像信号は、第２のエンコーダ
回路２０４に入力され、入力信号のレベルにより重み付
けされた信号に変換される。ここでは、第１のエンコー
ダ回路と同様に８ｂｉｔの入力信号を４ｂｉｔに変換す
るものとして説明する。
【００５９】第２のエンコーダ回路２０４により重み付
けをされた信号は、ＬＵＴ２０５に入力される。
けをされた信号は、ＬＵＴ２０５に入力される。
【００６０】従って、ＬＵＴ２０５には、第１のエンコ
ーダ回路より出力される４ｂｉｔの信号と第２のエンコ
ーダ回路より出力される４ｂｉｔの信号の計８ｂｉｔの
信号が入力される。
ーダ回路より出力される４ｂｉｔの信号と第２のエンコ
ーダ回路より出力される４ｂｉｔの信号の計８ｂｉｔの
信号が入力される。
【００６１】ＬＵＴ２０５はアドレス８ｂｉｔを入力し
て、そのアドレスにより選択されるデータ８ｂｉｔを出
力する。
て、そのアドレスにより選択されるデータ８ｂｉｔを出
力する。
【００６２】本例では、第１のエンコーダ回路２０２か
らの出力４ｂｉｔがＬＵＴ２０５のアドレス入力の上位
４ｂｉｔに接続され、第２のエンコーダ回路２０４から
の出力４ｂｉｔがＬＵＴ２０５のアドレス入力の下位４
ｂｉｔに入力される。
らの出力４ｂｉｔがＬＵＴ２０５のアドレス入力の上位
４ｂｉｔに接続され、第２のエンコーダ回路２０４から
の出力４ｂｉｔがＬＵＴ２０５のアドレス入力の下位４
ｂｉｔに入力される。
【００６３】ＬＵＴ２０５のデータには、各々のアドレ
スに対応した補正値を入力しておく。
スに対応した補正値を入力しておく。
【００６４】図８はＬＵＴ２０５の一例であり、アドレ
スの上位４ｂｉｔ（現在の映像信号レベル）とアドレス
の下位４ｂｉｔ（１フレームまたは１フィールド前の映
像信号レベル）から現在の映像信号に加減算する補正量
を選択し出力される。
スの上位４ｂｉｔ（現在の映像信号レベル）とアドレス
の下位４ｂｉｔ（１フレームまたは１フィールド前の映
像信号レベル）から現在の映像信号に加減算する補正量
を選択し出力される。
【００６５】例えば、１フレームまたは１フィールド前
の信号レベルが００００ｂであり、現在の映像信号レベ
ルが０１１１ｂである場合には、補正値として＋３１
（０００１ １１１１ｂ）が選択される。
の信号レベルが００００ｂであり、現在の映像信号レベ
ルが０１１１ｂである場合には、補正値として＋３１
（０００１ １１１１ｂ）が選択される。
【００６６】補正値＋３１と現在の映像信号を加減算器
２０６にて、加算し、液晶表示パネルに印加することに
より、表示速度の劣化の無い映像を表示することが可能
となる。
２０６にて、加算し、液晶表示パネルに印加することに
より、表示速度の劣化の無い映像を表示することが可能
となる。
【００６７】本実施形態では入力映像信号を８ｂｉｔと
し、エンコーダ回路にて４ｂｉｔに圧縮した後、補正デ
ータを演算する構成としたが、入力信号およびエンコー
ダによる圧縮されるｂｉｔ数は、要求される演算精度お
よび使用可能なハード量との兼ね合いから適当なｂｉｔ
数を選べばよい。
し、エンコーダ回路にて４ｂｉｔに圧縮した後、補正デ
ータを演算する構成としたが、入力信号およびエンコー
ダによる圧縮されるｂｉｔ数は、要求される演算精度お
よび使用可能なハード量との兼ね合いから適当なｂｉｔ
数を選べばよい。
【００６８】また、入力映像信号８ｂｉｔの上位４ｂｉ
ｔのみを使うなどの簡単な構成で実現することもでき
る。
ｔのみを使うなどの簡単な構成で実現することもでき
る。
【００６９】また、入力映像信号８ｂｉｔを圧縮せずに
そのまま演算回路に入力する構成をとることも可能であ
る。
そのまま演算回路に入力する構成をとることも可能であ
る。
【００７０】また、本実施形態では、補正表示映像信号
演算手段５の一例として、予め演算した結果を入力した
ＬＵＴ２０５と加減算器２０６を用いたが、補正表示映
像信号演算手段５としては、演算を行う演算回路を別途
設けてもよい。２０３のフレームメモリは特殊なビデオ
メモリである必要はなく、メモリ手段であればＳＲＡ
Ｍ，ＤＲＡＭ，ＥＤＯＲＡＭ，ＳＤＲＡＭ，ＦＩＦＯな
どメモリ機能があれば何でも良い。
演算手段５の一例として、予め演算した結果を入力した
ＬＵＴ２０５と加減算器２０６を用いたが、補正表示映
像信号演算手段５としては、演算を行う演算回路を別途
設けてもよい。２０３のフレームメモリは特殊なビデオ
メモリである必要はなく、メモリ手段であればＳＲＡ
Ｍ，ＤＲＡＭ，ＥＤＯＲＡＭ，ＳＤＲＡＭ，ＦＩＦＯな
どメモリ機能があれば何でも良い。
【００７１】［実施形態３］図４は実施形態３による液
晶表示パネル駆動装置の構成を示すブロック図である。
晶表示パネル駆動装置の構成を示すブロック図である。
【００７２】ここでは、第２のエンコーダ回路４０４に
より信号レベルを検出し、信号を圧縮した後にフレーム
メモリ４０３に書込む構成としている。
より信号レベルを検出し、信号を圧縮した後にフレーム
メモリ４０３に書込む構成としている。
【００７３】本構成をとることにより、フレームメモリ
に書込むｂｉｔ数を削減することができるため、容量の
少ないメモリを用いることが可能となり、コスト削減が
可能となるというメリットがある。
に書込むｂｉｔ数を削減することができるため、容量の
少ないメモリを用いることが可能となり、コスト削減が
可能となるというメリットがある。
【００７４】［実施形態４］図５は実施形態４による液
晶表示パネル駆動装置の構成を示すブロック図である。
晶表示パネル駆動装置の構成を示すブロック図である。
【００７５】この実施形態は、実施形態３と比較して、
第２のエンコーダ回路４０４を削除し、第１のエンコー
ド回路４０２の出力を直接フレームメモリに書込む点が
異なる。この実施形態の構成は、第２のエンコーダ回路
４０４によるレベル検出範囲が第１のエンコーダ回路４
０２のレベル検出範囲と同じである場合に可能となる。
第２のエンコーダ回路４０４を削除し、第１のエンコー
ド回路４０２の出力を直接フレームメモリに書込む点が
異なる。この実施形態の構成は、第２のエンコーダ回路
４０４によるレベル検出範囲が第１のエンコーダ回路４
０２のレベル検出範囲と同じである場合に可能となる。
【００７６】実施形態３と比較して更にハード量を減ら
しコストを削減する効果がある。
しコストを削減する効果がある。
【００７７】
【発明の効果】以上説明したように本発明によれば、現
在の入力映像信号のレベルと同一画素を駆動した過去の
入力映像信号のレベルに応じて液晶表示パネルの駆動信
号を最適値に補正することにより液晶表示パネルの表示
特性の改善を行うことができる。
在の入力映像信号のレベルと同一画素を駆動した過去の
入力映像信号のレベルに応じて液晶表示パネルの駆動信
号を最適値に補正することにより液晶表示パネルの表示
特性の改善を行うことができる。
【００７８】それにより、動画表示をした場合において
も、残像のより少ない映像を表示することが可能となる
ため、応答速度の遅い液晶表示パネルであっても、動画
表示を行う用途に用いることが可能となる。
も、残像のより少ない映像を表示することが可能となる
ため、応答速度の遅い液晶表示パネルであっても、動画
表示を行う用途に用いることが可能となる。
【図１】本発明の実施形態１による液晶表示パネル駆動
装置の構成を示すブロック図である。
装置の構成を示すブロック図である。
【図２】本発明の実施形態２による液晶表示パネル駆動
装置の構成を示すブロック図である。
装置の構成を示すブロック図である。
【図３】エンコーダ回路の構成を示すブロック図であ
る。
る。
【図４】本発明の実施形態３による液晶表示パネル駆動
装置の構成を示すブロック図である。
装置の構成を示すブロック図である。
【図５】本発明の実施形態４による液晶表示パネル駆動
装置の構成を示すブロック図である。
装置の構成を示すブロック図である。
【図６】本発明による液晶表示パネルの応答速度補正の
原理を説明する図である。
原理を説明する図である。
【図７】補正済映像出力信号Ｓｃの演算方法の基礎とな
る液晶表示パネルの応答の説明図である。
る液晶表示パネルの応答の説明図である。
【図８】ＬＵＴ（ルックアップテーブル）のデータ配列
の一例である。
の一例である。
１ 現在の入力映像の入力端子 ２ 第１のレベル検出手段 ３ メモリ手段 ４ 第２のレベル検出手段 ５ 補正表示映像信号演算手段 ６ 出力端子 ２０１ 映像信号入力端子 ２０２ 第１のエンコーダ回路 ２０３ フレームメモリ ２０４ 第２のエンコーダ回路 ２０５ ＬＵＴ（ルックアップテーブル） ２０６ 加減算器 ２０７ 出力端子
Claims (3)
- 【請求項１】 入力映像信号の信号レベルを検出する第
１の信号レベル検出手段と、 前記入力映像信号を任意の一定時間だけ遅延させるメモ
リ手段と、 該メモリ手段の出力の信号レベルを検出する第２の信号
レベル検出手段と、 前記第１の信号レベル検出手段と前記第２の信号レベル
検出手段との出力と、前記任意の一定時間とをもとにし
て、前記入力映像信号を補正して出力する補正表示映像
信号演算手段と、 を備えることを特徴とする液晶表示パネル駆動装置。 - 【請求項２】 前記補正映像信号演算手段はルックアッ
プテーブルよりなることを特徴とする請求項１に記載の
液晶表示パネル駆動装置。 - 【請求項３】 前記任意の一定時間は前記入力映像信号
が液晶表示パネルの同一画素を再度駆動するまでの時間
であることを特徴とする請求項１又は２に記載の液晶表
示パネル駆動装置。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29096897A JP3305240B2 (ja) | 1997-10-23 | 1997-10-23 | 液晶表示パネル駆動装置と駆動方法 |
| US09/176,273 US6501451B1 (en) | 1997-10-23 | 1998-10-21 | Liquid crystal display panel driving device and method |
| EP98308626A EP0911795A3 (en) | 1997-10-23 | 1998-10-22 | Liquid crystal display panel driving device and method |
| US10/267,673 US20030038768A1 (en) | 1997-10-23 | 2002-10-10 | Liquid crystal display panel driving device and method |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29096897A JP3305240B2 (ja) | 1997-10-23 | 1997-10-23 | 液晶表示パネル駆動装置と駆動方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH11126050A JPH11126050A (ja) | 1999-05-11 |
| JP3305240B2 true JP3305240B2 (ja) | 2002-07-22 |
Family
ID=17762777
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP29096897A Expired - Fee Related JP3305240B2 (ja) | 1997-10-23 | 1997-10-23 | 液晶表示パネル駆動装置と駆動方法 |
Country Status (3)
| Country | Link |
|---|---|
| US (2) | US6501451B1 (ja) |
| EP (1) | EP0911795A3 (ja) |
| JP (1) | JP3305240B2 (ja) |
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