JP2018113369A - Semiconductor device, display device and electronic apparatus - Google Patents
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Abstract
Description
本技術は、トランジスタを有する半導体装置、この半導体装置を用いた表示装置および電子機器に関する。 The present technology relates to a semiconductor device having a transistor, a display device using the semiconductor device, and an electronic apparatus.
近年、アクティブマトリクス駆動方式のディスプレイの大画面化および高速駆動化に伴い、酸化物半導体膜をチャネルに用いた薄膜トランジスタ(TFT:Thin Film Transistor)の開発が活発に行われている(例えば、特許文献1)。酸化物半導体膜を有する半導体装置には、薄膜トランジスタとともに、複数の配線および保持容量素子等が設けられている。 2. Description of the Related Art In recent years, thin film transistors (TFTs) using an oxide semiconductor film as a channel have been actively developed along with the increase in screen size and drive speed of active matrix drive systems (for example, patent documents). 1). In a semiconductor device including an oxide semiconductor film, a plurality of wirings, a storage capacitor element, and the like are provided along with a thin film transistor.
このような半導体装置では、電子素子および配線等の設計の自由度をより高めることが望まれている。 In such a semiconductor device, it is desired to increase the degree of freedom in designing electronic elements and wirings.
設計の自由度を高めることが可能な半導体装置、この半導体装置を用いた表示装置および電子機器を提供することが望ましい。 It is desirable to provide a semiconductor device capable of increasing the degree of freedom in design, a display device using the semiconductor device, and an electronic apparatus.
本技術の一実施の形態に係る半導体装置は、ゲート電極およびゲート電極に対向する酸化物半導体膜のチャネル領域を有するトランジスタと、酸化物半導体膜と同層に設けられ、酸化物半導体膜と同一の構成材料を含む第1配線と、ゲート電極と同層に設けられた第2配線と、第1配線を間にして第2配線に対向する酸素透過防止膜および酸素透過防止膜と第1配線との間の第1絶縁膜を含む積層部とを備えたものである。 A semiconductor device according to an embodiment of the present technology is provided in the same layer as a transistor having a gate electrode and a channel region of an oxide semiconductor film facing the gate electrode, and is the same as the oxide semiconductor film A first wiring containing the constituent material, a second wiring provided in the same layer as the gate electrode, an oxygen permeation preventive film, an oxygen permeation preventive film and the first wiring facing the second wiring with the first wiring in between And a laminated portion including a first insulating film between the two.
本技術の一実施の形態に係る表示装置は、表示素子および表示素子を駆動する半導体装置を備え、半導体装置は、ゲート電極およびゲート電極に対向する酸化物半導体膜のチャネル領域を有するトランジスタと、酸化物半導体膜と同層に設けられ、酸化物半導体膜と同一の構成材料を含む第1配線と、ゲート電極と同層に設けられた第2配線と、第1配線を間にして第2配線に対向する酸素透過防止膜および酸素透過防止膜と第1配線との間の第1絶縁膜を含む積層部とを含むものである。 A display device according to an embodiment of the present technology includes a display element and a semiconductor device that drives the display element. The semiconductor device includes a gate electrode and a transistor having a channel region of an oxide semiconductor film facing the gate electrode; The first wiring provided in the same layer as the oxide semiconductor film and including the same constituent material as the oxide semiconductor film, the second wiring provided in the same layer as the gate electrode, and the second wiring interposed between the first wiring and the second wiring. An oxygen permeation preventive film facing the wiring, and a stacked portion including a first insulating film between the oxygen permeation preventive film and the first wiring are included.
本技術の一実施の形態に係る電子機器は、上記本技術の表示装置を備えたものである。 An electronic apparatus according to an embodiment of the present technology includes the display device of the present technology.
本技術の一実施の形態に係る半導体装置、表示装置および電子機器では、積層部に設けられた酸素透過防止膜により、第1配線への酸素の供給が抑えられる。 In the semiconductor device, the display device, and the electronic device according to the embodiment of the present technology, supply of oxygen to the first wiring is suppressed by the oxygen permeation prevention film provided in the stacked portion.
本技術の一実施の形態に係る半導体装置、表示装置および電子機器によれば、積層部に酸素透過防止膜を設けるようにしたので、第1配線と第2配線とが重なる部分においても第1配線の導電性を安定して維持することができる。よって、設計の自由度を高めることが可能となる。なお、ここに記載された効果は必ずしも限定されるものではなく、本開示中に記載されたいずれの効果であってもよい。 According to the semiconductor device, the display device, and the electronic device according to the embodiment of the present technology, since the oxygen permeation prevention film is provided in the stacked portion, the first wiring and the second wiring overlap each other. The conductivity of the wiring can be stably maintained. Therefore, it is possible to increase the degree of design freedom. Note that the effects described here are not necessarily limited, and may be any effects described in the present disclosure.
以下、本技術の実施の形態について、図面を参照して詳細に説明する。なお、説明は以下の順序で行う。
1.実施の形態(積層部に酸素透過防止膜を有する半導体装置の例)
2.変形例1(酸素透過防止膜の一部が保持容量素子の下部電極を構成する例)
3.変形例2(ボトムゲート型のトランジスタを有する例)
4.適用例1(表示装置および撮像装置の例)
5.適用例2(電子機器の例)
Hereinafter, embodiments of the present technology will be described in detail with reference to the drawings. The description will be given in the following order.
1. Embodiment (Example of a semiconductor device having an oxygen permeation preventive film in a laminated portion)
2. Modification 1 (example in which part of the oxygen permeation prevention film constitutes the lower electrode of the storage capacitor element)
3. Modification 2 (example having a bottom gate type transistor)
4). Application example 1 (example of display device and imaging device)
5). Application Example 2 (Example of electronic equipment)
<実施の形態>
[構成]
図1は、本技術の一実施の形態に係る半導体装置(半導体装置1)の断面構成を模式的に表したものであり、図2は、半導体装置1の一部の平面構成を表している。図2のI−I’線に沿った断面構成が図1に示されている。半導体装置1は、トップゲート型の薄膜トランジスタ(トランジスタ10T)を有しており、例えば表示装置および撮像装置(後述の図7の表示装置2Aおよび図8の撮像装置2B)等の駆動回路に用いられる。半導体装置1は、基板11上に、絶縁膜12(第2絶縁膜)、酸素透過防止膜13、絶縁層間膜14(第1絶縁膜)、酸化物半導体膜15、ゲート絶縁膜16およびゲート電極17をこの順に有している。
<Embodiment>
[Constitution]
FIG. 1 schematically illustrates a cross-sectional configuration of a semiconductor device (semiconductor device 1) according to an embodiment of the present technology, and FIG. 2 illustrates a partial planar configuration of the
酸化物半導体膜15のうち、ゲート電極17と対向する領域は、トランジスタ10Tのチャネル領域15Tであり、チャネル領域15T以外の領域は低抵抗化された第1配線領域15Wである。ゲート電極17と同層には、ゲート電極17と離間して第2配線18が設けられている。第2配線18と酸化物半導体膜15とは互いに交差する方向に延在しており(図2)、半導体装置1には、第2配線18と酸化物半導体膜15とが重なる部分(積層部10L)が設けられている。
In the
基板11は、例えば、ガラス,石英およびシリコンなどから構成されている。あるいは、基板11は、例えば、PET(ポリエチレンテレフタレート),PI(ポリイミド),PC(ポリカーボネート)またはPEN(ポリエチレンナフタレート)などの樹脂材料から構成されていてもよい。この他にも、ステンレス鋼(SUS)などの金属板に絶縁材料を成膜したものを基板11に用いることもできる。
The
絶縁膜12は、基板11からの不純物の拡散を防止するためのものであり、基板11の全面にわたって設けられている。絶縁膜12は、酸化物半導体膜15のキャリア密度を制御する役割も担っている。この絶縁膜12は、例えばシリコン酸化膜(SiOx)、シリコン窒化膜(SiNx)、酸窒化シリコン(SiON)および酸化アルミニウム膜(AlOx)等の無機絶縁膜により構成されている。絶縁膜12は、例えばアクリル系樹脂,ポリイミドおよびノボラック系樹脂などの有機絶縁膜と無機絶縁膜とを積層して構成するようにしてもよい。絶縁膜12の厚みは、例えば10nm〜1000nmである。
The
酸素透過防止膜13は、基板11および絶縁膜12から酸化物半導体膜15への酸素の移動を遮るためのものである。本実施の形態では、積層部10Lに、この酸素透過防止膜13が設けられ、酸素透過防止膜13が第1配線領域15Wを間にして第2配線18に対向している。詳細は後述するが、これにより、下層(基板11および絶縁膜12)から酸化物半導体膜15への酸素の供給が抑えられるので、第1配線領域15Wの導電性を安定して維持することが可能となる。
The oxygen permeation
酸素透過防止膜13は、絶縁膜12上の選択的な領域(積層部10L)に設けられている。例えば、酸素透過防止膜13の幅(Y方向の長さ)は、酸化物半導体膜15の幅よりも小さく、酸素透過防止膜13の長さ(X方向の長さ)は、第2配線18の幅よりも大きくなっている(図2)。
The oxygen permeation
酸素透過防止膜13は、例えば金属を含んでいる。酸素透過防止膜13は、例えばチタン(Ti),タングステン(W),タンタル(Ta),アルミニウム(Al),モリブデン(Mo),銀(Ag),ネオジウム(Nd)および銅(Cu)のうちの1種を含む単体および合金等により構成されている。酸素透過防止膜13は、金属酸化物により構成するようにしてもよく、例えば、インジウム(In),ガリウム(Ga),亜鉛(Zn),スズ(Sn),チタン(Ti)およびニオブ(Nb)のうちの少なくとも1種の元素を含む酸化物により構成するようにしてもよい。具体的には、酸化インジウムスズ亜鉛(ITZO),酸化インジウムガリウム亜鉛(IGZO:InGaZnO),酸化亜鉛(ZnO),酸化インジウ亜鉛(IZO),酸化インジウムガリウム(IGO),酸化インジウムスズ(ITO),酸化スズ(SnO)および酸化インジウム(InO)等により酸素透過防止膜13を構成するようにしてもよい。酸素透過防止膜13に、酸化チタン(TiO)および酸化アルミニウム(AlO)を用いることも可能である。酸素透過防止膜13の厚み(Z方向の長さ)は、例えば10nm〜500nmである。
The oxygen
酸素透過防止膜13と酸化物半導体膜15との間には絶縁層間膜14が設けられている。この絶縁層間膜14は、酸素透過防止膜13と酸化物半導体膜15との接触を防ぐためのものである。絶縁層間膜14は、酸素透過防止膜13を覆い、例えば基板11の全面にわたって設けられている。絶縁層間膜14は例えばシリコン酸化膜(SiOx)、シリコン窒化膜(SiNx)、酸窒化シリコン(SiON)および酸化アルミニウム膜(AlOx)等の無機絶縁膜により構成されている。絶縁層間膜14には、ポリイミド,アクリル樹脂およびシリコン系樹脂等の有機絶縁膜を用いるようにしてもよい。絶縁層間膜14の厚みは例えば10nm〜1000nmである。
An insulating
トップゲート型のトランジスタ10Tは、酸化物半導体膜15(チャネル領域15T)上に、ゲート絶縁膜16を間にしてゲート電極17を有している。酸化物半導体膜15の第1配線領域15Wには、ソース・ドレイン電極(図示せず)が電気的に接続されている。
The
酸化物半導体膜15は、絶縁層間膜14上の選択的な領域に設けられている。酸化物半導体膜15は、例えばX方向に沿って延在しており(図2)、前述のように、チャネル領域15Tおよび第1配線領域15Wを有している。チャネル領域15Tは、ゲート電極17と平面視で重なって(対向して)いる。第1配線領域15Wは、チャネル領域15Tよりも電気抵抗の低い領域であり、例えばドーパントとして拡散した金属元素(例えば、アルミニウム(Al),インジウム(In),チタン(Ti)およびスズ(Sn)等)を含んでいる。第1配線領域15Wでは、酸化物半導体膜15の酸素が脱離されることにより低抵抗化されていてもよい。第1配線領域15Wは、導体として機能するようになっている。この第1配線領域15Wに交差して、第2配線18が設けられている。即ち、積層部10Lでは、酸化物半導体膜15の第1配線領域15Wと第2配線18とがゲート絶縁膜16を間にして重なっている。ここでは、第1配線領域15Wの酸化物半導体膜15が、本技術の「第1配線」の一具体例である。即ち、ここでは、「第1配線」はチャネル領域15Tを有する酸化物半導体膜15と同一の構成材料からなり、同一の厚みを有している。
The
酸化物半導体膜15は、例えば、インジウム(In),ガリウム(Ga),亜鉛(Zn),スズ(Sn),チタン(Ti)およびニオブ(Nb)のうちの少なくとも1種の元素の酸化物を主成分として含む酸化物半導体から構成されている。具体的には、酸化物半導体膜15に酸化インジウムスズ亜鉛(ITZO),酸化インジウムガリウム亜鉛(IGZO:InGaZnO),酸化亜鉛(ZnO),酸化インジウ亜鉛(IZO),酸化インジウムガリウム(IGO),酸化インジウムスズ(ITO)および酸化インジウム(InO)等を用いることができる。酸化物半導体膜15の厚みは例えば10nm〜200nmである。
The
ゲート絶縁膜16は、例えば基板11の全面にわたって設けられ、酸化物半導体膜15を覆うとともに、絶縁層間膜14上に設けられている。トランジスタ10Tでは、チャネル領域15Tとゲート電極17との間に、積層部10Lでは、第1配線領域15Wと第2配線18との間に、ゲート絶縁膜16(第3絶縁膜)が配置されている。ゲート絶縁膜16は、例えばシリコン酸化膜(SiOx)、シリコン窒化膜(SiNx)、シリコン窒化酸化膜(SiON)および酸化アルミニウム膜(AlOx)のうちの1種よりなる単層膜、またはそれらのうちの2種以上よりなる積層膜により構成されている。ゲート絶縁膜16の厚みは、例えばシリコン酸化膜の単層膜の場合、50nm以上300nm以下である。
The
ゲート電極17は、印加されるゲート電圧(Vg)によってチャネル領域15T中のキャリア密度を制御すると共に、電位を供給する配線としての機能を有するものである。このゲート電極17の構成材料は、例えば、チタン(Ti),タングステン(W),タンタル(Ta),アルミニウム(Al),モリブデン(Mo),銀(Ag),ネオジウム(Nd)および銅(Cu)のうちの1種を含む単体および合金が挙げられる。あるいは、それらのうちの少なくとも1種を含む化合物および2種以上を含む積層膜であってもよい。また、例えばITO等の透明導電膜が用いられても構わない。ゲート電極17は、ゲート絶縁膜16上の選択的な領域に、チャネル領域15Tと対向して設けられている。
The
ソース・ドレイン電極(図示せず)は、トランジスタ10Tのソースまたはドレインとして機能するものであり、例えば、上記ゲート電極17の構成材料として列挙したものと同様の金属または透明導電膜を含んで構成されている。このソース・ドレイン電極としては、電気伝導性の良い材料が選択されることが望ましい。
The source / drain electrodes (not shown) function as the source or drain of the
第2配線18は、ゲート電極17と同層、即ち、ゲート絶縁膜16上に設けられ、例えばY方向に沿って延在している。第2配線18は、例えばデータ線またはゲート線などの電圧制御をするためのものであり、例えば各画素トランジスタのゲート電極またはソース・ドレイン電極等に接続されている。第2配線18は、ゲート電極17と同一の工程で形成されており、ゲート電極17と同一の構成材料からなり、ゲート電極17と同じ厚みを有している。
The
[製造方法]
上記のような半導体装置1は、例えば次のようにして製造することができる。
[Production method]
The
まず、基板11上の全面に、絶縁膜12を形成する。次いで、この絶縁膜12上に、例えばスパッタリング法を用いて金属膜を成膜した後、例えばフォトリソグラフィおよびエッチングにより、所定の形状にパターニングして酸素透過防止膜13を形成する。続いて、酸素透過防止膜13上および絶縁膜12上に、絶縁層間膜14を形成する。
First, the insulating
次に、絶縁層間膜14上に酸化物半導体材料を、例えばスパッタ法等により成膜した後、例えばフォトリソグラフィおよびエッチングにより、所定の形状にパターニングして酸化物半導体膜15を形成する。この後、酸化物半導体膜15の第1配線領域15Wに金属元素をドーパントとして拡散させ、第1配線領域15Wを低抵抗化する。あるいは、酸化物半導体膜15の酸素を引き抜く等の方法により、第1配線領域15Wを低抵抗化してもよい。続いて、例えばCVD法等を用いてゲート絶縁膜16を成膜した後、ゲート絶縁膜16上にゲート電極17および第2配線18を形成する。最後に、上述した金属材料よりなるソース・ドレイン電極を形成することにより、図1に示した半導体装置1が完成する。
Next, after an oxide semiconductor material is formed on the insulating
[作用、効果]
本実施の形態の半導体装置1では、ゲート電極17に閾値電圧以上のオン電圧が印加されると、酸化物半導体膜15のチャネル領域15Tが活性化される。これにより、一対のソース・ドレイン電極間に、第1配線領域15Wを通じて電流が流れる。
[Action, effect]
In the
本実施の形態の半導体装置1では、積層部10Lの絶縁膜12と第1配線領域15Wとの間に、酸素透過防止膜13が設けられている。これにより、基板11および絶縁膜12から酸化物半導体膜15への酸素の供給が抑えられるので、第1配線領域15Wの導電性を安定して維持することが可能となる。以下、これについて比較例を用いて説明する。
In the
図3は、比較例にかかる半導体装置(半導体装置100)の模式的な断面構成を表したものである。この半導体装置100には、酸素透過防止膜および絶縁層間膜(図1の酸素透過防止膜13および絶縁層間膜14)が設けられていない。半導体装置100は、酸化物半導体膜15上に金属酸化膜130を有しており、チャネル領域15Tおよび積層部100L以外の酸化物半導体膜15には金属酸化膜130が接している。半導体装置1と同様に、チャネル領域15Tの酸化物半導体膜15上には、ゲート絶縁膜16およびゲート電極17が設けられ、積層部100Lの酸化物半導体膜15上には、ゲート絶縁膜16および第2配線18が設けられている。
FIG. 3 illustrates a schematic cross-sectional configuration of a semiconductor device (semiconductor device 100) according to a comparative example. The
金属酸化膜130は、例えば酸化アルミニウムにより構成されており、下層(絶縁膜12および酸化物半導体膜15)から酸素Oを吸い上げるようになっている。このため、金属酸化膜130と接している部分の第1配線領域15Wは、安定して導電性を維持することができる。また、金属酸化膜130は、酸化物半導体膜15を保護する役割も担っている。
The
しかしながら、上述のように、積層部100Lでは、第1配線領域15W上に絶縁膜16Bおよび第2配線18が設けられているので、第1配線領域15Wに金属酸化膜130を接触させることができない。このため、積層部100Lの第1配線領域15Wには下層から酸素が供給され、チャネル領域15Tと類似した半導体挙動を示すおそれがある。即ち、トランジスタと類似の構造を有する積層部100Lでは、第1配線領域15Wの導電性を安定して維持することができない。したがって、半導体装置100では、酸化物半導体膜15と第2配線180とを重ねて配置することが困難であり、積層部100Lのないレイアウトに制限される。
However, as described above, in the
これに対し、半導体装置1では積層部10Lに酸素透過防止膜13が設けられているので、図4に示したように、基板11および絶縁膜12から酸化物半導体膜15への酸素Oの移動が酸素透過防止膜13によって遮られる。したがって、積層部10Lにおいても、第1配線領域15Wの導電性が安定して維持され、酸化物半導体膜15と第2配線18とをより自由にレイアウトすることが可能となる。
On the other hand, since the oxygen permeation
以上説明したように本実施の形態では、積層部10Lの絶縁膜12と酸化物半導体膜15との間に酸素透過防止膜13を設けるようにしたので、第1配線領域15Wの導電性を安定して維持することができる。よって、設計の自由度を高めることが可能となる。
As described above, in this embodiment, since the oxygen permeation
以下、本実施の形態の変形例について説明するが、以降の説明において上記実施の形態と同一構成部分については同一符号を付してその説明は適宜省略する。 Hereinafter, modifications of the present embodiment will be described. In the following description, the same components as those of the above-described embodiment will be denoted by the same reference numerals, and description thereof will be omitted as appropriate.
<変形例1>
図5(A)は、上記実施の形態の変形例1に係る半導体装置(半導体装置1A)の要部の模式的な平面構成、図5(B)は半導体装置1Aの要部の模式的な断面構成を表している。この半導体装置1Aは、酸素透過防止膜(酸素透過防止膜13A)の一部が電子素子の構成要素として機能するものであり、酸素透過防止膜13Aと酸化物半導体膜15とが第2配線18を介して電気的に接続されている。この点を除き、半導体装置1Aは上記実施の形態の半導体装置1と同様の構成を有し、その作用および効果も同様である。
<
5A is a schematic plan configuration of the main part of the semiconductor device (semiconductor device 1A) according to
半導体装置1Aは、例えば薄膜トランジスタ(例えば図1のトランジスタ10T)とともに、保持容量素子(図示せず)を有している。酸素透過防止膜13Aは導電膜により構成されており、その一部(図示せず)は、例えば保持容量素子の一方の電極(例えば下部電極)として機能するようになっている。
The semiconductor device 1A includes, for example, a storage capacitor element (not shown) together with a thin film transistor (for example, the
積層部10Lでは、基板11、酸素透過防止膜13A、絶縁層間膜14、第1配線領域15W、絶縁膜16Bおよび第2配線18がこの順に積層されている。即ち、基板11と酸化物半導体膜15との間に酸素透過防止膜13Aが設けられているので、基板11から酸化物半導体膜15への酸素の供給が抑えられ、第1配線領域15Wの導電性を安定して維持することができる。
In the stacked
半導体装置1Aは、酸化物半導体膜15と第2配線18とが接する第1コンタクト部C1と、酸素透過防止膜13Aと第2配線18とが接する第2コンタクト部C2とを有している。この第1コンタクト部C1および第2コンタクト部C2により、酸素透過防止膜13Aと酸化物半導体膜15とが第2配線18を介して電気的に接続されている。第1コンタクト部C1では、基板11、酸素透過防止膜13A、絶縁層間膜14、酸化物半導体膜15および第2配線18がこの順に設けられている。第2コンタクト部C2では、基板11、酸素透過防止膜13Aおよび第2配線18がこの順に設けられている。半導体装置1Aでは、積層部10L、第1コンタクト部C1および第2コンタクト部C2がこの順に隣接して配置されている。
The semiconductor device 1A includes a first contact portion C1 where the
半導体装置1Aでは、積層部10Lに、保持容量素子の下部電極を延長させた酸素透過防止膜13Aが設けられているので、より簡便な方法で、安定した保持容量素子の下部電極と酸化物半導体膜15(第1配線領域15W)とのコンタクト構造を形成することができる。
In the semiconductor device 1A, since the oxygen permeation
例えば、積層部10Lに酸素透過防止膜13Aが設けられていない場合には、第1配線領域15Wの導電性を安定して維持することができないので、第2配線18を酸化物半導体膜15に重ねて配置することができない。このため、保持容量素子の下部電極と酸化物半導体膜15とを接続するためには、複数のフォトリソグラフィ工程が必要となり、製造工程が煩雑となる。
For example, when the oxygen permeation
これに対し、半導体装置1Aでは、積層部10Lに、保持容量素子の下部電極を延長させた酸素透過防止膜13Aが設けられているので、積層部10Lでの第1配線領域15Wの導電性が安定して維持される。したがって、フォトリソグラフィ工程を増加させることなく、保持容量素子の下部電極と酸化物半導体膜15(第1配線領域15W)とを電気的に接続させることができる。よって、より簡便な方法で、安定した保持容量素子の下部電極と第1配線領域15Wとのコンタクト構造を形成することができる。
In contrast, in the semiconductor device 1A, since the oxygen permeation
また、積層部10L、第1コンタクト部C1および第2コンタクト部C2を隣接して配置することにより、コンタクト面積の増加を抑えることができる。
Further, by arranging the stacked
半導体装置1Aにおいても、積層部10Lに酸素透過防止膜13Aが設けられているので、上記半導体装置1と同様に、酸化物半導体膜15と第2配線18とをより自由に配置して設計の自由度を高めることが可能となる。また、酸素透過防止膜13Aの一部は、電子素子の構成要素として機能し、より簡便な方法で酸素透過防止膜13Aと酸化物半導体膜15(第1配線領域15W)とのコンタクト構造を形成することができる。
Also in the semiconductor device 1A, since the oxygen permeation
<変形例2>
図6は上記実施の形態の変形例2に係る半導体装置(半導体装置1B)の断面構成を模式的に表している。この半導体装置1Bは、ボトムゲート型のトランジスタ(トランジスタ10TB)を有している。この点を除き、半導体装置1Bは上記実施の形態の半導体装置1と同様の構成を有し、その作用および効果も同様である。
<Modification 2>
FIG. 6 schematically illustrates a cross-sectional configuration of a semiconductor device (semiconductor device 1B) according to Modification 2 of the above embodiment. This semiconductor device 1B has a bottom-gate transistor (transistor 10TB). Except for this point, the semiconductor device 1B has the same configuration as the
半導体装置1Bは、基板11、ゲート電極17、ゲート絶縁膜16、酸化物半導体膜15、絶縁層間膜14、酸素透過防止膜13および絶縁膜12をこの順に有している。積層部10Lでは、ゲート電極17と同層に第2配線18が設けられており、酸素透過防止膜13が絶縁層間膜14と絶縁膜12との間に配置されている。
The semiconductor device 1B includes a
このような半導体装置1Bも、上記半導体装置1と同様に、積層部10Lに酸素透過防止膜13が設けられているので、上層(絶縁膜12)から第1配線領域15Wへの酸素の供給が抑えられる。よって、積層部10Lでの第1配線領域15Wの導電性が安定して維持され、設計の自由度を高めることが可能となる。
Similarly to the
<適用例1>
上記実施の形態および変形例において説明した半導体装置(半導体装置1,1A,1B)は、例えば表示装置(後述の図7の表示装置2A)および撮像装置(後述の図8の撮像装置2B)等の駆動回路に用いることができる。
<Application example 1>
The semiconductor devices (
図7は、表示装置2Aの機能ブロック構成を示したものである。表示装置2Aは、外部から入力された映像信号あるいは内部で生成した映像信号を、映像として表示するものであり、上述した有機ELディスプレイの他にも、例えば液晶ディスプレイなどにも適用される。表示装置2Aは、例えばタイミング制御部21と、信号処理部22と、駆動部23と、表示画素部24とを備えている。
FIG. 7 shows a functional block configuration of the
タイミング制御部21は、各種のタイミング信号(制御信号)を生成するタイミングジェネレータを有しており、これらの各種のタイミング信号を基に、信号処理部22等の駆動制御を行うものである。信号処理部22は、例えば、外部から入力されたデジタルの映像信号に対して所定の補正を行い、それにより得られた映像信号を駆動部23に出力するものである。駆動部23は、例えば走査線駆動回路および信号線駆動回路などを含んで構成され、各種制御線を介して表示画素部24の各画素を駆動するものである。表示画素部24は、例えば有機EL素子または液晶表示素子等の表示素子と、表示素子を画素毎に駆動するための画素回路とを含んで構成されている。これらのうち、例えば、駆動部23または表示画素部24の一部を構成する各種回路に、上述の半導体装置が用いられる。
The
図8は、撮像装置2Bの機能ブロック構成を示したものである。撮像装置2Bは、例えば画像を電気信号として取得する固体撮像装置であり、例えばCCD(Charge Coupled Device)またはCMOS(Complementary Metal Oxide Semiconductor)イメージセンサなどから構成されている。撮像装置2Bは、例えばタイミング制御部25と、駆動部26と、撮像画素部27と、信号処理部28とを備えている。
FIG. 8 shows a functional block configuration of the
タイミング制御部25は、各種のタイミング信号(制御信号)を生成するタイミングジェネレータを有しており、これらの各種のタイミング信号を基に、駆動部26の駆動制御を行うものである。駆動部26は、例えば行選択回路、AD変換回路および水平転送走査回路などを含んで構成され、各種制御線を介して撮像画素部27の各画素から信号を読み出す駆動を行うものである。撮像画素部27は、例えばフォトダイオードなどの撮像素子(光電変換素子)と、信号読み出しのための画素回路とを含んで構成されている。信号処理部28は、撮像画素部27から得られた信号に対して様々な信号処理を施すものである。これらのうち、例えば、駆動部26または撮像画素部27の一部を構成する各種回路に、上述の半導体装置が用いられる。
The
<電子機器の例>
上記表示装置2Aおよび撮像装置2B等は、様々なタイプの電子機器に用いることができる。図9に、電子機器3の機能ブロック構成を示す。電子機器3としては、例えばテレビジョン装置、パーソナルコンピュータ(PC)、スマートフォン、タブレット型PC、携帯電話機、デジタルスチルカメラおよびデジタルビデオカメラ等が挙げられる。
<Examples of electronic devices>
The
電子機器3は、例えば上述の表示装置2A(または撮像装置2B)と、インターフェース部30とを有している。インターフェース部30は、外部から各種の信号および電源等が入力される入力部である。このインターフェース部30は、また、例えばタッチパネル、キーボードまたは操作ボタン等のユーザインターフェースを含んでいてもよい。
The electronic device 3 includes, for example, the above-described
以上、実施の形態等を挙げて説明したが、本技術は上記実施の形態等に限定されるものではなく、種々変形が可能である。例えば、上記実施の形態等に記載した各層の材料および厚みは列挙したものに限定されるものではなく、他の材料および厚みとしてもよい。 Although the embodiments have been described above, the present technology is not limited to the above-described embodiments and the like, and various modifications are possible. For example, the material and thickness of each layer described in the above embodiment and the like are not limited to those listed, and may be other materials and thicknesses.
また、図2では、酸素透過防止膜13の幅が酸化物半導体膜15の幅よりも小さくなっている場合を示したが、図10に示したように、酸素透過防止膜13の幅が酸化物半導体膜15の幅よりも大きくなっていてもよい。
2 shows the case where the width of the oxygen permeation
更に、上記実施の形態等では、本技術の「第1配線」の一具体例として、酸化物半導体膜15の第1配線領域15Wを用いて説明したが、本技術の「第1配線」は、チャネル領域15Tが設けられた酸化物半導体膜15とは分離して設けられていてもよい。
Furthermore, in the above-described embodiment and the like, the
加えて、上記実施の形態等では、ゲート絶縁膜16が基板11の全面にわたって設けられている場合について説明したが、チャネル領域とゲート電極との間のゲート絶縁膜と、第1配線と第2配線との間の絶縁膜(第3絶縁膜)とが分離して設けられていてもよい。
In addition, in the above-described embodiment and the like, the case where the
上記実施の形態等において説明した効果は一例であり、本開示の効果は、他の効果であってもよいし、更に他の効果を含んでいてもよい。 The effects described in the above-described embodiments and the like are examples, and the effects of the present disclosure may be other effects or may include other effects.
尚、本技術は以下のような構成を取ることも可能である。
(1)
ゲート電極および前記ゲート電極に対向する酸化物半導体膜のチャネル領域を有するトランジスタと、
前記酸化物半導体膜と同層に設けられ、前記酸化物半導体膜と同一の構成材料を含む第1配線と、
前記ゲート電極と同層に設けられた第2配線と、
前記第1配線を間にして前記第2配線に対向する酸素透過防止膜および前記酸素透過防止膜と前記第1配線との間の第1絶縁膜を含む積層部と
を備えた半導体装置。
(2)
更に、第2絶縁膜を有し、
前記積層部では、前記第2絶縁膜、前記酸素透過防止膜および前記第1絶縁膜がこの順に設けられている
前記(1)記載の半導体装置。
(3)
前記トランジスタは、更に、前記酸化物半導体膜と前記ゲート電極との間のゲート絶縁膜を含み、
前記積層部には、更に、前記第1配線と前記第2配線との間に、前記ゲート絶縁膜と同層の第3絶縁膜が設けられている
前記(2)記載の半導体装置。
(4)
更に、基板を有し、
前記積層部では、前記基板上に、前記第2絶縁膜、前記酸素透過防止膜、前記第1絶縁膜、前記第1配線、前記第3絶縁膜および前記第2配線がこの順に設けられている
前記(3)記載の半導体装置。
(5)
前記第1配線と前記第2配線とは互いに交差する方向に延在している
前記(1)乃至(4)のいずれか1つに記載の半導体装置。
(6)
更に、保持容量素子を有し、
前記酸素透過防止膜の一部が、前記保持容量素子の一方の電極を構成する
前記(1)乃至(5)のいずれか1つに記載の半導体装置。
(7)
更に、前記第1配線と前記第2配線とが接する第1コンタクト部と、
前記酸素透過防止膜と前記第2配線とが接する第2コンタクト部とを含む
前記(6)記載の半導体装置。
(8)
前記積層部、前記第1コンタクト部および前記第2コンタクト部がこの順に隣接して配置されている
前記(7)記載の半導体装置。
(9)
前記酸素透過防止膜は金属を含む
前記(1)乃至(8)のいずれか1つに記載の半導体装置。
(10)
前記第2配線は、前記ゲート電極と同一の構成材料を含み、かつ、前記ゲート電極と同一の厚みを有する
前記(1)乃至(9)のいずれか1つに記載の半導体装置。
(11)
前記第1配線は、前記酸化物半導体膜と同一の厚みを有する
前記(1)乃至(10)のいずれか1つに記載の半導体装置。
(12)
前記第1配線は、前記酸化物半導体膜のうちの低抵抗化された領域により構成されている
前記(1)乃至(11)のいずれか1つに記載の半導体装置。
(13)
表示素子および前記表示素子を駆動する半導体装置を備え、
前記半導体装置は、
ゲート電極および前記ゲート電極に対向する酸化物半導体膜のチャネル領域を有するトランジスタと、
前記酸化物半導体膜と同層に設けられ、前記酸化物半導体膜と同一の構成材料を含む第1配線と、
前記ゲート電極と同層に設けられた第2配線と、
前記第1配線を間にして前記第2配線に対向する酸素透過防止膜および前記酸素透過防止膜と前記第1配線との間の第1絶縁膜を含む積層部とを含む
表示装置。
(14)
表示素子および前記表示素子を駆動する半導体装置を備え、
前記半導体装置は、
ゲート電極および前記ゲート電極に対向する酸化物半導体膜のチャネル領域を有するトランジスタと、
前記酸化物半導体膜と同層に設けられ、前記酸化物半導体膜と同一の構成材料を含む第1配線と、
前記ゲート電極と同層に設けられた第2配線と、
前記第1配線を間にして前記第2配線に対向する酸素透過防止膜および前記酸素透過防止膜と前記第1配線との間の第1絶縁膜を含む積層部とを含む
表示装置を有する電子機器。
In addition, this technique can also take the following structures.
(1)
A transistor having a gate electrode and a channel region of an oxide semiconductor film facing the gate electrode;
A first wiring provided in the same layer as the oxide semiconductor film and including the same constituent material as the oxide semiconductor film;
A second wiring provided in the same layer as the gate electrode;
A semiconductor device comprising: an oxygen permeation prevention film facing the second wiring with the first wiring interposed therebetween; and a stacked portion including a first insulating film between the oxygen permeation prevention film and the first wiring.
(2)
Furthermore, it has a second insulating film,
The semiconductor device according to (1), wherein the second insulating film, the oxygen permeation prevention film, and the first insulating film are provided in this order in the stacked portion.
(3)
The transistor further includes a gate insulating film between the oxide semiconductor film and the gate electrode,
The semiconductor device according to (2), wherein the stacked portion is further provided with a third insulating film in the same layer as the gate insulating film between the first wiring and the second wiring.
(4)
Furthermore, it has a substrate,
In the stacked portion, the second insulating film, the oxygen permeation preventive film, the first insulating film, the first wiring, the third insulating film, and the second wiring are provided in this order on the substrate. The semiconductor device according to (3).
(5)
The semiconductor device according to any one of (1) to (4), wherein the first wiring and the second wiring extend in a direction crossing each other.
(6)
Furthermore, it has a storage capacitor element,
The semiconductor device according to any one of (1) to (5), wherein a part of the oxygen permeation prevention film constitutes one electrode of the storage capacitor element.
(7)
A first contact portion where the first wiring and the second wiring are in contact;
The semiconductor device according to (6), including a second contact portion where the oxygen permeation preventive film and the second wiring are in contact with each other.
(8)
The semiconductor device according to (7), wherein the stacked portion, the first contact portion, and the second contact portion are adjacently disposed in this order.
(9)
The semiconductor device according to any one of (1) to (8), wherein the oxygen permeation prevention film includes a metal.
(10)
The semiconductor device according to any one of (1) to (9), wherein the second wiring includes the same constituent material as the gate electrode and has the same thickness as the gate electrode.
(11)
The semiconductor device according to any one of (1) to (10), wherein the first wiring has the same thickness as the oxide semiconductor film.
(12)
The semiconductor device according to any one of (1) to (11), wherein the first wiring is configured by a low resistance region of the oxide semiconductor film.
(13)
A display device and a semiconductor device for driving the display device;
The semiconductor device includes:
A transistor having a gate electrode and a channel region of an oxide semiconductor film facing the gate electrode;
A first wiring provided in the same layer as the oxide semiconductor film and including the same constituent material as the oxide semiconductor film;
A second wiring provided in the same layer as the gate electrode;
A display device comprising: an oxygen permeation prevention film facing the second wiring with the first wiring interposed therebetween; and a stacked portion including a first insulating film between the oxygen permeation prevention film and the first wiring.
(14)
A display device and a semiconductor device for driving the display device;
The semiconductor device includes:
A transistor having a gate electrode and a channel region of an oxide semiconductor film facing the gate electrode;
A first wiring provided in the same layer as the oxide semiconductor film and including the same constituent material as the oxide semiconductor film;
A second wiring provided in the same layer as the gate electrode;
An electron having a display device, comprising: an oxygen permeation preventive film facing the second interconnect with the first interconnect in between; and a stacked portion including a first insulating film between the oxygen permeation preventive film and the first interconnect machine.
1,1A,1B…半導体装置、10T,10TB…トランジスタ、10L…積層部、11…基板、12…絶縁膜、13,13A…酸素透過防止膜、14…絶縁層間膜、15…酸化物半導体膜、15T…チャネル領域、15W…第1配線領域、16…ゲート絶縁膜、17…ゲート電極、18…第2配線、2A…表示装置、2B…撮像装置、3…電子機器、21,25…タイミング制御部、22,28…信号処理部、23,26…駆動部、24…表示画素部、27…撮像画素部、30…インターフェース部。
DESCRIPTION OF
Claims (14)
前記酸化物半導体膜と同層に設けられ、前記酸化物半導体膜と同一の構成材料を含む第1配線と、
前記ゲート電極と同層に設けられた第2配線と、
前記第1配線を間にして前記第2配線に対向する酸素透過防止膜および前記酸素透過防止膜と前記第1配線との間の第1絶縁膜を含む積層部と
を備えた半導体装置。 A transistor having a gate electrode and a channel region of an oxide semiconductor film facing the gate electrode;
A first wiring provided in the same layer as the oxide semiconductor film and including the same constituent material as the oxide semiconductor film;
A second wiring provided in the same layer as the gate electrode;
A semiconductor device comprising: an oxygen permeation prevention film facing the second wiring with the first wiring interposed therebetween; and a stacked portion including a first insulating film between the oxygen permeation prevention film and the first wiring.
前記積層部では、前記第2絶縁膜、前記酸素透過防止膜および前記第1絶縁膜がこの順に設けられている
請求項1記載の半導体装置。 Furthermore, it has a second insulating film,
The semiconductor device according to claim 1, wherein in the stacked portion, the second insulating film, the oxygen permeation prevention film, and the first insulating film are provided in this order.
前記積層部には、更に、前記第1配線と前記第2配線との間に、前記ゲート絶縁膜と同層の第3絶縁膜が設けられている
請求項2記載の半導体装置。 The transistor further includes a gate insulating film between the oxide semiconductor film and the gate electrode,
The semiconductor device according to claim 2, wherein a third insulating film in the same layer as the gate insulating film is further provided in the stacked portion between the first wiring and the second wiring.
前記積層部では、前記基板上に、前記第2絶縁膜、前記酸素透過防止膜、前記第1絶縁膜、前記第1配線、前記第3絶縁膜および前記第2配線がこの順に設けられている
請求項3記載の半導体装置。 Furthermore, it has a substrate,
In the stacked portion, the second insulating film, the oxygen permeation preventive film, the first insulating film, the first wiring, the third insulating film, and the second wiring are provided in this order on the substrate. The semiconductor device according to claim 3.
請求項1記載の半導体装置。 The semiconductor device according to claim 1, wherein the first wiring and the second wiring extend in a direction crossing each other.
前記酸素透過防止膜の一部が、前記保持容量素子の一方の電極を構成する
請求項1記載の半導体装置。 Furthermore, it has a storage capacitor element,
The semiconductor device according to claim 1, wherein a part of the oxygen permeation prevention film constitutes one electrode of the storage capacitor element.
前記酸素透過防止膜と前記第2配線とが接する第2コンタクト部とを含む
請求項6記載の半導体装置。 A first contact portion where the first wiring and the second wiring are in contact;
The semiconductor device according to claim 6, further comprising a second contact portion where the oxygen permeation preventive film and the second wiring are in contact with each other.
請求項7記載の半導体装置。 The semiconductor device according to claim 7, wherein the stacked portion, the first contact portion, and the second contact portion are adjacently disposed in this order.
請求項1記載の半導体装置。 The semiconductor device according to claim 1, wherein the oxygen permeation prevention film includes a metal.
請求項1記載の半導体装置。 The semiconductor device according to claim 1, wherein the second wiring includes the same constituent material as that of the gate electrode and has the same thickness as the gate electrode.
請求項1記載の半導体装置。 The semiconductor device according to claim 1, wherein the first wiring has the same thickness as the oxide semiconductor film.
請求項1記載の半導体装置。 The semiconductor device according to claim 1, wherein the first wiring is configured by a low resistance region of the oxide semiconductor film.
前記半導体装置は、
ゲート電極および前記ゲート電極に対向する酸化物半導体膜のチャネル領域を有するトランジスタと、
前記酸化物半導体膜と同層に設けられ、前記酸化物半導体膜と同一の構成材料を含む第1配線と、
前記ゲート電極と同層に設けられた第2配線と、
前記第1配線を間にして前記第2配線に対向する酸素透過防止膜および前記酸素透過防止膜と前記第1配線との間の第1絶縁膜を含む積層部とを含む
表示装置。 A display device and a semiconductor device for driving the display device;
The semiconductor device includes:
A transistor having a gate electrode and a channel region of an oxide semiconductor film facing the gate electrode;
A first wiring provided in the same layer as the oxide semiconductor film and including the same constituent material as the oxide semiconductor film;
A second wiring provided in the same layer as the gate electrode;
A display device comprising: an oxygen permeation prevention film facing the second wiring with the first wiring interposed therebetween; and a stacked portion including a first insulating film between the oxygen permeation prevention film and the first wiring.
前記半導体装置は、
ゲート電極および前記ゲート電極に対向する酸化物半導体膜のチャネル領域を有するトランジスタと、
前記酸化物半導体膜と同層に設けられ、前記酸化物半導体膜と同一の構成材料を含む第1配線と、
前記ゲート電極と同層に設けられた第2配線と、
前記第1配線を間にして前記第2配線に対向する酸素透過防止膜および前記酸素透過防止膜と前記第1配線との間の第1絶縁膜を含む積層部とを含む
表示装置を有する電子機器。 A display device and a semiconductor device for driving the display device;
The semiconductor device includes:
A transistor having a gate electrode and a channel region of an oxide semiconductor film facing the gate electrode;
A first wiring provided in the same layer as the oxide semiconductor film and including the same constituent material as the oxide semiconductor film;
A second wiring provided in the same layer as the gate electrode;
An electron having a display device, comprising: an oxygen permeation preventive film facing the second interconnect with the first interconnect in between; and a stacked portion including a first insulating film between the oxygen permeation preventive film and the first interconnect machine.
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|---|---|
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Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2020025032A (en) * | 2018-08-08 | 2020-02-13 | 株式会社ジャパンディスプレイ | Thin film transistor and electronic circuit |
Citations (13)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008176262A (en) * | 2006-03-20 | 2008-07-31 | Canon Inc | Light control device and image display device |
| JP2010156963A (en) * | 2008-12-05 | 2010-07-15 | Semiconductor Energy Lab Co Ltd | Semiconductor device |
| JP2010177223A (en) * | 2009-01-27 | 2010-08-12 | Videocon Global Ltd | Liquid crystal display device and method of manufacturing the same |
| WO2011135873A1 (en) * | 2010-04-28 | 2011-11-03 | シャープ株式会社 | Shift register and display device |
| JP2013168644A (en) * | 2012-01-20 | 2013-08-29 | Semiconductor Energy Lab Co Ltd | Semiconductor device and manufacturing method of the same |
| JP2014107453A (en) * | 2012-11-28 | 2014-06-09 | Fujifilm Corp | Oxide semiconductor element, method for manufacturing oxide semiconductor element, display device, and image sensor |
| JP2014135378A (en) * | 2013-01-10 | 2014-07-24 | Japan Display Inc | Semiconductor device and display device |
| JP2015108731A (en) * | 2013-12-05 | 2015-06-11 | ソニー株式会社 | Semiconductor device and manufacturing method thereof, and display device and electronic apparatus |
| JP2015138867A (en) * | 2014-01-22 | 2015-07-30 | 株式会社ジャパンディスプレイ | Thin film transistor mounting substrate manufacturing method |
| WO2015186619A1 (en) * | 2014-06-06 | 2015-12-10 | シャープ株式会社 | Semiconductor device, display device and method for manufacturing semiconductor device |
| US20160372497A1 (en) * | 2015-06-19 | 2016-12-22 | Lg Display Co., Ltd. | Thin film transistor substrate and display device using the same |
| JP2017531322A (en) * | 2014-12-16 | 2017-10-19 | エルジー ディスプレイ カンパニー リミテッド | Thin film transistor array substrate |
| WO2017195699A1 (en) * | 2016-05-10 | 2017-11-16 | シャープ株式会社 | Active matrix substrate, method for producing same, and display device |
-
2017
- 2017-01-12 JP JP2017003486A patent/JP6811096B2/en active Active
Patent Citations (13)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008176262A (en) * | 2006-03-20 | 2008-07-31 | Canon Inc | Light control device and image display device |
| JP2010156963A (en) * | 2008-12-05 | 2010-07-15 | Semiconductor Energy Lab Co Ltd | Semiconductor device |
| JP2010177223A (en) * | 2009-01-27 | 2010-08-12 | Videocon Global Ltd | Liquid crystal display device and method of manufacturing the same |
| WO2011135873A1 (en) * | 2010-04-28 | 2011-11-03 | シャープ株式会社 | Shift register and display device |
| JP2013168644A (en) * | 2012-01-20 | 2013-08-29 | Semiconductor Energy Lab Co Ltd | Semiconductor device and manufacturing method of the same |
| JP2014107453A (en) * | 2012-11-28 | 2014-06-09 | Fujifilm Corp | Oxide semiconductor element, method for manufacturing oxide semiconductor element, display device, and image sensor |
| JP2014135378A (en) * | 2013-01-10 | 2014-07-24 | Japan Display Inc | Semiconductor device and display device |
| JP2015108731A (en) * | 2013-12-05 | 2015-06-11 | ソニー株式会社 | Semiconductor device and manufacturing method thereof, and display device and electronic apparatus |
| JP2015138867A (en) * | 2014-01-22 | 2015-07-30 | 株式会社ジャパンディスプレイ | Thin film transistor mounting substrate manufacturing method |
| WO2015186619A1 (en) * | 2014-06-06 | 2015-12-10 | シャープ株式会社 | Semiconductor device, display device and method for manufacturing semiconductor device |
| JP2017531322A (en) * | 2014-12-16 | 2017-10-19 | エルジー ディスプレイ カンパニー リミテッド | Thin film transistor array substrate |
| US20160372497A1 (en) * | 2015-06-19 | 2016-12-22 | Lg Display Co., Ltd. | Thin film transistor substrate and display device using the same |
| WO2017195699A1 (en) * | 2016-05-10 | 2017-11-16 | シャープ株式会社 | Active matrix substrate, method for producing same, and display device |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2020025032A (en) * | 2018-08-08 | 2020-02-13 | 株式会社ジャパンディスプレイ | Thin film transistor and electronic circuit |
| WO2020031488A1 (en) * | 2018-08-08 | 2020-02-13 | 株式会社ジャパンディスプレイ | Thin film transistor and electronic circuit |
| JP7153497B2 (en) | 2018-08-08 | 2022-10-14 | 株式会社ジャパンディスプレイ | electronic circuit |
Also Published As
| Publication number | Publication date |
|---|---|
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| JP2017049568A (en) | Semiconductor device, display device, display device manufacturing method, and electronic apparatus | |
| US10886411B2 (en) | Semiconductor device and display unit | |
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