JP2018098247A - Manufacturing method of multilayer ceramic electronic component - Google Patents
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Abstract
Description
本発明は、積層セラミック電子部品の製造方法に関する。 The present invention relates to a method for manufacturing a multilayer ceramic electronic component.
積層セラミック電子部品の一例として、積層セラミックコンデンサが挙げられる。積層セラミックコンデンサを製造するためには、例えば、内部電極が形成されたセラミックグリーンシートを積層し、得られた生の部品本体を焼成した後、焼結した部品本体の相対向する端面に外部電極を形成する。これによって、両側の端面に引き出された内部電極が外部電極と電気的に接続された積層セラミックコンデンサが得られる。 An example of the multilayer ceramic electronic component is a multilayer ceramic capacitor. In order to manufacture a multilayer ceramic capacitor, for example, a ceramic green sheet on which internal electrodes are formed is laminated, and the raw component body obtained is fired, and then external electrodes are formed on opposite end surfaces of the sintered component body. Form. As a result, a multilayer ceramic capacitor is obtained in which the internal electrodes drawn out on both end faces are electrically connected to the external electrodes.
近年、電子部品の小型化及び高機能化に伴い、積層セラミックコンデンサには、小型化及び高容量化が求められている。積層セラミックコンデンサの小型化及び高容量化を実現するためには、セラミックグリーンシート上を占有する内部電極の有効面積、つまり、互いに対向する内部電極の面積を大きくすることが有効である。 In recent years, with the miniaturization and high functionality of electronic components, multilayer ceramic capacitors are required to be small and have high capacity. In order to reduce the size and increase the capacity of the multilayer ceramic capacitor, it is effective to increase the effective area of the internal electrodes occupying the ceramic green sheet, that is, the area of the internal electrodes facing each other.
例えば、特許文献1には、積層された複数のセラミックグリーンシートと、上記セラミックグリーンシート間の複数の界面に沿ってそれぞれ配置された内部電極パターンとを含む、マザーブロックを作製する工程と、上記マザーブロックを互いに直交する第1方向の切断線および第2方向の切断線に沿って切断することによって、生の状態にある複数のセラミック層と複数の内部電極とをもって構成された積層構造を有し、かつ上記第1方向の切断線に沿う切断によって現れた切断側面に上記内部電極が露出した状態にある、複数のグリーンチップを得る工程と、上記切断側面にセラミックペーストを塗布して、生のセラミック保護層を形成することによって、生の部品本体を得る工程と、上記生の部品本体を焼成する工程とを備える積層セラミック電子部品の製造方法が開示されている。 For example, Patent Document 1 includes a step of producing a mother block including a plurality of laminated ceramic green sheets and internal electrode patterns respectively disposed along a plurality of interfaces between the ceramic green sheets; By cutting the mother block along a cutting line in the first direction and a cutting line in the second direction orthogonal to each other, the mother block has a laminated structure composed of a plurality of ceramic layers and a plurality of internal electrodes in a raw state. And a step of obtaining a plurality of green chips in which the internal electrode is exposed on a cut side surface that appears by cutting along the cutting line in the first direction, and applying a ceramic paste to the cut side surface, Forming a ceramic protective layer, and obtaining a raw component body, and firing the raw component body. Mick method of manufacturing an electronic component is disclosed.
特許文献1に記載の方法では、側面に内部電極が露出するようにマザーブロックを切断することによって、互いに対向する内部電極の面積を大きくしている。しかし、マザーブロックの切断にはダイシング等の方法が用いられており、切断時の応力によって内部電極が垂れてしまうため、内部電極間の距離が短くなるほど、内部電極が層間をまたがって接触する箇所(以下、短絡箇所ともいう)が切断側面に発生しやすくなる。さらに、切断時の応力によって、切断側面が粗くなりやすい。このような状態でチップ部品を作製すると、脱脂後の段階でのショート不良率が増加してしまう。以上より、高容量の積層セラミックコンデンサを製造する方法において、良好な切断側面を得ることは困難であった。 In the method described in Patent Document 1, the area of the internal electrodes facing each other is increased by cutting the mother block so that the internal electrodes are exposed on the side surfaces. However, a method such as dicing is used for cutting the mother block, and the internal electrodes hang down due to the stress at the time of cutting. Therefore, the shorter the distance between the internal electrodes, the more the internal electrodes are in contact across the layers. (Hereinafter, also referred to as a short-circuit portion) is likely to occur on the cut side surface. Furthermore, the cut side surface is likely to be rough due to stress during cutting. If a chip component is manufactured in such a state, the short-circuit defect rate at the stage after degreasing increases. From the above, it has been difficult to obtain a good cut side face in the method for producing a high-capacity multilayer ceramic capacitor.
なお、上記の問題は、積層セラミックコンデンサを製造する場合に限らず、積層セラミックコンデンサ以外の積層セラミック電子部品を製造する場合に共通する問題である。 The above problem is not limited to the case of manufacturing a multilayer ceramic capacitor, but is a problem common to the case of manufacturing a multilayer ceramic electronic component other than the multilayer ceramic capacitor.
本発明は上記の問題を解決するためになされたものであり、良好な切断側面を有する積層セラミック電子部品の製造方法を提供することを目的とする。 The present invention has been made to solve the above problems, and an object of the present invention is to provide a method for producing a multilayer ceramic electronic component having a good cut side surface.
本発明の積層セラミック電子部品の製造方法は、第1の態様において、積層された複数のセラミックグリーンシートと、上記セラミックグリーンシート間の複数の界面に沿ってそれぞれ配置された内部電極パターンとを含む、マザーブロックを作製する工程と、上記マザーブロックを互いに直交する第1方向の切断線及び第2方向の切断線に沿って切断することによって、生の状態にある複数のセラミック層と複数の内部電極とをもって構成された積層構造を有し、かつ上記第1方向の切断線に沿う切断によって現れた切断側面に上記内部電極が露出した、複数のグリーンチップを得る工程と、上記切断側面に対して、バイトを用いた切削処理を行う工程と、上記切削処理後の切断側面に生のセラミック保護層を形成することによって、生の部品本体を得る工程と、上記生の部品本体を焼成する工程と、を備えることを特徴とする。 In the first aspect, the method for manufacturing a multilayer ceramic electronic component of the present invention includes a plurality of laminated ceramic green sheets, and internal electrode patterns respectively disposed along a plurality of interfaces between the ceramic green sheets. A step of fabricating a mother block, and cutting the mother block along a cutting line in a first direction and a cutting line in a second direction orthogonal to each other, thereby providing a plurality of ceramic layers in a raw state and a plurality of interiors And a step of obtaining a plurality of green chips, wherein the internal electrode is exposed on a cut side surface that appears by cutting along the cutting line in the first direction, A cutting process using a cutting tool and forming a raw ceramic protective layer on the cut side surface after the cutting process, Characterized in that it comprises a step of obtaining the goods body, a step of firing the raw component body.
本発明の第1の態様では、内部電極が露出しているグリーンチップの切断側面に対して、バイトを用いた切削処理を行うことにより、切断時に発生した内部電極の垂れを除去することができるため、短絡箇所の発生を防止することができる。その結果、良好な切断側面を得ることができる。 In the first aspect of the present invention, the sagging of the internal electrode generated during cutting can be removed by performing a cutting process using a cutting tool on the cut side surface of the green chip where the internal electrode is exposed. Therefore, it is possible to prevent the occurrence of a short circuit location. As a result, a good cut side surface can be obtained.
本発明の積層セラミック電子部品の製造方法は、第1の態様において、上記切削処理を行う工程の前に、行及び列方向に配列された複数の上記グリーンチップの互いの間隔を広げた状態で、複数の上記グリーンチップを転動させることによって、複数の上記グリーンチップの各々の上記切断側面を揃って開放面とする工程をさらに備え、上記開放面とされた上記切断側面に対して上記切削処理を行うことが好ましい。この場合、切断側面に対する切削処理、及び、セラミック保護層の形成を効率的に行うことができる。 In the first aspect of the method for manufacturing a multilayer ceramic electronic component according to the present invention, in the first aspect, the plurality of green chips arranged in the row and column directions are spaced apart from each other before the step of performing the cutting process. The method further comprises a step of rolling the plurality of green chips to align the cut side surfaces of each of the plurality of green chips into an open surface, and cutting the cut side surface as the open surface. It is preferable to carry out the treatment. In this case, it is possible to efficiently perform the cutting process on the cut side surface and the formation of the ceramic protective layer.
本発明の積層セラミック電子部品の製造方法は、第2の態様において、積層された複数のセラミックグリーンシートと、上記セラミックグリーンシート間の複数の界面に沿ってそれぞれ配置された内部電極パターンとを含む、マザーブロックを作製する工程と、上記マザーブロックを第1方向の切断線に沿って切断することによって、生の状態にある複数のセラミック層と複数の内部電極とをもって構成された積層構造を有し、かつ上記第1方向の切断線に沿う切断によって現れた切断側面に上記内部電極が露出した、複数の棒状のグリーンブロック体を得る工程と、上記切断側面に対して、バイトを用いた切削処理を行う工程と、上記切削処理後の切断側面に生のセラミック保護層を形成する工程と、上記生のセラミック保護層が形成された上記棒状のグリーンブロック体を、上記第1方向に直交する第2方向の切断線に沿って切断することによって、複数の生の部品本体を得る工程と、上記生の部品本体を焼成する工程と、を備えることを特徴とする。 In the second aspect, the method for producing a multilayer ceramic electronic component of the present invention includes a plurality of laminated ceramic green sheets, and internal electrode patterns respectively disposed along a plurality of interfaces between the ceramic green sheets. And a step of producing a mother block and a laminated structure composed of a plurality of ceramic layers and a plurality of internal electrodes in a raw state by cutting the mother block along a cutting line in a first direction. And a step of obtaining a plurality of rod-shaped green block bodies in which the internal electrodes are exposed on a cut side surface that appears by cutting along the cutting line in the first direction, and cutting using a cutting tool on the cut side surface Forming a raw ceramic protective layer on the cut side surface after the cutting treatment, and forming the raw ceramic protective layer. A step of obtaining a plurality of raw component bodies by cutting the rod-shaped green block body along a cutting line in a second direction orthogonal to the first direction; and a step of firing the raw component bodies; It is characterized by providing.
本発明の第2の態様では、内部電極が露出している棒状のグリーンブロック体の切断側面に対して、バイトを用いた切削処理を行うことにより、切断時に発生した内部電極の垂れを除去することができるため、短絡箇所の発生を防止することができる。その結果、良好な切断側面を得ることができる。 In the second aspect of the present invention, the sagging side surface of the rod-shaped green block body from which the internal electrode is exposed is subjected to a cutting process using a cutting tool, thereby removing the sagging of the internal electrode that has occurred during cutting. Therefore, the occurrence of a short circuit can be prevented. As a result, a good cut side surface can be obtained.
本発明の積層セラミック電子部品の製造方法は、第2の態様において、上記切削処理を行う工程の前に、所定方向に配列された複数の上記棒状のグリーンブロック体の互いの間隔を広げた状態で、複数の上記棒状のグリーンブロック体を転動させることによって、複数の上記棒状のグリーンブロック体の各々の上記切断側面を揃って開放面とする工程をさらに備え、上記開放面とされた上記切断側面に対して上記切削処理を行うことが好ましい。この場合、切断側面に対する切削処理、及び、セラミック保護層の形成を効率的に行うことができる。 In the second aspect of the manufacturing method of the multilayer ceramic electronic component of the present invention, in the second aspect, the plurality of rod-shaped green block bodies arranged in a predetermined direction are spaced apart from each other before the step of performing the cutting process. Then, by rolling the plurality of rod-shaped green block bodies, the method further comprises a step of aligning the cut side surfaces of the plurality of rod-shaped green block bodies to open surfaces, and forming the open surfaces. The cutting process is preferably performed on the cut side surface. In this case, it is possible to efficiently perform the cutting process on the cut side surface and the formation of the ceramic protective layer.
以下、本発明の第1の態様及び第2の態様を特に区別しない場合、単に「本発明の積層セラミック電子部品の製造方法」という。 Hereinafter, when the first aspect and the second aspect of the present invention are not particularly distinguished, they are simply referred to as “a method for producing a multilayer ceramic electronic component of the present invention”.
本発明の積層セラミック電子部品の製造方法において、上記切削処理は、上記バイト及び上記グリーンチップの少なくとも一方、又は、上記バイト及び上記棒状のグリーンブロック体の少なくとも一方を回転させて行われることが好ましい。 In the method for producing a multilayer ceramic electronic component of the present invention, the cutting treatment is preferably performed by rotating at least one of the cutting tool and the green chip, or at least one of the cutting tool and the rod-shaped green block body. .
本発明の積層セラミック電子部品の製造方法において、上記切削処理後の切断側面の表面粗さRaは、50nm以下であることが好ましい。切断側面の表面粗さを小さくすることにより、ショート不良率を低減させることができる。 In the method for producing a multilayer ceramic electronic component of the present invention, the surface roughness Ra of the cut side surface after the cutting treatment is preferably 50 nm or less. By reducing the surface roughness of the cut side surface, the short-circuit defect rate can be reduced.
本発明の積層セラミック電子部品の製造方法において、上記生のセラミック保護層は、セラミック保護層用グリーンシートを貼り付けるか、又は、セラミック保護層用ペーストを塗布することにより形成され、上記セラミック保護層用グリーンシート又は上記セラミック保護層用ペーストには、Mgが実質的に含有されていないことが好ましい。これまでに、Mgを含有するセラミック保護層用グリーンシート又はセラミック保護層用ペーストを用いて生のセラミック保護層を形成することによって、内部電極の端部に異相を形成してショート不良率を低減させる方法が知られている。これに対し、本発明の積層セラミック電子部品の製造方法では、セラミック保護層用グリーンシート又はセラミック保護層用ペーストにMgが実質的に含有されていなくても、ショート不良率を低減させることができる。 In the method for manufacturing a multilayer ceramic electronic component of the present invention, the raw ceramic protective layer is formed by attaching a green sheet for a ceramic protective layer or by applying a ceramic protective layer paste, The green sheet for ceramic or the paste for ceramic protective layer preferably contains substantially no Mg. To date, by forming a raw ceramic protective layer using a ceramic protective layer green sheet or ceramic protective layer paste containing Mg, a different phase is formed at the end of the internal electrode to reduce the short-circuit defect rate. The method of making it known is known. On the other hand, in the method for manufacturing a multilayer ceramic electronic component of the present invention, even if Mg is not substantially contained in the ceramic protective layer green sheet or the ceramic protective layer paste, the short-circuit defect rate can be reduced. .
本発明の積層セラミック電子部品の製造方法において、上記生のセラミック保護層は、セラミック保護層用ペーストを塗布することにより形成されることが好ましい。セラミック保護層用グリーンシートを貼り付ける方法に比べて、セラミック保護層用ペーストを塗布する方法の方が、生のセラミック保護層を形成する際にグリーンチップ又は棒状のグリーンブロック体に与えるダメージが少ない。したがって、ショート不良率をさらに低減させることができる。 In the method for manufacturing a multilayer ceramic electronic component of the present invention, the raw ceramic protective layer is preferably formed by applying a ceramic protective layer paste. Compared to the method of applying the ceramic protective layer green sheet, the method of applying the ceramic protective layer paste causes less damage to the green chip or rod-shaped green block body when forming the raw ceramic protective layer. . Therefore, the short-circuit defect rate can be further reduced.
本発明の積層セラミック電子部品の製造方法において、上記マザーブロックを作製するためのセラミックグリーンシートの厚みは、1μm以下であることが好ましい。本発明の積層セラミック電子部品の製造方法においては、内部電極の垂れを除去しているため、セラミックグリーンシートが薄い、つまり内部電極間の距離が短い場合であっても、短絡箇所の発生を防止することができる。 In the method for producing a multilayer ceramic electronic component of the present invention, the thickness of the ceramic green sheet for producing the mother block is preferably 1 μm or less. In the manufacturing method of the multilayer ceramic electronic component of the present invention, since the sagging of the internal electrode is removed, even when the ceramic green sheet is thin, that is, when the distance between the internal electrodes is short, occurrence of a short-circuited portion is prevented. can do.
本発明によれば、良好な切断側面を有する積層セラミック電子部品の製造方法を提供することができる。 ADVANTAGE OF THE INVENTION According to this invention, the manufacturing method of the laminated ceramic electronic component which has a favorable cut | disconnected side surface can be provided.
以下、本発明の積層セラミック電子部品の製造方法について説明する。
しかしながら、本発明は、以下の構成に限定されるものではなく、本発明の要旨を変更しない範囲において適宜変更して適用することができる。なお、以下において記載する本発明の個々の望ましい構成を2つ以上組み合わせたものもまた本発明である。
Hereinafter, the manufacturing method of the multilayer ceramic electronic component of the present invention will be described.
However, the present invention is not limited to the following configurations, and can be applied with appropriate modifications without departing from the scope of the present invention. Note that the present invention also includes a combination of two or more desirable configurations of the present invention described below.
本発明の積層セラミック電子部品の製造方法の一実施形態として、積層セラミックコンデンサの製造方法を例にとって説明する。なお、本発明の製造方法は、積層セラミックコンデンサ以外の積層セラミック電子部品にも適用することができる。 As an embodiment of the method for manufacturing a multilayer ceramic electronic component of the present invention, a method for manufacturing a multilayer ceramic capacitor will be described as an example. In addition, the manufacturing method of this invention is applicable also to multilayer ceramic electronic components other than a multilayer ceramic capacitor.
まず、本発明の積層セラミック電子部品の製造方法によって得られる積層セラミックコンデンサについて説明する。
図1は、本発明の積層セラミック電子部品の製造方法によって得られる積層セラミックコンデンサの一例を模式的に示す斜視図である。図2は、図1に示す積層セラミックコンデンサを構成する部品本体の一例を模式的に示す斜視図である。
First, a multilayer ceramic capacitor obtained by the method for producing a multilayer ceramic electronic component of the present invention will be described.
FIG. 1 is a perspective view schematically showing an example of a multilayer ceramic capacitor obtained by the method for manufacturing a multilayer ceramic electronic component of the present invention. FIG. 2 is a perspective view schematically showing an example of a component main body constituting the multilayer ceramic capacitor shown in FIG.
図1に示す積層セラミックコンデンサ11は、部品本体12を備えている。図2に示すように、部品本体12は、直方体状又は略直方体状をなしており、互いに対向する1対の主面13及び14と、互いに対向する1対の側面15及び16と、互いに対向する1対の端面17及び18とを有している。
A multilayer
図3は、図2に示す部品本体を作製するために準備されるグリーンチップの一例を模式的に示す斜視図である。
後述するように、図2に示す部品本体12は、図3に示すグリーンチップ19の互いに対向する1対の側面(以下、切断側面という)20及び21上に、生のセラミック保護層22及び23をそれぞれ形成したものを焼成することにより得られる。以後の説明において、焼成後の部品本体12におけるグリーンチップ19に由来する部分を積層部24と呼ぶことにする。
FIG. 3 is a perspective view schematically showing an example of a green chip prepared for producing the component main body shown in FIG.
As will be described later, the component
図2及び図3に示すように、部品本体12における積層部24は、主面13及び14の方向に延びかつ主面13及び14に直交する方向に積層された複数のセラミック層25と、セラミック層25間の界面に沿って形成された複数対の内部電極26及び27とをもって構成された積層構造を有している。部品本体12は、その側面15及び16をそれぞれ与えるように積層部24の切断側面20及び21上に配置される1対のセラミック保護層22及び23を有している。セラミック保護層22及び23の厚みは、互いに同じであることが好ましい。
As shown in FIGS. 2 and 3, the
なお、図1及び図2においては、説明の便宜のために、積層部24とセラミック保護層22及び23の各々との境界が明瞭に図示されているが、このような境界は明瞭に現れなくてもよい。
In FIGS. 1 and 2, for convenience of explanation, the boundary between the
図2及び図3に示すように、内部電極26と内部電極27とは、セラミック層25を介して互いに対向する。内部電極26と内部電極27とが対向することによって、電気的特性が発現する。すなわち、図1に示す積層セラミックコンデンサ11においては、静電容量が形成される。
As shown in FIGS. 2 and 3, the
内部電極26は、部品本体12の端面17に露出する露出端を持ち、内部電極27は、部品本体12の端面18に露出する露出端を持っている。一方、上述したセラミック保護層22及び23が配置されているため、内部電極26及び27は、部品本体12の側面15及び16には露出しない。
The
図1に示すように、積層セラミックコンデンサ11は、さらに、内部電極26及び27の各々の露出端にそれぞれ電気的に接続されるように、部品本体12の少なくとも1対の端面17及び18上にそれぞれ形成された、外部電極28及び29を備えている。
As shown in FIG. 1, the multilayer
外部電極28及び29は、部品本体12の少なくとも1対の端面17及び18上にそれぞれ形成されており、図1では、主面13及び14並びに側面15及び16の各一部にまで回り込んだ部分を有している。
The
内部電極を構成する導電材料としては、例えば、Ni、Cu、Ag、Pd、Ag−Pd合金、Au等を用いることができる。 For example, Ni, Cu, Ag, Pd, an Ag—Pd alloy, Au, or the like can be used as the conductive material constituting the internal electrode.
セラミック層及びセラミック保護層を構成するセラミック材料としては、例えば、BaTiO3、CaTiO3、SrTiO3、CaZrO3等を主成分とする誘電体セラミックを用いることができる。 As the ceramic material constituting the ceramic layer and the ceramic protective layer, for example, a dielectric ceramic mainly composed of BaTiO 3 , CaTiO 3 , SrTiO 3 , CaZrO 3, or the like can be used.
セラミック保護層を構成するセラミック材料は、セラミック層を構成するセラミック材料と少なくとも主成分が同じであることが好ましい。この場合、同じ組成のセラミック材料がセラミック層とセラミック保護層との双方に用いられることが特に好ましい。 The ceramic material constituting the ceramic protective layer is preferably at least the same as the main component of the ceramic material constituting the ceramic layer. In this case, it is particularly preferred that ceramic materials having the same composition are used for both the ceramic layer and the ceramic protective layer.
上述のとおり、本発明の製造方法は、積層セラミックコンデンサ以外の積層セラミック電子部品にも適用することができる。例えば、積層セラミック電子部品が圧電部品の場合には、PZT系セラミック等の圧電体セラミック、サーミスタの場合には、スピネル系セラミック等の半導体セラミックが用いられる。 As described above, the manufacturing method of the present invention can be applied to multilayer ceramic electronic components other than multilayer ceramic capacitors. For example, when the multilayer ceramic electronic component is a piezoelectric component, a piezoelectric ceramic such as a PZT ceramic is used, and when the thermistor is a semiconductor ceramic such as a spinel ceramic.
外部電極は、下地層と下地層上に形成されるめっき層とで構成されることが好ましい。下地層を構成する導電材料としては、例えば、Cu、Ni、Ag、Pd、Ag−Pd合金、Au等を用いることができる。下地層は、導電性ペーストを未焼成の部品本体上に塗布して部品本体と同時焼成するコファイア法を適用することによって形成されてもよく、導電性ペーストを焼成後の部品本体上に塗布して焼き付けるポストファイア法を適用することによって形成されてもよい。あるいは、下地層は、直接めっきにより形成されてもよく、熱硬化性樹脂を含む導電性樹脂を硬化させることにより形成されてもよい。 The external electrode is preferably composed of a base layer and a plating layer formed on the base layer. For example, Cu, Ni, Ag, Pd, an Ag—Pd alloy, Au, or the like can be used as the conductive material constituting the base layer. The underlayer may be formed by applying a co-fire method in which a conductive paste is applied onto an unfired component body and simultaneously fired with the component body, and the conductive paste is applied onto the fired component body. It may be formed by applying a post-fire method. Alternatively, the underlayer may be formed by direct plating, or may be formed by curing a conductive resin including a thermosetting resin.
下地層上に形成されるめっき層は、Niめっき、及び、その上のSnめっきの2層構造であることが好ましい。 The plating layer formed on the base layer preferably has a two-layer structure of Ni plating and Sn plating thereon.
次に、本発明の積層セラミック電子部品の製造方法の一例として、図1に示す積層セラミックコンデンサ11の製造方法について説明する。
Next, a method for manufacturing the multilayer
まず、セラミック層となるべきセラミックグリーンシートが準備される。セラミックグリーンシートは、例えば、キャリアフィルム上で、ダイコータ、グラビアコータ、マイクログラビアコータ等を用いて成形される。 First, a ceramic green sheet to be a ceramic layer is prepared. For example, the ceramic green sheet is formed on a carrier film using a die coater, a gravure coater, a micro gravure coater, or the like.
セラミックグリーンシートの厚みは、通常3μm以下であり、1μm以下であることが好ましく、0.6μm以下であることがより好ましい。 The thickness of the ceramic green sheet is usually 3 μm or less, preferably 1 μm or less, and more preferably 0.6 μm or less.
次に、セラミックグリーンシート上に、所定のパターンをもって導電性ペーストが印刷される。 Next, a conductive paste is printed on the ceramic green sheet with a predetermined pattern.
図4は、図3に示すグリーンチップを作製するために準備される内部電極パターンが形成されたセラミックグリーンシートの一例を模式的に示す平面図である。
図4に示すように、セラミック層25となるべきセラミックグリーンシート31上に、所定のパターンをもって導電性ペーストが印刷されることによって、内部電極26及び27の各々となるべき内部電極パターン32が形成される。具体的には、セラミックグリーンシート31上に、帯状の内部電極パターン32が複数列形成される。
FIG. 4 is a plan view schematically showing an example of a ceramic green sheet on which an internal electrode pattern prepared for producing the green chip shown in FIG. 3 is formed.
As shown in FIG. 4, an
内部電極パターンの厚みは特に限定されないが、1.5μm以下であることが好ましい。 The thickness of the internal electrode pattern is not particularly limited, but is preferably 1.5 μm or less.
その後、内部電極パターンが形成されたセラミックグリーンシートをずらしながら所定枚数積層し、その上下に内部電極パターンが形成されていないセラミックグリーンシートを所定枚数積層する積層工程が行われる。 Thereafter, a stacking process is performed in which a predetermined number of ceramic green sheets on which internal electrode patterns are formed are stacked while being shifted, and a predetermined number of ceramic green sheets on which no internal electrode patterns are formed are stacked on the top and bottom.
図5(a)は、図4に示すセラミックグリーンシートを積層する工程を説明するための斜視図である。
図5(a)に示すように、内部電極パターン32が形成されたセラミックグリーンシート31を、幅方向に沿って所定間隔、すなわち内部電極パターン32の幅方向寸法の半分ずつずらしながら所定枚数積層する。さらに、その上下に内部電極パターンが印刷されていないセラミックグリーンシートを所定枚数積層する。
Fig.5 (a) is a perspective view for demonstrating the process of laminating | stacking the ceramic green sheet shown in FIG.
As shown in FIG. 5A, a predetermined number of ceramic
図5(b)及び図5(c)は、図4に示すセラミックグリーンシートを積層する工程を説明するための平面図である。図5(b)及び図5(c)は、それぞれ1層目及び2層目のセラミックグリーンシートが拡大して示されている。
図5(b)及び図5(c)には、帯状の内部電極パターン32が延びる方向と直交する幅方向(図5(b)及び図5(c)における上下方向)の切断線33、及び、これに対して直交する長手方向(図5(b)及び図5(c)における左右方向)の切断線34の各一部が示されている。帯状の内部電極パターン32は、2つ分の内部電極26及び27が各々の引出し部同士で連結されたものが、長手方向に沿って連なった形状を有している。図5(b)及び図5(c)では、切断線33及び34が共通して示されている。
FIGS. 5B and 5C are plan views for explaining a process of laminating the ceramic green sheets shown in FIG. FIGS. 5B and 5C are enlarged views of the first and second ceramic green sheets, respectively.
5B and 5C, a cutting
積層工程の結果、積層された複数のセラミックグリーンシートと、セラミックグリーンシート間の複数の界面に沿ってそれぞれ配置された内部電極パターンとを含む、マザーブロックが得られる。得られたマザーブロックは、静水圧プレス等の手段により積層方向にプレスされる。 As a result of the lamination step, a mother block including a plurality of laminated ceramic green sheets and internal electrode patterns respectively arranged along a plurality of interfaces between the ceramic green sheets is obtained. The obtained mother block is pressed in the stacking direction by means such as isostatic pressing.
プレスされたマザーブロックを互いに直交する第1方向の切断線及び第2方向の切断線に沿って切断することによって、複数のグリーンチップが得られる。この切断には、例えば、ダイシング、押切り、レーザカット等の方法が適用される。 A plurality of green chips is obtained by cutting the pressed mother block along a cutting line in a first direction and a cutting line in a second direction orthogonal to each other. For this cutting, for example, methods such as dicing, pressing, and laser cutting are applied.
図6は、マザーブロックを切断する工程を説明するための斜視図である。
図6において、マザーブロック35は、互いに直交する第1方向の切断線33及び第2方向の切断線34に沿って切断され、行及び列方向に配列された複数のグリーンチップ19が得られる。図6では、マザーブロック35の内部に位置する最上の内部電極パターン32が破線で示されている。なお、図6では、1個のマザーブロック35から6個のグリーンチップ19が取り出されているが、実際には、より多数のグリーンチップ19が取り出される。
FIG. 6 is a perspective view for explaining a process of cutting the mother block.
In FIG. 6, the
図3に示したように、各グリーンチップ19は、生の状態にある複数のセラミック層25と複数の内部電極26及び27とをもって構成された積層構造を有している。グリーンチップ19の切断側面20及び21は、第1方向の切断線33に沿う切断によって現れた面であり、切断端面36及び37は第2方向の切断線34の切断によって現れた面である。切断側面20及び21には、内部電極26及び27のすべてが露出している。また、一方の切断端面36には、内部電極26のみが露出し、他方の切断端面37には、内部電極27のみが露出している。
As shown in FIG. 3, each
なお、図6に示すように、複数のグリーンチップ19が行及び列方向に配列されるように、マザーブロック35が拡張性のある粘着シート38上に貼り付けられた状態で切断されることが好ましい。この場合、図示しないエキスパンド装置によって、粘着シート38を拡張することができる。
In addition, as shown in FIG. 6, the
図7は、行及び列方向に配列された複数のグリーンチップの互いの間隔を広げた状態を示す斜視図である。
図6に示す粘着シート38を拡張することによって、図7に示すように、行及び列方向に配列された複数のグリーンチップ19は、互いの間隔を広げた状態とされる。
FIG. 7 is a perspective view illustrating a state in which a plurality of green chips arranged in the row and column directions are spaced apart from each other.
By extending the
続いて、複数のグリーンチップを転動させることによって、複数のグリーンチップの各々の切断側面を揃って開放面とする転動工程が行われることが好ましい。 Subsequently, it is preferable that a rolling step is performed in which a plurality of green chips are rolled to align the cut side surfaces of the plurality of green chips to open surfaces.
図8(a)及び図8(b)は、グリーンチップを転動させる工程を説明するための斜視図である。
図8(a)に示すグリーンチップ19を90度回転させることによって、図8(b)に示すように、切断側面20が上方へ向いた開放面とすることができる。
FIGS. 8A and 8B are perspective views for explaining a process of rolling the green chip.
By rotating the
切断側面に対して、バイトを用いた切削処理が行われる。上述の転動工程を行う場合、転動工程により上方へ向いた切断側面に対して切削処理が行われることが好ましい。 A cutting process using a cutting tool is performed on the cut side surface. When performing the above-mentioned rolling process, it is preferable that a cutting process is performed with respect to the cut side surface which faced upwards by the rolling process.
切削処理は、マザーブロックを切断した後、生のセラミック保護層を形成する前であれば、どの段階で行われてもよい。そのため、例えば、転動工程の前の切断側面に対して切削処理が行われてもよいし、転動工程を行わず、切断により得られる切断側面に対して切削処理が行われてもよい。 The cutting process may be performed at any stage after the mother block is cut and before the raw ceramic protective layer is formed. Therefore, for example, the cutting process may be performed on the cut side surface before the rolling process, or the cutting process may be performed on the cut side surface obtained by cutting without performing the rolling process.
図9(a)及び図9(b)は、切削処理を行う工程を説明するための図である。図9(a)及び図9(b)は、グリーンチップの端面方向から示した切断側面付近の拡大図である。
図9(a)に示すように、切断側面20には、切断時の応力によって内部電極26の垂れ26Aが存在する。切断側面20に対して、図9(a)に示す切削線X−Xの位置まで切削処理を行うことによって、図9(b)に示すように、内部電極26の垂れ26Aを除去することができる。
FIG. 9A and FIG. 9B are diagrams for explaining a process of performing a cutting process. FIG. 9A and FIG. 9B are enlarged views of the vicinity of the cut side surface shown from the end surface direction of the green chip.
As shown in FIG. 9A, a dripping 26A of the
切削処理としては、例えば、バイトの回転による切削処理、グリーンチップの回転による切削処理、バイトの直線運動による切削処理、グリーンチップの直線運動による切削処理等が挙げられる。これらの処理を組み合わせてもよい。 Examples of the cutting process include a cutting process by rotating a cutting tool, a cutting process by rotating a green chip, a cutting process by linear moving of a cutting tool, and a cutting process by linear moving of a green chip. These processes may be combined.
短絡箇所の発生を防止する観点からは、バイトの回転による切削処理、グリーンチップの回転による切削処理、又は、これらを組み合わせた切削処理が好ましい。具体的には、サーフェースプレーナー等の切削装置を用いた切削処理が好ましい。サーフェースプレーナーを用いる場合、所定の切込高さに固定したバイトを回転させた状態において、グリーンチップを送ることによって、グリーンチップの表面を切削することができる。さらに、バイトの刃先によって、グリーンチップの表面が1回で削り取られるため、グリーンチップの表面を平滑にすることもできる。 From the viewpoint of preventing the occurrence of a short-circuit portion, a cutting process by rotating a cutting tool, a cutting process by rotating a green chip, or a cutting process combining these is preferable. Specifically, a cutting process using a cutting device such as a surface planar is preferable. When the surface planar is used, the surface of the green chip can be cut by feeding the green chip in a state where the tool fixed at a predetermined cutting height is rotated. Furthermore, since the surface of the green chip is scraped off once by the cutting edge of the cutting tool, the surface of the green chip can be smoothed.
バイトを用いた切削処理において、バイトの材質は特に限定されないが、ダイヤモンドバイトが好ましい。 In the cutting process using a cutting tool, the material of the cutting tool is not particularly limited, but a diamond cutting tool is preferable.
切削処理後の切断側面の表面粗さRaは、50nm以下であることが好ましく、20nm以下であることがより好ましい。切断側面の表面粗さを小さくすることにより、ショート不良率を低減させることができる。
なお、表面粗さRaは、光干渉式表面粗さ計(ZYGO社製 NewView)を用いて測定することができる。
The surface roughness Ra of the cut side surface after the cutting treatment is preferably 50 nm or less, and more preferably 20 nm or less. By reducing the surface roughness of the cut side surface, the short-circuit defect rate can be reduced.
In addition, surface roughness Ra can be measured using a light interference type surface roughness meter (NewView by ZYGO).
切削処理後、切断側面に生のセラミック保護層が形成される。生のセラミック保護層は、例えば、セラミック保護層用グリーンシートを貼り付けるか、又は、セラミック保護層用ペーストを塗布することにより形成される。 After the cutting process, a raw ceramic protective layer is formed on the cut side surface. The raw ceramic protective layer is formed by, for example, attaching a ceramic protective layer green sheet or applying a ceramic protective layer paste.
図10は、生のセラミック保護層を形成する工程を説明するための図である。
図10に示すように、切削処理後の切断側面20にセラミック保護層用グリーンシートを貼り付けるか、又は、セラミック保護層用ペーストを塗布することによって、生のセラミック保護層22を形成することができる。
FIG. 10 is a diagram for explaining a process of forming a raw ceramic protective layer.
As shown in FIG. 10, a green ceramic
セラミック保護層用グリーンシート又はセラミック保護層用ペーストには、マザーブロックを作製するためのセラミックグリーンシートと同じセラミック原料が主成分として含有されていることが好ましい。 The ceramic protective layer green sheet or the ceramic protective layer paste preferably contains the same ceramic raw material as the main component of the ceramic green sheet for producing the mother block.
また、セラミック保護層用グリーンシート又はセラミック保護層用ペーストには、Mgが実質的に含有されていないことが好ましい。 Moreover, it is preferable that Mg is not substantially contained in the ceramic protective layer green sheet or the ceramic protective layer paste.
生のセラミック保護層を形成した後、必要に応じて、乾燥工程が行われる。乾燥工程では、生のセラミック保護層22が形成されたグリーンチップ19が、例えば、120℃に設定されたオーブンに5分間入れられる。
After forming the raw ceramic protective layer, a drying step is performed as necessary. In the drying process, the
次に、図8を参照して説明した工程と同様の転動工程が行われることが好ましい。すなわち、複数のグリーンチップを転動させることによって、複数のグリーンチップの各々の切断側面を揃って開放面とする転動工程が行われることが好ましい。この場合、グリーンチップを180度回転させることによって、反対側の切断側面が上方へ向いた開放面とすることができる。 Next, it is preferable that a rolling process similar to the process described with reference to FIG. 8 is performed. That is, it is preferable that a rolling process is performed in which a plurality of green chips are rolled to align the cut side surfaces of the plurality of green chips to be open surfaces. In this case, by rotating the green chip by 180 degrees, the cut surface on the opposite side can be made an open surface facing upward.
反対側の切断側面に対しても、上記と同様に、バイトを用いた切削処理を行い、生のセラミック保護層を形成すればよい。切削処理の条件は同じでもよいし、異なっていてもよい。また、生のセラミック保護層を形成した後、必要に応じて、乾燥工程が行われる。以上により、生の部品本体が得られる。 Also on the opposite cut side surface, a cutting process using a cutting tool may be performed in the same manner as described above to form a raw ceramic protective layer. The conditions for the cutting process may be the same or different. Moreover, after forming a raw ceramic protective layer, a drying process is performed as needed. Thus, a raw component body is obtained.
得られた生の部品本体が焼成される。焼成温度は、生の部品本体に含まれるセラミック材料や金属材料にもよるが、例えば900℃以上、1300℃以下の範囲である。 The obtained raw component body is fired. The firing temperature is, for example, in the range of 900 ° C. or higher and 1300 ° C. or lower, although it depends on the ceramic material or metal material contained in the raw component body.
焼成後の部品本体の両端面17及び18に導電性ペーストを塗布し、焼き付け、さらに、必要に応じて、めっきが施されることによって、外部電極28及び29が形成される。なお、導電性ペーストの塗布は、生の部品本体に対して実施されてもよく、生の部品本体の焼成時に、導電性ペーストの焼付けを同時に行なうようにしてもよい。
このようにして、図1に示す積層セラミックコンデンサ11が製造される。
In this way, the multilayer
上述した実施形態では、マザーブロックを第1方向の切断線及び第2方向の切断線に切断して複数のグリーンチップを得てから、切断側面に対して切削処理を行い、生のセラミック保護層を形成していたが、以下のように変更することも可能である。 In the embodiment described above, the mother block is cut into a cutting line in the first direction and a cutting line in the second direction to obtain a plurality of green chips, and then a cutting process is performed on the cut side surface to obtain a raw ceramic protective layer However, it can be changed as follows.
すなわち、マザーブロックを第1方向の切断線のみに沿って切断することによって、第1方向の切断線に沿う切断によって現れた切断側面に内部電極が露出した、複数の棒状のグリーンブロック体を得てから、切断側面に対して切削処理を行い、生のセラミック保護層を形成した後、第2方向の切断線に切断して複数の生の部品本体を得て、その後、生の部品本体を焼成してもよい。焼成後は、前述の実施形態と同様の工程を行うことによって、積層セラミック電子部品を製造することができる。 That is, by cutting the mother block along only the cutting line in the first direction, a plurality of rod-shaped green block bodies are obtained in which the internal electrodes are exposed on the cutting side surfaces that appear by cutting along the cutting line in the first direction. Then, after cutting the cut side surface to form a raw ceramic protective layer, a plurality of raw component bodies are obtained by cutting along a cutting line in the second direction. You may bake. After firing, a multilayer ceramic electronic component can be manufactured by performing the same process as in the above-described embodiment.
以下、本発明の積層セラミック電子部品の製造方法をより具体的に開示した実施例を示す。なお、本発明は、これらの実施例のみに限定されるものではない。 Examples in which the method for producing a multilayer ceramic electronic component of the present invention is disclosed more specifically below. In addition, this invention is not limited only to these Examples.
[積層セラミックコンデンサの作製]
(実施例1)
セラミック原料としてのBaTiO3に、ポリビニルブチラール系バインダ、可塑剤及び有機溶剤としてのエタノールを加え、これらをボールミルにより湿式混合し、セラミックスラリーを作製した。次いで、このセラミックスラリーをリップ方式によりシート成形し、矩形のセラミックグリーンシートを得た。次に、上記セラミックグリーンシート上に、Niを含有する導電性ペーストをスクリーン印刷し、Niを主成分とする内部電極パターンを形成した。
[Production of multilayer ceramic capacitors]
Example 1
A polyvinyl butyral binder, a plasticizer and ethanol as an organic solvent were added to BaTiO 3 as a ceramic raw material, and these were wet mixed by a ball mill to prepare a ceramic slurry. Next, this ceramic slurry was formed into a sheet by a lip method to obtain a rectangular ceramic green sheet. Next, a conductive paste containing Ni was screen-printed on the ceramic green sheet to form an internal electrode pattern containing Ni as a main component.
内部電極パターンが形成されたセラミックグリーンシートを幅方向にずらしながら複数枚積層し、その上下に内部電極パターンが印刷されていないセラミックグリーンシートを積層することにより、マザーブロックを得た。得られたマザーブロックを、静水圧プレスにより積層方向にプレスした。 A plurality of ceramic green sheets on which internal electrode patterns were formed were stacked while shifting in the width direction, and ceramic green sheets on which no internal electrode patterns were printed were stacked on the top and bottom to obtain a mother block. The obtained mother block was pressed in the laminating direction by an isostatic press.
プレスされたマザーブロックをチップ形状に切断することにより、個々の内部電極が両端面及び両側面に露出したグリーンチップを得た。切断後、純水による超音波洗浄を行った。 The pressed mother block was cut into a chip shape to obtain a green chip in which individual internal electrodes were exposed on both end faces and both side faces. After cutting, ultrasonic cleaning with pure water was performed.
グリーンチップの一方の切断側面に対して、バイトを用いた切削処理を行った。実施例1では、刃幅5μmの片刃バイトを有するサーフェースプレーナー(DISCO社製 DAS8920)を用い、加工条件は、切込深さ10μm、テーブル送り速度0.33mm/sec、回転数1000rpmとした。 A cutting process using a cutting tool was performed on one cut side of the green chip. In Example 1, a surface planer (DAS8920 manufactured by DISCO Co., Ltd.) having a single blade with a blade width of 5 μm was used, and the processing conditions were a depth of cut of 10 μm, a table feed speed of 0.33 mm / sec, and a rotation speed of 1000 rpm.
切削処理後、純水による超音波洗浄を行い、その後、水分を乾燥させた。続いて、切削処理後の切断側面にセラミック保護層用グリーンシートを貼り付けることにより、生のセラミック保護層を形成した。セラミック保護層用グリーンシートの組成は、セラミックグリーンシートの組成と同じである。 After the cutting treatment, ultrasonic cleaning with pure water was performed, and then moisture was dried. Then, the raw ceramic protective layer was formed by affixing the green sheet for ceramic protective layers on the cut side surface after a cutting process. The composition of the ceramic protective layer green sheet is the same as the composition of the ceramic green sheet.
グリーンチップの他方の切断側面に対しても、上記と同様に、バイトを用いた切削処理を行った後、生のセラミック保護層を形成した。これにより、生の部品本体を得た。 Also on the other cut side surface of the green chip, a cutting process using a cutting tool was performed in the same manner as described above, and then a raw ceramic protective layer was formed. As a result, a raw component body was obtained.
得られた生の部品本体を窒素雰囲気中にて脱脂した後、水素/窒素混合雰囲気中にて焼成した。焼成後、導電性ペーストの塗布及び焼付けによって、外部電極を形成し、実施例1の積層セラミックコンデンサを作製した。 The obtained raw component body was degreased in a nitrogen atmosphere and then fired in a hydrogen / nitrogen mixed atmosphere. After firing, an external electrode was formed by applying and baking a conductive paste, and a multilayer ceramic capacitor of Example 1 was produced.
(比較例1)
グリーンチップの切断側面に対して切削処理を行わなかったこと以外は実施例1と同様に外部電極まで形成し、比較例1の積層セラミックコンデンサを作製した。
(Comparative Example 1)
Except that the cutting process was not performed on the cut side surface of the green chip, the external electrodes were formed in the same manner as in Example 1 to produce the multilayer ceramic capacitor of Comparative Example 1.
[評価]
(完全短絡箇所)
走査型電子顕微鏡(SEM)を用いて、外部電極を形成する前の切断側面を倍率7000倍で撮影した。内部電極14〜16本中、Ni粒子同士が完全に層間をまたがって接触している箇所の数を測定した。結果を表1の「完全短絡箇所」に示す。完全短絡箇所の数が0である場合を◎(優)、1以上である場合を×(不可)と評価した。
[Evaluation]
(Completely shorted point)
Using a scanning electron microscope (SEM), the cut side surface before forming the external electrode was photographed at a magnification of 7000 times. In 14 to 16 internal electrodes, the number of locations where Ni particles completely contact each other across the layers was measured. The results are shown in “Completely short-circuited locations” in Table 1. A case where the number of completely short-circuited portions was 0 was evaluated as ◎ (excellent), and a case where it was 1 or more was evaluated as × (impossible).
(表面粗さ)
光干渉式表面粗さ計(ZYGO社製 NewView)を用いて、外部電極を形成する前の切断側面の表面粗さRaを測定した。結果を表1の「表面粗さ」に示す。表面粗さRaが20nm以下である場合を◎(優)、20nmより大きく50nm以下である場合を○(良)、50nmより大きい場合を×(不可)と評価した。
(Surface roughness)
The surface roughness Ra of the cut side surface before forming the external electrode was measured using an optical interference type surface roughness meter (New View manufactured by ZYGO). The results are shown in “Surface roughness” in Table 1. The case where the surface roughness Ra was 20 nm or less was evaluated as ◎ (excellent), the case where it was larger than 20 nm and 50 nm or less was evaluated as ◯ (good), and the case where it was larger than 50 nm was evaluated as × (impossible).
(脱脂後ショート率)
それぞれ100個の積層セラミックコンデンサの静電容量をLCRメータにて測定し、ショート不良の発生率を算出した。結果を表1の「脱脂後ショート率」に示す。脱脂後ショート率が80%未満である場合を◎(優)、80%以上100%未満である場合を○(良)、100%である場合を×(不可)と評価した。
(Short rate after degreasing)
The capacitance of 100 multilayer ceramic capacitors was measured with an LCR meter, and the occurrence rate of short-circuit defects was calculated. The results are shown in “Short rate after degreasing” in Table 1. A case where the short-circuit rate after degreasing was less than 80% was evaluated as ◎ (excellent), a case where it was 80% or more and less than 100% was evaluated as ○ (good), and a case where it was 100% was evaluated as × (impossible).
表1に示すように、マザーブロックを切断した後、生のセラミック保護層を形成する前に、切断側面に対して切削処理を行っていない比較例1では、完全短絡箇所が発生していたのに対し、切断側面に対して切削処理を行った実施例1では、完全短絡箇所が0であった。さらに、実施例1では、切削処理後の切断側面の表面粗さが小さく、比較例1よりも脱脂後ショート率が大きく低下していた。 As shown in Table 1, after the mother block was cut and before the raw ceramic protective layer was formed, in Comparative Example 1 in which the cutting treatment was not performed on the cut side surface, a complete short-circuit portion occurred. On the other hand, in Example 1 which performed the cutting process with respect to the cut side surface, the complete short circuit location was 0. Furthermore, in Example 1, the surface roughness of the cut side surface after the cutting treatment was small, and the post-degreasing short-circuit rate was greatly reduced as compared with Comparative Example 1.
図11(a)は、比較例1の積層セラミックコンデンサの切断側面のSEM画像であり、図11(b)は、実施例1の積層セラミックコンデンサの切断側面のSEM画像である。
表1の結果と同様、切断側面に対して切削処理を行っていない比較例1では、図11(a)に示すように、完全短絡箇所が確認されたのに対し、切断側面に対して切削処理を行った実施例1では、図11(b)に示すように、完全短絡箇所が確認されなかった。
11A is an SEM image of the cut side surface of the multilayer ceramic capacitor of Comparative Example 1, and FIG. 11B is an SEM image of the cut side surface of the multilayer ceramic capacitor of Example 1. FIG.
Similar to the results in Table 1, in Comparative Example 1 in which the cutting process was not performed on the cut side surface, as shown in FIG. In Example 1 where the treatment was performed, as shown in FIG.
11 積層セラミックコンデンサ(積層セラミック電子部品)
12 部品本体
13,14 主面
15,16 側面
17,18 端面
19 グリーンチップ
20,21 切断側面
22,23 セラミック保護層
24 積層部
25 セラミック層
26,27 内部電極
26A 内部電極の垂れ
28,29 外部電極
31 セラミックグリーンシート
32 内部電極パターン
33 第1方向の切断線
34 第2方向の切断線
35 マザーブロック
36,37 切断端面
38 粘着シート
11 Multilayer ceramic capacitors (multilayer ceramic electronic components)
12 Parts
Claims (9)
前記マザーブロックを互いに直交する第1方向の切断線及び第2方向の切断線に沿って切断することによって、生の状態にある複数のセラミック層と複数の内部電極とをもって構成された積層構造を有し、かつ前記第1方向の切断線に沿う切断によって現れた切断側面に前記内部電極が露出した、複数のグリーンチップを得る工程と、
前記切断側面に対して、バイトを用いた切削処理を行う工程と、
前記切削処理後の切断側面に生のセラミック保護層を形成することによって、生の部品本体を得る工程と、
前記生の部品本体を焼成する工程と、を備えることを特徴とする積層セラミック電子部品の製造方法。 A step of producing a mother block including a plurality of laminated ceramic green sheets and internal electrode patterns respectively disposed along a plurality of interfaces between the ceramic green sheets;
A laminated structure including a plurality of ceramic layers and a plurality of internal electrodes in a raw state by cutting the mother block along a cutting line in a first direction and a cutting line in a second direction orthogonal to each other. And obtaining a plurality of green chips, wherein the internal electrodes are exposed on a cut side surface that appears by cutting along the cutting line in the first direction;
For the cutting side, a step of performing a cutting process using a cutting tool,
Forming a raw ceramic protective layer on the cut side surface after the cutting process to obtain a raw component body;
And a step of firing the raw component body. A method of manufacturing a multilayer ceramic electronic component, comprising:
前記開放面とされた前記切断側面に対して前記切削処理を行う請求項1に記載の積層セラミック電子部品の製造方法。 Before the step of performing the cutting process, a plurality of the green chips are rolled by rolling a plurality of the green chips in a state where a plurality of the green chips arranged in row and column directions are widened. Further comprising the step of aligning the cut side surfaces of each of the surfaces into an open surface,
The method for manufacturing a multilayer ceramic electronic component according to claim 1, wherein the cutting process is performed on the cut side surface that is the open surface.
前記マザーブロックを第1方向の切断線に沿って切断することによって、生の状態にある複数のセラミック層と複数の内部電極とをもって構成された積層構造を有し、かつ前記第1方向の切断線に沿う切断によって現れた切断側面に前記内部電極が露出した、複数の棒状のグリーンブロック体を得る工程と、
前記切断側面に対して、バイトを用いた切削処理を行う工程と、
前記切削処理後の切断側面に生のセラミック保護層を形成する工程と、
前記生のセラミック保護層が形成された前記棒状のグリーンブロック体を、前記第1方向に直交する第2方向の切断線に沿って切断することによって、複数の生の部品本体を得る工程と、
前記生の部品本体を焼成する工程と、を備えることを特徴とする積層セラミック電子部品の製造方法。 A step of producing a mother block including a plurality of laminated ceramic green sheets and internal electrode patterns respectively disposed along a plurality of interfaces between the ceramic green sheets;
By cutting the mother block along a cutting line in the first direction, the mother block has a laminated structure including a plurality of ceramic layers and a plurality of internal electrodes in a raw state, and cutting in the first direction A step of obtaining a plurality of rod-shaped green block bodies in which the internal electrode is exposed on a cut side surface that appears by cutting along a line;
For the cutting side, a step of performing a cutting process using a cutting tool,
Forming a raw ceramic protective layer on the cut side surface after the cutting treatment;
Cutting the rod-shaped green block body on which the raw ceramic protective layer is formed along a cutting line in a second direction perpendicular to the first direction to obtain a plurality of raw component bodies;
And a step of firing the raw component body. A method of manufacturing a multilayer ceramic electronic component, comprising:
前記開放面とされた前記切断側面に対して前記切削処理を行う請求項3に記載の積層セラミック電子部品の製造方法。 Before the step of performing the cutting treatment, a plurality of the rod-shaped green block bodies are rolled in a state in which the plurality of rod-shaped green block bodies arranged in a predetermined direction are widened. Further comprising the step of aligning the cut side surfaces of each of the rod-shaped green block bodies to open surfaces.
The manufacturing method of the multilayer ceramic electronic component of Claim 3 which performs the said cutting process with respect to the said cut side surface made into the said open surface.
前記セラミック保護層用グリーンシート又は前記セラミック保護層用ペーストには、Mgが実質的に含有されていない請求項1〜6のいずれか1項に記載の積層セラミック電子部品の製造方法。 The raw ceramic protective layer is formed by attaching a ceramic protective layer green sheet or by applying a ceramic protective layer paste,
The method for manufacturing a multilayer ceramic electronic component according to claim 1, wherein Mg is not substantially contained in the ceramic protective layer green sheet or the ceramic protective layer paste.
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