JP2012078379A - Display device - Google Patents
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Abstract
【課題】従来技術における有機EL表示装置においては、駆動トランジスタの特性の検出を高精度かつ高速度で行うことができない。
【解決手段】表示装置であって、発光素子と、階調値に応じた電流を前記発光素子に供給する駆動トランジスタと、をそれぞれ有する複数の画素と、前記各駆動トランジスタの特性を検出する検出手段と、前記各発光素子の発光後に、前記各駆動トランジスタのゲート・ソース間に第1の電圧信号を供給する手段と、前記第1の電圧信号が供給された後、前記各駆動トランジスタのゲート・ソース間に、前記第1の電圧信号とは異なる第2の電圧信号を供給する手段とを有し、前記検出手段は、前記第2の電圧信号を供給する期間に、前記各駆動トランジスタの特性を検出し、前記第1の電圧信号は、前記第2の電圧信号に比べ、前記駆動トランジスタのソース・ドレイン間により多くの電流を供給可能な電圧を有する電圧信号である。
【選択図】図3In an organic EL display device according to the prior art, it is impossible to detect characteristics of a driving transistor with high accuracy and high speed.
A display device includes a plurality of pixels each having a light emitting element and a driving transistor that supplies a current corresponding to a gradation value to the light emitting element, and detection for detecting characteristics of each driving transistor. Means for supplying a first voltage signal between the gate and the source of each driving transistor after the light emission of each light emitting element; and after the first voltage signal is supplied, the gate of each driving transistor Means for supplying a second voltage signal different from the first voltage signal between the sources, and the detection means is configured to supply each of the drive transistors during a period of supplying the second voltage signal. A characteristic is detected, and the first voltage signal is a voltage signal having a voltage capable of supplying more current between the source and drain of the driving transistor than the second voltage signal.
[Selection] Figure 3
Description
本発明は、表示素子に関し、特には、自発光素子を有する表示装置に関する。 The present invention relates to a display element, and more particularly to a display device having a self-luminous element.
近年、有機発光ダイオード(Organic Light Emitting Diode)に代表される有機EL(Organic Electro-luminescent)素子と呼ばれる自発光体を用いた表示装置(以下、「有機EL表示装置」という。)が実用化段階にある。この有機EL表示装置は、従来の液晶表示装置と比較して、自発光体を用いているため、視認性、応答速度の点で優れているだけでなく、バックライトのような補助照明装置を要しないため、更なる薄型化が可能となっている。 In recent years, a display device using a self-luminous body called an organic EL (Organic Electro-luminescent) element typified by an organic light emitting diode (hereinafter referred to as “organic EL display device”) has been put into practical use. It is in. Since this organic EL display device uses a self-luminous body as compared with a conventional liquid crystal display device, it is not only superior in terms of visibility and response speed, but also has an auxiliary illumination device such as a backlight. Since it is not necessary, further thinning is possible.
このような有機EL表示装置は、マトリクス状に多数の画素を配置した表示パネルを有する。そして、各画素は、有機EL素子と当該有機EL素子を駆動する駆動トランジスタを含む。当該駆動トランジスタは、一般に薄膜トランジスタ(Thin Film-Transistor)で構成されることから、製造上の問題等により、当該各駆動トランジスタの閾値電圧にバラツキが生じる。よって、各画素の発光特性にバラツキが生じ、結果として、表示パネルの表示が不均一になるという問題がある。 Such an organic EL display device has a display panel in which a large number of pixels are arranged in a matrix. Each pixel includes an organic EL element and a drive transistor that drives the organic EL element. Since the driving transistor is generally composed of a thin film transistor (Thin Film-Transistor), the threshold voltage of each driving transistor varies due to manufacturing problems. Therefore, there is a problem in that the light emission characteristics of each pixel vary, and as a result, display on the display panel becomes non-uniform.
そこで、次のような従来技術における有機EL表示装置が知られている。当該有機EL表示装置においては、各画素に流れる電流を検出し、当該検出した電流値に基づいて補正用オフセットを算出する。そして、画像データに当該補正用オフセットを付加することにより、画面の表示の不均一の発生を防止する(下記特許文献1、2参照)。あるいは、駆動トランジスタのソースに定電流源を接続してその電圧を計測することにより閾値電圧のバラツキを検出する方法も提案されている(下記特許文献3参照)。
Accordingly, the following organic EL display device in the prior art is known. In the organic EL display device, a current flowing through each pixel is detected, and a correction offset is calculated based on the detected current value. Then, by adding the correction offset to the image data, non-uniform display of the screen is prevented (see
しかしながら、上記従来技術における有機EL表示装置においては、駆動トランジスタの特性の検出精度を高くすると、検出時間が長くなってしまうという課題がある。 However, in the organic EL display device according to the above-described prior art, there is a problem that if the detection accuracy of the characteristics of the drive transistor is increased, the detection time becomes longer.
具体的には、駆動トランジスタにおけるヒステリシスの影響を考慮すると、駆動トランジスタの特性が安定した状態になるまでの待機時間として、数msecの待機時間が必要となる。ここで、充分な待機時間を確保しない場合には、当該ヒステリシスの影響を受けるため、検出精度が大幅に低下するという問題がある。一方、電圧レンジを考慮した場合、最大でも1画素あたりμAオーダー程度の電流しか流すことができず、検出速度が制限され、結果として、十分な待機時間を確保できないという問題がある。 Specifically, considering the influence of hysteresis in the drive transistor, a standby time of several milliseconds is required as a standby time until the characteristics of the drive transistor become stable. Here, when a sufficient standby time is not secured, there is a problem that the detection accuracy is greatly lowered because of being affected by the hysteresis. On the other hand, when the voltage range is taken into consideration, only a current of the order of μA per pixel can flow at the maximum, the detection speed is limited, and as a result, a sufficient standby time cannot be secured.
そこで、本発明は、各画素に含まれる駆動トランジスタの特性を高精度かつ高速度で検出することができる表示装置を提供することを目的とする。 Accordingly, an object of the present invention is to provide a display device that can detect the characteristics of the drive transistor included in each pixel with high accuracy and high speed.
本発明の表示装置は、発光素子と、階調値に応じた電流を前記発光素子に供給する駆動トランジスタと、をそれぞれ有する複数の画素と、前記各駆動トランジスタの特性を検出する検出手段と、前記各発光素子の発光後に、前記各駆動トランジスタのゲート・ソース間に第1の電圧信号を供給する手段と、前記第1の電圧信号が供給された後、前記各駆動トランジスタのゲート・ソース間に、前記第1の電圧信号とは異なる第2の電圧信号を供給する手段とを有し、前記検出手段は、前記第2の電圧信号を供給する期間に、前記各駆動トランジスタの特性を検出し、前記第1の電圧信号は、前記第2の電圧信号に比べ、前記駆動トランジスタのソース・ドレイン間により多くの電流を供給可能な電圧を有する電圧信号であることを特徴とする。 The display device of the present invention includes a plurality of pixels each having a light emitting element and a driving transistor that supplies a current corresponding to a gradation value to the light emitting element, and a detection unit that detects characteristics of each driving transistor, Means for supplying a first voltage signal between the gate and source of each driving transistor after light emission of each of the light emitting elements; and between the gate and source of each driving transistor after the first voltage signal is supplied. And a means for supplying a second voltage signal different from the first voltage signal, and the detecting means detects the characteristics of the drive transistors during the period of supplying the second voltage signal. The first voltage signal is a voltage signal having a voltage that can supply more current between the source and drain of the driving transistor than the second voltage signal.
本発明の表示装置において、前記第2の電圧信号を供給する期間は、前記第1の電圧信号を供給する期間よりも長いことを特徴としてもよい。 In the display device of the present invention, the period for supplying the second voltage signal may be longer than the period for supplying the first voltage signal.
本発明の表示装置において、前記表示装置は、更に、前記検出手段の検出結果に基づいて、前記各複数の画素へ供給するデータ信号を補正する補正手段を有することを特徴としてもよい。 In the display device of the present invention, the display device may further include a correction unit that corrects a data signal supplied to each of the plurality of pixels based on a detection result of the detection unit.
本発明の表示装置において、前記検出手段は、前記各駆動トランジスタのソースへ定電流を供給する電流源を有し、前記検出手段は、前記各駆動トランジスタのソース電位を検出することを特徴としてもよい。 In the display device according to the aspect of the invention, the detection unit may include a current source that supplies a constant current to the source of each driving transistor, and the detection unit may detect a source potential of each driving transistor. Good.
本発明の表示装置において、前記検出手段は、前記各駆動トランジスタのソースへ定電圧を供給する電圧源を有し、前記検出手段は、前記各発光素子の一端における電位を検出することを特徴としてもよい。 In the display device according to the aspect of the invention, the detection unit includes a voltage source that supplies a constant voltage to the source of each driving transistor, and the detection unit detects a potential at one end of each light emitting element. Also good.
本発明の表示装置において、前記発光素子は、有機発光ダイオードであることを特徴としてもよい。 In the display device of the present invention, the light emitting element may be an organic light emitting diode.
本発明の表示装置において、前記駆動トランジスタは、TFTであることを特徴としてもよい。 In the display device of the present invention, the driving transistor may be a TFT.
本発明の表示装置において、前記TFTは、多結晶Si半導体デバイスであることを特徴としてもよい。 In the display device of the present invention, the TFT may be a polycrystalline Si semiconductor device.
本発明の表示装置において、前記TFTは、微結晶Si半導体デバイスであることを特徴としてもよい。 In the display device of the present invention, the TFT may be a microcrystalline Si semiconductor device.
本発明の表示装置において、前記TFTは、アモルファス半導体デバイスであることを特徴としてもよい。 In the display device of the present invention, the TFT may be an amorphous semiconductor device.
本発明の表示装置において、前記TFTは、酸化物半導体デバイスであることを特徴としてもよい。 In the display device of the present invention, the TFT may be an oxide semiconductor device.
各画素に含まれる駆動トランジスタの特性を高精度かつ高速度で検出することができる表示装置を提供することができる。 It is possible to provide a display device that can detect the characteristics of the drive transistor included in each pixel with high accuracy and high speed.
以下、本発明の実施形態について、図面を参照しつつ説明する。なお、図面については、同一又は同等の要素には同一の符号を付し、重複する説明は省略する。 Embodiments of the present invention will be described below with reference to the drawings. In addition, about drawing, the same code | symbol is attached | subjected to the same or equivalent element, and the overlapping description is abbreviate | omitted.
図1は、本発明の実施の形態に係る表示装置を示す図である。図1に示すように、表示装置100は、表示パネルを有するTFT(Thin Film Transistor)基板200を挟むように固定する上フレーム110及び下フレーム120と、表示する情報を生成する回路素子を備える回路基板140と、その回路基板140において生成されたRGBの情報をTFT基板200に伝えるフレキシブル基板130と、により構成される。
FIG. 1 is a diagram showing a display device according to an embodiment of the present invention. As shown in FIG. 1, a
図2及び図3は、図1に示した表示装置の構成を説明するための図である。図2に示すように、表示装置100は、表示用走査部201、表示領域203、検出用走査部208、データ線駆動部211等を有する。なお、図2においては、説明の簡略化のため、DT(v)、Dt(v+1)、及び、Data(h)、Data(h+1)で表したスイッチを、それぞれ検出用走査部208及びデータ線駆動部211の外部に示しているが、実際には検出用走査部208及びデータ線駆動部211の内部に形成される。
2 and 3 are diagrams for explaining the configuration of the display device shown in FIG. As shown in FIG. 2, the
また、表示用走査部201、検出用走査部208、データ線駆動部211は、各々別々のLSI等で形成してもよいし、1つのLSI等で形成してもよい。また、表示用走査部201、検出用走査部208、データ線駆動部211等は、例えば、TFT基板200上に形成される。
The
表示用走査部201は、走査線202を介して、表示領域203へ表示用走査信号を出力することにより、表示動作時にデータ信号を書き込む画素204、205、206、207や発光させる画素204、205、206、207を選択する。
The
なお、走査線202は、図2に示すように、マトリクス状に配置された各画素204、205、206、207の行方向に、検出線210及びデータ線209は、マトリクス状に配置された各画素204、205、206、207の列方向に、配置される。
As shown in FIG. 2, the
検出用走査部208は、走査線202を介して、表示領域203へ検査用走査信号を出力することにより、検出動作時にトラップ電圧及びデトラップ電圧を付加する画素204、205、206、207を選択する。
The
ここで、トラップ電圧とは、実際に駆動トランジスタ301の特性を検出する期間であるデトラップ期間において、駆動トランジスタ301のヒステリシスにおける変動を十分に抑制するために、駆動トランジスタ301のゲートに印加する電圧に相当する。また、デトラップ電圧とは、上記デトラップ期間において、駆動トランジスタ301のゲートに印加する電圧に相当する。なお、当該トラップ電圧、デトラップ電圧等については、後に詳述する。
Here, the trap voltage is a voltage applied to the gate of the
また、上記表示動作とは、各画素204、205、206、207の表示に関する動作をいい、具体的には、各画素204、205、206、207へのデータ信号の書き込み動作や、各画素204、205、206、207の発光についての動作等に相当する。検出動作とは、各画素204、205、206、207に含まれる各駆動トランジスタ301の特性の検出に関する動作をいうが、具体的には後述する。なお、当該検出動作は、例えば、上記表示動作の発光期間と書き込み動作の間に行われてもよいし、または、表示装置100が、例えば、携帯電話等である場合には、携帯電話の折りたたみ時等、画面の表示を行う必要がない時間に行われてもよい。
The display operation refers to an operation related to display of each of the
表示領域203は、マトリクス状に配置された複数の画素204、205、206、207を有する。また、各画素204、205、206、207は、駆動トランジスタ301、有機EL素子302、容量303、セレクトスイッチ304を有する。なお、図2においては、図面の簡略化のため、4の画素204、205、206、207のみを示しているが、必要に応じてその他の数が用いられることはいうまでもない。
The
図3(a)に示すように、駆動トランジスタ301は、ソースが、容量303の一端に接続され、ドレインが有機EL素子302のアノードに接続され、ゲートがセレクトスイッチ304のドレインに接続される。
As shown in FIG. 3A, the
有機EL素子302は、アノードが上述のように接続され、カソードは、接地される。
The
セレクトスイッチ304は、ゲートが走査線202に接続され、ソースがデータ線209に接続され、ドレインが、容量303の他端に接続される。
The
容量303は、一端が駆動トランジスタ301のソースに接続され、他端が駆動トランジスタ301のゲート及びセレクトスイッチ304のドレインに接続される。
The
電流源213は、駆動トランジスタ301のソースにスイッチ214を介して、接続され、検出期間に各検出線210に定電流Iを出力する。また、電圧源215は、スイッチ216を介して、駆動トランジスタ301のソースに接続され、表示動作時に駆動トランジスタ301を駆動する電源Voledを供給する。また、スイッチ214は、駆動トランジスタ301の特性を検出する検出動作時にオンし、スイッチ216は、表示装置100の表示動作時にオンする。
The
また、表示動作時には、表示用走査部201からの信号に応じてセレクトスイッチ304がオンし、容量303に、後述するデータ線駆動部211からのデータ信号に対応した信号が書き込まれる。そして、駆動トランジスタ301が、当該書き込まれた信号に応じて有機EL素子302を発光させることにより、表示領域203は、画像を表示する。なお、当該表示装置100の表示動作は周知であるため、詳細な説明については省略する。
In the display operation, the
データ線駆動部211は、図4に示すようにデータ信号駆動部401、検出信号駆動部402、補正部403を有する。データ信号駆動部401は、表示装置100の表示動作時に、データ線209を介して、表示する画素204、205、206、207の階調値に対応するデータ信号を各画素204、205、206、207に出力する。
As shown in FIG. 4, the data
検出信号駆動部402は、当該表示装置100の検出動作時に、データ線209を介してトラップ電圧及びデトラップ電圧を各画素204、205、206、207の駆動トランジスタ301のゲートに出力する。
The
補正部403は、検出部212からの各駆動トランジスタ301のソース電圧、及び、検出期間における検出信号駆動部402からの対応する各駆動トランジスタ301のゲートに与えられるデトラップ電圧から、各駆動トランジスタ301の閾値電圧Vthを求める。
The
具体的には、後述するデトラップ期間に、セレクトスイッチ304がオンすると、データ線209から駆動トランジスタ301のゲート端子にゲート電圧(Vg)が与えられる。検出部212は、当該状態において、駆動トランジスタ301のソース端子の電圧を検出する。
Specifically, when the
ここで、データ線209に与える電圧Vgから駆動トランジスタ301の閾値電圧Vthの絶対値を引いた値であるオーバードライブ電圧より、駆動トランジスタ301のソース・ドレイン間電圧Vdsが充分に大きい条件では、駆動トランジスタ301は、飽和領域を保つ。したがって、検出電圧(ソース電圧)とデータ線209に与える電圧(ゲート電圧Vg)から、電流源213から定電流Iを駆動トランジスタ301に流した時の駆動トランジスタ301のゲート・ソース間電圧Vgsを検出することができる。このゲート・ソース間電圧Vgsは、駆動トランジスタ301の持つ閾値電圧Vthのバラツキに対応する。よって、当該ゲート・ソース間電圧Vgsから、駆動トランジスタ301の持つ閾値電圧Vthを求めることができる。
Here, driving is performed under the condition that the source-drain voltage Vds of the driving
例えば、図3(b)に示したように、各画素204、205、206、207に含まれる駆動トランジスタ301のトランジスタ特性は、TFT特性1乃至3のいずれかとなる。そして、当該TFT特性1乃至3のそれぞれに対応するゲート・ソース間電圧Vgs1乃至Vgs3を検出することにより、各駆動トランジスタ301の閾値電圧Vthを求めることができる。なお、図3の例においては、当該ゲート電圧Vgがデトラップ電圧に相当するが、詳細には後述する。
For example, as illustrated in FIG. 3B, the transistor characteristics of the
上記のように、補正部403は、検出部212からの各駆動トランジスタ301のソース電圧、及び、検出信号駆動部402から対応する各駆動トランジスタ301のゲートに与えられるゲート電圧Vgに基づいて、各駆動トランジスタ301の閾値電圧を求める。そして、当該各駆動トランジスタ301の閾値電圧Vthのバラツキに基づき、各画素204、205、206、207の輝度のバラツキが少なくなるようにデータ信号を補正する補正信号を算出し、データ信号駆動部401に出力する。
As described above, the
なお、データ信号駆動部401は、当該補正信号に基づき、データ信号を各画素204、205、206、207に出力することはいうまでもない。また、具体的な補正信号の算出等については、例えば、上記特許文献1及び2等に記載された方法等を用いればよい。
Needless to say, the data signal
検出部212は、検出線210を介して、各駆動トランジスタ301のソースに接続され、検出期間に、電流源213からの定電流を駆動トランジスタ301に流した際の駆動トランジスタ301のソース電圧を検出する。
The
具体的には、検出部212は、図3(a)に示すように、例えば、バッファ回路305、ローパスフィルタ306、A/D変換器307を有する。
Specifically, the
バッファ回路305は、電流源213とローパスフィルタ306との間に配置される。具体的には、例えば、バッファ回路305はOPアンプから形成される。そして、OPアンプの非反転入力端子は、駆動トランジスタ301のソースに接続され、OPアンプの反転入力端子はOPアンプの出力端子に接続される。
The
ローパスフィルタ306は、入力側がバッファ回路305の出力端子に接続され、出力側は、A/D変換器307に接続される。
The low-
A/D変換器307は、駆動トランジスタ301のソース電圧をデジタルデータに変換し、当該データを補正部403に出力する。
The A /
次に、図5を用いて、各画素204、205、206、207の閾値電圧Vthの検出についての動作の概要について説明する。
Next, an outline of an operation for detecting the threshold voltage Vth of each of the
まず、待機期間においては、駆動トランジスタ301はオフである。1つの画素の検出期間中、後述するようにその他の全ての画素がオフされる。
First, in the standby period, the
次のトラップ期間においては、駆動トランジスタ301のゲートにトラップ電圧が入力される。なお、図5においては、当該トラップ電圧は、ΔVpに相当し、トラップ期間はΔTpに対応する。
In the next trap period, a trap voltage is input to the gate of the
次のデトラップ期間においては、駆動トランジスタ301のゲートにデトラップ電圧が入力され、このとき、検出部212は、駆動トランジスタ301のソース電圧を検出する。なお、図5においては、当該デトラップ電圧は、ΔVdに相当する。
In the next detrapping period, a detrapping voltage is input to the gate of the driving
上記のように、トラップ期間にはトラップ電圧を印加し、デトラップ期間における各駆動トランジスタ301のヒステリシスによる変動を抑制する。この点につき、下記により具体的に説明する。
As described above, a trap voltage is applied during the trap period, and fluctuation due to hysteresis of each
図6、図7、及び図8は、画素204、205、206、207内の各駆動トランジスタ301のヒステリシス特性について説明するための図である。
6, 7, and 8 are diagrams for explaining the hysteresis characteristics of the
駆動トランジスタ301のゲート電圧とドレイン電流の関係が図6に示すようなヒステリシス特性を有する場合がある。なお、図6において、縦軸は、駆動トランジスタ301のドレイン電流を表し、横軸は、駆動トランジスタ301のゲート・ソース間電圧を表す。
The relationship between the gate voltage and the drain current of the driving
このヒステリシス特性は、図7に示すような駆動トランジスタ301のゲート酸化膜にトラップされるキャリア(主に正電荷)の数によって生じる。
This hysteresis characteristic is caused by the number of carriers (mainly positive charges) trapped in the gate oxide film of the
具体的には、駆動トランジスタ301のゲート酸化膜には、図7(a)に示すように、ゲートにキャリアをトラップする状態と、一方、図7(b)に示すような、ゲートにキャリアをデトラップする状態がある。そして、ゲートにキャリアがトラップされた状態では駆動トランジスタ301の閾値電圧がエンハンスされ、デトラップされた状態ではディプリートされる。また、ゲートにキャリアをトラップする時間に比べて、デトラップする時間の方が充分に大きい。
Specifically, the gate oxide film of the driving
また、図8(a)に示すように、所定の電位差を所定期間駆動トランジスタ301のゲート・ソース間に印加する場合、当該電位差ΔVgが大きい程、また当該期間tonが長い程、図8(b)に示すように、当該電位差印加後の駆動トランジスタ301の特性は時間を経ても変化しにくい。
As shown in FIG. 8A, when a predetermined potential difference is applied between the gate and source of the driving
具体的には、例えば、図8(a)に示すように、図8(c)に示した場合と比べて、長い時間、大きな電位差を与える場合、図8(b)に示すように、当該電位差印加後の駆動トランジスタ301のゲート電圧・ドレイン電流の関係は、図8(d)に示した場合に比べ、時間が経過しても変化が少ない。いいかえれば、図8(a)に示した場合は、時間が経過しても、図8(b)のBで示した状態に近い特性C1を保つのに対し、図8(d)に示した場合は、図8(d)に示した特性C2のように、図8(b)に示した場合と比べ速く図8(d)のAで示した特性に近づく。
Specifically, for example, as shown in FIG. 8 (a), when a large potential difference is given for a long time compared to the case shown in FIG. 8 (c), as shown in FIG. The relationship between the gate voltage and the drain current of the driving
なお、図6に示した場合において、駆動トランジスタ301にゲートに印加される電位差の大きさ及び時間に応じて、駆動トランジスタ301のドレイン電流と経過時間についての特性は、図6に示したAからBの状態までばらつくものとして説明した。また、図6及び図8に示した特性A及びBは、それぞれ対応し、特性CはC1またはC2に対応する。
In the case shown in FIG. 6, the characteristics of the drain current and elapsed time of the driving
したがって、上記のようにΔVg及び当該ΔVgを与える期間を適切に調整することにより、図6及び図8に示した駆動トランジスタ301の特性Bから特性Aに回復する時定数を大きくし、実際に検出動作を行うデトラップ期間に各駆動トランジスタ301の特性を特性Bに近い特性に揃えてから、検出することができる。
Therefore, by appropriately adjusting ΔVg and the period during which ΔVg is applied as described above, the time constant for recovering from the characteristic B of the driving
つまり、トラップ電圧及びトラップ期間とはそれぞれ、上記のようにΔVgの印加後のデトラップ期間に、駆動トランジスタ301の特性変動を十分に抑制することができるΔVg及びΔVgを与える期間tonに相当する。また、デトラップ期間とは、当該トラップ電圧を印加するトラップ期間の後、実際に検出動作を行う期間に相当する。言い換えれば、トラップ電圧とは、駆動トランジスタ301の特性変動を、デトラップ期間において十分に抑制するために、駆動トランジスタ301のゲート・ソース間に印加する電圧であって、駆動トランジスタ301のゲートに印加する電圧に相当する。つまり、図8の例を用いて説明すれば、図8(b)において特性Bに近接した特性(例えば図8(b)のC1)を有するように、トラップ期間に駆動トランジスタ301のゲートに印加する電圧に相当する。
That is, the trap voltage and the trap period correspond to a period ton that gives ΔVg and ΔVg, respectively, that can sufficiently suppress the characteristic variation of the
具体的には、ΔVpは0.5V以上、10V以下の値が望ましいが、特に表示装置100に実装される電圧発生回路の負担を最小限に留めつつ最大限の効果を得るためには、1V以上5V以下であることがより望ましく、最適値は3V前後である。また、トラップ期間ΔTpは、0.1μ秒以上の値が望ましいが、特に多画素化に伴う高速駆動に支障なく最大限の効果を得るためには、1μ秒以上1m秒以下であることがより望ましく、最適値は10μ秒前後である。このように、トラップ期間tonよりデトラップ期間を長い状態とすることで、検出動作をより安定に行うことができる。
Specifically, ΔVp is preferably a value of 0.5 V or more and 10 V or less. In particular, in order to obtain the maximum effect while minimizing the burden on the voltage generation circuit mounted on the
次に、図9を用いて、本実施の形態における表示装置100全体としての検出動作の際に制御される信号のタイミングチャートについて説明する。なお、図2及び図3に示したように、本実施の形態においては、セレクトスイッチ304は、nMOSであることからゲート電圧が高電圧の時にオンし、駆動トランジスタ301はpMOSであることから、ゲート電圧が低電圧の時にオンすることはいうまでもない。
Next, a timing chart of signals controlled in the detection operation of the
時刻T0においては、DT(v)、Dt(v+1)をオンし、Data(h)及びData(h+1)をハイ電圧とする。これにより、各画素204乃至207に含まれるセレクトスイッチ304がオンするとともに、駆動トランジスタ301のゲート電圧を、ハイ電圧とする。これにより、全ての画素204乃至207の駆動トランジスタ301は、オフする。
At time T0, DT (v) and Dt (v + 1) are turned on, and Data (h) and Data (h + 1) are set to a high voltage. As a result, the
時刻T1においては、DT(v)をオンの状態に保ち、Dt(v+1)をオフする。また、Data(h)を上記トラップ電圧とする。これにより、画素204の駆動トランジスタ301のゲート端子にトラップ電圧を印加する。なお、図9においては、当該時刻T1から次の時刻T2までの期間がトラップ期間に相当する。また、ΔVpがトラップ電圧に相当する。
At time T1, DT (v) is kept on and Dt (v + 1) is turned off. Data (h) is the trap voltage. Thereby, a trap voltage is applied to the gate terminal of the driving
時刻T2においては、Data(h)を上記デトラップ電圧とする。よって、画素204の駆動トランジスタ301のゲート端子にデトラップ電圧が印加される。このとき、上述のように、画素204の駆動トランジスタ301のソースの電圧を検出する。なお、図9においては、当該時刻T2から次の時刻T3までの期間がデトラップ期間となる。また、ΔVdがデトラップ電圧に相当する。
At time T2, Data (h) is set as the detrapping voltage. Therefore, a detrapping voltage is applied to the gate terminal of the driving
その他の画素205乃至207についても、上記と同様にトラップ期間及びデトラップ期間を設ける。具体的には、時刻T3においては、DT(v)をオンの状態に保ち、Dt(v+1)をオンする。また、Data(h)をハイ電圧とし、及びData(h+1)をハイ電圧の状態に保つ。これにより、時刻T1と同様に、全ての画素204乃至207の駆動トランジスタ301は、オフする。
For the
時刻T4においては、DT(v)をオフし、Dt(v+1)などDT(V)以外のスイッチをオンの状態に保つ。また、Data(h)をトラップ電圧とする。Data(h)以外のデータ線はハイ電圧のままとする。これにより、画素205の駆動トランジスタ301のゲート端子にトラップ電圧を印加する。なお、当該時刻T4から次の時刻T5までの期間がトラップ期間に相当する。
At time T4, DT (v) is turned off, and switches other than DT (V) such as Dt (v + 1) are kept on. Data (h) is a trap voltage. Data lines other than Data (h) remain at a high voltage. Thereby, a trap voltage is applied to the gate terminal of the driving
時刻T5においては、Data(h)を、デトラップ電圧とする。このとき、画素Bの駆動トランジスタ301のソースの電圧を検出する。なお、当該時刻T5から次の時刻T6までの期間がデトラップ期間となる。
At time T5, Data (h) is set as a detrapping voltage. At this time, the voltage of the source of the driving
時刻T6においては、DT(v)をオンし、Dt(v+1)をオン状態に保つ。また、Data(h)をハイ電圧とし、及びData(h+1)をハイ電圧の状態に保つ。これにより、時刻T1と同様に、全ての画素の駆動トランジスタ301はオフする。
At time T6, DT (v) is turned on and Dt (v + 1) is kept on. Further, Data (h) is set to a high voltage, and Data (h + 1) is maintained at a high voltage state. Thereby, like the time T1, the driving
時刻T7においては、DT(v)などDT(V+1)以外のスイッチをオン状態に保ち、Dt(v+1)をオフする。また、Data(h+1)を上記トラップ電圧とする。Data(h+1)以外のデータ線はハイ電圧のままとする。これにより、画素206の駆動トランジスタ301のゲート端子にトラップ電圧を印加する。なお、当該時刻T7から次の時刻T8までの期間がトラップ期間に相当する。
At time T7, switches other than DT (V + 1) such as DT (v) are kept on, and Dt (v + 1) is turned off. Data (h + 1) is the trap voltage. Data lines other than Data (h + 1) remain at a high voltage. Thereby, a trap voltage is applied to the gate terminal of the driving
時刻T8においては、Data(h+1)を、上記デトラップ電圧とする。このとき、画素206の駆動トランジスタ301のソースの電圧を検出する。なお、当該時刻T8から次の時刻T9までの期間がデトラップ期間となる。
At time T8, Data (h + 1) is set as the detrapping voltage. At this time, the voltage of the source of the driving
時刻T9においては、DT(v)をオンの状態に保ち、Dt(v+1)をオンする。また、Data(h)をハイ電圧に保ち、及びData(h+1)をハイ電圧とする。これにより、時刻T1と同様に、全ての画素の駆動トランジスタ301はオフする。
At time T9, DT (v) is kept on and Dt (v + 1) is turned on. Further, Data (h) is kept at a high voltage, and Data (h + 1) is made a high voltage. Thereby, like the time T1, the driving
時刻T10においては、DT(v)をオフし、Dt(v+1)をオン状態に保つ。また、Data(h+1)を上記トラップ電圧とする。これにより、画素207の駆動トランジスタ301のゲート端子にトラップ電圧を印加する。なお、当該時刻T10から次の時刻T11までの期間がトラップ期間に相当する。
At time T10, DT (v) is turned off and Dt (v + 1) is kept on. Data (h + 1) is the trap voltage. Thereby, a trap voltage is applied to the gate terminal of the
時刻T11においては、Data(h+1)を、上記デトラップ電圧とする。このとき、画素207の駆動トランジスタ301のソースの電圧が検出される。なお、当該時刻T11から次の時刻T12までの期間がデトラップ期間となる。
At time T11, Data (h + 1) is set as the detrapping voltage. At this time, the voltage of the source of the driving
時刻T12においては、DT(v)をオンし、Dt(v+1)をオン状態に保つ。また、Data(h)をハイ電圧の状態に保ち、Data(h+1)をハイ電圧とする。これにより、全て画素204乃至207の駆動トランジスタ301はオフする。
At time T12, DT (v) is turned on and Dt (v + 1) is kept on. Further, Data (h) is kept at a high voltage state, and Data (h + 1) is set to a high voltage. As a result, the driving
上記のように、図2に示した画素204、205、206、207の順に、順次、各画素204、205、206、207に含まれる駆動トランジスタ301のソース電圧を検出する。なお、図2及び9については、図面の簡略化のため、表示領域203が4の画素のみを有する場合について説明したが、その他の数の画素を有する場合にも同様に、順次各画素に含まれる駆動トランジスタのソース電圧を検出することはいうまでもない。
As described above, the source voltage of the
なお、本実施の形態における表示装置100は、例えば、図10または図11に示すような、携帯電話150やPDA160等の携帯端末やテレビ170、ビデオカメラ180等に実装される。その他、本実施形態における表示装置100は、パソコン用ディスプレイ、公告表示用ディスプレイ等の各種の情報表示用の表示装置として採用できる。また、デジタルスチルカメラ、カーナビゲーションシステム、カーオーディオ、ゲーム機器、携帯情報端末など、各種の電子機器の表示部として利用することも可能である。
Note that the
また、以上の説明においては発光素子として有機EL素子302を用いることとしたが、これに限らず、本実施の形態に係る表示装置100は、例えば無機EL素子やFED(Field-Emission Device)など、各種の発光素子を用いた表示装置100であってもよい。また、駆動トランジスタ301は、例えば多結晶Si半導体デバイス、微結晶Si半導体デバイス、アモルファス半導体デバイス、または、酸化物半導体デバイスにより形成される。
In the above description, the
上記のように構成することで、本実施の形態に係る表示装置100によれば、各画素に含まれる駆動トランジスタのヒステリシスによる影響を抑制しつつ、各駆動トランジスタの特性を検出することができる。よって、従来技術に比べ、高精度かつ高速度で各駆動トランジスタの特性を検出することができる。また、当該検出結果に応じてデータ信号を補正することで、従来技術に比べ、高画質化を図ることができる。
With the configuration described above, according to
なお、本発明は、上記実施の形態に限定されるものではなく、種々の変形が可能である。例えば、上記実施の形態で示した構成と実質的に同一の構成、同一の作用効果を奏する構成又は同一の目的を達成することができる構成で置き換えてもよい。 In addition, this invention is not limited to the said embodiment, A various deformation | transformation is possible. For example, a configuration that is substantially the same as the configuration described in the above embodiment, a configuration that exhibits the same effects, or a configuration that can achieve the same object may be used.
[変形例]
図12及び13は、本発明の変形例を説明するための図である。本変形例では、上記実施の形態と比較して、主に、検出部212の配置が異なる。その他の点は、上記実施の形態と同様であり、同様である点については説明を省略する。
[Modification]
12 and 13 are diagrams for explaining a modification of the present invention. In this modification, the arrangement of the
図12及び13に示すように、有機EL素子302のカソードには抵抗217の一端が接続され、当該抵抗217の他端は接地される。
As shown in FIGS. 12 and 13, one end of a
また、検出部212は、当該有機EL素子302の抵抗217の接続部分に接続される。つまり、本変形例においては、検出部212は、当該抵抗217の抵抗値Rと当該抵抗217を流れる電流値Id(例えば図3(b)のId1乃至Id3)との積を検出する。そして、補正部403は、当該積に基づいて、各駆動トランジスタ301の閾値電圧を求める。つまり、本変形例においては、電流源213及びそのスイッチ214は、不要である。なお、その他の構成及び動作については、上記実施の形態と同様であるので、説明を省略する。また、ここでは当該有機EL素子302のカソード側において検出部を設けた例を述べたが、当該有機EL素子の電極構成によってはアノード側となる場合もある。
The
上記のように構成することで、上記実施の形態と同様、本変形例による表示装置100によれば、各画素に含まれる駆動トランジスタのヒステリシスによる影響を抑制しつつ、各駆動トランジスタの特性を検出することができる。よって、従来技術に比べ、高精度かつ高速度で各駆動トランジスタの特性を検出することができる。また、当該検出結果に応じてデータ信号を補正することで、従来技術に比べ、高画質化を図ることができる。
With the configuration described above, as in the above embodiment, the
なお、本発明は、上記実施の形態及び変形例に限定されるものではなく、種々の変形が可能である。例えば、上記変形例で示した構成と実質的に同一の構成、同一の作用効果を奏する構成又は同一の目的を達成することができる構成で置き換えてもよい。 In addition, this invention is not limited to the said embodiment and modification, A various deformation | transformation is possible. For example, the configuration may be replaced with a configuration that is substantially the same as the configuration described in the above modification, a configuration that exhibits the same effects, or a configuration that can achieve the same purpose.
100 表示装置、110 上フレーム、120 下フレーム、130 フレキシブル基板、140 回路基板、200 TFT基板、201 表示用走査部、202 走査線、203 表示領域、204、205、206、207 画素、208 検出用走査部、209 データ線、210 検出線、211 データ線駆動部、212 検出部、213 電流源、214 スイッチ、215 電圧源、301 駆動トランジスタ、302 有機EL素子、303 容量、304 セレクトスイッチ、401 データ信号駆動部、402 検出信号駆動部、403 補正部。 100 display device, 110 upper frame, 120 lower frame, 130 flexible substrate, 140 circuit substrate, 200 TFT substrate, 201 display scanning unit, 202 scanning line, 203 display region, 204, 205, 206, 207 pixels, 208 for detection Scanning unit, 209 data line, 210 detection line, 211 data line drive unit, 212 detection unit, 213 current source, 214 switch, 215 voltage source, 301 drive transistor, 302 organic EL element, 303 capacitance, 304 select switch, 401 data Signal drive unit, 402 detection signal drive unit, 403 correction unit.
Claims (11)
前記第1の電圧信号は、前記第2の電圧信号に比べ、前記駆動トランジスタのソース・ドレイン間により多くの電流を供給可能な電圧を有する電圧信号であることを特徴とする表示装置。 A plurality of pixels each having a light emitting element and a driving transistor for supplying a current corresponding to a gradation value to the light emitting element; a detecting means for detecting a characteristic of each driving transistor; and after light emission of each light emitting element , Means for supplying a first voltage signal between the gate and source of each driving transistor, and the first voltage between the gate and source of each driving transistor after the first voltage signal is supplied. Means for supplying a second voltage signal different from the signal, and the detecting means detects the characteristics of the respective drive transistors during the period of supplying the second voltage signal,
The display device, wherein the first voltage signal is a voltage signal having a voltage capable of supplying more current between the source and the drain of the driving transistor than the second voltage signal.
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