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JP2011081363A - 有機発光表示装置及びその製造方法 - Google Patents

有機発光表示装置及びその製造方法 Download PDF

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JP2011081363A JP2010195556A JP2010195556A JP2011081363A JP 2011081363 A JP2011081363 A JP 2011081363A JP 2010195556 A JP2010195556 A JP 2010195556A JP 2010195556 A JP2010195556 A JP 2010195556A JP 2011081363 A JP2011081363 A JP 2011081363A
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五燮 權
Moo-Soon Ko
武恂 高
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Abstract

【課題】効果的に不純物がドーピングされた多結晶シリコン膜をキャパシタの電極として使用した有機発光表示装置を提供する。
【解決手段】本発明の実施例による有機発光表示装置は、基板本体、前記基板本体上の同一層に形成された半導体層及び第1キャパシタ電極、前記半導体層及び前記第1キャパシタ電極上に形成されたゲート絶縁膜、前記ゲート絶縁膜を間において前記半導体層上に形成されたゲート電極、そして前記ゲート絶縁膜を間において前記第1キャパシタ電極上に形成されて、前記ゲート電極と同一層に形成された第2キャパシタ電極を含む。そして、前記第1キャパシタ電極及び前記半導体層は、各々不純物がドーピングされた多結晶シリコン膜を含み、前記第2キャパシタ電極は前記ゲート電極より相対的に厚さが薄い。
【選択図】図3

Description

本発明は、有機発光表示装置に関するものであり、より詳細には、不純物がドーピングされた多結晶シリコン膜をキャパシタの電極として使用した有機発光表示装置に関するものである。
有機発光表示装置(organic light emitting diode display)は、光を放出する有機発光素子(organic light emitting diode)を含んで画像を表示する自発光型表示装置である。有機発光表示装置は、液晶表示装置(liquid−crystal−displayay)とは異なって、別途の光源が不要であるので、相対的に厚さ及び重量を減少させることができる。また、有機発光表示装置は、低い消費電力、高い輝度、及び高い反応速度などの高品位特性を示すので、携帯用電子機器の次世代表示装置として注目されている。
有機発光表示装置は、駆動方式によって受動駆動型(passive matrix type)及び能動駆動型(active matrix type)に区分される。能動駆動型有機発光表示装置は、各画素ごとに形成された有機発光素子、薄膜トランジスター(thin−film−transistor、TFT)、及びキャパシタ(capacitor)を含んで、画素を独立的に制御する。
キャパシタは、通常、薄膜トランジスターと同時に形成することができる。例えば、キャパシタの両電極を各々薄膜トランジスターの半導体層及びゲート電極と同時に形成することができる。この時、半導体層及びキャパシタの両電極のうちの一電極は不純物がドーピングされた多結晶シリコン膜を含む。
しかし、キャパシタの一電極を不純物がドーピングされた多結晶シリコン膜で形成するためには、キャパシタの一電極を形成するための別途のドーピングマスク工程が追加されなければならないので、工程が複雑になって、製造費用が高くなる問題点がある。
本発明は、前述した背景技術の問題点を解決するためのものであって、効果的に不純物がドーピングされた多結晶シリコン膜をキャパシタの電極として使用した有機発光表示装置を提供する。
また、前記有機発光表示装置の製造工程を単純化させた製造方法を提供する。
本発明の実施例による有機発光表示装置は、基板本体、前記基板本体上の同一層に形成された半導体層及び第1キャパシタ電極、前記半導体層及び前記第1キャパシタ電極上に形成されたゲート絶縁膜、前記ゲート絶縁膜を間において前記半導体層上に形成されたゲート電極、そして前記ゲート絶縁膜を間において前記第1キャパシタ電極上に形成されて、前記ゲート電極と同一層に形成された第2キャパシタ電極を含む。そして、前記第1キャパシタ電極及び前記半導体層は、各々不純物がドーピングされた多結晶シリコン膜を含み、前記第2キャパシタ電極は前記ゲート電極より相対的に厚さが薄い。
前記ゲート電極及び前記第2キャパシタ電極は、互いに同一な金属物質を含み、前記金属物質は、モリブデン(Mo)、クロム(Cr)、及びタングステン(W)のうちの一つ以上を含む。
前記ゲート電極は厚さが170nm以上であり、前記第2キャパシタ電極は厚さが前記ゲート電極の厚さの75%以下である。
前記第1キャパシタ電極及び前記半導体層に各々ドーピングされた不純物は、P型不純物及びN型不純物のうちのいずれか一つである。
前記不純物はホウ素(boron)を含むことができる。
前記ゲート絶縁膜は、テトラエトキシシラン(tetra ethyl ortho silicate、TEOS)、窒化ケイ素(SiN)、及び酸化ケイ素(SiO)のうちの一つ以上を含むことができる。
前記半導体層は、前記ゲート電極と重畳したチャンネル領域、そして前記チャンネル領域の両側に形成されたソース領域及びドレイン領域に区分される。
前記半導体層の前記チャンネル領域は真性半導体(intrinsic semiconductor)であり、前記半導体層の前記ソース領域及び前記ドレイン領域、そして前記第1キャパシタ電極は不純物半導体(impurity semiconductor)である。
前記有機発光表示装置において、前記第2キャパシタ電極は厚さが10nm乃至140nmの範囲内に属する。
また、本発明の実施例による有機発光表示装置の製造方法は、基板本体上に多結晶シリコン膜を形成する段階、前記多結晶シリコン膜をパターニング(patterning)して半導体層中間体及び第1キャパシタ電極中間体を形成する段階、前記半導体層中間体及び前記第1キャパシタ電極中間体上にゲート絶縁膜を形成する段階、前記ゲート絶縁膜上に前記半導体層中間体の一部と重畳するようにゲート電極を形成し、前記第1キャパシタ電極中間体と重畳するように第2キャパシタ電極を形成する段階、そして前記半導体層中間体及び前記第1キャパシタ電極中間体に不純物をドーピングして半導体層及び第1キャパシタ電極を形成する段階を含む。そして、前記第2キャパシタ電極は前記ゲート電極より相対的に厚さが薄く、前記不純物は前記第2キャパシタ電極を透過して前記第1キャパシタ電極にドーピングされる。
前記ゲート電極及び前記第2キャパシタ電極は、互いに同一な金属物質を含み、前記金属物質は、モリブデン(Mo)、クロム(Cr)、及びタングステン(W)のうちの一つ以上を含むことができる。
前記ゲート電極は厚さが170nm以上であり、前記第2キャパシタ電極は厚さが前記ゲート電極の厚さの75%以下である。
前記第2キャパシタ電極は厚さが10nm乃至140nmの範囲内に属する。
前記不純物は、P型不純物及びN型不純物のうちのいずれか一つである。
前記不純物はホウ素(boron)を含むことができる。
前記不純物は、80keV以上のエネルギー及び1.0e15atoms/cm以上のドーズ(dose)量でイオン注入される。
前記ゲート絶縁膜は、テトラエトキシシラン(tetra ethyl ortho silicate、TEOS)、窒化ケイ素(SiN)、及び酸化ケイ素(SiO)のうちの一つ以上を含むことができる。
前記半導体層は、前記ゲート電極と重畳したチャンネル領域、そして前記チャンネル領域の両側に形成されたソース領域及びドレイン領域に区分される。
前記半導体層の前記チャンネル領域は真性半導体(intrinsic semiconductor)であり、前記半導体層の前記ソース領域及び前記ドレイン領域、そして前記第1キャパシタ電極は不純物半導体(impurity semiconductor)である。
前記有機発光表示装置の製造方法において、前記ゲート電極及び前記第2キャパシタ電極は、前記ゲート絶縁膜上にゲート金属膜を形成した後、前記ゲート金属膜を感光膜パターンを利用した写真エッチング工程によってパターニングして形成される。そして、前記感光膜パターンは、前記ゲート電極上に位置する第1部分、及び前記第1部分より相対的に厚さが薄くて、前記第2キャパシタ電極上に位置する第2部分を含むことができる。
前記感光膜パターンによって前記ゲート金属膜をエッチングして前記ゲート電極及び第2キャパシタ電極中間体を形成した後、前記感光膜パターンの第2部分を除去し、再び前記第2キャパシタ電極中間体の一部をエッチングして前記キャパシタ電極を形成することができる。
前記感光膜パターンは、前記ゲート金属膜上に感光膜を形成し、第1マスクを使用して前記感光膜を1次露光させ、第2マスクを使用して前記感光膜を2次露光させた後、前記感光膜を現像して形成される。
前記第1マスクは、前記ゲート電極が形成される位置が露光されるのを遮断するゲート遮蔽部、及び前記第2キャパシタ電極が形成される位置が露光されるのを遮断するキャパシタ遮蔽部を含むことができる。
前記第2マスクは、前記ゲート電極が形成される位置が露光されるのを遮断するゲート遮蔽部を含むことができる。
本発明によれば、有機発光表示装置は、効果的に不純物がドーピングされた多結晶シリコン膜をキャパシタの電極として使用することができる。
また、前記有機発光表示装置の製造方法を単純化させることができる。
本発明の一実施例による有機発光表示装置の構造を概略的に示した平面図である。 図1の有機発光表示装置が含む画素回路を示した回路図である。 図1の有機発光表示装置を部分拡大して示した断面図である。 図1の有機発光表示装置の製造過程を順次に示した断面図である。 図1の有機発光表示装置の製造過程を順次に示した断面図である。 図1の有機発光表示装置の製造過程を順次に示した断面図である。 図1の有機発光表示装置の製造過程を順次に示した断面図である。 図1の有機発光表示装置の製造過程を順次に示した断面図である。 図1の有機発光表示装置の製造過程を順次に示した断面図である。 図1の有機発光表示装置の製造過程を順次に示した断面図である。 図1の有機発光表示装置の製造過程を順次に示した断面図である。 図1の有機発光表示装置の製造過程を順次に示した断面図である。 図1の有機発光表示装置の製造過程を順次に示した断面図である。 実験例及び比較例のCV特性を各々示したグラフである。 実験例及び比較例のCV特性を各々示したグラフである。 実験例及び比較例のCV特性を各々示したグラフである。 実験例及び比較例のCV特性を各々示したグラフである。
以下、添付した図面を参照して、本発明の実施例について、本発明が属する技術分野で通常の知識を有する者が容易に実施できるように詳細に説明する。しかし、本発明は、多様な相異した形態に具現され、ここで説明する実施例に限定されない。
本発明を明確に説明するために、説明に不要な部分は省略し、明細書全体にわたって同一または類似した構成要素については、同一な参照符号を付けた。
また、図面に示した各構成の大きさ及び厚さは、説明の便宜のために任意に示したものであるため、本発明が必ずしも示されたものに限定されるのではない。
図面では、多様な層及び領域を明確に表現するために、厚さを拡大して示した。そして、図面においては、説明の便宜のために、一部の層及び領域の厚さを誇張して示した。層、膜、領域、板などの部分が他の部分の「上に」または「上部に」あるとする時、これは他の部分の「真上に」ある場合だけでなく、その中間にまた他の部分がある場合も含む。
以下、図1乃至図3を参照して、本発明の一実施例による有機発光表示装置101について説明する。
図1に図示したように、有機発光表示装置101は、表示領域(DA)及び非表示領域(NA)に区分された基板本体111を含む。基板本体111の表示領域(DA)には複数の画素(PE)が形成されて画像を表示し、非表示領域(NA)には一つ以上の駆動回路(GD、DD)が形成される。しかし、本発明の一実施例では、非表示領域(NA)に駆動回路(GD、DD)が必ず形成されなければならないのではなく、省略されてもよい。
図2に示したように、本発明の一実施例では、一つの画素(PE)が有機発光素子(organic light emitting diode)70、二つの薄膜トランジスター(TFT)10、20、そして一つのキャパシタ(capacitor)80を備えた2Tr−1Cap構造を有する。しかし、本発明の一実施例がこれに限定されるのではない。したがって、有機発光表示装置101は、一つの画素(PE)に三つ以上の薄膜トランジスター及び二つ以上のキャパシタを備え、別途の配線がさらに形成されて、多様な構造を有するように形成することもできる。このように追加的に形成される薄膜トランジスター及びキャパシタは、補償回路の構成になることができる。
補償回路は、各画素(PE)ごとに形成された有機発光素子70の均一性を向上させて、画質に偏差が発生するのを抑制する。一般に、補償回路は、2つ乃至8つの薄膜トランジスターを含む。
また、基板本体111の非表示領域(NA)上に形成された駆動回路(GD、DD)(図1に図示)も追加的に形成される薄膜トランジスターを含むことができる。
有機発光素子70は、正孔注入電極であるアノード電極、電子注入電極であるカソード電極、そしてアノード電極及びカソード電極の間に配置された有機発光層を含む。
本発明の一実施例で、一つの画素(PE)は、第1薄膜トランジスター10及び第2薄膜トランジスター20を含む。
第1薄膜トランジスター10及び第2薄膜トランジスター20は、各々ゲート電極、半導体層、ソース電極、及びドレイン電極を含む。そして、第1薄膜トランジスター10及び第2薄膜トランジスター20のうちの一つ以上の薄膜トランジスターの半導体層は、不純物がドーピングされた多結晶シリコン膜を含む。つまり、第1薄膜トランジスター10及び第2薄膜トランジスター20のうちの一つ以上の薄膜トランジスターは、多結晶シリコン薄膜トランジスターである。
図2にはゲートライン(GL)、データライン(DL)、及び共通電源ライン(VDD)と共にキャパシタライン(CL)が示されているが、本発明の一実施例が図2に示された構造に限定されるのではない。したがって、キャパシタライン(CL)は、場合によっては省略されてもよい。
データライン(DL)には第1薄膜トランジスター10のソース電極が連結され、ゲートライン(GL)には第1薄膜トランジスター10のゲート電極が連結される。そして、第1薄膜トランジスター10のドレイン電極は、キャパシタ80を通じてキャパシタライン(CL)に連結される。そして、第1薄膜トランジスター10のドレイン電極及びキャパシタ80の間にノードが形成されて、第2薄膜トランジスター20のゲート電極が連結される。そして、第2薄膜トランジスター20のドレイン電極には共通電源ライン(VDD)が連結され、ソース電極には有機発光素子70のアノード電極が連結される。
第1薄膜トランジスター10は、発光させようとする画素(PE)を選択するスイッチング素子として使用される。第1薄膜トランジスター10が瞬間的に導通されるとキャパシタ80は蓄電され、この時に蓄電される電荷量は、データライン(DL)から印加される電圧の電位に比例する。そして、第1薄膜トランジスター10が遮断された状態でキャパシタライン(CL)に1フレーム周期で電圧が増加する信号が入力されると、第2薄膜トランジスター20のゲート電位は、キャパシタ80に蓄電された電位を基準にして印加される電圧のレベルがキャパシタライン(CL)を通じて印加される電圧に伴って上昇する。そして、第2薄膜トランジスター20は、ゲート電位がしきい電圧を超えると導通される。そうすると、共通電源ライン(VDD)に印加された電圧が第2薄膜トランジスター20を通じて有機発光素子70に印加されて、有機発光素子70は発光する。
このような画素(PE)の構成は、前述したものに限定されず、当該技術分野の当業者が容易に変形実施できる範囲内で多様に変形可能である。
以下、図3を参照して、本発明の一実施例による有機発光表示装置101について、第2薄膜トランジスター20及びキャパシタ80の構造を中心に積層順序に応じて詳細に説明する。以下では、第2薄膜トランジスター20を薄膜トランジスターという。
基板本体111は、ガラス、石英、セラミック、及びプラスチックなどからなる絶縁性基板で形成される。しかし、本発明の一実施例がこれに限定されるのではなく、基板本体111は、ステンレス鋼などからなる金属性基板で形成されてもよい。
基板本体111上にはバッファー層120が形成される。一例として、バッファー層120は、窒化ケイ素(SiN)の単一膜、または窒化ケイ素(SiN)及び酸化ケイ素(SiO)が積層された二重膜構造に形成される。バッファー層120は、不純元素または水分などの不要な成分の浸透を防止すると同時に、表面を平坦化する役割を果たす。しかし、バッファー層120は必ずしも必要な構成ではなく、基板本体111の種類及び工程条件によっては省略されてもよい。
バッファー層120上には半導体層135及び第1キャパシタ電極138が形成される。つまり、半導体層135及び第1キャパシタ電極138は同一層に形成される。また、半導体層135及び第1キャパシタ電極138は、各々不純物がドーピングされた多結晶シリコン膜を含む。
具体的に、半導体層135は、チャンネル領域1355、そしてチャンネル領域1355の両側に各々形成されたソース領域1357及びドレイン領域1356に区分される。半導体層135のチャンネル領域1355は、不純物がドーピングされない多結晶シリコン膜、つまり真性半導体(intrinsic semiconductor)である。半導体層135のソース領域1357及びドレイン領域1356は、不純物がドーピングされた多結晶シリコン膜、つまり不純物半導体(impurity semiconductor)である。また、第1キャパシタ電極138は、半導体層135のソース領域1357及びドレイン領域1356と実質的に同一に不純物がドーピングされた多結晶シリコン膜で形成される。つまり、第1キャパシタ電極138は、半導体層135のソース領域1357及びドレイン領域1356が形成される時に共に形成される。
半導体層135のソース領域1357及びドレイン領域1356、そして第1キャパシタ電極185にドーピングされる不純物は、P型不純物及びN型不純物のうちのいずれか一つである。不純物の種類は薄膜トランジスター20の種類によって異なってもよい。本発明の一実施例では、不純物としてホウ素(boron、B)を含むP型不純物が使用されるが、これに限定されない。ここで、ホウ素を含む不純物はBであり、ホウ素イオンが多結晶シリコン膜にドーピングされて、半導体層135のソース領域1357及びドレイン領域1356、そして第1キャパシタ電極185が形成される。
半導体層135及び第1キャパシタ電極138上にはゲート絶縁膜140が形成される。ゲート絶縁膜140は、テトラエトキシシラン(tetra ethyl ortho silicate、TEOS)、窒化ケイ素(SiN)、及び酸化ケイ素(SiO)のうちの一つ以上を含んで形成される。一例として、ゲート絶縁膜140は、厚さが40nmの窒化シリコン膜及び厚さが80nmのテトラエトキシシラン膜が順次に積層された二重膜に形成される。しかし、本発明の一実施例で、ゲート絶縁膜140が前述した構成に限定されるのではない。
ゲート絶縁膜140上にはゲート電極155及び第2キャパシタ電極158が形成される。ゲート電極155及び第2キャパシタ電極158は、互いに同一な層に位置し、実質的に同一な金属物質で形成される。この時、金属物質は、モリブデン(Mo)、クロム(Cr)、及びタングステン(W)のうちの一つ以上を含む。一例として、ゲート電極155及び第2キャパシタ電極158は、モリブデン(Mo)またはモリブデン(Mo)を含む合金で形成される。しかし、第2キャパシタ電極158はゲート電極155より相対的に厚さが薄い。一例として、ゲート電極155は厚さが170nm以上であり、第2キャパシタ電極158は厚さがゲート電極155の厚さの75%以下である。
ゲート電極155は、半導体層135のチャンネル領域1355と重畳するように半導体層135上に形成される。ゲート電極155は、半導体層135を形成する過程で半導体層135のソース領域1357及びドレイン領域1356に不純物をドーピングする時にチャンネル領域1355に不純物がドーピングされるのを遮断する役割を果たす。したがって、ゲート電極155の厚さが170nm未満である場合には、必要以上の不純物がゲート電極155を通過して半導体層135にドーピングされることがある。つまり、ゲート電極155が半導体層135のチャンネル領域1355に不純物がドーピングされるのを適切に遮断することができない。
第2キャパシタ電極158は、第1キャパシタ電極138上に形成される。この時、不純物は、第2キャパシタ電極158を通過して第1キャパシタ電極138にドーピングされる。したがって、第2キャパシタ電極158の厚さが厚すぎると、不純物が第2キャパシタ電極158を通過することができず、第1キャパシタ電極138が適切な導電性を確保することができずに不良になる。また、第2キャパシタ電極158の厚さが薄すぎると、第2キャパシタ電極158の電気的特性が低下して、キャパシタ80の静電容量が不良になる。このような問題点を考慮して、第2キャパシタ電極158は厚さが10nm乃至140nmの範囲内に属するのが効果的である。
このように、第2キャパシタ電極158がゲート絶縁膜140を間において第1キャパシタ電極138上に形成されると、本発明の一実施例によるキャパシタ80が完成される。この時、ゲート絶縁膜140は、キャパシタ80の誘電体となる。
ゲート電極155及び第2キャパシタ電極158上には層間絶縁膜160が形成される。層間絶縁膜160は、ゲート絶縁膜140と同様にテトラエトキシシラン(tetra ethyl ortho silicate、TEOS)、窒化ケイ素(SiN)、または酸化ケイ素(SiO)などで形成されるが、これに限定されない。
層間絶縁膜160及びゲート絶縁膜140は、共に半導体層135のソース領域1357及びドレイン領域1356の一部を各々露出するソース接触孔167及びドレイン接触孔166を有する。
層間絶縁膜160上にはソース接触孔167及びドレイン電極孔166を通じて半導体層135のソース領域1357及びドレイン領域1356と各々接触して互いに離隔したソース電極177及びドレイン電極176が形成される。これによって、本発明の一実施例による薄膜トランジスター20が完成される。
また、図示してはいないが、層間絶縁膜160上にはソース電極177及びドレイン電極176と同一層に同一な素材で形成された追加のキャパシタ電極が配置される。この時、追加のキャパシタは、第1キャパシタ電極138及び第2キャパシタ電極158のうちの一つ以上の電極と重畳するように形成される。このように、追加のキャパシタ電極が配置される場合、キャパシタ80はデュアル構造を有して、蓄電容量をより向上させることができる。
層間絶縁膜160上にはソース電極177及びドレイン電極176を覆う平坦化膜180が形成される。平坦化膜180は、その上に形成される有機発光素子70の発光効率を向上させるために段差をなくして平坦化させる役割を果たす。また、平坦化膜180は、ドレイン電極176の一部を露出させるアノード接触孔186を有する。
平坦化膜180は、ポリアクリル系樹脂(polyacrylates resin)、エポキシ樹脂(epoxy resin)、フェノール樹脂(phenolic resin)、ポリアミド系樹脂(polyamides resin)、ポリイミド系樹脂(polyimides rein)、不飽和ポリエステル系樹脂(unsaturated polyesters resin)、ポリフェニレン系樹脂(poly(phenylenethers) resin)、ポリフェニレンスルフィド系樹脂(poly(phenylenesulfides) resin)、及びベンゾシクロブテン(benzocyclobutene、BCB)のうちの一つ以上の物質を含んで形成される。
平坦化膜180上には有機発光素子70の画素電極710が形成される。ここで、画素電極710はアノード電極をいう。画素電極710は、平坦化膜180のアノード接触孔186を通じてドレイン電極176と連結される。
また、平坦化膜180上には画素電極710を露出する開口部195を有する画素定義膜190が形成される。つまり、画素電極710は、画素定義膜190の開口部195に対応するように配置される。画素定義膜190は、ポリアクリル系(polyacrylates)またはポリイミド系(polyimides)などの樹脂及びシリカ系の無機物などを含んで形成される。
画素定義膜190の開口部195内で画素電極710上には有機発光層720が形成され、画素定義膜190及び有機発光層720上には共通電極730が形成される。ここで、共通電極730はカソード電極をいう。
このように、画素電極710、有機発光層720、及び共通電極730を含む有機発光素子70が形成される。
有機発光表示装置101は、有機発光素子70が光を放出する方向によって前面表示型、背面表示型、及び両面表示型のうちのいずれかの構造を有する。
有機発光表示装置101が前面表示型である場合には、画素電極710は反射膜で形成され、共通電極730は半透過膜で形成される。反面、有機表示装置101が背面表示型である場合には、画素電極710は半透過膜で形成され、共通電極730は反射膜で形成される。また、有機表示装置101が両面表示型である場合には、画素電極710及び共通電極730は透明膜または半透過膜で形成される。
反射膜及び半透過膜は、マグネシウム(Mg)、銀(Ag)、金(Au)、カルシウム(Ca)、リチウム(Li)、クロム(Cr)、及びアルミニウム(Al)のうちの一つ以上の金属、またはこれらの合金を使用して形成される。この時、反射膜及び半透過膜は厚さによって決定される。一般に、半透過膜は厚さが200nm以下である。半透過膜は、厚さが薄くなるほど光の透過率が高くなり、厚さが厚くなるほど光の透過率が低くなる。
透明膜は、ITO(Indium Tin Oxide)、IZO(Indium Zinc Oxide)、ZnO(酸化亜鉛)、またはIn(Indium Oxide)などの物質を使用して形成される。
また、有機発光層720は、発光層、正孔注入層(hole−injection layer、HIL)、正孔輸送層(hole−transporting layer、HTL)、電子輸送層(electron−transportiong layer、ETL)、及び電子注入層(electron−injection layer、EIL)のうちの一つ以上を含む多重膜に形成される。有機発光層720がこれらの全てを含む場合、正孔注入層がアノード電極の画素電極710上に配置され、その上に正孔輸送層、発光層、電子輸送層、電子注入層が順次に積層される。また、有機発光層720は、必要に応じて他の層をさらに含むこともできる。
このような構成によって、本発明の一実施例による有機発光表示装置101は、効果的に不純物がドーピングされた多結晶シリコン膜をキャパシタ80の電極として使用することができる。
具体的に、本発明の一実施例によれば、不純物が第1キャパシタ電極138上に配置された第2キャパシタ電極158を通過することができるので、第1キャパシタ電極138は、不純物がドーピングされた多結晶シリコン膜で容易に形成される。つまり、半導体層135を形成する過程で別途の追加工程なく容易に第1キャパシタ電極138を形成することができる。
それによって、有機発光表示装置101の全体的な製造過程を効率的に簡素化させることができる。
以下、図4乃至図13を参照して、本発明の一実施例による有機発光表示装置101の製造方法を説明する。
まず、図4に示したように、基板本体111上にバッファー層120を形成する。バッファー層120は、窒化ケイ素(SiN)及び酸化ケイ素(SiO)などの無機絶縁物質がPECVD(Plasma Enhanced Chemical‐Vapor‐Depositionition)などの公知の蒸着方法で基板本体111上に全面蒸着されて形成される。
次に、バッファー層120上に多結晶シリコン膜を形成する。多結晶シリコン膜は、まず非晶質シリコン膜を形成して、これを結晶化させる方法で形成することができる。非晶質シリコン膜は、PECVDなどの公知の方法で形成される。また、非晶質シリコン膜を結晶化させる方法としては、当該技術分野の当業者に公知の多様な方法を使用することができる。例えば、非晶質シリコン層は、熱、レーザー、ジュール熱、電場、または触媒金属などを利用して結晶化させることができる。また、結晶化工程以前に非晶質シリコン膜内に存在する水素原子を除去するための脱水素化(dehydrogenation)工程をさらに行うこともできる。
次に、多結晶シリコン膜を写真エッチング工程によってパターニング(patterning)して半導体層中間体1305及び第1キャパシタ電極中間体1308を形成する。
次に、図5に示したように、半導体層中間体1305及び第1キャパシタ電極中間体1308上にゲート絶縁膜140を形成する。
本発明の一実施例で、ゲート絶縁膜140は、厚さが40nmの窒化シリコン膜及びその上に厚さが80nmのテトラエトキシシラン(TEOS)膜を含む。そして、前記無機膜は、PECVDなどの公知の方法で形成される。
次に、ゲート絶縁膜140上にゲート金属膜1500を形成する。ゲート金属膜1500は、モリブデン(Mo)、クロム(Cr)、及びタングステン(W)のうちの一つ以上を含む。本発明の一実施例では、一例としてゲート金属膜1500をモリブデン(Mo)で形成した。
また、ゲート金属膜1500は、スパッタリングなどの公知の方法で形成される。
次に、図6に示したように、ゲート金属膜1500上に感光物質をコーティングして感光膜800を形成する。この時、感光膜800は、一例として厚さが約1000nm乃至2000nmの範囲内に属する。
次に、第1マスク901を使用して感光膜800を1次露光する。ここで、第1マスク901は、ベース基板910、及びベース基板910に形成された遮蔽部921、922を含む。そして、遮蔽部は、ゲート電極155(図3に図示)が形成される位置が露光されるのを遮断するゲート遮蔽部921、及び第2キャパシタ電極158(図3に図示)が形成される位置が露光されるのを遮断するキャパシタ遮蔽部922を含む。
次に、図7に示したように、第2マスク902を使用して感光膜800を2次露光する。ここで、第2マスク902は、ゲート電極155(図3に図示)が形成される位置が露光されるのを遮断するゲート遮蔽部921を含み、第1マスク901のようなキャパシタ遮蔽部922は含まない。
次に、図8に示したように、感光膜800を現像して感光膜パターン810を形成する。感光膜パターン810は、ゲート電極155(図3に図示)が形成される位置上に配置された第1部分811、及び第1部分811より相対的に厚さが薄い第2キャパシタ電極158(図3に図示)が形成される位置上に配置された第2部分812、そしてゲート金属膜1500を露出する第3部分を含む。つまり、第3部分には感光膜800が実質的に存在しない。
次に、図9に示したように、感光膜パターン810を使用したエッチング工程によってゲート金属膜1500をエッチングしてゲート電極155及び第2キャパシタ電極中間体1508を形成する。
次に、図10に示したように、感光膜パターン810の第2部分812を除去する。この時、感光膜パターン810の第1部分811も第2部分812の除去された厚さ程度が除去されて薄くなる。
次に、図11に示したように、第2部分812が除去された感光膜パターン810を使用して第2キャパシタ電極中間体1508の一部をエッチングする。第2キャパシタ電極中間体1508は、一部がエッチングされてゲート電極155より相対的に厚さが薄い第2キャパシタ電極158になる。ここで、第2キャパシタ電極158は厚さ(t2)が10nm乃至140nmの範囲内に属し、ゲート電極155は厚さ(t1)が170nm以上である。第2キャパシタ電極158は厚さ(t2)がゲート電極155の厚さ(t1)のほぼ75%以下である。
次に、図12に示したように、半導体層中間体1305及び第1キャパシタ電極中間体1308に不純物をドーピングして半導体層135及び第1キャパシタ電極138を形成する。この過程で、ゲート電極155は、半導体層135のソース領域1357及びドレイン領域1356に不純物をドーピングする時にチャンネル領域1355に不純物がドーピングされるのを遮断する役割を果たす。したがって、ゲート電極155は、チャンネル領域1355に不純物がドーピングされるのを安定的に遮断するために、厚さが170nm以上である。
このように、半導体層中間体1305に不純物がドーピングされると、ゲート電極155と重畳したチャンネル領域1355、そしてチャンネル領域1355の両側に形成されたソース領域1357及びドレイン領域1356に区分される半導体層135が形成される。つまり、チャンネル領域1355は真性半導体になり、ソース領域1357及びドレイン領域1356は不純物半導体になる。
また、第1キャパシタ電極138は、半導体層135のソース領域1357及びドレイン領域1356と実質的に同一に形成される。ただし、第1キャパシタ電極中間体1308にドーピングされる不純物は、第2キャパシタ電極158を通過して第1キャパシタ電極中間体1308にドーピングされる。したがって、第2キャパシタ電極158の厚さが厚すぎると、不純物が第2キャパシタ電極158を通過することができず、第1キャパシタ電極138が適切な導電性を確保することができずに不良になる。また、第2キャパシタ電極158の厚さが薄すぎると、第2キャパシタ電極158の電気的特性が低下して、キャパシタ80が不良になる。このような問題点を考慮して、第2キャパシタ電極158は、厚さが10nm乃至140nmの範囲内に属するのが効果的である。
また、不純物は、P型不純物及びN型不純物のうちのいずれか一つである。不純物の種類は薄膜トランジスター20の種類によって決定される。本発明の一実施例で、不純物はホウ素などのP型不純物である。具体的に、不純物はBであり、第1キャパシタ電極138にはホウ素イオンがドーピングされる。
また、不純物は、80keV以上のエネルギー及び1.0e15atoms/cm以上のドーズ(dose)量で第1キャパシタ電極138にイオン注入される。これは、不純物が第2キャパシタ電極158を通過して第1キャパシタ電極138に効果的にドーピングされるように設定された条件である。
このような方法で、第1キャパシタ電極138、及びゲート絶縁膜140を間において第1キャパシタ電極138上に形成された第2キャパシタ電極158を含むキャパシタ80が完成される。特に、半導体層135を形成する過程で別途の追加工程なく容易に第1キャパシタ電極138を形成することができる。したがって、有機発光表示装置101の全体的な製造過程を非常に効率的に簡素化させることができる。
次に、図13に示したように、ゲート電極155上の感光膜パターン810を全て除去した後、ゲート電極155及び第2キャパシタ電極158上に層間絶縁膜160を形成する。ここで、ゲート電極155上の感光膜パターン810は、不純物をドーピングする工程以前に除去してもよい。
層間絶縁膜160は、ゲート絶縁膜140と同様にテトラエトキシシラン(tetra ethyl ortho silicate、TEOS)、窒化ケイ素(SiN)、または酸化ケイ素(SiO)などを含み、PECVDなどの公知の方法によって形成される。
次に、写真エッチング工程によって層間絶縁膜160及びゲート絶縁膜140を共にエッチングして半導体層135のソース領域1357及びドレイン領域1356の一部を各々露出するソース接触孔167及びドレイン接触孔166を形成する。
次に、層間絶縁膜160上にソース電極177及びドレイン電極176を形成する。この時、ソース電極177及びドレイン電極176は、各々ソース接触孔167及びドレイン接触孔166を通じて半導体層135のソース領域1357及びドレイン領域1356と接触する。
次に、前記図3に示したように、ソース電極177及びドレイン電極176上に平坦化膜180を形成する。この時、平坦化膜180は、ドレイン電極176を露出するアノード接触孔186を有する。
次に、平坦化膜180上に画素電極710を形成する。画素電極710は、アノード接触孔186を通じてドレイン電極176と接触する。
しかし、本発明の一実施例が前述したものに限定されるのではない。したがって、平坦化膜180は省略されてもよい。このように平坦化膜180が省略される場合、ドレイン電極176が直接画素電極710になる。
次に、平坦化膜180上に画素定義膜190を形成する。この時、画素定義膜190は、画素電極710を露出する開口部195を有する。そして、画素定義膜190の開口部195内に有機発光層720を形成し、再びその上に共通電極730を形成して、有機発光素子70を完成する。
以上のような製造方法によって本発明の一実施例による有機発光表示装置101を製造することができる。つまり、本発明の一実施例によれば、有機発光表示装置101の製造方法を効率的に単純化させることができる。
以下、図14乃至図17を参照して、本発明の一実施例による実験例及び比較例を見てみる。図14乃至図17は、実験例及び比較例のCV特性を各々示したグラフである。
実験は、第2キャパシタ電極158の厚さを変化させながら不純物をドーピングして第1キャパシタ電極138を形成する方法で行った。モリブデン(Mo)を使用して第2キャパシタ電極158を形成し、Bを不純物として使用した。また、不純物を85keV以上のエネルギー及び3.0e15 atoms/cm以上のドーズ(dose)量でイオン注入した。
図14は比較例によるCV特性を示したグラフである。比較例は、厚さが170nmの第2キャパシタ電極158を含む。図14に示されているように、比較例の場合、キャパシタ80が正常に作動できないことが分かった。
図15は実験例1によるCV特性を示したグラフである。実験例1は、厚さが130nmの第2キャパシタ電極158を含む。図15に示されているように、実験例1の場合、キャパシタ80が作動できることが分かった。しかし、実験例1の場合、電圧が増加するのに伴って静電容量が減少する傾向があることが分かった。
図16は実験例2によるCV特性を示したグラフである。実験例2は、厚さが100nmの第2キャパシタ電極158を含む。図16に示されているように、実験例2の場合、キャパシタ80が全電圧区間で問題なく正常に作動できることが分かった。
図17は実験例3によるCV特性を示したグラフである。実験例3は、厚さが30nmの第2キャパシタ電極158を含む。図17に示されているように、実験例3の場合、キャパシタ80が全電圧区間で問題なく正常に作動できることが分かった。
以上の実験から、第2キャパシタ電極158の厚さが140nm以下であれば、第1キャパシタ電極138に不純物がドーピングされて、キャパシタ80が作動できることが分かった。特に、第2キャパシタ電極158の厚さが100nm以下である場合に、キャパシタ80が全電圧区間で静電容量の減少なく安定的に作動できることが分かった。
本発明を前記に記載した内容で好ましい実施例を通して説明したが、本発明はこれに限定されず、特許請求の範囲の概念及び範囲を逸脱しない限り、多様な修正及び変形が可能であるということを、本発明が属する技術分野の当業者は簡単に理解することができる。
10、20 薄膜トランジスター
70 有機発光素子
80 キャパシタ
101 有機発光表示装置
111 基板本体
120 バッファー層
135 半導体層
138 第1キャパシタ電極
140 ゲート絶縁膜
155 ゲート電極
158 第2キャパシタ電極
160 層間絶縁膜
166 ドレイン電極孔
167 ソース接触孔
176 ドレイン電極
177 ソース電極
180 平坦化膜
186 アノード接触孔
190 画素定義膜
195 開口部
710 画素電極
720 有機発光層
730 共通電極
800 感光膜
810 感光膜パターン
901 第1マスク
902 第2マスク
910 ベース基板
921、922 遮蔽部
1305 半導体層中間体
1308 第1キャパシタ電極中間体
1355 チャンネル領域
1356 ドレイン領域
1357 ソース領域
1500 ゲート金属膜
GL ゲートライン
DL データライン
VDD 共通電源ライン
CL キャパシタライン
DA 表示領域
NA 非表示領域
PE 画素
GD、DD 駆動回路

Claims (24)

  1. 基板本体;
    前記基板本体上の同一層に形成された半導体層及び第1キャパシタ電極;
    前記半導体層及び前記第1キャパシタ電極上に形成されたゲート絶縁膜;
    前記ゲート絶縁膜を間において前記半導体層上に形成されたゲート電極;そして
    前記ゲート絶縁膜を間において前記第1キャパシタ電極上に形成されて、前記ゲート電極と同一層に形成された第2キャパシタ電極;を含み、
    前記第1キャパシタ電極及び前記半導体層は、各々不純物がドーピングされた多結晶シリコン膜を含み、前記第2キャパシタ電極は前記ゲート電極より相対的に厚さが薄い、有機発光表示装置。
  2. 前記ゲート電極及び前記第2キャパシタ電極は、互いに同一な金属物質を含み、前記金属物質は、モリブデン、クロム、及びタングステンのうちの一つ以上を含む、請求項1に記載の有機発光表示装置。
  3. 前記ゲート電極は厚さが170nm以上であり、前記第2キャパシタ電極は厚さが前記ゲート電極の厚さの75%以下である、請求項2に記載の有機発光表示装置。
  4. 前記第1キャパシタ電極及び前記半導体層に各々ドーピングされた不純物は、P型不純物及びN型不純物のうちのいずれか一つである、請求項2に記載の有機発光表示装置。
  5. 前記不純物はホウ素を含む、請求項4に記載の有機発光表示装置。
  6. 前記ゲート絶縁膜は、テトラエトキシシラン、窒化ケイ素、及び酸化ケイ素のうちの一つ以上を含む、請求項2に記載の有機発光表示装置。
  7. 前記半導体層は、前記ゲート電極と重畳したチャンネル領域、そして前記チャンネル領域の両側に形成されたソース領域及びドレイン領域に区分される、請求項2に記載の有機発光表示装置。
  8. 前記半導体層の前記チャンネル領域は真性半導体であり、前記半導体層の前記ソース領域及び前記ドレイン領域、そして前記第1キャパシタ電極は不純物半導体である、請求項7に記載の有機発光表示装置。
  9. 前記第2キャパシタ電極は厚さが10nm乃至140nmの範囲内に属する、請求項1乃至8のいずれか一項に記載の有機発光表示装置。
  10. 基板本体上に多結晶シリコン膜を形成する段階;
    前記多結晶シリコン膜をパターニングして半導体層中間体及び第1キャパシタ電極中間体を形成する段階;
    前記半導体層中間体及び前記第1キャパシタ電極中間体上にゲート絶縁膜を形成する段階;
    前記ゲート絶縁膜上に前記半導体層中間体の一部と重畳するようにゲート電極を形成し、前記第1キャパシタ電極中間体と重畳するように第2キャパシタ電極を形成する段階;そして
    前記半導体層中間体及び前記第1キャパシタ電極中間体に不純物をドーピングして半導体層及び第1キャパシタ電極を形成する段階;を含み、
    前記第2キャパシタ電極は前記ゲート電極より相対的に厚さが薄く、前記不純物は前記第2キャパシタ電極を透過して前記第1キャパシタ電極にドーピングされる、有機発光表示装置の製造方法。
  11. 前記ゲート電極及び前記第2キャパシタ電極は、互いに同一な金属物質を含み、前記金属物質は、モリブデン、クロム、及びタングステンのうちの一つ以上を含む、請求項10に記載の有機発光表示装置の製造方法。
  12. 前記ゲート電極は厚さが170nm以上であり、前記第2キャパシタ電極は厚さが前記ゲート電極の厚さの75%以下である、請求項11に記載の有機発光表示装置の製造方法。
  13. 前記第2キャパシタ電極は厚さが10nm乃至140nmの範囲内に属する、請求項12に記載の有機発光表示装置の製造方法。
  14. 前記不純物は、P型不純物及びN型不純物のうちのいずれか一つである、請求項13に記載の有機発光表示装置の製造方法。
  15. 前記不純物はホウ素を含む、請求項14に記載の有機発光表示装置の製造方法。
  16. 前記不純物は、80keV以上のエネルギー及び1.0e15atoms/cm以上のドーズ量でイオン注入される、請求項14に記載の有機発光表示装置の製造方法。
  17. 前記ゲート絶縁膜は、テトラエトキシシラン、窒化ケイ素、及び酸化ケイ素のうちの一つ以上を含む、請求項12に記載の有機発光表示装置の製造方法。
  18. 前記半導体層は、前記ゲート電極と重畳したチャンネル領域、そして前記チャンネル領域の両側に形成されたソース領域及びドレイン領域に区分される、請求項12に記載の有機発光表示装置の製造方法。
  19. 前記半導体層の前記チャンネル領域は真性半導体であり、前記半導体層の前記ソース領域及び前記ドレイン領域、そして前記第1キャパシタ電極は不純物半導体である、請求項18に記載の有機発光表示装置の製造方法。
  20. 前記ゲート電極及び前記第2キャパシタ電極は、前記ゲート絶縁膜上にゲート金属膜を形成した後、前記ゲート金属膜を感光膜パターンを利用した写真エッチング工程によってパターニングして形成され、
    前記感光膜パターンは、前記ゲート電極上に位置する第1部分、及び前記第1部分より相対的に厚さが薄い前記第2キャパシタ電極上に位置する第2部分を含む、請求項10乃至19のいずれか一項に記載の有機発光表示装置の製造方法。
  21. 前記感光膜パターンによって前記ゲート金属膜をエッチングして前記ゲート電極及び第2キャパシタ電極中間体を形成した後、前記感光膜パターンの第2部分を除去し、再び前記第2キャパシタ電極中間体の一部をエッチングして前記キャパシタ電極を形成する、請求項20に記載の有機発光表示装置の製造方法。
  22. 前記感光膜パターンは、前記ゲート金属膜上に感光膜を形成し、第1マスクを使用して前記感光膜を1次露光させ、第2マスクを使用して前記感光膜を2次露光させた後、前記感光膜を現像して形成される、請求項20に記載の有機発光表示装置の製造方法。
  23. 前記第1マスクは、前記ゲート電極が形成される位置が露光されるのを遮断するゲート遮蔽部、及び前記第2キャパシタ電極が形成される位置が露光されるのを遮断するキャパシタ遮蔽部を含む、請求項22に記載の有機発光表示装置の製造方法。
  24. 前記第2マスクは、前記ゲート電極が形成される位置が露光されるのを遮断するゲート遮蔽部を含む、請求項22に記載の有機発光表示装置の製造方法。
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KR20130024029A (ko) 2011-08-30 2013-03-08 삼성디스플레이 주식회사 유기 발광 표시 장치 및 그 제조 방법
KR20130025717A (ko) * 2011-09-02 2013-03-12 삼성디스플레이 주식회사 유기 발광 표시 장치 및 유기 발광 표시 장치 제조 방법
KR20130063077A (ko) * 2011-12-06 2013-06-14 삼성디스플레이 주식회사 유기발광소자 및 그의 제조방법
KR102015986B1 (ko) 2012-01-06 2019-08-30 삼성디스플레이 주식회사 유기발광 표시장치
KR102143924B1 (ko) * 2013-07-12 2020-08-13 삼성디스플레이 주식회사 유기 발광 표시 장치
US10008513B2 (en) * 2013-09-05 2018-06-26 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device
KR20160013341A (ko) 2014-07-24 2016-02-04 삼성디스플레이 주식회사 표시장치 및 표시장치 제조방법
KR102369300B1 (ko) * 2015-02-24 2022-03-03 삼성디스플레이 주식회사 유기 발광 표시 장치 및 그 제조 방법
KR20170126054A (ko) * 2016-05-04 2017-11-16 삼성디스플레이 주식회사 표시 장치 및 그 제조 방법
KR101859484B1 (ko) * 2016-05-30 2018-05-21 엘지디스플레이 주식회사 표시 장치 및 그 제조 방법
KR102716398B1 (ko) * 2016-06-17 2024-10-11 삼성디스플레이 주식회사 유기 발광 표시 장치 및 유기 발광 표시 장치의 제조 방법
CN107680974B (zh) * 2017-09-21 2020-12-29 武汉华星光电半导体显示技术有限公司 一种显示面板和显示装置
CN110752245A (zh) * 2019-11-01 2020-02-04 京东方科技集团股份有限公司 一种显示面板和显示面板的制备方法
KR102811475B1 (ko) * 2020-04-22 2025-05-22 삼성디스플레이 주식회사 표시 장치
TWI807739B (zh) * 2022-03-30 2023-07-01 友達光電股份有限公司 顯示面板及其製造方法

Family Cites Families (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100195253B1 (ko) 1996-10-24 1999-06-15 윤종용 다결정실리콘-박막트랜지스터의 제조방법
JP5090658B2 (ja) * 2006-04-06 2012-12-05 三菱電機株式会社 薄膜トランジスタ、及びその製造方法、並びにアクティブマトリクス型表示装置
JP5090708B2 (ja) 2006-10-20 2012-12-05 株式会社ジャパンディスプレイイースト 画像表示装置とその製造方法
KR100847661B1 (ko) * 2007-03-21 2008-07-21 삼성에스디아이 주식회사 반도체 장치의 제조 방법
KR100958640B1 (ko) * 2008-06-09 2010-05-20 삼성모바일디스플레이주식회사 커패시터와 박막 트랜지스터를 갖는 기판, 이를 구비한평판 디스플레이 장치 및 상기 커패시터와 박막트랜지스터를 갖는 기판의 제조방법

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